JPS5856026A - 表示装置 - Google Patents
表示装置Info
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- JPS5856026A JPS5856026A JP15558681A JP15558681A JPS5856026A JP S5856026 A JPS5856026 A JP S5856026A JP 15558681 A JP15558681 A JP 15558681A JP 15558681 A JP15558681 A JP 15558681A JP S5856026 A JPS5856026 A JP S5856026A
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- Japan
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- memory
- display
- counter
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- Pending
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- Digital Computer Display Output (AREA)
- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は複数桁の文字または数字の表示ケ行なわせゐ機
器の表示装置に関する。
器の表示装置に関する。
一般に複数桁の文字または数字の表示装置は計測、演算
２時計等の機能？有する機器に用いらｎｌその制御ハマ
イクロコンピューター等の演算側（財）回路により集中
的に行なわｆている。
２時計等の機能？有する機器に用いらｎｌその制御ハマ
イクロコンピューター等の演算側（財）回路により集中
的に行なわｆている。
第１図は一般的に用いらｎているマイクロコンビュータ
ケ用いて７セグメントの表示素子ケ点灯させゐ回路の一
例である。以下図に従って説明すめと、表示１ｉ’？ｌ
路は表示素子１．デマルチプレクサ２、ドライバー回路
３．アドレスランチｌｒ’ｌ路４゜データラッチ回路６
より構成さｎ、前記表示回路および計測、計時等の本来
機能回路の制（財）および演算は全てマイクロコンピュ
ータ回路６によって行なわｔｌ、る。
ケ用いて７セグメントの表示素子ケ点灯させゐ回路の一
例である。以下図に従って説明すめと、表示１ｉ’？ｌ
路は表示素子１．デマルチプレクサ２、ドライバー回路
３．アドレスランチｌｒ’ｌ路４゜データラッチ回路６
より構成さｎ、前記表示回路および計測、計時等の本来
機能回路の制（財）および演算は全てマイクロコンピュ
ータ回路６によって行なわｔｌ、る。
前記構成において表示桁数２Ｎと丁ゐと、次のステップ
で動作子ゐ。
で動作子ゐ。
（１） マイクロコンピュータ−１１１路６よりアド
レスラッチ回路４に桁指定のデータ孕、データラッチ回
路６に選択術の表示データー？コードの形式で書込み、
そｆぞｔ、デマルチプレクサ２とドライバー回路３に出
力する。
レスラッチ回路４に桁指定のデータ孕、データラッチ回
路６に選択術の表示データー？コードの形式で書込み、
そｆぞｔ、デマルチプレクサ２とドライバー回路３に出
力する。
（２）デマルチプレクサ２で入力コードに応じて表示素
子１のｎ桁目ｒ選択し、データーラッチ回路６よりドラ
イバー回路３ケ介して選択権の表示データーケ表示素子
１に出力し、選択桁ケ点灯させる。
子１のｎ桁目ｒ選択し、データーラッチ回路６よりドラ
イバー回路３ケ介して選択権の表示データーケ表示素子
１に出力し、選択桁ケ点灯させる。
（３）マイクロコンビコータ回路６で他の本来機能回路
７２制陣するとともに四部で演算ケ行なう。
７２制陣するとともに四部で演算ケ行なう。
（４）桁選択の７ドレスコ一ド２順次一定周期変化させ
、各桁２１１１次点灯させる。
、各桁２１１１次点灯させる。
（６）前記（１）〜（６）ケ繰り返すことにより表示素
子１ケダイナミノク点灯させる。
子１ケダイナミノク点灯させる。
このような回路は回路構成が簡単なので、広く用いらｎ
ているが、反面表示中は常に−・足周期でマイクロコン
ピュータ回路６により桁ケスキャンさせ、なおかつ表示
データの書替え７行なわねばナラス、マイクロコンピュ
ータ−の動作の中で表示Ｎ路の駆動の占める割合が、メ
モリー容量と時間の配分のヒで大さくなり、本来機能回
路７に複卸な機能ケ持たせる場合には、表示回路は簡単
な回路構成となっても機器全体の回路構成及びプログラ
ムが複雑になゐ。
ているが、反面表示中は常に−・足周期でマイクロコン
ピュータ回路６により桁ケスキャンさせ、なおかつ表示
データの書替え７行なわねばナラス、マイクロコンピュ
ータ−の動作の中で表示Ｎ路の駆動の占める割合が、メ
モリー容量と時間の配分のヒで大さくなり、本来機能回
路７に複卸な機能ケ持たせる場合には、表示回路は簡単
な回路構成となっても機器全体の回路構成及びプログラ
ムが複雑になゐ。
前記のエリな、本来機能が複雑な機器における欠点ケ解
消するために、第２図のようにデーターセレクタ２２と
表示する各桁の内容ケ全て一記憶できるメモリ２０ケ有
し、通常はカウンタ２１のカウント出力でデータセレク
ター２２ケ介してメモリー２０のアドレスケスキャンさ
せ同時にメモリー２０内の前記アドレスに記憶さｎてい
る表示データケドライバー２０ｉ介して表示素子１７（
出力することにエリ表示素子２０を点灯させ、メモリー
への書込み時には、マイクロコンピューター工りデータ
ーセレクタ−２２を介してメモリー２７のアドレスケ選
択してデータケ書込むという表示回路ケ構成することに
エリ、表示内容の書き替工時しかマイクロコン（ニータ
ーが関与しない回路構成とすることにより、マイクロコ
ンピュータ−の負担ケ軽くする回路がある。しかしなが
らこの構成でに回路構成が複雑となる。
消するために、第２図のようにデーターセレクタ２２と
表示する各桁の内容ケ全て一記憶できるメモリ２０ケ有
し、通常はカウンタ２１のカウント出力でデータセレク
ター２２ケ介してメモリー２０のアドレスケスキャンさ
せ同時にメモリー２０内の前記アドレスに記憶さｎてい
る表示データケドライバー２０ｉ介して表示素子１７（
出力することにエリ表示素子２０を点灯させ、メモリー
への書込み時には、マイクロコンピューター工りデータ
ーセレクタ−２２を介してメモリー２７のアドレスケ選
択してデータケ書込むという表示回路ケ構成することに
エリ、表示内容の書き替工時しかマイクロコン（ニータ
ーが関与しない回路構成とすることにより、マイクロコ
ンピュータ−の負担ケ軽くする回路がある。しかしなが
らこの構成でに回路構成が複雑となる。
不発明は第２図の回路構成ケさらに簡略化し、従来の回
路に比べて部品点数の削減及びコストタ゛ウン勿計るこ
とケ目的とし、その目的を達成する基本的構成は表示素
子と、クロックパルスケカウントし、カウント出カケ任
意の時に任意のコードに設定できるカウンターと、入出
力の独立した表示データーメモリーケ有し、前記カウン
ターのカウント出カケ前記メモリーのアドレス入力に接
続し、メモリー書き込み時にはカウント出カケ任意のア
ドレスコードに設定することにより前記メモリーのアド
レスへのデータ書込みケ行ない、表示動作時には前記カ
ウンターのカウント動作によりカウント出カケ変化させ
、表示の桁位置會スキン丁ゐとともに前記コードに対応
したアドレス内容ケ前記メモリーエリ読み出し、前記表
示素子に出力子ゐことにより前記表示素子ケダイナミッ
ク点灯させるように構成したものである。以下本発明の
一実施例ケ第３図〜第４図に従って説明する。
路に比べて部品点数の削減及びコストタ゛ウン勿計るこ
とケ目的とし、その目的を達成する基本的構成は表示素
子と、クロックパルスケカウントし、カウント出カケ任
意の時に任意のコードに設定できるカウンターと、入出
力の独立した表示データーメモリーケ有し、前記カウン
ターのカウント出カケ前記メモリーのアドレス入力に接
続し、メモリー書き込み時にはカウント出カケ任意のア
ドレスコードに設定することにより前記メモリーのアド
レスへのデータ書込みケ行ない、表示動作時には前記カ
ウンターのカウント動作によりカウント出カケ変化させ
、表示の桁位置會スキン丁ゐとともに前記コードに対応
したアドレス内容ケ前記メモリーエリ読み出し、前記表
示素子に出力子ゐことにより前記表示素子ケダイナミッ
ク点灯させるように構成したものである。以下本発明の
一実施例ケ第３図〜第４図に従って説明する。
第４図は第３図の７セグメント表示板３６勿ダイナミッ
ク点灯さ＋！：／ｂ場合の例であり、表示素子３７と、
こｎｋ働かせるためのデマルチプレクサ３８およびドラ
イバー３９と、メモリー４０と、発振回路４１と、シリ
セット付カウンター４２と、マイクロコンピュータ４３
および本来機能回路６３エリなり、その通常の表示動作
時の動作ステップは、 （１）発振回路４１１す出力さｎるクロックパルス４８
ケブリセント付カウンター４２でカウントする。
ク点灯さ＋！：／ｂ場合の例であり、表示素子３７と、
こｎｋ働かせるためのデマルチプレクサ３８およびドラ
イバー３９と、メモリー４０と、発振回路４１と、シリ
セット付カウンター４２と、マイクロコンピュータ４３
および本来機能回路６３エリなり、その通常の表示動作
時の動作ステップは、 （１）発振回路４１１す出力さｎるクロックパルス４８
ケブリセント付カウンター４２でカウントする。
（２）カウンタ出力４６ケデマルチプレクサ３日へ入力
することによジ、カウンタ出力４６のコードに応じて、
表示桁選択信号４４のうちの１信号のみケアクチイブに
することにエリ表示素子３７の表示桁ケ選択する。
することによジ、カウンタ出力４６のコードに応じて、
表示桁選択信号４４のうちの１信号のみケアクチイブに
することにエリ表示素子３７の表示桁ケ選択する。
（３）メモリー４０エリカウント出力４６のコードのア
ドレスケ選択し、そのアドレス内に記憶さ７しているデ
ータケドライバー３９ケ介して表示素子へ出力子ゐこと
にエリ、光示素子３７の表示桁選択信号にエリ選択さｎ
た桁を点灯する。
ドレスケ選択し、そのアドレス内に記憶さ７しているデ
ータケドライバー３９ケ介して表示素子へ出力子ゐこと
にエリ、光示素子３７の表示桁選択信号にエリ選択さｎ
た桁を点灯する。
（４）前記（１）〜（３）ケクロノクパルス４８の出力
の度に繰り返す。
の度に繰り返す。
壕だ表示内容書替え時には
（１） プリセット信号５ｏによりプリセント付カウ
ンタ４２ケプリセノトモードとし、前記の（１）〜（４
）の表示動作ケ中断する。
ンタ４２ケプリセノトモードとし、前記の（１）〜（４
）の表示動作ケ中断する。
（２） マイクロコンピュータより書き替えるメモリ
のアドレスケアドレス信号４９として出力する−（３）
プリセット付カウンタ４２に工′す、カウント、出
力４６のコードケアドレス信号４９と同じコードに設定
子ゐ。
のアドレスケアドレス信号４９として出力する−（３）
プリセット付カウンタ４２に工′す、カウント、出
力４６のコードケアドレス信号４９と同じコードに設定
子ゐ。
（４） マイクロコンピュータより変更桁の表示データ
ケメモリー４０に出力し、メモリー書き込み信号５２に
エリアドレス信号４９のアドレスに対応したアドレスの
データケ書き替える。
ケメモリー４０に出力し、メモリー書き込み信号５２に
エリアドレス信号４９のアドレスに対応したアドレスの
データケ書き替える。
（６） プリセット信号６０（／ｒよりプリセット付
カウンタ４２ケカウントモードにもどし、設定さｎたカ
ウント出力のコードに対応した桁力・ら表示ケ再開丁ゐ
っ 以−トのように第２図と同じ機能ケさらに簡単に行なえ
、ＩＣ等の部品点数の削減とコストダウンが；ｔｉｔゐ
ために、実用。ヒ有用なものといえる。
カウンタ４２ケカウントモードにもどし、設定さｎたカ
ウント出力のコードに対応した桁力・ら表示ケ再開丁ゐ
っ 以−トのように第２図と同じ機能ケさらに簡単に行なえ
、ＩＣ等の部品点数の削減とコストダウンが；ｔｉｔゐ
ために、実用。ヒ有用なものといえる。
第１図、第２図は従来の実施例構成図、第３図は７セグ
メント表示板の外観図、第４図に本発明の実施例構成図
である。 ３７・・・・・・表示素子、３８・・・・・・デマルチ
プレクサ、３９・・・・・・ドライバー、４３・・・・
・・マイクロコンピュータ、６３・・・・・・本来機能
回路、４６・・・・・・表示データドライブ信号、４９
・・・・・・アドレス信号、６１・・・・・・データ信
号、４０・・・・・・メモリー、４１・・・・・・発振
回路、４６・・・・・・カウンター出力、４７・・・・
・・メモリー出力、４８・・・・・・クロックパルス、
６２・・・・・・メモリー書き込み信号、６０・・・・
・・プリセット信号。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名ＪＲ
Ｉ図 ９２図 第３図 護
メント表示板の外観図、第４図に本発明の実施例構成図
である。 ３７・・・・・・表示素子、３８・・・・・・デマルチ
プレクサ、３９・・・・・・ドライバー、４３・・・・
・・マイクロコンピュータ、６３・・・・・・本来機能
回路、４６・・・・・・表示データドライブ信号、４９
・・・・・・アドレス信号、６１・・・・・・データ信
号、４０・・・・・・メモリー、４１・・・・・・発振
回路、４６・・・・・・カウンター出力、４７・・・・
・・メモリー出力、４８・・・・・・クロックパルス、
６２・・・・・・メモリー書き込み信号、６０・・・・
・・プリセット信号。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名ＪＲ
Ｉ図 ９２図 第３図 護
Claims (1)
- 表示素子と、クロックパルスケカウントし、カウント出
カケ任意の時に任意のコードに設定できるカウンターと
、入出力の独立した表示データーメモリーケ有し、前記
カウンターのカウント出カケ前記メモリーのアドレス入
力に接続し、メモリー書き込み時にはカウント出カケ任
意のアドレスコードに設定することにエリ前記メモリー
のアドレスへのデーター書込みケ行ない、表示動作時に
に前記カウンターのカウント動作によりカウント出カケ
変化させ、表示の桁位置ケスキャンするとともに、前記
コードに対応したアドレス内容ケ前記メモリーエリ読み
出し、前記表示素子に出力することにより、前記表示素
子ケグイナミソク点灯させることを特徴とする表示装置
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15558681A JPS5856026A (ja) | 1981-09-29 | 1981-09-29 | 表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15558681A JPS5856026A (ja) | 1981-09-29 | 1981-09-29 | 表示装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5856026A true JPS5856026A (ja) | 1983-04-02 |
Family
ID=15609274
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15558681A Pending JPS5856026A (ja) | 1981-09-29 | 1981-09-29 | 表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5856026A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61167696U (ja) * | 1985-04-04 | 1986-10-17 |
-
1981
- 1981-09-29 JP JP15558681A patent/JPS5856026A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61167696U (ja) * | 1985-04-04 | 1986-10-17 |
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