JPS5837229U - 論理回路 - Google Patents
論理回路Info
- Publication number
- JPS5837229U JPS5837229U JP13009381U JP13009381U JPS5837229U JP S5837229 U JPS5837229 U JP S5837229U JP 13009381 U JP13009381 U JP 13009381U JP 13009381 U JP13009381 U JP 13009381U JP S5837229 U JPS5837229 U JP S5837229U
- Authority
- JP
- Japan
- Prior art keywords
- flop
- flip
- signal
- inhibit
- input
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図は従来例、第２図はそれを説明するための信号波
形、第３図は本考案の一実施例、第４図はそれを説明す
るための信号波形、第５図は本考案の他の実施例である
。 ６１〜Ｇ７・・・ゲート。
形、第３図は本考案の一実施例、第４図はそれを説明す
るための信号波形、第５図は本考案の他の実施例である
。 ６１〜Ｇ７・・・ゲート。
Claims (1)
- 第１のフリップ・フロップと、該第１の７リツプ・フロ
ップの入力側に於いて、該第１のフリップ・７０ツブを
セット及びリセットする入力信号を入力する入力端子と
、該入力信号が変化しても゛前記第１のフリップ・フロ
ップの状態を保持するように該入力信号を禁止する禁止
信号を入力する入力端子と、該禁止動作をする禁止ゲー
トと、前記第１のフリップ・フロップと同−論理構成さ
れた第２のフリップ・フロップとを有し、前記セット及
びリセット入力信号と、前記禁止信号の変化点で第１の
フリップ・フロップが第２のフリップ・フロップの状態
を保持する信号を出力することを利用して安定に動作さ
せるようにしたことを特徴とする論理回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13009381U JPS5837229U (ja) | 1981-09-01 | 1981-09-01 | 論理回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13009381U JPS5837229U (ja) | 1981-09-01 | 1981-09-01 | 論理回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5837229U true JPS5837229U (ja) | 1983-03-10 |
Family
ID=29923742
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP13009381U Pending JPS5837229U (ja) | 1981-09-01 | 1981-09-01 | 論理回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5837229U (ja) |
-
1981
- 1981-09-01 JP JP13009381U patent/JPS5837229U/ja active Pending
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