JPS58196427A - ロ−ドセル秤 - Google Patents
ロ−ドセル秤Info
- Publication number
- JPS58196427A JPS58196427A JP7977382A JP7977382A JPS58196427A JP S58196427 A JPS58196427 A JP S58196427A JP 7977382 A JP7977382 A JP 7977382A JP 7977382 A JP7977382 A JP 7977382A JP S58196427 A JPS58196427 A JP S58196427A
- Authority
- JP
- Japan
- Prior art keywords
- display
- load cell
- outside
- external noise
- flicker prevention
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Classifications
-
- G—PHYSICS
- G01—MEASURING; TESTING
- G01G—WEIGHING
- G01G23/00—Auxiliary devices for weighing apparatus
- G01G23/18—Indicating devices, e.g. for remote indication; Recording devices; Scales, e.g. graduated
- G01G23/36—Indicating the weight by electrical means, e.g. using photoelectric cells
- G01G23/37—Indicating the weight by electrical means, e.g. using photoelectric cells involving digital counting
- G01G23/3707—Indicating the weight by electrical means, e.g. using photoelectric cells involving digital counting using a microprocessor
Landscapes
- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Indicating Measured Values (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、計量内容をデジタル的に表示する表示器を備
えたロードセル秤に関するものである。
えたロードセル秤に関するものである。
従来、デジタル表示器を備えたロードセル秤において、
計量物を受皿上に載せたシ取り去ったシするときに急激
な荷重変化を伴う。そのため、そのままデータ表示を行
なわせると表示器の表示内容も急減に変化し、とくに安
定する直前においては表示内容のチラッキが生じて計量
速度が遅くなるものである。このようなことから、従来
はチラッキ防止プログラムを設定し、チラッキを防止す
るようにしている。
計量物を受皿上に載せたシ取り去ったシするときに急激
な荷重変化を伴う。そのため、そのままデータ表示を行
なわせると表示器の表示内容も急減に変化し、とくに安
定する直前においては表示内容のチラッキが生じて計量
速度が遅くなるものである。このようなことから、従来
はチラッキ防止プログラムを設定し、チラッキを防止す
るようにしている。
このようなチラッキ防止処理は、従来の種々の手段が採
用されているが、その−例をあげるとつぎのとおりであ
る。すなわち、所定周期をもってデータ出力がなされる
が、これらのデータをそのデータが送られて来る毎に最
新のものを含めてＮ個の集団を形づくり、このＮ個中に
同一データがいくつおるかを数え、同一値が最も多いデ
ータで、かつ、最も新しいデータを選んで表示させる。
用されているが、その−例をあげるとつぎのとおりであ
る。すなわち、所定周期をもってデータ出力がなされる
が、これらのデータをそのデータが送られて来る毎に最
新のものを含めてＮ個の集団を形づくり、このＮ個中に
同一データがいくつおるかを数え、同一値が最も多いデ
ータで、かつ、最も新しいデータを選んで表示させる。
そのため、表示すべきデータの変化は緩やかに行なわれ
るとともに安定直前のデータ表示もチラッキが生じるこ
となく急速に安定する。
るとともに安定直前のデータ表示もチラッキが生じるこ
となく急速に安定する。
しかして、通常は計量スピードを早めるために、サンプ
リングする数Ｎが少ない状態とし、チラツキを防止しつ
つ重量表示の遅れをなくしている。
リングする数Ｎが少ない状態とし、チラツキを防止しつ
つ重量表示の遅れをなくしている。
しかしながら、この場合に問題になるのは、外来ノイズ
の影響によシデータが狂う可能性が大きいことである。
の影響によシデータが狂う可能性が大きいことである。
一方、重量光示のチラッキを強く防止するためにサンプ
リン数Ｎを大きく設定して強いチラッキ防止処理をする
こともでき、これによシ、外来ノイズがあっても表示が
変らないようにすることもできるが、このようなものは
計量速度が遅くなると云う欠点を有する。
リン数Ｎを大きく設定して強いチラッキ防止処理をする
こともでき、これによシ、外来ノイズがあっても表示が
変らないようにすることもできるが、このようなものは
計量速度が遅くなると云う欠点を有する。
本発明は、このような点に鑑みなされたもので、外来ノ
イズの有無によシチラツキ防止処理の強さを自動的に切
換え、これにより計量スピードが早く、かつ、重量表示
がちらつかないロードセル秤を得ることを目的とする。
イズの有無によシチラツキ防止処理の強さを自動的に切
換え、これにより計量スピードが早く、かつ、重量表示
がちらつかないロードセル秤を得ることを目的とする。
本発明は、ＣＰＵを含むデータ処理装置において、通常
のチラッキ防止処理と強いチラッキ防止処理との二種の
チラッキ防止プログラムを設定しておき、外来ノイズ検
出回路の信号によシチラツキ防止プログラムの切換えを
行なうようにしたので、外来ノイズのないときには計量
速度が速い状態でのチラッキ防止を行ない、外来ノイズ
のあるときにはその外来ノイズによるチラッキ発生を抑
制するように構成したものである。
のチラッキ防止処理と強いチラッキ防止処理との二種の
チラッキ防止プログラムを設定しておき、外来ノイズ検
出回路の信号によシチラツキ防止プログラムの切換えを
行なうようにしたので、外来ノイズのないときには計量
速度が速い状態でのチラッキ防止を行ない、外来ノイズ
のあるときにはその外来ノイズによるチラッキ発生を抑
制するように構成したものである。
本発明の一実施例を図面に基づいて説明する。
まず、図示しない受皿等が連結されたロードセル（１）
が設けられ、このロードセル（１）には差動増幅器（２
）、周波数濾波器（３）、ＡＤ変換器（４）が順次接続
され、とのＡＤ変換器（４）は”ｏ’ ）（５）に接
続されている。
が設けられ、このロードセル（１）には差動増幅器（２
）、周波数濾波器（３）、ＡＤ変換器（４）が順次接続
され、とのＡＤ変換器（４）は”ｏ’ ）（５）に接
続されている。
また表示及びキーボードコントローラ（６）が設けられ
、この表示及びキーボードコントローラ（６）にはデジ
タル表示を行なう表示器（７）とキーボード（８）とが
接続されている。
、この表示及びキーボードコントローラ（６）にはデジ
タル表示を行なう表示器（７）とキーボード（８）とが
接続されている。
ツイテ、ＣＰＵ （９） トＲＡＭ ＣＬ□ トＲＯＭ
＜ｉｌｌ トにデータ処理装置（６）が設けられてい
る。これらのＣＰＵ （９）、ＲＡＭαＱ、ＲＯＭαめ
と前記％ポート（５）と前記表示及びキーボードコント
ローラ（６）とのそれぞれの間はデータバスライン（ハ
）およびアドレスバスラインαゆによ多接続されている
。
＜ｉｌｌ トにデータ処理装置（６）が設けられてい
る。これらのＣＰＵ （９）、ＲＡＭαＱ、ＲＯＭαめ
と前記％ポート（５）と前記表示及びキーボードコント
ローラ（６）とのそれぞれの間はデータバスライン（ハ
）およびアドレスバスラインαゆによ多接続されている
。
また、前記ＣＰＵ （９）には外来ノイズ検出回路（ト
）が接続されている。この外来ノイズ検出回路（ト）は
コンデンサａ→を介してアンテナ（ロ）に接続されたゲ
ー源Ｖｐｌｃ基づく入力電位をスレッシュホー１ルド電
位近辺に設定している。たとえば、Ｖｐが５ｖの場合に
スレッシュホールド電位２ｖ付近に設定率れているもの
で、ＶＩＮとＶＯＵＴとの関係は第２図に示す状態であ
シ、外来ノイズによってＶＯＵＴは大きく変化する。
）が接続されている。この外来ノイズ検出回路（ト）は
コンデンサａ→を介してアンテナ（ロ）に接続されたゲ
ー源Ｖｐｌｃ基づく入力電位をスレッシュホー１ルド電
位近辺に設定している。たとえば、Ｖｐが５ｖの場合に
スレッシュホールド電位２ｖ付近に設定率れているもの
で、ＶＩＮとＶＯＵＴとの関係は第２図に示す状態であ
シ、外来ノイズによってＶＯＵＴは大きく変化する。
しかして、前記データ処理装置（６）内においては、前
記表示器（７）によるチラッキを防止するために二種の
チラッキ防止プログラムが設定されている。
記表示器（７）によるチラッキを防止するために二種の
チラッキ防止プログラムが設定されている。
そのうちの一つは通常のチラッキ防止処理で６Ｄ、他の
一つは強いチラッキ防止処理である。この強いチラッキ
防止処理の場合には、表示内容を一時的に固定すること
も含まれる。
一つは強いチラッキ防止処理である。この強いチラッキ
防止処理の場合には、表示内容を一時的に固定すること
も含まれる。
このような構成において、外来電波等の外来ノイズのな
い場合においては、通常のチラッキ防止処理がなされる
ように設定されている。そのため、ロードセル（１）か
らの出力が演算処理されて表示器（７）によシ表示され
るが、そのチラッキ防止は簡易なものであシ計量速度は
早い。
い場合においては、通常のチラッキ防止処理がなされる
ように設定されている。そのため、ロードセル（１）か
らの出力が演算処理されて表示器（７）によシ表示され
るが、そのチラッキ防止は簡易なものであシ計量速度は
早い。
しかして、外来電波その他の外来ノイズがあってＡＤ変
換器（４）等が誤動作するおそれのあるときには、第３
図に示すように割込処理が行なわれる。
換器（４）等が誤動作するおそれのあるときには、第３
図に示すように割込処理が行なわれる。
すなわち、外来ノイズがあるとゲート（ハ）のスレッシ
ュホールド電位を超えるため、ゲートｃＬ→のｖｏｔｒ
’ｒは高電位になシ、その出力信号がＣＰＵ （９）に
与えられて第３図に示すようにＲＡＭα１の所定領域に
「ノイズ有フラグ」をセットする割込処理がなされる。
ュホールド電位を超えるため、ゲートｃＬ→のｖｏｔｒ
’ｒは高電位になシ、その出力信号がＣＰＵ （９）に
与えられて第３図に示すようにＲＡＭα１の所定領域に
「ノイズ有フラグ」をセットする割込処理がなされる。
このようにして「ノイズ有フラグ」が立つと、第４図に
示すようにメインルーチンにおいてプログラム選択がな
される。
示すようにメインルーチンにおいてプログラム選択がな
される。
すなわち、「ノイズ有フラグ」がセットされていなけれ
ば、前述の通常のチラッキ防止処理であシ、「ノイズ有
フラグ」がセットされていると強いチラッキ防止処理が
なされる。そして、ノイズ有フラグはリセットされる。
ば、前述の通常のチラッキ防止処理であシ、「ノイズ有
フラグ」がセットされていると強いチラッキ防止処理が
なされる。そして、ノイズ有フラグはリセットされる。
したがって、外来ノイズの影響に基づくチラッキは防止
される。
される。
本発明は、上述のようにＣＰＵを備えたデータ処理装置
と表示器とを有するものにおいて、外来ノイズ検出回路
の出力によシチラッキ防止プログラムの実行を通常のチ
ラッキ防止処理と強いチラッキ防止処理とに切換えるこ
とができ、これによシ、外来ノイズのないときには計量
速度が速い状態での計量を行なうことができ、また、外
来ノイズのあるときには表示器のチラッキを防止するこ
とができ、これによシ、計量時の信頼性を高めることが
できるものである。
と表示器とを有するものにおいて、外来ノイズ検出回路
の出力によシチラッキ防止プログラムの実行を通常のチ
ラッキ防止処理と強いチラッキ防止処理とに切換えるこ
とができ、これによシ、外来ノイズのないときには計量
速度が速い状態での計量を行なうことができ、また、外
来ノイズのあるときには表示器のチラッキを防止するこ
とができ、これによシ、計量時の信頼性を高めることが
できるものである。
図面は本発明の一実施例を示すもので、第１図はブロッ
ク図、第２図はゲートの入出力の関係を示すグラフ、第
３図は割込処理時のフローチャート、第４図はチラッキ
防止処理のフローチャートである。
ク図、第２図はゲートの入出力の関係を示すグラフ、第
３図は割込処理時のフローチャート、第４図はチラッキ
防止処理のフローチャートである。
Claims (1)
- ロードセルからの信号、を演算処理するＣＰＵを備えた
データ処理装置とこのデータ処理装置の出力を表示する
表示器とを設けたものにおいて、前記ロードセルからの
出力変化に基づく前記表示器の表示内容の変化をゆるや
かに行なわせる重量表示のチラッキ防止プログラムを通
常のチラッキ防止処理と強いチラッキ防止処理との二種
に設定し、外来ノイズを検出してその外来ノイズのレベ
ルカ所定値を超えたときに通常のチラッキ防止処理を強
いチラッキ防止処理に切換える割込信号を発する外来ノ
イズ検出回路を前記ＣＰＵに接続したことを特徴とする
ロードセル秤。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7977382A JPS58196427A (ja) | 1982-05-12 | 1982-05-12 | ロ−ドセル秤 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7977382A JPS58196427A (ja) | 1982-05-12 | 1982-05-12 | ロ−ドセル秤 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS58196427A true JPS58196427A (ja) | 1983-11-15 |
| JPH0254485B2 JPH0254485B2 (ja) | 1990-11-21 |
Family
ID=13699518
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7977382A Granted JPS58196427A (ja) | 1982-05-12 | 1982-05-12 | ロ−ドセル秤 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58196427A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008122378A (ja) * | 2006-11-11 | 2008-05-29 | Mettler-Toledo Ag | 力計の状態の監視及び／又は計測を行うための方法及び力計 |
| KR101109751B1 (ko) * | 2009-04-24 | 2012-03-16 | 한국에이.엔.디 주식회사 | 전자 저울 및 컴퓨터 단말기 일체형 장치 |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| PL1860410T3 (pl) * | 2006-05-22 | 2019-05-31 | Mettler Toledo Gmbh | Sposób przetwarzania sygnału wyjściowego z przetwornika pomiarowego oraz urządzenie do pomiaru siły |
-
1982
- 1982-05-12 JP JP7977382A patent/JPS58196427A/ja active Granted
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008122378A (ja) * | 2006-11-11 | 2008-05-29 | Mettler-Toledo Ag | 力計の状態の監視及び／又は計測を行うための方法及び力計 |
| KR101109751B1 (ko) * | 2009-04-24 | 2012-03-16 | 한국에이.엔.디 주식회사 | 전자 저울 및 컴퓨터 단말기 일체형 장치 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0254485B2 (ja) | 1990-11-21 |
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