JPH11202292A - Driving method for active matrix type liquid crystal display device - Google Patents
Driving method for active matrix type liquid crystal display deviceInfo
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- JPH11202292A JPH11202292A JP872098A JP872098A JPH11202292A JP H11202292 A JPH11202292 A JP H11202292A JP 872098 A JP872098 A JP 872098A JP 872098 A JP872098 A JP 872098A JP H11202292 A JPH11202292 A JP H11202292A
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Abstract
Description
【０００１】[0001]
【発明の属する技術分野】本発明は、表示輝度の均一性
を改善したアクティブマトリクス形液晶表示装置の駆動
方法に関する。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a method for driving an active matrix type liquid crystal display device having improved display luminance uniformity.
【０００２】[0002]
【従来の技術】近年、パーソナルコンピュータやワーク
ステーションの表示素子に適した高性能の液晶表示装置
が開発、実用化されている。この種の液晶表示装置の代
表的なものとして、アクティブマトリクス形液晶表示装
置がある。このアクティブマトリクス形液晶表示装置
は、一方の透光性基板に薄膜トランジスタ（Thin Film
Transistor）を備えた画素電極がマトリクス上に配置さ
れたアレイ基板を用い、このアレイ基板に対して対向電
極を有する透光性基板を対向配置し、これらアレイ基板
および対向基板間に液晶を挟持させている。2. Description of the Related Art In recent years, high-performance liquid crystal display devices suitable for display elements of personal computers and workstations have been developed and put into practical use. A typical example of this type of liquid crystal display device is an active matrix liquid crystal display device. This active matrix type liquid crystal display device has a thin film transistor (Thin Film)
Transistor) is used with an array substrate in which pixel electrodes are arranged on a matrix, and a translucent substrate having a counter electrode is arranged opposite to this array substrate, and liquid crystal is sandwiched between the array substrate and the opposing substrate. ing.
【０００３】そして、アレイ基板は、ガラスなどの透光
性基板上に薄膜プロセス技術を用いて形成されており、
図２に等価回路のように構成される。[0003] The array substrate is formed on a light-transmitting substrate such as glass using a thin film process technique.
FIG. 2 shows an equivalent circuit.
【０００４】図２に示すように、Ｘ1 ，Ｘ2 ，・・・，
Ｘm は複数の列を構成するデータ線で、これらデータ線
Ｘ1 ，Ｘ2 ，・・・，Ｘm に対して直交し、複数の行を
構成するアドレス線Ｙ1 ，Ｙ2 ，・・・，Ｙn がガラス
などによる図示しない透光性基板上に配列されている。
また、11はマトリクス状に配列された複数の透明な画素
電極で、これら各画素電極11毎に、薄膜トランジスタ
（Thin Film Transistor）12がそれぞれ設けられてい
る。As shown in FIG. 2, X1, X2,.
Xm is a data line constituting a plurality of columns, and is orthogonal to these data lines X1, X2,..., Xm, and address lines Y1, Y2,. Are arranged on a transparent substrate (not shown).
Reference numeral 11 denotes a plurality of transparent pixel electrodes arranged in a matrix. Each of the pixel electrodes 11 is provided with a thin film transistor (Thin Film Transistor) 12.
【０００５】これら薄膜トランジスタ12のソースおよび
ドレインのいずれか一方は、対応する画素電極11に接続
され、薄膜トランジスタ12のソースおよびドレインのい
ずれか他方は、同じ列毎に対応するデータ線Ｘ1 ，Ｘ2
，・・・，Ｘm のいずれかに共通接続されている。ま
た、各薄膜トランジスタ12のゲートは、同じ行毎に対応
するアドレス線Ｙ1 ，Ｙ2 ，・・・，Ｙn のいずれかに
共通接続されている。One of the source and the drain of the thin film transistor 12 is connected to the corresponding pixel electrode 11, and the other of the source and the drain of the thin film transistor 12 is connected to the corresponding data line X1, X2 in the same column.
,..., Xm. The gate of each thin film transistor 12 is commonly connected to one of the address lines Y1, Y2,..., Yn corresponding to the same row.
【０００６】また、各画素電極11に対してはそれぞれ信
号蓄積容量13が設けられており、この信号蓄積容量13の
一端は対応する画素電極11に接続され、他端は共通接続
されて共通接続端子14に導出されている。A signal storage capacitor 13 is provided for each pixel electrode 11. One end of the signal storage capacitor 13 is connected to the corresponding pixel electrode 11, and the other end is connected to the common connection. Leaded to terminal 14.
【０００７】このような構成のアレイ基板に対し、図示
していないが同じくガラスなどの透光性基板上に、複数
の透明な画素電極11に対向する共通の対向電極を形成し
た対向電極基板が設けられている。In contrast to the array substrate having such a structure, a counter electrode substrate, which is not shown but also has a common counter electrode facing a plurality of transparent pixel electrodes 11 on a light-transmitting substrate such as glass, is used. Is provided.
【０００８】さらに、アレイ基板および対向電極基板の
互いに対向する周辺部はシール剤によって封着され、ア
レイ基板および対向基板間の数μｍの間隙には液晶が挟
持され、アクティブマトリクス形液晶表示装置が構成さ
れる。Further, the peripheral portions of the array substrate and the counter electrode substrate facing each other are sealed with a sealant, and a liquid crystal is sandwiched in a gap of several μm between the array substrate and the counter substrate. Be composed.
【０００９】このような構成の液晶表示装置を駆動する
場合、複数のデータ線Ｘ1 ，Ｘ2 ，・・・，Ｘm には表
示信号が順次供給され、また、アドレス線Ｙ1 ，Ｙ2 ，
・・・，Ｙn には書込用の走査信号が順次供給され、さ
らに、共通の対向電極には対向電極電圧が供給される。
なお、信号蓄積容量13の共通接続端子14は、一般に共通
な対向電極に接続して駆動される。When driving the liquid crystal display device having such a configuration, display signals are sequentially supplied to a plurality of data lines X1, X2,..., Xm, and address lines Y1, Y2,.
, Yn are sequentially supplied with a scanning signal for writing, and a common electrode is supplied with a common electrode voltage.
Note that the common connection terminal 14 of the signal storage capacitor 13 is generally connected to and driven by a common counter electrode.
【００１０】[0010]
【発明が解決しようとする課題】次に、図３を参照して
図２で示したアレイ基板を用いるアクティブマトリクス
形液晶表示装置の動作および問題点について説明する。Next, the operation and problems of the active matrix type liquid crystal display device using the array substrate shown in FIG. 2 will be described with reference to FIG.
【００１１】図３に示すように、書込み走査信号電圧Ｖ
y1，Ｖy2，・・・，Ｖynはアドレス線Ｙ1 ，Ｙ2 ，・・
・，Ｙn に書き込まれ、複数のデータ線Ｘ1 ，Ｘ2 ，・
・，Ｘm の全てに表示信号が書き込まれる水平周期毎
に、順次各アドレス線Ｙ1 ，Ｙ2 ，・・・，Ｙn に供給
され、垂直走査される。なお、この垂直走査が１フレー
ム終了する垂直走査期間をＴｆとする。As shown in FIG. 3, the write scan signal voltage V
y1, Vy2,..., Vyn are address lines Y1, Y2,.
, Yn and a plurality of data lines X1, X2,.
, Xm are sequentially supplied to each address line Y1, Y2,..., Yn in every horizontal cycle in which the display signal is written, and are vertically scanned. Note that a vertical scanning period in which the vertical scanning ends by one frame is defined as Tf.
【００１２】また、表示信号電圧Ｖxi（i=１〜ｍ）は任
意のデータ線Ｘｉに供給され、垂直走査期間Ｔｆ毎に、
中心電圧Ｖscを基準にして極性反転され、画素電位Ｖpu
および画素電位Ｖpbは、それぞれデータ線Ｘｉから、対
応する薄膜トランジスタ12を介して表示信号電圧Ｖxiが
供給される画素の液晶に印加される。The display signal voltage Vxi (i = 1 to m) is supplied to an arbitrary data line Xi.
The polarity is inverted with respect to the center voltage Vsc, and the pixel potential Vpu is inverted.
The pixel potential Vpb is applied to the liquid crystal of the pixel to which the display signal voltage Vxi is supplied from the data line Xi via the corresponding thin film transistor 12, respectively.
【００１３】このうち、画素電位Ｖpuは、垂直走査期間
Ｔｆの最初の書込み走査信号Ｖy1により、アドレス線Ｙ
1 に接続された薄膜トランジスタ12がオン動作したこと
によって書き込まれた画素の電圧であり、すなわち、垂
直走査期間Ｔｆの最初であるから、極性反転直後の表示
信号電圧Ｖxiが書き込まれたときの画素の電圧である。The pixel potential Vpu is changed by the first write scan signal Vy1 in the vertical scan period Tf to the address line Y.
1 is the voltage of the pixel written when the thin film transistor 12 connected to 1 is turned on, that is, the voltage of the pixel when the display signal voltage Vxi immediately after the polarity inversion is written since it is the beginning of the vertical scanning period Tf. Voltage.
【００１４】これに対し、画素電位Ｖpbは、垂直走査期
間Ｔｆの最後の書込み走査信号Ｖynにより、アドレス線
Ｙn に接続された薄膜トランジスタ12がオン動作したこ
とによって書き込まれた画素の電圧である。すなわち、
垂直走査期間Ｔｆの最後であるから、極性反転直前の表
示信号電圧Ｖxiが書き込まれたときの画素の電圧であ
る。On the other hand, the pixel potential Vpb is a voltage of a pixel written by the thin-film transistor 12 connected to the address line Yn being turned on by the last write scanning signal Vyn in the vertical scanning period Tf. That is,
Since this is the end of the vertical scanning period Tf, this is the voltage of the pixel when the display signal voltage Vxi immediately before the polarity inversion is written.
【００１５】なお、駆動電圧Ｖｃは対向電圧に供給され
る直流駆動電圧で、画素の液晶に直流電圧が印加されな
いように電位が調整されている。The drive voltage Vc is a DC drive voltage supplied to the counter voltage, and the potential is adjusted so that no DC voltage is applied to the liquid crystal of the pixel.
【００１６】このように、書込み走査信号Ｖy1の高電位
期間に、アドレス線Ｙ1 とデータ線Ｘi との交差部の画
素に、表示信号電圧Ｖxiの極性反転直後の電位が薄膜ト
ランジスタ12を介して信号蓄積容量13や液晶層容量に書
き込まれる。また、書込み走査信号Ｖy1の低電位期間で
は、書き込まれた電位が保持され、これらが画素電位Ｖ
puとなる。As described above, during the high potential period of the write scan signal Vy1, the potential immediately after the polarity inversion of the display signal voltage Vxi is stored in the pixel at the intersection of the address line Y1 and the data line Xi via the thin film transistor 12. The data is written to the capacitance 13 and the capacitance of the liquid crystal layer. Further, in the low potential period of the write scanning signal Vy1, the written potential is held, and these are the pixel potentials Vy1.
It becomes pu.
【００１７】この画素電位Ｖpuは、図示のように、デー
タ線Ｘi 上の表示信号電圧Ｖxiとほぼ同位相、同電位
で、対応する薄膜トランジスタ12のソース、ドレイン間
の電圧は小さい。したがって、薄膜トランジスタ12のオ
フ時リーク電流の影響を受け難く、図示波形で示すよう
に、書き込まれた電圧はほとんど減衰することなく、そ
の電圧保持状態は良好である。As shown, the pixel potential Vpu has substantially the same phase and the same potential as the display signal voltage Vxi on the data line Xi, and the voltage between the source and the drain of the corresponding thin film transistor 12 is small. Therefore, the thin-film transistor 12 is hardly affected by the off-state leakage current, and the written voltage is hardly attenuated, as shown by the waveforms in the drawing, and the voltage holding state is good.
【００１８】一方、アドレス線Ｙn とデータ線Ｘi との
交差部の画素には、書込み走査信号電圧Ｖynの高電位期
間に、表示信号電圧Ｖxiの極性反転直前の電位が薄膜ト
ランジスタ12を介して信号蓄積容量13や液晶層容量に書
き込まれる。また、書込み走査信号Ｖy1の低電位期間で
は、書き込まれた電位が保持され、これらが画素電位Ｖ
pbとなる。On the other hand, in the pixel at the intersection of the address line Yn and the data line Xi, the potential immediately before the reversal of the polarity of the display signal voltage Vxi is stored via the thin film transistor 12 during the high potential period of the write scanning signal voltage Vyn. The data is written to the capacitor 13 and the liquid crystal layer capacitor. Further, in the low potential period of the write scanning signal Vy1, the written potential is held, and these are the pixel potentials Vy1.
pb.
【００１９】この画素電位Ｖpbは、図示のように、デー
タ線Ｘi 上の表示信号電圧Ｖxiとほぼ逆位相で、対応す
る薄膜トランジスタ12のソース、ドレイン間には大きな
電圧が印加される。したがって、薄膜トランジスタ12の
オフ時リーク電流の影響を受け、書き込まれた電位が、
データ線Ｘi 上の表示信号電圧Ｖxiの電位に向けて放電
する。このため、画素電位Ｖpbは、図示波形で示すよう
に低下してしまい、書き込まれた電圧の保持特性が悪く
なる。As shown, the pixel potential Vpb is substantially in phase with the display signal voltage Vxi on the data line Xi, and a large voltage is applied between the source and the drain of the corresponding thin film transistor 12. Therefore, under the influence of the off-state leakage current of the thin film transistor 12, the written potential becomes
Discharge is performed toward the potential of the display signal voltage Vxi on the data line Xi. For this reason, the pixel potential Vpb decreases as shown by the waveforms shown in the figure, and the retention characteristics of the written voltage deteriorate.
【００２０】これらの結果、画素電極11と対向電極との
間の液晶に印加される電圧について、図３で示した画素
電位Ｖpuが印加される画素と画素電位Ｖpbが印加される
画素とでは、データ線Ｘi 上の表示信号電圧Ｖxiが同一
であっても、それぞれの画素の液晶に印加される電圧の
実効値が異なるために表示輝度が異なってしまうという
問題を生じている。As a result, with respect to the voltage applied to the liquid crystal between the pixel electrode 11 and the counter electrode, the pixel applied with the pixel potential Vpu and the pixel applied with the pixel potential Vpb shown in FIG. Even if the display signal voltage Vxi on the data line Xi is the same, there is a problem that the display luminance differs because the effective values of the voltages applied to the liquid crystal of each pixel are different.
【００２１】本発明は、上記問題点に鑑みなされたもの
で、同一表示信号レベルに対する画素間での表示輝度差
を生じさせることのないアクティブマトリクス形液晶表
示装置の駆動方法を提供することを目的とする。The present invention has been made in view of the above problems, and has as its object to provide a driving method of an active matrix type liquid crystal display device which does not cause a display luminance difference between pixels for the same display signal level. And
【００２２】[0022]
【課題を解決するための手段】本発明は、マトリクス状
に配列された複数の画素電極、これら画素電極にソース
およびドレインのいずれか一方がそれぞれ接続された複
数の薄膜トランジスタ、これら薄膜トランジスタのゲー
トが行毎に共通接続されたアドレス線、および、前記薄
膜トランジスタのソースおよびドレインのいずれか他方
が列毎に共通接続された複数のデータ線を有する第１の
透光性基板と、前記画素電極に対向して画素容量を形成
する対向電極を有する第２の透光性基板と、これら第１
および第２の透光性基板間に挟持された液晶とを備えた
アクティブマトリクス形液晶表示装置の駆動方法であっ
て、前記各アドレス線に一垂直走査期間中に書込み走査
信号を線順次に印加し、この垂直走査期間毎に前記表示
信号の極性を反転させると共に、前記対向電極に印加さ
れる電圧を、前記垂直走査期間の後期の走査により前記
画素容量に書き込まれる電圧が、垂直走査期間の前期の
走査により前記画素容量に書き込まれる電圧より大きく
なるように変化させるものである。According to the present invention, there are provided a plurality of pixel electrodes arranged in a matrix, a plurality of thin film transistors each having one of a source and a drain connected to the pixel electrodes, and a gate of each of the thin film transistors. A first light-transmitting substrate having an address line commonly connected to each of the plurality of data lines and a plurality of data lines commonly connected to each of the columns, and one of the source and the drain of the thin film transistor facing the pixel electrode; A second light-transmitting substrate having a counter electrode forming a pixel capacitor by
And a liquid crystal interposed between a second light-transmitting substrate and a driving method of an active matrix liquid crystal display device, wherein a write scan signal is applied to each address line in a vertical scanning period in a line-sequential manner. Then, while inverting the polarity of the display signal for each vertical scanning period, the voltage applied to the counter electrode is changed to a voltage written to the pixel capacitor by scanning in the latter half of the vertical scanning period. The voltage is changed so as to be higher than the voltage written to the pixel capacitor by the previous scanning.
【００２３】そして、対向電極に書き込まれる電圧を変
化させて、垂直走査期間の後期の走査により画素に書き
込まれる電圧が垂直走査期間の前期の走査により画素に
書き込まれる電圧より大きくなるようにして、各画素電
圧の実効値を等しくしたので、同一表示信号レベルに対
する画素間での表示輝度差を生じさせない。Then, the voltage written to the counter electrode is changed so that the voltage written to the pixel by the latter half of the vertical scanning period is higher than the voltage written to the pixel by the first half of the vertical scanning period. Since the effective values of the pixel voltages are made equal, there is no difference in display luminance between pixels for the same display signal level.
【００２４】また、対向電極に印加される電圧を、垂直
走査期間内で連続に変化させるものである。Further, the voltage applied to the counter electrode is changed continuously within the vertical scanning period.
【００２５】さらに、対向電極に印加される電圧を、表
示信号の極性反転に同期して反転される鋸歯状電圧とし
たものである。Further, the voltage applied to the counter electrode is a sawtooth voltage which is inverted in synchronization with the polarity inversion of the display signal.
【００２６】またさらに、対向電極に印加される電圧
を、水平走査期間毎に階段状に変化させるものである。Further, the voltage applied to the counter electrode is changed stepwise every horizontal scanning period.
【００２７】そして、いずれの場合もより表示輝度差を
生じさせない。In any case, a difference in display luminance does not occur.
【００２８】[0028]
【発明の実施の形態】以下、本発明のアクティブマトリ
クス形液晶表示装置の一実施の形態を図面を参照して説
明する。DESCRIPTION OF THE PREFERRED EMBODIMENTS An embodiment of the active matrix type liquid crystal display device of the present invention will be described below with reference to the drawings.
【００２９】図２で示したアレイ基板を有し、ガラスな
どの透光性基板上にマトリクス状に配列された複数の透
明な画素電極11、および、これら画素電極11毎に設けら
れた薄膜トランジスタ（Thin Film Transistor）12、複
数の列を構成するデータ線Ｘ1 ，Ｘ2 ，・・・，Ｘm 、
および、これらデータ線Ｘ1 ，Ｘ2 ，・・・，Ｘm に直
交し、複数の行を構成するアドレス線Ｙ1 ，Ｙ2 ，・・
・，Ｙn を有する。また、各画素電極11に対しては、そ
れぞれ信号蓄積容量13が設けられている。A plurality of transparent pixel electrodes 11 having the array substrate shown in FIG. 2 and arranged in a matrix on a light-transmitting substrate such as glass, and a thin-film transistor ( Thin Film Transistor) 12, data lines X1, X2,.
Address lines Y1, Y2,..., Which are orthogonal to the data lines X1, X2,.
, Yn. A signal storage capacitor 13 is provided for each pixel electrode 11.
【００３０】このような構成のアレイ基板に対し、ガラ
スなどの透光性基板上に、共通の対向電極を形成した対
向電極基板が設けられ、さらに、アレイ基板および対向
電極基板の互いに対向する周辺部はシール剤によって封
着され、アレイ基板および対向基板間の数μｍの間隙に
は液晶が挟持され、アクティブマトリクス形液晶表示装
置が構成される。With respect to the array substrate having such a configuration, a counter electrode substrate having a common counter electrode formed on a light-transmitting substrate such as glass is provided. The part is sealed with a sealant, and a liquid crystal is sandwiched in a gap of several μm between the array substrate and the counter substrate, thereby forming an active matrix type liquid crystal display device.
【００３１】このような液晶表示装置の駆動に際して
は、複数のデータ線Ｘ1 ，Ｘ2 ，・・・，Ｘm に表示信
号を順次供給するとともに、アドレス線Ｙ1 ，Ｙ2 ，・
・・，Ｙn に書込み用の走査信号を順次供給し、さら
に、共通の対向電極には対向電極電圧を供給する。信号
蓄積容量13の共通接続端子14は、一般に共通な対向電極
に接続して駆動される。In driving such a liquid crystal display device, display signals are sequentially supplied to a plurality of data lines X1, X2,..., Xm, and address lines Y1, Y2,.
.., Yn are sequentially supplied with a scanning signal for writing, and a common electrode is supplied with a common electrode voltage. The common connection terminal 14 of the signal storage capacitor 13 is generally connected to and driven by a common counter electrode.
【００３２】次に、図１を参照して図２で示したアレイ
基板を用いるアクティブマトリクス形液晶表示装置の動
作を説明する。なお、図１は、図３で説明した従来方法
による電圧波形と対比して示してあり、対応する波形に
は同一符号を付している。Next, the operation of the active matrix type liquid crystal display device using the array substrate shown in FIG. 2 will be described with reference to FIG. FIG. 1 is shown in comparison with the voltage waveform according to the conventional method described with reference to FIG. 3, and corresponding waveforms are denoted by the same reference numerals.
【００３３】図１に示すように、書込み走査信号電圧Ｖ
y1，Ｖy2，・・・，Ｖynはアドレス線Ｙ1 ，Ｙ2 ，・・
・，Ｙn に書き込まれ、複数のデータ線Ｘ1 ，Ｘ2 ，・
・，Ｘm の全てに表示信号が書き込まれる水平周期毎
に、順次各アドレス線にＹ1 ，Ｙ2 ，・・・，Ｙn に供
給され、垂直走査し、垂直走査が１フレーム終了する期
間を垂直走査期間Ｔｆとする。As shown in FIG. 1, the write scan signal voltage V
y1, Vy2,..., Vyn are address lines Y1, Y2,.
, Yn and a plurality of data lines X1, X2,.
.., Yn are sequentially supplied to each address line in each horizontal cycle in which the display signal is written to all of Xm, and the vertical scanning is performed. Let it be Tf.
【００３４】また、表示信号電圧Ｖxi（i=１〜ｍ）は、
任意のデータ線Ｘｉに供給され、垂直走査期間Ｔｆ毎
に、中心電圧Ｖscを基準にして極性反転される。画素電
位Ｖpuおよび画素電位Ｖpbは、それぞれデータ線Ｘｉか
ら、対応する薄膜トランジスタ12を介して表示信号電圧
Ｖxiが供給された画素の液晶に印加される。The display signal voltage Vxi (i = 1 to m) is
The voltage is supplied to an arbitrary data line Xi, and the polarity is inverted with respect to the center voltage Vsc every vertical scanning period Tf. The pixel potential Vpu and the pixel potential Vpb are applied to the liquid crystal of the pixel supplied with the display signal voltage Vxi from the data line Xi via the corresponding thin film transistor 12, respectively.
【００３５】このうち、画素電位Ｖpuは垂直走査期間Ｔ
ｆの最初の、すなわち極性反転直後の表示信号電圧Ｖxi
が書き込まれたときの画素電圧であり、画素電位Ｖpbは
垂直走査期間Ｔｆの最後の、すなわち極性反転直前の表
示信号電圧Ｖxiが書き込まれたときの画素電圧である。The pixel potential Vpu is the vertical scanning period T
f, the display signal voltage Vxi immediately after the polarity inversion
Is the pixel voltage at the time of writing, and the pixel potential Vpb is the pixel voltage at the end of the vertical scanning period Tf, that is, when the display signal voltage Vxi immediately before the polarity inversion is written.
【００３６】また、駆動電圧Ｖｃは対向電圧に供給さ
れ、図示のように、垂直走査期間Ｔｆ内において、後期
の走査により表示信号電圧Ｖxiによって画素に書き込ま
れる電圧の振幅が、垂直走査期間Ｔｆの前期の走査によ
り信号電圧Ｖxiによって画素に書き込まれる電圧の振幅
より、ａだけ大きくなるように変化させている。The drive voltage Vc is supplied as a counter voltage. As shown in the figure, during the vertical scanning period Tf, the amplitude of the voltage written to the pixel by the display signal voltage Vxi by the latter scanning is changed during the vertical scanning period Tf. The amplitude of the voltage written to the pixel by the signal voltage Vxi in the first scan is changed to be larger by a.
【００３７】すなわち、対向電極に印加される駆動電圧
Ｖｃを、表示信号電圧Ｖxiの極性反転に同期して反転さ
れる鋸歯状電圧として、この駆動電圧Ｖｃを垂直走査期
間Ｔｆ内で連続に変化させるようにしている。なお、＜
Ｖｃ＞は等価対向電極電位である。That is, the driving voltage Vc applied to the common electrode is set as a sawtooth voltage inverted in synchronization with the inversion of the polarity of the display signal voltage Vxi, and the driving voltage Vc is continuously changed within the vertical scanning period Tf. Like that. Note that <
Vc> is an equivalent counter electrode potential.
【００３８】このような電圧波形の関係において、書込
み走査信号Ｖy1の高電位期間に、アドレス線Ｙ1 とデー
タ線Ｘi との交差部の画素に、表示信号電圧Ｖxiの極性
反転直後の電位が薄膜トランジスタ12を介して書き込ま
れ、信号蓄積容量13や液晶層容量に充電される。また、
この書込み走査信号Ｖy1の低電位期間では、書き込まれ
た電位が保持され、これらが画素電位Ｖpuとなる。In such a relationship of the voltage waveforms, during the high potential period of the write scanning signal Vy1, the potential immediately after the inversion of the polarity of the display signal voltage Vxi is applied to the pixel at the intersection of the address line Y1 and the data line Xi. , And is charged in the signal storage capacitor 13 and the liquid crystal layer capacitor. Also,
In the low potential period of the write scanning signal Vy1, the written potentials are held, and these become the pixel potentials Vpu.
【００３９】この画素電位Ｖpuは、図示のように、デー
タ線Ｘi 上の表示信号電圧Ｖxiとほぼ同位相、同電位
で、対応する薄膜トランジスタ12のソース・ドレイン間
の電圧は小さい。したがって、薄膜トランジスタ12のオ
フ時リーク電流の影響を受け難く、図示波形で示すよう
に、書き込まれた電圧はほとんど減衰することなく、そ
の電圧保持状態は良好である。As shown, the pixel potential Vpu has substantially the same phase and the same potential as the display signal voltage Vxi on the data line Xi, and the voltage between the source and drain of the corresponding thin film transistor 12 is small. Therefore, the thin-film transistor 12 is hardly affected by the off-state leakage current, and the written voltage is hardly attenuated, as shown by the waveforms in the drawing, and the voltage holding state is good.
【００４０】一方、アドレス線Ｙn とデータ線Ｘi との
交差部の画素には、書込み走査信号電圧Ｖynの高電位期
間に、表示信号Ｖxiの極性反転直前の電位が薄膜トラン
ジスタ12を介して書き込まれ、信号蓄積容量13や液晶層
容量に充電される。この書込み走査信号電圧Ｖy1の低電
位期間では、書き込まれた電位が保持され、これらが画
素電位Ｖpbとなる。On the other hand, in the pixel at the intersection of the address line Yn and the data line Xi, the potential immediately before the polarity inversion of the display signal Vxi is written via the thin film transistor 12 during the high potential period of the write scanning signal voltage Vyn. The signal storage capacitor 13 and the liquid crystal layer capacitor are charged. In the low potential period of the write scanning signal voltage Vy1, the written potentials are held, and these become the pixel potentials Vpb.
【００４１】この画素電位Ｖpbは、図示のように、デー
タ線Ｘi 上の表示信号電圧Ｖxiとほぼ逆位相で、対応す
る薄膜トランジスタ12のソース、ドレイン間には大きな
電圧が印加される。したがって、薄膜トランジスタ12の
オフ時リーク電流の影響を受け、書き込まれた電位が、
データ線Ｘi 上の表示信号電圧Ｖxiの電位に向けて放電
し、画素電位Ｖpbは、図示波形で示すように低下してし
まい、書き込まれた電圧の保持特性が悪くなることを防
止するため、対向電極の駆動電圧Ｖｃを変化させ、画素
電圧Ｖpbは画素電圧Ｖpuに比べて、書き込み時の電圧
が、対向電極の駆動電圧Ｖｃの振幅ａだけ大きくなる。
したがって、この振幅ａの値を調整することにより、画
素電位Ｖpbの実効値を、画素電位Ｖpuの実効値と等しく
することができる。As shown, the pixel potential Vpb is substantially in phase with the display signal voltage Vxi on the data line Xi, and a large voltage is applied between the source and the drain of the corresponding thin film transistor 12. Therefore, under the influence of the off-state leakage current of the thin film transistor 12, the written potential becomes
Discharge is performed toward the potential of the display signal voltage Vxi on the data line Xi, and the pixel potential Vpb decreases as shown in the waveforms in FIG. The drive voltage Vc of the electrode is changed, and the pixel voltage Vpb is such that the voltage at the time of writing is larger than the pixel voltage Vpu by the amplitude a of the drive voltage Vc of the counter electrode.
Therefore, by adjusting the value of the amplitude a, the effective value of the pixel potential Vpb can be made equal to the effective value of the pixel potential Vpu.
【００４２】この結果、データ線Ｘi 上の表示信号電圧
Ｖxiの電位が同一であれば、それぞれの画素の液晶に印
加される電圧の実効値を等しくすることができるので、
データ線Ｘi 上の表示信号電圧Ｖxiの電位が同一であっ
ても、それぞれの画素の液晶に印加される電圧の実効値
が異なるために表示輝度が異なってしまうことはなく、
均一な輝度による良好な表示が可能になる。As a result, if the potential of the display signal voltage Vxi on the data line Xi is the same, the effective value of the voltage applied to the liquid crystal of each pixel can be made equal.
Even if the potential of the display signal voltage Vxi on the data line Xi is the same, the display luminance does not differ because the effective value of the voltage applied to the liquid crystal of each pixel is different.
Good display with uniform luminance becomes possible.
【００４３】なお、上記実施の形態では、対向電極の駆
動電圧Ｖｃを垂直走査期間Ｔｆ内で連続変化させる際、
直線的に変化させているが、対向電極の駆動電圧Ｖｃを
曲線的に変化させても同等の効果を得ることができる。In the above embodiment, when the drive voltage Vc of the counter electrode is continuously changed within the vertical scanning period Tf,
Although it is changed linearly, the same effect can be obtained even if the drive voltage Vc of the counter electrode is changed in a curved line.
【００４４】また、対向電極の駆動電圧Ｖｃを垂直走査
期間Ｔｆ内で変化させる方法として、上述の各実施形態
のように連続に変化させるだけでなく、水平走査期間毎
に階段状に変化させてもよい。As a method of changing the driving voltage Vc of the common electrode within the vertical scanning period Tf, the driving voltage Vc is not only changed continuously as in the above-described embodiments, but is also changed stepwise every horizontal scanning period. Is also good.
【００４５】[0045]
【発明の効果】本発明によれば、対向電極に書き込まれ
る電圧を変化させて、垂直走査期間の後期の走査により
画素に書き込まれる電圧が垂直走査期間の前期の走査に
より画素に書き込まれる電圧より大きくなるようにし
て、各画素電圧の実効値を等しくしたので、同一表示信
号レベルに対する画素間での表示輝度差を生じさせるこ
とを防止できる。According to the present invention, by changing the voltage written to the counter electrode, the voltage written to the pixel by the latter scanning in the vertical scanning period is made smaller than the voltage written to the pixel by the scanning in the first half of the vertical scanning period. Since the effective values of the pixel voltages are made equal by making the pixel voltages larger, it is possible to prevent a display luminance difference between pixels for the same display signal level.
【００４６】また、対向電極に印加される電圧を、垂直
走査期間内で連続に変化させ、対向電極に印加される電
圧を、表示信号の極性反転に同期して反転される鋸歯状
電圧としたものとし、あるいは、対向電極に印加される
電圧を、水平走査期間毎に階段状に変化させるものであ
るので、いずれの場合もより表示輝度差を生じさせるこ
とを防止できる。Further, the voltage applied to the counter electrode is continuously changed within the vertical scanning period, and the voltage applied to the counter electrode is a sawtooth voltage which is inverted in synchronization with the polarity inversion of the display signal. Alternatively, since the voltage applied to the counter electrode is changed stepwise in each horizontal scanning period, it is possible to prevent a display luminance difference from occurring in any case.
【図１】本発明のアクティブマトリクス形液晶表示装置
の駆動方法の一実施の形態を示す波形図である。FIG. 1 is a waveform diagram showing one embodiment of a method for driving an active matrix liquid crystal display device of the present invention.
【図２】アクティブマトリクス形液晶表示装置のアレイ
基板の構成を示す回路図である。FIG. 2 is a circuit diagram showing a configuration of an array substrate of an active matrix type liquid crystal display device.
【図３】同上従来のアクティブマトリクス形液晶表示装
置の駆動方法を示す波形図である。FIG. 3 is a waveform chart showing a driving method of the conventional active matrix liquid crystal display device.
11 画素電極 12 薄膜トランジスタ Ｘ1 ，Ｘ2 ，・・，Ｘm データ線 Ｙ1 ，Ｙ2 ，・・，Ｙn アドレス線 11 Pixel electrode 12 Thin film transistor X1, X2,..., Xm Data line Y1, Y2,.
Claims (4)
極、これら画素電極にソースおよびドレインのいずれか
一方がそれぞれ接続された複数の薄膜トランジスタ、こ
れら薄膜トランジスタのゲートが行毎に共通接続された
アドレス線、および、前記薄膜トランジスタのソースお
よびドレインのいずれか他方が列毎に共通接続された複
数のデータ線を有する第１の透光性基板と、前記画素電
極に対向して画素容量を形成する対向電極を有する第２
の透光性基板と、これら第１および第２の透光性基板間
に挟持された液晶とを備えたアクティブマトリクス形液
晶表示装置の駆動方法であって、 前記各アドレス線に一垂直走査期間中に書込み走査信号
を線順次に印加し、この垂直走査期間毎に前記表示信号
の極性を反転させると共に、前記対向電極に印加される
電圧を、前記垂直走査期間の後期の走査により前記画素
容量に書き込まれる電圧が、垂直走査期間の前期の走査
により前記画素容量に書き込まれる電圧より大きくなる
ように変化させることを特徴とするアクティブマトリク
ス形液晶表示装置の駆動方法。1. A plurality of pixel electrodes arranged in a matrix, a plurality of thin film transistors each having one of a source and a drain connected to these pixel electrodes, and an address line in which the gates of these thin film transistors are commonly connected for each row. And a first light-transmitting substrate having a plurality of data lines in which one of the source and the drain of the thin film transistor is commonly connected for each column; and a counter electrode which forms a pixel capacitance in opposition to the pixel electrode. The second with
And a liquid crystal sandwiched between the first and second transparent substrates. A method for driving an active matrix type liquid crystal display device, comprising: During the vertical scanning period, a write scan signal is applied line-sequentially, the polarity of the display signal is inverted, and the voltage applied to the counter electrode is changed by the latter scanning of the vertical scanning period. Wherein the voltage written to the pixel matrix is changed so as to be higher than the voltage written to the pixel capacitor by scanning in the first half of the vertical scanning period.
期間内で連続に変化させることを特徴とする請求項１記
載のアクティブマトリクス形液晶表示装置の駆動方法。2. The method according to claim 1, wherein the voltage applied to the common electrode is changed continuously within a vertical scanning period.
の極性反転に同期して反転される鋸歯状電圧としたこと
を特徴とする請求項１記載のアクティブマトリクス形液
晶表示装置の駆動方法。3. The method of driving an active matrix type liquid crystal display device according to claim 1, wherein the voltage applied to the counter electrode is a sawtooth voltage which is inverted in synchronization with the polarity inversion of the display signal. .
期間毎に階段状に変化させることを特徴とする請求項１
記載のアクティブマトリクス形液晶表示装置の駆動方
法。4. The method according to claim 1, wherein the voltage applied to the counter electrode is changed stepwise every horizontal scanning period.
The driving method of the active matrix type liquid crystal display device described in the above.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP872098A JPH11202292A (en) | 1998-01-20 | 1998-01-20 | Driving method for active matrix type liquid crystal display device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP872098A JPH11202292A (en) | 1998-01-20 | 1998-01-20 | Driving method for active matrix type liquid crystal display device |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH11202292A true JPH11202292A (en) | 1999-07-30 |
Family
ID=11700795
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP872098A Pending JPH11202292A (en) | 1998-01-20 | 1998-01-20 | Driving method for active matrix type liquid crystal display device |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH11202292A (en) |
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2005508507A (en) * | 2001-03-12 | 2005-03-31 | トムソン ライセンシング ソシエテ アノニム | Reduction of sparkle artifacts by limiting slew rate after gamma correction |
| JP2010197417A (en) * | 2009-02-23 | 2010-09-09 | Toppoly Optoelectronics Corp | Display device and electronic apparatus equipped with same |
| WO2011077925A1 (en) * | 2009-12-25 | 2011-06-30 | Semiconductor Energy Laboratory Co., Ltd. | Method for driving liquid crystal display device |
| US8953112B2 (en) | 2010-09-15 | 2015-02-10 | Semiconductor Energy Laboratory Co., Ltd. | Liquid crystal display device |
| US9805676B2 (en) | 2012-11-28 | 2017-10-31 | Semiconductor Energy Laboratory Co., Ltd. | Display device |
| JP2019128591A (en) * | 2018-01-19 | 2019-08-01 | 三星ディスプレイ株式會社Ｓａｍｓｕｎｇ Ｄｉｓｐｌａｙ Ｃｏ．，Ｌｔｄ． | Sink device and liquid crystal display device having the same |
-
1998
- 1998-01-20 JP JP872098A patent/JPH11202292A/en active Pending
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| US9852703B2 (en) | 2009-12-25 | 2017-12-26 | Semiconductor Energy Laboratory Co., Ltd. | Method for driving liquid crystal display device |
| US10255868B2 (en) | 2009-12-25 | 2019-04-09 | Semiconductor Energy Laboratory Co., Ltd. | Method for driving liquid crystal display device |
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| US9230994B2 (en) | 2010-09-15 | 2016-01-05 | Semiconductor Energy Laboratory Co., Ltd. | Liquid crystal display device |
| US9805676B2 (en) | 2012-11-28 | 2017-10-31 | Semiconductor Energy Laboratory Co., Ltd. | Display device |
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| US11763771B2 (en) | 2018-01-19 | 2023-09-19 | Samsung Display Co., Ltd. | Sink device with variable frame rate and display device including the same |
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