JPH1097385A - ディスク記録再生装置及び同装置に適用するインターフェース制御装置 - Google Patents
ディスク記録再生装置及び同装置に適用するインターフェース制御装置Info
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- JPH1097385A JPH1097385A JP8247791A JP24779196A JPH1097385A JP H1097385 A JPH1097385 A JP H1097385A JP 8247791 A JP8247791 A JP 8247791A JP 24779196 A JP24779196 A JP 24779196A JP H1097385 A JPH1097385 A JP H1097385A
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- G06F3/0628—Interfaces specially adapted for storage systems making use of a particular technique
- G06F3/0655—Vertical data movement, i.e. input-output transfer; data movement between one or more hosts and one or more storage devices
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- General Engineering & Computer Science (AREA)
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Abstract
(57)【要約】
【課題】一連のコマンド処理を複数の動作ブロックに相
当する複数のコマンド処理に分割して実行できるように
して、かつ各コマンド処理の動作状態を用意に把握でき
るようにして、ＨＤＣなどのインターフェース制御装置
の設計上の簡単化とコマンド処理機能に対する自由度を
高めることにある。 【解決手段】ホストコンピュータ２から発行されたコマ
ンドに対する一連のコマンド処理を複数のコマンド処理
に分割して、各コマンド処理を独立して実行可能なコマ
ンド処理部１２が、ＨＤＣ１に設けられている。コマン
ド処理部１２は状態レジスタにセットされた状態コード
に対応するコマンド処理を独立的に実行する。また、コ
マンド処理部１２は各コマンド処理の完了時点で状態レ
ジスタの状態コードを更新する。さらに、ＣＰＵ５は、
コマンド処理部１２の状態レジスタの制御により、リー
ド／ライトコマンド以外の特定コマンドに対する処理を
実行する。
当する複数のコマンド処理に分割して実行できるように
して、かつ各コマンド処理の動作状態を用意に把握でき
るようにして、ＨＤＣなどのインターフェース制御装置
の設計上の簡単化とコマンド処理機能に対する自由度を
高めることにある。 【解決手段】ホストコンピュータ２から発行されたコマ
ンドに対する一連のコマンド処理を複数のコマンド処理
に分割して、各コマンド処理を独立して実行可能なコマ
ンド処理部１２が、ＨＤＣ１に設けられている。コマン
ド処理部１２は状態レジスタにセットされた状態コード
に対応するコマンド処理を独立的に実行する。また、コ
マンド処理部１２は各コマンド処理の完了時点で状態レ
ジスタの状態コードを更新する。さらに、ＣＰＵ５は、
コマンド処理部１２の状態レジスタの制御により、リー
ド／ライトコマンド以外の特定コマンドに対する処理を
実行する。
Description
【０００１】
【発明の属する技術分野】本発明は、特にハードディス
ク装置等のディスク記録再生装置に適用し、ディスクド
ライブとホストコンピュータとのインターフェースを構
成するインターフェース制御装置に関する。
ク装置等のディスク記録再生装置に適用し、ディスクド
ライブとホストコンピュータとのインターフェースを構
成するインターフェース制御装置に関する。
【０００２】
【従来の技術】従来、例えばハードディスク装置等のデ
ィスク記録再生装置は、例えばパーソナルコンピュータ
の本体内に内蔵または外付けされて、コンピュータ本体
のＣＰＵ（以下ホストコンピュータと称する）からのコ
マンドに従って、記録媒体であるディスク上にデータを
記録し、ディスクからデータを再生する。以下、ハード
ディスク装置（ＨＤＤ）について説明する。
ィスク記録再生装置は、例えばパーソナルコンピュータ
の本体内に内蔵または外付けされて、コンピュータ本体
のＣＰＵ（以下ホストコンピュータと称する）からのコ
マンドに従って、記録媒体であるディスク上にデータを
記録し、ディスクからデータを再生する。以下、ハード
ディスク装置（ＨＤＤ）について説明する。
【０００３】ＨＤＤは、大別してディスクドライブのメ
イン機構と、メイン制御装置、およびディスクコントロ
ーラからなる。メイン機構とは、ディスクを固定して回
転するスピンドル機構およびヘッドを駆動するヘッド駆
動機構に大別される。メイン制御装置は、メイン機構を
制御するためのマイクロプロセッサ（ＣＰＵ）を主構成
要素とし、データの記録再生制御およびヘッドの駆動制
御（ディスク回転制御も含む）を行なう。
イン機構と、メイン制御装置、およびディスクコントロ
ーラからなる。メイン機構とは、ディスクを固定して回
転するスピンドル機構およびヘッドを駆動するヘッド駆
動機構に大別される。メイン制御装置は、メイン機構を
制御するためのマイクロプロセッサ（ＣＰＵ）を主構成
要素とし、データの記録再生制御およびヘッドの駆動制
御（ディスク回転制御も含む）を行なう。
【０００４】ディスクコントローラ（ＨＤＣ）は、ホス
トコンピュータとディスクドライブとのインターフェー
スを構成し、データの入出力制御（転送制御）を行なう
インターフェース制御装置である。ＨＤＣは、ホストコ
ンピュータとのホストインターフェース制御、リード／
ライトデータの転送制御、リード／ライトデータを保存
するバッファＲＡＭ（セクタバッファメモリ）の制御、
およびコマンド処理の各機能を有する。
トコンピュータとディスクドライブとのインターフェー
スを構成し、データの入出力制御（転送制御）を行なう
インターフェース制御装置である。ＨＤＣは、ホストコ
ンピュータとのホストインターフェース制御、リード／
ライトデータの転送制御、リード／ライトデータを保存
するバッファＲＡＭ（セクタバッファメモリ）の制御、
およびコマンド処理の各機能を有する。
【０００５】ＨＤＣは、いわばホストコンピュータから
発行されたコマンドを受付けると、一連のコマンド処理
を実行することにより、ホストコンピュータとディスク
ドライブ間のデータ転送を実行する。ここで、データ転
送は、バッファＲＡＭとホストコンピュータ間のデータ
転送およびバッファＲＡＭとディスク間のデータ転送か
らなる。コマンド処理には、コマンド受付処理から始ま
って、コマンド認識処理、ＢＵＳＹセット処理、キャッ
シュヒット判定処理、データ転送処理、コマンドアドレ
ス更新処理、割り込み発生処理、ＢＵＳＹクリア処理な
どの一連の動作からなる。以下、一連のコマンド処理つ
いて、ＣＰＵとバッファＲＡＭの関連動作も含めて説明
する。
発行されたコマンドを受付けると、一連のコマンド処理
を実行することにより、ホストコンピュータとディスク
ドライブ間のデータ転送を実行する。ここで、データ転
送は、バッファＲＡＭとホストコンピュータ間のデータ
転送およびバッファＲＡＭとディスク間のデータ転送か
らなる。コマンド処理には、コマンド受付処理から始ま
って、コマンド認識処理、ＢＵＳＹセット処理、キャッ
シュヒット判定処理、データ転送処理、コマンドアドレ
ス更新処理、割り込み発生処理、ＢＵＳＹクリア処理な
どの一連の動作からなる。以下、一連のコマンド処理つ
いて、ＣＰＵとバッファＲＡＭの関連動作も含めて説明
する。
【０００６】まず、ホストコンピュータからコマンドが
発行されると、ＨＤＣはコマンドを受付けて、コマンド
を認識する処理を実行する。このとき、ディスクドライ
ブがＢＵＳＹ状態（コマンド実行中）であることを示す
ＢＵＳＹフラグを、ＨＤＣの内部にあるコントロールレ
ジスタにセットする（ＢＵＳＹセット処理）。コントロ
ールレジスタは、ホストコンピュータが参照できるステ
ータスレジスタなどのレジスタ群である。ステータスレ
ジスタには、ＢＵＳＹフラグ以外に、例えば前回のコマ
ンド実行でエラーが発生したことを示すエラーフラグ、
データ転送の要求を示すフラグ、ディスクドライブがＲ
ＥＡＤＹ状態（コマンド待機状態）であることを示すフ
ラグなどがセットされる。
発行されると、ＨＤＣはコマンドを受付けて、コマンド
を認識する処理を実行する。このとき、ディスクドライ
ブがＢＵＳＹ状態（コマンド実行中）であることを示す
ＢＵＳＹフラグを、ＨＤＣの内部にあるコントロールレ
ジスタにセットする（ＢＵＳＹセット処理）。コントロ
ールレジスタは、ホストコンピュータが参照できるステ
ータスレジスタなどのレジスタ群である。ステータスレ
ジスタには、ＢＵＳＹフラグ以外に、例えば前回のコマ
ンド実行でエラーが発生したことを示すエラーフラグ、
データ転送の要求を示すフラグ、ディスクドライブがＲ
ＥＡＤＹ状態（コマンド待機状態）であることを示すフ
ラグなどがセットされる。
【０００７】ＨＤＣは、コマンド認識処理によりライト
コマンド、リードコマンド、またはそれ以外の特定コマ
ンドであるかを認識し、リード／ライトコマンド以外の
特定コマンドの場合にはＣＰＵの制御に移行する。リー
ド／ライトコマンドの場合には、キャッシュヒット判定
処理を実行する。キャッシュヒット判定処理は、以前に
同一アドレスに対するアクセスがあったか否かを判定す
る。具体的には、ライトコマンドの場合には、バッファ
ＲＡＭにアクセス対象のアドレスが確保されているか否
かを判定する。確保されていれば（ヒットすれば）、Ｈ
ＤＣはホストコンピュータから転送されるライトデータ
をバッファＲＡＭに保存する。また、リードコマンドの
場合には、バッファＲＡＭのアクセス対象のアドレスに
リードデータが保存されているか否かを判定する。保存
されていれば（ヒットすれば）、ＨＤＣはバッファＲＡ
Ｍからホストコンピュータにリードデータを転送する。
コマンド、リードコマンド、またはそれ以外の特定コマ
ンドであるかを認識し、リード／ライトコマンド以外の
特定コマンドの場合にはＣＰＵの制御に移行する。リー
ド／ライトコマンドの場合には、キャッシュヒット判定
処理を実行する。キャッシュヒット判定処理は、以前に
同一アドレスに対するアクセスがあったか否かを判定す
る。具体的には、ライトコマンドの場合には、バッファ
ＲＡＭにアクセス対象のアドレスが確保されているか否
かを判定する。確保されていれば（ヒットすれば）、Ｈ
ＤＣはホストコンピュータから転送されるライトデータ
をバッファＲＡＭに保存する。また、リードコマンドの
場合には、バッファＲＡＭのアクセス対象のアドレスに
リードデータが保存されているか否かを判定する。保存
されていれば（ヒットすれば）、ＨＤＣはバッファＲＡ
Ｍからホストコンピュータにリードデータを転送する。
【０００８】なお、ＨＤＣは、ＣＰＵによりデータ転送
の準備ができた後に、ＣＰＵからのデータ転送指示に応
じてデータ転送処理を実行する。また、キャッシュヒッ
ト判定処理によりヒットしない場合には、ＣＰＵにより
ライトデータの受取りの準備ができた後に、ＨＤＣはラ
イトデータをバッファＲＡＭに保存する。また、ＣＰＵ
によりディスクから読出されたリードデータをバッファ
ＲＡＭに保存する。
の準備ができた後に、ＣＰＵからのデータ転送指示に応
じてデータ転送処理を実行する。また、キャッシュヒッ
ト判定処理によりヒットしない場合には、ＣＰＵにより
ライトデータの受取りの準備ができた後に、ＨＤＣはラ
イトデータをバッファＲＡＭに保存する。また、ＣＰＵ
によりディスクから読出されたリードデータをバッファ
ＲＡＭに保存する。
【０００９】さらに、ＨＤＣはコマンドアドレスを更新
して、ＣＰＵからのコマンド終了指示があった後にＢＵ
ＳＹフラグをクリアし、コマンド受付状態に移行する。
即ち、ステータスレジスタには、ディスクドライブがＲ
ＥＡＤＹ状態であることを示すフラグをセットする。
して、ＣＰＵからのコマンド終了指示があった後にＢＵ
ＳＹフラグをクリアし、コマンド受付状態に移行する。
即ち、ステータスレジスタには、ディスクドライブがＲ
ＥＡＤＹ状態であることを示すフラグをセットする。
【００１０】
【発明が解決しようとする課題】以上のようにＨＤＣ
は、ホストコンピュータからコマンドを受付けてから、
一連のコマンド処理を逐次的に実行し、コマンド処理の
内容に従って各種フラグを変化させている。しかしなが
ら、このような一連のコマンド処理の逐次的実行を行な
う方式は、多数の条件フラグを用意し、この条件フラグ
に従って各種の動作を実行するため、ＨＤＣの構成は複
雑化している。このため、ＨＤＣを設計する段階におい
て、処理工程の不具合を発見するのは極めて困難であ
り、また、設計後に不具合が発見されても、例えばＣＰ
Ｕにより不具合を修正して、代替的にコマンド処理の一
部を実行するようなことは不可能である。このような問
題を解消するためには、一連のコマンド処理を複数のコ
マンド処理（または動作ブロック）に分割して、それぞ
れの各コマンド処理を独立して実行し、かつ各コマンド
処理の動作状態をＣＰＵにより参照できる方式が望まし
いが、従来では実現されていない。
は、ホストコンピュータからコマンドを受付けてから、
一連のコマンド処理を逐次的に実行し、コマンド処理の
内容に従って各種フラグを変化させている。しかしなが
ら、このような一連のコマンド処理の逐次的実行を行な
う方式は、多数の条件フラグを用意し、この条件フラグ
に従って各種の動作を実行するため、ＨＤＣの構成は複
雑化している。このため、ＨＤＣを設計する段階におい
て、処理工程の不具合を発見するのは極めて困難であ
り、また、設計後に不具合が発見されても、例えばＣＰ
Ｕにより不具合を修正して、代替的にコマンド処理の一
部を実行するようなことは不可能である。このような問
題を解消するためには、一連のコマンド処理を複数のコ
マンド処理（または動作ブロック）に分割して、それぞ
れの各コマンド処理を独立して実行し、かつ各コマンド
処理の動作状態をＣＰＵにより参照できる方式が望まし
いが、従来では実現されていない。
【００１１】そこで、本発明の目的は、一連のコマンド
処理を複数の動作ブロックに相当する複数のコマンド処
理に分割して実行できるようにして、かつ各コマンド処
理の動作状態を容易に把握できるようにして、ＨＤＣな
どのインターフェース制御装置の設計上の簡単化とコマ
ンド処理機能に対する自由度を高めることにある。
処理を複数の動作ブロックに相当する複数のコマンド処
理に分割して実行できるようにして、かつ各コマンド処
理の動作状態を容易に把握できるようにして、ＨＤＣな
どのインターフェース制御装置の設計上の簡単化とコマ
ンド処理機能に対する自由度を高めることにある。
【００１２】
【課題を解決するための手段】本発明は、ホストコンピ
ュータからのコマンドに基づいて、記録媒体であるディ
スクに対してデータの記録再生を行なうディスク記録再
生装置に適用し、ホストコンピュータから発行されたコ
マンドに対する一連のコマンド処理を複数のコマンド処
理に分割して、各コマンド処理を独立して実行可能なコ
マンド処理手段と、各コマンド処理毎に設定された動作
状態を示す状態コードをセットするための状態レジスタ
手段と、状態レジスタ手段にセットされた状態コードに
対応するコマンド処理を実行させて、各コマンド処理の
完了時点で状態レジスタ手段を更新する制御手段とを備
えたものである。
ュータからのコマンドに基づいて、記録媒体であるディ
スクに対してデータの記録再生を行なうディスク記録再
生装置に適用し、ホストコンピュータから発行されたコ
マンドに対する一連のコマンド処理を複数のコマンド処
理に分割して、各コマンド処理を独立して実行可能なコ
マンド処理手段と、各コマンド処理毎に設定された動作
状態を示す状態コードをセットするための状態レジスタ
手段と、状態レジスタ手段にセットされた状態コードに
対応するコマンド処理を実行させて、各コマンド処理の
完了時点で状態レジスタ手段を更新する制御手段とを備
えたものである。
【００１３】これらのコマンド処理手段、状態レジスタ
手段、および制御手段は、例えばハードディスク装置の
ディスクコントローラなどのインターフェース制御装置
に設けられている。状態レジスタ手段は、ディスクに対
するデータの記録再生の制御を行なうためのＣＰＵによ
り状態コードを参照または変更することが可能になって
いる。
手段、および制御手段は、例えばハードディスク装置の
ディスクコントローラなどのインターフェース制御装置
に設けられている。状態レジスタ手段は、ディスクに対
するデータの記録再生の制御を行なうためのＣＰＵによ
り状態コードを参照または変更することが可能になって
いる。
【００１４】このような構成により、ホストコンピュー
タからコマンドを受付てからの一連のコマンド処理を、
状態レジスタ手段の状態コードを変化させることによ
り、各コマンド処理をそれぞれ独立的に実行させること
ができる。さらに、ＣＰＵは、状態レジスタ手段を参照
することにより、常にコマンド処理の動作状態を把握す
ることができる。また、ＣＰＵは、状態レジスタ手段の
状態コードを変更することにより、例えばホストコンピ
ュータからの特定コマンドを認識して、インターフェー
ス制御装置を介して特定コマンドを処理することができ
る。従って、コマンド処理機能に関係する設計を行なう
場合に、各処理毎に内容を検討し、処理内容の変更や修
正が容易となる。また、新たなコマンド処理を追加した
り、またＣＰＵにより特定コマンド処理を行なうような
機能を追加することも容易であるため、結果的にコマン
ド処理機能に対する自由度を高めることができる。
タからコマンドを受付てからの一連のコマンド処理を、
状態レジスタ手段の状態コードを変化させることによ
り、各コマンド処理をそれぞれ独立的に実行させること
ができる。さらに、ＣＰＵは、状態レジスタ手段を参照
することにより、常にコマンド処理の動作状態を把握す
ることができる。また、ＣＰＵは、状態レジスタ手段の
状態コードを変更することにより、例えばホストコンピ
ュータからの特定コマンドを認識して、インターフェー
ス制御装置を介して特定コマンドを処理することができ
る。従って、コマンド処理機能に関係する設計を行なう
場合に、各処理毎に内容を検討し、処理内容の変更や修
正が容易となる。また、新たなコマンド処理を追加した
り、またＣＰＵにより特定コマンド処理を行なうような
機能を追加することも容易であるため、結果的にコマン
ド処理機能に対する自由度を高めることができる。
【００１５】
【発明の実施の形態】以下図面を参照して本発明の実施
の形態を説明する。図１は本実施形態に関係するシステ
ム構成を示すブロック図であり、図２は本実施形態に関
係するＨＤＣの要部を示すブロック図であり、図３は本
実施形態のライトコマンド処理を説明するためのフロー
チャートであり、図４は本実施形態のリードコマンド処
理を説明するためのフローチャートであり、図５は本実
施形態に関係する状態レジスタの変化を示す概念図であ
る。 （システム構成）本実施形態は、ハードディスク装置
（ＨＤＤ）のインターフェース制御装置であるディスク
コントローラ（ＨＤＣ）１を想定する。ＨＤＣ１は、図
１に示すように、ホストインターフェース制御部１０
と、データ制御部１３と、バッファ制御部１４とを有す
る。データ制御部１３は、いわばディスクドライブ（デ
ィスク３とヘッドの駆動機構）とのインターフェース部
であり、主としてディスク３に対するライトデータとリ
ードデータの転送を制御する。ここで、ディスク３はス
ピンドルモータにより回転されている。さらに、ディス
ク３はボイスコイルモータにより駆動するヘッドによ
り、データの記録再生がなされる。
の形態を説明する。図１は本実施形態に関係するシステ
ム構成を示すブロック図であり、図２は本実施形態に関
係するＨＤＣの要部を示すブロック図であり、図３は本
実施形態のライトコマンド処理を説明するためのフロー
チャートであり、図４は本実施形態のリードコマンド処
理を説明するためのフローチャートであり、図５は本実
施形態に関係する状態レジスタの変化を示す概念図であ
る。 （システム構成）本実施形態は、ハードディスク装置
（ＨＤＤ）のインターフェース制御装置であるディスク
コントローラ（ＨＤＣ）１を想定する。ＨＤＣ１は、図
１に示すように、ホストインターフェース制御部１０
と、データ制御部１３と、バッファ制御部１４とを有す
る。データ制御部１３は、いわばディスクドライブ（デ
ィスク３とヘッドの駆動機構）とのインターフェース部
であり、主としてディスク３に対するライトデータとリ
ードデータの転送を制御する。ここで、ディスク３はス
ピンドルモータにより回転されている。さらに、ディス
ク３はボイスコイルモータにより駆動するヘッドによ
り、データの記録再生がなされる。
【００１６】バッファ制御部１４は、ライトデータとリ
ードデータを一時的に保存するためのバッファＲＡＭ４
を制御する。バッファＲＡＭ４はセクタバッファとも呼
ばれており、ホストコンピュータ２から転送されたライ
トデータを保存し、またディスク３から読出されたリー
ドデータを保存する。バッファＲＡＭ４はデータ転送用
のバッファメモリ機能（ホストコンピュータ２とディス
ク３間のデータ転送速度の差異の吸収機能）だけでな
く、後述するキャッシュメモリ機能（コマンドの実行速
度の高速化機能）も備えている。
ードデータを一時的に保存するためのバッファＲＡＭ４
を制御する。バッファＲＡＭ４はセクタバッファとも呼
ばれており、ホストコンピュータ２から転送されたライ
トデータを保存し、またディスク３から読出されたリー
ドデータを保存する。バッファＲＡＭ４はデータ転送用
のバッファメモリ機能（ホストコンピュータ２とディス
ク３間のデータ転送速度の差異の吸収機能）だけでな
く、後述するキャッシュメモリ機能（コマンドの実行速
度の高速化機能）も備えている。
【００１７】ホストインターフェース制御部１０は、ホ
ストコンピュータ２とのインターフェース部であり、イ
ンターフェース１１を介してデータ及びコマンドの交換
を行なう。さらに、ホストインターフェース制御部１０
は、本発明に関係するコマンド処理部１２を有する。本
実施形態では、コマンド処理部１２はＣＰＵ５との間
で、コマンドや状態コードなどの制御データの交換を行
なう。
ストコンピュータ２とのインターフェース部であり、イ
ンターフェース１１を介してデータ及びコマンドの交換
を行なう。さらに、ホストインターフェース制御部１０
は、本発明に関係するコマンド処理部１２を有する。本
実施形態では、コマンド処理部１２はＣＰＵ５との間
で、コマンドや状態コードなどの制御データの交換を行
なう。
【００１８】ＣＰＵ５は、前述したように、ディスクド
ライブのメイン制御装置を構成するマイクロプロセッサ
であり、ディスク３に対するデータ記録再生制御に必要
な各種の制御動作を実行する。また、本実施形態では、
ＣＰＵ５は、後述するように、ライトコマンドとリード
コマンド以外の特定コマンドを処理する機能を備えてい
る（本実施形態の変形例を参照）。 （コマンド処理部の構成）コマンド処理部１２は具体的
には、図２に示すように、一連のコマンド処理を行なう
ための回路群２３〜２９、インターフェース回路２０、
および状態制御回路２１を備えている。インターフェー
ス回路２０は、ホストコンピュータ２とのインターフェ
ース１１を含み、全てのコマンド処理に共通に使用され
るコントロールレジスタ回路を有する。インターフェー
ス１１は、ホストコンピュータ２から設定されるコマン
ド実行アドレスを保持するレジスタ、コマンド内容の情
報を保持するレジスタ、ホストコンピュータ２に対する
割り込み信号出力を行なうための回路、レジスタアクセ
ス応答のための回路などを含む。コントロールレジスタ
回路は、ヒットアドレス登録レジスタ、実行アドレス保
存レジスタ（論理ブロックアドレスの保存レジスタ）、
ライトコマンドフラグを保持するレジスタ、ヒットフラ
グを保持するレジスタなどのフラグレジスタ群からな
る。
ライブのメイン制御装置を構成するマイクロプロセッサ
であり、ディスク３に対するデータ記録再生制御に必要
な各種の制御動作を実行する。また、本実施形態では、
ＣＰＵ５は、後述するように、ライトコマンドとリード
コマンド以外の特定コマンドを処理する機能を備えてい
る（本実施形態の変形例を参照）。 （コマンド処理部の構成）コマンド処理部１２は具体的
には、図２に示すように、一連のコマンド処理を行なう
ための回路群２３〜２９、インターフェース回路２０、
および状態制御回路２１を備えている。インターフェー
ス回路２０は、ホストコンピュータ２とのインターフェ
ース１１を含み、全てのコマンド処理に共通に使用され
るコントロールレジスタ回路を有する。インターフェー
ス１１は、ホストコンピュータ２から設定されるコマン
ド実行アドレスを保持するレジスタ、コマンド内容の情
報を保持するレジスタ、ホストコンピュータ２に対する
割り込み信号出力を行なうための回路、レジスタアクセ
ス応答のための回路などを含む。コントロールレジスタ
回路は、ヒットアドレス登録レジスタ、実行アドレス保
存レジスタ（論理ブロックアドレスの保存レジスタ）、
ライトコマンドフラグを保持するレジスタ、ヒットフラ
グを保持するレジスタなどのフラグレジスタ群からな
る。
【００１９】本発明のコマンド処理部１２は、一連のコ
マンド処理を複数の動作ブロックに分割し、各動作ブロ
ックに対応するコマンド処理をそれぞれ独立して実行で
きるように構成されている。具体的には、図２に示すよ
うに、各動作ブロックに対応するコマンド処理を実行す
るための回路群２３〜２９およびそれらを制御するため
の状態制御回路２１を有する。以下、各回路２１，２３
〜２９の機能について説明する。
マンド処理を複数の動作ブロックに分割し、各動作ブロ
ックに対応するコマンド処理をそれぞれ独立して実行で
きるように構成されている。具体的には、図２に示すよ
うに、各動作ブロックに対応するコマンド処理を実行す
るための回路群２３〜２９およびそれらを制御するため
の状態制御回路２１を有する。以下、各回路２１，２３
〜２９の機能について説明する。
【００２０】状態制御回路２１は状態レジスタ２２を有
し、各回路２３〜２９の動作状態（コマンド処理状態）
を示す状態コード（３ビットのＸＸＸ）を状態レジスタ
２２に保持し、この状態コードに基づいて各回路２３〜
２９の動作を許可するためのイネーブル信号を出力す
る。状態コードは、後述するように、各回路２３〜２９
と１対１に対応するように設定されている。従って、各
回路２３〜２９は同時に動作することはない。
し、各回路２３〜２９の動作状態（コマンド処理状態）
を示す状態コード（３ビットのＸＸＸ）を状態レジスタ
２２に保持し、この状態コードに基づいて各回路２３〜
２９の動作を許可するためのイネーブル信号を出力す
る。状態コードは、後述するように、各回路２３〜２９
と１対１に対応するように設定されている。従って、各
回路２３〜２９は同時に動作することはない。
【００２１】状態レジスタ２２は、各回路２３〜２９か
らの変更要求に従って、状態制御回路２１により状態コ
ードが変更される。また、各回路２３〜２９が直接に状
態コードを変更してもよい。さらに、後述するように、
状態レジスタ２２は、ＣＰＵ５により参照されて、かつ
状態コードの書き込み、変更がなされるように構成され
ている。
らの変更要求に従って、状態制御回路２１により状態コ
ードが変更される。また、各回路２３〜２９が直接に状
態コードを変更してもよい。さらに、後述するように、
状態レジスタ２２は、ＣＰＵ５により参照されて、かつ
状態コードの書き込み、変更がなされるように構成され
ている。
【００２２】コマンド待ち回路２３は、ホストコンピュ
ータ２からのコマンド発行を監視するための回路であ
り、本実施形態では状態レジスタ２２の状態コードが
「０００」のときに動作する。コマンド待ち回路２３
は、コマンドの発行を確認すると、状態レジスタ２２の
状態コードを「００１」に変更する変更要求を出力す
る。以下、本実施形態では、便宜的に各回路２３〜２９
が直接に、状態レジスタ２２の状態コードを変更するよ
うに記述する。コマンド待ち回路２３は、コマンド処理
が終了して、状態レジスタ２２の状態コードが「００
０」に変化したときに、ＢＵＳＹステータスのクリアや
ホストコンピュータ２に対する割り込み発生（インター
フェース回路２０の割り込み信号出力の回路を使用す
る）も行なう。
ータ２からのコマンド発行を監視するための回路であ
り、本実施形態では状態レジスタ２２の状態コードが
「０００」のときに動作する。コマンド待ち回路２３
は、コマンドの発行を確認すると、状態レジスタ２２の
状態コードを「００１」に変更する変更要求を出力す
る。以下、本実施形態では、便宜的に各回路２３〜２９
が直接に、状態レジスタ２２の状態コードを変更するよ
うに記述する。コマンド待ち回路２３は、コマンド処理
が終了して、状態レジスタ２２の状態コードが「００
０」に変化したときに、ＢＵＳＹステータスのクリアや
ホストコンピュータ２に対する割り込み発生（インター
フェース回路２０の割り込み信号出力の回路を使用す
る）も行なう。
【００２３】コマンド受付回路２４は、発行されたコマ
ンドを受付けて、その内容を判断するコマンド認識処理
を行なう回路である。コマンド受付回路２４は、状態レ
ジスタ２２の状態コードが「００１」のときに動作し、
ホストコンピュータ２に対するＢＵＳＹフラグ（コマン
ド実行状態を示すフラグ）をセットし、コマンドの種類
に従って状態コードを変更する。具体的には、ディスク
３に対してアクセスし、ホストコンピュータ２とのデー
タ転送動作を伴うコマンド（ライトコマンドとリードコ
マンド）の場合には、状態コードを「０１０」に変更
し、それ以外のコマンド（後述する特定コマンド等）の
場合には状態コードを「１１０」に変更する。
ンドを受付けて、その内容を判断するコマンド認識処理
を行なう回路である。コマンド受付回路２４は、状態レ
ジスタ２２の状態コードが「００１」のときに動作し、
ホストコンピュータ２に対するＢＵＳＹフラグ（コマン
ド実行状態を示すフラグ）をセットし、コマンドの種類
に従って状態コードを変更する。具体的には、ディスク
３に対してアクセスし、ホストコンピュータ２とのデー
タ転送動作を伴うコマンド（ライトコマンドとリードコ
マンド）の場合には、状態コードを「０１０」に変更
し、それ以外のコマンド（後述する特定コマンド等）の
場合には状態コードを「１１０」に変更する。
【００２４】アドレス変換回路２５は、状態コードが
「０１０」のときに動作し、ホストコンピュータ２から
のアクセス対象アドレスを、所定のアドレスに変換する
回路である。具体的には、ホストコンピュータ２からの
アドレス指定が、シリンダ番号、ヘッド番号、セクタ番
号からなる物理アドレス（ＣＨＳ）の場合に、そのＣＨ
Ｓを連続アドレスである論理ブロックアドレス（ＬＢ
Ａ）に変換する。アドレス変換回路２５は状態コードを
「０１１」に変更する。
「０１０」のときに動作し、ホストコンピュータ２から
のアクセス対象アドレスを、所定のアドレスに変換する
回路である。具体的には、ホストコンピュータ２からの
アドレス指定が、シリンダ番号、ヘッド番号、セクタ番
号からなる物理アドレス（ＣＨＳ）の場合に、そのＣＨ
Ｓを連続アドレスである論理ブロックアドレス（ＬＢ
Ａ）に変換する。アドレス変換回路２５は状態コードを
「０１１」に変更する。
【００２５】キャッシュヒット判定回路２６は、状態コ
ードが「０１１」のときに動作し、前回のコマンド終了
時に登録されているアドレス（キャッシュヒットアドレ
スＬＢＡ）と今回のアクセス要求のアドレス（ＬＢＡ）
とを比較し、ヒットするか否かを判定する。キャッシュ
ヒット判定回路２６は、ヒットしたときに、ライトコマ
ンドの場合には状態コードを「１０１」に変更し、リー
ドコマンドの場合には状態コードを「１００」に変更す
る。また、ヒットしないときには、状態コードを「１１
０」に変更する。
ードが「０１１」のときに動作し、前回のコマンド終了
時に登録されているアドレス（キャッシュヒットアドレ
スＬＢＡ）と今回のアクセス要求のアドレス（ＬＢＡ）
とを比較し、ヒットするか否かを判定する。キャッシュ
ヒット判定回路２６は、ヒットしたときに、ライトコマ
ンドの場合には状態コードを「１０１」に変更し、リー
ドコマンドの場合には状態コードを「１００」に変更す
る。また、ヒットしないときには、状態コードを「１１
０」に変更する。
【００２６】リードデータ転送回路２７は、状態コード
が「１００」のときに動作し、バッファＲＡＭ４に保存
されているリードデータをホストコンピュータ２に転送
する処理を行なう回路である。リードデータ転送回路２
７は、通常ではセクタ単位のリードデータを転送する毎
に、コマンド実行アドレスを更新し、アクセス要求され
たリードデータの転送完了後に、状態コードを「００
０」に変更する。
が「１００」のときに動作し、バッファＲＡＭ４に保存
されているリードデータをホストコンピュータ２に転送
する処理を行なう回路である。リードデータ転送回路２
７は、通常ではセクタ単位のリードデータを転送する毎
に、コマンド実行アドレスを更新し、アクセス要求され
たリードデータの転送完了後に、状態コードを「００
０」に変更する。
【００２７】ライトデータ転送回路２８は、状態コード
が「１０１」のときに動作し、ホストコンピュータ２か
らのライトデータをバッファＲＡＭ４に転送して保存す
る回路である。ライトデータ転送回路２８は、通常では
セクタ単位のライトデータを受信する毎に、コマンド実
行アドレスを更新し、ライトアクセス要求されたライト
データの受信完了後に、状態コードを「０００」に変更
する。
が「１０１」のときに動作し、ホストコンピュータ２か
らのライトデータをバッファＲＡＭ４に転送して保存す
る回路である。ライトデータ転送回路２８は、通常では
セクタ単位のライトデータを受信する毎に、コマンド実
行アドレスを更新し、ライトアクセス要求されたライト
データの受信完了後に、状態コードを「０００」に変更
する。
【００２８】さらに、コマンド終了待ち回路２９は、状
態コードが「１１０」のときに動作し、ＣＰＵ５による
制御待ちを行なう回路である。コマンド終了待ち回路２
９は、ＣＰＵ５による状態レジスタ２１の操作を待ち、
自身では状態コードの変更（変更要求）を行なわない。 （本実施形態のコマンド処理）以下、図３〜図５を参照
して本実施形態の動作を説明する。まず、図３のフロー
チャートに示すように、ホストコンピュータ２からデー
タの記録要求があった場合について、図５の状態レジス
タ２２の変化を参照しながら説明する。
態コードが「１１０」のときに動作し、ＣＰＵ５による
制御待ちを行なう回路である。コマンド終了待ち回路２
９は、ＣＰＵ５による状態レジスタ２１の操作を待ち、
自身では状態コードの変更（変更要求）を行なわない。 （本実施形態のコマンド処理）以下、図３〜図５を参照
して本実施形態の動作を説明する。まず、図３のフロー
チャートに示すように、ホストコンピュータ２からデー
タの記録要求があった場合について、図５の状態レジス
タ２２の変化を参照しながら説明する。
【００２９】コマンド発行待ちの状態では、図５（Ａ）
に示すように、状態レジスタ２２には状態コード「００
０」がセットされている。コマンド待ち回路２３は、ホ
ストコンピュータ２からライトコマンドが発行される
と、それを検知して状態レジスタ２２の状態コードを
「００１」にセットする（図５（Ｂ）を参照）。
に示すように、状態レジスタ２２には状態コード「００
０」がセットされている。コマンド待ち回路２３は、ホ
ストコンピュータ２からライトコマンドが発行される
と、それを検知して状態レジスタ２２の状態コードを
「００１」にセットする（図５（Ｂ）を参照）。
【００３０】コマンド受付回路２４は、状態コード「０
０１」によりコマンド受付け動作を実行し、ホストコン
ピュータ２に対してコマンド処理を開始すること（また
は実行中）を示すために、コントロールレジスタのＢＵ
ＳＹフラグをセットする（ステップＳ１）。さらに、コ
マンド受付回路２４はコマンド認識処理を実行し、ホス
トコンピュータ２が発行したコマンドがライトコマンド
であることを認識する（ステップＳ２，Ｓ３）。コマン
ド受付回路２４はライトコマンドの場合には状態レジス
タ２２の状態コードを「０１０」に変更する（図５
（Ｃ）を参照）。ここで、ホストコンピュータ２から発
行されたコマンドが、リード／ライトコマンド以外の特
定コマンドの場合には、コマンド受付回路２４は状態コ
ードを「１１０」に変更する。
０１」によりコマンド受付け動作を実行し、ホストコン
ピュータ２に対してコマンド処理を開始すること（また
は実行中）を示すために、コントロールレジスタのＢＵ
ＳＹフラグをセットする（ステップＳ１）。さらに、コ
マンド受付回路２４はコマンド認識処理を実行し、ホス
トコンピュータ２が発行したコマンドがライトコマンド
であることを認識する（ステップＳ２，Ｓ３）。コマン
ド受付回路２４はライトコマンドの場合には状態レジス
タ２２の状態コードを「０１０」に変更する（図５
（Ｃ）を参照）。ここで、ホストコンピュータ２から発
行されたコマンドが、リード／ライトコマンド以外の特
定コマンドの場合には、コマンド受付回路２４は状態コ
ードを「１１０」に変更する。
【００３１】アドレス変換回路２５は、状態コード「０
１０」により動作し、ホストコンピュータ２が指定した
コマンド実行アドレスがシリンダ番号、ヘッド番号、セ
クタ番号からなる物理アドレス（ＣＨＳ）の場合に、連
続アドレスである論理ブロックアドレス（ＬＢＡ）に変
換する（ステップＳ４）。アドレス変換回路２５は、変
換した論理ブロックアドレス（ＬＢＡ）を、コントロー
ルレジスタ回路の実行アドレス保持レジスタにセット
し、状態コードを「０１１」に変更する（図５（Ｄ）を
参照）。
１０」により動作し、ホストコンピュータ２が指定した
コマンド実行アドレスがシリンダ番号、ヘッド番号、セ
クタ番号からなる物理アドレス（ＣＨＳ）の場合に、連
続アドレスである論理ブロックアドレス（ＬＢＡ）に変
換する（ステップＳ４）。アドレス変換回路２５は、変
換した論理ブロックアドレス（ＬＢＡ）を、コントロー
ルレジスタ回路の実行アドレス保持レジスタにセット
し、状態コードを「０１１」に変更する（図５（Ｄ）を
参照）。
【００３２】キャッシュヒット判定回路２６は状態コー
ド「０１１」により動作し、前回のコマンド終了時に登
録されているアドレス（ＬＢＡ）と今回のアクセス要求
のアドレス（ＬＢＡ）とを比較し、ヒットするか否かを
判定する（ステップＳ５）。前回のアドレス（ＬＢＡ）
はライトコマンド終了時に、ヒットアドレス登録レジス
タに登録されている。キャッシュヒット判定回路２６
は、ヒットしたときには、状態コードを「１０１」に変
更し、ヒットしないときには状態コードを「１１０」に
変更する（図５（Ｅ），（Ｇ）を参照）。なお、リード
コマンドの場合、ヒットしたときには状態コードを「１
００」に変更する。
ド「０１１」により動作し、前回のコマンド終了時に登
録されているアドレス（ＬＢＡ）と今回のアクセス要求
のアドレス（ＬＢＡ）とを比較し、ヒットするか否かを
判定する（ステップＳ５）。前回のアドレス（ＬＢＡ）
はライトコマンド終了時に、ヒットアドレス登録レジス
タに登録されている。キャッシュヒット判定回路２６
は、ヒットしたときには、状態コードを「１０１」に変
更し、ヒットしないときには状態コードを「１１０」に
変更する（図５（Ｅ），（Ｇ）を参照）。なお、リード
コマンドの場合、ヒットしたときには状態コードを「１
００」に変更する。
【００３３】キャッシュヒット判定回路２６の判定がヒ
ットの場合には、ライトデータ転送回路２８は、ホスト
コンピュータ２からセクタ単位のライトデータを受信す
る毎に、バッファＲＡＭ４に格納して、コマンド実行ア
ドレスを更新する（ステップＳ６のＹＥＳ，Ｓ７）。ラ
イトデータ転送回路２８は、ホストコンピュータ２が要
求した全てのライトデータをバッファＲＡＭ４に格納し
た時点で、状態レジスタ２２の状態コードを「０００」
にセットする（図５（Ｆ）を参照）。
ットの場合には、ライトデータ転送回路２８は、ホスト
コンピュータ２からセクタ単位のライトデータを受信す
る毎に、バッファＲＡＭ４に格納して、コマンド実行ア
ドレスを更新する（ステップＳ６のＹＥＳ，Ｓ７）。ラ
イトデータ転送回路２８は、ホストコンピュータ２が要
求した全てのライトデータをバッファＲＡＭ４に格納し
た時点で、状態レジスタ２２の状態コードを「０００」
にセットする（図５（Ｆ）を参照）。
【００３４】コマンド終了待ち回路２９は、状態コード
「０００」により動作し、ライトコマンド処理の終了に
伴って、ＢＵＳＹフラグのクリアおよびホストコンピュ
ータ２に対する割り込み信号の出力を行なう（ステップ
Ｓ８）。ここで、コマンド終了待ち回路２９は、状態レ
ジスタ２２の状態コードが「０００」以外の状態コード
から状態コード「０００」に変化したときに、前記のコ
マンド終了処理を実行する。なお、コマンド終了待ち回
路２９は、ＣＰＵ５による状態レジスタ２１の操作を待
ち、自身では状態コードの変更（変更要求）を行なわな
い。
「０００」により動作し、ライトコマンド処理の終了に
伴って、ＢＵＳＹフラグのクリアおよびホストコンピュ
ータ２に対する割り込み信号の出力を行なう（ステップ
Ｓ８）。ここで、コマンド終了待ち回路２９は、状態レ
ジスタ２２の状態コードが「０００」以外の状態コード
から状態コード「０００」に変化したときに、前記のコ
マンド終了処理を実行する。なお、コマンド終了待ち回
路２９は、ＣＰＵ５による状態レジスタ２１の操作を待
ち、自身では状態コードの変更（変更要求）を行なわな
い。
【００３５】一方、キャッシュヒット判定回路２６の判
定がヒットでない場合に、図５（Ｇ）に示すように、状
態レジスタ２２の状態コードは「１１０」にセットされ
ている。この状態コード「１１０」では、ＣＰＵ５が状
態レジスタ２２の内容を変更しない限り、コマンド処理
部１２は動作停止状態となる。ＣＰＵ５は、インターフ
ェース回路２０のコントロールレジスタ回路により、ホ
ストコンピュータ２からライトコマンドが発行されてい
ることを認識している。そこで、ＣＰＵ５は、バッファ
ＲＡＭ４にライトデータを格納するための準備動作を実
行する（ステップＳ９）。即ち、前回のライトコマンド
によりバッファＲＡＭ４に格納されているライトデータ
がディスク３に記録されるまで待機し、ディスク３への
記録が完了した時点で、ＣＰＵ５は状態レジスタ２２に
状態コード「１０１」をセットする（図５（Ｈ）を参
照）。
定がヒットでない場合に、図５（Ｇ）に示すように、状
態レジスタ２２の状態コードは「１１０」にセットされ
ている。この状態コード「１１０」では、ＣＰＵ５が状
態レジスタ２２の内容を変更しない限り、コマンド処理
部１２は動作停止状態となる。ＣＰＵ５は、インターフ
ェース回路２０のコントロールレジスタ回路により、ホ
ストコンピュータ２からライトコマンドが発行されてい
ることを認識している。そこで、ＣＰＵ５は、バッファ
ＲＡＭ４にライトデータを格納するための準備動作を実
行する（ステップＳ９）。即ち、前回のライトコマンド
によりバッファＲＡＭ４に格納されているライトデータ
がディスク３に記録されるまで待機し、ディスク３への
記録が完了した時点で、ＣＰＵ５は状態レジスタ２２に
状態コード「１０１」をセットする（図５（Ｈ）を参
照）。
【００３６】この状態コード「１０１」に従って、ライ
トデータ転送回路２８は前記のライトデータの転送処理
を実行する（ステップＳ１０）。即ち、ホストコンピュ
ータ２からセクタ単位のライトデータを受信する毎に、
バッファＲＡＭ４に格納して、コマンド実行アドレスを
更新する。そして、ホストコンピュータ２が要求した全
てのライトデータをバッファＲＡＭ４に格納した時点
で、状態レジスタ２２の状態コードを「０００」にセッ
トする。 （リードコマンド処理）ホストコンピュータ２からのコ
マンドがリードコマンドの場合でも、前述のライトコマ
ンドの場合と基本的には同様の処理となる。具体的に
は、図３のステップＳ２に示すように、コマンド受付回
路２４はコマンド認識処理により、ホストコンピュータ
２が発行したコマンドがリードコマンドであることを認
識すると、リードコマンド処理に移行する（ステップＳ
３のＮＯ，図４のフローチャートを参照）。
トデータ転送回路２８は前記のライトデータの転送処理
を実行する（ステップＳ１０）。即ち、ホストコンピュ
ータ２からセクタ単位のライトデータを受信する毎に、
バッファＲＡＭ４に格納して、コマンド実行アドレスを
更新する。そして、ホストコンピュータ２が要求した全
てのライトデータをバッファＲＡＭ４に格納した時点
で、状態レジスタ２２の状態コードを「０００」にセッ
トする。 （リードコマンド処理）ホストコンピュータ２からのコ
マンドがリードコマンドの場合でも、前述のライトコマ
ンドの場合と基本的には同様の処理となる。具体的に
は、図３のステップＳ２に示すように、コマンド受付回
路２４はコマンド認識処理により、ホストコンピュータ
２が発行したコマンドがリードコマンドであることを認
識すると、リードコマンド処理に移行する（ステップＳ
３のＮＯ，図４のフローチャートを参照）。
【００３７】即ち、アドレス変換回路２５は、状態コー
ド「０１０」により動作し、ホストコンピュータ２が指
定したコマンド実行アドレスがシリンダ番号、ヘッド番
号、セクタ番号からなる物理アドレス（ＣＨＳ）の場合
に、連続アドレスである論理ブロックアドレス（ＬＢ
Ａ）に変換する（ステップＳ２０）。アドレス変換回路
２５は、変換した論理ブロックアドレス（ＬＢＡ）を、
コントロールレジスタ回路の実行アドレス保持レジスタ
にセットし、状態コードを「０１１」に変更する。さら
に、キャッシュヒット判定回路２６は状態コード「０１
１」により動作し、前回のコマンド終了時に登録されて
いるアドレス（ＬＢＡ）と今回のアクセス要求のアドレ
ス（ＬＢＡ）とを比較し、ヒットするか否かを判定する
（ステップＳ２２）。
ド「０１０」により動作し、ホストコンピュータ２が指
定したコマンド実行アドレスがシリンダ番号、ヘッド番
号、セクタ番号からなる物理アドレス（ＣＨＳ）の場合
に、連続アドレスである論理ブロックアドレス（ＬＢ
Ａ）に変換する（ステップＳ２０）。アドレス変換回路
２５は、変換した論理ブロックアドレス（ＬＢＡ）を、
コントロールレジスタ回路の実行アドレス保持レジスタ
にセットし、状態コードを「０１１」に変更する。さら
に、キャッシュヒット判定回路２６は状態コード「０１
１」により動作し、前回のコマンド終了時に登録されて
いるアドレス（ＬＢＡ）と今回のアクセス要求のアドレ
ス（ＬＢＡ）とを比較し、ヒットするか否かを判定する
（ステップＳ２２）。
【００３８】ここで、キャッシュヒット判定回路２６
は、ヒットしたときには、状態コードをリードコマンド
に対応する「１００」に変更する。また、ヒットしない
ときには、ライトコマンドの場合と同様に状態コードを
「１１０」に変更する。この状態コード「１００」に従
って、リードデータ転送回路２７が動作し、前回のリー
ドコマンド時にバッファＲＡＭ４に格納されているリー
ドデータを、セクタ単位でホストコンピュータ２に転送
する処理を実行する（ステップＳ２３）。リードデータ
転送回路２７は、ホストコンピュータ２が要求した全て
のリードデータの転送が終了した時点で、状態レジスタ
２２の状態コードを「０００」にセットする。これによ
り、コマンド終了待ち回路２９が前述したようなコマン
ド終了処理を実行する（ステップＳ２４）。
は、ヒットしたときには、状態コードをリードコマンド
に対応する「１００」に変更する。また、ヒットしない
ときには、ライトコマンドの場合と同様に状態コードを
「１１０」に変更する。この状態コード「１００」に従
って、リードデータ転送回路２７が動作し、前回のリー
ドコマンド時にバッファＲＡＭ４に格納されているリー
ドデータを、セクタ単位でホストコンピュータ２に転送
する処理を実行する（ステップＳ２３）。リードデータ
転送回路２７は、ホストコンピュータ２が要求した全て
のリードデータの転送が終了した時点で、状態レジスタ
２２の状態コードを「０００」にセットする。これによ
り、コマンド終了待ち回路２９が前述したようなコマン
ド終了処理を実行する（ステップＳ２４）。
【００３９】一方、キャッシュヒット判定回路２６の判
定がヒットでない場合に、状態レジスタ２２の状態コー
ドは「１１０」にセットされている。従って、ＣＰＵ５
の動作に移行し、ＣＰＵ５はアクセス要求されたリード
データをディスク３から読出す動作を実行させる（ステ
ップＳ２５）。このとき、ＣＰＵ５は、ディスク３から
転送されたリードデータをバッファＲＡＭ４に格納する
ための準備処理を実行し、ディスク３から読出されたセ
クタ単位のリードデータをバッファＲＡＭ４に格納する
（ステップＳ２７）。ＣＰＵ５は、要求された全てのリ
ードデータがバッファＲＡＭ４に格納された時点で、状
態レジスタ２２に状態コード「１００」をセットする。
この状態コード「１００」に従って、リードデータ転送
回路２７が動作し、バッファＲＡＭ４に格納されている
リードデータを、セクタ単位でホストコンピュータ２に
転送する処理を実行する（ステップＳ２３）。
定がヒットでない場合に、状態レジスタ２２の状態コー
ドは「１１０」にセットされている。従って、ＣＰＵ５
の動作に移行し、ＣＰＵ５はアクセス要求されたリード
データをディスク３から読出す動作を実行させる（ステ
ップＳ２５）。このとき、ＣＰＵ５は、ディスク３から
転送されたリードデータをバッファＲＡＭ４に格納する
ための準備処理を実行し、ディスク３から読出されたセ
クタ単位のリードデータをバッファＲＡＭ４に格納する
（ステップＳ２７）。ＣＰＵ５は、要求された全てのリ
ードデータがバッファＲＡＭ４に格納された時点で、状
態レジスタ２２に状態コード「１００」をセットする。
この状態コード「１００」に従って、リードデータ転送
回路２７が動作し、バッファＲＡＭ４に格納されている
リードデータを、セクタ単位でホストコンピュータ２に
転送する処理を実行する（ステップＳ２３）。
【００４０】以上のように本実施形態によれば、ホスト
コンピュータ２からのコマンドに対して、一連のコマン
ド処理をコマンド処理部１２の各回路２３〜２９がそれ
ぞれ、状態レジスタ２２の状態コードに基づいて独立的
に実行する。換言すれば、一連のコマンド処理を複数の
動作ブロックに分割し、各動作ブロックを状態コードに
より制御して実行させる。従って、従来の逐次的にコマ
ンド処理を行なう方式に対して、コマンド処理を複数の
処理に分割して、それぞれを独立的に実行する方式であ
るため、ＨＤＣ１を設計する上で、各処理毎に不具合な
どを発見することが容易となる。また、設計後に不具合
が発見された場合でも、状態レジスタ２２を制御するこ
とにより、ＣＰＵ５の処理により対応することが可能で
ある。さらに、コマンド処理の中に新規の処理を追加す
る場合に、状態コードを新たに設定することにより、容
易に実現することができるため、ＨＤＣの設計上の自由
度を向上することができる。 （本実施形態の変形例）本実施形態の変形例として、ホ
ストコンピュータ２からリード／ライトコマンド以外の
特殊コマンドが発行された場合のコマンド処理を想定し
て、図６を参照して説明する。この特殊コマンドとして
は、ある特定のパラメータ情報を返送するための特定コ
マンド（ｇｅｔ ｐａｒａｍｅｔｅｒコマンド）を想定
する。
コンピュータ２からのコマンドに対して、一連のコマン
ド処理をコマンド処理部１２の各回路２３〜２９がそれ
ぞれ、状態レジスタ２２の状態コードに基づいて独立的
に実行する。換言すれば、一連のコマンド処理を複数の
動作ブロックに分割し、各動作ブロックを状態コードに
より制御して実行させる。従って、従来の逐次的にコマ
ンド処理を行なう方式に対して、コマンド処理を複数の
処理に分割して、それぞれを独立的に実行する方式であ
るため、ＨＤＣ１を設計する上で、各処理毎に不具合な
どを発見することが容易となる。また、設計後に不具合
が発見された場合でも、状態レジスタ２２を制御するこ
とにより、ＣＰＵ５の処理により対応することが可能で
ある。さらに、コマンド処理の中に新規の処理を追加す
る場合に、状態コードを新たに設定することにより、容
易に実現することができるため、ＨＤＣの設計上の自由
度を向上することができる。 （本実施形態の変形例）本実施形態の変形例として、ホ
ストコンピュータ２からリード／ライトコマンド以外の
特殊コマンドが発行された場合のコマンド処理を想定し
て、図６を参照して説明する。この特殊コマンドとして
は、ある特定のパラメータ情報を返送するための特定コ
マンド（ｇｅｔ ｐａｒａｍｅｔｅｒコマンド）を想定
する。
【００４１】まず、ホストコンピュータ２から特定コマ
ンドが発行されてから、その特定コマンドが受付けられ
るまでの処理は、本実施形態の場合と同様である。即
ち、図６（Ｂ）に示すように、コマンド発行待ちの状態
では、状態レジスタ２２には状態コード「０００」がセ
ットされている。コマンド待ち回路２３は、ホストコン
ピュータ２から特定コマンドが発行されると、それを検
知して状態レジスタ２２の状態コードを「００１」にセ
ットする。
ンドが発行されてから、その特定コマンドが受付けられ
るまでの処理は、本実施形態の場合と同様である。即
ち、図６（Ｂ）に示すように、コマンド発行待ちの状態
では、状態レジスタ２２には状態コード「０００」がセ
ットされている。コマンド待ち回路２３は、ホストコン
ピュータ２から特定コマンドが発行されると、それを検
知して状態レジスタ２２の状態コードを「００１」にセ
ットする。
【００４２】コマンド受付回路２４は、状態コード「０
０１」によりコマンド受付け動作を実行し、前記のＢＵ
ＳＹフラグをセットする（ステップＳ３０，Ｓ３１）。
ここで、コマンド受付回路２４はコマンド認識処理を実
行したときに、登録されていない特定コマンドであるこ
とを認識し、状態レジスタ２２の状態コードを「１１
０」に変更する（ステップＳ３０，Ｓ３１）。
０１」によりコマンド受付け動作を実行し、前記のＢＵ
ＳＹフラグをセットする（ステップＳ３０，Ｓ３１）。
ここで、コマンド受付回路２４はコマンド認識処理を実
行したときに、登録されていない特定コマンドであるこ
とを認識し、状態レジスタ２２の状態コードを「１１
０」に変更する（ステップＳ３０，Ｓ３１）。
【００４３】この状態コード「１１０」では、ＣＰＵ５
が状態レジスタ２２の内容を変更しない限り、コマンド
処理部１２は動作停止状態となる。ＣＰＵ５は、コント
ロールレジスタ回路から特定コマンドを読出し、その内
容を認識する（ステップＳ３２）。ＣＰＵ５は、特定コ
マンドに従って返送データ（パラメータデータ）を準備
してバッファＲＡＭ４に格納する（ステップＳ３３）。
ここで、バッファＲＡＭ４に準備される返送データは、
１セクタ分のデータ量（５１２バイト分）と想定する。
ＣＰＵ５は、返送データの準備が完了した時点で、状態
レジスタ２２の状態コードを「１００」にセットする
（ステップＳ３４）。
が状態レジスタ２２の内容を変更しない限り、コマンド
処理部１２は動作停止状態となる。ＣＰＵ５は、コント
ロールレジスタ回路から特定コマンドを読出し、その内
容を認識する（ステップＳ３２）。ＣＰＵ５は、特定コ
マンドに従って返送データ（パラメータデータ）を準備
してバッファＲＡＭ４に格納する（ステップＳ３３）。
ここで、バッファＲＡＭ４に準備される返送データは、
１セクタ分のデータ量（５１２バイト分）と想定する。
ＣＰＵ５は、返送データの準備が完了した時点で、状態
レジスタ２２の状態コードを「１００」にセットする
（ステップＳ３４）。
【００４４】この状態コード「１００」に従って、リー
ドデータ転送回路２７が動作し、バッファＲＡＭ４に格
納されている１セクタ分の返送データをホストコンピュ
ータ２に転送する処理を実行する（ステップＳ３５）。
リードデータ転送回路２７は、ホストコンピュータ２が
要求した返送データの転送が終了した時点で、状態レジ
スタ２２の状態コードを「０００」にセットする。これ
により、コマンド終了待ち回路２９が前述したようなコ
マンド終了処理を実行する（ステップＳ３６）。
ドデータ転送回路２７が動作し、バッファＲＡＭ４に格
納されている１セクタ分の返送データをホストコンピュ
ータ２に転送する処理を実行する（ステップＳ３５）。
リードデータ転送回路２７は、ホストコンピュータ２が
要求した返送データの転送が終了した時点で、状態レジ
スタ２２の状態コードを「０００」にセットする。これ
により、コマンド終了待ち回路２９が前述したようなコ
マンド終了処理を実行する（ステップＳ３６）。
【００４５】以上のように本実施形態の変形例によれ
ば、ＨＤＣ１のコマンド処理部１２が処理できない特殊
コマンドを、状態レジスタ２２の制御により、ＣＰＵ５
により処理させることができる。換言すれば、コマンド
処理部１２がサポートしていない新たなコマンドを、Ｃ
ＰＵ５により処理させる方式により、容易に追加するこ
とができる。
ば、ＨＤＣ１のコマンド処理部１２が処理できない特殊
コマンドを、状態レジスタ２２の制御により、ＣＰＵ５
により処理させることができる。換言すれば、コマンド
処理部１２がサポートしていない新たなコマンドを、Ｃ
ＰＵ５により処理させる方式により、容易に追加するこ
とができる。
【００４６】
【発明の効果】以上詳述したように本発明によれば、ホ
ストコンピュータに対する一連のコマンド処理を複数の
動作ブロックに相当する独立した処理工程に分割して、
各処理工程をぞれぞれ実行制御する方式を実現すること
ができる。従って、一連のコマンド処理を分割した各処
理毎に動作状態を把握できるため、設計上において各処
理毎の不具合を容易に発見できるため、設計変更が簡単
になる。また、また設計後においても不具合を容易に発
見できるため、ＣＰＵによりサポートさせるような対応
処置を容易に取ることができる。さらに、ＣＰＵにより
処理できる新たなコマンド機能を容易に追加することが
可能であるため、結果的にコマンド処理機能に対する自
由度を高めることができる。
ストコンピュータに対する一連のコマンド処理を複数の
動作ブロックに相当する独立した処理工程に分割して、
各処理工程をぞれぞれ実行制御する方式を実現すること
ができる。従って、一連のコマンド処理を分割した各処
理毎に動作状態を把握できるため、設計上において各処
理毎の不具合を容易に発見できるため、設計変更が簡単
になる。また、また設計後においても不具合を容易に発
見できるため、ＣＰＵによりサポートさせるような対応
処置を容易に取ることができる。さらに、ＣＰＵにより
処理できる新たなコマンド機能を容易に追加することが
可能であるため、結果的にコマンド処理機能に対する自
由度を高めることができる。
【図１】本発明の実施形態に関係するシステム構成を示
すブロック図。
すブロック図。
【図２】本実施形態に関係するＨＤＣの要部を示すブロ
ック図。
ック図。
【図３】本実施形態のライトコマンド処理を説明するた
めのフローチャート。
めのフローチャート。
【図４】本実施形態のリードコマンド処理を説明するた
めのフローチャート。
めのフローチャート。
【図５】本実施形態に関係する状態レジスタの変化を示
す概念図。
す概念図。
【図６】本実施形態の変形例を説明するための図。
１…ディスクコントローラ（ＨＤＣ） ２…ホストコンピュータ ３…ディスク ４…バッファＲＡＭ（データバッファ手段） ５…ＣＰＵ １０…ホストインターフェース制御部 １１…インターフェース １２…コマンド処理部 １３…データ制御部 １４…バッファ制御部 ２０…インターフェース回路 ２１…状態制御回路 ２２…状態レジスタ ２３…コマンド待ち回路 ２４…コマンド受付回路 ２５…アドレス変換回路 ２６…キャッシュヒット判定回路 ２７…リードデータ転送回路 ２８…ライトデータ転送回路 ２９…コマンド終了待ち回路
Claims (10)
- 【請求項１】 ホストコンピュータからのコマンドに基
づいて、前記ホストコンピュータとの間でディスクに記
録するデータ及び前記ディスクから再生したデータの転
送制御を行なうディスク記録再生装置において、 前記ホストコンピュータから発行されたコマンドに対す
る一連のコマンド処理を複数のコマンド処理に分割し
て、各コマンド処理を独立して実行可能なコマンド処理
手段と、 前記コマンド処理手段による各コマンド処理毎に設定さ
れた動作状態を示す状態コードをセットするための状態
レジスタ手段と、 前記状態レジスタ手段にセットされた状態コードに対応
するコマンド処理を実行させて、各コマンド処理の完了
時点で前記状態レジスタ手段を更新する制御手段とを具
備したことを特徴とするディスク記録再生装置。 - 【請求項２】 ホストコンピュータからのコマンドに基
づいて、ディスクにデータを記録し、前記ディスクから
データを再生するディスク記録再生装置に設けられて、
前記ホストコンピュータとの間でデータの転送制御を行
なうインターフェース制御装置であって、 前記ホストコンピュータから発行されたコマンドに対す
る一連のコマンド処理を複数の動作状態毎の動作ブロッ
クに分割し、各動作ブロックに対応する処理をそれぞれ
独立して実行するコマンド処理手段と、 前記コマンド処理手段の各動作ブロック毎に設定した状
態コードをセットするための状態レジスタ手段と、 前記状態レジスタ手段にセットされた状態コードに基づ
いて前記コマンド処理手段を制御し、前記各動作ブロッ
ク単位のコマンド処理を実行させる制御手段とを具備し
たことを特徴とするインターフェース制御装置。 - 【請求項３】 前記コマンド処理手段は、前記ホストコ
ンピュータから発行されたコマンドを受付けてコマンド
を認識するコマンド受付処理、前記コマンドに含まれる
アクセス対象アドレスを所定のアドレスに変換するアド
レス変換手段、前記ホストコンピュータからのライトデ
ータの転送および前記ホストコンピュータへのリードデ
ータの転送を行なうデータ転送処理、および所定のコマ
ンド終了処理の各動作ブロックをそれぞれ実行する回路
からなることを特徴とする請求項１に記載のディスク記
録再生装置または請求項２記載のインターフェース制御
装置。 - 【請求項４】 ホストコンピュータからのコマンドに基
づいて、前記ホストコンピュータとの間でディスクに記
録するデータ及び前記ディスクから再生したデータの転
送制御を行なうディスク記録再生装置において、 前記ホストコンピュータから発行されたコマンドに対す
る一連のコマンド処理をそれぞれ実行するための各コマ
ンド処理手段と、 前記各コマンド処理手段毎に設定されたコマンド処理の
動作状態を示す状態コードをセットするための状態レジ
スタ手段と、 前記状態レジスタ手段にセットされた状態コードに対応
するコマンド処理手段を動作させて、各コマンド処理の
完了時点で前記状態レジスタ手段を更新する制御手段
と、 前記各コマンド処理手段によるコマンド処理結果に基づ
いて、前記ホストコンピュータからのライトデータを前
記ディスク上に記録し、または前記ディスクからリード
データを再生するための記録再生動作を制御し、かつ前
記状態レジスタ手段にセットされた状態コードを参照ま
たは変更する機能を有するＣＰＵ手段とを具備したこと
を特徴とするディスク記録再生装置。 - 【請求項５】 前記ＣＰＵ手段は、前記ホストコンピュ
ータからの特定コマンドを認識し、前記状態レジスタ手
段の状態コードをセットすることにより前記特定コマン
ドに従った一連のコマンド処理を実行させる機能を有す
ることを特徴とする請求項４記載のディスク記録再生装
置。 - 【請求項６】 ホストコンピュータからのコマンドに基
づいて、ディスクにデータを記録し、前記ディスクから
データを再生するディスク記録再生装置に設けられて、
前記ホストコンピュータとの間でデータの転送制御を行
なうインターフェース制御装置であって、 前記ホストコンピュータから発行されたコマンドに対す
る一連のコマンド処理を複数の動作状態毎の動作ブロッ
クに分割し、各動作ブロックに対応する処理をそれぞれ
独立して実行するコマンド処理手段と、 前記コマンド処理手段の各動作ブロック毎に設定した状
態コードをセットするための状態レジスタ手段と、 前記コマンドがライトコマンドの場合には前記ホストコ
ンピュータからのライトデータを保存し、前記コマンド
がリードコマンドの場合には前記ディスクから再生した
リードデータを保存するためのデータバッファ手段と、 前記状態レジスタ手段にセットされた状態コードに基づ
いて前記コマンド処理手段を制御して前記各動作ブロッ
ク単位のコマンド処理を実行させて、前記ライトコマン
ドの場合には前記データバッファ手段に保存されたライ
トデータを前記ディスク側に転送し、前記リードコマン
ドの場合には前記データバッファ手段に保存されたリー
ドデータを前記ホストコンピュータ側に転送するデータ
転送制御機能を有する制御手段とを具備したことを特徴
とするインターフェース制御装置。 - 【請求項７】 前記コマンド処理手段には、前記コマン
ドに含まれるアクセス対象アドレスがヒットするか否か
のキャッシュヒット判定を行なう動作ブロックが含まれ
ており、 前記コマンドがライトコマンドの場合には前記キャッシ
ュヒット判定処理により前記データバッファ手段にライ
トデータを保存するためのアクセス対象アドレスが確保
されているか否かを判定し、前記コマンドがリードコマ
ンドの場合には前記キャッシュヒット判定処理により前
記データバッファ手段にアクセス対象アドレスに対応す
るリードデータが保存されているか否かを判定する機能
を備えていることを特徴とする請求項５記載のインター
フェース制御装置。 - 【請求項８】 ホストコンピュータからのコマンドに基
づいて、ディスクにデータを記録し、前記ディスクから
データを再生するディスク記録再生装置に設けられて、
前記ホストコンピュータとの間でデータの転送制御を行
なうインターフェース制御装置に適用するコマンド処理
方法であって、 前記ホストコンピュータからのコマンドを受付けて、前
記コマンドを認識処理するステップと、 前記コマンドに含まれるアクセス対象アドレスを所定の
アドレスに変換するステップと、 前記コマンドがライトコマンドの場合にホストコンピュ
ータからのライトデータをデータバッファ手段に保存
し、前記コマンドがリードコマンドの場合には前記ディ
スクから再生したリードデータを前記データバッファ手
段に保存して、前記ホストコンピュータとのデータ入出
力転送制御を行なうステップと、 前記コマンド処理が終了した時点で、次のコマンドを受
付ける待機状態に移行するコマンド終了処理を実行する
ステップとからなる一連のコマンド処理を実行し、 前記一連のコマンド処理毎に設定した状態コードをセッ
トするための状態レジスタ手段を有し、前記状態レジス
タ手段にセットする状態コードに応じて前記一連のコマ
ンド処理を順次実行することを特徴とするコマンド処理
方法。 - 【請求項９】 ホストコンピュータからのコマンドに基
づいてディスクにデータを記録し、前記ディスクからデ
ータを再生するディスク記録再生装置に設けられて、前
記ホストコンピュータとの間でデータの転送制御を行な
うインターフェース制御装置に適用するコマンド処理方
法であって、 前記インターフェース制御装置は前記ホストコンピュー
タからのライトデータを保存し、かつ前記ディスクから
のリードデータを保存するためのデータバッファ手段、
前記ホストコンピュータから発行されたコマンドに対す
る一連のコマンド処理の各動作ブロック毎に設定した状
態コードをセットするための状態レジスタ手段および前
記状態レジスタ手段にセットされた状態コードに基づい
て前記一連のコマンド処理を実行させる制御手段を備え
ており、 前記制御手段は、前記状態レジスタ手段にセットされた
状態コードを順次更新することにより、 前記ホストコンピュータからのコマンドを受付けて、前
記コマンドを認識処理するステップと、 前記コマンドに含まれるアクセス対象アドレスを所定の
アドレスに変換するステップと、 前記コマンドがライトコマンドの場合に前記データバッ
ファ手段にライトデータを保存するためのアクセス対象
アドレスが確保されているか否かを判定し、前記コマン
ドがリードコマンドの場合には前記データバッファ手段
にアクセス対象アドレスに対応するリードデータが保存
されているか否かを判定するキャッシュヒット判定処理
を実行するステップと、 前記コマンドがライトコマンドの場合に前記データバッ
ファ手段に確保したアクセス対象アドレスにライトデー
タを保存し、前記コマンドがリードコマンドの場合に前
記キャッシュヒット判定処理がヒットであれば前記デー
タバッファ手段に保存されたアクセス対象アドレスのリ
ードデータを前記ホストコンピュータに転送し、前記キ
ャッシュヒット判定処理がヒットでなければ前記ディス
クから再生したリードデータを前記データバッファ手段
に保存するステップと、 前記データバッファ手段に保存されたライトデータを前
記ディスク側に転送し、前記データバッファ手段に保存
されたリードデータを前記ホストコンピュータに転送す
る転送制御を実行するステップと、 前記コマンド処理が終了した時点で、次のコマンドを受
付ける待機状態に移行するコマンド終了処理を実行する
ステップとからなる一連のコマンド処理を実行すること
を特徴とするコマンド処理方法。 - 【請求項１０】 前記ディスク記録再生装置は前記各コ
マンド処理手段によるコマンド処理結果に基づいて、前
記ホストコンピュータからのライトデータを前記ディス
ク上に記録し、または前記ディスクからリードデータを
再生するための記録再生動作を制御し、かつ前記状態レ
ジスタ手段にセットされた状態コードを参照または変更
する機能を有するＣＰＵ手段を有し、 前記ＣＰＵ手段が前記状態レジスタ手段の状態コードを
セットすることにより、前記制御手段は、前記ＣＰＵ手
段が前記ホストコンピュータからの特定コマンドを認識
し、前記特定コマンドに従った一連のコマンド処理を実
行することを特徴とする請求項６記載のインターフェー
ス制御装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8247791A JPH1097385A (ja) | 1996-09-19 | 1996-09-19 | ディスク記録再生装置及び同装置に適用するインターフェース制御装置 |
| US08/790,707 US5860089A (en) | 1996-09-19 | 1997-01-29 | Disk system with command processing function |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8247791A JPH1097385A (ja) | 1996-09-19 | 1996-09-19 | ディスク記録再生装置及び同装置に適用するインターフェース制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH1097385A true JPH1097385A (ja) | 1998-04-14 |
Family
ID=17168710
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8247791A Pending JPH1097385A (ja) | 1996-09-19 | 1996-09-19 | ディスク記録再生装置及び同装置に適用するインターフェース制御装置 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US5860089A (ja) |
| JP (1) | JPH1097385A (ja) |
Families Citing this family (16)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6098121A (en) * | 1996-12-03 | 2000-08-01 | Matsushita Electric Industrial Co., Ltd. | Data transfer apparatus with improved throughput due to reduced processing overhead in interrupt process |
| US6282045B1 (en) * | 1997-09-15 | 2001-08-28 | Texas Instruments Incorporated | Server hard disk drive integrated circuit and method of operation |
| JP3582970B2 (ja) * | 1997-11-04 | 2004-10-27 | 富士通株式会社 | アダプタ、及びアダプタとディスクカートリッジ駆動装置との間の通信方法 |
| US6456213B1 (en) | 1998-06-11 | 2002-09-24 | Seagate Technology Llc | Digitizing readback waveform for testing hard disc drives |
| US6557058B1 (en) * | 1999-12-01 | 2003-04-29 | Iomega Corporation | Method and apparatus of sustained sequential data transfer in a media drive |
| JP2001229115A (ja) * | 2000-02-17 | 2001-08-24 | Matsushita Electric Ind Co Ltd | Ａｔａｐｉコマンド処理方式 |
| TWI238386B (en) * | 2001-11-02 | 2005-08-21 | Lite On It Corp | Method for data-caching from an optical storage device |
| US20080222323A1 (en) * | 2006-06-14 | 2008-09-11 | Genesys Logic, Inc. | Multimedia adapting apparatus |
| TWI360114B (en) * | 2007-02-16 | 2012-03-11 | Mediatek Inc | Buffer management method and optical disc drive |
| US7827320B1 (en) * | 2008-03-28 | 2010-11-02 | Western Digital Technologies, Inc. | Serial ATA device implementing intra-command processing by detecting XRDY primitive while in the XRDY state |
| US8856390B1 (en) | 2008-03-28 | 2014-10-07 | Western Digital Technologies, Inc. | Using device control field to implement non-disruptive notification of an ATA device |
| US9645752B1 (en) | 2014-04-07 | 2017-05-09 | Western Digital Technologies, Inc. | Identification of data committed to non-volatile memory by use of notification commands |
| US9632711B1 (en) | 2014-04-07 | 2017-04-25 | Western Digital Technologies, Inc. | Processing flush requests by utilizing storage system write notifications |
| US20160253111A1 (en) * | 2015-02-27 | 2016-09-01 | Kabushiki Kaisha Toshiba | Storage device and storing method |
| TWI639921B (zh) * | 2017-11-22 | 2018-11-01 | 大陸商深圳大心電子科技有限公司 | 指令處理方法及使用所述方法的儲存控制器 |
| JP2022144449A (ja) * | 2021-03-19 | 2022-10-03 | キオクシア株式会社 | メモリシステム、メモリシステムの制御方法及びホストデバイス |
Family Cites Families (9)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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| US4942552A (en) * | 1986-11-20 | 1990-07-17 | Allen-Bradley Company, Inc. | Method and apparatus for saving and performing industrial control commands |
| US4803622A (en) * | 1987-05-07 | 1989-02-07 | Intel Corporation | Programmable I/O sequencer for use in an I/O processor |
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| KR0136594B1 (ko) * | 1988-09-30 | 1998-10-01 | 미다 가쓰시게 | 단일칩 마이크로 컴퓨터 |
| US5131082A (en) * | 1989-06-09 | 1992-07-14 | International Business Machines Corporation | Command delivery for a computing system for transfers between a host and subsystem including providing direct commands or indirect commands indicating the address of the subsystem control block |
| US5339449A (en) * | 1989-06-30 | 1994-08-16 | Digital Equipment Corporation | System and method for reducing storage channels in disk systems |
| US5249279A (en) * | 1989-11-03 | 1993-09-28 | Compaq Computer Corporation | Method for controlling disk array operations by receiving logical disk requests and translating the requests to multiple physical disk specific commands |
| US5465343A (en) * | 1993-04-30 | 1995-11-07 | Quantum Corporation | Shared memory array for data block and control program storage in disk drive |
-
1996
- 1996-09-19 JP JP8247791A patent/JPH1097385A/ja active Pending
-
1997
- 1997-01-29 US US08/790,707 patent/US5860089A/en not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| US5860089A (en) | 1999-01-12 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |