JPH10190203A - Printed wiring board - Google Patents

Printed wiring board

Info

Publication number
JPH10190203A
JPH10190203A JP34378096A JP34378096A JPH10190203A JP H10190203 A JPH10190203 A JP H10190203A JP 34378096 A JP34378096 A JP 34378096A JP 34378096 A JP34378096 A JP 34378096A JP H10190203 A JPH10190203 A JP H10190203A
Authority
JP
Japan
Prior art keywords
solder
pad
printed wiring
dummy
wiring board
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP34378096A
Other languages
Japanese (ja)
Other versions
JP3795600B2 (en
Inventor
Hiroaki Satake
博明 佐竹
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Ibiden Co Ltd
Original Assignee
Ibiden Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Ibiden Co Ltd filed Critical Ibiden Co Ltd
Priority to JP34378096A priority Critical patent/JP3795600B2/en
Publication of JPH10190203A publication Critical patent/JPH10190203A/en
Application granted granted Critical
Publication of JP3795600B2 publication Critical patent/JP3795600B2/en
Anticipated expiration legal-status Critical
Expired - Fee Related legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K1/00Printed circuits
    • H05K1/02Details
    • H05K1/11Printed elements for providing electric connections to or between printed circuits
    • H05K1/111Pads for surface mounting, e.g. lay-out
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/30Assembling printed circuits with electric components, e.g. with resistor
    • H05K3/32Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits
    • H05K3/34Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits by soldering
    • H05K3/3457Solder materials or compositions; Methods of application thereof

Landscapes

  • Electric Connection Of Electric Components To Printed Circuits (AREA)

Abstract

PROBLEM TO BE SOLVED: To provide a printed wiring board, in which marring and crushing are difficult to generate in a solder layer on a pad even when a plurality of the printed wiring boards are superposed and placed. SOLUTION: In the printed wiring 1, a solder resist 5 is provided on the board 2 with a pad row 3 consisting of a plurality of pads 7, 8, and the pad row 3 is exposed from the opening section 6 of the solder resist 5. The pad row 3 is composed of the normal pads 7, which are related to the wiring 1 and to which solder precoating layers 9 are formed, and a dummy pad 8 not related to the wiring. The height T2 of the dummy pad 8 is made relatively higher than that T1 of the normal pad 7, to which the solder precoating layer 9 is added.

Description

【発明の詳細な説明】DETAILED DESCRIPTION OF THE INVENTION

【0001】[0001]

【発明の属する技術分野】本発明は、プリント配線板に
関し、特にはそのパッド列部分の構造に関するものであ
る。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a printed wiring board, and more particularly to a structure of a pad row portion thereof.

【0002】[0002]

【従来の技術】図5には、QFPやTCP等の半導体パ
ッケージを表面実装するための従来のプリント配線板4
1が例示されている。このプリント配線板41を構成す
る基板42における部品実装部には、複数の同じ形状を
したパッド43からなる4つのパッド列44が正方形状
に配列されている。また、前記基板42上にはソルダー
レジスト45が設けられ、そのソルダーレジスト45の
開口部46からはパッド列44が露出されている。
2. Description of the Related Art FIG. 5 shows a conventional printed wiring board 4 for surface mounting a semiconductor package such as QFP or TCP.
1 is illustrated. In a component mounting portion of a substrate 42 constituting the printed wiring board 41, four pad rows 44 composed of a plurality of pads 43 having the same shape are arranged in a square shape. A solder resist 45 is provided on the substrate 42, and a pad row 44 is exposed from an opening 46 of the solder resist 45.

【0003】ところで、近年ではプリント配線板41の
ファイン化が著しく、それに伴ってパッド43間のピッ
チも0.5mm、0.3mm…というように狭くなる傾向に
ある。また、このような狭ピッチのパッド43に対する
はんだ付けを可能とする手段として、あらかじめパッド
43上にはんだプリコート層47を形成しておく方法
(いわゆるはんだプリコート法)が従来より提案されて
いる。
[0003] In recent years, the fineness of the printed wiring board 41 has been remarkably reduced, and accordingly, the pitch between the pads 43 has tended to be reduced to 0.5 mm, 0.3 mm. As a means for enabling soldering to such a narrow pitch pad 43, a method of forming a solder precoat layer 47 on the pad 43 in advance (so-called solder precoat method) has been conventionally proposed.

【0004】[0004]

【発明が解決しようとする課題】しかしながら、はんだ
プリコート層47を厚く形成した場合、はんだプリコー
ト層47の頂部の高さがソルダーレジスト45の表面の
高さよりも10μm 以上高くなってしまうことがある
(図5(b) ,図5(c) のΔT参照)。
However, when the solder pre-coat layer 47 is formed thick, the height of the top of the solder pre-coat layer 47 may be 10 μm or more higher than the height of the surface of the solder resist 45 (see FIG. 1). (See ΔT in FIGS. 5B and 5C).

【0005】そして、このような状態のプリント配線板
41を複数枚重ね合わせて載置すると、特に下層におい
ては、突出したはんだプリコート層47が基板42の裏
面に接触することにより、はんだプリコート層47が傷
付いたり潰れたりする。
When a plurality of printed wiring boards 41 in such a state are placed on top of each other, especially in the lower layer, the protruding solder pre-coat layer 47 comes into contact with the back surface of the substrate 42 so that the solder pre-coat layer 47 Is damaged or crushed.

【0006】また、パッド43が0.3mmピッチ以下で
ある場合には、上記の傷付きや潰れにより、とりわけは
んだブリッジB1 (図6参照)やはんだの偏り等が生じ
やすくなり、このことが不良発生の原因となっていた。
If the pad 43 has a pitch of 0.3 mm or less, the above-mentioned damage and crushing tend to cause solder bridges B1 (see FIG. 6) and unevenness of the solder. Was causing the outbreak.

【0007】本発明は上記の課題を解決するためなされ
たものであり、その目的は、複数枚重ね合わせて載置し
たときでも、パッド上のはんだ層に傷付きや潰れが起こ
りにくいプリント配線板を提供することにある。
SUMMARY OF THE INVENTION The present invention has been made to solve the above problems, and an object of the present invention is to provide a printed wiring board in which a solder layer on a pad is less likely to be damaged or crushed even when a plurality of sheets are placed one upon another. Is to provide.

【0008】[0008]

【課題を解決するための手段】上記の課題を解決するた
めに、請求項1に記載の発明では、複数のパッドからな
るパッド列を備えるプリント配線板において、前記パッ
ド列は、配線に関与しかつはんだプリコート層が形成さ
れる通常のパッドと配線に関与しないダミーパッドとに
よって構成され、前記ダミーパッドの高さを、前記はん
だプリコート層を加えた前記通常のパッドの高さよりも
相対的に高くしたことを特徴とするプリント配線板をそ
の要旨とする。
According to a first aspect of the present invention, there is provided a printed wiring board having a pad row including a plurality of pads, wherein the pad row is involved in wiring. And it is configured by a normal pad on which a solder precoat layer is formed and a dummy pad not involved in wiring, and the height of the dummy pad is relatively higher than the height of the normal pad to which the solder precoat layer is added. The gist of the present invention is a printed wiring board characterized by the above.

【0009】請求項2に記載の発明は、請求項1におい
て、前記ダミーパッドははんだ凝集部を備え、そのはん
だ凝集部にははんだが凝集して盛り上がったはんだ盛り
上がり部が形成されているとした。
According to a second aspect of the present invention, in the first aspect, the dummy pad has a solder aggregation portion, and the solder aggregation portion has a solder swell portion formed by agglomeration of the solder and swelling. .

【0010】請求項3に記載の発明は、請求項2におい
て、前記ダミーパッドの長さを、前記通常のパッドの長
さと略等しく設定した。以下、本発明の「作用」を説明
する。
According to a third aspect of the present invention, in the second aspect, the length of the dummy pad is set substantially equal to the length of the normal pad. Hereinafter, the “action” of the present invention will be described.

【0011】請求項1〜3に記載の発明によると、プリ
ント配線板を複数枚重ね合わせて載置したとき、通常の
パッドよりも相対的に高く形成されたダミーパッドが基
板に対して優先的に接触することで、通常のパッドと基
板との接触が回避される。その結果、通常のパッド上の
はんだ層に傷付きや潰れが起こりにくくなる。
According to the first to third aspects of the present invention, when a plurality of printed wiring boards are placed one on top of the other, a dummy pad formed relatively higher than a normal pad has priority over the substrate. , Contact between the normal pad and the substrate is avoided. As a result, the solder layer on the normal pad is less likely to be damaged or crushed.

【0012】請求項2に記載の発明によると、はんだ凝
集部にあるはんだ盛り上がり部が基板に対して優先的に
接触することで、通常のパッドと基板との接触が回避さ
れる。また、このようなはんだ盛り上がり部は、ダミー
パッド上に載せられたはんだを熱で溶融させて前記はん
だ凝集部に凝集させることによって、容易に形成するこ
とができる。これは、溶融したはんだは表面張力が作用
する結果、はんだがダミーパッドにおける幅広領域に凝
集するという性質を利用したものである。さらに、前記
はんだ盛り上がり部は、通常のパッド上にはんだプリコ
ート層を形成する既存の工程において同時に形成するこ
とも可能である。従って、製造が容易なプリント配線板
とすることができる。
According to the second aspect of the present invention, the contact between the normal pad and the substrate is avoided by preferentially contacting the solder bulging portion in the solder aggregation portion with the substrate. Further, such a raised portion of solder can be easily formed by melting the solder placed on the dummy pad by heat and aggregating the solder on the solder aggregation portion. This utilizes the property that the molten solder is subjected to surface tension, and as a result, the solder aggregates in a wide area of the dummy pad. Further, the solder bumps can be formed simultaneously in an existing step of forming a solder precoat layer on a normal pad. Therefore, a printed wiring board that can be easily manufactured can be obtained.

【0013】請求項3に記載の発明の作用を以下に述べ
る。ダミーパッドが通常のパッドよりも相対的に長いも
のであると、基板上に形成用スペースが要ることでパタ
ーン設計上不利になり、かつ製造容易化やファイン化の
妨げになる。逆に、ダミーパッドが通常のパッドよりも
相対的に短いものであると、はんだがはんだ凝集部に充
分に供給されず、はんだ盛り上がり部を高くすることが
できなくなる。従って、通常のパッドと略等しい長さの
ダミーパッドにしておけば、上記の問題を解消すること
ができる。
The operation of the present invention will be described below. If the dummy pad is relatively longer than the normal pad, a space for formation is required on the substrate, which is disadvantageous in pattern design, and hinders manufacturing and fineness. On the other hand, if the dummy pad is relatively shorter than a normal pad, the solder is not sufficiently supplied to the solder aggregation portion, and the solder swell portion cannot be increased. Therefore, if a dummy pad having a length substantially equal to that of a normal pad is used, the above problem can be solved.

【0014】[0014]

【発明の実施の形態】以下、本発明をQFP(Quad fla
t package )実装用のプリント配線板に具体化した一実
施形態を図1,図2に基づき詳細に説明する。
BEST MODE FOR CARRYING OUT THE INVENTION Hereinafter, the present invention is referred to as QFP (Quad
t package) One embodiment embodied in a printed wiring board for mounting will be described in detail with reference to FIGS.

【0015】このプリント配線板1を構成する基板2
は、表面実装部品としてのQFPを表面実装するための
部品実装部をその片側面に備えている。前記部品実装部
にはパッド列3が4つ形成され、それらはQFPのリー
ドの突出位置に対応すべく正方形状に配置されている。
また、基板2上にはソルダーレジスト5が設けられ、そ
のソルダーレジスト5の開口部6からは前記各パッド列
3が露出されている。
A substrate 2 constituting the printed wiring board 1
Has a component mounting portion for surface mounting a QFP as a surface mounting component on one side thereof. Four pad rows 3 are formed in the component mounting portion, and are arranged in a square shape so as to correspond to the protruding positions of the leads of the QFP.
Further, a solder resist 5 is provided on the substrate 2, and the respective pad rows 3 are exposed from openings 6 of the solder resist 5.

【0016】本実施形態では、各々のパッド列3は通常
のパッド7とダミーパッド8とによって構成されてい
る。通常のパッド7(ここでは長さ2mm,幅125μm
,0.25mmピッチ)とは、QFPのリードのうち配
線に関与するものがはんだを介して必ず接合される矩形
状のパッドをいう。前記通常のパッド7は、1つのパッ
ド列3内において数十個から百数十個ほど一直線上に配
置されている。そして、これらの通常のパッド7上に
は、ソルダーレジスト5の表面の高さよりも頂部が高く
なるようにはんだプリコート層9が形成されている。
In this embodiment, each pad row 3 is composed of normal pads 7 and dummy pads 8. Normal pad 7 (here 2 mm long and 125 μm wide)
, 0.25 mm pitch) means a rectangular pad to which a lead of a QFP that is involved in wiring is always joined via solder. The ordinary pads 7 are arranged in a straight line from several tens to one hundred and several tens in one pad row 3. A solder precoat layer 9 is formed on these ordinary pads 7 so that the top is higher than the surface of the solder resist 5.

【0017】一方、ダミーパッド8とは、QFPのいず
れのリードも接合されないパッドをいう。本実施形態で
は、ダミーパッド8は1つのパッド列3において2つ形
成されていて、それらは複数の通常のパッド7の最も外
側に配置されている。従って、1つの部品実装部におい
てかかるダミーパッド8は合計8つ存在している。
On the other hand, the dummy pad 8 is a pad to which neither lead of the QFP is bonded. In the present embodiment, two dummy pads 8 are formed in one pad row 3, and they are arranged on the outermost side of a plurality of normal pads 7. Therefore, there are a total of eight such dummy pads 8 in one component mounting part.

【0018】本実施形態のダミーパッド8は略H字状の
形状を呈している。即ち、等しい幅を有する2つの直線
部8aが所定間隔を隔てて平行に形成され、両直線部8
aを互いの中央部において連結すべく連結部8bが形成
されている。そして、この連結部8bを中心とする幅広
部分がはんだ凝集部G1 になっている。それに対して、
幅広部分でない幅狭の部分はいわばはんだ凝集部G1 に
はんだを供給するための部分となっている。前記ダミー
パッド8の長さは、通常のパッド7と等しい長さに、即
ち2mmに設定されている。また、ダミーパッド8の幅
(具体的には幅広のはんだ凝集部G1 における幅)は、
約250μm に設定されており、両直線部8aの幅は7
5μm に設定されている。
The dummy pad 8 of the present embodiment has a substantially H-shape. That is, two straight portions 8a having the same width are formed in parallel at a predetermined interval, and both straight portions 8a are formed.
A connecting portion 8b is formed so as to connect "a" at the center of each other. A wide portion centered on the connecting portion 8b is a solder aggregation portion G1. On the other hand,
The narrow part other than the wide part is a part for supplying the solder to the solder aggregation part G1. The length of the dummy pad 8 is set equal to the length of the normal pad 7, that is, 2 mm. The width of the dummy pad 8 (specifically, the width at the wide solder aggregation portion G1) is
The width of both straight portions 8a is 7 μm.
It is set to 5 μm.

【0019】はんだプリコート層9はダミーパッド8上
にも形成されている。ただし、はんだは、はんだ凝集部
G1 において特に凝集して盛り上がり、それ以外の箇所
(例えば両直線部8aの端部)でははんだ凝集部G1 よ
りも相対的に少なくなっている。そして、はんだ凝集部
G1 に形成されたはんだ盛り上がり部M1 は、図2
(d)に示されるように、通常のパッド7上に形成され
たはんだプリコート層9に比べていくぶん高くなってい
る。言い換えると、はんだプリコート層9を加えたダミ
ーパッド8の頂部の高さ(即ちはんだ盛り上がり部M1
の高さ)T2 は、はんだプリコート層9を加えた通常の
パッド7の頂部の高さT1 よりも相対的に高くなってい
る。パッド7,8の厚さが35μmである本実施形態の
場合、T1 =65μm,T2 =105μmであって、そ
の差は40μmである。
The solder precoat layer 9 is also formed on the dummy pad 8. However, the solder is particularly agglomerated and bulged at the solder agglomerated portion G1, and is relatively smaller than the solder agglomerated portion G1 at other portions (for example, the ends of both the linear portions 8a). The solder bulging portion M1 formed in the solder aggregation portion G1 is shown in FIG.
As shown in (d), the height is somewhat higher than the solder precoat layer 9 formed on the normal pad 7. In other words, the height of the top of the dummy pad 8 to which the solder precoat layer 9 is added (that is, the solder swell M1)
The height T2 is relatively higher than the height T1 of the top of the normal pad 7 to which the solder precoat layer 9 is added. In the case of this embodiment in which the thickness of the pads 7 and 8 is 35 μm, T1 = 65 μm and T2 = 105 μm, and the difference is 40 μm.

【0020】次に、上記のプリント配線板1を製造する
手順を説明する。まず、従来公知の手法を用いて基板2
上に通常のパッド7及びダミーパッド8をそれぞれパタ
ーン形成した後、ソルダーレジスト5を形成する(図2
(a) ,(b) 参照)。続いて、ソルダーレジスト5の開口
部6から露出している通常のパッド7及びダミーパッド
8上に、印刷法によりクリームはんだ(ここでは共晶は
んだを主成分とするクリームはんだ)C1 を所定厚さで
印刷する(図2(c) 参照)。なお、印刷法に代わる手法
として、例えばディスペンス法、部分はんだ剥離法、は
んだキャリアを用いた転写法等の従来公知の方法を採用
してもよい。そして、リフローを行うことによりパッド
7,8上のはんだを溶融させた後、冷却及び洗浄の各工
程を行う。以上の結果、図2(d)に示されるような所
望のプリント配線板1が得られるようになっている。
Next, a procedure for manufacturing the printed wiring board 1 will be described. First, the substrate 2 is formed using a conventionally known method.
After patterning normal pads 7 and dummy pads 8 on each, a solder resist 5 is formed.
(See (a) and (b).) Subsequently, a cream solder (here, a cream solder mainly composed of eutectic solder) C1 is applied to a predetermined thickness on the normal pads 7 and the dummy pads 8 exposed from the openings 6 of the solder resist 5 by a printing method. (See FIG. 2 (c)). As a method instead of the printing method, a conventionally known method such as a dispense method, a partial solder peeling method, a transfer method using a solder carrier, or the like may be adopted. After the solder on the pads 7 and 8 is melted by performing reflow, each step of cooling and cleaning is performed. As a result, a desired printed wiring board 1 as shown in FIG. 2D can be obtained.

【0021】次に、本実施形態において特徴的な作用効
果を列挙する。 (イ)このプリント配線板1では、上記のはんだ盛り上
がり部M1 を含むダミーパッド8の頂部の高さT2 を、
はんだプリコート層9を加えた通常のパッド7の頂部の
高さT1 よりも相対的に高くしたことを特徴としてい
る。従って、プリント配線板1を150枚以上重ね合わ
せて載置したときでも、通常のパッド7上のはんだプリ
コート層9ではなく、はんだ盛り上がり部M1 が基板2
の底面に対して優先的に接触する。このように、通常の
パッド7上のはんだプリコート層9と基板2との接触が
回避される結果、そのはんだプリコート層9に傷付きや
潰れが起こりにくくなる。よって、パッド7が0.3mm
ピッチ以下であっても、はんだブリッジやはんだの偏り
等が生じることがなく、不良のない品質に優れたプリン
ト配線板1を確実に得ることができる。
Next, the characteristic effects of this embodiment will be listed. (A) In the printed wiring board 1, the height T2 of the top of the dummy pad 8 including the solder bulge M1 is set as follows:
It is characterized in that the height is relatively higher than the height T1 of the top of the normal pad 7 to which the solder precoat layer 9 is added. Therefore, even when 150 or more printed wiring boards 1 are stacked and placed, not the solder pre-coat layer 9 on the normal pad 7 but the solder swell M1
Contacts the bottom surface of As described above, the contact between the solder precoat layer 9 on the normal pad 7 and the substrate 2 is avoided, so that the solder precoat layer 9 is less likely to be damaged or crushed. Therefore, pad 7 is 0.3mm
Even if the pitch is equal to or less than the pitch, the printed wiring board 1 having no defect and excellent quality can be reliably obtained without occurrence of solder bridges and bias of the solder.

【0022】(ロ)また、本実施形態では、ダミーパッ
ド8に設けられたはんだ凝集部G1にはんだ盛り上がり
部M1 を形成することで、前記高さT2 を前記高さT1
よりも相対的に高くすることとしている。そして、はん
だ盛り上がり部M1 は、ダミーパッド8上に載せられた
クリームはんだC1 を熱で溶融させ、表面張力の作用に
よってはんだをはんだ凝集部G1 に凝集させることによ
り形成される。従って、はんだ盛り上がり部M1 を極め
て容易に形成することができる。さらに、はんだ盛り上
がり部M1 は、通常のパッド7上にはんだプリコート層
9を形成する既存の工程において同時に形成することも
可能であり、工程の複雑化や生産性の低下を伴うことも
ない。以上の二点からも明らかなように、本実施形態の
構成にであると、上記のプリント配線板1を容易に製造
することができる。
(B) In the present embodiment, the height T2 is reduced by forming the solder bulging portion M1 at the solder aggregation portion G1 provided on the dummy pad 8.
It is set to be relatively higher than that. The solder bulge M1 is formed by melting the cream solder C1 placed on the dummy pad 8 by heat and aggregating the solder into the solder aggregate G1 by the action of surface tension. Therefore, the solder bump M1 can be formed very easily. Further, the solder bulging portion M1 can be formed simultaneously with the existing process of forming the solder precoat layer 9 on the normal pad 7, without complicating the process and reducing productivity. As is clear from the above two points, with the configuration of the present embodiment, the printed wiring board 1 can be easily manufactured.

【0023】(ハ)また、本実施形態のプリント配線板
1では、ダミーパッド8の長さを通常のパッド7と略等
しいものとしている。ここで、ダミーパッド8が通常の
パッド7よりも相対的に長いものであると、基板2上に
形成用スペースが要ることでパターン設計上不利にな
り、かつ製造容易化やファイン化の妨げになる。逆に、
ダミーパッド8が通常のパッド7よりも相対的に短いも
のであると、はんだがはんだ凝集部G1 に充分に供給さ
れず、はんだ盛り上がり部M1 を高くすることができな
くなる。従って、上記のように略等しい長さのダミーパ
ッド8にしておけば、上記の問題を解消することができ
る。
(C) In the printed wiring board 1 of the present embodiment, the length of the dummy pad 8 is substantially equal to that of the normal pad 7. Here, if the dummy pad 8 is relatively longer than the normal pad 7, a space for formation on the substrate 2 is required, which is disadvantageous in pattern design, and is difficult to manufacture and hinder fineness. Become. vice versa,
If the dummy pad 8 is relatively shorter than the normal pad 7, the solder will not be sufficiently supplied to the solder aggregation portion G1, and the solder protrusion M1 will not be able to be raised. Therefore, if the dummy pads 8 having substantially the same length are provided as described above, the above problem can be solved.

【0024】(ニ)本実施形態のダミーパッド8は略H
字状であるため、2本の直線部8a上にて溶融したはん
だが、連結部8bを中心とするはんだ凝集部G1 へと4
つの領域から凝集してくる。従って、所定高さのはんだ
盛り上がり部M1 を形成しうるはんだ量が確実に確保さ
れる。この場合、ダミーパッド8においてはんだ凝集部
G1 以外の部分のはんだ量が少なくなったとしても、格
段の支障はない。即ち、ダミーパッド8は上記のように
配線に関与しないものであって、QFPのリードとの間
にはんだフィレットを形成する必要がないからである。
(D) The dummy pad 8 of this embodiment is substantially H
The solder melted on the two straight portions 8a is formed into a solder aggregated portion G1 centered on the connecting portion 8b.
From one area. Therefore, the amount of solder that can form the solder protrusion M1 of a predetermined height is reliably ensured. In this case, even if the amount of solder in the portion other than the solder aggregation portion G1 in the dummy pad 8 is reduced, there is no significant problem. That is, the dummy pad 8 does not participate in wiring as described above, and it is not necessary to form a solder fillet between the dummy pad 8 and the QFP lead.

【0025】なお、本発明は上記実施形態に代えて、例
えば次のような形態に変更することが可能である。 ◎図3に示される別例1のダミーパッド11は、いわば
矩形状をした既存のパッドを長手方向に沿って2箇所か
ら切り欠いたような形状をしている。このような切り欠
き部12を備えるダミーパッド11の場合、切り欠き部
12の切り欠き端の間に存在する部分が幅広になってい
るため、当該部分がはんだ凝集部G1 として機能する。
このような形態のダミーパッド11であっても、積層載
置時おける通常のパッド7上のはんだプリコート層9の
傷付きや潰れを低減することができる。
The present invention can be modified, for example, in the following manner instead of the above embodiment. The dummy pad 11 of the other example 1 shown in FIG. 3 has a shape in which an existing rectangular pad is cut out from two places along the longitudinal direction. In the case of the dummy pad 11 having such a notch portion 12, the portion existing between the notch ends of the notch portion 12 is wide, so that the portion functions as a solder aggregation portion G1.
Even with the dummy pad 11 having such a configuration, it is possible to reduce the damage and crushing of the solder precoat layer 9 on the normal pad 7 at the time of stacking and mounting.

【0026】◎図4には各種の別例が示されている。図
4(a)に示される別例2のダミーパッド14は略菱形
状であって、幅広の中央部がはんだ凝集部G1 として機
能する。図4(b)に示される別例3のダミーパッド1
7では、その中央部にはんだ凝集部G1 として機能する
円形状幅広部分があり、その円形状幅広部分から2方向
に二等辺三角形状の幅狭部分が延設されている。図4
(c)に示される別例4のダミーパッド21は全体が二
等辺三角形状であって、その底辺側にある幅広部分がは
んだ凝集部G1 として機能する。即ち、はんだ凝集部G
1 は必ずしもダミーパッドの中央部になくてもよい。図
4(d)に示される別例5のダミーパッド24では、そ
の中央部にはんだ凝集部G1 として機能する略円形状幅
広部分があり、その略円形状幅広部分から2方向に矩形
状の幅狭部分が延設されている。なお、幅広部分と幅狭
部分とはいくぶん偏心している。図4(e)に示される
別例6のダミーパッド27は実施形態と類似の形態を有
しているものの、はんだ凝集部G1 となる連結部の位置
が中心からずれている。図4(f)に示される別例7の
ダミーパッド31は、細長い直角三角形状のパッドを底
辺側において連結したような形態になっている。従っ
て、その底辺側端部がはんだ凝集部G1 として機能する
幅広部分になっていて、それ以外の部分が幅狭部分にな
っている。図4(g)に示される別例8ダミーパッド3
4は略V字状であって、鋭角的に屈曲している屈曲部分
がはんだ凝集部G1 として機能するようになっている。
図4(h)に示される別例9のダミーパッド37は略X
字状であって、その中央部にある幅広のクロス部分がは
んだ凝集部G1 として機能するようになっている。以上
列挙した各種ダミーパッド14,17…37でも、積層
載置時おける通常のパッド7上のはんだプリコート層9
の傷付きや潰れを低減することができる。
FIG. 4 shows various other examples. The dummy pad 14 of another example 2 shown in FIG. 4A has a substantially rhombic shape, and a wide central portion functions as a solder aggregation portion G1. Dummy pad 1 of another example 3 shown in FIG.
In FIG. 7, a circular wide portion functioning as a solder aggregation portion G1 is provided at the center thereof, and an isosceles triangular narrow portion extends in two directions from the circular wide portion. FIG.
The dummy pad 21 of another example 4 shown in (c) has an isosceles triangular shape as a whole, and a wide portion on the bottom side functions as a solder aggregation portion G1. That is, the solder aggregation portion G
1 need not necessarily be at the center of the dummy pad. In a dummy pad 24 of another example 5 shown in FIG. 4D, there is a substantially circular wide portion functioning as a solder aggregation portion G1 at the center thereof, and a rectangular width in two directions from the substantially circular wide portion. The narrow part is extended. Note that the wide and narrow portions are somewhat eccentric. Although the dummy pad 27 of another example 6 shown in FIG. 4E has a form similar to that of the embodiment, the position of the connecting portion serving as the solder aggregation portion G1 is shifted from the center. The dummy pad 31 of another example 7 shown in FIG. 4F has a form in which elongated right triangle pads are connected on the bottom side. Therefore, the bottom side end is a wide portion functioning as the solder aggregation portion G1, and the other portion is a narrow portion. Another example 8 dummy pad 3 shown in FIG.
Numeral 4 is substantially V-shaped, and a bent portion bent at an acute angle functions as a solder aggregation portion G1.
The dummy pad 37 of another example 9 shown in FIG.
It is shaped like a letter, and the wide cross portion at the center thereof functions as a solder aggregation portion G1. Even with the various dummy pads 14, 17,...
Can be reduced.

【0027】◎ダミーパッド8,11…37は通常のパ
ッド7と略同じ長さであることが好ましいものの、それ
を通常のパッド7より長くまたは短くした構成を採るこ
ともある程度は許容される。
The dummy pads 8, 11,... 37 are preferably approximately the same length as the normal pads 7, but it is possible to some extent to adopt a configuration in which they are longer or shorter than the normal pads 7.

【0028】◎ダミーパッド8上へのはんだプリコート
層9の形成は、通常のパッド7上へのはんだプリコート
層9を形成する工程において同時に行うことが好ましい
ものの、それを別工程で行なうことも可能である。
The formation of the solder pre-coat layer 9 on the dummy pad 8 is preferably performed simultaneously with the usual step of forming the solder pre-coat layer 9 on the pad 7, but may be performed in a separate step. It is.

【0029】◎ダミーパッド8,11…37の頂部の高
さT2 を、前記はんだプリコート層9を加えた通常のパ
ッド7の頂部の高さT1 よりも相対的に高くするために
は、勿論、はんだ以外の手法(例えば接着剤等の塗布な
ど)を用いることも可能である。ただし、製造容易とい
う点においてはんだを用いた手法のほうが優れている。
In order to make the height T2 of the tops of the dummy pads 8, 11... 37 relatively higher than the height T1 of the tops of the normal pads 7 to which the solder precoat layer 9 is added, of course, It is also possible to use a method other than soldering (for example, application of an adhesive or the like). However, the method using solder is superior in terms of ease of manufacture.

【0030】(6)また、ダミーパッドには必ずしもは
んだプリコート層9が形成されていなくてもよく、例え
ばそのダミーパッド単独によって、前記はんだプリコー
ト層9を加えた通常のパッド7の頂部の高さT1 よりも
相対的に高くしてもよい。ただし、パターン形成が面倒
になるおそれがあることから、一般的には実施形態の構
成のほうが好ましい。
(6) Further, the solder pre-coat layer 9 may not necessarily be formed on the dummy pad. For example, the height of the top of the normal pad 7 to which the solder pre-coat layer 9 is added may be formed by the dummy pad alone. It may be relatively higher than T1. However, since the pattern formation may be troublesome, the configuration of the embodiment is generally preferable.

【0031】ここで、特許請求の範囲に記載された技術
的思想のほかに、前述した実施形態によって把握される
技術的思想をその効果とともに以下に列挙する。 (1) 請求項1〜3のいずれかにおいて、前記ダミー
パッドは1つのパッド列を構成する複数の通常のパッド
の最も外側に配置されることを特徴とするプリント配線
板。この構成であると、設計上ダミーパッドを配置しや
すくなり、ひいてはプリント配線板の製造容易化を図る
ことができる。
Here, in addition to the technical ideas described in the claims, the technical ideas grasped by the above-described embodiments are listed below together with their effects. (1) The printed wiring board according to any one of claims 1 to 3, wherein the dummy pad is arranged at the outermost side of a plurality of normal pads constituting one pad row. With this configuration, the dummy pads can be easily arranged in design, and the production of the printed wiring board can be facilitated.

【0032】(2) 請求項2,3、技術的思想1のい
ずれかにおいて、前記ダミーパッドの前記はんだ凝集部
は同ダミーパッドの略中央部に形成されていることを特
徴とするプリント配線板。この構成であると、はんだ凝
集部をダミーパッドの端部に設けた場合に比べて、溶融
したはんだをスムーズに凝集させることができ、はんだ
盛り上がり部を確実に高くすることができる。
(2) The printed wiring board according to any one of claims 2 and 3 and the technical idea 1, wherein the solder aggregation portion of the dummy pad is formed substantially at the center of the dummy pad. . With this configuration, compared with the case where the solder aggregation portion is provided at the end of the dummy pad, the molten solder can be aggregated more smoothly, and the solder swell portion can be reliably increased.

【0033】(3) 請求項2,3、技術的思想1,2
のいずれかにおいて、前記ダミーパッドは略H状である
ことを特徴とするプリント配線板。この構成であると、
技術的思想2と同様の作用効果を奏することができる。
(3) Claims 2 and 3, technical ideas 1 and 2
In any one of the above, the dummy pad is substantially H-shaped. With this configuration,
The same operation and effect as in the technical idea 2 can be obtained.

【0034】(4) 請求項1〜3、技術的思想1〜3
のいずれかにおいて、前記ダミーパッドは1つの部品搭
載部において離間した位置に複数個形成されていること
を特徴とするプリント配線板。この構成であると、はん
だ盛り上がり部が1箇所のみの場合とは異なり、複数箇
所にできるはんだ盛り上がり部によって通常のパッド上
のはんだ層と基板との接触が確実に回避される。
(4) Claims 1-3, technical ideas 1-3
In any one of the above, a plurality of the dummy pads are formed at separated positions in one component mounting portion. With this configuration, unlike the case where there is only one solder bulging portion, the contact between the solder layer on the normal pad and the substrate is reliably avoided by the solder bulging portions formed at a plurality of locations.

【0035】なお、本明細書中において使用した技術用
語を次のように定義する。 「はんだ: 共晶はんだに代表されるPb系のはんだを
いうほか、例えばAu系やIn系のはんだ等も含む。」
The technical terms used in this specification are defined as follows. "Solder: Pb-based solder typified by eutectic solder, as well as, for example, Au-based and In-based solders."

【0036】[0036]

【発明の効果】以上詳述したように、請求項1〜3に記
載の発明によれば、複数枚重ね合わせて載置したときで
も、パッド上のはんだ層に傷付きや潰れが起こりにくい
プリント配線板を提供することができる。
As described in detail above, according to the first to third aspects of the present invention, even when a plurality of sheets are placed one on top of the other, the solder layer on the pad is hardly damaged or crushed. A wiring board can be provided.

【0037】請求項2に記載の発明によれば、製造が容
易なプリント配線板を提供することができる。請求項3
に記載の発明によれば、製造容易化やファイン化を妨げ
ることもなく、しかも確実にはんだ盛り上がり部を高く
することができる。
According to the second aspect of the present invention, it is possible to provide a printed wiring board which is easy to manufacture. Claim 3
According to the invention described in (1), it is possible to reliably increase the height of the solder swell without obstructing the facilitation of manufacturing and the fineness.

【図面の簡単な説明】[Brief description of the drawings]

【図1】(a)は実施形態のプリント配線板を示す部分
平面図、(b)はその要部拡大平面図。
FIG. 1A is a partial plan view showing a printed wiring board of an embodiment, and FIG. 1B is an enlarged plan view of a main part thereof.

【図2】(a)〜(d)は、同プリント配線板における
パッド列形成部位を示す要部拡大断面図。
FIGS. 2A to 2D are enlarged cross-sectional views of a main part showing a pad row formation site in the printed wiring board.

【図3】別例1のプリント配線板におけるパッド列形成
部位を示す要部拡大平面図。
FIG. 3 is an enlarged plan view of a main part showing a pad row formation site in a printed wiring board of another example 1.

【図4】(a)〜(h)は、別例2〜別例9のダミーパ
ッドの平面図。
FIGS. 4A to 4H are plan views of dummy pads according to other examples 2 to 9;

【図5】(a)は従来のプリント配線板を示す部分平面
図、(b)は同プリント配線板のパッド列形成部位の要
部拡大斜視図、(c)は同じく要部拡大断面図。
5A is a partial plan view showing a conventional printed wiring board, FIG. 5B is an enlarged perspective view of a main part of a pad row forming portion of the printed wiring board, and FIG.

【図6】従来の問題点を説明するための要部拡大斜視
図。
FIG. 6 is an enlarged perspective view of a main part for describing a conventional problem.

【符号の説明】[Explanation of symbols]

1…プリント配線板、2…基板、3…パッド列、5…ソ
ルダーレジスト、6…開口部、8,11,14,17,
21,24,27,31,34,37…ダミーパッド、
9…はんだプリコート層、T2 …ダミーパッドの高さ、
T1 …通常のパッドの高さ、G1 …はんだ凝集部、M1
…はんだ盛り上がり部。
DESCRIPTION OF SYMBOLS 1 ... Printed wiring board, 2 ... Board, 3 ... Pad row, 5 ... Solder resist, 6 ... Opening, 8, 11, 14, 17,
21, 24, 27, 31, 34, 37 ... dummy pad,
9: solder precoat layer, T2: height of dummy pad,
T1: Normal pad height, G1: Solder aggregation, M1
... Soldering swell.

Claims (3)

【特許請求の範囲】[Claims] 【請求項1】複数のパッドからなるパッド列を備えるプ
リント配線板において、 前記パッド列は、配線に関与しかつはんだプリコート層
が形成される通常のパッドと配線に関与しないダミーパ
ッドとによって構成され、前記ダミーパッドの高さを、
前記はんだプリコート層を加えた前記通常のパッドの高
さよりも相対的に高くしたことを特徴とするプリント配
線板。
1. A printed wiring board provided with a pad row composed of a plurality of pads, wherein said pad row is constituted by a normal pad on which a solder pre-coat layer is formed and a dummy pad which does not participate in the wiring. , The height of the dummy pad,
A printed wiring board, which is relatively higher than the height of the normal pad to which the solder precoat layer is added.
【請求項2】前記ダミーパッドははんだ凝集部を備え、
そのはんだ凝集部にははんだが凝集して盛り上がったは
んだ盛り上がり部が形成されていることを特徴とする請
求項1に記載のプリント配線板。
2. The method according to claim 1, wherein the dummy pad includes a solder aggregation portion.
The printed wiring board according to claim 1, wherein the solder aggregation portion has a solder bulge portion formed by agglomeration of the solder.
【請求項3】前記ダミーパッドの長さを、前記通常のパ
ッドの長さと略等しく設定したことを特徴とする請求項
2に記載のプリント配線板。
3. The printed wiring board according to claim 2, wherein the length of said dummy pad is set substantially equal to the length of said normal pad.
JP34378096A 1996-12-24 1996-12-24 Printed wiring board Expired - Fee Related JP3795600B2 (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP34378096A JP3795600B2 (en) 1996-12-24 1996-12-24 Printed wiring board

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP34378096A JP3795600B2 (en) 1996-12-24 1996-12-24 Printed wiring board

Publications (2)

Publication Number Publication Date
JPH10190203A true JPH10190203A (en) 1998-07-21
JP3795600B2 JP3795600B2 (en) 2006-07-12

Family

ID=18364189

Family Applications (1)

Application Number Title Priority Date Filing Date
JP34378096A Expired - Fee Related JP3795600B2 (en) 1996-12-24 1996-12-24 Printed wiring board

Country Status (1)

Country Link
JP (1) JP3795600B2 (en)

Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN100355327C (en) * 2005-03-25 2007-12-12 华为技术有限公司 A printed circuit board and production method thereof
CN100416807C (en) * 2004-10-20 2008-09-03 力晶半导体股份有限公司 Semiconductor package structure and producing method thereof
JP2009135403A (en) * 2007-11-30 2009-06-18 Hynix Semiconductor Inc Substrate for semiconductor package, and semiconductor package having the same
JP2009289999A (en) * 2008-05-29 2009-12-10 Renesas Technology Corp Semiconductor device and method for manufacturing it
KR20210001894A (en) * 2019-06-28 2021-01-06 엘지디스플레이 주식회사 Electronic device and manufacturing method thereof, and display device and manufacturing method thereof

Cited By (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN100416807C (en) * 2004-10-20 2008-09-03 力晶半导体股份有限公司 Semiconductor package structure and producing method thereof
CN100355327C (en) * 2005-03-25 2007-12-12 华为技术有限公司 A printed circuit board and production method thereof
JP2009135403A (en) * 2007-11-30 2009-06-18 Hynix Semiconductor Inc Substrate for semiconductor package, and semiconductor package having the same
US8581397B2 (en) 2007-11-30 2013-11-12 Hynix Semiconductor Inc. Substrate for semiconductor package with improved bumping of chip bumps and contact pads and semiconductor package having the same
JP2009289999A (en) * 2008-05-29 2009-12-10 Renesas Technology Corp Semiconductor device and method for manufacturing it
KR20210001894A (en) * 2019-06-28 2021-01-06 엘지디스플레이 주식회사 Electronic device and manufacturing method thereof, and display device and manufacturing method thereof

Also Published As

Publication number Publication date
JP3795600B2 (en) 2006-07-12

Similar Documents

Publication Publication Date Title
US5889326A (en) Structure for bonding semiconductor device to substrate
US7285734B2 (en) Circuit board and method for manufacturing the same and semiconductor device and method for manufacturing the same
JPH09129686A (en) Tape carrier and its mounting structure
JP2008252042A (en) Circuit substrate and forming method therefor
JPH10190203A (en) Printed wiring board
JPH07273119A (en) Semiconductor device
JP3315871B2 (en) Wiring board having solder bumps and method of manufacturing the same
JPH08195548A (en) Electronic component mounting method
JP2800691B2 (en) Circuit board connection structure
JPH06169153A (en) Printed wiring board
JPH0357223A (en) Semiconductor device
JP3739229B2 (en) Semiconductor device
JPH0739220B2 (en) Cream Solder screen mask
JPH05166812A (en) Semiconductor device
JPH09252074A (en) Package with lead and bonding method thereof
JPH05327020A (en) Printed wiring board
JPH06244541A (en) Circuit board device
JP2526796B2 (en) Tape carrier package
JPH04196332A (en) Electronic circuit device
JPS58165394A (en) Mounting structure for electronic part
JPH0342691Y2 (en)
JPH1197205A (en) Chip resistor
JP2002246203A (en) Chip resistor
JPH0269992A (en) Method of soldering lead of surface mounting part
JP2008004757A (en) Mounting structure of semiconductor component, and mounting board used for it

Legal Events

Date Code Title Description
A131 Notification of reasons for refusal

Effective date: 20050927

Free format text: JAPANESE INTERMEDIATE CODE: A131

A521 Written amendment

Effective date: 20051128

Free format text: JAPANESE INTERMEDIATE CODE: A523

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Effective date: 20060404

Free format text: JAPANESE INTERMEDIATE CODE: A01

A61 First payment of annual fees (during grant procedure)

Effective date: 20060413

Free format text: JAPANESE INTERMEDIATE CODE: A61

R150 Certificate of patent (=grant) or registration of utility model

Free format text: JAPANESE INTERMEDIATE CODE: R150

FPAY Renewal fee payment (prs date is renewal date of database)

Year of fee payment: 4

Free format text: PAYMENT UNTIL: 20100421

FPAY Renewal fee payment (prs date is renewal date of database)

Year of fee payment: 5

Free format text: PAYMENT UNTIL: 20110421

FPAY Renewal fee payment (prs date is renewal date of database)

Year of fee payment: 6

Free format text: PAYMENT UNTIL: 20120421

FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20130421

Year of fee payment: 7

LAPS Cancellation because of no payment of annual fees