JPH09298496A - Transmitter-receiver for pilot signal - Google Patents
Transmitter-receiver for pilot signalInfo
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- JPH09298496A JPH09298496A JP11350396A JP11350396A JPH09298496A JP H09298496 A JPH09298496 A JP H09298496A JP 11350396 A JP11350396 A JP 11350396A JP 11350396 A JP11350396 A JP 11350396A JP H09298496 A JPH09298496 A JP H09298496A
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Abstract
Description
【０００１】[0001]
【発明の属する技術分野】本発明は送受信装置に関し、
特に移動体通信装置に使用されるフィードフォワード回
路の増幅器内部のパイロット信号の送受信装置に関す
る。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a transmitting / receiving apparatus,
In particular, the present invention relates to a pilot signal transmitter / receiver inside an amplifier of a feedforward circuit used in a mobile communication device.
【０００２】[0002]
【従来の技術】従来、パイロット信号の送受信装置では
ないが、酷似する一般の送受信装置として、たとえば特
開昭５７−１９３１３３号公報に示されるように、送受
信を共用する１つの基準発振器を用いて行うことが、装
置の小型軽量、消費電力低減、コスト低減を目的として
実施されている。2. Description of the Related Art Conventionally, although not a transmitter / receiver for pilot signals, as a general transmitter / receiver that closely resembles, one reference oscillator for sharing transmitter / receiver is used as shown in Japanese Patent Laid-Open No. 193133/1982. What is done is carried out for the purpose of reducing the size and weight of the device, reducing power consumption, and reducing costs.
【０００３】図３は従来のＰＭ変調方式による送受信装
置の一例の構成を示すブロック図である。同図におい
て、３１は送受信共用器、３２は受信混合器、３３は帯
域フィルタ、３４は振幅制限増幅器（リミッタ）、３５
は周波数弁別器、３６は演算増幅器、３７は周波数逓倍
増幅器、３８は受信局発混合器、３９は帯域フィルタ、
４０は位相振幅等価器、４１は水晶基準発振器、４２は
分周器、４３は送信周波数増幅器、４４は位相比較器、
４５は積分器、４６は電圧制御発振器、４７は可変分周
器、４８は周波数変調器、４９は瞬時振幅制限器であ
る。FIG. 3 is a block diagram showing the configuration of an example of a conventional transmission / reception apparatus using the PM modulation method. In the figure, 31 is a transmission / reception duplexer, 32 is a reception mixer, 33 is a band filter, 34 is an amplitude limiting amplifier (limiter), and 35 is
Is a frequency discriminator, 36 is an operational amplifier, 37 is a frequency multiplication amplifier, 38 is a receiving station mixer, 39 is a band filter,
40 is a phase amplitude equalizer, 41 is a crystal reference oscillator, 42 is a frequency divider, 43 is a transmission frequency amplifier, 44 is a phase comparator,
Reference numeral 45 is an integrator, 46 is a voltage controlled oscillator, 47 is a variable frequency divider, 48 is a frequency modulator, and 49 is an instantaneous amplitude limiter.
【０００４】従来の回路で、送信波は、水晶基準発振器
４１で発振された基準周波数ｆr を分周する分周器４２
の出力によって制御される電圧制御発振器４６の出力で
ある発振波ｆVCO を、送信変調入力Ｔi をリミッタ４９
に通した後、周波数変調器４８に入力させて周波数変調
を行い、これによって得られた被変調波ｆtmを増幅器４
３→共用器３１を通じて送信出力Ｐとして送信してい
る。In the conventional circuit, the transmitted wave divides the reference frequency f r oscillated by the crystal reference oscillator 41 into a frequency divider 42.
The oscillation wave f VCO is the output of the voltage controlled oscillator 46 which is controlled by the output of the transmission modulation input T i limiter 49
Then, it is input to the frequency modulator 48 to perform frequency modulation, and the modulated wave f tm obtained by this is modulated by the amplifier 4
3 → Transmitted as a transmission output P through the duplexer 31.
【０００５】又、特開昭６０−１４６５３２号公報にお
いても、同様に電圧制御発振器の出力を増幅器→共用器
を通じて送信出力している。In Japanese Patent Laid-Open No. 60-146532, the output of the voltage controlled oscillator is also transmitted and output through the amplifier → shared device.
【０００６】[0006]
【発明が解決しようとする課題】上記従来技術の問題点
は次のようなものである。The problems of the above-mentioned prior art are as follows.
【０００７】第１の問題点は、従来の技術において送
信、受信の周波数が異なる２波を用いる場合、共用器を
必要としているために共用器において高調波を除去する
ことが出来るが、本発明と同じように送信、受信の周波
数が同一の場合、共用器を用いることが出来ない為、従
来の技術における共用器が不要となる。この為、送信信
号に電圧制御発振器出力のスプリアスが含まれてしまう
ことである。The first problem is that when two waves with different transmission and reception frequencies are used in the prior art, a duplexer is required and therefore harmonics can be removed in the duplexer. Similarly, when the transmission and reception frequencies are the same, since the duplexer cannot be used, the duplexer in the conventional technique is unnecessary. Therefore, the transmission signal includes spurious output from the voltage controlled oscillator.
【０００８】その理由は、従来技術において共用器を使
用出来ず、電圧制御発振器の出力を直接、送信信号とし
て使用しなくてはならない為である。The reason is that the duplexer cannot be used in the prior art, and the output of the voltage controlled oscillator must be directly used as the transmission signal.
【０００９】本発明の目的は、上記従来技術の問題点に
鑑み、送受信周波数が同一周波数で、共用器を使用出来
ないパイロット信号の送受信装置において、共用器がな
い為に発生する送信時のパイロット信号のスプリアスを
除去する回路を組み込んだ送受信装置を提供することに
ある。In view of the above-mentioned problems of the prior art, an object of the present invention is to provide a pilot signal transmitting / receiving apparatus which has the same transmission / reception frequency and cannot use a duplexer because there is no duplexer at the time of transmission. It is an object of the present invention to provide a transmitter / receiver incorporating a circuit for removing spurious signals.
【００１０】[0010]
【課題を解決するための手段】本発明は、上記目的を達
成するために、送受信に同一周波数を用い、基準信号発
振器を共有するパイロット信号の送受信装置において、
基準周波数の信号を出力する基準信号発振器と、前記基
準信号発振器からの基準信号出力を分周し設定周波数に
ロックして出力する電圧制御発振器を含むＰＬＬ回路
と、前記電圧制御発振器からの設定周波数の出力と前記
基準信号発振器からの基準信号出力との混合出力を受
け、パイロット信号を出力する帯域フィルタを有するこ
とを特徴とする。In order to achieve the above object, the present invention provides a pilot signal transmitting / receiving apparatus which uses the same frequency for transmission and reception and shares a reference signal oscillator,
A reference signal oscillator that outputs a signal of a reference frequency, a PLL circuit that includes a voltage control oscillator that divides a reference signal output from the reference signal oscillator and locks and outputs the reference signal at a set frequency, and a set frequency from the voltage controlled oscillator And a reference signal output from the reference signal oscillator, and a bandpass filter for outputting a pilot signal.
【００１１】また、受信に際し、前記電圧制御発振器か
らの設定周波数の出力と受信信号とを混合する混合器を
有し、中間周波数信号を出力することを特徴とする。Further, when receiving, a mixer for mixing the output of the set frequency from the voltage controlled oscillator and the received signal is provided, and the intermediate frequency signal is output.
【００１２】本発明では基準信号発振器と電圧制御発振
器出力を混合してパイロット信号を生成する為、基準信
号発振器と電圧制御発振器の出力のスプリアスが混合器
で混合された後、その出力から帯域フィルタを用いてス
プリアス除去を容易に行なえる。In the present invention, the reference signal oscillator and the voltage controlled oscillator output are mixed to generate the pilot signal. Therefore, after the spurious of the outputs of the reference signal oscillator and the voltage controlled oscillator are mixed by the mixer, the bandpass filter is output from the output. Can be used to easily remove spurious.
【００１３】[0013]
【発明の実施の形態】本発明の実施形態について図面を
参照して詳細に説明する。Embodiments of the present invention will be described in detail with reference to the drawings.
【００１４】図１は本発明の実施例の構成を示すブロッ
ク図である。同図において、１は帯域フィルタ（ＢＰ
Ｆ）、２は増幅器、３は電圧制御発振器（ＶＣＯ）、４
はループフィルタ、５は位相比較器、６はプログラマブ
ルデバイダ、７はプリスケーラ、８は基準信号発振器、
９、１０は増幅器、１１、１３は混合器、１２は分周器、
１４、１６は増幅器、１５は帯域フィルタ、１７は検波
器である。FIG. 1 is a block diagram showing the configuration of an embodiment of the present invention. In the figure, 1 is a bandpass filter (BP).
F), 2 is an amplifier, 3 is a voltage controlled oscillator (VCO), 4
Is a loop filter, 5 is a phase comparator, 6 is a programmable divider, 7 is a prescaler, 8 is a reference signal oscillator,
9, 10 are amplifiers, 11 and 13 are mixers, 12 is a frequency divider,
Reference numerals 14 and 16 are amplifiers, 15 is a bandpass filter, and 17 is a wave detector.
【００１５】図１を参照すると、基準信号発振器８の出
力信号は増幅器１０で増幅され、分周器１２を経て位相
比較器５に入力される。又、分周比設定端子２０によっ
て設定された、プログラムデバイダ６とプリスケーラ７
で分周された周波数も同時に位相比較器５に入力され、
位相差に比例したパルスを発生し、ループフィルタ４で
積分され電圧制御発振器３に入力される。又、ループフ
ィルタ４で積分された積分電圧はプログラムデバイダ６
の出力周波数と基準信号器８の分周周波数とが同期され
る様に出力される。次にプログラムデバイダ６からの分
周出力周波数と基準信号発振器８の分周周波数とが同一
となってループロックがかかり、電圧制御発振器３の出
力が一定の周波数で安定出力される。その出力は分配さ
れ、増幅器１８で増幅して混合器１１に入力され、基準
周波数と混合し送信出力が混合器１１より出力される。
混合器１１の出力は、増幅器２を通り、帯域フィルタ１
にて不要成分を除去してパイロット信号として出力され
る。電圧制御発振器３の分配出力の他方は増幅器１９に
て増幅されて混合器１３に入力されて、増幅器１４で増
幅されて受信信号と混合され中間周波数に変換される。
そして混合器１３の出力は帯域フィルタ１５を通り増幅
器１６を経て検波器１７にて受信信号の検波電圧として
取り出される構成である。Referring to FIG. 1, the output signal of the reference signal oscillator 8 is amplified by the amplifier 10, and is input to the phase comparator 5 via the frequency divider 12. In addition, the program divider 6 and the prescaler 7 set by the division ratio setting terminal 20.
The frequency divided by is also input to the phase comparator 5 at the same time,
A pulse proportional to the phase difference is generated, integrated by the loop filter 4 and input to the voltage controlled oscillator 3. In addition, the integrated voltage integrated by the loop filter 4 is the program divider 6
Of the reference signal 8 and the divided frequency of the reference signal device 8 are output so as to be synchronized with each other. Then, the frequency division output frequency from the program divider 6 and the frequency division frequency of the reference signal oscillator 8 become the same, and the loop is locked, and the output of the voltage controlled oscillator 3 is stably output at a constant frequency. The output is distributed, amplified by the amplifier 18, input to the mixer 11, mixed with the reference frequency, and the transmission output is output from the mixer 11.
The output of mixer 11 passes through amplifier 2 and bandpass filter 1
At, the unnecessary components are removed and output as a pilot signal. The other distributed output of the voltage controlled oscillator 3 is amplified by the amplifier 19 and input to the mixer 13, amplified by the amplifier 14 and mixed with the received signal to be converted into an intermediate frequency.
The output of the mixer 13 passes through the bandpass filter 15, the amplifier 16, and is detected by the wave detector 17 as the detected voltage of the received signal.
【００１６】本発明の実施例の作用を図を参照して詳細
に説明する。図２は本発明の実施例の作用を示す図であ
る。The operation of the embodiment of the present invention will be described in detail with reference to the drawings. FIG. 2 is a diagram showing the operation of the embodiment of the present invention.
【００１７】本件の説明を行なうに当り、送信周波数ｆ
T ＝８００ＭＨｚと受信周波数ｆR＝８００ＭＨｚと
し、中間周波数ｆRΔ＝９０ＭＨｚとなる設計を前提に
説明する。In explaining the present case, the transmission frequency f
The description will be made on the assumption that T = 800 MHz and the reception frequency f R = 800 MHz, and the intermediate frequency f R Δ = 90 MHz.
【００１８】基準信号発振器８から出力された信号は増
幅器１０にて増幅され、分周器１２で分周し位相比較器
５に入力される。又、分周比設定端子２０により設定さ
れた、プログラマブルデバイダ６とプリスケーラ７で分
周された周波数も同時に位相比較器５に入力され、比較
器５はその位相差に比例したパルス幅を有する信号を発
生し、ループフィルタ４で積分され制御電圧として電圧
制御発振器３に与えられる。積分電圧はプログラマブル
デバイダ６の出力周波数と基準信号発振器８の分周周波
数とが同期される様に出力される。そして、プログラム
デバイダ６からの分周出力周波数と基準信号発振器８の
分周周波数が同一となり、ループロックがかかり電圧制
御発振器３の出力が一定の周波数で安定する（本動作は
ＰＬＬシンセサイザの基本動作である）。本回路では電
圧制御発振器３の出力がｆVO＝８９０ＭＨｚになる様、
プログラマブルデバイダ６に入力される分周比設定端子
２０によって制御されている。このｆVO＝８９０ＭＨｚ
は分配されて増幅器１８で増幅して混合器１１に入力さ
れ、基準信号発振器８からの基準周波数ｆ0 ＝９０ＭＨ
ｚと混合され、ｆT ＝ｆVO−ｆ0 ＝８９０−９０＝８０
０ＭＨｚのパイロット信号を与ている。このｆT ＝８０
０ＭＨｚは増幅器２で増幅され、帯域フィルタ１を通り
高調波等の不要成分を除去し、クリーンなパイロット信
号として出力される。The signal output from the reference signal oscillator 8 is amplified by the amplifier 10, divided by the frequency divider 12, and input to the phase comparator 5. Further, the frequency divided by the programmable divider 6 and the prescaler 7 set by the division ratio setting terminal 20 is also input to the phase comparator 5 at the same time, and the comparator 5 outputs a signal having a pulse width proportional to the phase difference. Is generated, integrated by the loop filter 4 and given to the voltage controlled oscillator 3 as a control voltage. The integrated voltage is output so that the output frequency of the programmable divider 6 and the divided frequency of the reference signal oscillator 8 are synchronized. Then, the frequency division output frequency from the program divider 6 and the frequency division frequency of the reference signal oscillator 8 become the same, loop lock is applied, and the output of the voltage controlled oscillator 3 stabilizes at a constant frequency (this operation is the basic operation of the PLL synthesizer. Is). In this circuit, the output of the voltage controlled oscillator 3 becomes f VO = 890MHz,
It is controlled by the frequency division ratio setting terminal 20 input to the programmable divider 6. This f VO = 890MHz
Is distributed, amplified by the amplifier 18, input to the mixer 11, and the reference frequency f 0 = 90 MH from the reference signal oscillator 8.
mixed with z, f T = f VO −f 0 = 890−90 = 80
A 0 MHz pilot signal is applied. This f T = 80
0 MHz is amplified by the amplifier 2, passes through the bandpass filter 1, removes unnecessary components such as harmonics, and is output as a clean pilot signal.
【００１９】又、電圧制御発振器３の分配出力のもう一
方は、増幅器１９にて増幅されて混合器１３に入力され
て、増幅器１４で増幅された受信信号ｆR ＝８００ＭＨ
ｚと混合され、ｆ＝ｆVO−ｆR ＝８９０−８００＝９０
ＭＨｚの中間周波数信号が得られる。The other distributed output of the voltage controlled oscillator 3 is amplified by the amplifier 19 and input to the mixer 13, and the received signal f R = 800 MH amplified by the amplifier 14.
mixed with z, f = f VO −f R = 890−800 = 90
An intermediate frequency signal of MHz is obtained.
【００２０】混合器１３から出力される中間周波数の信
号は、帯域フィルタ１５を通り増幅器１６を経て検波器
１７にて受信信号の周波数に比例した検波電圧として出
力される。The intermediate frequency signal output from the mixer 13 is output as a detection voltage proportional to the frequency of the received signal by the detector 17 after passing through the bandpass filter 15 and the amplifier 16.
【００２１】[0021]
【発明の効果】本発明の構成によれば、電圧制御発振器
の出力に高調波等の不要成分を除去する帯域フィルタを
入れたことで、送信出力に高調波成分のないパイロット
信号を出力することが出来るという効果を奏する。According to the structure of the present invention, a band-pass filter for removing unnecessary components such as higher harmonics is inserted in the output of the voltage controlled oscillator, so that a pilot signal having no higher harmonic components is output to the transmission output. There is an effect that can be.
【図１】本発明の実施例の構成を示すブロック図FIG. 1 is a block diagram showing a configuration of an embodiment of the present invention.
【図２】本発明の実施例の作用を示す図FIG. 2 is a diagram showing the operation of the embodiment of the present invention.
【図３】従来のＰＭ変調方式による送受信装置の一例の
構成を示すブロック図FIG. 3 is a block diagram showing a configuration of an example of a transmission / reception device using a conventional PM modulation method.
１ 帯域フィルタＢＰＦ ２ 増幅器 ３ 電圧制御発振器ＶＣＯ ４ ループフィルタ ５ 位相比較器 ６ プログラマブルデバイダ ７ プリスケーラ ８ 基準信号発振器 ９、１０ 増幅器 １１、１３ 混合器 １２ 分周器 １４、１６ 増幅器 １５ 帯域フィルタ １７ 検波器 １８、１９ 増幅器 ２０ 分周比設定端子 ３１ 送受信共用器 ３２ 受信混合器 ３３ 帯域フィルタＢＰＦ ３４ 振幅制限増幅器（リミッタ） ３５ 周波数弁別器 ３６ 演算増幅器 ３７ 周波数逓倍増幅器 ３８ 受信局発混合器 ３９ 帯域フィルタ ４０ 位相振幅等価器 ４１ 水晶基準発振器 ４２ 分周器 ４３ 送信周波数増幅器 ４４ 位相比較器 ４５ 積分器 ４６ 電圧制御発振器 ４７ 可変分周器 ４８ 周波数変調器 ４９ 瞬時振幅制限器 1 bandpass filter BPF 2 amplifier 3 voltage control oscillator VCO 4 loop filter 5 phase comparator 6 programmable divider 7 prescaler 8 reference signal oscillator 9, 10 amplifier 11, 13 mixer 12 frequency divider 14, 16 amplifier 15 bandpass filter 17 detector 18, 19 Amplifier 20 Dividing ratio setting terminal 31 Transmission / reception duplexer 32 Reception mixer 33 Band filter BPF 34 Amplitude limiting amplifier (limiter) 35 Frequency discriminator 36 Operational amplifier 37 Frequency multiplication amplifier 38 Receiver station mixer 39 Band filter 40 Phase amplitude equalizer 41 Crystal reference oscillator 42 Frequency divider 43 Transmission frequency amplifier 44 Phase comparator 45 Integrator 46 Voltage controlled oscillator 47 Variable frequency divider 48 Frequency modulator 49 Instantaneous amplitude limiter
Claims (2)
振器を共有するパイロット信号の送受信装置において、
基準周波数の信号を出力する基準信号発振器と、前記基
準信号発振器からの基準信号出力を分周し設定周波数に
ロックして出力する電圧制御発振器を含むＰＬＬ回路
と、前記電圧制御発振器からの設定周波数の出力と前記
基準信号発振器からの基準信号出力との混合出力を受
け、パイロット信号を出力する帯域フィルタを有するこ
とを特徴とするパイロット信号の送受信装置。1. A transmitter / receiver for pilot signals that uses the same frequency for transmission and reception and shares a reference signal oscillator,
A reference signal oscillator that outputs a signal of a reference frequency, a PLL circuit that includes a voltage control oscillator that divides a reference signal output from the reference signal oscillator and locks and outputs the reference signal at a set frequency, and a set frequency from the voltage controlled oscillator And a reference signal output from the reference signal oscillator, and a pilot signal transmitting / receiving apparatus having a bandpass filter for outputting a pilot signal.
振器を共有するパイロット信号の送受信装置において、
基準周波数の信号を出力する基準信号発振器と、前記基
準信号発振器からの基準信号出力を分周し設定周波数に
ロックして出力する電圧制御発振器を含むＰＬＬ回路
と、前記電圧制御発振器からの設定周波数の出力と受信
信号とを混合する混合器を有し、中間周波数信号を出力
することを特徴とするパイロット信号の送受信装置。2. A transmitter / receiver for pilot signals that uses the same frequency for transmission and reception and shares a reference signal oscillator,
A reference signal oscillator that outputs a signal of a reference frequency, a PLL circuit that includes a voltage control oscillator that divides a reference signal output from the reference signal oscillator and locks and outputs the reference signal at a set frequency, and a set frequency from the voltage controlled oscillator A transmitter / receiver of a pilot signal, which has a mixer for mixing the output of the signal and the received signal and outputs an intermediate frequency signal.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11350396A JPH09298496A (en) | 1996-05-08 | 1996-05-08 | Transmitter-receiver for pilot signal |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11350396A JPH09298496A (en) | 1996-05-08 | 1996-05-08 | Transmitter-receiver for pilot signal |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH09298496A true JPH09298496A (en) | 1997-11-18 |
Family
ID=14613984
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11350396A Pending JPH09298496A (en) | 1996-05-08 | 1996-05-08 | Transmitter-receiver for pilot signal |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH09298496A (en) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| AU716451B2 (en) * | 1997-12-02 | 2000-02-24 | Samsung Electro-Mechanics Co., Ltd. | Wireless transceiver |
| JP2016009298A (en) * | 2014-06-24 | 2016-01-18 | 日本リライアンス株式会社 | Information processor |
-
1996
- 1996-05-08 JP JP11350396A patent/JPH09298496A/en active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| AU716451B2 (en) * | 1997-12-02 | 2000-02-24 | Samsung Electro-Mechanics Co., Ltd. | Wireless transceiver |
| JP2016009298A (en) * | 2014-06-24 | 2016-01-18 | 日本リライアンス株式会社 | Information processor |
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