JPH09103071A - 時分割並列運転式昇圧チョッパ−回路 - Google Patents
時分割並列運転式昇圧チョッパ−回路Info
- Publication number
- JPH09103071A JPH09103071A JP28648195A JP28648195A JPH09103071A JP H09103071 A JPH09103071 A JP H09103071A JP 28648195 A JP28648195 A JP 28648195A JP 28648195 A JP28648195 A JP 28648195A JP H09103071 A JPH09103071 A JP H09103071A
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- JP
- Japan
- Prior art keywords
- switching element
- output
- electrolytic capacitor
- time
- chopper circuit
- Prior art date
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- Pending
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- Control Of Voltage And Current In General (AREA)
- Dc-Dc Converters (AREA)
Abstract
(57)【要約】
【課題】 昇圧チョッパー回路の出力を拡大する時にス
イッチング素子に流れるピーク電流の最大値を抑制し
て、熱損失を抑制し、かつ入力電解コンデンサおよび出
力電解コンデンサのリプル電流の増加を抑制して、全体
として小形高出力化を図る。 【解決手段】 1つの入力電解コンデンサに2組のチョ
ークコイル、スイッチング素子、整流ダイオードのブロ
ックを接続し、出力側は1つの出力電解コンデンサとす
る。さらに、昇圧制御回路にフリップフロップ出力とな
る二信号出力をもつものを用い、二信号出力を2組のス
イッチング素子にそれぞれ接続して、一方のスイッチン
グ素子がONしているときに、他方のスイッチング素子
をOFFさせ、つぎに他方のスイッチング素子がONし
ているときに、一方のスイッチング素子をOFFさせる
サイクルを続けるように2組を並列運転する、時分割並
列運転式昇圧チョッパー回路。
イッチング素子に流れるピーク電流の最大値を抑制し
て、熱損失を抑制し、かつ入力電解コンデンサおよび出
力電解コンデンサのリプル電流の増加を抑制して、全体
として小形高出力化を図る。 【解決手段】 1つの入力電解コンデンサに2組のチョ
ークコイル、スイッチング素子、整流ダイオードのブロ
ックを接続し、出力側は1つの出力電解コンデンサとす
る。さらに、昇圧制御回路にフリップフロップ出力とな
る二信号出力をもつものを用い、二信号出力を2組のス
イッチング素子にそれぞれ接続して、一方のスイッチン
グ素子がONしているときに、他方のスイッチング素子
をOFFさせ、つぎに他方のスイッチング素子がONし
ているときに、一方のスイッチング素子をOFFさせる
サイクルを続けるように2組を並列運転する、時分割並
列運転式昇圧チョッパー回路。
Description
【0001】
【発明の属する技術分野】本発明は、昇圧チョッパー回
路を並列運転するときに、スイッチ素子のON時に流れ
る電流を時系列上で分割することで、単独運転において
出力を拡大する時にスイッチング素子に流れるピーク電
流の最大値を抑制することにより、熱損失を抑制し、か
つ入力電解コンデンサおよび出力電解コンデンサのリプ
ル電流の増加を抑制して、全体として小形高出力化を図
る昇圧チョッパー回路の改良に関するものである。
路を並列運転するときに、スイッチ素子のON時に流れ
る電流を時系列上で分割することで、単独運転において
出力を拡大する時にスイッチング素子に流れるピーク電
流の最大値を抑制することにより、熱損失を抑制し、か
つ入力電解コンデンサおよび出力電解コンデンサのリプ
ル電流の増加を抑制して、全体として小形高出力化を図
る昇圧チョッパー回路の改良に関するものである。
【0002】
【従来の技術】必要とする直流電圧をそれより低い直流
電圧から昇圧するため、昇圧チョッパー回路を単独運転
で使用している。図2は従来の昇圧チョッパー回路の一
例を示し、この回路の原理は、スイッチング素子14の
ON時間にチョークコイル12に磁気エネルギーを蓄積
し、次のOFF時間にこのエネルギーを放出して低めの
入力電圧から必要な出力電圧を取り出すことを利用した
ものであるが、同一の入力電圧から出力電圧を一定とし
て、取り出せる出力電圧を2倍にしたいときは、入出力
の電解コンデンサ1および9、チョークコイル12、ス
イッチング素子14、整流ダイオード13が2倍必要な
ため、電源の容積が大きくなってしまう欠点がある。図
において11は昇圧制御回路である。
電圧から昇圧するため、昇圧チョッパー回路を単独運転
で使用している。図2は従来の昇圧チョッパー回路の一
例を示し、この回路の原理は、スイッチング素子14の
ON時間にチョークコイル12に磁気エネルギーを蓄積
し、次のOFF時間にこのエネルギーを放出して低めの
入力電圧から必要な出力電圧を取り出すことを利用した
ものであるが、同一の入力電圧から出力電圧を一定とし
て、取り出せる出力電圧を2倍にしたいときは、入出力
の電解コンデンサ1および9、チョークコイル12、ス
イッチング素子14、整流ダイオード13が2倍必要な
ため、電源の容積が大きくなってしまう欠点がある。図
において11は昇圧制御回路である。
【0003】したがって、より小さい容積において、高
い出力電力を得るためには、入出力電解コンデンサのリ
プル電流を抑制し、スイッチング素子に流れるピーク電
流を抑制して放熱フィンの大きさをも抑制する必要があ
る。
い出力電力を得るためには、入出力電解コンデンサのリ
プル電流を抑制し、スイッチング素子に流れるピーク電
流を抑制して放熱フィンの大きさをも抑制する必要があ
る。
【0004】
【発明が解決しようとする課題】昇圧チョッパ回路の単
独運転において、入出力電解コンデンサのリプル電流
は、スイッチング素子のON時に流れるピーク電流に比
例し、かつON時間とOFF時間の比率に影響を受け
る。したがって、同一回路で出力を拡大すると、電解コ
ンデンサのリプル電流が増加して、寿命を短くする恐れ
があるため、静電容量や電圧を大きくしてリプル電流耐
量を大きくする必要がある。
独運転において、入出力電解コンデンサのリプル電流
は、スイッチング素子のON時に流れるピーク電流に比
例し、かつON時間とOFF時間の比率に影響を受け
る。したがって、同一回路で出力を拡大すると、電解コ
ンデンサのリプル電流が増加して、寿命を短くする恐れ
があるため、静電容量や電圧を大きくしてリプル電流耐
量を大きくする必要がある。
【0005】また、昇圧チョッパー回路の単独運転にお
いて、スイッチング素子のON時に流れるピーク電流は
入力電流に比例して流れており、出力電力を2倍にする
と、入力電流が2倍になったとすればピーク電流もまた
2倍に増えるため、スイッチンク素子の電力損失はI2
Rで4倍に増加する。したがって、出力電力を2倍にし
て、損失を増やさないためには素子の並列数を4倍にす
る必要がある。
いて、スイッチング素子のON時に流れるピーク電流は
入力電流に比例して流れており、出力電力を2倍にする
と、入力電流が2倍になったとすればピーク電流もまた
2倍に増えるため、スイッチンク素子の電力損失はI2
Rで4倍に増加する。したがって、出力電力を2倍にし
て、損失を増やさないためには素子の並列数を4倍にす
る必要がある。
【0006】
【課題を解決するための手段】1つの入力電解コンデン
サに2組のチョークコイル、スイッチング素子、整流ダ
イオードのブロックを接続し、出力側は1つの出力電解
コンデンサとする。つぎに、昇圧制御回路にフリップフ
ロップ出力となるQとQ′の二信号出力をもつものをス
イッチング素子にそれぞれ接続して、Q側のスイッチン
グ素子がONしているときに、Q′側のスイッチング素
子をOFFさせ、つぎにQ′側のスイッチング素子がO
Nしているときに、Q側のスイッチング素子をOFFさ
せるサイクルを続けることにより、スイッチング素子の
ピーク電流を増やすことなく出力電力を2倍に引き上げ
ることができ、入力電解コンデンサからの放電時間比率
が長くなるため、リプル電流を小さくすることができ
る。
サに2組のチョークコイル、スイッチング素子、整流ダ
イオードのブロックを接続し、出力側は1つの出力電解
コンデンサとする。つぎに、昇圧制御回路にフリップフ
ロップ出力となるQとQ′の二信号出力をもつものをス
イッチング素子にそれぞれ接続して、Q側のスイッチン
グ素子がONしているときに、Q′側のスイッチング素
子をOFFさせ、つぎにQ′側のスイッチング素子がO
Nしているときに、Q側のスイッチング素子をOFFさ
せるサイクルを続けることにより、スイッチング素子の
ピーク電流を増やすことなく出力電力を2倍に引き上げ
ることができ、入力電解コンデンサからの放電時間比率
が長くなるため、リプル電流を小さくすることができ
る。
【0007】
【発明の実施の形態】2組のチョークコイル、スイッチ
ング素子、整流ダイオード、および昇圧制御回路にフリ
ップフロップ出力となる二信号出力をもつものを用い、
二信号出力を2組のスイッチング素子にそれぞれ接続し
て、一方のスイッチング素子がONしているときに、他
方のスイッチング素子をOFFさせ、つぎに他方のスイ
ッチング素子がONしているときに、一方のスイッチン
グ素子をOFFさせるサイクルを続けるように2組を並
列運転することにより、スイッチング素子のピーク電流
を増やすことなく出力電力を2倍に引き上げることがで
き、リプル電流を小さくすることができる。
ング素子、整流ダイオード、および昇圧制御回路にフリ
ップフロップ出力となる二信号出力をもつものを用い、
二信号出力を2組のスイッチング素子にそれぞれ接続し
て、一方のスイッチング素子がONしているときに、他
方のスイッチング素子をOFFさせ、つぎに他方のスイ
ッチング素子がONしているときに、一方のスイッチン
グ素子をOFFさせるサイクルを続けるように2組を並
列運転することにより、スイッチング素子のピーク電流
を増やすことなく出力電力を2倍に引き上げることがで
き、リプル電流を小さくすることができる。
【0008】
【実施例】図1は本発明昇圧チョッパー回路の一実施例
を示す図であり、1は入力側に並列接続された入力電解
コンデンサ、2はQおよびQ′の二出力を有する昇圧制
御回路である。3はQ側チョークコイル、4はQ′側チ
ョークコイル、5はQ側スイッチング素子、6はQ′側
スイッチング素子、7はQ側整流ダイオード、8はQ′
側整流ダイオードであり、3と4、5と6、7と8は、
同等の電気定格および電気性能を持ったものを組み合わ
せて、ピーク電流値のバランスを取っている。
を示す図であり、1は入力側に並列接続された入力電解
コンデンサ、2はQおよびQ′の二出力を有する昇圧制
御回路である。3はQ側チョークコイル、4はQ′側チ
ョークコイル、5はQ側スイッチング素子、6はQ′側
スイッチング素子、7はQ側整流ダイオード、8はQ′
側整流ダイオードであり、3と4、5と6、7と8は、
同等の電気定格および電気性能を持ったものを組み合わ
せて、ピーク電流値のバランスを取っている。
【0009】9は出力側に並列接続された出力電解コン
デンサ、10は出力電圧分圧抵抗器であり、ここで得ら
れた電圧を昇圧制御回路2にフィードバックして得られ
た入力電圧から必要とする出力電圧が得られるように抵
抗器10の値を設定する。
デンサ、10は出力電圧分圧抵抗器であり、ここで得ら
れた電圧を昇圧制御回路2にフィードバックして得られ
た入力電圧から必要とする出力電圧が得られるように抵
抗器10の値を設定する。
【0010】Qの信号出力とQ′の信号出力はフリップ
フロップ動作を行ない、時系列上重なり合わないように
2組の昇圧チョッパー回路が並列運転される。
フロップ動作を行ない、時系列上重なり合わないように
2組の昇圧チョッパー回路が並列運転される。
【0011】
【発明の効果】以上述べたように、本発明によれば、昇
圧チョッパー回路を並列運転するときに、スイッチ素子
のON時に流れる電流を時系列上で分割することで、ス
イッチング素子に流れるピーク電流の最大値を抑制し
て、熱損失を抑制し、かつ入力電解コンデンサおよび出
力電解コンデンサのリプル電流の増加を抑制して、全体
として小形高出力化を図ることができる。
圧チョッパー回路を並列運転するときに、スイッチ素子
のON時に流れる電流を時系列上で分割することで、ス
イッチング素子に流れるピーク電流の最大値を抑制し
て、熱損失を抑制し、かつ入力電解コンデンサおよび出
力電解コンデンサのリプル電流の増加を抑制して、全体
として小形高出力化を図ることができる。
【図1】本発明時分割並列運転式昇圧チョッパー回路の
一実施例を示す図。
一実施例を示す図。
【図2】従来の昇圧チョッパー回路の一例を示す図。
1 入力電解コンデンサ 2 昇圧制御回路 3 Q側チョークコイル 4 Q′側チョークコイル 5 Q側スイッチング素子 6 Q′側スイッチング素子 7 Q側整流ダイオード 8 Q′側整流ダイオード 9 出力電解コンデンサ 10 出力電圧分圧抵抗器
Claims (1)
- 【請求項1】 入力電解コンデンサと、QおよびQ′の
二出力を有する昇圧制御回路と、Q側チョークコイル
と、Q′側チョークコイルと、Q側スイッチング素子
と、Q′側スイッチング素子と、Q側整流ダイオード
と、Q′側整流ダイオードと、出力電解コンデンサと、
出力電圧分圧抵抗器とからなり、Qの信号出力とQ′の
信号出力はフリップフロップ動作を行ない、時系列上重
なり合わないことを特徴とする、時分割並列運転式昇圧
チョッパー回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP28648195A JPH09103071A (ja) | 1995-10-06 | 1995-10-06 | 時分割並列運転式昇圧チョッパ−回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP28648195A JPH09103071A (ja) | 1995-10-06 | 1995-10-06 | 時分割並列運転式昇圧チョッパ−回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH09103071A true JPH09103071A (ja) | 1997-04-15 |
Family
ID=17704960
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP28648195A Pending JPH09103071A (ja) | 1995-10-06 | 1995-10-06 | 時分割並列運転式昇圧チョッパ−回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH09103071A (ja) |
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100560338B1 (ko) * | 2004-07-09 | 2006-03-14 | 한국전기연구원 | 승압 회로 |
JP2007228781A (ja) * | 2006-02-20 | 2007-09-06 | Katsunori Taniguchi | ソフトスイッチング高昇圧コンバータ |
JPWO2007069371A1 (ja) * | 2005-12-12 | 2009-05-21 | 三菱電機株式会社 | 発光ダイオード点灯装置およびこの装置を使用した車両用灯具点灯装置 |
KR100916902B1 (ko) * | 2007-11-12 | 2009-09-09 | 주식회사 효성 | 무변압기형 부스터 컨버터 |
JP2011233255A (ja) * | 2010-04-23 | 2011-11-17 | On Semiconductor Trading Ltd | 発光素子の制御回路 |
-
1995
- 1995-10-06 JP JP28648195A patent/JPH09103071A/ja active Pending
Cited By (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100560338B1 (ko) * | 2004-07-09 | 2006-03-14 | 한국전기연구원 | 승압 회로 |
JPWO2007069371A1 (ja) * | 2005-12-12 | 2009-05-21 | 三菱電機株式会社 | 発光ダイオード点灯装置およびこの装置を使用した車両用灯具点灯装置 |
JP4675971B2 (ja) * | 2005-12-12 | 2011-04-27 | 三菱電機株式会社 | 車両灯具用発光ダイオード点灯装置 |
JP2007228781A (ja) * | 2006-02-20 | 2007-09-06 | Katsunori Taniguchi | ソフトスイッチング高昇圧コンバータ |
KR100916902B1 (ko) * | 2007-11-12 | 2009-09-09 | 주식회사 효성 | 무변압기형 부스터 컨버터 |
JP2011233255A (ja) * | 2010-04-23 | 2011-11-17 | On Semiconductor Trading Ltd | 発光素子の制御回路 |
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