JPH08508626A - 音声再生装置用の適応型ゲイン及びフィルタリング回路 - Google Patents
音声再生装置用の適応型ゲイン及びフィルタリング回路Info
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Abstract
Description
Claims (1)
- 【特許請求の範囲】 1. 音に応答して入力信号を作り出すためのマイクロホンと、 共通出力部に接続された複数のチャネルとを備え、 各チャネルが、 上記入力信号を受け、フィルタにかけられた信号を作り出すためのプ リセットパラメータを有するフィルタと、 チャネル出力信号を作り出すためのフィルタにかけられた信号に応答 するチャネル増幅器と、 上記チャネル出力信号に対するチャネル敷居レベルを作り出すための 手段と、 上記チャネル出力信号と上記チャネル敷居レベルに応答し、上記チャ ネル出力信号が上記チャネル敷居レベル以下に降下した場合には、予め決めた限 界まで上記チャネル増幅器のゲイン設定を増大させ、上記チャネル出力信号が上 記チャネル敷居レベル以上に上昇した場合には、上記チャネル増幅器のゲイン設 定を減少させるための手段であって、上記チャネル出力信号が、適応的に圧縮さ れ、フィルタにかけられた出力信号を作り出すために組み合わされる手段と、 上記適応的に圧縮され、フィルタにかけられた出力信号の関数として 音を作り出す変換器と からなる補聴器。 2. 上記チャネルの各々における上記増大させ、減少させる手段が、値dp を有する増分で上記チャネル増幅器のゲイン設定を増大させ、値dmを有する減分 で上記チャネル増幅器のゲイン設定を減少させるための手段を備えた請求項1に 記載の回路。 3. 上記チャネルの各々における上記増大させ、減少させる手段が、さら に、 上記チャネル敷居レベルより大きいか、或いは小さい上記チャネル出 力信号のレベルの関数として制御信号を作り出すための比較器と、 ゲイン設定を記憶するためのゲインレジスタと、 上記チャネル出力信号が、上記チャネル敷居レベル以下に降下した場 合には、dpだけゲインレジスタにおいて上記ゲイン設定を増大させ、上記チャネ ル出力信号が上記チャネル敷居レベル以上に上昇した場合には、dmに対応した負 の値だけ上記ゲインレジスタにおいて上記ゲイン設定を減少させるために上記制 御信号に応答する加算器とを備え、 上記チャネル増幅器が、記憶されたゲイン設定の関数として上記チャ ネル増幅器のゲインを設定するために上記ゲインレジスタに応答する請求項2に 記載の回路。 4. 上記チャネル増幅器が、2段増幅器を備え、その第1段は可変ゲイン を有し、その第2段は予め定めたゲインを有する請求項1に記載の回路。 5. 上記チャネルの上記フィルタが、聞き取れる周波数レンジの実質的に すべてにわたって選択的に入力信号を変更するためのプリセットフィルタパラメ ータを有する請求項1に記載の回路。 6. 上記チャネルの各フィルタが、聞き取れる周波数の予め定められたレ ンジにわたって上記入力信号を選択的に通過させるためのプリセットフィルタパ ラメータを有し、各フィルタが、予め定められた上記レンジに生じていない入力 信号のいくらかを実質的に減衰させる請求項1に記載の回路。 7. さらに、第2チャネル出力信号を作り出すためにフィルタにかけられ た信号に応答する第2チャネル増幅器と、 上記第1チャネル増幅器のゲイン設定の関数として上記第2チャネル 増幅器のゲイン設定をプログラムするための手段とを備え、 上記第2チャネル出力信号が、プログラム可能に圧縮され、フィルタ にかけられた出力信号を作り出すために組み合わされ、上記変換器が、プログラ ム可能に圧縮され、フィルタにかけられた出力信号の関数として音を作り出す請 求項1に記載の回路。 8. 上記プログラムする手段が、上記第1チャネル増幅器の上記ゲイン設 定のパワーの関数として上記第2チャネル増幅器のゲイン設定を変更するための 手段を備えた請求項7に記載の回路。 9. 上記チャネルのフィルタが、聞き取れる上記周波数レンジの実質的に すべてにわたって上記入力信号を選択的に変更するためのプリセットフィルタパ ラメータを有する請求項7に記載の回路。 10. 上記チャネルの各フィルタが、聞き取れる周波数の予め定められたレ ンジにわたって入力信号を選択的に通過させるためのプリセットフィルタパラメ ータを有し、各フィルタが、予め定められた上記レンジに生じていない上記入力 信号のいくらかを実質的に減衰させる請求項7に記載の回路。 11. 音に応答して入力信号を作り出すためのマイクロホンと、 出力信号を作り出すために上記入力信号を受ける増幅器と、 上記出力信号に対する敷居レベルを確立するための手段と、 上記出力信号および上記敷居レベルに応答し、上記出力信号が上記敷 居レベル以下に降下する場合には値dpを有する増分で予め定められた限界まで上 記増幅器の上記ゲイン設定増大させ、上記出力信号が敷居レベル以上に上昇した 場合には、値dmを有する減分で上記増幅器のゲイン設定を減少させるための手段 と、 上記出力信号の関数として音を作り出す変換器と からなる補聴器。 12. 上記増大させ、減少させる手段が、さらに、 上記敷居レベルより大きいか、或いは小さい上記出力信号のレベルの 関数として制御信号を作り出すための比較器と、 ゲイン設定を記憶するためのゲインレジスタと、 上記出力信号が、上記敷居レベル以下に降下した場合には、dpだけゲ インレジスタにおいて上記ゲイン設定を増大させ、上記出力信号が、上記敷居レ ベル以上に上昇した場合には、dmに対応した負の値だけ上記ゲインレジスタにお いて上記ゲイン設定を減少させるために上記制御信号に応答する加算器とを備え 、 上記増幅器が、記憶されたゲイン設定の関数として上記増幅器のゲイ ンを設定するために上記ゲインレジスタに応答する請求項11に記載の回路。 13. 上記増幅器が、2段増幅器を備え、その第1段は、可変ゲインを有し 、 その第2段は、予め定められたゲインを有する請求項11に記載の回路。 14. さらに、第2出力信号を作り出すために上記入力信号に応答する第2 増幅器と、 上記第1増幅器のゲイン設定の関数として上記第2増幅器のゲイン設 定をプログラムするための手段とを備え、 上記変換器が、上記第2出力信号の関数として音を作り出す請求項1 1に記載の回路。 15. 上記プログラムする手段が、上記第1増幅器の上記ゲイン設定のパワ ーの関数として上記第2増幅器のゲインを変えるための手段を備えた請求項14 に記載の回路。 16. 共通出力部に接続された複数のチャネルを備え、 各チャネルが、 フィルタにかけられた信号を作り出すために聞き取れる周波数レンジ の入力信号を受けるためのプリセットパラメータを有するフィルタと、 チャネル出力信号を作り出すためのフィルタにかけられた上記信号に 応答するチャネル増幅器と、 上記チャネル出力信号に対するチャネル敷居レベルを確立するための 手段と、 上記チャネル出力信号および上記チャネル敷居レベルに応答し、上記 チャネル出力信号が、上記チャネル敷居レベル以下に降下した場合には、予め定 められた限界まで上記チャネル増幅器のゲインを増大させ、上記チャネル出力信 号が、上記チャネル敷居レベル以上に上昇した場合には、上記チャネル増幅器の ゲインを減少させるための手段とを備え、 上記チャネル出力信号が、適応的に圧縮され、フィルタにかけられた 出力信号を作り出すために組み合わされた適応形圧縮、フィルタ回路。 17. 上記チャネルの各々における上記増大させ、減少させる手段が、値dp を有する増分で上記チャネル増幅器のゲインを増大させ、値dmを有する減分で上 記チャネル増幅器のゲインを減少させるための手段を備えた請求項16に記載の 回路。 18. 上記チャネルの各々における上記増大させ、減少させる手段が、さら に、 上記チャネル敷居レベルより大きいか、或いは小さい上記チャネル出 力信号のレベルの関数として制御信号を作り出すための比較器と、 ゲイン設定を記憶するためのゲインレジスタと、 上記チャネル出力信号が、上記チャネル敷居レベル以下に降下した場 合には、dpだけゲインレジスタにおいて上記ゲイン設定を増大させ、上記チャネ ル出力信号が、上記チャネル敷居レベル以上に上昇した場合には、dmに対応した 負の値だけ上記ゲインレジスタにおいて上記ゲイン設定を減少させるために上記 制御信号に応答する加算器とを備え、 上記チャネル増幅器が、記憶されたゲイン設定の関数として上記チャ ネル増幅器のゲインを設定するために上記ゲインレジスタに応答する請求項17 に記載の回路。 19. 各チャネルにおける増大させ、減少させる上記手段が、さらに、 dpおよびdmの値を記憶するための第2のレジスタを備え、上記加算器 がdpおよびdmの記憶された値を受け、上記ゲインレジスタ内に記憶されたゲイン 設定を増大させ、減少させるために上記レジスタに応答する請求項18に記載の 回路。 20. 上記チャネル増幅器が、2段増幅器を備え、その第1段は可変ゲイン を有し、その第2段は予め定めたゲインを有する請求項16に記載の回路。 21. タイミングシーケンスを作り出すための手段を備え、各チャネルにお ける増大させ、減少させる上記手段が、上記タイミングシーケンスの予め定めら れた部分の間、チャネル増幅器のゲインを増大させ、減少させるために上記タイ ミングシーケンスに応答可能である請求項16に記載の回路。 22. 各チャネルが、さらに、適応的にクリップし、圧縮したチャネル出力 信号を作り出すために予め定められたレベルでチャネル出力信号をクリップする 手段を備えた請求項16に記載の回路。 23. 上記チャネルの上記フィルタが、聞き取れる周波数レンジの実質的に すべてにわたって上記入力信号を選択的に変更するためのプリセットフィルタパ ラメータを有する請求項16に記載の回路。 24. 上記チャネルの各フィルタが、聞き取れる周波数の予め定められたレ ンジにわたって上記入力信号を選択的に通過させるためのプリセットフィルタパ ラメータを有し、各フィルタが、上記予め定められたレンジ内に生じない上記入 力信号のいずれかを実質的に減衰させる請求項16に記載の回路。 25. 上記チャネルの各々における上記フィルタが、有限インパルス応答フ ィルタからなる請求項16に記載の回路。 26. 各チャネルが、さらに、 第2チャネル出力信号を作り出すためのフィルタにかけられた信号に 応答する第2チャネル増幅器と、 上記第1チャネル増幅器のゲインの関数として上記第2チャネル増幅 器のゲイン設定をプログラムするための手段とを備え、 上記第2チャネル出力信号が、プログラム可能に圧縮され、フィルタ にかけられた出力信号を作り出すために組み合わせられる請求項16に記載の回 路。 27. 上記プログラムする手段が、上記第1チャネル増幅器のゲイン設定の パワーの関数として上記第2チャネル増幅器のゲインを変更するための手段を備 えた請求項26に記載の回路。 28. 上記プログラムする手段が、さらに、パワー値を記憶するためのレジ スタを備え、このプログラムする手段が、上記第1チャネル増幅器の上記ゲイン 設定を上記記憶されたパワー値のパワーに上げることにより得られる上記値の関 数として上記第2チャネル増幅器のゲインを変更する請求項27に記載の回路。 29. 上記第1、第2チャネル増幅器の各々が、2段増幅器からなり、その 第1段は可変ゲインを有し、その第2段はプリセットゲインを有する請求項26 に記載の回路。 30. 聞き取れる周波数レンジにおける入力信号を受け、出力信号を作り出 すための増幅器と、 上記出力信号に対する敷居レベルを確立するための手段と、 上記出力信号および上記敷居レベルに応答し、上記出力信号が、上記 敷居レベル以下に降下した場合には、値dpを有する増分で予め定められた限界ま で上記増幅器のゲインを増大させ、上記出力信号が、上記敷居レベル以上に上昇 した場合には、値dmを有する減分で上記増幅器のゲインを減少させる手段とを備 え、 これにより上記出力信号が、適応的に圧縮された出力信号を作り出す ためにdm対dpの比の関数として圧縮される適応型ゲイン増幅回路。 31. 増大させ、減少させる上記手段が、 上記敷居レベルより大きいか、或いは小さい上記出力信号のレベルの 関数として制御信号を作り出すための比較器と、 ゲイン設定を記憶するためのゲインレジスタと、 上記出力信号が上記敷居レベル以下に降下した場合には、dpだけゲイ ンレジスタにおいて上記ゲイン設定を増大させ、上記出力信号が上記敷居レベル 以上に上昇した場合には、dmに対応した負の値だけ上記ゲインレジスタにおいて 上記ゲイン設定を減少させるために上記制御信号に応答する加算器とを備え、 上記増幅器が、記憶されたゲイン設定の関数として上記増幅器のゲイ ンを設定するために上記ゲインレジスタに応答する請求項30に記載の回路。 32. 増大させ、減少させる上記手段が、さらに、 タイミングシーケンスを作り出すための手段を備え、この増大させ、減少させる 手段が、タイミングシーケンスの予め定められた部分の間、上記ゲインレジスタ に記憶されたゲイン設定を増大させ、減少させるために上記タイミングシーケン スに応答可能である請求項31に記載の回路。 33. 増大させ、減少させる上記手段が、さらに、 dpおよびdmの値を記憶するための第2のレジスタを備え、上記加算器 が、上記ゲインレジスタ内に記憶されたゲイン設定を増大させ、減少させるため の記憶されたdpおよびdmの値を受けるために上記レジスタに応答する請求項31 に記載の回路。 34. 上記増幅器が、2段増幅器からなり、その第1段は、可変ゲインを有 し、その第2段は、予め定められたゲインを有する請求項31に記載の回路。 35. 上記増幅器が、2段増幅器からなり、その第1段は、可変ゲインを有 し、その第2段は、予め定められたゲインを有する請求項30に記載の回路。 36. さらに、適応的に圧縮された上記出力信号を予め定められたレベルで クリップし、適応的にクリップされ、圧縮された出力信号を作り出すための手段 を備えた請求項30に記載の回路。 37. 聞き取れる周波数レンジにおける入力信号を受け、増幅された信号を 作り出すための第1増幅器と、 上記増幅された信号に対する敷居レベルを確立するための手段と、 上記増幅された信号および上記敷居レベルに応答し、上記増幅された 信号が、上記敷居レベル以下に降下した場合には、上記第1増幅器のゲイン設定 を予め定められた限界まで増大させ、上記増幅された信号が上記敷居レベル以上 に上昇した場合には、上記第1増幅器のゲイン設定を減少させ、これによって上 記増幅された信号を圧縮する手段と、 上記入力信号を受け、出力信号を作り出す第2増幅器と、 上記第1増幅器のゲイン設定の関数として上記第2増幅器のゲイン設 定をプログラムする手段とを備え、 上記出力信号が、プログラム可能に圧縮されるプログラマブル圧縮性 ゲイン増幅回路。 38. 増大させ、減少させる上記手段が、値dpを有する増分で上記第1増幅 器のゲインを増大させ、値dmを有する減分で上記第1増幅器のゲインを減少させ る手段を備えた請求項37に記載の回路。 39. 増大させ、減少させる上記手段が、さらに、 上記敷居レベルより大きいか、或いは小さい上記増幅された信号のレ ベルの関数として制御信号を作り出すための比較器と、 ゲイン設定を記憶するためのゲインレジスタと、 上記増幅された信号が、上記敷居レベル以下に降下した場合には、dp だけゲインレジスタにおいて上記ゲイン設定を増大させ、上記増幅された信号が 、上記敷居レベル以上に増大した場合には、、dmに対応した負の値だけ上記ゲイ ンレジスタにおいて上記ゲイン設定を減少させるために上記制御信号に応答する 加算器とを備え、 上記第1増幅器が、記憶されたゲイン設定の関数として上記第1増幅 器のゲインを設定するために上記ゲインレジスタに応答する請求項38に記載の 回路。 40. 増大させ、減少させる上記手段が、さらに、 タイミングシーケンスを作り出すための手段を備え、この増大させ、減少させる 手段が、タイミングシーケンスの予め定められた部分の間、上記ゲインレジスタ に記憶されたゲイン設定を増大させ、減少させるために上記タイミングシーケン スに応答可能である請求項39に記載の回路。 41. 増大させ、減少させる上記手段が、さらに、 dpおよびdmの値を記憶するための第2のレジスタを備え、上記加算器 が、上記ゲインレジスタ内に記憶されたゲイン設定を増大させ、減少させるため の記憶されたdpおよびdmの値を受けるために上記レジスタに応答する請求項39 に記載の回路。 42. 上記プログラムする手段が、上記第1増幅器のゲイン設定のパワーの 関数として上記第2増幅器のゲインを変更するための手段を備えた請求項37に 記載の回路。 43. 上記プログラムする手段が、さらに、パワー値を記憶するためのレジ スタを備え、このプログラムする手段が、上記第1増幅器の上記ゲイン設定を上 記記憶されたパワー値のパワーに上げることにより得られる上記値の関数として 上記第2増幅器のゲインを変更する請求項42に記載の回路。 44. 上記第1、第2増幅器の各々が、2段増幅器からなり、その第1段は 可変ゲインを有し、その第2段はプリセットゲインを有する請求項37に記載の 回路。 45. さらに、適応的に圧縮された上記出力信号を予め定められたレベルで クリップし、適応的にクリップされ、圧縮された出力信号を作り出すための手段 を備えた請求項37に記載の回路。 46. 音に応答して入力信号を作り出すためのマイクロホンと、 上記入力信号を受け、適応的にフィルタにかけられた信号を作り出す ために可変パラメータを有するフィルタと、 適応的にフィルタにかけられた信号を受け、適応的にフィルタにかけ られた出力信号を作り出すための増幅器と、 上記入力信号の特性を検出するための手段と、 上記検出手段に応答し、検出された上記特性の関数として上記可変フ ィルタのパラメータを変更し、上記増幅器のゲインを変更するための手段と、 適応的にフィルタにかけられた上記出力信号の関数として音を作り出 す変換器と を備えた補聴器。 47. 上記変更する手段が、特性値、関係するフィルタパラメータおよび関 係する増幅器ゲイン値のテーブルを記憶するメモリを備え、 上記メモリが、上記検出された特性の関数としてフィルタパラメータ および増幅器ゲイン値を読み出すために上記検出手段に応答し、上記可変フィル タが、上記読み出されたフィルタパラメータの関数として上記可変フィルタのパ ラメータを設定するために上記メモリに応答し、上記増幅器が、上記読み出され たゲイン値の関数として上記増幅器のゲインを設定するために上記メモリに応答 する請求項46に記載の回路。 48. 音に応答して入力信号を作り出すためのマイクロホンと、 共通出力部に接続された複数のチャネルであって、その各々が、上記 入力信号を受け、フィルタにかけられた信号を作り出すためのプリセットパラメ ータを有するフィルタ、およびチャネル出力信号を作り出すために上記フィルタ にかけられた信号に応答する増幅器を備えたチャネルと、 特有の信号を作り出すために上記入力信号に応答するプリセットパラ メータを有する第2フィルタと、 制御信号を作り出すために上記特有の信号に応答する検出器であって 、その時定数をプログラムするための手段を含む検出器と、 上記制御信号を表す対数値を作り出すために上記検出器に応答する手 段と、 対数値とゲイン値の予め選ばれたテーブルを記憶するためのメモリで あって、作り出された対数値の関数として上記チャネル内の増幅器の各々に対す るゲイン値を選択するために対数値発生手段に応答し、上記チャネル内の増幅器 の各々が、それぞれの選択されたゲイン値の関数としてそれぞれの増幅器のゲイ ンを個別に変更させるために上記メモリに応答するこのメモリと、 上記組み合わされたチャネル出力信号の関数として音を作り出す変換 器と からなる補聴器。 49. 共通出力部に接続された複数のチャネルであって、各チャネルが、聞 き取れる周波数レンジ内の入力信号を受け、フィルタにかけられた信号を作り出 すためのプリセットパラメータを有するフィルタと、出力信号を作り出すために 上記フィルタにかけられた信号に応答するチャネル増幅器とを備えたチャネルと 、 各チャネルにおける上記出力信号の特性を検出するための手段と、 上記検出手段に応答し、上記検出された特性の関数として上記出力信 号を圧縮するために上記チャネルの各々における増幅器のゲインを個別に変更す るための手段とを備え、 上記チャネルにおける上記出力信号が、適応的に圧縮され、フィルタ にかけられた出力信号を作り出すために組み合わせられる適応形圧縮、フィルタ 回路。 50. 上記チャネル増幅器の各々が、2段増幅器を備え、その第1段が、そ れぞれのチャネルに対して作用するレンジを規定するための予め定められたゲイ ンを有し、第2段が、上記可変手段に応答する可変ゲインを有する請求項49に 記載の回路。 51. 上記可変手段が、さらに、 上記入力信号のレベルの関数として最初から最後まで上記チャネルの 各々における上記ゲイン設定を順次修正するための手段を備えた請求項49に記 載の回路。 52. 上記チャネルにおける上記フィルタが、聞き取れる周波数レンジの実 質的にすべてにわたって上記入力信号を選択的に変更するためのプリセットフィ ルタパラメータを有する請求項49に記載の回路。 53. 上記チャネルの各フィルタが、聞き取れる周波数の予め定められたレ ンジにわたって上記入力信号を選択的に通過させるためのプリセットフィルタパ ラメータをを有し、各フィルタが、上記予め定めたレンジ内に生じない上記入力 信号のいずれかを実質的に減衰させる請求項49に記載の回路。 54. 上記チャネルの各々における上記フィルタが、有限インパルス応答フ ィルタからなる請求項49に記載の回路。 55. 上記検出手段が、さらに、 各チャネルにおいて上記出力信号に対するチャネル敷居レベルを確立 するための手段を備え、 さらに上記手段が、それぞれの上記チャネルの上記出力信号が、上記 チャネル敷居レベル以下に降下した場合には、各増幅器の上記ゲインを予め定め られた限界まで増大させ、上記出力信号が、上記チャネル敷居レベル以上に上昇 した場合には、上記増幅器のゲインを減少させるための手段を備えた請求項49 に記載の回路。 56. 増大させ、減少させる上記手段が、値dpを有する増分で上記第1増幅 器のゲインを増大させ、値dmを有する減分で上記第1増幅器のゲインを減少させ る手段を備えた請求項55に記載の回路。 57. 増大させ、減少させる上記手段が、さらに、 上記チャネル敷居レベルより大きいか、或いは小さい上記チャネルに おける上記出力信号のレベルの関数として制御信号を作り出すための比較器と、 各増幅器に対するゲイン設定を記憶するためのゲインレジスタと、 それぞれの上記チャネルにおける上記出力信号が、上記チャネル敷居 レベル以下に降下した場合には、dpだけ増幅器に対する上記ゲイン設定を増大さ せ、上記チャネルにおける上記出力信号が、上記チャネル敷居レベル以上に上昇 した場合には、dmに対応した負の値だけ上記増幅器に対する上記ゲイン設定を減 少させるために上記制御信号に応答する加算器とを備え、 上記増幅器が、記憶された上記ゲイン設定の関数として上記増幅器の ゲインを設定するために上記ゲインレジスタに応答する請求項56に記載の回路 。 58. 増大させ、減少させる上記手段が、さらに、 dpおよびdmの値を記憶するための第2のレジスタを備え、上記加算器 が、上記ゲインレジスタ内に記憶されたゲイン設定を増大させ、減少させるため の記憶されたdpおよびdmの値を受けるために上記第2のレジスタに応答する請求 項57に記載の回路。 59. さらに、タイミングシーケンスを作り出すための手段を備え、上記変 更させる手段が、タイミングシーケンスの予め定められた部分の間、上記増幅器 のゲインを変更させるために上記タイミングシーケンスに応答可能である請求項 49に記載の回路。 60. 各チャネルが、さらに、適応的にクリップされ、圧縮された出力信号 を作り出すために、予め定められたレベルで各チャネルにおける上記出力信号を クリップする手段を備えた請求項49に記載の回路。 61. 共通出力部に接続された複数のチャネルであって、その各々が、フィ ルタにかけられた信号を作り出すために聞き取れる周波数レンジ内の入力信号を 受けるためのプリセットパラメータを有するフィルタと、チャネル出力信号を作 り出すために上記フィルタにかけられた信号に応答する増幅器とを備えたチャネ ルと、 特有の信号を作り出すために上記入力信号に応答するプリセットパラ メータを有する第2フィルタと、 制御信号を作り出すために上記特有の信号に応答する検出器であって 、その時定数をプログラムするための手段を含む検出器と、 上記制御信号を表す対数値を作り出すために上記検出器に応答する手 段と、 対数値とゲイン値の予め選ばれたテーブルを記憶するためのメモリで あって、作り出された対数値の関数として上記チャネル内の増幅器の各々に対す るゲイン値を選択するために対数値発生手段に応答し、上記チャネル内の増幅器 の各々が、それぞれの選択されたゲイン値の関数としてそれぞれの増幅器のゲイ ンを個別に変更させるために上記メモリに応答し、それにより上記チャネル出力 信号が、適応的にフィルタにかけられた出力信号を作り出すために組み合わせら れる上記メモリと を備えた適応形フィルタ回路。 62. 上記チャネルにおけるフィルタが、聞き取れる周波数レンジの実質的 にすべてにわたって入力信号を選択的に変更するためにプリセットフィルタパラ メータを有する請求項61に記載の回路。 63. 上記チャネルにおける各フィルタが、聞き取れる周波数の予め定めら れたレンジにわたって上記入力信号を選択的に通過させるためにプリセットフィ ルタパラメータを有し、各フィルタが、上記予め定められたレンジに生じない入 力信号のいずれかを実質的に減衰させる請求項61に記載の回路。 64. 上記チャネルの各々における上記フィルタが、有限インパルス応答フ ィルタを備え、上記検出手段における上記フィルタが、有限インパルス応答フィ ルタを備えた請求項61に記載の回路。 65. 上記第2フィルタが、上記チャネルの内の一つにおける上記フィルタ の内の一つにより構成された請求項61に記載の回路。 66. 聞き取れる周波数レンジ内の入力信号を受け、適応的にフィルタにか けられた信号を作り出すための可変パラメータを有するフィルタと、 適応的にフィルタにかけられた信号を受け、適応的にフィルタにかけ られた出力信号を作り出すための増幅器と、入力信号の特性を検出するための手 段と、 上記検出手段に応答し、検出された特性の関数として上記フィルタの 可変パラメータを変更し、上記増幅器のゲインを変更するための手段と を備えた適応形フィルタ回路。 67. 上記検出手段が、特性を有する信号を作り出すための上記入力信号に 応答するフィルタと、 制御信号を作り出すための上記特性を有する信号に応答する検出器と を備え、 この検出器が、検出器の時定数をプログラムするための手段を含み、 上記可変手段が、上記制御信号の関数として上記可変フィルタのパラメータを変 更し、上記増幅器のゲインを変更するための手段を備えた請求項66に記載の回 路。 68. 上記変更手段が、上記制御信号を表す対数値を作り出すために上記検 出器に応答する手段と、 対数値と関係するフィルタパラメータとゲイン値の予め選ばれたテー ブルを記憶するためのメモリとを備え、 このメモリが、作り出された上記対数値の関数としてフィルタパラメ ータとゲイン値を選ぶために対数値発生手段に応答し、上記可変フィルタが、選 ばれた上記フィルタパラメータの関数として上記可変フィルタのパラメータを設 定するために上記メモリに応答し、上記増幅器が、選ばれた上記ゲイン値の関数 として上記増幅器のゲインを設定するために上記メモリに応答する請求項67に 記載の回路。 69. 上記可変手段が、特性値、関係するフィルタパラメータおよび関係す る増幅器のゲイン値のテーブルを記憶するためのメモリを備え、このメモリが、 検出された上記特性の関数としてフィルタパラメータおよび増幅器のゲイン値を 読み出し、上記増幅器が、上記読み出したゲイン値の関数として上記増幅器のゲ インを設定するために上記メモリに応答する請求項66に記載の回路。 70. さらに、適応的にフィルタにかけられた上記出力信号を受け、制限さ れた出力信号を作り出すためのリミッタと、 制限された上記出力信号を受け、フィルタにかけられた上記出力信号 を作り出すための可変パラメータを有する第2フィルタとを備え、 この第2可変フィルタのパラメータが、上記第1可変フィルタのパラ メータの関数として変わる請求項66に記載の回路。 71. 上記可変手段が、特性値、関係するフィルタパラメータおよび関係す る増幅器ゲイン値のテーブルを記憶するためのメモリを備え、 このメモリが、検出された上記特性の関数としてフィルタパラメータ および増幅器ゲイン値を読み出すために上記検出手段に応答し、上記第1、第2 可変フィルタ読み出された上記フィルタパラメータの関数として上記フィルタの パラメータを設定するために上記メモリに応答し、上記増幅器が、読み出された 上記ゲイン値の関数として上記増幅器のゲインを設定するために上記メモリに応 答する請求項70に記載の回路。
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