JPH0816480A - メモリーカード - Google Patents
メモリーカードInfo
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- JPH0816480A JPH0816480A JP6144833A JP14483394A JPH0816480A JP H0816480 A JPH0816480 A JP H0816480A JP 6144833 A JP6144833 A JP 6144833A JP 14483394 A JP14483394 A JP 14483394A JP H0816480 A JPH0816480 A JP H0816480A
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- analog switch
- memory card
- diode
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- input terminal
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- WHXSMMKQMYFTQS-UHFFFAOYSA-N Lithium Chemical compound [Li] WHXSMMKQMYFTQS-UHFFFAOYSA-N 0.000 description 9
- 229910052744 lithium Inorganic materials 0.000 description 9
- 238000010586 diagram Methods 0.000 description 3
- 230000000717 retained effect Effects 0.000 description 3
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Abstract
(57)【要約】
【目的】 データの記録、保持を行うメモリーカードに
おいて、一定時間後に、そのメモリーカードに保持され
ていたデータが消えるメモリーカードを提供することを
目的とする。 【構成】 第１のダイオード１２のカソード側とＳＲＡ
Ｍ１４との間に第１のアナログスイッチ１３を設けると
ともに電池１６の正電極側に一方の端子が接続された第
２のアナログスイッチ１７と、この第２のアナログスイ
ッチ１７の他方の端子と前記第１のアナログスイッチ１
３の制御端子との間に接続された時間設定手段１８とを
有している。
おいて、一定時間後に、そのメモリーカードに保持され
ていたデータが消えるメモリーカードを提供することを
目的とする。 【構成】 第１のダイオード１２のカソード側とＳＲＡ
Ｍ１４との間に第１のアナログスイッチ１３を設けると
ともに電池１６の正電極側に一方の端子が接続された第
２のアナログスイッチ１７と、この第２のアナログスイ
ッチ１７の他方の端子と前記第１のアナログスイッチ１
３の制御端子との間に接続された時間設定手段１８とを
有している。
Description
【０００１】
【産業上の利用分野】本発明は、データの記録・保持を
行うメモリーカードに関するものである。
行うメモリーカードに関するものである。
【０００２】
【従来の技術】以下、従来のメモリーカードについて説
明する。
明する。
【０００３】従来のメモリーカードは図２に示すよう
に、電源入力端子１と、この電源入力端子１にそのアノ
ード側が接続された第１のダイオード２と、この第１の
ダイオード２のカソード側に接続された不揮発性メモリ
（以下ＳＲＡＭという）３と、前記第１のダイオード２
のカソード側にそのカソード側が接続された第２のダイ
オード４と、この第２のダイオード４のアノード側に正
電極が接続されるとともに負電極側はグランドに接続さ
れたリチウム電池５とで構成されていた。
に、電源入力端子１と、この電源入力端子１にそのアノ
ード側が接続された第１のダイオード２と、この第１の
ダイオード２のカソード側に接続された不揮発性メモリ
（以下ＳＲＡＭという）３と、前記第１のダイオード２
のカソード側にそのカソード側が接続された第２のダイ
オード４と、この第２のダイオード４のアノード側に正
電極が接続されるとともに負電極側はグランドに接続さ
れたリチウム電池５とで構成されていた。
【０００４】以上のように構成されたメモリーカードに
ついて以下にその動作を説明する。メモリーカードを取
り付けた時、電源は電源入力端子１より第１のダイオー
ド２を介してＳＲＡＭ３に供給され、データの読み書き
を行う。
ついて以下にその動作を説明する。メモリーカードを取
り付けた時、電源は電源入力端子１より第１のダイオー
ド２を介してＳＲＡＭ３に供給され、データの読み書き
を行う。
【０００５】メモリーカードを取り外した時、電源入力
端子１は開放状態となり、リチウム電池５の電圧は第２
のダイオード４を介してＳＲＡＭ３に供給されＳＲＡＭ
３のデータはメモリーカードを電源供給部から取り外し
ても保持される。
端子１は開放状態となり、リチウム電池５の電圧は第２
のダイオード４を介してＳＲＡＭ３に供給されＳＲＡＭ
３のデータはメモリーカードを電源供給部から取り外し
ても保持される。
【０００６】
【発明が解決しようとする課題】しかしながら、このよ
うな従来の構成では、メモリーカードのデータはメモリ
ーカードを取り外してもほぼ永久に保持されるので、た
とえば、あやまってメモリーカードを盗まれた時等にメ
モリーカードの中のデータを容易に読み出す事ができる
ので機密度の高い重要なデータをこのようなメモリーカ
ードに記憶することは安全面で問題があった。
うな従来の構成では、メモリーカードのデータはメモリ
ーカードを取り外してもほぼ永久に保持されるので、た
とえば、あやまってメモリーカードを盗まれた時等にメ
モリーカードの中のデータを容易に読み出す事ができる
ので機密度の高い重要なデータをこのようなメモリーカ
ードに記憶することは安全面で問題があった。
【０００７】本発明はこのような問題点を解決するもの
で、たとえメモリーカードが盗まれた時でも、一定時間
後に、そのメモリーカードに保持されていたデータが消
えるメモリーカードを提供することを目的としたもので
ある。
で、たとえメモリーカードが盗まれた時でも、一定時間
後に、そのメモリーカードに保持されていたデータが消
えるメモリーカードを提供することを目的としたもので
ある。
【０００８】
【課題を解決するための手段】この目的を達成するため
に本発明のメモリーカードは、前記第１のダイオードの
カソード側と前記不揮発性メモリとの間に第１のアナロ
グスイッチを設けるとともに、前記電池の正電極側に一
方の端子が接続された第２のアナログスイッチと、この
第２のアナログスイッチの他方の端子と前記第１のアナ
ログスイッチの制御端子との間に接続された時間設定手
段とを有し、前記電源入力端子と前記第２のアナログス
イッチの制御端子とが接続された構成としたものであ
る。
に本発明のメモリーカードは、前記第１のダイオードの
カソード側と前記不揮発性メモリとの間に第１のアナロ
グスイッチを設けるとともに、前記電池の正電極側に一
方の端子が接続された第２のアナログスイッチと、この
第２のアナログスイッチの他方の端子と前記第１のアナ
ログスイッチの制御端子との間に接続された時間設定手
段とを有し、前記電源入力端子と前記第２のアナログス
イッチの制御端子とが接続された構成としたものであ
る。
【０００９】
【作用】この構成によりメモリーカードを取り外した
時、電池の電圧は第２のアナログスイッチを介して時間
設定手段の入力端子に供給され、一定時間経過後、前記
時間設定手段の出力端子により第１のアナログスイッチ
がオフ状態となり、不揮発性メモリにリチウム電池の電
圧が供給されなくなるので、メモリーカードに保持され
ていたデータが消える。したがって、たとえメモリーカ
ードが盗まれたとしてもメモリーカードの中のデータま
で盗まれることはない。
時、電池の電圧は第２のアナログスイッチを介して時間
設定手段の入力端子に供給され、一定時間経過後、前記
時間設定手段の出力端子により第１のアナログスイッチ
がオフ状態となり、不揮発性メモリにリチウム電池の電
圧が供給されなくなるので、メモリーカードに保持され
ていたデータが消える。したがって、たとえメモリーカ
ードが盗まれたとしてもメモリーカードの中のデータま
で盗まれることはない。
【００１０】
【実施例】以下、本発明の一実施例について図面を参照
しながら説明する。
しながら説明する。
【００１１】図１は、本発明の一実施例におけるメモリ
ーカードのブロック図である。図１において、本発明の
メモリーカードは電源入力端子１１と、この電源入力端
子１１にそのアノード側が接続された第１のダイオード
１２と、この第１のダイオード１２のカソード側に接続
された第１のアナログスイッチ１３と、この第１のアナ
ログスイッチ１３に接続されたＳＲＡＭ１４と、前記第
１のダイオード１２のカソード側にそのカソード側が接
続された第２のダイオード１５と、この第２のダイオー
ド１５のアノード側に正電極が接続されるとともに負電
極側はグランドに接続されたリチウム電池（電池の一例
として用いた）１６とを備えた構成となっている。ま
た、前記電池１６の正電極側には一方の端子が接続され
た第２のアナログスイッチ１７と、この第２のアナログ
スイッチ１７の他方の端子と前記第１のアナログスイッ
チ１２の制御端子との間に接続された時間設定手段１８
とを有するとともに前記電源入力端子１１と前記第２の
アナログスイッチ１７の制御端子とが接続されている。
ーカードのブロック図である。図１において、本発明の
メモリーカードは電源入力端子１１と、この電源入力端
子１１にそのアノード側が接続された第１のダイオード
１２と、この第１のダイオード１２のカソード側に接続
された第１のアナログスイッチ１３と、この第１のアナ
ログスイッチ１３に接続されたＳＲＡＭ１４と、前記第
１のダイオード１２のカソード側にそのカソード側が接
続された第２のダイオード１５と、この第２のダイオー
ド１５のアノード側に正電極が接続されるとともに負電
極側はグランドに接続されたリチウム電池（電池の一例
として用いた）１６とを備えた構成となっている。ま
た、前記電池１６の正電極側には一方の端子が接続され
た第２のアナログスイッチ１７と、この第２のアナログ
スイッチ１７の他方の端子と前記第１のアナログスイッ
チ１２の制御端子との間に接続された時間設定手段１８
とを有するとともに前記電源入力端子１１と前記第２の
アナログスイッチ１７の制御端子とが接続されている。
【００１２】また、時間設定手段１８の詳細は以下のよ
うになっている。すなわち時間設定手段１８の入力端子
１９と、この入力端子１９に接続されたタイマー回路２
０と、このタイマー回路２０に接続されたカウンタ回路
２１と、このカウンタ回路２１の出力が一方の入力に接
続されたコンパレータ回路２２と、このコンパレータ回
路２２の出力に接続された時間設定手段１８の出力端子
２３と、データ登録入力端子２４と、このデータ登録入
力端子２４と前記コンパレータ回路２２の他方の入力と
の間に接続されたレジスタ回路２５とで構成されてい
る。
うになっている。すなわち時間設定手段１８の入力端子
１９と、この入力端子１９に接続されたタイマー回路２
０と、このタイマー回路２０に接続されたカウンタ回路
２１と、このカウンタ回路２１の出力が一方の入力に接
続されたコンパレータ回路２２と、このコンパレータ回
路２２の出力に接続された時間設定手段１８の出力端子
２３と、データ登録入力端子２４と、このデータ登録入
力端子２４と前記コンパレータ回路２２の他方の入力と
の間に接続されたレジスタ回路２５とで構成されてい
る。
【００１３】以上のように構成されたメモリーカードに
ついて、以下にその動作を説明する。
ついて、以下にその動作を説明する。
【００１４】メモリーカードを電源供給部（図示せず）
に取り付けた時、電源入力端子１１には外部より電源が
供給され第２のアナログスイッチ１７の制御端子には電
圧が印加される。第２のアナログスイッチ１７は例えば
Ｐチャンネル型ＦＥＴで構成されており、制御端子に電
圧が印加されるので第２のアナログスイッチ１７はオフ
状態になる。
に取り付けた時、電源入力端子１１には外部より電源が
供給され第２のアナログスイッチ１７の制御端子には電
圧が印加される。第２のアナログスイッチ１７は例えば
Ｐチャンネル型ＦＥＴで構成されており、制御端子に電
圧が印加されるので第２のアナログスイッチ１７はオフ
状態になる。
【００１５】また、電源入力端子１１に供給された電源
は第１のダイオード１２を介して第１のアナログスイッ
チ１３の入力端子に印加される。第１のアナログスイッ
チ１３は例えばＮチャンネル型ＦＥＴで構成されてお
り、制御端子に抵抗１３ａを介して電圧が印加されるの
で第１のアナログスイッチ１３はオン状態になる。
は第１のダイオード１２を介して第１のアナログスイッ
チ１３の入力端子に印加される。第１のアナログスイッ
チ１３は例えばＮチャンネル型ＦＥＴで構成されてお
り、制御端子に抵抗１３ａを介して電圧が印加されるの
で第１のアナログスイッチ１３はオン状態になる。
【００１６】従ってメモリーカードを取り付けた時は、
電源入力端子１１に供給された電源は第１のダイオード
１２、第１のアナログスイッチ１３を介してＳＲＡＭ１
４に供給され、従来例と同様にＳＲＡＭ１４内のデータ
を読み書きできる。
電源入力端子１１に供給された電源は第１のダイオード
１２、第１のアナログスイッチ１３を介してＳＲＡＭ１
４に供給され、従来例と同様にＳＲＡＭ１４内のデータ
を読み書きできる。
【００１７】メモリーカードを取り外した時、電源入力
端子１１には外部より電源が供給されなくなり、リチウ
ム電池１６の電圧が第２のダイオード１５を介して第１
のアナログスイッチ１３の制御端子に印加され、第１の
アナログスイッチ１３はオン状態となり、ＳＲＡＭ１４
にリチウム電池１６の電圧が印加され、ＳＲＡＭ１４内
のデータが保持される。
端子１１には外部より電源が供給されなくなり、リチウ
ム電池１６の電圧が第２のダイオード１５を介して第１
のアナログスイッチ１３の制御端子に印加され、第１の
アナログスイッチ１３はオン状態となり、ＳＲＡＭ１４
にリチウム電池１６の電圧が印加され、ＳＲＡＭ１４内
のデータが保持される。
【００１８】また、このとき電源入力端子１１には外部
より電源が供給されなくなるので、第２のアナログスイ
ッチ１７の制御端子は抵抗１７ａを介してグランドに接
地され、第２のアナログスイッチ１７はオン状態にな
る。すると、リチウム電池１６の電圧は時間設定手段１
８の入力端子１９に供給され、タイマー回路２０が動作
し始める。
より電源が供給されなくなるので、第２のアナログスイ
ッチ１７の制御端子は抵抗１７ａを介してグランドに接
地され、第２のアナログスイッチ１７はオン状態にな
る。すると、リチウム電池１６の電圧は時間設定手段１
８の入力端子１９に供給され、タイマー回路２０が動作
し始める。
【００１９】タイマー回路２０は時計用ＩＣ等で構成さ
れ、一定時間（例えば１分）毎にクロックを出力する。
タイマー回路２０から出力されたクロックはカウンタ回
路２１によって計数される。レジスタ回路２５には、あ
る数値を設定しておく。例えば数値の１００をレジスタ
回路２５に設定しておくとカウンタ回路２１によって１
００まで計数されるとコンパレータ回路２２でカウンタ
回路２１での計数値とレジスタ回路２５での設定値１０
０が比較され、カウンタ回路２１の計数値が１００にな
ると時間設定手段１８の出力端子２３に信号が出力さ
れ、第１のアナログスイッチ１３の制御端子に印加され
る。出力端子２３に出力される信号の電位をグランド電
位とすると第１のアナログスイッチ１３はオフ状態とな
り、リチウム電池１６の電圧はＳＲＡＭ１４に供給され
なくなるのでＳＲＡＭ１４内のデータは保持されなくな
る。
れ、一定時間（例えば１分）毎にクロックを出力する。
タイマー回路２０から出力されたクロックはカウンタ回
路２１によって計数される。レジスタ回路２５には、あ
る数値を設定しておく。例えば数値の１００をレジスタ
回路２５に設定しておくとカウンタ回路２１によって１
００まで計数されるとコンパレータ回路２２でカウンタ
回路２１での計数値とレジスタ回路２５での設定値１０
０が比較され、カウンタ回路２１の計数値が１００にな
ると時間設定手段１８の出力端子２３に信号が出力さ
れ、第１のアナログスイッチ１３の制御端子に印加され
る。出力端子２３に出力される信号の電位をグランド電
位とすると第１のアナログスイッチ１３はオフ状態とな
り、リチウム電池１６の電圧はＳＲＡＭ１４に供給され
なくなるのでＳＲＡＭ１４内のデータは保持されなくな
る。
【００２０】タイマー回路２０から出力されるクロック
の周期を１分とするとメモリーカードを取り外して１０
０分後には第１のアナログスイッチがオフ状態になるの
でＳＲＡＭ１４内のデータは消える。
の周期を１分とするとメモリーカードを取り外して１０
０分後には第１のアナログスイッチがオフ状態になるの
でＳＲＡＭ１４内のデータは消える。
【００２１】以上のように本実施例によればメモリーカ
ードを取り外して１００分後にメモリーカード内のデー
タは消えてしまうのでメモリーカードを盗まれてもメモ
リーカード内のデータを読み出されることがなくなる。
ードを取り外して１００分後にメモリーカード内のデー
タは消えてしまうのでメモリーカードを盗まれてもメモ
リーカード内のデータを読み出されることがなくなる。
【００２２】なおデータ登録入力端子２４を介してレジ
スタ回路２５の設定値を任意に設定する事ができるので
メモリーカードを取り外してからメモリーカード内のデ
ータが消えてしまう時間を任意に設定できる。
スタ回路２５の設定値を任意に設定する事ができるので
メモリーカードを取り外してからメモリーカード内のデ
ータが消えてしまう時間を任意に設定できる。
【００２３】
【発明の効果】以上のように、本発明メモリーカードは
第１のダイオードのカソード側と不揮発性メモリとの間
に第１のアナログスイッチを設けるとともに電池の正電
極側に一方の端子が接続された第２のアナログスイッチ
と、この第２のアナログスイッチの他方の端子と前記第
１のアナログスイッチの制御端子との間に接続された時
間設定手段とを有し、電源入力端子と前記第２のアナロ
グスイッチの制御端子とが接続された構成としているの
で、メモリーカードを取り外した時、電池の電圧は第２
のアナログスイッチを介して時間設定手段の入力端子に
供給され、一定時間経過後、前記時間設定手段の出力端
子により第１のアナログスイッチがオフ状態となり不揮
発性メモリに前記電池の電圧が供給されなくなるのでメ
モリーカードに保持されていたデータが消える。したが
って、たとえメモリーカードが盗まれたとしてもメモリ
ーカードの中のデータまで盗まれる事はない。
第１のダイオードのカソード側と不揮発性メモリとの間
に第１のアナログスイッチを設けるとともに電池の正電
極側に一方の端子が接続された第２のアナログスイッチ
と、この第２のアナログスイッチの他方の端子と前記第
１のアナログスイッチの制御端子との間に接続された時
間設定手段とを有し、電源入力端子と前記第２のアナロ
グスイッチの制御端子とが接続された構成としているの
で、メモリーカードを取り外した時、電池の電圧は第２
のアナログスイッチを介して時間設定手段の入力端子に
供給され、一定時間経過後、前記時間設定手段の出力端
子により第１のアナログスイッチがオフ状態となり不揮
発性メモリに前記電池の電圧が供給されなくなるのでメ
モリーカードに保持されていたデータが消える。したが
って、たとえメモリーカードが盗まれたとしてもメモリ
ーカードの中のデータまで盗まれる事はない。
【００２４】またデータ登録入力端子によりレジスタ回
路の設定値を任意に設定すればメモリーカードの中のデ
ータが消えるまでの時間を任意に設定できる。
路の設定値を任意に設定すればメモリーカードの中のデ
ータが消えるまでの時間を任意に設定できる。
【図面の簡単な説明】
【図１】本発明の一実施例によるメモリーカードのブロ
ック図
ック図
【図２】従来のメモリーカードのブロック図
１１ 電源入力端子 １２ 第１のダイオード １３ 第１のアナログスイッチ １４ ＳＲＡＭ １５ 第２のダイオード １６ リチウム電池 １７ 第２のアナログスイッチ １８ 時間設定手段
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.6 識別記号 庁内整理番号 ＦＩ 技術表示箇所 Ｇ０６Ｋ 19/10
Claims (2)
- 【請求項１】 電源入力端子と、この電源入力端子にそ
のアノード側が接続された第１のダイオードと、この第
１のダイオードのカソード側に接続された不揮発性メモ
リと、前記第１のダイオードのカソード側にそのカソー
ド側が接続された第２のダイオードと、この第２のダイ
オードのアノード側に正電極が接続されるとともに負電
極側はグランドに接続された電池とを備え、前記第１の
ダイオードのカソード側と前記不揮発性メモリの間に第
１のアナログスイッチを設けるとともに、前記電池の正
電極側に一方の端子が接続された第２のアナログスイッ
チと、この第２のアナログスイッチの他方の端子と前記
第１のアナログスイッチの制御端子との間に接続された
時間設定手段とを有し、前記電源入力端子と前記第２の
アナログスイッチの制御端子とが接続されたメモリーカ
ード。 - 【請求項２】 時間設定手段は、時間設定手段の入力端
子と、この入力端子に接続されたタイマー回路と、この
タイマー回路に接続されたカウンタ回路と、このカウン
タ回路の出力が一方の入力に接続されたコンパレータ回
路と、このコンパレータ回路の出力に接続された時間設
定手段の出力端子と、データ登録入力端子と、このデー
タ登録入力端子と前記コンパレータ回路の他方の入力と
の間に接続されたレジスタ回路とを有する請求項１記載
のメモリーカード。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6144833A JPH0816480A (ja) | 1994-06-27 | 1994-06-27 | メモリーカード |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6144833A JPH0816480A (ja) | 1994-06-27 | 1994-06-27 | メモリーカード |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0816480A true JPH0816480A (ja) | 1996-01-19 |
Family
ID=15371504
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6144833A Pending JPH0816480A (ja) | 1994-06-27 | 1994-06-27 | メモリーカード |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0816480A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2000242565A (ja) * | 1999-02-19 | 2000-09-08 | Nec Corp | 無線携帯端末 |
| JP2006195719A (ja) * | 2005-01-13 | 2006-07-27 | Nec Corp | 不揮発メモリ装置、不揮発メモリシステム、データの消去方法、プログラム及び記憶媒体 |
| JP2008242924A (ja) * | 2007-03-28 | 2008-10-09 | Casio Comput Co Ltd | 端末装置及びプログラム |
-
1994
- 1994-06-27 JP JP6144833A patent/JPH0816480A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2000242565A (ja) * | 1999-02-19 | 2000-09-08 | Nec Corp | 無線携帯端末 |
| JP2006195719A (ja) * | 2005-01-13 | 2006-07-27 | Nec Corp | 不揮発メモリ装置、不揮発メモリシステム、データの消去方法、プログラム及び記憶媒体 |
| JP2008242924A (ja) * | 2007-03-28 | 2008-10-09 | Casio Comput Co Ltd | 端末装置及びプログラム |
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