JPH07134573A - 表示駆動装置 - Google Patents
表示駆動装置Info
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- JPH07134573A JPH07134573A JP5282580A JP28258093A JPH07134573A JP H07134573 A JPH07134573 A JP H07134573A JP 5282580 A JP5282580 A JP 5282580A JP 28258093 A JP28258093 A JP 28258093A JP H07134573 A JPH07134573 A JP H07134573A
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Abstract
って駆動回路の負荷を軽くし、かつラッシュ電流による
駆動波形の歪みを小さくして高表示品位で低消費電力の
表示駆動装置を得る。 【構成】 レベルの異なる2つの電圧を交互に切り替え
る駆動回路1において、その極性が切り替わる時の所定
期間、その駆動回路1とその出力端VOUTに接続された
負荷をスイッチSW1で切り離して、駆動回路1からの
矩形波の電圧レベル間の電圧Vgを発生させる電源部2
と負荷をスイッチSW2で接続するので、矩形波の極性
の切り替わり時に流れるラッシュ電流の一部を電源部2
に負担させることで、駆動回路1の負担が軽くなり、ま
た、ラッシュ電流による駆動回路1からの出力波形の歪
みも小さくなって高表示品位で低消費電力となる。
Description
マトリクス型液晶表示装置などに用いられる表示駆動装
置に関する。
ティブマトリクス型液晶表示装置について説明する。
表示装置の構成を模式的に示すブロック図である。図4
において、対向して配設された2枚の基板100,10
1の間に表示媒体である液晶が封入され、一方の基板1
00の液晶側表面にはマトリクス状に配列された絵素電
極102を駆動するためのスイッチング素子としてTF
T(Thin Film Transistor)103、このTFT103
を介して絵素電極102に電圧を印加するための信号配
線(データ配線)104、さらにTFT103を駆動す
るための走査配線(ゲート配線)105などが複数配設
され、また、他方の基板101の液晶側表面には共通電
極が設けられ、この共通電極に接続される電極端子10
6が形成されている。この共通電極と絵素電極102と
の間で、表示に寄与する液晶容量を構成する。また、デ
ジタルソースドライバ200は信号配線104に接続さ
れ、ゲートドライバ300は走査配線105に接続され
ている。さらに、階調電圧発生回路400はデジタルソ
ースドライバ200に接続され、デジタルソースドライ
バ200に対して階調電圧を発生させる。さらに、共通
電極駆動回路500は共通電極の電極端子106に接続
され、共通電極に電圧VCOMを出力する。これらデジタ
ルソースドライバ200、ゲートドライバ300、階調
電圧発生回路400および共通電極駆動回路500はコ
ントロール回路600に接続され、コントロール回路6
00によりこれらを制御する。
配線104に電圧を供給するものであるが、ここでは、
映像信号がデジタルで与えられるデジタルソースドライ
バ200について説明する。このデジタルソースドライ
バ200としては、図5に示すような回路構成が用いら
れる。ここでは簡単のため、映像信号データは2ビット
で構成されているものとする。即ち、映像信号データ
は、0〜3の4つの値を持ち、それぞれの値に対応し
て、階調電圧発生回路400から供給される階調用電圧
V0〜V3が選択されて出力される。
00における第i番目の出力に対応した構成部分を示
す。図6において、映像信号データの各ビット(D0,
D1)毎に設けられた第1段目のDフリップフロップ
(サンプリングフリップフロップ)MSMP、第2段目
のDフリップフロップ(ホールドフリップフロップ)M
H、1個のデコーダDEC、さらに、4種類の階調電圧
V0〜V3とSi番目の信号配線104との間に各々設け
られたアナログスイッチASW0〜ASW3により構成さ
れる。なお、デジタル映像信号データ(D0,D1)のサ
ンプリングは、Dフリップフロップ以外にも種々のもの
を用いることができる。
ように動作する。まず、映像信号データ(D0,D1)は
第i番目の信号配線104に対応するサンプリングパル
スTSMPiの立ち上がり時点でサンプリングフリップ
フロップMSMPに取り込まれ、そこで保持される。そ
して、1水平期間のサンプリングが終了した時点で出力
パルスOEがホールドフリップフロップMHに与えら
れ、サンプリングフリップフロップMSMPに保持され
ていた映像信号データ(D0,D1)はホールドフリップ
フロップMHに取り込まれるとともにデコーダDECに
出力される。このデコーダDECでは、この2ビットの
映像信号データ(D0,D1)がデコードされ、その値
(0〜3)に応じてアナログスイッチASW0〜ASW3
のいずれか1個を貫通として、4種の階調電圧V0〜V3
のいずれかをSi番目の信号配線104に出力する。
の電極端子106に加えられる共通電極電圧Vcomの電
圧波形例を示している。ここでは、階調電圧はV0〜V3
の順で絵素電極102に印加される電圧が高くなるもの
とする。即ち、|V0−Vcom|<|V1−Vcom|<|V
2−Vcom|<|V3−Vcom|であり、この関係は逆であ
っても良い。図7に示すように、各電圧V0〜V3および
Vcomは、1出力期間H毎に反転する、コントロール回
路600からのPOL信号と同期して電圧レベルが変化
している。
ら見た階調電圧V0〜V3を示している。ある絵素を考え
ると、その絵素が走査配線105を介したゲートドライ
バ300によって選択されている場合、図8の各電圧で
その絵素電極102が充電されることになる。
により、絵素電極103と共通電極との間に所定の電圧
を得るための信号配線104に印加する電圧の振幅を小
さくでき、デジタルソースドライバ200の動作電圧を
下げることができる。
0には、演算増幅器OP2と相補回路BUFとが設けら
れている。この演算増幅器OP2には一定電圧とPOL
信号が各入力端子に入力され、演算増幅器OP2の出力
端は相補回路BUFに接続されている。また、演算増幅
器OP2は相補回路BUFの出力Voutをその−入力端子
にフィードバックすることにより反転増幅動作を行って
いる。
00として使う場合と図4の階調電圧発生回路400の
各階調電圧発生回路として使う場合との違いは本質的に
はないが、階調電圧発生回路500の場合は、それぞれ
データに対応した振幅および中心電圧になることと、P
OL信号に対する位相が、同相の場合と逆相の場合があ
ることだけである。
の出力波形を示したものである。図10において、1水
平周期H毎に電圧の極性を反転する、ライン反転駆動の
場合の波形が示されている。POL信号は高低2レベル
で切り替わる信号であり、POL信号が高レベルのと
き、共通電極駆動回路500は低い電圧を出力し、また
はPOL信号が低レベルのとき、共通電極駆動回路は高
い電圧を出力する。したがって、POL信号が高レベル
のときには、絵素電極103が正に充電されることとな
り、POL信号が低レベルのときには、絵素電極103
が負に充電されることになる。
電極端子106に接続される共通電極には信号配線10
4との寄生容量などの容量性負荷が存在し、この共通電
極の印加電圧が変化するとこれらの容量性負荷に充放電
電流が流れるが、特に、図10の駆動波形ではその極性
の切り替わり部分でラッシュ電流が流れ、しかもそのピ
ーク電流は数百mAから数Aとなる。
うなラッシュ電流を基本的に充足可能な能力を備える必
要があったため、例えば図9の回路においては演算増幅
器OP2にはできるだけ高速かつ電流容量の大きなもの
を使用し、さらにその後段のトランジスタの相補回路B
UFによる電流増幅器でかかる要求を満たすように回路
を構成していた。しかしこれは価格の上昇を招き、さら
に、本来表示体の駆動に不必要な消費電力の増加を招い
ていた。また、回路構成などによっては、このラッシュ
電流が流れることにより図10の駆動波形が歪み、表示
品位の低下を招く場合もあった。
で、極性が切り替わる部分でのラッシュ電流を補って駆
動回路の負荷を軽くすることができ、また、ラッシュ電
流による駆動波形の歪みを小さくして高表示品位で低消
費電力の表示駆動装置を提供することを目的とする。
は、表示媒体を挟んで設けられた2枚の基板のうち一方
の基板に絵素電極を形成し、他方の基板に該絵素電極と
の間で容量が形成される共通電極を形成し、該共通電極
に対して、レベルの異なる2種類の電圧からなる矩形波
を出力する共通電極駆動部と、該矩形波の電圧レベル間
の任意の電圧レベルを発生する電圧発生部と、該駆動部
出力から電圧発生部出力に該矩形波の電圧レベル切り替
え時の所定期間切り替えるスイッチ部とを備えたもので
あり、そのことにより上記目的が達成される。
与えられた階調用電圧をそのまま選択して出力するか、
又は該階調用電圧の組合せによって作られる補間電圧を
出力して、レベルの異なる2種類の電圧からなる矩形波
を表示体の信号線に印加する階調電圧駆動部と、該矩形
波の電圧レベル間の任意の電圧レベルを発生する電圧発
生部と、該階調電圧駆動部出力から電圧発生部出力に該
矩形波の電圧レベル切り替え時の所定期間切り替えるス
イッチ部とを備えたものであり、そのことにより上記目
的が達成される。
イッチ部を第1および第2のスイッチ手段で構成し、該
第1のスイッチ手段は共通電極駆動部出力または階調電
圧駆動部出力をスイッチングし、該第2スイッチ手段は
電圧発生部出力をスイッチングして、該共通電極駆動部
出力または階調電圧駆動部出力から該電圧発生部出力に
前記矩形波の電圧レベル切り替え時の所定期間切り替え
る構成とし、該第1および第2スイッチ手段はともにオ
フするように制御し、該オフする期間は、第1および2
のスイッチ手段を構成する素子の過渡期なスイッチング
時間よりも大きく設定したものであり、そのことにより
上記目的が達成される。
交互に切り替える駆動部において、その極性が切り替わ
る部分で、その駆動部とその出力に接続された負荷をス
イッチ部で切り離して、駆動部出力の電圧レベル間の電
圧を発生する電圧発生部と負荷を接続するので、極性の
切り替わり時に流れるラッシュ電流の一部を電圧発生部
に負担させることで、駆動回路の負担が軽くなり、ま
た、ラッシュ電流による駆動波形の歪みも小さくなって
高表示品位で低消費電力となる。
について説明する。図1において、駆動回路1はスイッ
チSW1を介して出力端Voutに接続され、電源部2はス
イッチSW2を介して出力端Voutに接続されている。こ
の駆動回路1には極性反転信号であるPOL信号が与え
られる。また、スイッチSW2には制御信号DISが与
えられ、スイッチSW1には制御信号DISがインバー
タINVを介して与えられる。即ち、スイッチSW1が
オンの時はスイッチSW2がオフとなり、スイッチSW1
がオフの時はスイッチSW2がオンとなるように制御さ
れる。これらのスイッチSW1,SW2は、可能な限りオ
ン抵抗が低く、オフ抵抗が高い素子を用いることが好ま
しい。以上により電圧発生回路3が構成される。
るタイミング波形図を示す。この電圧発生回路3の動作
を、このタイミング波形図に基づいて説明する。
OL信号は、ライン反転駆動では1水平時間毎に反転す
る信号であり、POL信号がハイレベルの時は、絵素を
正電圧に充電する時限(タイミング)であり、駆動回路
1は電圧レベルVa1を出力し、また、POL信号がロ
ーレベルの時は、絵素を負電圧に充電する時限であり、
駆動回路1は電圧レベルVa2を出力する。したがっ
て、駆動回路1からの出力電圧Vaは電圧レベルVa1
およびVa2の矩形波である。また、制御信号DIS
は、POL信号がハイレベルからローレベルへ、ローレ
ベルからハイレベルへ切り替わるタイミング、即ち極性
が切り替わるタイミングで一定期間ハイレベルになる信
号である。さらに、電源部2は、駆動回路1からの出力
電圧レベルVa1,Va2間の任意の電圧レベルとしての
電源電圧Vgを出力する。駆動回路1はPOL信号によ
り制御される矩形波発生回路であり、POL信号がハイ
レベルのときローレベルの出力電圧Va2を出力し、P
OL信号がローレベルのときハイレベルの出力電圧レベ
ルVa1を出力する。
は、極性が切り替わる部分ではスイッチSW1により駆
動回路1と出力端Voutは切り離されて、電源部2と出
力端Voutが接続される。このことにより、極性が切り
替わる部分で流れるラッシュ電流は電源部2から供給さ
れ、駆動回路1の負担は軽くなり、また、電源部2から
は駆動回路1から出力される電圧レベル間の電圧Vgを
発生することで駆動回路1のラッシュ電流を低減させる
ことができる。
について説明する。本実施例では、第1実施例の駆動回
路1を、演算増幅器OP1を用いて実現させている。ま
た、本実施例においては、スイッチSW1,SW2には電
解効果トランジスタFETを用いて実現させている。こ
れらFETは双方向性であり、かつ、オン抵抗がきわめ
て小さいので、本発明のスイッチ回路として用いるのに
適している。また、論理レベルで与えられるDIS信号
および、インバータINVを介したその反転信号をレベ
ル変換回路4によりFETの制御に適したレベルに変換
しているが、このレベル変換回路4は使用するFETの
特性によっては不要である。
で、スイッチSW1により演算増幅器OP1の出力電圧V
aは駆動回路の出力端Voutと切り離され、その代わ
りに出力端VoutはスイッチSW2によりGNDに接
地される。演算増幅器OP1からの出力電圧Vaが極性
の違う時限で正電圧と負電圧になる場合、第1の実施例
における図1の電源部2の代わりにGNDと接続させる
ことによって、駆動回路全体の省電力化を実現すること
ができる。これは、第1実施例の場合、駆動回路1から
のラッシュ電流を低減する代わりに電源部2がラッシュ
電流を供給することになるが、電源部2の代わりにGN
Dに接続させることにより、極性の切り替わる部分で流
れるラッシュ電流は、スイッチSW2にて接地されたG
NDより供給されるからである。
が同時にオンすることはないので演算増幅器OP1の出
力電流がスイッチSW1,SW2介してGNDに流れ込む
ことはない。
W1,SW2が同時にオンすることはないが、MOS型ア
ナログスイッチなどの過渡応答の大きいスイッチを使用
するような場合には、オンからオフ或は、オフからオン
の過渡的な領域で貫通電流が流れる場合がある。この場
合、スイッチSW1,SW2の切り替わるタイミングで共
にオフする期間を設けるように各スイッチを制御すれ
ば、貫通電流は流れない。この場合、オフする期間は、
スイッチSW1,SW2を構成する素子の過渡期なスイ
ッチング時間よりも大きく設定する。
通電極駆動回路について説明してきたが、外部から与え
られた階調用電圧をそのまま選択して出力するか、又は
該階調用電圧の組合せによって作られる補間電圧を出力
する階調電圧駆動回路においても同様の構成で同様の効
果を得ることができる。また、上記実施例においては、
ライン反転駆動方式における1水平時間毎のタイミング
で説明したが、これに限定されるものではなく、駆動方
式によっては他のタイミングでもよい。さらに、第2の
実施例におけるスイッチ回路はFETで説明したが、こ
れに限定されるものではなく、他の種類のスイッチ手段
を使用することもできる。
り替わる部分で流れるラッシュ電流を駆動部自体で負担
させることを防止し、かつ駆動部からのラッシュ電流を
大幅に小さくすることができて、低消費電力の表示駆動
装置を実現することができる。また、従来のようにラッ
シュ電流で電圧波形の歪みによる表示品位の低下を防止
することができる。さらに、従来のようなトランジスタ
などで構成する電流増幅のための相補回路が必要なくな
ってコストの削減を図ることができ、また、従来のよう
にトランジスタで消費されていた電力も不要になり、そ
の分、電力削減をすることができる。さらに、駆動部の
低消費電力化、即ち駆動部自体が省電力回路となるの
で、回路構成素子が従来のものと比べて小型化が可能と
なり、駆動部の基板の小型化、省スペース化を図ること
ができ、表示装置の薄型化を実現させることができる。
構成を示すブロック図である。
ミングを示す波形図である。
構成を示すブロック図である。
構成を示すブロック図である。
示すブロック図である。
Si番目の1構成単位を示すブロック図である。
階調電圧と図4の共通電極駆動回路500からの共通電
極電圧を示す波形図である。
ベルを示す電圧レベル比較図である。
ロック図である。
力のタイミングを示す波形図である。
Claims (3)
- 【請求項1】 表示媒体を挟んで設けられた2枚の基板
のうち一方の基板に絵素電極を形成し、他方の基板に該
絵素電極との間で容量が形成される共通電極を形成し、
該共通電極に対して、レベルの異なる2種類の電圧から
なる矩形波を出力する共通電極駆動部と、該矩形波の電
圧レベル間の任意の電圧レベルを発生する電圧発生部
と、該駆動部出力から電圧発生部出力に該矩形波の電圧
レベル切り替え時の所定期間切り替えるスイッチ部とを
備えた表示駆動装置。 - 【請求項2】 外部から与えられた階調用電圧をそのま
ま選択して出力するか、又は該階調用電圧の組合せによ
って作られる補間電圧を出力して、レベルの異なる2種
類の電圧からなる矩形波を表示体の信号線に印加する階
調電圧駆動部と、該矩形波の電圧レベル間の任意の電圧
レベルを発生する電圧発生部と、該階調電圧駆動部出力
から電圧発生部出力に該矩形波の電圧レベル切り替え時
の所定期間切り替えるスイッチ部とを備えた表示駆動装
置。 - 【請求項3】 前記スイッチ部を第1および第2のスイ
ッチ手段で構成し、該第1のスイッチ手段は前記共通電
極駆動部出力または階調電圧駆動部出力をスイッチング
し、該第2スイッチ手段は電圧発生部出力をスイッチン
グして、該共通電極駆動部出力または階調電圧駆動部出
力から該電圧発生部出力に前記矩形波の電圧レベル切り
替え時の所定期間切り替える構成とし、該第1および第
2スイッチ手段はともにオフするように制御され、該オ
フする期間は、第1および2のスイッチ手段を構成する
素子の過渡期なスイッチング時間よりも大きく設定した
請求項1または2記載の表示駆動装置。
Priority Applications (9)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP28258093A JP2849034B2 (ja) | 1993-11-11 | 1993-11-11 | 表示駆動装置 |
KR1019940002371A KR0140041B1 (ko) | 1993-02-09 | 1994-02-08 | 표시 장치용 전압 발생 회로, 공통 전극 구동 회로, 신호선 구동 회로 및 계조 전압 발생 회로 |
US08/194,151 US5929847A (en) | 1993-02-09 | 1994-02-09 | Voltage generating circuit, and common electrode drive circuit, signal line drive circuit and gray-scale voltage generating circuit for display devices |
EP94300941A EP0611144B1 (en) | 1993-02-09 | 1994-02-09 | Voltage generating circuit, and common electrode drive circuit, signal line drive circuit and gray-scale voltage generating circuit for display devices |
DE69434493T DE69434493T2 (de) | 1993-02-09 | 1994-02-09 | Spannungserzeugungsschaltung, Steuerungsschaltung für gemeinsame Elektrode, Steuerungsschaltung für Signalleitung und Grauskala-Spannungserzeugungsschaltung für Anzeigevorrichtungen |
KR97065767A KR0139970B1 (en) | 1993-02-09 | 1997-11-29 | Voltage generating circuit, and common electrode drive circuit, signal line drive circuit and gray scale voltage gnerating circuit for display devices |
KR1019970065766A KR0175230B1 (en) | 1993-02-09 | 1997-11-29 | Voltage generating circuit and common electrode drive circuit signal line drive circuit and gray-scale yoltage gen... |
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Applications Claiming Priority (1)
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Publications (2)
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Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
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JP2007058235A (ja) * | 1996-03-26 | 2007-03-08 | Semiconductor Energy Lab Co Ltd | アクティブマトリクス型表示装置の駆動方法 |
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-
1993
- 1993-11-11 JP JP28258093A patent/JP2849034B2/ja not_active Expired - Fee Related
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JP2849034B2 (ja) | 1999-01-20 |
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