JPH0683616A - 半導体集積回路 - Google Patents
半導体集積回路Info
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- JPH0683616A JPH0683616A JP4234537A JP23453792A JPH0683616A JP H0683616 A JPH0683616 A JP H0683616A JP 4234537 A JP4234537 A JP 4234537A JP 23453792 A JP23453792 A JP 23453792A JP H0683616 A JPH0683616 A JP H0683616A
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- JP
- Japan
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- clock signal
- peripheral circuits
- mpu
- semiconductor integrated
- integrated circuit
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- 239000004065 semiconductor Substances 0.000 title claims abstract description 26
- 230000002093 peripheral effect Effects 0.000 claims abstract description 73
- 238000001514 detection method Methods 0.000 claims description 3
- 102100040862 Dual specificity protein kinase CLK1 Human genes 0.000 abstract description 20
- 101000749294 Homo sapiens Dual specificity protein kinase CLK1 Proteins 0.000 abstract description 18
- 238000010586 diagram Methods 0.000 description 6
- 101100328957 Caenorhabditis elegans clk-1 gene Proteins 0.000 description 1
- 230000010354 integration Effects 0.000 description 1
Classifications
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
- Y02D—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN INFORMATION AND COMMUNICATION TECHNOLOGIES [ICT], I.E. INFORMATION AND COMMUNICATION TECHNOLOGIES AIMING AT THE REDUCTION OF THEIR OWN ENERGY USE
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- Microcomputers (AREA)
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Abstract
(57)【要約】
【目的】 ノイズ及び消費電力の低減化を図った、MP
U及びその周辺回路からなる半導体集積回路を得る。 【構成】 MPU2′は内部にクロック制御部22及び
命令実行部23を有する。クロック制御部22は外部よ
りクロック信号CLK0を取り込み、命令実行部23よ
り与えられる制御信号に基づき、このクロック信号CL
K0を分周して分周クロック信号CLK1を選択的に周
辺回路31〜33に出力する。 【効果】 選択的に周辺回路へのクロック信号の供給を
停止することにより、周辺回路を停止状態にする分、ノ
イズ及び消費電力の低減化を図ることができる。
U及びその周辺回路からなる半導体集積回路を得る。 【構成】 MPU2′は内部にクロック制御部22及び
命令実行部23を有する。クロック制御部22は外部よ
りクロック信号CLK0を取り込み、命令実行部23よ
り与えられる制御信号に基づき、このクロック信号CL
K0を分周して分周クロック信号CLK1を選択的に周
辺回路31〜33に出力する。 【効果】 選択的に周辺回路へのクロック信号の供給を
停止することにより、周辺回路を停止状態にする分、ノ
イズ及び消費電力の低減化を図ることができる。
Description
【0001】
【産業上の利用分野】この発明はMPU及びその周辺回
路からなる半導体集積回路に関し、特にクロック信号の
制御に関する。
路からなる半導体集積回路に関し、特にクロック信号の
制御に関する。
【0002】
【従来の技術】図3は、MPU及びその周辺回路からな
る従来の半導体集積回路の構成を示すブロック図であ
る。同図に示すように、半導体集積回路1はMPU2と
複数の周辺回路31〜33とから構成される。MPU2
は内部に内部分周器21を備える。内部分周器21は外
部よりクロック信号CLK0を取り込み、クロック信号
CLK0を分周して分周クロック信号CLK1を、MP
U2の内部の各ブロック(図示せず)及び周辺回路31
〜33それぞれのクロック入力CLKに出力する。
る従来の半導体集積回路の構成を示すブロック図であ
る。同図に示すように、半導体集積回路1はMPU2と
複数の周辺回路31〜33とから構成される。MPU2
は内部に内部分周器21を備える。内部分周器21は外
部よりクロック信号CLK0を取り込み、クロック信号
CLK0を分周して分周クロック信号CLK1を、MP
U2の内部の各ブロック(図示せず)及び周辺回路31
〜33それぞれのクロック入力CLKに出力する。
【0003】MPU2内の各ブロック及び周辺回路31
〜33は分周クロック信号CLK1に同期して所定の動
作を実行する。
〜33は分周クロック信号CLK1に同期して所定の動
作を実行する。
【0004】
【発明が解決しようとする課題】MPU及びその周辺回
路からなる従来の半導体集積回路は以上のように構成さ
れており、集積度が高まるにつれ、周辺回路31〜33
を構成するトランジスタ数も増加する。これに伴い、半
導体集積回路1の動作時に生じるノイズの増大及び消費
電力の増大が無視できないレベルになるという問題点が
あった。
路からなる従来の半導体集積回路は以上のように構成さ
れており、集積度が高まるにつれ、周辺回路31〜33
を構成するトランジスタ数も増加する。これに伴い、半
導体集積回路1の動作時に生じるノイズの増大及び消費
電力の増大が無視できないレベルになるという問題点が
あった。
【0005】この発明は上記問題点を解決するためにな
されたもので、ノイズ及び消費電力の低減化を図った、
MPU及びその周辺回路からなる半導体集積回路を得る
ことを目的とする。
されたもので、ノイズ及び消費電力の低減化を図った、
MPU及びその周辺回路からなる半導体集積回路を得る
ことを目的とする。
【0006】
【課題を解決するための手段】この発明にかかる請求項
1記載の半導体集積回路は、クロック信号供給機能を備
えたMPUと、各々が前記クロック信号に同期して動作
する複数の周辺回路とを備え、前記MPUは、所定のク
ロック信号選択命令に従い、前記複数の周辺回路それぞ
れへの前記クロック信号の供給を選択的に停止する命令
実行手段を備える。
1記載の半導体集積回路は、クロック信号供給機能を備
えたMPUと、各々が前記クロック信号に同期して動作
する複数の周辺回路とを備え、前記MPUは、所定のク
ロック信号選択命令に従い、前記複数の周辺回路それぞ
れへの前記クロック信号の供給を選択的に停止する命令
実行手段を備える。
【0007】この発明にかかる請求項2記載の半導体集
積回路は、クロック信号供給機能を備えたMPUと、各
々が前記クロック信号に同期して動作する複数の周辺回
路とを備え、前記MPUは、所定の周辺回路状態検出命
令に従い、前記複数の周辺回路それぞれが実動作状態あ
るかアイドル状態にあるかを検出し、前記複数の周辺回
路のうちアイドル状態にある周辺回路への前記クロック
信号の供給を停止する命令実行手段を備える。
積回路は、クロック信号供給機能を備えたMPUと、各
々が前記クロック信号に同期して動作する複数の周辺回
路とを備え、前記MPUは、所定の周辺回路状態検出命
令に従い、前記複数の周辺回路それぞれが実動作状態あ
るかアイドル状態にあるかを検出し、前記複数の周辺回
路のうちアイドル状態にある周辺回路への前記クロック
信号の供給を停止する命令実行手段を備える。
【0008】
【作用】この発明の請求項1記載の半導体集積回路にお
けるMPU内の命令実行手段は、所定のクロック信号選
択命令に従い、複数の周辺回路それぞれへのクロック信
号の供給を選択的に停止する。したがって、停止状態の
周辺回路はノイズを発生せず、電力を消費しない。
けるMPU内の命令実行手段は、所定のクロック信号選
択命令に従い、複数の周辺回路それぞれへのクロック信
号の供給を選択的に停止する。したがって、停止状態の
周辺回路はノイズを発生せず、電力を消費しない。
【0009】この発明の請求項2記載の半導体集積回路
におけるMPU内の命令実行手段は、所定の周辺回路状
態検出命令に従い、複数の周辺回路それぞれが実動作状
態あるかアイドル状態にあるかを検出し、複数の周辺回
路のうちアイドル状態にある周辺回路へのクロック信号
の供給を停止する。したがって、停止状態の周辺回路は
ノイズを発生せず、電力を消費しない。
におけるMPU内の命令実行手段は、所定の周辺回路状
態検出命令に従い、複数の周辺回路それぞれが実動作状
態あるかアイドル状態にあるかを検出し、複数の周辺回
路のうちアイドル状態にある周辺回路へのクロック信号
の供給を停止する。したがって、停止状態の周辺回路は
ノイズを発生せず、電力を消費しない。
【0010】
【実施例】図1はこの発明の第1の実施例である、MP
U及びその周辺回路からなる半導体集積回路の構成を示
すブロック図である。同図に示すように、半導体集積回
路1は従来同様、MPU2′と周辺回路31〜33とか
ら構成されているが、MPU2′の内部構成が従来と異
なる。
U及びその周辺回路からなる半導体集積回路の構成を示
すブロック図である。同図に示すように、半導体集積回
路1は従来同様、MPU2′と周辺回路31〜33とか
ら構成されているが、MPU2′の内部構成が従来と異
なる。
【0011】MPU2′は内部にクロック制御部22及
び命令実行部23を有する。クロック制御部22は外部
よりクロック信号CLK0を取り込み、このクロック信
号CLK0を分周して分周クロック信号CLK1をMP
U2′内部の各ブロック(図示せず)に出力するととも
に、命令実行部23より与えられる制御信号に基づき、
分周クロック信号CLK1を選択的に周辺回路31〜3
3に出力する。
び命令実行部23を有する。クロック制御部22は外部
よりクロック信号CLK0を取り込み、このクロック信
号CLK0を分周して分周クロック信号CLK1をMP
U2′内部の各ブロック(図示せず)に出力するととも
に、命令実行部23より与えられる制御信号に基づき、
分周クロック信号CLK1を選択的に周辺回路31〜3
3に出力する。
【0012】MPU2′が実行する命令の1種として、
クロック信号選択命令があらかじめ設けられており、命
令実行部23は、クロック信号選択命令を受けると、こ
のクロック信号選択命令の指示に基づく制御信号をクロ
ック制御部22に出力する。なお、クロック信号選択命
令とは、「周辺回路32及び33への分周クロック信号
CLK1のクロック供給を中止せよ」、「周辺回路31
への分周クロック信号CLK1の供給を中止せよ」、
「すべての周辺回路31〜33に分周クロック信号CL
K1の供給を開始せよ」等を指示する命令である。
クロック信号選択命令があらかじめ設けられており、命
令実行部23は、クロック信号選択命令を受けると、こ
のクロック信号選択命令の指示に基づく制御信号をクロ
ック制御部22に出力する。なお、クロック信号選択命
令とは、「周辺回路32及び33への分周クロック信号
CLK1のクロック供給を中止せよ」、「周辺回路31
への分周クロック信号CLK1の供給を中止せよ」、
「すべての周辺回路31〜33に分周クロック信号CL
K1の供給を開始せよ」等を指示する命令である。
【0013】このような構成において、MPU2′が外
部から、クロック信号選択命令を受けると、内部の命令
実行部23がクロック信号選択命令の指示に基づく制御
信号をクロック制御部22に出力する。
部から、クロック信号選択命令を受けると、内部の命令
実行部23がクロック信号選択命令の指示に基づく制御
信号をクロック制御部22に出力する。
【0014】すると、クロック制御部22は、制御信号
に基づき、分周クロック信号CLK1を選択的に周辺回
路31〜33に出力する。例えば、クロック信号選択命
令が「周辺回路32及び33への分周クロック信号CL
K1のクロック供給を中止せよ」であれば、周辺回路3
1のクロック入力CLKのみに分周クロック信号CLK
1を出力し、周辺回路32及び33のクロック入力CL
Kには分周クロック信号CLK1を出力しない。
に基づき、分周クロック信号CLK1を選択的に周辺回
路31〜33に出力する。例えば、クロック信号選択命
令が「周辺回路32及び33への分周クロック信号CL
K1のクロック供給を中止せよ」であれば、周辺回路3
1のクロック入力CLKのみに分周クロック信号CLK
1を出力し、周辺回路32及び33のクロック入力CL
Kには分周クロック信号CLK1を出力しない。
【0015】その結果、周辺回路31のみ動作状態で、
周辺回路32及び33は停止状態となるため、半導体集
積回路1′全体のノイズ発生量及び消費電力は、周辺回
路32及び33を停止状態となる分、低減化する。
周辺回路32及び33は停止状態となるため、半導体集
積回路1′全体のノイズ発生量及び消費電力は、周辺回
路32及び33を停止状態となる分、低減化する。
【0016】周辺回路31〜33が同時に使用される場
合は少なく、周辺回路31〜33のうちアイドル状態に
ある周辺回路の存在可能性は高いため、上記例のよう
に、クロック信号選択命令により、一部の(例えばアイ
ドル状態にある)周辺回路に対するクロック信号の供給
を停止すれば、半導体集積回路1′は何ら支障なく動作
を実行することができる。
合は少なく、周辺回路31〜33のうちアイドル状態に
ある周辺回路の存在可能性は高いため、上記例のよう
に、クロック信号選択命令により、一部の(例えばアイ
ドル状態にある)周辺回路に対するクロック信号の供給
を停止すれば、半導体集積回路1′は何ら支障なく動作
を実行することができる。
【0017】図2はこの発明の第2の実施例である、M
PU及びその周辺回路からなる半導体集積回路の構成を
示すブロック図である。同図に示すように、半導体集積
回路1′′は第1の実施例同様、MPU2′′と周辺回
路31′〜33′から構成されているが、MPU2′′
の内部構成及び周辺回路31′〜33′それぞれの内部
構成が第1の実施例と異なる。
PU及びその周辺回路からなる半導体集積回路の構成を
示すブロック図である。同図に示すように、半導体集積
回路1′′は第1の実施例同様、MPU2′′と周辺回
路31′〜33′から構成されているが、MPU2′′
の内部構成及び周辺回路31′〜33′それぞれの内部
構成が第1の実施例と異なる。
【0018】MPU2′′は内部にクロック制御部2
2、命令実行部23′及び内部レジスタ24を有する。
クロック制御部22は、第1の実施例同様、外部よりク
ロック信号CLK0を取り込み、このクロック信号CL
K0を分周して分周クロック信号CLK1をMPU
2′′内部の各ブロック(図示せず)に出力するととも
に、命令実行部23′より与えられる制御信号に基づ
き、分周クロックCLK1を選択的に周辺回路31′〜
33′に出力する。
2、命令実行部23′及び内部レジスタ24を有する。
クロック制御部22は、第1の実施例同様、外部よりク
ロック信号CLK0を取り込み、このクロック信号CL
K0を分周して分周クロック信号CLK1をMPU
2′′内部の各ブロック(図示せず)に出力するととも
に、命令実行部23′より与えられる制御信号に基づ
き、分周クロックCLK1を選択的に周辺回路31′〜
33′に出力する。
【0019】周辺回路31′〜33′は、それぞれ内部
にステータスレジスタ41〜43を有する。ステータス
レジスタ41〜43には、各周辺回路31′〜33′そ
れぞれが、実動作状態であるかアイドル状態であるかを
示すステータスデータが格納される。なお、ステータス
レジスタ41〜43には、遮断されることなく常に別系
統から分周クロック信号CLK1が付与される。したが
って、例え、周辺回路が停止状態になっても、内部のス
テータスレジスタは動作状態であり、周辺回路の状態変
化に伴い、そのステータスデータSDは変化する。
にステータスレジスタ41〜43を有する。ステータス
レジスタ41〜43には、各周辺回路31′〜33′そ
れぞれが、実動作状態であるかアイドル状態であるかを
示すステータスデータが格納される。なお、ステータス
レジスタ41〜43には、遮断されることなく常に別系
統から分周クロック信号CLK1が付与される。したが
って、例え、周辺回路が停止状態になっても、内部のス
テータスレジスタは動作状態であり、周辺回路の状態変
化に伴い、そのステータスデータSDは変化する。
【0020】MPU2′′が実行する命令の1つとし
て、周辺回路31〜33の状態検出用のステータス読み
出し命令があらかじめ設けられており、命令実行部2
3′は、ステータス読み出し命令を受けると、各周辺回
路31′〜33′のステータスレジスタ41〜43に格
納されたステータスデータSD1〜SD3を内部レジス
タ24に取り込む。この動作は、MPU2′′から所定
の読み出し信号を各周辺回路31′〜33′の読み出し
入力バーRDに付与し、内部のデータバス50を介し
て、ステータスレジスタ41〜43内に格納されたステ
ータスデータSD1〜SD3を内部レジスタ24に取り
込むことにより行う。
て、周辺回路31〜33の状態検出用のステータス読み
出し命令があらかじめ設けられており、命令実行部2
3′は、ステータス読み出し命令を受けると、各周辺回
路31′〜33′のステータスレジスタ41〜43に格
納されたステータスデータSD1〜SD3を内部レジス
タ24に取り込む。この動作は、MPU2′′から所定
の読み出し信号を各周辺回路31′〜33′の読み出し
入力バーRDに付与し、内部のデータバス50を介し
て、ステータスレジスタ41〜43内に格納されたステ
ータスデータSD1〜SD3を内部レジスタ24に取り
込むことにより行う。
【0021】そして、内部レジスタ24に取り込んだS
D1〜SD3に基づき、アイドル状態にある周辺回路へ
の分周クロック信号CLK1の供給停止を指示する制御
信号をクロック制御部22に出力する。クロック制御部
22は、命令実行部23′の制御信号に基づき分周クロ
ック信号CLK1を周辺回路31′〜33に選択的に出
力する。
D1〜SD3に基づき、アイドル状態にある周辺回路へ
の分周クロック信号CLK1の供給停止を指示する制御
信号をクロック制御部22に出力する。クロック制御部
22は、命令実行部23′の制御信号に基づき分周クロ
ック信号CLK1を周辺回路31′〜33に選択的に出
力する。
【0022】このような構成において、MPU2′′が
外部から、ステータス読み出し命令を受けると、内部の
命令実行部23′は、周辺回路31′〜33′内のステ
ータスレジスタ41〜43内に格納されたステータスデ
ータSD1〜SD3を内部レジスタ24に取り込む。そ
して、内部レジスタ24に格納されたステータスデータ
SD1〜SD3に基づき、アイドル状態にある周辺回路
に対する分周クロック信号CLK1の供給停止を指示す
る制御信号をクロック制御部22に出力する。すると、
クロック制御部22より、アイドル状態にある周辺回路
に対して分周クロック信号CLK1の供給停止をするよ
うに、選択的に分周クロック信号CLK1が周辺回路3
に出力される。
外部から、ステータス読み出し命令を受けると、内部の
命令実行部23′は、周辺回路31′〜33′内のステ
ータスレジスタ41〜43内に格納されたステータスデ
ータSD1〜SD3を内部レジスタ24に取り込む。そ
して、内部レジスタ24に格納されたステータスデータ
SD1〜SD3に基づき、アイドル状態にある周辺回路
に対する分周クロック信号CLK1の供給停止を指示す
る制御信号をクロック制御部22に出力する。すると、
クロック制御部22より、アイドル状態にある周辺回路
に対して分周クロック信号CLK1の供給停止をするよ
うに、選択的に分周クロック信号CLK1が周辺回路3
に出力される。
【0023】その結果、アイドル状態にある周辺回路を
停止状態にする分、半導体集積回路1′′全体のノイズ
発生量及び消費電力を低減化することができる。
停止状態にする分、半導体集積回路1′′全体のノイズ
発生量及び消費電力を低減化することができる。
【0024】
【発明の効果】以上説明したように、この発明の請求項
1記載の半導体集積回路によれば、MPU内の命令実行
手段により、複数の周辺回路それぞれへのクロック信号
の供給が選択的に停止されるため、周辺回路を停止状態
にする分、ノイズ及び消費電力の低減化を図ることがで
きる。
1記載の半導体集積回路によれば、MPU内の命令実行
手段により、複数の周辺回路それぞれへのクロック信号
の供給が選択的に停止されるため、周辺回路を停止状態
にする分、ノイズ及び消費電力の低減化を図ることがで
きる。
【0025】この発明の請求項2記載の半導体集積回路
によれば、MPU内の命令実行手段により、複数の周辺
回路それぞれが実動作状態あるかアイドル状態にあるか
が検出され、複数の周辺回路のうちアイドル状態にある
周辺回路へのクロック信号の供給が停止されるため、ア
イドル状態の周辺回路を停止状態にする分、ノイズ及び
消費電力の低減化を図ることができる。
によれば、MPU内の命令実行手段により、複数の周辺
回路それぞれが実動作状態あるかアイドル状態にあるか
が検出され、複数の周辺回路のうちアイドル状態にある
周辺回路へのクロック信号の供給が停止されるため、ア
イドル状態の周辺回路を停止状態にする分、ノイズ及び
消費電力の低減化を図ることができる。
【図1】この発明の第1の実施例である半導体集積回路
の構成を示すブロック図である。
の構成を示すブロック図である。
【図2】この発明の第2の実施例である半導体集積回路
の構成を示すブロック図である。
の構成を示すブロック図である。
【図3】従来の半導体集積回路の構成を示すブロック図
である。
である。
【符号の説明】 2′ MPU 2′′ MPU 22 クロック制御部 23 命令実行部 23′ 命令実行部 24 内部レジスタ 31〜33 周辺回路 31′〜33′ 周辺回路 41〜43 ステータスレジスタ
Claims (2)
- 【請求項1】 クロック信号供給機能を備えたMPU
と、 各々が前記クロック信号に同期して動作する複数の周辺
回路とを備え、 前記MPUは、所定のクロック信号選択命令に従い、前
記複数の周辺回路それぞれへの前記クロック信号の供給
を選択的に停止する命令実行手段を備えたことを特徴と
する半導体集積回路。 - 【請求項2】 クロック信号供給機能を備えたMPU
と、 各々が前記クロック信号に同期して動作する複数の周辺
回路とを備え、 前記MPUは、所定の周辺回路状態検出命令に従い、前
記複数の周辺回路それぞれが実動作状態あるかアイドル
状態にあるかを検出し、前記複数の周辺回路のうちアイ
ドル状態にある周辺回路への前記クロック信号の供給を
停止する命令実行手段を備えたことを特徴とする半導体
集積回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4234537A JPH0683616A (ja) | 1992-09-02 | 1992-09-02 | 半導体集積回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4234537A JPH0683616A (ja) | 1992-09-02 | 1992-09-02 | 半導体集積回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0683616A true JPH0683616A (ja) | 1994-03-25 |
Family
ID=16972583
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP4234537A Pending JPH0683616A (ja) | 1992-09-02 | 1992-09-02 | 半導体集積回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0683616A (ja) |
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH1020960A (ja) * | 1996-06-28 | 1998-01-23 | Nec Shizuoka Ltd | クロックパルス供給方式 |
US6211715B1 (en) | 1997-03-31 | 2001-04-03 | Nec Corporation | Semiconductor integrated circuit incorporating therein clock supply circuit |
US7093152B2 (en) | 2001-08-15 | 2006-08-15 | Fujitsu Limited | Semiconductor device with a hardware mechanism for proper clock control |
JP2009017557A (ja) * | 2007-07-02 | 2009-01-22 | Siemens Medical Instruments Pte Ltd | マルチコンポーネント補聴器、マルチコンポーネント補聴器の補聴器部品およびマルチコンポーネント補聴器の駆動方法 |
US8213652B2 (en) | 2007-07-02 | 2012-07-03 | Siemens Medical Instruments Pte. Ltd. | Multi-component hearing aid system and a method for its operation |
-
1992
- 1992-09-02 JP JP4234537A patent/JPH0683616A/ja active Pending
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH1020960A (ja) * | 1996-06-28 | 1998-01-23 | Nec Shizuoka Ltd | クロックパルス供給方式 |
US6211715B1 (en) | 1997-03-31 | 2001-04-03 | Nec Corporation | Semiconductor integrated circuit incorporating therein clock supply circuit |
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JP2009017557A (ja) * | 2007-07-02 | 2009-01-22 | Siemens Medical Instruments Pte Ltd | マルチコンポーネント補聴器、マルチコンポーネント補聴器の補聴器部品およびマルチコンポーネント補聴器の駆動方法 |
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