JPH0680759B2 - チツプオンボ−ドのリ−ドピン - Google Patents

チツプオンボ−ドのリ−ドピン

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JPH0680759B2
JPH0680759B2 JP60232981A JP23298185A JPH0680759B2 JP H0680759 B2 JPH0680759 B2 JP H0680759B2 JP 60232981 A JP60232981 A JP 60232981A JP 23298185 A JP23298185 A JP 23298185A JP H0680759 B2 JPH0680759 B2 JP H0680759B2
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Tanaka Kikinzoku Kogyo KK
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    • H01L23/48Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
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Description

【発明の詳細な説明】 (産業上の利用分野) 本発明は例えばプリント配線基板等に設けられた外部引
出用のリードピンに関するものである。
(従来の技術とその問題点) 従来、この種のチップオンボード(以下ボードとい
う。)に対するリードピンは、上端に円形状の頭部を有
するものと、リードピンの脚杆部の中途部に円形状の鍔
部を有するものとがある。
この脚杆部の中途部に円形状の鍔部を有するリードピン
の固定は、第7図に示す様にボード(A′)に穿設した
取付孔(1′a)内面に銅,金,ニッケルメッキ等のメ
ッキ(1′b)を施して形成されたスルホール部
(1′)に、該スルホール部(1′)の内径よりも小径
な脚杆部(2′)の上部にスルホール部(1′)の内面
と密接合して仮止めをするための楕円形状に圧潰した当
接部(5)側から、ボード(A′)のスルホール部
(1′)下側よりかしめ等の嵌挿手段により嵌挿し、リ
ードピン(B′)の上部周縁及び鍔部(4′)周縁を夫
々別々の作業でボード(A′)に半田付けして固着して
いた。
ところが、これらの固着方法は夫々別々の2工程作業で
固着するため、作業性が劣ると共に上部周縁の半田
(m)に鬆等(m1)が発生し、固着不良のためリードピ
ン(B′)が離脱するおそれがあった。
(発明が解決しようとるする技術的課題) 以上の問題を解決するための本発明の技術的課題は、ボ
ードのスルホール部にリードピンを固定する際に、その
固着作業を能率的にすると共にリードピンを該スルホー
ル部に確実に固着することである。
(技術的課題を達成するための技術的手段) 以上の技術的課題を達成するための本発明の技術的手段
は、脚杆部の上端側に、チップオンボードのスルホール
部内周への当接係合部を形成すると共に、該当接係合部
の下部近辺に、前記スルホール部の内径よりも大径な鍔
部を有し、前記当接係合部をスルホール部内に挿入し、
且つ前記鍔部をスルホール部の開口部に当接せしめた状
態でスルホール部に対して半田付するリードピンであっ
て、上記鍔部に、スルホール部内へ半田液を通す連絡路
を開穿したことを特徴とする。
(作用) 而して上記構成によれば、ボードの下面側を半田液中に
浸漬することにより、半田液がスルホール部とリードピ
ンとの間隙に生じる毛細管現象で鍔部の連通路を介して
該間隙内を上昇して充填され、リードピンの上部周縁及
び鍔部周縁を被覆してスルホール部に固着する。
(発明の効果) 本発明は以上の様な構成にしたことにより下記の効果を
有する。
鍔部の連通路を介して半田がスルホール部とリード
ピンとの間隙に生じる毛細管現象により該間隙に上げら
れてくまなく充填されるので、その接着部における鬆等
の発生を防止することができると共に、リードピンの上
部周縁及び鍔部周縁が基板に半田付けされるのでスルホ
ール部に確実に固着することができる。
一工程でリードピンをスルホール部に固着すること
ができるので作業能率の向上を図ることができる。
(実施例) 以下、本発明の一実施例を図面により説明する。
(A)はプラスチック,ガラス等のボード、(B)はボ
ード(A)のスルホール部(1)に圧入し半田付けする
リードピンである。
ボードにおけるスルホール部(1)はボード(A)に平
面形状が円形の取付孔(1a)を貫通開穿し、その取付孔
(1a)の内面に導電性の高い銅メッキ,金メッキ,ニッ
ケルメッキ等のメッキ(1b)を施して形成されている。
リードピン(B)は鉄とニッケルの合金を素材とし、表
面に錫メッキを施したものでボード(A)のスルホール
部(1)の内径よりも小径な脚杆部(2)の上端側、即
ちスルホール部(1)内に挿入する部分は圧潰してスル
ホール部(1)と略同径の幅寸法を備えた当接係合部
(2b)を形成すると共に、その当接係合部(2b)の下部
近辺には、スルホール部(1)の内径よりも大径な円板
状の鍔部(3)を形成し、脚杆部(2)上端側をボード
(A)下面側からスルホール部(1)内に圧入して当接
係合部(2b)をスルホール部(1)内周に当接係合せし
め、且つ鍔部(3)をスルホール部(1)の下側開口部
(2a)に当接せしめるをもってスルホール部(1)に対
して仮止めし得るように構成する。尚、上記脚杆部
(2)の長さは、その上端側をスルホール部(1)内に
挿入した状態でボード(A)の下面から下方に適宜長さ
突出する長さとする。
また、リードピン(B)における鍔部(3)には、スル
ホール部(1)に連通する連通路(4)が開穿され、該
連通路(4)は第2図及び第4図に示す様に該鍔部
(3)の外周から内周に向って一文字の凹溝(3a)を設
けたものの他、第5図に示す適宜間隔ごとに複数の長溝
孔(3b)を開穿したもの及び適宜大きさの通孔(3c)を
多数設けたもの等があり、ボード(A)を半田液に浸漬
した際に、該半田がこれらの連通路(4)を介してスル
ホール部(1)に通されるものである。
また、これら連通路(4)は上記のものだけに限らず、
スルホール部(1)内に半田を通すことが可能なもので
あれば十文字及び放射状の凹溝を設けることも任意であ
る。
次に、ボード(A)にリードピン(B)に固着する手順
について説明すると、先ずボード(A)のスルホール部
(1)に前述の如く脚杆部(2)上端側をボード(A)
下面側から挿入(圧入)し、且つ鍔部(3)をスルホー
ル部(1)の下側開口部(2a)に当接せしめるをもっ
て、スルホール部(1)に対してリードピン(B)を仮
止めし、しかる後ボード(A)の下側面を半田液(n)
に浸漬する。
半田液(n)としては、例えば4−6半田(鉛4に対し
錫6の割合で混合した半田)を230℃の温度に溶解し、
これに30秒間浸漬する。
このように、半田液(n)に浸漬することにより該半田
液(n)はスルホール部(1)の内面とリードピン
(B)との間に生じる毛細管現象で連通路(4)を介し
てスルホール部(1)とリードピン(B)との間隙を上
昇してスルホール部(1)の上側開口部(2c)からボー
ド(A)上面に流出したリードピン(B)の上部を被覆
して半円形状の頭部を形成すると共に鍔部周縁をも被覆
して基板(A)にリードピン(B)が半田付けされるこ
とになる。
【図面の簡単な説明】
第1図は本発明のリードピンをスルホール部に挿入した
状態の断面図、第2図,第3図は同半田液に浸漬した状
態の断面図、第4図は第2図のIV−IV線断面図、第5
図,第6図は鍔部の他の実施例を示す断面図、第7図は
従来例を示す断面図である。 尚、図中 (A)……回路基板本体、(B)……リードピン (1)……スルホール部、(3)……鍔部 (4)……連通路 を夫々示す。

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】脚杆部の上端側に、チップオンボードのス
    ルホール部内周への当接係合部を形成すると共に、該当
    接係合部の下部近辺に、前記スルホール部の内径よりも
    大径な鍔部を有し、前記当接係合部をスルホール部内に
    挿入し、且つ前記鍔部をスルホール部の開口部に当接せ
    しめた状態でスルホール部に対して半田付するリードピ
    ンであって、上記鍔部に、スルホール部内へ半田液を通
    す連通路を開穿したことを特徴とするチップオンボード
    のリードピン。
JP60232981A 1985-10-17 1985-10-17 チツプオンボ−ドのリ−ドピン Expired - Fee Related JPH0680759B2 (ja)

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0719874B2 (ja) * 1986-05-31 1995-03-06 イビデン株式会社 半導体搭載基板用の導体ピン及びその製造方法
JPH0766953B2 (ja) * 1986-09-11 1995-07-19 イビデン株式会社 半導体搭載用基板
JP2540461B2 (ja) * 1987-05-15 1996-10-02 新光電気工業株式会社 電子部品用パッケ−ジのリ−ド取り付け構造
JPH0815201B2 (ja) * 1987-05-18 1996-02-14 イビデン株式会社 半導体搭載用基板
JPH0815200B2 (ja) * 1987-05-18 1996-02-14 イビデン株式会社 半導体搭載基板用の導体ピン
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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS48104072A (ja) * 1972-04-14 1973-12-26
JPS5982757A (ja) * 1982-11-04 1984-05-12 Toshiba Corp 半導体用ステムおよびその製造方法
US4551914A (en) * 1983-10-05 1985-11-12 Hewlett-Packard Company Method of making flexible circuit connections

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