JPH06118621A - 欠陥のないプリントレチクルおよびその製造方法 - Google Patents

欠陥のないプリントレチクルおよびその製造方法

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JPH06118621A
JPH06118621A JP15346493A JP15346493A JPH06118621A JP H06118621 A JPH06118621 A JP H06118621A JP 15346493 A JP15346493 A JP 15346493A JP 15346493 A JP15346493 A JP 15346493A JP H06118621 A JPH06118621 A JP H06118621A
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phase shift
phase
defect
layer
opaque layer
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JP15346493A
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John L Nistler
ジョーン・エル・ニストラー
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Advanced Micro Devices Inc
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    • GPHYSICS
    • G03PHOTOGRAPHY; CINEMATOGRAPHY; ANALOGOUS TECHNIQUES USING WAVES OTHER THAN OPTICAL WAVES; ELECTROGRAPHY; HOLOGRAPHY
    • G03FPHOTOMECHANICAL PRODUCTION OF TEXTURED OR PATTERNED SURFACES, e.g. FOR PRINTING, FOR PROCESSING OF SEMICONDUCTOR DEVICES; MATERIALS THEREFOR; ORIGINALS THEREFOR; APPARATUS SPECIALLY ADAPTED THEREFOR
    • G03F1/00Originals for photomechanical production of textured or patterned surfaces, e.g., masks, photo-masks, reticles; Mask blanks or pellicles therefor; Containers specially adapted therefor; Preparation thereof
    • G03F1/26Phase shift masks [PSM]; PSM blanks; Preparation thereof
    • GPHYSICS
    • G03PHOTOGRAPHY; CINEMATOGRAPHY; ANALOGOUS TECHNIQUES USING WAVES OTHER THAN OPTICAL WAVES; ELECTROGRAPHY; HOLOGRAPHY
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    • G03F1/72Repair or correction of mask defects

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  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Preparing Plates And Mask In Photomechanical Process (AREA)
  • Exposure And Positioning Against Photoresist Photosensitive Materials (AREA)

Abstract

(57)【要約】 【目的】 ICウェハのフォトリソグラフィ処理で使わ
れるレチクルを製造する方法を提供する。 【構成】 欠陥ボーティング技術を利用する最適化され
たレイアウトの組合せ、およびエッチングされた石英の
アプローチは、欠陥のないプリントマスク、またはレチ
クル10を高い確率で得るために利用される。この欠陥
ボーティング技術は、それにより多数のパターンにその
都度部分的なエッチングをするような方法で載せられる
技術に言及している。位相シフタの層は、レチクルから
半導体ウェハへの欠陥印刷可能性を減じる。SPLAT
を利用するモデル化は、ボーティング技術を利用する欠
陥16、20、24の印刷の可能性と一緒に、欠陥印刷
可能性上の位相遷移の結果を示す。したがって、マスク
の欠陥があるかもしれないときは、これらの欠陥はウェ
ハに印刷されない。

Description

【発明の詳細な説明】
【0001】
【技術分野】この発明は一般的に、集積回路(IC)の
製造に用いられるリソグラフィの技術に関し、より特定
的には、半導体ウェハを処理するためフォトリソグラフ
ィにおいて利用されるレチクルマスクの製造に関する。
【0002】
【背景技術】位相シフトマスク技術のアプローチは、文
献で徹底的に論じられてきた。最初の研究は、M.D.
レヴェンソン(M.D.Levenson)らにより始められ、
電子装置に関するIEEE議事録、ED−29巻、12
号、1828ないし1836頁に記載の、「位相シフテ
ィングマスクを用いたフォトリソグラフィにおける解像
度の改良(Improving Resolution in Photolithography
with a Phase-Shifting Mask )」(1982年12
月)である。様々な設計および方法の発展は、材料およ
びポジ型またはネガ型の設計レイアウトのアプローチの
広い範囲にわたって論議されてきた。様々なアプローチ
の長所および欠点は、表1に要約される。表2は、ポジ
型(ライトフィールド)レイアウトと、ネガ型またはダ
ークフィールドレイアウトとの長所および欠点を識別す
る。
【0003】
【表1】
【0004】
【表2】
【0005】実質上欠陥のないマスクを製造する方法を
設ける必要が残る。この中で使われているように、「欠
陥のない」という用語は、マスクまたはレチクル上の実
際の欠陥が半導体ウェハに欠陥として印刷される、可能
性が低いことを示す。
【0006】
【発明の開示】この発明によると、欠陥ボーティング技
術およびエッチングされた石英のアプローチを利用する
最適化されたレイアウトの組合せが、欠陥のないプリン
トレチクルを得る可能性を高くするのに使われる。ここ
で利用されるような欠陥ボーティング技術とは、複数の
パターンが、その都度部分的なエッチングをするような
方法で載せられる技術をさす。
【0007】位相シフタの層のボーティングは、レチク
ルから半導体ウェハへの欠陥印刷の可能性を減じる。S
PLATを利用するモデル化は、ボーティング技術を利
用しての欠陥の印刷可能性と一緒に、欠陥の印刷に対す
る位相の遷移の効果を示す。
【0008】欠陥のないプリントレチクルを製造するた
めの、この発明の方法は、(a)透明な基板の主表面上
に不透明な層を形成するステップと、(b)不透明な層
をパターニングして、下にある透明な基板部分を露出す
るステップと、(c)位相シフトマスクの層を形成し
て、下にある透明な基板部分を露出するステップと、
(d)予め選択された位相シフトの角度と等価な量だ
け、透明な基板の露出部分を途中まで位相エッチングす
るステップと、(e)全180°の位相シフトが達成さ
れるまで、各々が位相シフトの角度に等しい一連のステ
ップにおいて、位相シフトマスクの層をボーティングし
て、位相エッチングを達成するステップとを含み、それ
により、レチクルの露出部分で複製されるいかなる位相
の欠陥も、半導体ウェハ上に印刷できない。
【0009】この発明の他の目的、特徴、および利点
は、以下の詳細な記述および添付図面を考慮すれば明ら
かとなり、その中で、同じ参照符号は、図を通じて同じ
特徴を表わす。
【0010】
【発明の実施のための最良の態様】ここではこの発明の
特定の実施例について詳細に言及し、それは、この発明
を実行するため発明者により現在考えられる最良の態様
を示す。代わりとなり得る実施例もまた、適用可能なも
のとして、簡単に述べられる。
【0011】
【アプローチの定義】AMDリソドライバ位相1電気テ
ストチップ(AMD Litho Driver Phase 1 Electrical Te
st Chip )は、180°/120°/60°/0°の遷
移でポジ型レイアウトを利用するよう設計された。この
レイアウトは120°のレイアウト上に60°のレイア
ウトを重ね、180°のレイアウト上に120°のレイ
アウトを重ねるという、独特な設計がされた。この設計
アプローチは、ボーティングの利用を可能にし、位相遷
移欠陥印刷性を減少させる。120°のパターンは、元
の180°のパターンに付加的領域を加えたものを含む
ので、180°と120°との間での位相遷移が起こ
る。同様に、60°のパターンは、前のパターンに付加
的領域を加えたものを含むので、120°と60°との
間の位相遷移が起こり、以下についても同様である。
【0012】位相の層をボーティングするのは、位相エ
ッチングが段階的に(たとえば1回に60°)において
なされる場合の技術である。いくつかの方法において、
マスクは位相エッチングのステップ間で清浄にされる
が、好ましくは、その都度完全なフォトプロセスがなさ
れる。いずれの場合にも、3つのステップのいずれかで
位相の層のエッチングを妨げる欠陥は、清浄プロセスに
おいて除去される。このように、レジストパターニング
においてのピンホールまたは欠陥により起こり得るのは
たった60°の(またはより少ない)位相の誤差だけで
ある。結果として、これらの位相の誤差または欠陥は、
半導体ウェハへ印刷される可能性が低いだろう。
【0013】図1は、この発明の方法を実施する場合の
流れを表わす。マスク10は、石英基板14上に形成さ
れたパターニングクロム層12を含む。これは、一度に
60°の位相角度ステップへと位相エッチングし、かつ
後に石英に欠陥を生じるかもしれない表面の粒子をさら
に減じるため各々のレベルでさらに清浄ステップを導入
することにより生じる。クロム層12の形成および石英
基板14上でのその厚さならびにクロム層のパターニン
グは従来のものであり、したがって、この発明の一部を
形成しない。同様に、石英エッチングの手順および用い
られたエッチャントは従来どおりであり、この発明の一
部を形成しない。
【0014】いかなる不透明な材料も、層12のクロム
の代わりに用いられ得る。例として、(可視光リソグラ
フィのための)金、モリブデン、ポリシリコン、(X線
リソグラフィのための)炭化ケイ素、(遠UVリソグラ
フィのための)窒化ケイ素、酸化チタン、酸化セレンが
ある。
【0015】シリカベースのガラスのようないかなる透
明な基板14も、石英に代わって用いられ得る。
【0016】以下の論議は、3つの個別の60°の位相
エッチングに関して提示される。しかしながら、この発
明は4つの45°の位相エッチング、6つの30°の位
相エッチング等のような、複数の位相エッチングに等し
く適用できる。
【0017】図1(A)は、石英基板14上に形成され
る修復されたクロム層12を表わし、クロム層は従来ど
おりにパターニングされる。図1(B)は、60°の石
英位相エッチング部分をブロックして支柱16を残す、
欠陥16を示す。図1(C)では、清浄ステップが第2
のレベルの処理に先立ってなされ、それは欠陥16を除
去する。図1(D)は、新しい欠陥20を示し、それは
第2の60°の石英エッチングをブロックし、さらなる
支柱22を残す。支柱18は通常、元の高さから減じら
れ、エッチングされた穴においてより深く複製される。
欠陥16が除去されていないとすれば、支柱の高さが第
2のエッチングで増加していたであろうということが認
識されるだろう。
【0018】図1(E)では、第3のレベルの処理に先
立って別の清浄ステップがなされ、それは欠陥20を除
去する。図1(F)は、さらに別の欠陥24を示し、そ
れは第3の60°の石英エッチングをブロックして、支
柱26を残す。大抵の位相シフトマスクにはクロム層が
残るが、それは180°ないし0°の位相の遷移を利用
して細いラインを印刷する場合等には、除去され得る。
図1(G)に示されるように、以下の最終清浄に見られ
るのはたった60°の(またはより少ない)位相の誤差
のみである。この発明によるプロセスなしでは、180
°、120°、および60°の位相の誤差が得られ、こ
れらの位相の誤差がウェハ上に印刷される可能性は、か
なり増すだろう。
【0019】石英基板14の場合において水酸化ナトリ
ウムの水溶液を用いるような、最終的なウエットエッチ
ングは、クロム層12をアンダカットし、かつ60°の
支柱の高さを減じるのに利用される。クロム層のアンダ
カットは、隣接する隙間の反射された強度同士が相互作
用して結合するため、エッチングされた石英の領域の強
度損失を減少させる。
【0020】位相シフトされたマスクを設計するため
に、複数のアプローチが存在する。最初の、そしてしば
しば最も簡単と考えられるアプローチは、クロムが位相
の遷移を終わらせるのに利用される、ネガ型またはダー
クフィールドレイアウトである。このアプローチは、2
つの理由によりとられなかった。第1に、ネガ型G線お
よびI線レジストが要求されることがある。これは、主
としてポジ型レジストを利用するIC製造ラインからか
なりの抵抗にあうだろう。第2に、通常誤解されるの
が、位相の遷移についての問題が生じないだろうという
ことである。しかしながら、メモリおよび論理デバイス
上で、ポリシリコンおよび金属のレイアウトを評価する
場合、位相の遷移についての問題が生じるということが
わかった。特に、要求される位相の遷移数は減じられた
が、除去されたのではない。したがって、レチクルを組
立てる複雑さは同じであるように思われる。
【0021】おおいに注目を集めている第2のアプロー
チは、「クロムなし」アプローチで、それは興味深いア
プローチであり、評価されているが、現在プレートを生
産するのにクロムなしアプローチを利用することを妨げ
る、いくつかの装備および処理制限がある。このアプロ
ーチは、k1 =0.4未満の解像度で長所を持つであろ
うし、k1 ≒0.24のジオメトリでうまくプリントさ
れるであろう。量k1は、式R=k1 λ/NAの中で
用いられ、そこではRはリソグラフィのプロセスの解像
度であり、λは波長であり、NAは開口率であり、かつ
1 は、このプロセス、材料、レジスト等に依存する修
正ファクタである。
【0022】第3の、そしてこの発明の実行において行
なわれるアプローチは、ポジ型またはブライトフィール
ドのレイアウトマスクである。このアプローチでは、3
の基礎となる技術が利用され得る。第1の技術では、2
40°/120°/0°の位相シフトレイアウトは、ソ
ース/ドレインまたはLOCOSレベルのために調査さ
れており、それはそのレベルに関連する不規則な構造物
によるものであるが、120°ないし0°の遷移の印刷
の確率が高いため、レイアウトにおいて注意が払われね
ばならない。上に述べたように、0焦点での120°な
いし0°の遷移は、70%の強度ディップを有する。第
2の技術は、180°/90°/0°のレイアウトの利
用を伴うが、40%の強度ディップが、3つの波長全
部、つまり436、365、および248nmで印刷を
行なうので、それはここでは利用されない。第3のそし
てこの発明の実行において用いられる技術は、180°
/120°/60°/0°の遷移を伴うが、それは遷移
印刷の可能性を除去する力が十分にあり、かつレチクル
の多層処理と関連する複雑さのために、180°/15
0°/120°/90°/60°/30°/0°の遷移
よりも好まれて利用される。
【0023】G線(436nm)、開口率(NA)=
0.38および0.58の部分的コヒーレンス(σ)に
ついて、非位相シフトと120°および180°の交互
位相シフトとのアプローチでのコントラスト、すなわち
I(max)−I(min)をプロットすることで、
(使用されたモデルにより)以下のことが明らかとな
る。k1 の大きい値または0.9μmより大きな線幅で
は、非位相シフトの場合に比べて120°又は180°
のいずれかの位相シフトの改良は示されない。部分的コ
ヒーレンスは、ウェハステッパと関連する投影光学系に
おける、レンズの光受容円錐に関するコンデンサの隙間
の充填比率である。
【0024】
【位相シフトマスクのためのマスク製造プロセス】レチ
クルは、ETECのアライメントアルゴリズムを利用す
る、MEBESIIIマシンでの従来のCALMA G
DSファイルを用いて生成された。現在のプロセス
は、、石英基板14を位相シフトの手段として定義付け
る、石英の厚みをエッチングによって減じる技術を利用
する。このアプローチは、図2に示され、そこでは主要
なステップは、第1のエッチング位相シフタの層のため
に略図として描かれている。
【0025】図2(A)に示されるように、マスク製造
プロセスは、石英ブランク14に始まり、その上にポリ
ブチルスチレン(PBS)28の層でコーティングした
クロム層12が形成される。PBSのEビームレジスト
28はパターニングされて現像される。図2(B)は、
ここではウエットエッチングによりクロム層12へと転
写される、PBSの層28のパターンを示す。従来のウ
エットエッチャントが用いられる。マスク10は、ここ
では検査され、あるいは修復され得る。
【0026】次に、図2(C)に示されるように、金
(Au)の薄い層(図示せず)が電荷の消散のため堆積
され、ポジ型フォトレジストの層30が与えられ、露光
され、現像されて、「位相エッチングされる」パターン
の特徴を明らかにし、その一方で「非位相の」他の特徴
を保護する。
【0027】Auの薄い層は、スパッタエッチングさ
れ、それに続いて特定の位相の深さへの、石英14の反
応イオンエッチングが行なわれる。結果として生じる構
造は、図2(D)に示される。
【0028】次に、第2のレベルのレジスト30ははが
されて、そのプロセスが何度も繰返されるか、またはレ
チクル10が最終検査を受けることとなる。結果として
生じる構造物は、図2(E)に示される。
【0029】
【理論上の欠陥印刷可能性】ウェハの印刷可能性に悪影
響を与える3つの基本タイプの欠陥は、位相シフトされ
たレチクル上で生じ得る。第1の組の欠陥は、位相シフ
トの欠陥としてか、クロム印刷の欠陥としてかのどちら
かで転写される従来のクロムの欠陥である。第2の組の
欠陥は、位相遷移に関し、他で記載されている。たとえ
ば、S.K.ダンブラック(S.K.Dunbrack)らの、
SPIE1464巻314ないし316頁に記載の、
「位相シフトマスク技術:Eビームマスクリソグラフィ
のための要件(Phase-shift Mask Technology : Requir
ements for E-beam Mask Lithography)」(1991
年)を参照されたい。位相の欠陥により生じる、第3の
組の欠陥が、ここで論議されるだろう。他のレイアウト
により得られる180°の欠陥に対する、このレイアウ
トで起こり得る60°の欠陥の理論上の可能性につい
て、比較がなされる。
【0030】関係のある基本的領域の1つは、ポリシリ
コンおよび金属等の臨界レベルのためのウェハの臨界寸
法(C.D.)制御への位相欠陥の影響と欠陥印刷によ
ってウェハ上で起こり得るブリッジまたは短絡問題であ
ろう。0.36μmラインスペース(L/S)パターン
のためのC.D.制御の結果は、I線、NA=0.48
およびσ=0.38用にシミュレートされた。(欠陥印
刷の可能性は、部分的コヒーレンスσが減少するにつれ
増加する。)0.36×0.3μm2 の欠陥が、交互位
相シフトアプローチのゼロ位相領域にかけて置かれるな
らば、もっと悪い場合の、0.8μmデフォーカスでの
C.D.制御のシミュレーションは、60°、120
°、および180°の位相の欠陥に対して行なわれるか
もしれない。180°の位相が、完全な短絡を起こすと
いうことが判断される。120°のC/D.変化は、受
容されないだろうし、60°では±10%C.D.制御
で受容できることがわかる。したがって、C.D.制御
に対する、焦点の有効な深さは、「大きな」位相の欠陥
に対して約1.6μmとなることが期待される。
【0031】0.1×0.1μm2 欠陥のように、より
小さな欠陥が得られるなら、シミュレーションの結果、
1.6μmの有効焦点深度では、生じるであろう最大ス
ペースC.D.変化は、以下のようになることが示され
る。
【0032】a)60°の位相の欠陥に対し6.8%、 b)120°の位相の欠陥に対し17.0%、および c)180°の位相の欠陥に対し20%。
【0033】したがって、60°の位相の欠陥に対する
C.D.制御の結果は、180°の位相の欠陥の結果の
約3分の1である。
【0034】興味深い第2の点は、オープンフィールド
エリアでの、60°、120°、および180°の欠陥
の印刷可能性である。0.8μmデフォーカスでの、大
きな0.52×0.52μm2 欠陥に対する60°、1
20°、180°の位相の欠陥の印刷可能性は、この発
明のプロセスを利用して得られる最悪の場合の状態と見
なされるものであり、60°ではまだ、ウェハ上で約
0.4×0.4μm2 領域の単一の欠陥として印刷され
ることが明らかである。
【0035】欠陥の印刷可能性への部分的コヒーレンス
の影響を示すため、60°の0.52×0.52μm2
欠陥は、部分的コヒーレンス、σ=0.62のためシミ
ュレートされる。この例では、欠陥のプリントはないだ
ろう。
【0036】
【産業上の利用可能性】この発明のプロセスは、ICウ
ェハのフォトリソグラフィ処理で利用されるレチクル製
造に利用できると期待されている。
【0037】前述の、この発明の好ましい実施例の記載
は、図示および記載の目的で提示された。それは余すと
ころないわけではないことが意図され、またこの発明
が、開示されたのと寸分違わない形態に限定されること
が意図されるのではない。明らかに、多くの修正および
変形は、当業者に対し明白となるだろう。この発明が、
MOSまたはバイポーラ方法において、他の製造技術に
より実施されることもあり得る。同様に、記載されるい
かなる方法のステップも、同じ結果に達するために他の
ステップと交換可能であるかもしれない。実施例は、こ
の発明の原則と、その実際の適用について、最良の説明
をするために選択され、記載されたのであり、それによ
り、他の当業者が予期される特定の利用法に適合するよ
う、発明の様々な実施例、および様々な修正を理解でき
るようにする。この発明の範囲は、前掲の特許請求の範
囲およびその均等物により、定義されることが意図され
る。
【0038】この記述において言及される図は、特に記
される以外は、尺度決めされて描かれないものとして理
解されるべきである。さらに、図面はこの発明に従う製
造されたレチクルの一部のみを図示することが意図され
る。
【図面の簡単な説明】
【図1】ボーティング技術が、いかに効果的に、多層位
相エッチングアプローチにより製造プロセスにおいて生
成される欠陥の影響を減じるかを示す、この発明による
方法で利用されるステップの流れを図示する図である。
【図2】石英基板の減少パターニングを伴う、この発明
の位相シフトマスク製造方法における必須のステップの
シーケンスを図示する図である。
【符号の説明】
10 マスク 12 層 14 基板

Claims (21)

    【特許請求の範囲】
  1. 【請求項1】 欠陥のないプリントレチクルの製造方法
    であって、 (a)透明な基板の主表面上に、不透明な層を形成する
    ステップと、 (b)前記不透明な層をパターニングして、前記下にあ
    る透明な基板部分を露出するステップと、 (c)前記下にある透明な基板の前記部分を露出する位
    相シフトマスクの層を形成するステップと、 (d)前記透明な基板の前記露出部分を予め選択された
    位相シフトの角度と等しい量だけ、途中まで位相エッチ
    ングするステップと、 (e)全180°の位相シフトが達成されるまで、各々
    が前記位相シフトの角度に等しい一連のステップにおい
    て、前記位相シフトマスクの層をボーティングして、前
    記位相エッチングを達成するステップとを含む方法であ
    って、 前記レチクルの前記露出部分で複製されるいかなる位相
    の欠陥も、半導体ウェハ上に印刷されない、方法。
  2. 【請求項2】 前記不透明な層が、クロム、モリブデ
    ン、ポリシリコン、金、炭化ケイ素、窒化ケイ素、酸化
    チタン、および酸化セレンからなる群から選択される、
    請求項1に記載の方法。
  3. 【請求項3】 前記透明な基板が石英を含む、請求項1
    に記載の方法。
  4. 【請求項4】 全180°の位相シフトの達成に続い
    て、前記透明な基板が、ウエットエッチングのために露
    出され、前記不透明な層をアンダカットして、いかなる
    位相の欠陥の柱の高さをも減じる、請求項1に記載の方
    法。
  5. 【請求項5】 前記予め選択された位相シフトの角度が
    約60°である、請求項1に記載の方法。
  6. 【請求項6】 前記ボーティングが、180°/120
    °/60°/0°のレイアウトにより生成される、請求
    項5に記載の方法。
  7. 【請求項7】 前記予め選択された位相シフトの角度が
    約45°である、請求項1に記載の方法。
  8. 【請求項8】 前記ボーティングが、180°/135
    °/90°/45°/0°のレイアウトにより生成され
    る、請求項7に記載の方法。
  9. 【請求項9】 前記予め選択された位相シフトの角度が
    約30°である、請求項1に記載の方法。
  10. 【請求項10】 前記ボーティングが、180°/15
    0°/120°/90°/60°/30°/0°のレイ
    アウトにより生成される、請求項9に記載の方法。
  11. 【請求項11】 請求項1に記載の方法により製造され
    る、欠陥のないプリントレチクル。
  12. 【請求項12】 欠陥のないプリントレチクルを製造す
    る方法であって、 (a)石英基板の主表面上に不透明な層を形成するステ
    ップと、 (b)前記不透明な層に、フォトレジストコーティング
    を適用するステップと、 (c)前記フォトレジストの層をパターニングし、それ
    を現像し、かつそれをエッチングして、前記下にある不
    透明な層の部分を露出するステップと、 (d)前記下にある不透明な層の前記露出部分を介して
    エッチングし、下にある前記石英基板の部分を露出する
    ステップと、 (e)残りのフォトレジストを除去するステップと、 (f)前記石英基板の前記主表面を、フォトレジストで
    再コーティングするステップと、 (g)前記フォトレジストをパターニングして、位相シ
    フトマスクの層を形成し、前記フォトレジストを現像し
    て、前記下にある石英基板の前記部分を露出するステッ
    プと、 (h)予め選択された位相シフトの角度と等しい量だ
    け、前記石英基板の前記露出部分を途中までエッチング
    するステップと、 (i)前記フォトレジストを除去するステップと、 (j)全180°の位相シフトが達成されるまで、前記
    石英基板の同じ部分に関して(f)ないし(i)のステ
    ップを繰返すステップとを含む方法であって、 前記レチクルの前記露出部分において複製されるいかな
    る位相の欠陥も、半導体ウェハ上に印刷されない、方
    法。
  13. 【請求項13】 前記不透明な層が、クロム、モリブデ
    ン、ポリシリコン、金、炭化ケイ素、窒化ケイ素、酸化
    チタンおよび酸化セレンからなる群から選択される、請
    求項12に記載の方法。
  14. 【請求項14】 全180°の位相シフトの達成に続い
    て、前記石英基板が、ウエットエッチングのために露出
    され、前記不透明な層をアンダカットして、いかなる位
    相の欠陥の柱の高さをも減じる、請求項12に記載の方
    法。
  15. 【請求項15】 前記予め選択された位相シフトの角度
    が約60°である、請求項12に記載の方法。
  16. 【請求項16】 前記全位相シフトが、180°/12
    0°/60°/0°のレイアウトにより生成される、請
    求項15に記載の方法。
  17. 【請求項17】 前記予め選択された位相シフトの角度
    が約45°である、請求項12に記載の方法。
  18. 【請求項18】 前記全位相シフトが、180°/13
    5°/90°/45°/0°のレイアウトにより生成さ
    れる、請求項17に記載の方法。
  19. 【請求項19】 前記予め選択された位相シフトの角度
    が約30°である、請求項12に記載の方法。
  20. 【請求項20】 前記全位相シフトが、180°/15
    0°/120°/90°/60°/30°/0°のレイ
    アウトにより生成される、請求項19に記載の方法。
  21. 【請求項21】 請求項12に記載の方法により製造さ
    れる、欠陥のないレチクル。
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Families Citing this family (27)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5672450A (en) * 1994-05-11 1997-09-30 Micron Technology, Inc. Method of phase shift mask fabrication comprising a tapered edge and phase conflict resolution
US5573890A (en) * 1994-07-18 1996-11-12 Advanced Micro Devices, Inc. Method of optical lithography using phase shift masking
US5686208A (en) * 1995-12-04 1997-11-11 Micron Technology, Inc. Process for generating a phase level of an alternating aperture phase shifting mask
US5695896A (en) * 1995-12-04 1997-12-09 Micron Technology, Inc. Process for fabricating a phase shifting mask
US5851734A (en) * 1996-03-26 1998-12-22 Micron Technology, Inc. Process for defining resist patterns
US5801954A (en) * 1996-04-24 1998-09-01 Micron Technology, Inc. Process for designing and checking a mask layout
US5876878A (en) * 1996-07-15 1999-03-02 Micron Technology, Inc. Phase shifting mask and process for forming comprising a phase shift layer for shifting two wavelengths of light
US5885734A (en) * 1996-08-15 1999-03-23 Micron Technology, Inc. Process for modifying a hierarchical mask layout
US5942355A (en) * 1996-09-04 1999-08-24 Micron Technology, Inc. Method of fabricating a phase-shifting semiconductor photomask
US5851704A (en) * 1996-12-09 1998-12-22 Micron Technology, Inc. Method and apparatus for the fabrication of semiconductor photomask
US5840448A (en) * 1996-12-31 1998-11-24 Intel Corporation Phase shifting mask having a phase shift that minimizes critical dimension sensitivity to manufacturing and process variance
JPH10256394A (ja) 1997-03-12 1998-09-25 Internatl Business Mach Corp <Ibm> 半導体構造体およびデバイス
US5948571A (en) * 1997-03-12 1999-09-07 International Business Machines Corporation Asymmetrical resist sidewall
US5759724A (en) * 1997-03-31 1998-06-02 Micron Technology, Inc. Method for making multi-phase, phase shifting masks
US5985492A (en) * 1998-01-22 1999-11-16 International Business Machines Corporation Multi-phase mask
US6103429A (en) * 1998-09-28 2000-08-15 Intel Corporation Technique for fabricating phase shift masks using self-aligned spacer formation
US6277527B1 (en) 1999-04-29 2001-08-21 International Business Machines Corporation Method of making a twin alternating phase shift mask
US6368516B1 (en) * 1999-06-24 2002-04-09 Infineon Technologies North America Corp. Semiconductor manufacturing methods
US6410191B1 (en) 1999-06-25 2002-06-25 Advanced Micro Devices, Inc. Phase-shift photomask for patterning high density features
US6562521B1 (en) * 1999-06-25 2003-05-13 Advanced Micro Devices, Inc. Semiconductor feature having support islands
US6428936B1 (en) 1999-12-16 2002-08-06 Intel Corporation Method and apparatus that compensates for phase shift mask manufacturing defects
US6701004B1 (en) * 1999-12-22 2004-03-02 Intel Corporation Detecting defects on photomasks
US6582856B1 (en) * 2000-02-28 2003-06-24 Chartered Semiconductor Manufacturing Ltd. Simplified method of fabricating a rim phase shift mask
US6513151B1 (en) * 2000-09-14 2003-01-28 Advanced Micro Devices, Inc. Full flow focus exposure matrix analysis and electrical testing for new product mask evaluation
US6535280B1 (en) * 2001-08-31 2003-03-18 Advanced Micro Devices, Inc. Phase-shift-moiré focus monitor
US7448012B1 (en) 2004-04-21 2008-11-04 Qi-De Qian Methods and system for improving integrated circuit layout
US8753974B2 (en) * 2007-06-20 2014-06-17 Micron Technology, Inc. Charge dissipation of cavities

Family Cites Families (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4124473A (en) * 1977-06-17 1978-11-07 Rca Corporation Fabrication of multi-level relief patterns in a substrate
US4579812A (en) * 1984-02-03 1986-04-01 Advanced Micro Devices, Inc. Process for forming slots of different types in self-aligned relationship using a latent image mask
JP2710967B2 (ja) * 1988-11-22 1998-02-10 株式会社日立製作所 集積回路装置の製造方法
US5194346A (en) * 1991-04-15 1993-03-16 Micron Technology, Inc. Method of fabricating phase shifting reticles with an accurate phase shift layer
US5194345A (en) * 1991-05-14 1993-03-16 Micron Technology, Inc. Method of fabricating phase shift reticles

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