JPH0591186A - Bit error rate measurement system - Google Patents
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Abstract
Description
【０００１】[0001]
【産業上の利用分野】本発明はビットエラ−率測定方式
に係わり、特に伝送速度が６４Ｋｂｐｓのロ−カル交換
局に収容されているＩＳＤＮ加入者線におけるビットエ
ラ−率を集中保守局で監視する通信システムにおけるビ
ットエラ−率測定方式に関する。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a bit error rate measuring method, and more particularly, to a communication for monitoring a bit error rate in an ISDN subscriber line accommodated in a local exchange station having a transmission rate of 64 Kbps by a central maintenance station. The present invention relates to a bit error rate measuring method in a system.
【０００２】[0002]
【従来の技術】ＩＳＤＮ（サ−ビス総合デジタル網）の
ＩＳＤＮ加入者線は２線式デジタル加入者線であり、約
３００Ｋｂｐｓのデジタル信号が伝送されている。この
デジタル信号は雷の発生、信号路の切断等により、デー
タが「１」→「０」，「０」→「１」と変化する伝送エ
ラ−が発生し、伝送品質を低下させる。このため、ＩＳ
ＤＮ交換機は、ビットエラ−率を測定し、該ビットエラ
−率に基づいて伝送品質をチェックし、伝送品質が悪い
場合には、予備の回線に切り換えるようにしている。2. Description of the Related Art The ISDN subscriber line of ISDN (Service Integrated Digital Network) is a two-line digital subscriber line, and a digital signal of about 300 Kbps is transmitted. This digital signal causes a transmission error in which the data changes from “1” → “0” and “0” → “1” due to the occurrence of lightning, disconnection of the signal path, etc., and the transmission quality is degraded. Therefore, IS
The DN switch measures the bit error rate, checks the transmission quality based on the bit error rate, and switches to the backup line if the transmission quality is poor.
【０００３】図６はビットエラ−測定器を、デジタル加
入者線を収容しているＩＳＤＮ交換機に設けた従来の構
成図であり、１はＩＳＤＮ電話端末、２は網終端装置
（ＮＴＥ）、３はデジタル加入者線、４はＩＳＤＮ交換
機、５は中継線（ＰＣＭ伝送路）である。ＩＳＤＮ交換
機４において、４ａはデジタル加入者線回路（ＤＬ
Ｃ）、４ｂはネットワ−ク（ＮＷ）、４ｃはデジタルタ
−ミナル（ＤＴ）、４ｄはビットエラ−測定器である。
このように、ビットエラ−率の測定をデジタル加入者線
３を収容しているＩＳＤＮ交換機４内で行なう場合に
は、交換機内では６４Ｋｂｐｓ信号をビットエラ−測定
器４ｄに流すことができるため、なんら問題なくビット
エラ−率を測定することができる。FIG. 6 is a conventional configuration diagram in which a bit error measuring device is provided in an ISDN exchange accommodating a digital subscriber line. 1 is an ISDN telephone terminal, 2 is a network terminating equipment (NTE), and 3 is The digital subscriber line, 4 is an ISDN exchange, and 5 is a relay line (PCM transmission line). In the ISDN exchange 4, 4a is a digital subscriber line circuit (DL).
C), 4b is a network (NW), 4c is a digital terminal (DT), and 4d is a bit error measuring device.
As described above, when the bit error rate is measured in the ISDN exchange 4 accommodating the digital subscriber line 3, a 64 Kbps signal can be sent to the bit error measuring device 4d in the exchange, which causes no problem. The bit error rate can be measured without any error.
【０００４】ところで、ロ−カル交換局の保守を集中し
て行なう集中保守局からビットエラ−率の測定を遠隔操
作で行なう場合がある。図７は、かかる集中保守局を含
む通信システムの構成図であり、１はＩＳＤＮ電話端
末、２は網終端装置（ＮＴＥ）、３はデジタル加入者
線、４はＩＳＤＮ交換機であるロ−カル交換局（ＬＳ
局：Local Switch 局)、５は中継線（ＰＣＭ伝送路）、
６はＬＳ局の保守を集中的に行なう集中保守局（ＣＭＯ
Ｃ局：Centralized Maintenance & Operation Center
局)である。ＩＳＤＮ交換機４において、４ａはデジタ
ル加入者線回路（ＤＬＣ）、４ｂはネットワ−ク（Ｎ
Ｗ）、４ｃはデジタルタ−ミナル（ＤＴ）であり、集中
保守局６において６ａはデジタルタ−ミナル（ＤＴ）、
６ｂはネットワ−ク（ＮＷ）、６ｃはビットエラ−測定
器である。デジタル交換機は６４Ｋｂｐｓで信号処理を
行なっているが、ＰＣＭ伝送路はＰＣＭ２４Ｂ方式また
はＰＣＭ３０Ｂ方式で多重伝送する。By the way, there is a case where the bit error rate is measured by remote control from a central maintenance station which centrally maintains the local exchange stations. FIG. 7 is a block diagram of a communication system including such a central maintenance station. 1 is an ISDN telephone terminal, 2 is a network terminating device (NTE), 3 is a digital subscriber line, and 4 is a local exchange which is an ISDN exchange. Station (LS
Station: Local Switch station, 5 is a relay line (PCM transmission line),
6 is a central maintenance station (CMO) that centrally maintains LS stations.
Station C: Centralized Maintenance & Operation Center
Bureau). In the ISDN exchange 4, 4a is a digital subscriber line circuit (DLC) and 4b is a network (N).
W), 4c are digital terminals (DT), and 6a is a digital terminal (DT) in the central maintenance station 6.
6b is a network (NW), and 6c is a bit error measuring device. Although the digital exchange performs signal processing at 64 Kbps, the PCM transmission line performs multiplex transmission by the PCM 24B system or the PCM 30B system.
【０００５】ＰＣＭ３０方式は、図８に示すように、１
フレ−ム（＝１２５μｓ）を３２タイムスロットに時分
割し、ＴＳ１〜ＴＳ１５、ＴＳ１７〜ＴＳ３１の３０個
のタイムスロットに所定チャンネルの８ビット音声デ−
タやデジタルデータを割り当てて時分割多重伝送するも
のである。尚、チャンネル毎の伝送速度は６４Ｋｂｐｓ
であり、タイムスロットＴＳ０はメインテナンス信号
用、タイムスロットＴＳ１６は監視信号用である。The PCM30 system, as shown in FIG.
The frame (= 125 μs) is time-divided into 32 time slots, and an 8-bit audio data of a predetermined channel is provided in 30 time slots of TS1 to TS15 and TS17 to TS31.
Data and digital data are allocated and time-division multiplex transmission is performed. The transmission rate for each channel is 64 Kbps.
The time slot TS0 is for the maintenance signal and the time slot TS16 is for the supervisory signal.
【０００６】従って、ＰＣＭ３０方式でロ−カル局４か
ら集中保守局６にＰＣＭ多重伝送する場合には、集中保
守局６のビットエラ−測定器６ｃに８ビットデ−タをそ
のまま入力できる、ビットエラ−測定上問題はない。Therefore, when PCM multiplex transmission is performed from the local station 4 to the central maintenance station 6 by the PCM30 system, 8-bit data can be directly input to the bit error measuring device 6c of the central maintenance station 6, which is a bit error measurement. There is no problem on the top.
【０００７】[0007]
【発明が解決しようとする課題】しかし、ロ−カル局４
から集中保守局６にＰＣＭ２４Ｂ方式で多重伝送する場
合に以下の問題が生じる。すなわち、図９に示すよう
に、ＰＣＭ２４Ｂ方式では、１フレ−ムを２４タイムス
ロットに時分割し、各タイムスロットＴＳ０〜ＴＳ２３
に所定チャンネルの８ビット音声デ−タやデジタルデー
タを割り当てて時分割多重伝送する。従って、ＰＣＭ３
０方式と同様に、チャンネル毎の伝送速度は６４Ｋｂｐ
ｓであり、１つのタイムスロットに８ビットデ−タが入
る。However, the local station 4
When the PCM24B method is used for multiplex transmission from the central maintenance station 6 to the central maintenance station 6, the following problems occur. That is, as shown in FIG. 9, in the PCM24B system, one frame is time-divided into 24 time slots, and each time slot TS0 to TS23.
8 bit audio data or digital data of a predetermined channel is assigned to the time division multiplex transmission. Therefore, PCM3
As with the 0 system, the transmission rate for each channel is 64 Kbp.
s, and 8-bit data is contained in one time slot.
【０００８】しかし、ＰＣＭ２４Ｂ方式では、最下位ビ
ット（８ビット目）に各回線の接続中・切断中などを示
す監視信号デ−タを６フレ−ムに１回の割合で挿入・伝
送する必要があると共に、残りの７ビットのうち１ビッ
トをオ−ルゼロサプレッション(All Zero Suppression)
として伝送する必要がある。However, in the PCM24B system, it is necessary to insert / transmit the supervisory signal data indicating the connection / disconnection of each line into the least significant bit (8th bit) once in every 6 frames. There is, and 1 bit of the remaining 7 bits is All Zero Suppression
Need to be transmitted as.
【０００９】このため、デ−タとしては、６ビットだけ
使用するタイムスロットが出てくる。こうなると、ロ−
カル局４は８ビットで伝送を行なっているので、２ビッ
トだけ伝送されない場合が生じ、正確にビットエラ−を
測定できない問題が生じる。For this reason, a time slot that uses only 6 bits appears as data. When this happens,
Since the Cull station 4 is transmitting with 8 bits, there may be a case where only 2 bits are not transmitted, which causes a problem that the bit error cannot be accurately measured.
【００１０】以上から本発明の目的は、ロ−カル局から
集中保守局にＰＣＭ２４Ｂ方式あるいは同等な方式で多
重伝送する場合であっても、集中保守局で正確にビット
エラ−率の測定ができるビットエラ−率測定方式を提供
することである。In view of the above, the object of the present invention is to enable a bit error rate to be accurately measured by the central maintenance station even when multiple transmission is performed from the local station to the central maintenance station by the PCM24B system or an equivalent system. -To provide a rate measurement scheme.
【００１１】[0011]
【課題を解決するための手段】図１は本発明の原理説明
図である。１４はロ−カル交換局、１５は中継線（ＰＣ
Ｍ多重伝送路）、１６は多数のロ−カル交換局の保守を
集中して行なう集中保守局である。ロ−カル交換局１４
において、１４ａはＩＳＤＮ加入者線、１４ｂは加入者
線回路、１４ｃはネットワ−ク、１４ｄは８ビットデー
タを前半の４ビットと後半の４ビットに分割して中継線
１５に多重出力する第１のアダプタ部である。FIG. 1 illustrates the principle of the present invention. 14 is a local exchange, 15 is a trunk line (PC
M multiplex transmission lines) and 16 are centralized maintenance stations that centrally maintain many local exchange stations. Local exchange 14
14a is an ISDN subscriber line, 14b is a subscriber line circuit, 14c is a network, and 14d is 8-bit data which is divided into first 4 bits and latter 4 bits and is multiplexed and output to a relay line 15. It is the adapter part of.
【００１２】集中保守局１６において、１６ａはネット
ワ−ク、１６ｂはビットエラ−測定器、１６ｃは中継線
１５を介して入力された８ビットデータを前半及び後半
の４ビットデータに分離し、２つの８ビットデ−タから
分離した前半の４ビットを合成して、第１のアダプタ部
１４ｄによる分割前の元の８ビットデータを復元する第
２アダプタ部である。In the centralized maintenance station 16, 16a is a network, 16b is a bit error measuring device, and 16c separates the 8-bit data input via the relay line 15 into the first half and the second half of the 4-bit data, This is a second adapter unit that combines the first four bits separated from the 8-bit data to restore the original 8-bit data before the division by the first adapter unit 14d.
【００１３】[0013]
【作用】ロ−カル交換局１４より６４Ｋｂｐｓのデータ
を１フレ−ム当り８ビットづつ多重化して集中保守局１
６に伝送する際、ロ−カル交換局の第１アダプタ部１４
ｄは、８ビットデータを前半の４ビットと後半の４ビッ
トに分割し、前半及び後半の４ビットにそれぞれ前半、
後半であることを示す２ビットのシ−ケンシャル番号を
付加すると共に、残りの２ビットに監視データ又はオ−
ルゼロサプレッションデータを挿入、あるいは空きビッ
トにして２つの８ビットデータを作成して中継線１５に
出力する。集中保守局１６の第２アダプタ部１６ｃは、
中継線１５を介して入力された８ビットデータを前半及
び後半の４ビットデータに分離し、後半の４ビットに含
まれるシ−ケンシャル番号に基づいて、連続して入力さ
れた２つの８ビットデータの順序を識別し、識別した順
序で前半の２つの４ビットを合成して、第１アダプタ部
１４ｄによる分割前の元の８ビットデータを復元してビ
ットエラ−測定器１６ｂに入力し、ビットエラ−率を測
定する。The central maintenance station 1 multiplexes data of 64 Kbps from the local exchange 14 by 8 bits per frame.
6 for transmission to the first local exchange unit, the first adapter unit 14 of the local exchange.
d is a method of dividing 8-bit data into 4 bits of the first half and 4 bits of the latter half, and dividing the first half and 4 bits of the first half into the first half,
A 2-bit sequential number indicating the latter half is added, and the remaining 2 bits are used for monitoring data or an audio.
The zero-zero suppression data is inserted, or two bits of 8-bit data are created with empty bits and output to the relay line 15. The second adapter section 16c of the central maintenance station 16 is
The 8-bit data input via the relay line 15 is separated into the first half and the latter half of the 4-bit data, and two consecutive 8-bit data are input based on the sequential number included in the latter half 4 bits. Of the first half is combined with each other in the identified order to restore the original 8-bit data before the division by the first adapter section 14d and input to the bit error measuring device 16b. Measure the rate.
【００１４】このように、６４Ｋｂｐｓの１つの８ビッ
トデ−タを前半及び後半の４ビットデ−タに分割し、そ
れぞれにシ−ケンシャル番号や監視データ又はオ−ルゼ
ロサプレッションデータ等を挿入して２つの８ビットデ
−タを作成して多重伝送し、集中保守局側で元の８ビッ
トデ−タを復元するようにしたから、ロ−カル交換局か
ら集中保守局にＰＣＭ２４Ｂ方式で多重伝送する場合で
あっても、集中保守局で正確にビットエラ−率の測定が
できる。In this way, one 8-bit data of 64 Kbps is divided into the first half and the latter half of 4-bit data, and the sequential number, the monitor data, the all-zero suppression data, etc. are inserted into each of the two, and then 2 One 8-bit data is created and multiplex-transmitted, and the central maintenance station side restores the original 8-bit data. Therefore, it is possible to multiplex-transmit by the PCM24B system from the local exchange station to the centralized maintenance station. Even if there is, the central maintenance station can accurately measure the bit error rate.
【００１５】[0015]
【実施例】全体の構成 図２は本発明のビットエラ−率測定方式を実現する通信
システムの構成図であり、図１と同一部分には同一符号
を付している。図中、１１はＩＳＤＮ電話端末、１２は
網終端装置（ＮＴＥ）、１３はＩＳＤＮ（デジタル）加
入者線、１４はロ−カル交換局、１５は中継線（ＰＣＭ
多重伝送路）、１６は多数のロ−カル交換局の保守を集
中して行なう集中保守局である。DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENTS Overall Configuration FIG. 2 is a configuration diagram of a communication system which realizes the bit error rate measuring method of the present invention. The same parts as those in FIG. 1 are designated by the same reference numerals. In the figure, 11 is an ISDN telephone terminal, 12 is a network terminating device (NTE), 13 is an ISDN (digital) subscriber line, 14 is a local exchange, and 15 is a trunk line (PCM).
A multiplex transmission line), 16 is a centralized maintenance station for centrally maintaining a large number of local exchange stations.
【００１６】ロ−カル交換局１４において、１４ａはＩ
ＳＤＮ加入者線、１４ｂは加入者線回路（ＤＬＣ）、１
４ｃはネットワ−ク（ＮＷ）、１４ｄは８ビットデータ
を前半の４ビットと後半の４ビットに分割して中継線１
５に多重出力する第１のアダプタ部、１４ｅはデジタル
タ−ミナル（ＤＴ）である。集中保守局１６において、
１６ａはネットワ−ク（ＮＷ）、１６ｂはビットエラ−
率を測定するビットエラ−測定器、１６ｃは中継線１５
を介して入力された８ビットデータを前半及び後半の４
ビットデータに分離し、連続する２つの８ビットデ−タ
から分離した２つの前半の４ビットを合成し、第１のア
ダプタ部１４ｄによる分割前の元の８ビットデータを復
元する第２アダプタ部、１６ｄはデジタルタ−ミナル
（ＤＴ）である。In the local exchange 14, 14a is I.
SDN subscriber line, 14b is a subscriber line circuit (DLC), 1
Reference numeral 4c is a network (NW), and 14d is a relay line 1 in which 8-bit data is divided into 4 bits in the first half and 4 bits in the second half.
The first adapter unit 14e for multiplex output to 5 is a digital terminal (DT). In the central maintenance station 16,
16a is a network (NW), 16b is a bit error
Bit error measuring device for measuring the rate, 16c is a relay line 15
The 8-bit data input via the
A second adapter unit for separating the first 8-bit data before the division by the first adapter unit 14d by separating the two first-half 4 bits separated from two consecutive 8-bit data into bit data. 16d is a digital terminal (DT).
【００１７】第１アダプタ部の動作 伝送速度が６４Ｋｂｐｓであるロ−カル交換局１４か
ら、ＰＣＭ２４Ｂ方式でデ−タを多重伝送する場合、第
１のアダプタ部１４ｄは図３に示すように伝送方式を変
換する。すなわち、ある１つのタイムスロットＴＳ64１
（８ビット）のうちビット１〜ビット４のデ−タＡ，
Ｂ，Ｃ，ＤをＰＣＭ２４Ｂ方式の第１のタイムスロット
ＴＳ24１の前半の４ビットに割当て、ＴＳ64１のうちビ
ット５〜ビット８のデ−タＥ，Ｆ，Ｇ，ＨをＰＣＭ２４
Ｂ方式の第２のタイムスロットＴＳ24２の前半の４ビッ
トに割当てる。又、ＰＣＭ２４Ｂ方式の第１、第２のタ
イムスロットＴＳ24１，ＴＳ24２の第５ビット〜第６ビ
ットに、それぞれ２ビットのシ−ケンシャル番号”０
０”、”０１”を割当てると共に、第７ビット〜第８ビ
ットに適宜監視データ（１ビット）及びオ−ルゼロサプ
レッションデータ（１ビット）を挿入、あるいは空きビ
ットにして２つの８ビットデータを作成して中継線１５
に出力する。When data is multiplexed and transmitted by the PCM24B system from the local exchange 14 whose operating transmission speed is 64 Kbps, the first adapter unit 14d uses the transmission system as shown in FIG. To convert. That is, one time slot TS 64 1
Data A of bits 1 to 4 out of (8 bits),
B, C and D are assigned to the first 4 bits of the first time slot TS 24 1 of the PCM 24B system, and the data E, F, G and H of bits 5 to 8 of TS 64 1 are assigned to the PCM 24.
Assigned to the second 4 bits of the first half of time slot TS 24 2 B type. In addition, a 2-bit sequential number "0" is assigned to each of the 5th to 6th bits of the first and second time slots TS 24 1 and TS 24 2 of the PCM 24B system.
0 "and" 01 "are allocated, and monitoring data (1 bit) and all-zero suppression data (1 bit) are appropriately inserted into the 7th to 8th bits, or two 8-bit data are made empty. Create and relay line 15
Output to.
【００１８】同様にしてタイムスロットＴＳ64２（８ビ
ット）のデ−タを前半、後半の４ビットに分割してＰＣ
Ｍ２４Ｂ方式の２つのタイムスロットＴＳ24３，ＴＳ24
４に割当て、シ−ケンシャル番号”１０”、”１１”を
付加する。以後、同様にして、各タイムスロットＴＳ64
ｉ（８ビット）のデ−タを前半、後半の４ビットに分割
すると共に、それぞれに２ビットのシ−ケンシャル番
号”００”，”１０”又は”１０”，”１１”を付加し
てＰＣＭ２４Ｂ方式の２つのタイムスロットの８ビット
データを作成して中継線１５に送り出す。Similarly, the data of the time slot TS 642 (8 bits) is divided into 4 bits of the first half and the latter half, and the data is divided into PCs.
Two time slots TS 24 3 and TS 24 of the M24B system
4 and the sequential numbers “10” and “11” are added. Thereafter, similarly, each time slot TS 64
i (8 bits) data is divided into 4 bits in the first half and the latter half, and a 2-bit sequential number "00", "10" or "10", "11" is added to each of them, and PCM24B 8-bit data of two time slots of the system is created and sent to the trunk line 15.
【００１９】第１アダプタ部の構成 図４は第１アダプタ部１４ｄの構成図であり、局内から
の６４Ｋｂｐｓの８ビットデータを受信して前半の４ビ
ットと後半の４ビットに分解する分解器14d-1と、シ-ケ
ンシャル番号ライタ14d-2と、分解された４ビットづつ
のビット列に２ビットのシ−ケンシャル番号を付加する
と共に、適宜監視データとオ−ルゼロサプレッションデ
ータを付加してＰＣＭ２４Ｂ方式における２つの８ビッ
トデータを組み立て、組み立てられた８ビットデータを
所定のタイミングで中継線１５に送り出す組み立て器14
d-3が設けられている。 Configuration of First Adapter Unit FIG. 4 is a configuration diagram of the first adapter unit 14d, which is a decomposer 14d for receiving 8-bit data of 64 Kbps from the station and decomposing it into 4 bits in the first half and 4 bits in the second half. -1, a sequential number writer 14d-2, a 2-bit sequential number is added to the decomposed 4-bit bit string, and monitor data and all-zero suppression data are appropriately added to the PCM 24B. An assembling device 14 for assembling two 8-bit data in the method and sending the assembled 8-bit data to the relay line 15 at a predetermined timing.
d-3 is provided.
【００２０】第２アダプタ部の動作 ＰＣＭ２４Ｂ方式で８ビットデ−タが中継線１５から入
力されると、第２のアダプタ部１６ｃは第５〜第６ビッ
トのシ−ケンシャル番号”００”、”０１”又は”１
０”，”１１”を参照して連続して入力された２つの８
ビットデータの順序を識別し、識別した順序で前半の２
つの４ビットを合成して８ビットデータにし、換言すれ
ば、第１アダプタ部１４ｄによる分割前の元の８ビット
データを復元してビットエラ−測定器１６bに入力す
る。 Operation of the second adapter unit When 8-bit data is input from the trunk line 15 in the PCM24B system, the second adapter unit 16c causes the fifth to sixth bit sequential numbers "00" and "01". "Or" 1
Two 8s continuously input with reference to 0 ”and“ 11 ”
The order of the bit data is identified, and the first 2 in the identified order.
The four 4-bits are combined into 8-bit data. In other words, the original 8-bit data before the division by the first adapter unit 14d is restored and input to the bit error measuring device 16b.
【００２１】第２アダプタ部の構成 図５は第２アダプタ部１６ｃの構成図であり、中継線１
５より伝送されてきた８ビットデータを受信して前半及
び後半の４ビットデータに分解する分解器16c-１と、後
半の４ビットデータに含まれるシ-ケンシャル番号を抽
出して、入力された８ビットデータの順序を識別するシ
−ケンシャル番号リ−ダ16c-2と、識別した順序で連続
して入力された２つの８ビットデータの前半の４ビット
を合成して、第１アダプタ部１４ｄによる分割前の元の
８ビットデータを復元して組み立てられた８ビットデー
タを局内（ネットワ−ク１６ａ）に送り出す組み立て器
16c-3が設けられている。 Configuration of Second Adapter Unit FIG. 5 is a configuration diagram of the second adapter unit 16c.
Decompressor 16c-1 that receives 8-bit data transmitted from 5 and decomposes it into 4-bit data in the first half and the second half, and the sequential number included in the 4-bit data in the second half is extracted and input. A sequential number reader 16c-2 for identifying the order of the 8-bit data and the first half 4 bits of the two 8-bit data continuously input in the identified order are combined, and the first adapter unit 14d The assembler that restores the original 8-bit data before dividing by 8 and sends the assembled 8-bit data to the inside of the station (network 16a)
16c-3 is provided.
【００２２】全体の動作 ロ−カル交換局１４より６４Ｋｂｐｓのデータを１フレ
−ム当り８ビットづつ多重化して集中保守局１６に伝送
する際、ロ−カル交換局の第１アダプタ部１４ｄは、該
８ビットデータを前半の４ビットと後半の４ビットに分
割し、前半及び後半の４ビットにそれぞれ前半、後半で
あることを示す２ビットのシ−ケンシャル番号を付加す
ると共に、適宜監視データ又はオ−ルゼロサプレッショ
ンデータを挿入、あるいは空きビットにしてＰＣＭ２４
Ｂ方式における第１、第２のタイムスロットの８ビット
データを作成する。そして、２つの８ビットデータをＰ
ＣＭ２４Ｂ方式の第１、第２のタイムスロットにて中継
線１５に出力する。 Overall operation When the 64 Kbps data is multiplexed from the local exchange station 14 by 8 bits per frame and transmitted to the central maintenance station 16, the first adapter section 14d of the local exchange station The 8-bit data is divided into 4 bits in the first half and 4 bits in the second half, and 2-bit sequential numbers indicating the first half and the second half are added to the 4 bits in the first half and the second half, respectively, and monitor data or PCM24 with all-zero suppression data inserted or empty bits
8-bit data of the first and second time slots in the B system are created. Then, set the two 8-bit data to P
Output to the trunk line 15 in the first and second time slots of the CM24B system.
【００２３】集中保守局１６の第２アダプタ部１６ｃ
は、中継線１５を介して入力された８ビットデータを前
半及び後半の４ビットデータに分離し、後半の４ビット
に含まれるシ−ケンシャル番号に基づいて、入力された
８ビットデータの順序を識別し、識別した順序で連続し
て入力された２つの８ビットデータの前半の４ビット
（第１〜第４ビット）を合成して８ビットデータにし、
換言すれば、第１アダプタ部１４ｄによる分割前の元の
８ビットデータを復元して、ネットワ−ク１６ａを介し
てビットエラ−測定器１６ｂに入力する。ビットエラ−
測定器１６ｂは入力された６４Ｋｂｐｓの８ビットデー
タに基づいてビットエラ−率の測定を行なう。Second adapter section 16c of central maintenance station 16
Divides the 8-bit data input via the relay line 15 into 4-bit data in the first half and the second half, and determines the order of the 8-bit data input based on the sequential number included in the 4-bits in the second half. The first half 4 bits (first to fourth bits) of the two pieces of 8-bit data continuously input in the identified order are identified to form 8-bit data.
In other words, the original 8-bit data before the division by the first adapter unit 14d is restored and input to the bit error measuring device 16b via the network 16a. Bit error
The measuring device 16b measures the bit error rate based on the input 8-bit data of 64 Kbps.
【００２４】以上では、ＰＣＭ２４Ｂ方式に本発明を適
用した場合について説明したが、ＰＣＭ２４Ｂ方式と同
等な多重伝送方式にも適用できることは勿論である。以
上、本発明を実施例により説明したが、本発明は請求の
範囲に記載した本発明の主旨に従い種々の変形が可能で
あり、本発明はこれらを排除するものではない。Although the case where the present invention is applied to the PCM24B system has been described above, it is needless to say that the present invention can be applied to a multiplex transmission system equivalent to the PCM24B system. Although the present invention has been described above with reference to the embodiments, the present invention can be variously modified according to the gist of the present invention described in the claims, and the present invention does not exclude these.
【００２５】[0025]
【発明の効果】以上本発明によれば、１つの８ビットデ
−タを前半及び後半の４ビットデ−タに分割し、それぞ
れに監視データ又はオ−ルゼロサプレッションデータ等
を挿入して２つの８ビットデ−タを作成して多重伝送
し、集中保守局側で元の８ビットデ−タを復元するよう
に構成したから、ロ−カル局から集中保守局にＰＣＭ２
４Ｂ方式で多重伝送する場合であっても、集中保守局で
正確にビットエラ−率の測定ができる。As described above, according to the present invention, one 8-bit data is divided into first-half and second-half 4-bit data, and monitoring data or all-zero suppression data is inserted into each of the two 8-bit data to obtain two 8-bit data. Since the bit data is created and multiplexed and the original maintenance station side restores the original 8-bit data, the PCM2 is transmitted from the local station to the central maintenance station.
Even in the case of multiplex transmission by the 4B system, the central maintenance station can accurately measure the bit error rate.
【図１】本発明の原理説明図である。FIG. 1 is a diagram illustrating the principle of the present invention.
【図２】本発明の実施例構成図である。FIG. 2 is a configuration diagram of an embodiment of the present invention.
【図３】第１、第２アダプタ部の動作説明図である。FIG. 3 is an operation explanatory diagram of first and second adapter sections.
【図４】第１アダプタ部の構成図である。FIG. 4 is a configuration diagram of a first adapter section.
【図５】第２アダプタ部の構成図である。FIG. 5 is a configuration diagram of a second adapter section.
【図６】従来のビットエラ−測定の構成図である。FIG. 6 is a configuration diagram of a conventional bit error measurement.
【図７】集中保守局を含む通信システムの構成図であ
る。FIG. 7 is a configuration diagram of a communication system including a central maintenance station.
【図８】ＰＣＭ３０方式のデ−タ構成図である。FIG. 8 is a data block diagram of the PCM30 system.
【図９】ＰＣＭ２４Ｂ方式のデ−タ構成図である。FIG. 9 is a data block diagram of the PCM 24B system.
１４・・ロ−カル交換局 １４ａ・・ＩＳＤＮ加入者線 １４ｂ・・加入者線回路 １４ｃ・・ネットワ−ク １４ｄ・・第１のアダプタ部 １５・・中継線（ＰＣＭ多重伝送路） １６・・集中保守局 １６ａ・・ネットワ−ク １６ｂ・・ビットエラ−測定器 １６ｃ・・第２のアダプタ部 14 ... Local exchange station 14a ... ISDN subscriber line 14b ... Subscriber line circuit 14c ... Network 14d ... First adapter section 15 ... Relay line (PCM multiplex transmission line) 16 ... Central maintenance station 16a ··· Network 16b · · Bit error measuring device 16c · · Second adapter section
Claims (1)
ＳＤＮ加入者線(14a)におけるビットエラ−率を集中保
守局(16)で監視する通信システムにおけるビットエラ−
率測定方式において、 ロ−カル交換局よりデータを１フレ−ム当り８ビットづ
つ多重化して集中保守局に伝送する際、 ロ−カル交換局に、８ビットデータを前半の４ビットと
後半の４ビットに分割し、前半及び後半の４ビットにそ
れぞれ前半、後半であることを示す２ビットのシ−ケン
シャル番号を付加して２つの８ビットデータを作成して
中継線(15)に出力する第１アダプタ部(14d)を設け、 集中保守局に、中継線を介して入力された８ビットデー
タを前半及び後半の４ビットデータに分離し、後半の４
ビットに含まれるシ−ケンシャル番号に基づいて、入力
された８ビットデータの順序を識別し、識別した順序で
連続する２つの８ビットデータの前半の４ビットを合成
して、第１アダプタ部(14d)による分割前の元の８ビッ
トデータを作成する第２アダプタ部(16c)を設け、 第２アダプタ部から出力される８ビットデータに対して
ビットエラ−測定器(16b)でビットエラ−率を測定する
ことを特徴とするビットエラ−率測定方式。1. An I housed in a local exchange (14).
Bit error in a communication system in which the central maintenance station (16) monitors the bit error rate in the SDN subscriber line (14a)
In the rate measurement method, when data is multiplexed from the local exchange station by 8 bits per frame and transmitted to the central maintenance station, the 8-bit data of the first half and the latter half of the latter half are transmitted to the local exchange station. It is divided into 4 bits, and two 8-bit data are created by adding a 2-bit sequential number indicating the first half and the latter half to the first and second half 4 bits respectively, and output to the relay line (15). The first adapter unit (14d) is provided to separate the 8-bit data input via the trunk line into the first half and second half 4-bit data to the central maintenance station,
Based on the sequential number included in the bits, the order of the input 8-bit data is identified, the first 4 bits of two consecutive 8-bit data in the identified order are combined, and the first adapter unit ( A second adapter section (16c) that creates the original 8-bit data before division by 14d) is provided, and the bit error rate is measured by the bit error measuring instrument (16b) for the 8-bit data output from the second adapter section. A bit error rate measuring method characterized by measuring.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3248703A JP3017339B2 (en) | 1991-09-27 | 1991-09-27 | Bit error rate measurement method |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3248703A JP3017339B2 (en) | 1991-09-27 | 1991-09-27 | Bit error rate measurement method |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0591186A true JPH0591186A (en) | 1993-04-09 |
| JP3017339B2 JP3017339B2 (en) | 2000-03-06 |
Family
ID=17182079
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3248703A Expired - Lifetime JP3017339B2 (en) | 1991-09-27 | 1991-09-27 | Bit error rate measurement method |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3017339B2 (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100469413B1 (en) * | 2002-03-09 | 2005-02-02 | 엘지전자 주식회사 | Inspection apparatus and method for time division multiplex line using vocoder |
-
1991
- 1991-09-27 JP JP3248703A patent/JP3017339B2/en not_active Expired - Lifetime
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| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100469413B1 (en) * | 2002-03-09 | 2005-02-02 | 엘지전자 주식회사 | Inspection apparatus and method for time division multiplex line using vocoder |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3017339B2 (en) | 2000-03-06 |
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|---|---|---|---|
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
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