JPH0541615A - 増幅回路 - Google Patents
増幅回路Info
- Publication number
- JPH0541615A JPH0541615A JP19516991A JP19516991A JPH0541615A JP H0541615 A JPH0541615 A JP H0541615A JP 19516991 A JP19516991 A JP 19516991A JP 19516991 A JP19516991 A JP 19516991A JP H0541615 A JPH0541615 A JP H0541615A
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- JP
- Japan
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- amplifier
- circuit
- fet
- input signal
- input
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Abstract
(57)【要約】
【目的】 多値PSK変調波を増幅する場合のFET増
幅器の急峻な位相変化を検出し、出力端子におけるスペ
クトラムの広がりが隣接チャンネルへ影響しないように
入力信号レベルを制御する回路を具備する増幅回路を提
供することを目的とする。 【構成】 電界効果トランジスタ(FET)増幅器2
と、FET増幅器2のゲート端子5に設けられたゲート
電流検出回路6と、直流ゲート電流値に応じてFET増
幅器2の入力信号レベルを制御する入力信号レベル制御
回路7を設けることにより、FET増幅器の急峻な位相
変化を免れ隣接チャンネルへおよぼす影響を小さくする
ことができる。
幅器の急峻な位相変化を検出し、出力端子におけるスペ
クトラムの広がりが隣接チャンネルへ影響しないように
入力信号レベルを制御する回路を具備する増幅回路を提
供することを目的とする。 【構成】 電界効果トランジスタ(FET)増幅器2
と、FET増幅器2のゲート端子5に設けられたゲート
電流検出回路6と、直流ゲート電流値に応じてFET増
幅器2の入力信号レベルを制御する入力信号レベル制御
回路7を設けることにより、FET増幅器の急峻な位相
変化を免れ隣接チャンネルへおよぼす影響を小さくする
ことができる。
Description
【0001】
【産業上の利用分野】本発明はディジタル通信機器にお
いて、変調波を位相歪みなく増幅する増幅回路に関す
る。
いて、変調波を位相歪みなく増幅する増幅回路に関す
る。
【0002】
【従来の技術】近年、携帯電話機器などディジタル方式
無線通信機器において、送信増幅器は高出力高効率で低
位相歪が要求されており、特に位相歪が問題視されてい
る。以下従来の増幅回路について図面を参照しながら説
明する。
無線通信機器において、送信増幅器は高出力高効率で低
位相歪が要求されており、特に位相歪が問題視されてい
る。以下従来の増幅回路について図面を参照しながら説
明する。
【0003】図4に示すように、入力信号は入力端子2
1から入力し電界効果トランジスタ(以下、FETと略
す)増幅器22で増幅されたのち、出力端子23から出
力する。ここで、FET増幅器22には直流電源の入出
力のためのドレイン端子24とゲート端子25を有して
いる。
1から入力し電界効果トランジスタ(以下、FETと略
す)増幅器22で増幅されたのち、出力端子23から出
力する。ここで、FET増幅器22には直流電源の入出
力のためのドレイン端子24とゲート端子25を有して
いる。
【0004】以上のように構成されたFETを用いた増
幅回路について、以下その動作について説明する。
幅回路について、以下その動作について説明する。
【0005】まず、一般に、FET増幅器22はドレイ
ン端子24の電圧が低くても十分動作し、出力電力に対
する増幅器の直流消費電力効率が良好であり、歪特性が
優れているため携帯電話機器などに頻繁に用いられてい
る。FET増幅器22を効率よく使用するためには、F
ETのゲート端子25の電圧すなわち動作電圧はピンチ
オフ電圧付近(AB級またはB級)で使用している。さ
らに必要に応じて振幅特性においては線形補償回路(た
とえば、特公平2−206906号公報参照)を行うこ
とにより線形増幅器としても使用している。
ン端子24の電圧が低くても十分動作し、出力電力に対
する増幅器の直流消費電力効率が良好であり、歪特性が
優れているため携帯電話機器などに頻繁に用いられてい
る。FET増幅器22を効率よく使用するためには、F
ETのゲート端子25の電圧すなわち動作電圧はピンチ
オフ電圧付近(AB級またはB級)で使用している。さ
らに必要に応じて振幅特性においては線形補償回路(た
とえば、特公平2−206906号公報参照)を行うこ
とにより線形増幅器としても使用している。
【0006】
【発明が解決しようとする課題】しかしながら上記従来
の構成では、FET増幅器の入力端子に過大な多値PS
K変調信号が入力したような場合、FET増幅器での振
幅と位相が非線形になり、出力端子におけるスペクトラ
ムが広がり、隣接チャンネルへ妨害を与えるという問題
点を有していた。
の構成では、FET増幅器の入力端子に過大な多値PS
K変調信号が入力したような場合、FET増幅器での振
幅と位相が非線形になり、出力端子におけるスペクトラ
ムが広がり、隣接チャンネルへ妨害を与えるという問題
点を有していた。
【0007】本発明は上記従来の問題点を解決するもの
で、多値PSK変調波を増幅する場合FET増幅器の急
峻な位相変化を検出し、出力端子におけるスペクトラム
の広がりが隣接チャンネルに影響しないように入力信号
レベルを制御する回路を具備する増幅回路を提供するこ
とを目的とする。
で、多値PSK変調波を増幅する場合FET増幅器の急
峻な位相変化を検出し、出力端子におけるスペクトラム
の広がりが隣接チャンネルに影響しないように入力信号
レベルを制御する回路を具備する増幅回路を提供するこ
とを目的とする。
【0008】
【課題を解決するための手段】上記目的を達成するため
に本発明の増幅回路は、FET増幅器のゲート電流を検
出する回路と、FET増幅器のゲート電流の値に応じ
て、FET増幅器の入力信号レベルを制御するような構
成を有している。
に本発明の増幅回路は、FET増幅器のゲート電流を検
出する回路と、FET増幅器のゲート電流の値に応じ
て、FET増幅器の入力信号レベルを制御するような構
成を有している。
【0009】
【作用】上記構成において、多値PSK変調波を増幅す
る場合FET増幅器の急峻な位相変化を検出し、FET
増幅器の入力信号レベルを制御することにより出力端子
におけるスペクトラムの広がりが隣接チャンネルへの妨
害を防ぐこととなる。
る場合FET増幅器の急峻な位相変化を検出し、FET
増幅器の入力信号レベルを制御することにより出力端子
におけるスペクトラムの広がりが隣接チャンネルへの妨
害を防ぐこととなる。
【0010】
【実施例】以下本発明の一実施例について、図面を参照
しながら説明する。
しながら説明する。
【0011】図1において、入力信号は入力端子1から
入力しFET増幅器2で増幅されたのち出力端子3から
出力する。ここで、FET増幅器2直流電源の入出力の
ためのドレイン端子4とゲート端子5とを有している。
FET増幅器2のゲート端子5には、直流ゲート電流を
検出するためのゲート電流検出回路6を設けている。ま
た、ゲート電流検出回路6で得た電流値によりFET増
幅器2の入力信号レベルを制御するために入力信号レベ
ル制御回路7を設けている。
入力しFET増幅器2で増幅されたのち出力端子3から
出力する。ここで、FET増幅器2直流電源の入出力の
ためのドレイン端子4とゲート端子5とを有している。
FET増幅器2のゲート端子5には、直流ゲート電流を
検出するためのゲート電流検出回路6を設けている。ま
た、ゲート電流検出回路6で得た電流値によりFET増
幅器2の入力信号レベルを制御するために入力信号レベ
ル制御回路7を設けている。
【0012】以上のように構成された増幅回路につい
て、以下図1,図2および図3を用いてその動作を説明
する。
て、以下図1,図2および図3を用いてその動作を説明
する。
【0013】図1に示すように、入力端子1から入力し
た入力信号は入力信号レベル制御回路7で利得が制御さ
れて交流の信号分は、FET増幅器2の入力側から入力
し、増幅したのち出力側の出力端子3から出力する。こ
こでFET増幅器2の動作のための直流電源はドレイン
端子4とゲート端子5に加えられている。
た入力信号は入力信号レベル制御回路7で利得が制御さ
れて交流の信号分は、FET増幅器2の入力側から入力
し、増幅したのち出力側の出力端子3から出力する。こ
こでFET増幅器2の動作のための直流電源はドレイン
端子4とゲート端子5に加えられている。
【0014】つぎに、図2はFET増幅器の入出力特性
であり、入力電力に対する出力電力,ゲート電流,位相
変化を示している。FET増幅器2の入力電力を増加さ
せると横軸の(a)点付近から負性のゲート電流が多く
流れ始め、(b)点でFETのゲート電流の負電流が最
大となる。(b)点より更に入力電力を増加した(c)
点では位相が急峻に変化していることがわかる。
であり、入力電力に対する出力電力,ゲート電流,位相
変化を示している。FET増幅器2の入力電力を増加さ
せると横軸の(a)点付近から負性のゲート電流が多く
流れ始め、(b)点でFETのゲート電流の負電流が最
大となる。(b)点より更に入力電力を増加した(c)
点では位相が急峻に変化していることがわかる。
【0015】つぎに、図3はFET増幅器の入力電力と
ゲート電流の関係を示すものであり、実線で示される入
力電力(図2の(a)点付近)におけるゲート電流はド
レイン・ゲート間電圧による負電流であるが、破線で示
される入力信号の場合(図2の(c)点付近)にはゲー
トソース間電圧が一瞬であるが(d)点で正の方向にか
かり、大きな正電流が流れることがわかる。この現象に
一致して位相が大きく変化している。
ゲート電流の関係を示すものであり、実線で示される入
力電力(図2の(a)点付近)におけるゲート電流はド
レイン・ゲート間電圧による負電流であるが、破線で示
される入力信号の場合(図2の(c)点付近)にはゲー
トソース間電圧が一瞬であるが(d)点で正の方向にか
かり、大きな正電流が流れることがわかる。この現象に
一致して位相が大きく変化している。
【0016】以上のように本実施例によれば、FET増
幅器2のゲート電流を電流検出回路6で検出し、ゲート
電流値によりFET増幅器の入力信号レベルを制御する
制御回路7を設けることにより、FET増幅器の急峻な
位相変化を免れることができる。
幅器2のゲート電流を電流検出回路6で検出し、ゲート
電流値によりFET増幅器の入力信号レベルを制御する
制御回路7を設けることにより、FET増幅器の急峻な
位相変化を免れることができる。
【0017】なお、FET増幅回路2のゲート側に大き
な正電流が流れて位相が大きく変化することを避けるた
めに、ゲート電流検出回路6にピーク電流検出機能をも
たせることも有効な方法である。
な正電流が流れて位相が大きく変化することを避けるた
めに、ゲート電流検出回路6にピーク電流検出機能をも
たせることも有効な方法である。
【0018】また、ゲート電流値によりFET増幅器2
の入力信号レベルを制御する代わりに、入力信号レベル
を制御するための利得可変回路を設けることとか、また
別に、FET増幅器2の入力側に入力するベースバンド
信号のレベルを制御するためのレベル可変回路を設ける
ようにしてもよい。
の入力信号レベルを制御する代わりに、入力信号レベル
を制御するための利得可変回路を設けることとか、また
別に、FET増幅器2の入力側に入力するベースバンド
信号のレベルを制御するためのレベル可変回路を設ける
ようにしてもよい。
【0019】
【発明の効果】以上の実施例の説明より明らかなよう
に、本発明は多値PSK変調波を増幅する場合のFET
増幅器2のゲート電流をゲート電流検出回路で検出し、
ゲート電流値によりFET増幅器の入力信号レベルを制
御する制御回路を設けることにより、FET増幅器の急
峻な位相変化を免れ隣接チャンネルへおよぼす影響を小
さくすることができる優れた増幅回路を実現できる。
に、本発明は多値PSK変調波を増幅する場合のFET
増幅器2のゲート電流をゲート電流検出回路で検出し、
ゲート電流値によりFET増幅器の入力信号レベルを制
御する制御回路を設けることにより、FET増幅器の急
峻な位相変化を免れ隣接チャンネルへおよぼす影響を小
さくすることができる優れた増幅回路を実現できる。
【図1】本発明の第1の実施例における増幅回路のブロ
ック図
ック図
【図2】同実施例のFET増幅器の入出力特性図
【図3】同実施例のFET増幅器のゲート電流特性図
【図4】従来の増幅回路のブロック図
2 FET増幅器 4 ドレイン端子 5 ゲート端子 6 ゲート電流検出回路 7 入力信号レベル制御回路
Claims (4)
- 【請求項1】電界効果トランジスタ増幅器と、前記電界
効果トランジスタ増幅器の直流ゲート電流を検出する電
流検出回路を具備し、直流ゲート電流値に応じて前記電
界効果トランジスタ増幅器に入力する入力信号レベルを
制御するように配してなる増幅回路。 - 【請求項2】直流ゲート電流を検出する電流検出回路は
ピーク電流検出機能を有する請求項1記載の増幅回路。 - 【請求項3】電界効果トランジスタの信号入力側に入力
信号レベルを制御する利得可変回路を備えた請求項1記
載の増幅回路。 - 【請求項4】電界効果トランジスタに入力するベースバ
ンド信号のレベルを制御するレベル可変回路を備えた請
求項1記載の増幅回路。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP19516991A JPH0541615A (ja) | 1991-08-05 | 1991-08-05 | 増幅回路 |
US07/924,937 US5371477A (en) | 1991-08-05 | 1992-08-05 | Linear amplifier |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP19516991A JPH0541615A (ja) | 1991-08-05 | 1991-08-05 | 増幅回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0541615A true JPH0541615A (ja) | 1993-02-19 |
Family
ID=16336588
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP19516991A Pending JPH0541615A (ja) | 1991-08-05 | 1991-08-05 | 増幅回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0541615A (ja) |
-
1991
- 1991-08-05 JP JP19516991A patent/JPH0541615A/ja active Pending
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