JPH05218903A - Echo canceller - Google Patents
Echo cancellerInfo
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- JPH05218903A JPH05218903A JP45192A JP45192A JPH05218903A JP H05218903 A JPH05218903 A JP H05218903A JP 45192 A JP45192 A JP 45192A JP 45192 A JP45192 A JP 45192A JP H05218903 A JPH05218903 A JP H05218903A
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- JP
- Japan
- Prior art keywords
- circuit
- echo
- level
- delay time
- adaptive filter
- Prior art date
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- Withdrawn
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- Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)
Abstract
Description
【0001】[0001]
【産業上の利用分野】本発明はエコーキャンセラに関
し、特にデータ通信用の2線4線変換回路に用いられる
エコーキャンセラに関する。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to an echo canceller, and more particularly to an echo canceller used in a 2-wire / 4-wire conversion circuit for data communication.
【0002】[0002]
【従来の技術】従来のエコーキャンセラは、図3に示す
ように、送信データSDをランダムデータであるスクラ
ンブル送信データSDSに変換するスクランブラ1と、
2値データを符号化しアナログ信号に変換するコーダ2
と、コーダ2からのアナログ信号をハイブリッド回路4
に送出するドライバ3と、2線4線変換用のハイブリッ
ド回路4と、ハイブリッド回路4で分離された受信信号
から雑音を除去するフィルタ5と、フィルタ5を通過し
た受信信号であるフィルタ受信信号RDFから疑似エコ
ー信号Eを減算する加算回路6と、フィルタ受信信号R
DFから’0’,’1’データを判定し復号する検波回
路7と、検波回路7で復号されたデータからランダム性
を除去し受信データRDに変換するデスクランブラ8
と、スクランブル送信データSDSから疑似エコー信号
Eを予測し生成する適応フィルタ9とを備えて構成され
ていた。2. Description of the Related Art A conventional echo canceller includes a scrambler 1 for converting transmission data SD into scrambled transmission data SDS which is random data, as shown in FIG.
Coder 2 that encodes binary data and converts it into analog signals
And the analog signal from the coder 2 to the hybrid circuit 4
To the driver 3, a hybrid circuit 4 for 2-wire to 4-wire conversion, a filter 5 that removes noise from the received signal separated by the hybrid circuit 4, and a filter received signal RDF that is the received signal that has passed through the filter 5. Adder circuit 6 for subtracting the pseudo echo signal E from the filter reception signal R
A detection circuit 7 that determines and decodes "0" and "1" data from DF, and a descrambler 8 that removes randomness from the data decoded by the detection circuit 7 and converts it into reception data RD.
And an adaptive filter 9 for predicting and generating the pseudo echo signal E from the scrambled transmission data SDS.
【0003】次に、従来のエコーキャンセラの動作につ
いて説明する。Next, the operation of the conventional echo canceller will be described.
【0004】まず、ハイブリッド回路4では、ドライバ
3からのアナログ出力信号を2線側に送出し、2線側か
らの受信信号をフィルタ5側で受信するという2線4線
変換を行なう。しかし、ドライバ3の出力信号の一部が
エコーとしてハイブリッド回路4に戻ってくるため、受
信信号に対して妨害信号となり、正しくデータが受信さ
れない。First, the hybrid circuit 4 performs 2-wire 4-wire conversion in which the analog output signal from the driver 3 is sent to the 2-wire side and the received signal from the 2-wire side is received by the filter 5 side. However, since a part of the output signal of the driver 3 returns to the hybrid circuit 4 as an echo, it becomes an interference signal with respect to the received signal, and the data is not correctly received.
【0005】そのため、スクランブル送信データSDS
を入力として適応フィルタ9により疑似エコー信号Eを
生成し、フィルタ受信信号RDFから減算することによ
りエコーを消去し、正しくデータを受信できるようにす
るというものであった。Therefore, the scrambled transmission data SDS
Was input to generate a pseudo echo signal E by the adaptive filter 9 and subtracted from the filter reception signal RDF to cancel the echo so that correct data can be received.
【0006】適応フィルタ9はディジタルフィルタの一
種であり、図4に示すように、N−1個の遅延回路DL
1〜DLN−1と、N個の係数回路C1〜CNと、累算
回路AC1とから構成される周知のタップ数Nのトラン
スバーサルフィルタで構成される。The adaptive filter 9 is a kind of digital filter. As shown in FIG. 4, N-1 delay circuits DL are provided.
1 to DLN−1, N coefficient circuits C1 to CN, and an accumulator circuit AC1 with a known tap number N transversal filter.
【0007】[0007]
【発明が解決しようとする課題】上述した従来のエコー
キャンセラは、実際のエコーの遅延時間は2線側の線路
の距離に対応して変化するのに対し、スクランブルされ
た送信データがハイブリッド回路を介してエコーとして
受信側に戻ってくる時間が一定であることと、適応フィ
ルタを介して疑似エコーとして加算器に入力される時間
も一定であることにより、加算器でエコーを消去する場
合にこれらの遅延時間を予め実際のエコーの遅延時間に
合せ込んでおくか、あるいは、実際のエコーの遅延時間
の変化に対応できるように適応フィルタのタップ数を十
分多くしておく必要があり、このため2線側の線路の距
離変化に対応する調整が困難であることとハードウェア
の規模が大きくなるというという欠点があった。In the above-mentioned conventional echo canceller, the actual echo delay time changes according to the distance between the lines on the two-wire side, whereas the scrambled transmission data is transmitted through the hybrid circuit. Since the time to return to the receiving side as an echo through the adder is constant and the time to be input to the adder as a pseudo echo via the adaptive filter is also constant, these values are eliminated when the echo is canceled by the adder. It is necessary either to adjust the delay time of the echo to the delay time of the actual echo in advance, or to increase the number of taps of the adaptive filter sufficiently to cope with changes in the delay time of the actual echo. However, there are drawbacks in that it is difficult to make adjustments to cope with changes in the distance between the two lines, and the scale of the hardware increases.
【0008】[0008]
【課題を解決するための手段】本発明のエコーキャンセ
ラは、2線式伝送路と送信線路および受信線路を有する
4線式伝送路とを接続するハイブリッド回路と、前記送
信線路から入力される送信データから疑似エコー信号を
予測し生成する適応フィルタと、前記適応フィルタの出
力と前記ハイブリッド回路で分離された受信信号とを減
算する減算回路とを備え、前記適応フィルタに対する前
記疑似エコー信号を生成するための初期設定用のトレー
ニングを行なうエコーキャンセラにおいて、前記トレー
ニングのときに前記減算回路の出力から残留エコーのレ
ベルを検出するレベル検出回路と、前記送信線路と前記
ハイブリッド回路との間に挿入され前記送信データを遅
延し前記残留エコーのレベルが最小となるように前記送
信データの遅延時間を可変する可変遅延回路とを備えて
構成されている。The echo canceller of the present invention is a hybrid circuit for connecting a two-wire type transmission line and a four-line type transmission line having a transmission line and a reception line, and a transmission input from the transmission line. An adaptive filter for predicting and generating a pseudo echo signal from data and a subtraction circuit for subtracting the output of the adaptive filter and the received signal separated by the hybrid circuit are provided, and the pseudo echo signal for the adaptive filter is generated. In an echo canceller that performs training for initial setting for, a level detection circuit that detects the level of a residual echo from the output of the subtraction circuit at the time of the training, and is inserted between the transmission line and the hybrid circuit, When the transmission data is delayed so that the level of the residual echo is minimized by delaying the transmission data. It is constituted by a variable delay circuit for varying the.
【0009】[0009]
【実施例】次に、本発明の実施例について図面を参照し
て説明する。Embodiments of the present invention will now be described with reference to the drawings.
【0010】図1は本発明のエコーキャンセラの一実施
例を示すブロック図である。FIG. 1 is a block diagram showing an embodiment of the echo canceller of the present invention.
【0011】本実施例のエコーキャンセラは、図1に示
すように、前述の従来例と同様のスクランブラ1と、コ
ーダ2と、ドライバ3と、ハイブリッド回路4と、フィ
ルタ5と、加算回路6と、検波回路7と、デスクランブ
ラ8と、適応フィルタ9とに加えて、加算回路6の出力
から残留エコーのレベルを検出するベル検出回路10
と、スクランブルされた送信データであるスクランブル
送信データSDSがコーダ2に入力する時間を遅延させ
るための遅延回路11を備えて構成されている。As shown in FIG. 1, the echo canceller of this embodiment has a scrambler 1, a coder 2, a driver 3, a hybrid circuit 4, a filter 5, and an adder circuit 6 similar to those of the above-mentioned conventional example. In addition to the detection circuit 7, the descrambler 8 and the adaptive filter 9, a bell detection circuit 10 for detecting the level of the residual echo from the output of the addition circuit 6
And a delay circuit 11 for delaying the time when the scrambled transmission data SDS which is the scrambled transmission data is input to the coder 2.
【0012】次に、本実施例の動作について説明する。Next, the operation of this embodiment will be described.
【0013】図2は、図1で示す本実施例の回路の
(A)は遅延回路11の遅延時間が0のときの、(B)
は遅延回路11の遅延時間を最適に設定したのときの実
際のエコーEAと、疑似エコーEと、残留エコーERと
をそれぞれ示す波形図である。FIG. 2A shows the circuit of the present embodiment shown in FIG. 1A when the delay time of the delay circuit 11 is 0, and FIG.
FIG. 4 is a waveform diagram showing an actual echo EA, a pseudo echo E, and a residual echo ER when the delay time of the delay circuit 11 is optimally set.
【0014】まず、エコーキャンセラのトレーニングを
行なう。遅延回路11の遅延時間が0のときは、図2
(A)に示すように、残留エコーが存在する。ここで、
疑似エコーEのインパルス応答波形は、適応フィルタ9
の係数の値に相当し、タップ数がN個であるのでN個存
在する。ここで、実際のエコーEAと疑似エコーEの加
算回路6までの遅延時間との間に時間差τが存在する場
合には、この時間差τの部分のエコーが消去されずに残
留エコーERとしてフィルタされた受信信号であるフィ
ルタ受信信号RDFに重畳される。First, the training of the echo canceller is performed. When the delay time of the delay circuit 11 is 0,
As shown in (A), there are residual echoes. here,
The impulse response waveform of the pseudo echo E is the adaptive filter 9
The number of taps is N, which corresponds to the value of the coefficient of 1. Here, if there is a time difference τ between the actual echo EA and the delay time of the pseudo echo E to the adder circuit 6, the echo at the portion of this time difference τ is not erased and is filtered as the residual echo ER. It is superimposed on the filtered received signal RDF which is the received signal.
【0015】このときの残留エコーのレベルをレベル検
出回路10により検出し、これを記憶しておく。次に、
遅延回路11によりスクランブル送信データSDSに小
さな遅延時間tを与え、そのときの残留エコーレベルを
レベル検出回路10により再度検出し、これを記憶して
おく。同様に、遅延回路11によりスクランブル送信デ
ータSDSに小さな遅延時間を加えてゆき、レベル検出
回路10で検出される残留エコーERのレベルが最小と
なる遅延時間tmを求める。次に、スクランブル送信デ
ータSDSに遅延時間tmを加える。以上で、エコーキ
ャンセラのトレーニングを終了し、実際のデータ通信状
態に移行する。The level of the residual echo at this time is detected by the level detection circuit 10 and stored. next,
A small delay time t is given to the scrambled transmission data SDS by the delay circuit 11, the residual echo level at that time is detected again by the level detection circuit 10, and this is stored. Similarly, the delay circuit 11 adds a small delay time to the scrambled transmission data SDS to obtain the delay time tm that minimizes the level of the residual echo ER detected by the level detection circuit 10. Next, the delay time tm is added to the scramble transmission data SDS. This completes the training of the echo canceller and shifts to the actual data communication state.
【0016】以上、本発明の実施例を説明したが、本発
明は上記実施例に限られることなく種々の変形が可能で
ある。たたえば、遅延回路をコーダ側に挿入する代り
に、適応フィルタの入力側に挿入しレベル検出回路の出
力により遅延量を調整することも、本発明の主旨を逸脱
しない限り適用できることは勿論である。Although the embodiments of the present invention have been described above, the present invention is not limited to the above embodiments, and various modifications can be made. For example, instead of inserting the delay circuit on the coder side, it is of course possible to insert the delay circuit on the input side of the adaptive filter and adjust the delay amount by the output of the level detection circuit without departing from the gist of the present invention. is there.
【0017】[0017]
【発明の効果】以上説明したように、本発明のエコーキ
ャンセラは、トレーニングのときに残留エコーのレベル
を検出するレベル検出回路と、残留エコーのレベルが最
小となるように送信データの遅延時間を可変する可変遅
延回路とを備えることにより、適応フィルタのタップ数
を低減できるので、ハードウェアの規模を縮小できると
ともに、2線側の線路の距離変化に対応する調整が容易
となるという効果がある。As described above, in the echo canceller of the present invention, the level detection circuit for detecting the level of the residual echo during training and the delay time of the transmission data so that the level of the residual echo is minimized. Since the number of taps of the adaptive filter can be reduced by providing the variable delay circuit that is variable, there is an effect that the scale of hardware can be reduced and the adjustment corresponding to the distance change of the line on the two-wire side can be facilitated. .
【図1】本発明のエコーキャンセラの一実施例を示すブ
ロック図である。FIG. 1 is a block diagram showing an embodiment of an echo canceller of the present invention.
【図2】本実施例のエコーキャンセラにおける遅延回路
の遅延時間が0のときと遅延時間を最適に設定したのと
きの実際のエコーと疑似エコーと残留エコーとをそれぞ
れ示す波形図である。FIG. 2 is a waveform diagram showing an actual echo, a pseudo echo, and a residual echo when the delay time of the delay circuit in the echo canceller of this embodiment is 0 and when the delay time is optimally set.
【図3】従来のエコーキャンセラの一例を示すブロック
図である。FIG. 3 is a block diagram showing an example of a conventional echo canceller.
【図4】適応フィルタの一例を示すブロック図である。FIG. 4 is a block diagram showing an example of an adaptive filter.
1 スクランブラ 2 コーダ 3 ドライバ 4 ハイブリッド回路 5 フィルタ 6 加算回路 7 検波回路 8 デスクランブラ 9 適応フィルタ 10 レベル検出回路 11 遅延回路 AC1 累算回路 C1〜CN 係数回路 DL1〜DLN−1 遅延回路 DESCRIPTION OF SYMBOLS 1 scrambler 2 coder 3 driver 4 hybrid circuit 5 filter 6 addition circuit 7 detection circuit 8 descrambler 9 adaptive filter 10 level detection circuit 11 delay circuit AC1 accumulation circuit C1 to CN coefficient circuit DL1 to DLN-1 delay circuit
Claims (1)
を有する4線式伝送路とを接続するハイブリッド回路
と、前記送信線路から入力される送信データから疑似エ
コー信号を予測し生成する適応フィルタと、前記適応フ
ィルタの出力と前記ハイブリッド回路で分離された受信
信号とを減算する減算回路とを備え、前記適応フィルタ
に対する前記疑似エコー信号を生成するための初期設定
用のトレーニングを行なうエコーキャンセラにおいて、 前記トレーニングのときに前記減算回路の出力から残留
エコーのレベルを検出するレベル検出回路と、 前記送信線路と前記ハイブリッド回路との間に挿入され
前記送信データを遅延し前記残留エコーのレベルが最小
となるように前記送信データの遅延時間を可変する可変
遅延回路とを備えることを特徴とするエコーキャンセ
ラ。1. A hybrid circuit connecting a 2-wire transmission line and a 4-wire transmission line having a transmission line and a reception line, and an adaptive circuit for predicting and generating a pseudo echo signal from transmission data input from the transmission line. An echo canceller that includes a filter and a subtraction circuit that subtracts the output of the adaptive filter and the received signal separated by the hybrid circuit, and performs an initial setting training for generating the pseudo echo signal for the adaptive filter. In the above, the level detection circuit for detecting the level of the residual echo from the output of the subtraction circuit during the training, and the level of the residual echo by delaying the transmission data inserted between the transmission line and the hybrid circuit are And a variable delay circuit that varies the delay time of the transmission data so as to minimize the delay time. Echo canceller to.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP45192A JPH05218903A (en) | 1992-01-07 | 1992-01-07 | Echo canceller |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP45192A JPH05218903A (en) | 1992-01-07 | 1992-01-07 | Echo canceller |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH05218903A true JPH05218903A (en) | 1993-08-27 |
Family
ID=11474157
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP45192A Withdrawn JPH05218903A (en) | 1992-01-07 | 1992-01-07 | Echo canceller |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH05218903A (en) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2007158996A (en) * | 2005-12-08 | 2007-06-21 | Mitsubishi Electric Corp | Interference wave removing apparatus and interference wave removing method |
-
1992
- 1992-01-07 JP JP45192A patent/JPH05218903A/en not_active Withdrawn
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2007158996A (en) * | 2005-12-08 | 2007-06-21 | Mitsubishi Electric Corp | Interference wave removing apparatus and interference wave removing method |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A300 | Withdrawal of application because of no request for examination |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 19990408 |