JPH0494464A - Filter circuit - Google Patents
Filter circuitInfo
- Publication number
- JPH0494464A JPH0494464A JP21102590A JP21102590A JPH0494464A JP H0494464 A JPH0494464 A JP H0494464A JP 21102590 A JP21102590 A JP 21102590A JP 21102590 A JP21102590 A JP 21102590A JP H0494464 A JPH0494464 A JP H0494464A
- Authority
- JP
- Japan
- Prior art keywords
- current
- signal
- circuit
- output
- input signal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 239000003990 capacitor Substances 0.000 claims abstract description 20
- 238000006243 chemical reaction Methods 0.000 description 13
- 238000010586 diagram Methods 0.000 description 7
- 238000007599 discharging Methods 0.000 description 2
- 238000007493 shaping process Methods 0.000 description 2
- 230000003111 delayed effect Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000000630 rising effect Effects 0.000 description 1
Landscapes
- Ignition Installations For Internal Combustion Engines (AREA)
Abstract
Description
【発明の詳細な説明】
〔発明の目的〕
(産業上の利用分野)
本発明は、その出力パルス信号が自動車用点火装置等の
ドライブ信号となるドライバにおいて、ノイズ除去回路
として使用されるフィルタ回路に関するものである。[Detailed Description of the Invention] [Object of the Invention] (Industrial Application Field) The present invention relates to a filter circuit used as a noise removal circuit in a driver whose output pulse signal is a drive signal for an automobile ignition system, etc. It is related to.
(従来の技術)
パルス信号により動作する装置のドライバ、例えば自動
車用点火装置のドライバには、上記パルス信号からノイ
ズを除去するためのフィルタ回路が設けられる。(Prior Art) A driver for a device operated by a pulse signal, such as a driver for an automobile ignition system, is provided with a filter circuit for removing noise from the pulse signal.
つまり、自動車用点火装置の場合、ドライバは電磁ピッ
クアップの出力を整形することによりパルス信号を得て
、このパルス信号を点火装置に供給する。点火装置では
、このパルス信号のパルス発生タイミングで点火時期の
制御を行う。That is, in the case of an automobile ignition system, the driver obtains a pulse signal by shaping the output of the electromagnetic pickup, and supplies this pulse signal to the ignition system. In the ignition device, ignition timing is controlled based on the pulse generation timing of this pulse signal.
したがって、パルス信号にノイズが乗っていると点火タ
イミングに影響を及ぼすこととなるため、ドライバには
上記したようなフィルタ回路が設けられるのである。Therefore, if noise is added to the pulse signal, it will affect the ignition timing, which is why the driver is provided with a filter circuit as described above.
従来、この種のフィルタ回路は、CRオンデイレイ回路
の持つ時定数で入力信号のパルス前縁部に対する出力信
号のパルス前縁部の追従を拒否することにより、時定数
に満たない持続時間を有するパルス、つまりノイズパル
スを入力信号から除去するようになっている。Conventionally, this type of filter circuit rejects pulses whose duration is less than the time constant by refusing to follow the leading edge of the pulse of the input signal with the leading edge of the pulse of the input signal using the time constant of the CR on-delay circuit. In other words, noise pulses are removed from the input signal.
換言すれば、このフィルタ回路は上記時定数分の時間だ
け継続しない信号については入力と見なさず無視すると
いうもので、これにより、簡単な構成のノイズ除去回路
を提供している。In other words, this filter circuit ignores signals that do not continue for a period of time corresponding to the above-mentioned time constant, without considering them as input, thereby providing a noise removal circuit with a simple configuration.
しかし、このフィルタ回路は、パルス信号の供給先の動
作内容によっては、入力信号の周波数との関係で時定数
の設定に難点があった。However, this filter circuit has a difficulty in setting the time constant in relation to the frequency of the input signal, depending on the operation of the destination to which the pulse signal is supplied.
上記自動車用点火装置の場合、ドライバからのパルス信
号で点火時期を制御する関係上、ノイズの除去は不可欠
であるが、その他に、そのパルスの持続時間を利用して
点火コイルの電圧制御をも行っている。In the case of the above-mentioned automobile ignition system, noise removal is essential because the ignition timing is controlled by a pulse signal from the driver, but the duration of the pulse can also be used to control the voltage of the ignition coil. Is going.
第7図(イ)に示すパルス信号は電磁ピックアップから
の出力信号を整形して得たものであり、この図において
、Sはシグナルパルス、Nはノイズパルスである。The pulse signal shown in FIG. 7(a) is obtained by shaping the output signal from the electromagnetic pickup, and in this figure, S is a signal pulse and N is a noise pulse.
フィルタ回路では、上記遅延動作によってパルス信号か
らノイズパルスNを除去し、第7図()\)に示すよう
な信号を得る。この図中、Δtは遅延時間である。In the filter circuit, the noise pulse N is removed from the pulse signal by the delay operation described above, and a signal as shown in FIG. 7()\) is obtained. In this figure, Δt is the delay time.
このようにして得たパルス信号により、イグニッション
スイッチをオン・オフ制御する。例えば、パルス信号が
”H(ハイレベル)”のときイグニッションスイッチを
オンさせ、“L(ローレベル)”のときにはイグニッシ
ョンスイッチをオフさせる。The pulse signal obtained in this manner controls the ignition switch to be turned on or off. For example, when the pulse signal is "H (high level)", the ignition switch is turned on, and when the pulse signal is "L (low level)", the ignition switch is turned off.
そして、第7図(ニ)に示すようにイグニッションスイ
ッチがオンの期間中に点火コイルの電圧を高め、イグニ
ッションスイッチのターンオフでタイミングを取ってス
パークプラグに点火コイルの電圧を供給するようになっ
ている。Then, as shown in Figure 7 (d), the voltage of the ignition coil is increased while the ignition switch is on, and the voltage of the ignition coil is supplied to the spark plug at the timing when the ignition switch is turned off. There is.
ところで、ノイズパルスNはエンジンの回転速度が低速
であるほど発生しやすく且つその発生期間が長くなる。Incidentally, the lower the rotational speed of the engine, the more likely the noise pulse N is to occur and the longer the period of its occurrence.
逆に、ノイズパルスNはエンジンの回転速度が高速であ
るほど発生しに<<、発生しても第7図(ロ)に示すよ
うに短期間に集中する。On the other hand, the higher the rotational speed of the engine, the more likely the noise pulses N are generated, and even if they occur, they are concentrated in a short period of time as shown in FIG. 7(b).
よって、ノイズ除去の観点からは、上記遅延時間は、エ
ンジンの低速回転時に合わせ、長めにしておく方が有利
である。Therefore, from the viewpoint of noise removal, it is advantageous to set the delay time to be longer in accordance with the low speed rotation of the engine.
しかし、エンジン回転速度に応じて要求されるデユーテ
ィは第8図に実線で示すようにエンジン回転速度が高速
であるほど高い値が要求されるにもかかわらず、上記遅
延時間をエンジンの低速回転時に合わせて長く取ってし
まうと、もともと短い時間幅の高速回転時のパルスから
大きな割合でパルス前縁部が削られるため、デユーティ
不足を生じ、点火困難のような致命的な問題を生ずるこ
ととなってしまう。However, as shown by the solid line in Figure 8, the duty required according to the engine rotation speed is higher as the engine rotation speed becomes higher. If it is taken too long, the leading edge of the pulse will be shaved off to a large extent from the originally short pulse during high speed rotation, resulting in insufficient duty and causing fatal problems such as difficulty in ignition. It ends up.
つまり第7図(ニ)において、Isoは点火コイルに最
低限必要な電流値であり、第7図(イ)に示すような低
速時のシグナルパルスSであれば、フィルタ回路を通し
た後でも充分なパルス幅が確保され、第7図(ニ)に示
すように点火コイルの電流値をIslまで上昇させられ
、Isoを優に越えられる。しかし、第7図(ロ)に示
すような高速時のシグナルパルスSになると、フィルタ
回路を通すことにより、同図の例ではパルス幅の半分を
失われてしまう。その結果、フィルタ回路を通した後の
パルスは、第7図(ハ)において、立上がりをパルスS
′と同じとすると、立下がりは一点鎖線で示す時点にな
り、第7図(ハ)に示すように点火コイルの電流値はI
s2までしか上昇させることができず、IsOに届かな
い。そのために点火困難のような問題を生ずることとな
るのである。In other words, in Figure 7 (d), Iso is the minimum current value required for the ignition coil, and if the signal pulse S at low speed as shown in Figure 7 (a) is used, even after passing through the filter circuit. A sufficient pulse width is ensured, and the current value of the ignition coil can be increased to Isl, as shown in FIG. 7(d), and can easily exceed Iso. However, when it comes to a high-speed signal pulse S as shown in FIG. 7(b), half of the pulse width is lost in the example shown in the figure by passing it through the filter circuit. As a result, the pulse after passing through the filter circuit has the rising edge as the pulse S in FIG. 7(c).
' is the same, the fall will be at the point indicated by the dashed line, and the current value of the ignition coil will be I as shown in Figure 7 (c).
It can only be raised to s2 and does not reach IsO. This results in problems such as difficulty in ignition.
さらに第8図に破線で示すように、エンジンの回転速度
が高速になる程、パルス時間幅の除去される割合が高く
なってデユーティの低下が著しくなるため、高速である
ほど問題は深刻になる。Furthermore, as shown by the broken line in Figure 8, the higher the engine speed, the higher the rate at which the pulse time width is removed and the more significant the reduction in duty becomes, so the problem becomes more serious as the engine speed increases. .
そこで、従来にあってはやむを得ず、第9図に示すよう
に、上記遅延時間をエンジン回転速度の高速側で最大限
許容される値に設定していた。Therefore, in the past, it was unavoidable to set the delay time to the maximum allowable value on the high side of the engine rotational speed, as shown in FIG.
そのため、エンジンの低速回転時にノイズの除去が充分
に行われず、上記したような点火タイミングの制御不良
を生じることがあった。Therefore, when the engine rotates at low speed, noise is not removed sufficiently, which may result in the above-described poor control of ignition timing.
(発明が解決しようとする課題)
上記したように従来のフィルタ回路にあっては、入力信
号の周波数との関係で時定数の設定に難点を生ずる場合
があった。(Problems to be Solved by the Invention) As described above, in conventional filter circuits, there are cases where difficulties arise in setting the time constant in relation to the frequency of the input signal.
本発明は、上記従来技術の有する問題点に鑑みてなされ
たもので、その目的とするところは、入力信号の周波数
に応じて時定数を可変としたフィルタ回路を提供するこ
とにある。The present invention has been made in view of the problems of the prior art described above, and an object thereof is to provide a filter circuit whose time constant is variable according to the frequency of an input signal.
(課題を解決するための手段)
本発明のフィルタ回路は、カレントミラー回路における
出力電流の流路抵抗と、このカレントミラー回路におけ
る出力電流の流路に対し並列に接続されたコンデンサの
容量とに基づく時定数を持ち、この時定数で入力信号の
パルス前縁部に対する出力信号のパルス前縁部の追従を
拒否することにより、上記時定数に満たない持続時間を
有するパルスを入力信号から除去する遅延回路部と、上
記人力信号を、その周波数に応じた値の電流信号に変換
し、この電流信号を上記カレントミラー回路の入力端に
出力制御電流として与える制御電流供給回路とを備えて
いる。(Means for Solving the Problems) The filter circuit of the present invention has an output current flow path resistance in a current mirror circuit and a capacitance of a capacitor connected in parallel to the output current flow path in the current mirror circuit. a pulse having a duration less than the time constant is removed from the input signal by refusing to follow the leading edge of the pulse of the output signal with the leading edge of the pulse of the input signal with this time constant. The control current supply circuit includes a delay circuit section and a control current supply circuit that converts the human input signal into a current signal having a value corresponding to its frequency and supplies this current signal to the input end of the current mirror circuit as an output control current.
(作 用)
本発明によれば、遅延回路部の時定数の抵抗値がカレン
トミラー回路における出力電流の流路抵抗により設定さ
れ、この流路抵抗はカレントミラー回路へ入力する制御
電流の周波数特性に応じて変化する出力電流値に依存す
ることとなるため、遅延回路部の時定数を入力信号の周
波数に応じて変化させることができることとなる。(Function) According to the present invention, the resistance value of the time constant of the delay circuit section is set by the flow path resistance of the output current in the current mirror circuit, and this flow path resistance is determined by the frequency characteristics of the control current input to the current mirror circuit. Therefore, the time constant of the delay circuit section can be changed depending on the frequency of the input signal.
(実施例)
以下に本発明の実施例について図面を参照しつつ説明す
る。(Example) Examples of the present invention will be described below with reference to the drawings.
第2図は本発明に係るフィルタ回路を組込む点火装置の
ドライバの構成を示すものである。FIG. 2 shows the configuration of a driver for an ignition device incorporating a filter circuit according to the present invention.
この図において、201は入力回路、202は本発明に
係るフィルタ回路、203は出力回路である。In this figure, 201 is an input circuit, 202 is a filter circuit according to the present invention, and 203 is an output circuit.
入力回路201は電磁ピックアップ信号を波形整形して
パルス信号を出力する。このパルス信号はエンジンの回
転速度が高速であるほど周波数が高く且つデユーティが
高いものである。The input circuit 201 shapes the waveform of the electromagnetic pickup signal and outputs a pulse signal. The higher the rotational speed of the engine, the higher the frequency and duty of this pulse signal.
このパルス信号はフィルタ回路202に入力され、この
フィルタ回路202によってそのノイズか除去される。This pulse signal is input to a filter circuit 202, and the noise is removed by this filter circuit 202.
このフィルタ回路202の出力信号は出力回路203で
増幅され、点火装置に送られる。The output signal of this filter circuit 202 is amplified by an output circuit 203 and sent to the ignition device.
第1図は本発明の一実施例に係るフィルタ回路の回路構
成を示すものである。FIG. 1 shows the circuit configuration of a filter circuit according to an embodiment of the present invention.
この図に示す回路は機能により遅延回路部と制御電流発
生回路部とに大別される。The circuit shown in this figure is roughly divided into a delay circuit section and a control current generation circuit section depending on the function.
遅延回路部はNPN型トランジスタ101〜105と抵
抗器106〜108と定電流源回路109.110とコ
ンデンサ111とを備えている。The delay circuit section includes NPN transistors 101 to 105, resistors 106 to 108, constant current source circuits 109 and 110, and a capacitor 111.
入力信号はトランジスタ101のベースに与えられる。An input signal is applied to the base of transistor 101.
Viはその電圧値である。抵抗器106は、このトラン
ジスタ101のベース抵抗を、抵抗器107は、同トラ
ンジスタ101のコレクタ抵抗を構成する。Vi is the voltage value. Resistor 106 constitutes a base resistance of this transistor 101, and resistor 107 constitutes a collector resistance of this transistor 101.
トランジスタ102のベースはトランジスタ101のコ
レクタに接続され、抵抗器ICl3は、このトランジス
タ102のコレクタ抵抗を構成する。The base of transistor 102 is connected to the collector of transistor 101, and resistor ICl3 constitutes the collector resistance of this transistor 102.
トランジスタ103はトランジスタ102とダーリント
ン接続され、定電流源回路110は、このトランジスタ
102のコレクタに流れる電流を一定値に保持する。Transistor 103 is Darlington connected to transistor 102, and constant current source circuit 110 maintains the current flowing through the collector of transistor 102 at a constant value.
トランジスタ104,105はカレントミラー回路を構
成している。すなわち、両トランジスタ104.105
はベース同士が接続され、トランジスタ104のコレク
タとベースとは共通に接続されており、トランジスタ1
04のコレクタに流れる電流値と同じ値の電流■1がト
ランジスタ105のコレクタに流れ、そのラインの抵抗
値が決まるようになっている。Transistors 104 and 105 constitute a current mirror circuit. That is, both transistors 104.105
The bases of transistor 104 are connected to each other, and the collector and base of transistor 104 are commonly connected.
A current 1 having the same value as the current value flowing through the collector of transistor 04 flows through the collector of transistor 105, and the resistance value of that line is determined.
トランジスタ104のコレクタは定電流源回路109に
接続され、トランジスタ104は、この定電流源回路1
09により常時バイアスされるとともに、トランジスタ
105のコレクタはトランジスタ102のエミッタに接
続され、トランジスタ102のターンオンを待機して、
そのコレクタに電流11が流れるようになっている。The collector of the transistor 104 is connected to the constant current source circuit 109, and the transistor 104 is connected to the constant current source circuit 109.
09, and the collector of transistor 105 is connected to the emitter of transistor 102, waiting for transistor 102 to turn on.
A current 11 is allowed to flow through its collector.
コンデンサ111はトランジスタ102のエミッタとト
ランジスタ103のコレクタとの間に接続されている。Capacitor 111 is connected between the emitter of transistor 102 and the collector of transistor 103.
ここで、このように構成された遅延回路部の動作につい
て説明する。Here, the operation of the delay circuit section configured as described above will be explained.
入力電圧Vtとして“H(ハイレベル)”が入力される
と、トランジスタ101がオンとなる。When "H (high level)" is input as the input voltage Vt, the transistor 101 is turned on.
これにより、トランジスタ102のベースは“L(ロー
レベル)”となるために、このトランジスタ102はオ
フされ、連動してトランジスタ103がオフとなり、出
力電圧VOは“H”となる。As a result, the base of the transistor 102 becomes "L" (low level), so this transistor 102 is turned off, and in conjunction, the transistor 103 is turned off, and the output voltage VO becomes "H".
また、入力電圧Viとして“Loが入力されると、トラ
ンジスタ101はオフとなる。これにより、トランジス
タ102のベースは“Hoとなるために、このトランジ
スタ102はオンとなり、連動してトランジスタ103
がオンとなり、出力電圧Voは“Loとなる。Furthermore, when "Lo" is inputted as the input voltage Vi, the transistor 101 is turned off.As a result, the base of the transistor 102 becomes "Ho", so this transistor 102 is turned on, and in conjunction, the transistor 103
is turned on, and the output voltage Vo becomes "Lo".
つまり、コンデンサ111を抜きにして考えると出力電
圧Voのレベルは入力電圧Vi と同期して同一のレベ
ルになる。In other words, when considering without the capacitor 111, the level of the output voltage Vo becomes the same level in synchronization with the input voltage Vi.
ここで、このコンデンサ111は、トランジスタ102
がオン状態のときに充電され、トランジスタ102がオ
フ状態のときに放電する。よってトランジスタ102が
ターンオフしても、コンデンサ111の電位がその放電
の最中に“Hoに保持される時間だけトランジスタ10
3はオン状態を持続した後にターンオフすることとなる
ため、このトランジスタ103のターンオフはトランジ
スタ102のターンオフに遅れる。このことにより、出
力信号の立上りは人力信号の立上りよりも遅れることと
なる。Here, this capacitor 111 is connected to the transistor 102
is charged when transistor 102 is on, and discharged when transistor 102 is off. Therefore, even if the transistor 102 is turned off, the transistor 10 is turned off only for the time that the potential of the capacitor 111 is held at "Ho" during its discharge.
Since the transistor 103 is turned off after remaining in the on state, the turn-off of the transistor 103 lags behind the turn-off of the transistor 102. As a result, the rise of the output signal is delayed from the rise of the human input signal.
したがって、出力信号のパルス幅は入力信号のパルス幅
よりその立上りの遅延時間分だけ短くなる。そのため、
入力信号におけるその遅延時間に満たない時間幅の信号
は除去される。これにより、入力信号のノイズが除去さ
れることとなる。Therefore, the pulse width of the output signal is shorter than the pulse width of the input signal by the delay time of its rise. Therefore,
Signals with a time width less than the delay time in the input signal are removed. This will remove noise from the input signal.
この遅延時定数は、コンデンサ111の単位時間あたり
の放電電流値が電流値11により規定されるために、電
流値11に比例する。This delay time constant is proportional to the current value 11 because the discharge current value of the capacitor 111 per unit time is defined by the current value 11.
この関係を式で表すと、次のようになる。This relationship can be expressed as follows.
Δt+cVo/11
この式中、Δtは時定数、Cはコンデンサ111の容量
である。Δt+cVo/11 In this formula, Δt is a time constant, and C is the capacitance of the capacitor 111.
次に、制御電流発生回路部はF/V (周波数/電圧)
変換回路部とV/I(電圧/電流)変換回路部とを含む
。Next, the control current generation circuit section is F/V (frequency/voltage)
It includes a conversion circuit section and a V/I (voltage/current) conversion circuit section.
F/V変換回路部は、NPN型トランジスタ112.1
13とPNP型トランジスタ114とインバータ115
と抵抗器116,117と定電流源回路118とダイオ
ード119とコンデンサ120とを備えている。The F/V conversion circuit section includes an NPN transistor 112.1.
13, PNP transistor 114, and inverter 115
, resistors 116 and 117, a constant current source circuit 118, a diode 119, and a capacitor 120.
入力信号はインバータ115によってレベルが反転され
、その反転信号がトランジスタ112のベースに与えら
れる。■1′はその電圧値である。The level of the input signal is inverted by an inverter 115, and the inverted signal is applied to the base of the transistor 112. (1) 1' is the voltage value.
定電流源回路118は同トランジスタ112のコレクタ
に接続されている。A constant current source circuit 118 is connected to the collector of the transistor 112.
抵抗3116とコンデンサ120とは積分回路を構成し
ており、この積分回路にはトランジスタ112がオフの
ときダイオード119を介して定電流源回路118から
定電流が供給され、その積分値Vcを出力する。The resistor 3116 and the capacitor 120 constitute an integrating circuit, and a constant current is supplied to this integrating circuit from the constant current source circuit 118 via the diode 119 when the transistor 112 is off, and outputs the integrated value Vc. .
トランジスタ113,114はインピーダンス変換回路
を構成する。トランジスタ113のベスは積分回路の出
力端に接続され、トランジスタ114のベースはトラン
ジスタ113のコレクタに接続されている。よって、積
分回路の出力電位Vcはトランジスタ113のエミッタ
ーベースにより電位Vfだけ引上げられ、トランジスタ
114のベース−エミッタにより電位Vfだけ引下げら
れ、トランジスタ114のエミッタの電位は積分回路と
同じ<Vcとなる。このトランジスタ114のエミッタ
はF/V変換回路部の出力端子とされている。Transistors 113 and 114 constitute an impedance conversion circuit. The base of transistor 113 is connected to the output terminal of the integrating circuit, and the base of transistor 114 is connected to the collector of transistor 113. Therefore, the output potential Vc of the integrating circuit is raised by the potential Vf by the emitter base of the transistor 113, and lowered by the potential Vf by the base-emitter of the transistor 114, so that the potential of the emitter of the transistor 114 becomes <Vc, which is the same as that of the integrating circuit. The emitter of this transistor 114 is used as an output terminal of the F/V conversion circuit section.
ここで、このF/V変換回路部の動作について説明する
。Here, the operation of this F/V conversion circuit section will be explained.
まず、入力電圧Viとして“H″ (電圧Vl’として
は“L”)が入力されると、トランジスタ112はオフ
となり、定電流源回路118から上記積分回路へ電流が
供給される。これにより、コンデンサ120が充電され
、その電位が上昇する。First, when "H" is input as the input voltage Vi ("L" as the voltage Vl'), the transistor 112 is turned off, and current is supplied from the constant current source circuit 118 to the integrating circuit. This charges the capacitor 120 and increases its potential.
また、入力電圧VIとして“L″ (電圧V1°として
は“H”)が入力されると、トランジスタ112はオン
となるために、定電流源回路118からの電流供給はな
くなる。そして、コンデンサ120が抵抗器116を通
じて放電する。Further, when "L" is input as the input voltage VI ("H" as the voltage V1°), the transistor 112 is turned on, so that no current is supplied from the constant current source circuit 118. Capacitor 120 then discharges through resistor 116.
入力信号の反転信号は、そのデユーティが周波数に反比
例する。つまり、そのコンデンサ120の充電期間に対
する放電期間の比が周波数に反比例することとなるため
に、コンデンサ120の平均電位は周波数に比例するこ
ととなる。The duty of the inverted signal of the input signal is inversely proportional to the frequency. In other words, since the ratio of the discharging period to the charging period of the capacitor 120 is inversely proportional to the frequency, the average potential of the capacitor 120 is proportional to the frequency.
第4図(イ)はエンジン回転速度が低速のときの入力信
号の電圧v11第1図(ロ)はその反転信号の電圧Vi
゛、第4図(ハ)は同低速時における積分回路の出力電
圧VC,第4図(ニ)は同低速時における出力信号の電
圧VOs第4図(ホ)はエンジン回転速度が高速のとき
の入力信号の電圧V1、第4図(へ)はその反転信号の
電圧Vi’、第4図(ト)は同高速時における積分回路
の出力電圧vc、第4図(チ)は同高速時における出力
信号の電圧Voの各波形図である。Figure 4 (a) shows the voltage V1 of the input signal when the engine speed is low; Figure 1 (b) shows the voltage Vi of the inverted signal.
゛, Figure 4 (c) shows the output voltage VC of the integrating circuit at the same low speed, Figure 4 (d) shows the voltage VO of the output signal at the same low speed, and Figure 4 (e) shows the output voltage VC when the engine rotation speed is high. The voltage V1 of the input signal is shown in FIG. FIG. 3 is a waveform diagram of the voltage Vo of the output signal in FIG.
これらの図に示すように、入力信号の反転信号V1’は
、そのデユーティが低速時より高速時の方が低く、その
コンデンサ120の充電期間に対する放電期間の比が高
速時のほうが高くなるため、コンデンサ120の平均電
位は周波数に比例することとなる。As shown in these figures, the duty of the inverted input signal V1' is lower at high speed than at low speed, and the ratio of the discharging period to the charging period of the capacitor 120 is higher at high speed. The average potential of capacitor 120 will be proportional to frequency.
つまり、図中、Vsaxlは低速時のVcの最大値、V
minlは同最小値、V+gax2は高速時のVCの最
大値、Vsin2は同最小値である。That is, in the figure, Vsaxl is the maximum value of Vc at low speed, V
minl is the same minimum value, V+gax2 is the maximum value of VC at high speed, and Vsin2 is the same minimum value.
vloのデユーティは低速時・高速時ともに50%を割
るから、低速時・高速時共に次第に最大ピーク値まで上
昇することから最大値V g+axl。Since the duty of vlo is less than 50% at both low and high speeds, it gradually increases to the maximum peak value at both low and high speeds, so the maximum value is V g + axl.
Vsax2は同程度の値になる。しかし、放電時間が低
速時の方が長く、逆に高速時の方が短くなるために、最
小値に関しては放電量の違いでV■in2 >Vmin
lの関係となる。よって、最大値は同程度であり、最小
値は高速時の方が高くなるために、Vcの平均値は高速
時の方が低速時よりも大きな値になる。Vsax2 has a similar value. However, since the discharge time is longer at low speeds and shorter at high speeds, the minimum value is V in2 > Vmin due to the difference in discharge amount.
The relationship is l. Therefore, the maximum value is about the same, and the minimum value is higher at high speed, so the average value of Vc is larger at high speed than at low speed.
したがって、当該F/V変換回路の出力端子の電位はエ
ンジン回転速度が高速であるほど高く、入力電圧v1の
周波数fiに比例することとなる。Therefore, the potential at the output terminal of the F/V conversion circuit increases as the engine rotation speed increases, and is proportional to the frequency fi of the input voltage v1.
このようなF/V変換回路部の出力端子は上記遅延回路
部のトランジスタ104のコレクタに抵抗器121を介
して接続されている。この抵抗器121は上記V/I変
換回路部を構成している。The output terminal of such an F/V conversion circuit section is connected to the collector of the transistor 104 of the delay circuit section via a resistor 121. This resistor 121 constitutes the V/I conversion circuit section.
これにより、上記カレントミラー回路の電流値は工1は
、定電流源回路109からの電流値I2に抵抗器121
での電流値■3を加えた値になり、この電流値I3は入
力電圧Vjの周波数fiに比例するため、電流値11も
入力電圧v1の周波数fiに比例することとなる。As a result, the current value of the current mirror circuit 1 is connected to the current value I2 from the constant current source circuit 109 through the resistor 121.
Since this current value I3 is proportional to the frequency fi of the input voltage Vj, the current value 11 is also proportional to the frequency fi of the input voltage v1.
つまり、抵抗器121には、F/V変換回路部の出力端
子の電位Vcからトランジスタ104のベース−エミッ
タの電位Vrを引いた値の電圧が印加されることとなる
。That is, a voltage equal to the value obtained by subtracting the base-emitter potential Vr of the transistor 104 from the potential Vc of the output terminal of the F/V conversion circuit section is applied to the resistor 121.
よって、 II −12+l3 I3− (Vc −Vl’ ) /R Vc父N の関係になる。Therefore, II -12+l3 I3-(Vc-Vl')/R Vc father N It becomes a relationship.
よって、電流値11が入力電圧Vlの周波数f1に比例
し、遅延回路部における時定数は電流値11に反比例、
すなわち第6図に示すようにエンジン回転数に反比例す
る。Therefore, the current value 11 is proportional to the frequency f1 of the input voltage Vl, and the time constant in the delay circuit section is inversely proportional to the current value 11.
That is, as shown in FIG. 6, it is inversely proportional to the engine speed.
Δt1.Δt2は低速時・高速時の各時定数である。図
に示すように、時定数は、周波数が低いほど大きくなり
、低速では充分なノイズ除去時間が得られる。逆に時定
数は入力電圧V1の周波数が高いほど短くなるために、
高速でのデユーティ不足を解消することもできる。Δt1. Δt2 is a time constant at low speed and high speed. As shown in the figure, the time constant becomes larger as the frequency becomes lower, and sufficient noise removal time can be obtained at low speeds. Conversely, the time constant becomes shorter as the frequency of input voltage V1 becomes higher.
It is also possible to eliminate the lack of duty at high speed.
第3図は本発明に係るフィルタ回路が組込まれる他種ド
ライバの構成を示すものである。FIG. 3 shows the configuration of another type of driver in which the filter circuit according to the present invention is incorporated.
この図に示すドライバには入力回路301、フィルタ回
路302、出力回路304の他、演算回路303を備え
ている。入力回路301、フィルタ回路302、出力回
路304については第2図に示す入力回路201、フィ
ルタ回路202、出力回路203と同一機能であるため
にその説明は省略する。The driver shown in this figure includes an input circuit 301, a filter circuit 302, an output circuit 304, and an arithmetic circuit 303. Since the input circuit 301, filter circuit 302, and output circuit 304 have the same functions as the input circuit 201, filter circuit 202, and output circuit 203 shown in FIG. 2, their explanation will be omitted.
演算回路303はフィルタ回路302の出力を受けて、
そのデユーティをエンジン回転数に応じて精密に調整す
るもので、例えば、フィルタ回路302の出力そのまま
ではデユーティが大きすぎる場合にはこれを小さくする
ように調整する。The arithmetic circuit 303 receives the output of the filter circuit 302, and
The duty is precisely adjusted according to the engine speed. For example, if the output of the filter circuit 302 is too large, the duty is adjusted to be smaller.
第5図はその動作の概略を示すもので、同図(イ)はフ
ィルタ回路302の出力信号電圧vo1同図(ロ)は演
算回路303の内部生成信号、同図(ハ)は演算回路3
03の出力電圧である。FIG. 5 shows an outline of the operation. FIG. 5 (A) shows the output signal voltage vo of the filter circuit 302, FIG.
This is the output voltage of 03.
演算回路303では、フィルタ回路302からの信号の
オン期間を積分して第5図(ロ)に示すような鋸波を生
成し、これを所定のしきい値vthでスライスして、第
5図(ハ)に示すようなデユーティを小さくした信号を
生成する。これを出力回路304を介して点火装置に与
える。The arithmetic circuit 303 integrates the ON period of the signal from the filter circuit 302 to generate a sawtooth wave as shown in FIG. A signal with a reduced duty as shown in (c) is generated. This is supplied to the ignition device via the output circuit 304.
従来にあっては、ノイズの除去が不十分であったために
、演算回路303でのデユーティ演算に誤差を生ずるこ
ととなっていた。が、本実施例のフィルタ回路によれば
、ノイズは確実に除去されるため、演算誤差をなくすこ
とができる。In the past, noise removal was insufficient, resulting in an error in the duty calculation in the calculation circuit 303. However, according to the filter circuit of this embodiment, since noise is reliably removed, calculation errors can be eliminated.
以上説明したように本発明によれば、遅延回路部の時定
数の抵抗値がカレントミラー回路における出力電流の流
路抵抗により設定され、二〇流路抵抗はカレントミラー
回路へ入力する制御電流の周波数特性に応じて変化する
出力電流値に依存することとなるため、遅延回路部の時
定数を入力信号の周波数に応じて変化させることができ
ることとなる。As explained above, according to the present invention, the resistance value of the time constant of the delay circuit section is set by the flow path resistance of the output current in the current mirror circuit, and the 20 flow path resistance is the flow path resistance of the control current input to the current mirror circuit. Since it depends on the output current value which changes according to the frequency characteristics, the time constant of the delay circuit section can be changed according to the frequency of the input signal.
第1図は本発明の一実施例に係るフィルタ回路の回路図
、第2図は第1図に示すフィルタ回路が組込まれるドラ
イバの一例を示すブロック図、第3図は同ドライバの他
の例を示すブロック図、第4図は第1図に示すフィルタ
回路の動作を示す信号波形図、第5図は第3図に示す演
算回路の動作を示す信号波形図、第6図は第1図に示す
フィルタ回路のエツジ回転数に対する時定数の変化特性
を示す曲線図、第7図は従来のフィルタ回路の動作を示
す信号波形図、第8図は点火装置において要求するフィ
ルタ回路の出力デユーティと従来のフィルタ回路の出力
デユーティとの関係を示す曲線図、第9図は要求される
ノイズ除去時間と従来のフィルタ回路におけるノイズ除
去時間との関係を示す曲線図である。
101〜105・・・遅延回路部を構成するNPN型ト
ランジスタ(104,105・・・カレントミラー回路
を構成するトランジスタ)、111・・遅延回路部のコ
ンデンサ、112,113・・・制御電流発生回路部を
構成するNPN型トランジスタ、114・・・同PNP
型トランジスタ、115・・・同インバータ、116・
・同F/V変換用抵抗器、120・・・同F/V変換用
コンデンサ、121は同V/I変換用抵抗器。Fig. 1 is a circuit diagram of a filter circuit according to an embodiment of the present invention, Fig. 2 is a block diagram showing an example of a driver in which the filter circuit shown in Fig. 1 is incorporated, and Fig. 3 is another example of the same driver. FIG. 4 is a signal waveform diagram showing the operation of the filter circuit shown in FIG. 1, FIG. 5 is a signal waveform diagram showing the operation of the arithmetic circuit shown in FIG. 7 is a signal waveform diagram showing the operation of the conventional filter circuit, and FIG. 8 shows the output duty of the filter circuit required in the ignition system. FIG. 9 is a curve diagram showing the relationship between the output duty of the conventional filter circuit and the required noise removal time and the noise removal time of the conventional filter circuit. 101 to 105... NPN transistors forming the delay circuit section (104, 105... transistors forming the current mirror circuit), 111... Capacitors of the delay circuit section, 112, 113... Control current generation circuit NPN type transistors constituting the section, 114...PNP
type transistor, 115...same inverter, 116...
・Resistor for F/V conversion, 120...Capacitor for F/V conversion, 121 is a resistor for V/I conversion.
Claims (1)
カレントミラー回路における出力電流の流路に対し並列
に接続されたコンデンサの容量との時定数を持ち、この
時定数で入力信号のパルス前縁部に対する出力信号のパ
ルス前縁部の追従を拒否することにより、前記時定数に
満たない持続時間を有するパルスを前記入力信号から除
去する遅延回路部と、 前記入力信号の周波数に応じた値の電流信号を前記カレ
ントミラー回路の入力端に出力制御電流として与える制
御電流発生回路部と、 を備えているフィルタ回路。[Claims] It has a time constant of the flow path resistance of the output current in the current mirror circuit and the capacitance of the capacitor connected in parallel to the flow path of the output current in the current mirror circuit. a delay circuit for removing pulses from the input signal having a duration less than the time constant by refusing to follow a pulse leading edge of the output signal with respect to a pulse leading edge of the signal; a control current generation circuit section that supplies a current signal having a value corresponding to the current mirror circuit to an input terminal of the current mirror circuit as an output control current;
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP21102590A JPH0494464A (en) | 1990-08-09 | 1990-08-09 | Filter circuit |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP21102590A JPH0494464A (en) | 1990-08-09 | 1990-08-09 | Filter circuit |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0494464A true JPH0494464A (en) | 1992-03-26 |
Family
ID=16599114
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP21102590A Pending JPH0494464A (en) | 1990-08-09 | 1990-08-09 | Filter circuit |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0494464A (en) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0730339A (en) * | 1993-07-07 | 1995-01-31 | Nippondenso Co Ltd | Monolithic power amplifying integrated circuit |
-
1990
- 1990-08-09 JP JP21102590A patent/JPH0494464A/en active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0730339A (en) * | 1993-07-07 | 1995-01-31 | Nippondenso Co Ltd | Monolithic power amplifying integrated circuit |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
EP0503571B1 (en) | Pulse-width modulation amplifier | |
JPH0494464A (en) | Filter circuit | |
JPH05226994A (en) | Gate drive circuit for igbt | |
JPH0160672B2 (en) | ||
JPH10313235A (en) | V/f conversion circuit | |
US4452220A (en) | Electronically controlled ignition system | |
US4335322A (en) | Pulse generator for producing a pulse having a pulse width dependent on an input signal | |
US4538572A (en) | Electronically controlled ignition system for an internal combustion engine | |
US4977340A (en) | Device for protecting an electrical circuit against interference pulses | |
JPH0426416A (en) | Signal transmission circuit of ultrasonic diagnostic device | |
JPH08335954A (en) | Driver circuit | |
SU1026287A1 (en) | Relaxation oscillator | |
SU1152087A2 (en) | Frequency divider | |
JP2520466B2 (en) | Time constant circuit | |
JPS645419Y2 (en) | ||
JP2712522B2 (en) | Induction heating cooker | |
JPH0412792Y2 (en) | ||
JPH057778Y2 (en) | ||
JP2811854B2 (en) | Digital line termination controller | |
JP2532454Y2 (en) | Timer circuit | |
JPH054345Y2 (en) | ||
JP2567112B2 (en) | One-shot pulse generator | |
JPH01221018A (en) | Time constant circuit | |
JPS5811763B2 (en) | Den Atsuseigi Yohatsu Shinki | |
JPH06318842A (en) | Delay filter |