JPH04214615A - 半導体デバイスの製造方法 - Google Patents

半導体デバイスの製造方法

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JPH04214615A
JPH04214615A JP3039042A JP3904291A JPH04214615A JP H04214615 A JPH04214615 A JP H04214615A JP 3039042 A JP3039042 A JP 3039042A JP 3904291 A JP3904291 A JP 3904291A JP H04214615 A JPH04214615 A JP H04214615A
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マトヒアス ヨハネス ヨセフ テウニセン
Johanna M L Mulder
ヨハンナ マリア ランベルティナ ムルダー
Jan Haisma
ヤン ハイスマ
Wilhelmus P M Rutten
ウイルヘルムス ペトルス マリア ルテン
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、多結晶質または非晶質
シリコン層を、単結晶質シリコン基板上の酸化珪素層上
に設け、酸化珪素層における開口を介してシリコン基板
と接触させ、熱を開口において集中するための手段の存
在下熱処理により少くとも開口において単結晶質層に転
換する半導体デバイスの製造方法に関するものである。
【0002】
【従来の技術】上記の種類の方法は、米国特許第4,5
92,799 号により知られている。酸化珪素層上の
多結晶質または非晶質層の再結晶により単結晶質シリコ
ン層を形成する方法は、現在の技術水準で知られている
【0003】
【発明が解決しようとする課題】この方法は誘導された
高い基板温度および熱勾配のために基板が損傷を受ける
。これにより半導体デバイスおよび基板に存在する回路
の特性が悪化する。再結晶における他の問題は、多結晶
質または非晶質層上にしばしば存在する被覆酸化珪素層
の下でシリコン物質移動が起って単結晶質シリコン層が
均一な厚さで形成されないことである。第3の問題は次
の通りである。上記米国特許の方法では、熱を集中する
手段が金属珪化物から成り、これは供給するのが複雑で
時間がかかり高価で特に高い温度で汚染する。本発明の
目的は、特に上記問題を殆どなくすことにある。
【0004】
【課題を解決するための手段】従って本発明において、
序文に記載した方法は、熱処理前に多結晶質または非晶
質のシリコン層に第2酸化珪素層、第2多結晶質または
非晶質シリコン層および被覆層の形態で上記手段を設け
ること、および第2酸化珪素層に、第2酸化珪素層の残
りの部分の厚さより薄い厚さを、第1酸化珪素層の開口
において与えること並びに転換した第1シリコン層に熱
処理後回路素子を設けることを特徴とする。本発明は特
に、上記問題が上記の付加的層により回避されることを
認知したことに基づく。相互の頂部における2層の多結
晶質または非晶質シリコン層を同時に再結晶する場合に
は、下層(第1層)は極めて平坦なままで、大きい結晶
を生ずることを見出した。特に、開口上の薄い酸化物に
よって一層大なる熱流が生じ、これにより第1酸化珪素
層における開口の存在によって生ずる熱損失を補償する
ことができる。基板の損傷は生じない。或いはまた、本
発明の方法において熱を集中するための手段は、標準の
技術的方法によって形成することができる。熱処理にお
けるシリコン滴の形成は、被覆層により回避される。被
覆層は例えば酸化珪素から成る。好ましくは、開口に、
でき得れば長さ方向において中断することができる長く
て狭い溝の形状を与える。溝の方向に対して〔100〕
または〔110〕の方向を選ぶのが好ましい。熱処理は
レーザーによって実施するのが好ましい。この場合、比
較的厚い被覆層を使用することができる。連続波二酸化
炭素レーザーを使用して特に良好な結果を得ることがで
きる。生成する溶融スポットはこの方法で溝方向に移動
させられる。比較的薄い第1多結晶質または非晶質シリ
コン層を用い、比較的厚い主として高い電圧および出力
の半導体デバイスとしてサブミクロンのMOSTデバイ
スをつくることができる。
【0005】
【実施例】本発明を、図面を参照して実施例につき説明
する。本例は多結晶質若しくは非晶質酸化珪素層3を、
単結晶質シリコン基板1上の酸化珪素層2上に設け、酸
化珪素層2における1個または数個の開口を介してシリ
コン基板1と接触させる、半導体デバイスの製造方法に
関するものである。層3は開口4において熱を集中させ
るための手段の存在下で少くとも開口4において熱処理
により単結晶層に転換させる。本発明において、これ等
の手段は第2酸化珪素層5、第2多結晶質または非晶質
シリコン層6、および被覆層7から成り、第2酸化珪素
層5は開口4における厚さを第2酸化珪素層5の残りの
部分の厚さより薄くする。熱処理後、転換した第1シリ
コン層3に回路素子(図示せず)を設ける。基板1、層
2,3,5,6および7並びに開口4は常法で設ける。 従って、n形単結晶シリコン基板を基板1に使用する。 層2は1μm の幅の開口4を有する厚さ1.2 μm
 の酸化珪素層である。開口4において、それ自体既知
の選択エピタキシにより、開口4を層2の厚さまで単結
晶シリコンで満たす。層3は0.5 μm の厚さを有
する多結晶質または非晶質シリコン層である。層5は厚
さ1.0 μm の酸化珪素層で、開口4上に幅2μm
、厚さ0.5 μm の凹所を有する。層6は厚さ0.
5 μm の多結晶質または非晶質シリコン層で、層7
は厚さ1.0 μm の酸化珪素層である。長くて狭い
、できる限り中断した溝を開口4により形成する。溝の
方向は〔100〕または〔110〕方向であるのが好ま
しい。第1多結晶質または非晶質シリコン層3をレーザ
ー、例えば連続波二酸化炭素レーザーを用いる加熱処理
により開口4からエピタキシ再結晶する。二酸化炭素レ
ーザースポットは平均横断面が8μm に等しいガウス
形、または主横断面が例えば20μm の楕円形を有す
る。レーザー処理により生ずる溶融スポットは溝の方向
に移動させられる。本発明は記載した実施例に制限され
ないことは明らかである。或いはまた再結晶すべき層の
厚さは、例えば0.1 〜0.2 μm とすることが
できる。二酸化炭素レーザーの代りに、アルゴンレーザ
ーを用いることができ、或いは電子ビームによる熱処理
を用いることができ;層7は、アルゴンレーザー若しく
は電子ビームを使用する場合には更に薄くなくてはなら
ない。開口4に対しては楕円形以外の形状が可能である
ことは明らかである。また第3二酸化珪素層および第3
多結晶質若しくは非晶質シリコン層を用いることができ
、この場合同時に2層を再結晶することができる。
【図面の簡単な説明】
【図1】本発明の方法により製造する工程における半導
体デバイスの一部分の断面図である。
【符号の説明】
1  単結晶質シリコン基板 2  酸化珪素層 3  多結晶質または非晶質酸化珪素層4  開口 5  第2酸化珪素層 6  第2多結晶質または非晶質シリコン層7  被覆

Claims (6)

    【特許請求の範囲】
  1. 【請求項1】  多結晶質または非晶質シリコン層を、
    単結晶質シリコン基板上の酸化珪素層上に設け、酸化珪
    素層における開口を介してシリコン基板と接触させ、熱
    を開口において集中するための手段の存在下熱処理によ
    り少くとも開口において単結晶質層に転換する半導体デ
    バイスの製造方法において、熱処理前、多結晶質または
    非晶質シリコン層に、第2酸化珪素層、第2多結晶質ま
    たは非晶質シリコン層および被覆層の形態で上記手段を
    設け、第2酸化珪素層に、第2酸化珪素層の残りの部分
    の厚さより薄い厚さを第1酸化珪素層の開口において与
    え、転換した第1シリコン層に熱処理後回路素子を設け
    ることを特徴とする半導体デバイスの製造方法。
  2. 【請求項2】  開口に長くて狭い溝の形状を与えるこ
    とを特徴とする請求項1記載の方法。
  3. 【請求項3】  開口を長さ方向で中断することを特徴
    とする請求項2記載の方法。
  4. 【請求項4】  溝の方向として〔100〕または〔1
    10〕方向を選定することを特徴とする請求項2または
    3記載の方法。
  5. 【請求項5】  熱処理をレーザーにより実施し、溶融
    スポットを溝の方向において移動させることを特徴とす
    る請求項2,3または4記載の方法。
  6. 【請求項6】  連続波二酸化炭素レーザーを用いるこ
    とを特徴とする請求項5記載の方法。
JP3039042A 1990-02-12 1991-02-12 半導体デバイスの製造方法 Pending JPH04214615A (ja)

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NL9000324A NL9000324A (nl) 1990-02-12 1990-02-12 Werkwijze voor het vervaardigen van een halfgeleiderinrichting.
NL9000324 1990-02-12

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JP (1) JPH04214615A (ja)
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NL (1) NL9000324A (ja)

Families Citing this family (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
FR2682128B1 (fr) * 1991-10-08 1993-12-03 Thomson Csf Procede de croissance de couches heteroepitaxiales.
US5436197A (en) * 1993-09-07 1995-07-25 Motorola, Inc. Method of manufacturing a bonding pad structure
DE102013109163B4 (de) 2013-08-23 2022-05-12 Helmholtz-Zentrum Berlin für Materialien und Energie Gesellschaft mit beschränkter Haftung Verfahren zur Herstellung polykristalliner, 3D-Strukturen aufweisender Siliziumschichten gleichmäßiger Dicke

Family Cites Families (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4358326A (en) * 1980-11-03 1982-11-09 International Business Machines Corporation Epitaxially extended polycrystalline structures utilizing a predeposit of amorphous silicon with subsequent annealing
JPS6054277B2 (ja) * 1981-08-08 1985-11-29 富士通株式会社 非単結晶半導体層の単結晶化方法
JPS59108313A (ja) * 1982-12-13 1984-06-22 Mitsubishi Electric Corp 半導体単結晶層の製造方法
US4592799A (en) * 1983-05-09 1986-06-03 Sony Corporation Method of recrystallizing a polycrystalline, amorphous or small grain material
JPS61251113A (ja) * 1985-04-30 1986-11-08 Fujitsu Ltd 非単結晶層の単結晶化方法
JPH084067B2 (ja) * 1985-10-07 1996-01-17 工業技術院長 半導体装置の製造方法
JPS62160712A (ja) * 1986-01-09 1987-07-16 Agency Of Ind Science & Technol 半導体装置の製造方法
US4915772A (en) * 1986-10-01 1990-04-10 Corning Incorporated Capping layer for recrystallization process

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NL9000324A (nl) 1991-09-02
KR910016046A (ko) 1991-09-30
US5057452A (en) 1991-10-15
EP0442565A1 (en) 1991-08-21

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