JPH03240334A - 時分割多重における集線方式 - Google Patents
時分割多重における集線方式Info
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- JPH03240334A JPH03240334A JP3789790A JP3789790A JPH03240334A JP H03240334 A JPH03240334 A JP H03240334A JP 3789790 A JP3789790 A JP 3789790A JP 3789790 A JP3789790 A JP 3789790A JP H03240334 A JPH03240334 A JP H03240334A
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- 238000000034 method Methods 0.000 claims description 6
- 238000011144 upstream manufacturing Methods 0.000 claims description 2
- 230000005540 biological transmission Effects 0.000 abstract description 2
- 238000010586 diagram Methods 0.000 description 6
- 239000000872 buffer Substances 0.000 description 2
- 238000004891 communication Methods 0.000 description 2
- 238000005070 sampling Methods 0.000 description 2
- 238000005516 engineering process Methods 0.000 description 1
Landscapes
- Time-Division Multiplex Systems (AREA)
- Use Of Switch Circuits For Exchanges And Methods Of Control Of Multiplex Exchanges (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概要］
回線を収容する複数個の回線対応部と時分割方式の回線
多重部とを接続するデータハイウェイを回線多重部の多
重化回路又は復号化回路に接続する時分割多重における
集線方式に関し。
多重部とを接続するデータハイウェイを回線多重部の多
重化回路又は復号化回路に接続する時分割多重における
集線方式に関し。
多重化回路の入力線又は復号化回路の出力線に対する集
線比率を変更できるようにすることを目的とし。
線比率を変更できるようにすることを目的とし。
複数本のデータハイウェイを並列にまとめて多重化回路
の入力線とり、、かつ復号化回路の出力線に接続して集
線比率を高めた構成としている。
の入力線とり、、かつ復号化回路の出力線に接続して集
線比率を高めた構成としている。
（産業上の利用分野〕
回線を収容する複数個の回線対応部と時分割方式の回線
多重部とを接続するデータハイウェイを。
多重部とを接続するデータハイウェイを。
回線多重部の多重化回路又は復号化回路に接続する時分
割多重における集線方式に関する。
割多重における集線方式に関する。
第４図は、−船釣なハードウェアの構成図を示す。図中
１０−１は回線対応部、２０−ｉは上りデータハイウェ
イ、３０−ｉは下りデータハイウェイ、６０は回線多重
部、７０は回線交換部。
１０−１は回線対応部、２０−ｉは上りデータハイウェ
イ、３０−ｉは下りデータハイウェイ、６０は回線多重
部、７０は回線交換部。
８０は呼処理部、９０はコールプロセッサを表わす。
回線対応部１０−１に接続された端末から、情報が送ら
れて来ると２回線対応部１０−ｉは当該情報をＰＣＭ信
号又はＰＡＭ信号に変換して９回線長重部６０に導びき
、当該回線多重部６０は夫々の回線対応部１０−ｉから
送られて来る信号を時分割多重方式によって多重化し９
回線交換部７０は呼処理部８０の命令に従い当該多重化
された信号の交換処理を実行する。
れて来ると２回線対応部１０−ｉは当該情報をＰＣＭ信
号又はＰＡＭ信号に変換して９回線長重部６０に導びき
、当該回線多重部６０は夫々の回線対応部１０−ｉから
送られて来る信号を時分割多重方式によって多重化し９
回線交換部７０は呼処理部８０の命令に従い当該多重化
された信号の交換処理を実行する。
第５図は集線方式の従来例を示す０図中、２０−ｉ、３
Ｏ−ｉｔ ４０−ｉ、５０．６０は第４図に対応してお
り、１Ｏ−ｔ−ｊは回線対応部１４０は上りデータハイ
ウェイ２０−１の信号を多重化する多重化回路、５０は
下りデータハイウェイ３０−１へ対応する信号を復号し
て分配する復号化回路を表している。
Ｏ−ｉｔ ４０−ｉ、５０．６０は第４図に対応してお
り、１Ｏ−ｔ−ｊは回線対応部１４０は上りデータハイ
ウェイ２０−１の信号を多重化する多重化回路、５０は
下りデータハイウェイ３０−１へ対応する信号を復号し
て分配する復号化回路を表している。
上りデータハイウェイ２０−１及び下りデータハイウェ
イ３０−１は夫々、１個又は複数個の回線対応部１Ｏ−
ｉ−１ないし１Ｏ−ｉ−ｎを回線多重部６０内の多重化
回路４０の入力線及び復号化回路５０の出力線に接続し
ている。
イ３０−１は夫々、１個又は複数個の回線対応部１Ｏ−
ｉ−１ないし１Ｏ−ｉ−ｎを回線多重部６０内の多重化
回路４０の入力線及び復号化回路５０の出力線に接続し
ている。
回線対応部１Ｏ−ｉ−ｊは５当該回線対応部１Ｏ−ｉ−
ｊに接続されている端末装置から送られて来る信号を、
ＰＡＭ信号又はＰＣＭ信号に変換して、１つの送信端末
装置に対して１つのタイムスロットを用いて上りデータ
ハイウェイ２０−１へ伝送する。
ｊに接続されている端末装置から送られて来る信号を、
ＰＡＭ信号又はＰＣＭ信号に変換して、１つの送信端末
装置に対して１つのタイムスロットを用いて上りデータ
ハイウェイ２０−１へ伝送する。
逆に９回線対応部１Ｏ−ｉ−ｊに接続されている端末装
置（図示せず）に送信されて来たときには、下りデータ
ハイウェイ３０−１が伝送してくる当該端末装置に対応
するタイムスロットの信号を元の情報に変換して、当該
端末装置へ伝送する。
置（図示せず）に送信されて来たときには、下りデータ
ハイウェイ３０−１が伝送してくる当該端末装置に対応
するタイムスロットの信号を元の情報に変換して、当該
端末装置へ伝送する。
例えば、多重化回路４０の出力線及び復号化回路５０の
入力線におけるフレーム情報においてタイムスロットの
個数が３２であり、上りデータハイウェイ２０−１及び
下りデータハイウェイ３０−ｉが夫々４本であるとする
と、均等に配分した場合には夫々のデータハイウェイ２
０−１および３０−１のタイムスロット数は８である。
入力線におけるフレーム情報においてタイムスロットの
個数が３２であり、上りデータハイウェイ２０−１及び
下りデータハイウェイ３０−ｉが夫々４本であるとする
と、均等に配分した場合には夫々のデータハイウェイ２
０−１および３０−１のタイムスロット数は８である。
したがって例えば夫々の回線対応部１Ｏ−ｉ−ｊがタイ
ムスロットを２個づつ使用するとすると、４個の回線対
応部１Ｏ−ｉ−ｊを回線多重部６０へ接続するためのデ
ータハイウェイ２０−ｉおよび３〇−１が用意される。
ムスロットを２個づつ使用するとすると、４個の回線対
応部１Ｏ−ｉ−ｊを回線多重部６０へ接続するためのデ
ータハイウェイ２０−ｉおよび３〇−１が用意される。
［発明が解決しようとする課題〕
上記集線方式によると１例えば、上記の例で集線比率を
２倍にしようとすると、８個の回線対応部１Ｏ−ｉ−ｊ
を回線多重部６０へ接続することとなり回線多重部６０
として機能を向上したものを用意しなければならない。
２倍にしようとすると、８個の回線対応部１Ｏ−ｉ−ｊ
を回線多重部６０へ接続することとなり回線多重部６０
として機能を向上したものを用意しなければならない。
本発明は、多重化回路の入力線又は復号化回路の出力線
に対する集線比率を変更できるようにすることを目的と
する。
に対する集線比率を変更できるようにすることを目的と
する。
（課題を解決するための手段〕
第１図は本発明の原理図を表している。
図中、１Ｏ−ｉ−ｊは回線対応部、２０−１は上りデー
タハイウェイ、３０−ｉは下りデータハイウェイ、４０
は多重化回路、５０は復号化回路。
タハイウェイ、３０−ｉは下りデータハイウェイ、４０
は多重化回路、５０は復号化回路。
６０は回線多重部を示している。
回線対応部１Ｏ−４−ｊは、端末装置（図示せず）から
信号が送られて来るときには、当該信号をＰＡＭ信号又
はＰＣＭ信号に変換して３例えば１つの送信端末装置に
対して１つのタイムスロットを用いてデータハイウェイ
２０−１へ伝送する。
信号が送られて来るときには、当該信号をＰＡＭ信号又
はＰＣＭ信号に変換して３例えば１つの送信端末装置に
対して１つのタイムスロットを用いてデータハイウェイ
２０−１へ伝送する。
また接続されている端末装置に送信されて来たときには
、データハイウェイ３０−ｉが伝送してくる当該装置に
対応するタイムスロットの信号を元の情報に変換して当
該端末装置へ伝送する。
、データハイウェイ３０−ｉが伝送してくる当該装置に
対応するタイムスロットの信号を元の情報に変換して当
該端末装置へ伝送する。
多重化回路４０は、上りデータハイウェイ２０−ｉから
伝送して来る信号を時分割多重方式によって多重化する
。
伝送して来る信号を時分割多重方式によって多重化する
。
復号化回路５０は２時分側条重されている信号を復号し
分配してそれぞれの出力線から出力する。
分配してそれぞれの出力線から出力する。
上りデータハイウェイ２０−１は９回線対応部１Ｏ−ｉ
−ｊと多重化回路４０とを接続しており多重化回路４０
と接続する前に、複数の上りデータハイウェイ２０−１
がワイヤードオア接続されている。
−ｊと多重化回路４０とを接続しており多重化回路４０
と接続する前に、複数の上りデータハイウェイ２０−１
がワイヤードオア接続されている。
下りデータハイウェイ３０−１は、復号化回路５０と回
線対応部１Ｏ−ｉ−ｊとを接続しており。
線対応部１Ｏ−ｉ−ｊとを接続しており。
複数の下りデータハイウェイ３０−ｉが並列に復号化回
路５０の出力線に接続されている。
路５０の出力線に接続されている。
多重化回路４０の入力線及び復号化回路５０の出力線に
おいて複数のデータハイウェイ２０−１及び３０−１を
並列に接続しているので１例えば。
おいて複数のデータハイウェイ２０−１及び３０−１を
並列に接続しているので１例えば。
集線比率がｍ：１であるデータハイウェイ２０−１を用
いて２ｍ：１等の集線比率を実現することができる。
いて２ｍ：１等の集線比率を実現することができる。
第２図は本発明の実施例を示している。
図中、２０−ｉｔ ３Ｏ−ｉｔ ４０．５０．６−
１５は第１図に対応しており、１０−ｉは回線対応部。
１５は第１図に対応しており、１０−ｉは回線対応部。
１１−１は標本化部、１２−ｉはバッファ、１３−２は
復調部、１４−ｉはラインプロセッサ。
復調部、１４−ｉはラインプロセッサ。
８０は呼処理部、９０はコールプロセッサを表している
。
。
回線対応部１０−１に接続されている端末装置（図示せ
ず）から音声やデータ等の情報が送られて来ると、標本
化部１１−ｉが当該情報をＰＣＭ信号などに変換し、バ
ッファ１２−ｉに格納する。
ず）から音声やデータ等の情報が送られて来ると、標本
化部１１−ｉが当該情報をＰＣＭ信号などに変換し、バ
ッファ１２−ｉに格納する。
ラインプロセッサ１４−１は上記格納されたＰＣＭ信号
などを、呼処理部８０から指示があったタイムスロット
によって回線多重部６０へ送出させる。
などを、呼処理部８０から指示があったタイムスロット
によって回線多重部６０へ送出させる。
逆に上記端末装置に向かって信号が送られて来ると、ラ
インプロセッサ１４−ｉは、呼処理部８０から指示があ
ったタイムスロットを復調部１３−１へ知らせ、当該復
調部１３−１は当該タイムスロットの信号を元の情報に
変換して上記端末装置へ伝送する。
インプロセッサ１４−ｉは、呼処理部８０から指示があ
ったタイムスロットを復調部１３−１へ知らせ、当該復
調部１３−１は当該タイムスロットの信号を元の情報に
変換して上記端末装置へ伝送する。
回線多重部６０は多重化回路４０と復号化回路５０とを
をする。多重化回路４０はデータハイウェイ２０−１が
接続されている入力線からの信号を時分割多重して送り
出し１復号化回路５０は送られて来る信号を復号し対応
する出力線に分配して伝送する。
をする。多重化回路４０はデータハイウェイ２０−１が
接続されている入力線からの信号を時分割多重して送り
出し１復号化回路５０は送られて来る信号を復号し対応
する出力線に分配して伝送する。
呼処理部８０は、コールプロセッサ９０を有し。
夫々の回線対応部１０−１が用いるタイムスロットの管
理を行ない、同一タイムスロットを複数個の回線対応部
１０−１が使用しないようにする。
理を行ない、同一タイムスロットを複数個の回線対応部
１０−１が使用しないようにする。
第３図はフレーム構成図を示す、第３図（ａ）はデータ
ハイウェイ２０−１のフレーム構成、第３図（ｂ）はデ
ータハイウェイ２０−２のフレーム構成、第３図（Ｃ）
はデータハイウェイ２〇−１及び２０−２が接続される
多重化回路４００Å力線のフレーム構成を表わす、タイ
ムスロットＣ４の値はタイムスロットａ、の値とタイム
スロットｂｉＯ値との論理和をとった値になる。
ハイウェイ２０−１のフレーム構成、第３図（ｂ）はデ
ータハイウェイ２０−２のフレーム構成、第３図（Ｃ）
はデータハイウェイ２〇−１及び２０−２が接続される
多重化回路４００Å力線のフレーム構成を表わす、タイ
ムスロットＣ４の値はタイムスロットａ、の値とタイム
スロットｂｉＯ値との論理和をとった値になる。
回線対応部ｔｏ−１にタイムスロットａｔ 、回線対応
部１０−２にタイムスロットａ、９回線対応部１０−３
にタイムスロットｂ３１回線対応部１０−４にタイムス
ロットｂｔを割り当てるよう呼処理部８０が指示を出し
、タイムスロットａ１の値とタイムスロットｂ１の値と
の論理和をとってタイムスロットＣ１の値としている。
部１０−２にタイムスロットａ、９回線対応部１０−３
にタイムスロットｂ３１回線対応部１０−４にタイムス
ロットｂｔを割り当てるよう呼処理部８０が指示を出し
、タイムスロットａ１の値とタイムスロットｂ１の値と
の論理和をとってタイムスロットＣ１の値としている。
そして回線対応部１０−１及び１０−３が同時に通信す
ることが生じた場合には呼処理部８０はタイムスロッ）
ａ＋及びす、の値を送出する時間をずらせて交互に便用
されるようにし、結果として同時に同一のタイムスロッ
トを使用させないようにする。
ることが生じた場合には呼処理部８０はタイムスロッ）
ａ＋及びす、の値を送出する時間をずらせて交互に便用
されるようにし、結果として同時に同一のタイムスロッ
トを使用させないようにする。
言うまでもな（、同時に通信することが生じる可能性は
一般に小であり２通信品賞の上に実質上悪影響を与える
ことはない。
一般に小であり２通信品賞の上に実質上悪影響を与える
ことはない。
以上説明した如く２本発明によれば、多重化回路の入力
線又は復号イヒ回路の出力線に対する集線比率を変更す
ることが可能となる。
線又は復号イヒ回路の出力線に対する集線比率を変更す
ることが可能となる。
第１図は本発明の原理図、第２図は本発明の実施例、第
３図はフレーム構成図、第４図は一般的なハードウェア
の構成図、第５図は集線方式の従来例を示す。 図中、１Ｏ−ｉ−ｊは回線対応部、２０−ｉは上りハイ
ウェイ、３０−４は下りハイウェイ、４０は多重化回路
、５０は復号化回路、６０は回線多重部を表す。
３図はフレーム構成図、第４図は一般的なハードウェア
の構成図、第５図は集線方式の従来例を示す。 図中、１Ｏ−ｉ−ｊは回線対応部、２０−ｉは上りハイ
ウェイ、３０−４は下りハイウェイ、４０は多重化回路
、５０は復号化回路、６０は回線多重部を表す。
Claims (1)
- 【特許請求の範囲】 回線を収容する複数個の回線対応部（１０−ｉ−ｊ）が
、複数本のデータハイウェイ（２０−ｉ、３０−ｉ）に
よって、多重化を行なう多重化回路（４０）及び分離を
行なう復号化回路（５０）を備える時分割方式の回線多
重部（６０）と接続されている回線多重システムに関し
、上記データハイウェイ（２０−ｉ、３０−ｉ）を回線
多重部の多重化回路又は復号化回路に接続する時分割多
重における集線方式において、 複数の上り方向のデータハイウェイ（２０−ｉ）をワイ
ヤードオア形式で接続して多重化回路の入力線に接続す
るとともに、 復号化回路からの信号は複数の下り方向のデータハイウ
ェイ（３０−ｉ）に対して並列に分配するように接続し
た ことを特徴とする時分割多重における集線方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3789790A JPH03240334A (ja) | 1990-02-19 | 1990-02-19 | 時分割多重における集線方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3789790A JPH03240334A (ja) | 1990-02-19 | 1990-02-19 | 時分割多重における集線方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH03240334A true JPH03240334A (ja) | 1991-10-25 |
Family
ID=12510336
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3789790A Pending JPH03240334A (ja) | 1990-02-19 | 1990-02-19 | 時分割多重における集線方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH03240334A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5452307A (en) * | 1993-10-20 | 1995-09-19 | Hitachi, Ltd. | Data multiplexing system having at least one low-speed interface circuit connected to a bus |
-
1990
- 1990-02-19 JP JP3789790A patent/JPH03240334A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5452307A (en) * | 1993-10-20 | 1995-09-19 | Hitachi, Ltd. | Data multiplexing system having at least one low-speed interface circuit connected to a bus |
| US5757806A (en) * | 1993-10-20 | 1998-05-26 | Hitachi, Ltd. | Data multiplexing system having at least one low-speed interface circuit connected to a bus |
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