JPH0318982A - Data processing system - Google Patents
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Abstract
Description
【発明の詳細な説明】
〔産業上の利用分野］
本発明は、データ処理システムに係り、特にリアルタイ
ムでデジタルデータを処理するデータ処理システムに関
する。DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to a data processing system, and particularly to a data processing system that processes digital data in real time.
従来、例えば、入力画像から抽出された特徴によりその
画像を認識する画像処理システム等において、処理結果
の精巧さ、再現性、定量性および処理の多様さの理由に
より、デジタル処理系がしばしば用いられる。このデジ
タル処理系では、映像を画素の集合として取り扱う必要
があり、画素に関する演算は膨大なものとなる。例えば
５１２×５１２画素、ＲＧＢ各８ビットの画素について
粒度分布の測定を行うためには、処理速度２０ＭＩＰＳ
程度の超大型コンビエータを用いて計算したとしても数
秒の処理時間が必要であり、リアルタイム処理には十分
な速さではない。そこで、画像処理のための専用ＩＣに
より映像処理の高速化が図られたものもあるが、この専
用ＩＣの用途は極めて狭く、広範囲の映像処理には適用
できない。Conventionally, digital processing systems have often been used, for example, in image processing systems that recognize images based on features extracted from an input image, due to the sophistication, reproducibility, quantitative nature of the processing results, and the diversity of processing. . In this digital processing system, it is necessary to treat the video as a collection of pixels, and the calculations regarding the pixels become enormous. For example, in order to measure the particle size distribution of 512 x 512 pixels with 8 bits each for RGB, the processing speed is 20 MIPS.
Even if calculations were performed using a super-large combinator, the processing time would be several seconds, which is not fast enough for real-time processing. Therefore, although there have been attempts to speed up video processing using a dedicated IC for image processing, the purpose of this dedicated IC is extremely narrow and cannot be applied to a wide range of video processing.
〔発明が解決しようとする課題］
本発明は、上述したような従来のデータ処理システムの
問題点に鑑み、コンパクトな構成で、高速にデータ処理
を行うことができ、しかも汎用性に冨み、かつ広くデジ
タル信号処理に用いることができるデータ処理装置を得
ることを目的としてなされたものである。[Problems to be Solved by the Invention] In view of the problems of the conventional data processing system as described above, the present invention has a compact configuration, can perform data processing at high speed, and is highly versatile. This invention was made with the aim of obtaining a data processing device that can be widely used in digital signal processing.
本発明に係る映像処理システムは、デジタルデータが入
力される入力部と、この入力部の出力データに基づいて
後処理に必要なパラメータを算出する演算部と、この演
算部の出力データを高速メモリに入力し、この高速メモ
リの出力データに対して軽演算部において演算処理を施
すとともに高速メモリに戻すことのできる変換部とを備
えたことを特徴としている。The video processing system according to the present invention includes an input section into which digital data is input, a calculation section that calculates parameters necessary for post-processing based on the output data of this input section, and a high-speed memory for storing the output data of this calculation section. The present invention is characterized in that it is equipped with a conversion section that can perform arithmetic processing on the output data of the high-speed memory in a light arithmetic section and return it to the high-speed memory.
以下図示実施例に基づいて本発明を説明する。 The present invention will be explained below based on illustrated embodiments.
第１図において、データ処理システムはデジタルデータ
が入力される入力部工０を有し、デジタルデータはこの
入力部ｌＯから、順次データ保持部１４、演算部２０、
変換部３０において処理される。演算部２０においては
、数値演算あるいは状態演算等の前処理が行われ、変換
部３０においては、最終的な処理映像や特徴量を求める
後処理が行われる。In FIG. 1, the data processing system has an input section 0 into which digital data is input, and the digital data is sequentially transmitted from this input section 10 to a data holding section 14, a calculation section 20,
It is processed in the converter 30. In the calculation unit 20, preprocessing such as numerical calculation or state calculation is performed, and in the conversion unit 30, postprocessing is performed to obtain the final processed image and feature amount.
ここで、このデータ処理システムが画像処理を行うもの
であり、かつ入力部１０に入力されるデジタルデータが
画素データであるとする。このようなデータ処理システ
ムの場合、画素データＰｉｊは一般に、第２図に示すよ
うに、１スキヤンラインごとに順次配列されて入力部１
０に入力される。Here, it is assumed that this data processing system performs image processing and that the digital data input to the input unit 10 is pixel data. In the case of such a data processing system, pixel data Pij is generally arranged sequentially for each scan line and input to the input section 1, as shown in FIG.
It is input to 0.
データ保持部１４においては、第３図に示すような一定
近傍、例えば３×３の画素データＰ （ｉ−１１＋ｌｊ
＋１、Ｐ＋ｉ−ｎ、＝、Ｐ （ｉ−１１＋ （ｊ”ｌｌ
、Ｐｉ＋Ｔｊ−１１、Ｐ ｉｎ ｊｓ Ｐ ｉｎ （ｊ
、、）、Ｐ ＜１ｏｌ）＋ ＋ｊ−１１、ＰＨ＊＋＞、
＝、Ｐ （ｉ＊１＋＋ ｌｊ＊＋１を１つのマトリック
スとして保持する。すなわちデータ保持部１４は近傍処
理部として作用する。なお、この処理領域の大きさを２
×２に設定し、あるいはより大きな領域に設定し、さら
には正方形以外の形状の領域としてもよい。In the data holding unit 14, pixel data P (i-11+lj
+1, P+i-n, =, P (i-11+ (j”ll
, Pi+Tj-11, P in js P in (j
,, ), P <1ol)+ +j-11, PH**>,
=, P (i*1++ lj*+1 is held as one matrix. In other words, the data holding unit 14 acts as a neighborhood processing unit. Note that the size of this processing area is 2
x2, or a larger area, or even an area with a shape other than a square.
このような近傍処理を行うためには、例えば第４図の回
路が有効である。すなわち、２段のラインメモリ１５．
１６を直列に接続し、第１段のラインメモリ１５に画素
データＰｊ＋ｊを入力する。For example, the circuit shown in FIG. 4 is effective for performing such neighborhood processing. That is, two stages of line memory 15.
16 are connected in series, and pixel data Pj+j is input to the first stage line memory 15.
第１段のラインメモリ１５の入力および出力と第２段の
ラインメモリ１６の出力は、それぞれ遅延部１７．１８
．１９に接続されている。遅延部１７は入力がそのまま
通過するライン１７Ａ、入力を１クロック分遅延させる
第１段Ｄフリップフロップ１７Ｂ、およびこのフリップ
フロップ１７Ｂの出力をさらに１クロツタ分遅延させる
第２段Ｄフリップフロップ１７Ｃとを備え、連続する３
つの画素データが同時に出力されるようになっている。The input and output of the first stage line memory 15 and the output of the second stage line memory 16 are connected to delay sections 17 and 18, respectively.
．． It is connected to 19. The delay unit 17 includes a line 17A through which the input passes as is, a first stage D flip-flop 17B which delays the input by one clock, and a second stage D flip-flop 17C which further delays the output of this flip-flop 17B by one clock. Prepare, consecutive 3
Two pixel data are output simultaneously.
遅延部１８．１９も同様に構成され、ライン１８Ａ、１
９Ａ、Ｄフリップフロップ１８Ｂ、１８Ｃ，１９Ｂ、１
９ｃにより、それぞれ画素データの遅延同時出力を行い
得るようになっている。Delay sections 18.19 are similarly constructed, and lines 18A, 1
9A, D flip-flop 18B, 18C, 19B, 1
9c, it is possible to perform delayed and simultaneous output of pixel data.
第１段のラインメモリ１５に画素データが順次入力され
たとき、最初の画素データＰ（ｉ−１１＋ （ｊ−１）
、Ｐｉ＋Ｔｊ−１）、Ｐ（ｉ、Ｉ）＋ （ｊ−１１はま
ず第１段のラインメモリ１５に人力され、次のスキャン
ラインの画素データＰ＋１−Ｈｌｊ、Ｐｌ、５、Ｐ（ｉ
ｏＩ）市がラインメモリ１５に入力されたときに、画素
データＰ（ｉ−Ｉｌ、＋ｊ−１＞、Ｐ直＋ （ｊ−１）
、Ｐ （ｉｏ１１＋ （ｊ−１１は次のラインメモリ１
６に転送される。次のスキャンラインの対応画素データ
Ｐ（ｉ−１１＋１４．ｌ、、Ｐ ｉｎ ＋７１１、Ｐ
（！＊１１＋ （ｊ＊ｌ＋はラインメモリ１５に入力さ
れることなく、遅延部１７に与えられる。When pixel data is sequentially input to the first stage line memory 15, the first pixel data P(i-11+ (j-1)
, Pi+Tj-1), P(i, I)+ (j-11 is first manually entered into the first stage line memory 15, and the pixel data P+1-Hlj, Pl, 5, P(i
oI) When the city is input to the line memory 15, the pixel data P(i-Il, +j-1>, P direct + (j-1)
, P (io11+ (j-11 is the next line memory 1
Transferred to 6. Corresponding pixel data P(i-11+14.l,, P in +711, P
(!*11+ (j*l+ is given to the delay unit 17 without being input to the line memory 15.
遅延部１７ではＰ （ｉ−１）＋ （ｊ。、、はＤフリ
ップフロップ１７ｃに送られてから出力され、このとき
Ｄフリップフロップ１７Ａに到達していたＰ、。In the delay unit 17, P(i-1)+(j.,,) is sent to the D flip-flop 17c and then output, and at this time, P, which has reached the D flip-flop 17A.
＋ｊ ＋ １）がＤフリップフロップ１７Ｂから出力さ
れる。一方、ラインメモリ１５に送られたＰ（ｉ−０゜
５、Ｐ ｉｎ Ｊｓ Ｐ １ｉｏｌＬ＋ ｊは、同様に
遅延部１８において、Ｄフリップフロップ１８Ｃ，１８
Ｂ、ライン１８Ａから同時に出力され、ラインメモリ１
６に送られたＰ （！−Ｉｌｌ。−１，、Ｐ ｉｎ （
ｊ−１）、Ｐ （ｉｎ＋１＋ｌｊ−１１は・フリップフ
ロップ１９Ｃ，１９Ｂ、ライン１９Ａから同時に出力さ
れる。+j + 1) is output from the D flip-flop 17B. On the other hand, P(i-0°5, P in Js P 1iolL+j sent to the line memory 15 is similarly transferred to the D flip-flops 18C and 18 in the delay unit 18.
B, simultaneously output from line 18A, line memory 1
P (!-Ill.-1,,P in (!-Ill.-1,, P in (!-Ill.-1,, P in (
j-1), P (in+1+lj-11) are simultaneously output from flip-flops 19C, 19B and line 19A.
このように、近傍処理部では、画面中の任意の３×３の
領域を保持することができる。なお領域の大きさを２×
２に設定し、あるいはより大きな領域に設定し、さらに
は正方形以外の形状の領域としてもよい、また、データ
保持部１４において簡単な演算、例えば濃度平均などの
算出を行ってもよい。In this way, the neighborhood processing section can hold any 3×3 area on the screen. Note that the area size is 2×
2, or may be set to a larger area, and may also be set to an area with a shape other than a square.Furthermore, the data holding unit 14 may perform simple calculations, such as density average calculation.
データ保持部１４から出力されたデータは、演軍部２０
（第１図）に入力され、ここで映像処理に必要なパラメ
ータが算出される。前述の平均濃度もこのようなパラメ
ータの１つであり、この演算部２０において求めること
ができる。演算部２０は第５図に示すように、状態演算
部２１および数値演算部２２のうちの少なくとも一方を
備え、状態演算部２１では連結数や、その画素が処理の
対象であるか否かの指標、オイラー数を求めるためのパ
ラメータＴ、Ｆ、Ｄ、Ｅ、処理画像とその近傍の状態を
表すコンパレート信号、その他が算出され、一方、数値
演算部２２では濃度平均や、１次微分、２次微分、フィ
ルタ処理、その他が行われる。これら演算部２１．２２
の処理は、ハードウェア的なパイプライン処理により高
速化される。The data output from the data holding section 14 is stored in the performance section 20.
(FIG. 1), where parameters necessary for video processing are calculated. The above-mentioned average density is also one of such parameters, and can be obtained in this calculation section 20. As shown in FIG. 5, the calculation section 20 includes at least one of a state calculation section 21 and a numerical calculation section 22, and the state calculation section 21 calculates the number of connections and whether or not the pixel is a target of processing. The parameters T, F, D, E for determining the index, Euler's number, a comparator signal representing the state of the processed image and its vicinity, and others are calculated, while the numerical calculation unit 22 calculates the density average, first derivative, Second order differentiation, filtering, etc. are performed. These calculation units 21.22
The processing is accelerated by hardware pipeline processing.
このような演算部２０における演算結果は、変換部３０
（第１図）に入力され、最終的な映像処理あるいは特徴
量が求められる。The calculation result in the calculation unit 20 is transferred to the conversion unit 30
(Fig. 1), and final video processing or feature quantities are determined.
変換部３０は、概念的には第６図のように構成され、高
速メモリ３１の出力の分岐に軽油軍部３２を接続し、こ
の軽油軍部３２の出力を高速メモリ３１の入力端に戻し
ている。高速メモリ３１の入力にはセレクタ３３が接続
され、軽油軍部３２の出力はこのセレクタ３３に入力さ
れる。高速メモリ３１のアドレス入力にはデータＤ１が
入力され、高速メモリ３１のデータ入力にはセレクタ３
３の出力端子が接続される。セレクタ３３には、軽油軍
部３２の出力と並列にデータＤ２が入力され、セレクタ
３３は、軽油軍部３２の出力またはデータＤ２を択一的
に高速メモリ３１に導く。高速メモリ３１としては、高
速のスタティックＲＡＭなどが使用可能である。The conversion section 30 is conceptually configured as shown in FIG. 6, and a light oil section 32 is connected to a branch of the output of the high speed memory 31, and the output of this light oil section 32 is returned to the input end of the high speed memory 31. . A selector 33 is connected to the input of the high-speed memory 31, and the output of the light oil military unit 32 is input to this selector 33. Data D1 is input to the address input of the high speed memory 31, and the selector 3 is input to the data input of the high speed memory 31.
3 output terminals are connected. Data D2 is input to the selector 33 in parallel with the output of the light oil unit 32, and the selector 33 selectively guides the output of the light oil unit 32 or the data D2 to the high speed memory 31. As the high-speed memory 31, a high-speed static RAM or the like can be used.
軽油軍部３２を経たデータを高速メモリ３１の入力側に
戻すことにより、一つのデータに同一の演算処理を繰り
返し施したり、一連のデータ群に同一処理を施してから
高速メモリ３１内に順次格納したりすることも可能とな
り、またデータの積算、データの漸減、データの逐次比
較など極めて多様な処理が可能となる。また、高速メモ
リ３１にデータＤ１によりアドレスを与えて、そのアド
レスに格納されたデータを読み出す、テーブルとしての
使用も可能である。By returning the data that has passed through the light oil tank 32 to the input side of the high-speed memory 31, it is possible to repeatedly perform the same arithmetic processing on a single piece of data, or to perform the same processing on a series of data groups and then sequentially store them in the high-speed memory 31. It also becomes possible to perform extremely diverse processing such as data integration, data gradual reduction, and data successive comparison. It is also possible to use it as a table by giving an address to the high-speed memory 31 using the data D1 and reading out the data stored at that address.
軽油軍部３２としては、例えば加算器を採用することが
できる。この場合、軽油軍部３２すなわち加算器には高
速メモリ３１の出力の他にデータＤ３が入力され、さら
に高速メモリ３１には、Ｃ８（チップセレクト）あるい
はＷＥ（ライトイネーブル）の信号Ｓが入力される。As the light oil unit 32, for example, an adder can be adopted. In this case, in addition to the output of the high-speed memory 31, data D3 is input to the light oil unit 32, that is, the adder, and furthermore, the signal S of C8 (chip select) or WE (write enable) is input to the high-speed memory 31. .
例えば２値画像やラベル付けされた画像において面積を
計算するとき、画素値をアドレスＤ１として指定し、高
速メモリ３１からそのアドレス内の格納データを出力し
、加算器３２でこのデータにＤ３（ここでは「ｌ」に設
定しておく。）を加えた値をセレクタ３３に戻して高速
メモリ３ＩのアドレスＤ１に再び格納する。これにより
、画像中の各画素値の画素数がカウントされ、各ラベル
領域の面積が求められる。For example, when calculating the area of a binary image or a labeled image, the pixel value is specified as address D1, the data stored in that address is output from the high-speed memory 31, and the adder 32 adds this data to D3 (here Then, set it to "l") and return the value to the selector 33 and store it again at address D1 of the high speed memory 3I. As a result, the number of pixels of each pixel value in the image is counted, and the area of each label area is determined.
第７図は、映像処理システムの第２実施例を示すもので
ある。この実施例では、人力部として、複数の入力部１
０と画像メモリ４０とをセレクタ６１により選択可能と
し、さらに、出力部として、複数の出力部６２と画像メ
モリ４０とを分配器６３により選択可能としている。入
力部ｌＯとしては、例えばＶＴＲカメラ、スキャナ、ビ
デオデツキ、レーザディスク装置、ＣＤ−ＲＯＭ、光デ
ィスク、ハードディスク、通信１７Ｆ、および画像メモ
リなどがある。一方出力部としては、入力部として挙げ
たもののうちデータ受入れの可能なもの、および画像メ
モリなどがある。FIG. 7 shows a second embodiment of the video processing system. In this embodiment, a plurality of input units 1 are used as the human power unit.
0 and the image memory 40 can be selected by a selector 61, and furthermore, a plurality of output units 62 and the image memory 40 can be selected by a distributor 63 as output units. Examples of the input unit 10 include a VTR camera, scanner, video deck, laser disk device, CD-ROM, optical disk, hard disk, communication 17F, and image memory. On the other hand, the output section includes those listed as the input section that can accept data, and an image memory.
さらにこの実施例では、演算部２０、変換部３０、セレ
クタ６１、分配器６３、および画像メモ１Ｊ４０にコン
トローラ６４を接続シ、コントローラ６４によりその設
定、制御を行っている。全体の制御、およびコントロー
ラ６４の設定、制御はＭＰＵ６５により行われる。また
、映像処理のうちの複雑な演算はＭＰＵ６５により行わ
れる。これは、演算部２０や変換部３０の負荷をあまり
に高め過ぎると演算速度が著しく低下し、処理分担は、
処理内容に応じて最適化すべきだからである５なお、変
換部３０の軽演算の内容としては、加減算、最大および
最小値抽出の他、絶対値などの数値演算や、比較、ＡＮ
Ｄ、ＯＲ，ＮＡＮＤ、ＮＯＲ，ＥＸ７ＯＲ，ＥＸ−ＮＯ
Ｒなどの論理演算を自由に選択、採用し得る。Furthermore, in this embodiment, a controller 64 is connected to the calculation section 20, conversion section 30, selector 61, distributor 63, and image memo 1J40, and the controller 64 performs settings and control thereof. Overall control and setting and control of the controller 64 are performed by the MPU 65. Further, complicated calculations in video processing are performed by the MPU 65. This is because if the load on the calculation unit 20 or conversion unit 30 is too high, the calculation speed will drop significantly, and the processing division will be
This is because it should be optimized according to the processing content5.The contents of the light operations in the conversion unit 30 include addition/subtraction, maximum and minimum value extraction, numerical operations such as absolute values, comparisons, AN
D, OR, NAND, NOR, EX7OR, EX-NO
Logical operations such as R can be freely selected and adopted.
そして、変換部３０は高速メモリ３１を備えているので
、いわゆるカラーコードからＲＧＢ値を参照するような
データ参照のためのルッ久アップテーブルとして、ある
いは、画像のラベリングなどに際しては、ラベリング情
報を高速格納するキャッシュメモリとして適用し得るこ
とはいうまでもない。Since the conversion unit 30 is equipped with a high-speed memory 31, it can be used to quickly convert labeling information into a lookup table for data reference such as referencing RGB values from a so-called color code, or when labeling an image. Needless to say, it can be applied as a cache memory for storing data.
また前記セレクタには任意の切替手段例えばワイヤード
オアなどを含む。Further, the selector includes any switching means such as a wired OR.
上記実施例においてデータ処理システムは画素データを
処理するとして説明したが、入力データは画素データに
限定されるものではない。データ処理システムが画像処
理システムである場合、入力データは、ランレングス、
輪郭（ベクトル化データ、チェーンコード）、細線化デ
ータあるいは骨格化データ等の圧縮画像データであって
もよい。In the above embodiments, the data processing system has been described as processing pixel data, but the input data is not limited to pixel data. If the data processing system is an image processing system, the input data is run length,
It may be compressed image data such as contours (vectorized data, chain code), thinned data, or skeletonized data.
また入力データは、例えばファクシミリ通信信号（例え
ばデイザ化ランレングスデータ）のような変換データで
あってもよい。さらに入力データとしては、例えば印刷
の分野における色彩計測データ、および製鉄あるいはフ
ァクトリ−オートメーション（ＦＡ）における放射温度
計測データから得られるスペクトルデータでもよい。The input data may also be converted data, such as a facsimile communication signal (eg, dithered run length data). Furthermore, the input data may be, for example, color measurement data in the field of printing, and spectral data obtained from radiation temperature measurement data in steel manufacturing or factory automation (FA).
また、データ処理システムが通信の分野に適用される場
合、入力データは、音声データの多重化データであって
もよい。このように入力データが音声データの場合、デ
ータ保持部１４（第１図、第７図）としては、データを
所定バイト単位で保持して並列に演算部２０へ出力する
シリアル／パラレル変換部が用いられる。Furthermore, when the data processing system is applied to the field of communications, the input data may be multiplexed data of audio data. In this way, when the input data is audio data, the data holding unit 14 (FIGS. 1 and 7) includes a serial/parallel conversion unit that holds data in units of predetermined bytes and outputs the data in parallel to the calculation unit 20. used.
また入力データは統計データであってもよく、この場合
、データ保持部１４は不要である。なお統計データとし
ては、リモートセンシングの場合、種々の波長帯域の観
測結果に関する種々の特徴量、海洋の波浪に関する種々
の統計量、あるいは温度分布に関する種々の統計量等が
考えられる。また統計データとして、交通量調査等にお
ける車種分布あるいは走行車両数等の種々の統計量でも
よ（、セキュリティシステムにおいては、例えば赤外線
量の経時変化量に関する計測データが入力データとなる
。さらに株価予想において用いられる株価に関する種々
の統計データも入力データとなる。Further, the input data may be statistical data, and in this case, the data holding unit 14 is not necessary. In the case of remote sensing, the statistical data may include various characteristic amounts related to observation results in various wavelength bands, various statistical amounts related to ocean waves, various statistical amounts related to temperature distribution, etc. The statistical data may also be various statistics such as the distribution of vehicle types or the number of vehicles running in traffic surveys, etc. (For example, in a security system, the input data is measured data regarding the amount of change over time in the amount of infrared rays.Furthermore, stock price predictions Various statistical data related to stock prices used in the process also serve as input data.
しかして本発明は、全てのデジタルデータに適用するこ
とができる。Therefore, the present invention can be applied to all digital data.
［発明の効果〕
以上のように本発明によれば、多くの処理に適用可能な
演算を行うとともに、この演算の結果に基づいて最終的
な処理映像や特徴量を得る変換を行うことができるので
、極めて単純な構成で多様な処理を高速で実現し得ると
いう優れた効果が得られる。[Effects of the Invention] As described above, according to the present invention, it is possible to perform calculations that can be applied to many types of processing, and to perform conversion to obtain final processed images and feature amounts based on the results of these calculations. Therefore, an excellent effect can be obtained in that various types of processing can be realized at high speed with an extremely simple configuration.
第１図はこの発明に係るデータ処理システムの第１実施
例を示すブロック図、
第２図は画素データの配列を示す概念図、第３図は３×
３の画素データの配列を示す概念図、
第４図はデータ保持部の一例を示すブロック図、第５図
は演算部の概念を示すブロック図、第６図は変換部の概
念を示すブロック図、第７図はデータ処理システムの第
２実施例を示すブロック図である。
１０・・・入力部
２０・・・演算部
３０・・・変換部FIG. 1 is a block diagram showing a first embodiment of a data processing system according to the present invention, FIG. 2 is a conceptual diagram showing an arrangement of pixel data, and FIG. 3 is a 3×
3 is a conceptual diagram showing the arrangement of pixel data, FIG. 4 is a block diagram showing an example of the data holding section, FIG. 5 is a block diagram showing the concept of the calculating section, and FIG. 6 is a block diagram showing the concept of the converting section. , FIG. 7 is a block diagram showing a second embodiment of the data processing system. 10... Input section 20... Calculation section 30... Conversion section
Claims (1)
部の出力データに基づいて後処理に必要なパラメータを
算出する演算部と、この演算部の出力データを高速メモ
リに入力し、この高速メモリの出力データに対して軽演
算部において演算処理を施すとともに高速メモリに戻す
ことのできる変換部とを備えた映像処理システム。(1) An input section into which digital data is input, an arithmetic section that calculates parameters necessary for post-processing based on the output data of this input section, and an input section that inputs the output data of this arithmetic section into a high-speed memory. A video processing system that includes a conversion unit that performs arithmetic processing on output data from a memory in a light arithmetic unit and returns the data to a high-speed memory.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15224289A JPH0318982A (en) | 1989-06-16 | 1989-06-16 | Data processing system |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15224289A JPH0318982A (en) | 1989-06-16 | 1989-06-16 | Data processing system |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0318982A true JPH0318982A (en) | 1991-01-28 |
Family
ID=15536196
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15224289A Pending JPH0318982A (en) | 1989-06-16 | 1989-06-16 | Data processing system |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0318982A (en) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5243842A (en) * | 1988-07-14 | 1993-09-14 | Showa Aluminum Kabushiki Kaisha | Method of making a brazeable metal pipe having tube-insertion apertures formed with guide lugs |
| JPH0615441A (en) * | 1989-08-25 | 1994-01-25 | Showa Alum Corp | Production of metal pipe for brazing having guide piece in tube inserting hole |
| DE112007000143T5 (en) | 2006-03-31 | 2009-02-12 | Showa Denko K.K. | Brazed pipe and method of making the same |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60129890A (en) * | 1983-12-19 | 1985-07-11 | Matsushita Electric Ind Co Ltd | Digital signal processor |
| JPS63172378A (en) * | 1987-01-12 | 1988-07-16 | Iizeru:Kk | Converting circuit |
| JPS63187373A (en) * | 1987-01-29 | 1988-08-02 | Iizeru:Kk | Arithmetic circuit |
-
1989
- 1989-06-16 JP JP15224289A patent/JPH0318982A/en active Pending
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60129890A (en) * | 1983-12-19 | 1985-07-11 | Matsushita Electric Ind Co Ltd | Digital signal processor |
| JPS63172378A (en) * | 1987-01-12 | 1988-07-16 | Iizeru:Kk | Converting circuit |
| JPS63187373A (en) * | 1987-01-29 | 1988-08-02 | Iizeru:Kk | Arithmetic circuit |
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| Publication number | Priority date | Publication date | Assignee | Title |
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| US5243842A (en) * | 1988-07-14 | 1993-09-14 | Showa Aluminum Kabushiki Kaisha | Method of making a brazeable metal pipe having tube-insertion apertures formed with guide lugs |
| JPH0615441A (en) * | 1989-08-25 | 1994-01-25 | Showa Alum Corp | Production of metal pipe for brazing having guide piece in tube inserting hole |
| DE112007000143T5 (en) | 2006-03-31 | 2009-02-12 | Showa Denko K.K. | Brazed pipe and method of making the same |
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