JPH0245271B2 - - Google Patents
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- JPH0245271B2 JPH0245271B2 JP56060352A JP6035281A JPH0245271B2 JP H0245271 B2 JPH0245271 B2 JP H0245271B2 JP 56060352 A JP56060352 A JP 56060352A JP 6035281 A JP6035281 A JP 6035281A JP H0245271 B2 JPH0245271 B2 JP H0245271B2
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- 238000012795 verification Methods 0.000 claims description 3
- 238000010586 diagram Methods 0.000 description 4
- 101000821100 Homo sapiens Synapsin-1 Proteins 0.000 description 3
- 101000821096 Homo sapiens Synapsin-2 Proteins 0.000 description 3
- 102100021905 Synapsin-1 Human genes 0.000 description 3
- 102100021994 Synapsin-2 Human genes 0.000 description 3
- 238000006243 chemical reaction Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 208000033748 Device issues Diseases 0.000 description 1
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- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
- G06F3/06—Digital input from, or digital output to, record carriers, e.g. RAID, emulated record carriers or networked record carriers
- G06F3/0601—Interfaces specially adapted for storage systems
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
- G11B20/10—Digital recording or reproducing
- G11B20/12—Formatting, e.g. arrangement of data block or words on the record carriers
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- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B27/00—Editing; Indexing; Addressing; Timing or synchronising; Monitoring; Measuring tape travel
- G11B27/10—Indexing; Addressing; Timing or synchronising; Measuring tape travel
- G11B27/102—Programmed access in sequence to addressed parts of tracks of operating record carriers
- G11B27/105—Programmed access in sequence to addressed parts of tracks of operating record carriers of operating discs
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- G11B5/00—Recording by magnetisation or demagnetisation of a record carrier; Reproducing by magnetic means; Record carriers therefor
- G11B5/48—Disposition or mounting of heads or head supports relative to record carriers ; arrangements of heads, e.g. for scanning the record carrier to increase the relative speed
- G11B5/54—Disposition or mounting of heads or head supports relative to record carriers ; arrangements of heads, e.g. for scanning the record carrier to increase the relative speed with provision for moving the head into or out of its operative position or across tracks
- G11B5/55—Track change, selection or acquisition by displacement of the head
- G11B5/5521—Track change, selection or acquisition by displacement of the head across disk tracks
- G11B5/5526—Control therefor; circuits, track configurations or relative disposition of servo-information transducers and servo-information tracks for control thereof
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- Theoretical Computer Science (AREA)
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- Indexing, Searching, Synchronizing, And The Amount Of Synchronization Travel Of Record Carriers (AREA)
- Signal Processing For Digital Recording And Reproducing (AREA)
Description
【発明の詳細な説明】
本発明は磁気記憶装置制御機構に関し、特に固
定長セクタおよび同一装置内のセクタが16、32、
64バイト等と同じ場合の可変長セクタ等の記憶媒
体を持つフオーマツトの異なる磁気記憶装置を同
一の制御機構で制御することを可能とした磁気記
憶装置の制御機構に関する。
定長セクタおよび同一装置内のセクタが16、32、
64バイト等と同じ場合の可変長セクタ等の記憶媒
体を持つフオーマツトの異なる磁気記憶装置を同
一の制御機構で制御することを可能とした磁気記
憶装置の制御機構に関する。
磁気デイスク装置、磁気ドラム装置、フロツピ
デイスク装置等の回転磁気記録体を用いる磁気記
憶装置の制御機構においては、上記装置から指定
されたアドレス情報および記録フオーマツトによ
り定められた制御情報(アドレス部、データ部の
各先頭を示す制御コード等)の各情報ごとの比較
照合回路および該比較回路に対応したタイミング
発生回路を必要とする関係で、機構規模が大きく
かつ複雑となるという問題があつた。
デイスク装置等の回転磁気記録体を用いる磁気記
憶装置の制御機構においては、上記装置から指定
されたアドレス情報および記録フオーマツトによ
り定められた制御情報(アドレス部、データ部の
各先頭を示す制御コード等)の各情報ごとの比較
照合回路および該比較回路に対応したタイミング
発生回路を必要とする関係で、機構規模が大きく
かつ複雑となるという問題があつた。
更に重要なことは、フオーマツトの異なる磁気
記憶装置に対しては、それぞれに専用の制御機構
の設計が必要とされる点である。最近は、マイク
ロ・プログラムの導入に伴なう回路規模の縮少
化、論理の簡略化および汎用化が推進されてはい
るが、マイクロ・プログラムは処理時間が長いと
いう点で適用範囲が限られるというう問題点があ
る。
記憶装置に対しては、それぞれに専用の制御機構
の設計が必要とされる点である。最近は、マイク
ロ・プログラムの導入に伴なう回路規模の縮少
化、論理の簡略化および汎用化が推進されてはい
るが、マイクロ・プログラムは処理時間が長いと
いう点で適用範囲が限られるというう問題点があ
る。
本発明は上記事情に鑑みてなされたもので、そ
の目的とするところは、従来の磁気記憶装置の制
御機構の上述の如き問題点を解消し、簡略化され
た回路構成で汎用性を有する磁気記憶装置の制御
機構を提供することにある。
の目的とするところは、従来の磁気記憶装置の制
御機構の上述の如き問題点を解消し、簡略化され
た回路構成で汎用性を有する磁気記憶装置の制御
機構を提供することにある。
上記目的を達成するため、本発明の磁気記憶装
置制御機構は、回転磁気記憶装置上のアクセスす
べきセクタに関するアドレス情報を格納する貯蔵
装置と、貯蔵装置に格納するためのアドレスおよ
び貯蔵装置から読み出すためのアドレスを指定す
るアドレスレジスタと、回転磁気記憶装置から読
み取られたアドレス情報と貯蔵装置から読み出さ
れたアドレス情報とを照合する比較回路とを設け
比較回路による照合が行なわれるごとに、アドレ
スレジスタの内容をあらかじめ定められた数だけ
加算あるいは減算することにより、回転磁気記憶
装置上のアクセスすべきセクタを検索するように
した磁気記憶装置の制御機構において、貯蔵装置
には、アクセスすべきセクタに関するアドレス情
報を格納するエリアを最大数だけ設け、動作開始
前に上位装置よりセクタに関するアドレス情報を
そのエリアに順次格納し、格納ないしエリアは空
きエリアにして、アドレス情報が格納されている
エリアには制御ビツトを立て、その制御ビツトが
立つているエリアに対してのみ比較回路を起動し
て照合を行わしめるようにしたことに特徴があ
る。
置制御機構は、回転磁気記憶装置上のアクセスす
べきセクタに関するアドレス情報を格納する貯蔵
装置と、貯蔵装置に格納するためのアドレスおよ
び貯蔵装置から読み出すためのアドレスを指定す
るアドレスレジスタと、回転磁気記憶装置から読
み取られたアドレス情報と貯蔵装置から読み出さ
れたアドレス情報とを照合する比較回路とを設け
比較回路による照合が行なわれるごとに、アドレ
スレジスタの内容をあらかじめ定められた数だけ
加算あるいは減算することにより、回転磁気記憶
装置上のアクセスすべきセクタを検索するように
した磁気記憶装置の制御機構において、貯蔵装置
には、アクセスすべきセクタに関するアドレス情
報を格納するエリアを最大数だけ設け、動作開始
前に上位装置よりセクタに関するアドレス情報を
そのエリアに順次格納し、格納ないしエリアは空
きエリアにして、アドレス情報が格納されている
エリアには制御ビツトを立て、その制御ビツトが
立つているエリアに対してのみ比較回路を起動し
て照合を行わしめるようにしたことに特徴があ
る。
すなわち、従来から使用されている専用の記憶
制御機構では、コマンドとともに送られてくる制
御情報を、トラツクレジスタやセクタレジスタ等
のレジスタに順次セツトした後、専用のプログラ
ムにより上位装置からのコマンドに従つてトラツ
ク番号やセクタ番号のチエツクを行い、一致した
ときのみコマンドが実行される。この場合、各レ
ジスタのビツト数は固定であり、プログラムも専
用であるためフオーマツトが異なると動作できな
い。これに対して本発明による制御機構では、上
位装置から送られてきた全ての指令とアドレスを
貯蔵装置に格納した後、比較回路で記憶媒体から
読み出された情報と1つずつ比較照合するので、
一致したか否かでは該当するセクタを検索するこ
とができる。本発明の貯蔵装置の各エリアは最大
ビツト数だけ用意され、かつエリア数も余裕があ
るので、フオーマツトが異なつても、同一の制御
機構で磁気記憶装置を制御することができる。
制御機構では、コマンドとともに送られてくる制
御情報を、トラツクレジスタやセクタレジスタ等
のレジスタに順次セツトした後、専用のプログラ
ムにより上位装置からのコマンドに従つてトラツ
ク番号やセクタ番号のチエツクを行い、一致した
ときのみコマンドが実行される。この場合、各レ
ジスタのビツト数は固定であり、プログラムも専
用であるためフオーマツトが異なると動作できな
い。これに対して本発明による制御機構では、上
位装置から送られてきた全ての指令とアドレスを
貯蔵装置に格納した後、比較回路で記憶媒体から
読み出された情報と1つずつ比較照合するので、
一致したか否かでは該当するセクタを検索するこ
とができる。本発明の貯蔵装置の各エリアは最大
ビツト数だけ用意され、かつエリア数も余裕があ
るので、フオーマツトが異なつても、同一の制御
機構で磁気記憶装置を制御することができる。
以下、磁気デイスク装置の舌御を例にとり、本
発明の実施例を図面に基づいて詳細に説明する。
発明の実施例を図面に基づいて詳細に説明する。
第1図は一般的な磁気デイスク装置の記録フオ
ーマツトを示すもので、符号の意味は以下の通り
である。
ーマツトを示すもので、符号の意味は以下の通り
である。
ID…セクタのアドレス情報が記録されているエ
リア GAP…ギヤツプ部 DATA…上位装置との間で転送される情報が記
録されているエリア SYN1…IDの先頭を示す制御コード FLG…当該セクタの状態を示すフラグ情報 HCA…自身のシリンダ・アドレス HA…ヘツド・アドレス HSA…自身のセクタ・アドレス ACA…代替先(もしくは代替元)のシリンダ・
アドレス ASA…代替先(もしくは代替元)のセクタ・ア
ドレス CRC…チエツク・コード SYN2…DATAの先頭を示す制御コード なお、各部分の下に添えた数字は、当該部分の
バイト数を示すものである。
リア GAP…ギヤツプ部 DATA…上位装置との間で転送される情報が記
録されているエリア SYN1…IDの先頭を示す制御コード FLG…当該セクタの状態を示すフラグ情報 HCA…自身のシリンダ・アドレス HA…ヘツド・アドレス HSA…自身のセクタ・アドレス ACA…代替先(もしくは代替元)のシリンダ・
アドレス ASA…代替先(もしくは代替元)のセクタ・ア
ドレス CRC…チエツク・コード SYN2…DATAの先頭を示す制御コード なお、各部分の下に添えた数字は、当該部分の
バイト数を示すものである。
また、第2図は本発明の実施例装置における制
御情報を格納する貯蔵装置の配列順およびその内
容を示すものである。
御情報を格納する貯蔵装置の配列順およびその内
容を示すものである。
一般に、磁気デイスク装置において上位装置か
ら指定されるアドレスは現用エリア内のアドレス
であり、そのアドレス情報に従つて磁気デイスク
装置の現用エリアに対してアクセスが行なわれ
る。この場合のフオーマツト動作としては、前記
貯蔵装置アドレス“0”番地から順次、記録フオ
ーマツトに従つて第2図Aに示す如く制御情報が
格納される。格納に際しては、次のアドレス検索
動作において比較動作を実行する情報が格納され
るアドレスについては、タイミング制御ビツトT
を“1”とし、そうでないアドレスについては同
ビツトTを“0”として区別を付して格納する。
また、HCA(H)、HCA(L)、HAおよびHSAの各部
には、アクセス動作起動前に前記上位装置から指
定されるアドレス情報がそれぞれ格納される。な
お、SYN1およびSYN2については、磁気デイス
ク制御機構が初期状態にあるときにあらかじめ格
納しておく。
ら指定されるアドレスは現用エリア内のアドレス
であり、そのアドレス情報に従つて磁気デイスク
装置の現用エリアに対してアクセスが行なわれ
る。この場合のフオーマツト動作としては、前記
貯蔵装置アドレス“0”番地から順次、記録フオ
ーマツトに従つて第2図Aに示す如く制御情報が
格納される。格納に際しては、次のアドレス検索
動作において比較動作を実行する情報が格納され
るアドレスについては、タイミング制御ビツトT
を“1”とし、そうでないアドレスについては同
ビツトTを“0”として区別を付して格納する。
また、HCA(H)、HCA(L)、HAおよびHSAの各部
には、アクセス動作起動前に前記上位装置から指
定されるアドレス情報がそれぞれ格納される。な
お、SYN1およびSYN2については、磁気デイス
ク制御機構が初期状態にあるときにあらかじめ格
納しておく。
これに対して、上位装置から指定された現用エ
リア内のセクタ部に欠陥があり、代替処理がなさ
れていた場合には、当該セクタID部に記録され
ている代替先セクタ・アドレス情報に従つて、代
替先エリアに対してアクセスが行なわれる。
リア内のセクタ部に欠陥があり、代替処理がなさ
れていた場合には、当該セクタID部に記録され
ている代替先セクタ・アドレス情報に従つて、代
替先エリアに対してアクセスが行なわれる。
この場合、代替先エリアのアクセス動作前に貯
蔵装置の内容は第2図Bに示す如く更新される。
蔵装置の内容は第2図Bに示す如く更新される。
なお、第2図A,Bにおいて*印を付したアド
レスについては値は特に定めない。
レスについては値は特に定めない。
第3図は本発明の実施例を示す制御機構のブロ
ツク図である。図において、1は前記制御情報を
格納する貯蔵装置、2は該貯蔵装置のアドレスレ
ジスタ、3は磁気デイスク装置から読取られたデ
ータのシリアル/パラレル変換を行なうシフトレ
ジスタ、4はシフトレジスタ3の出力信号と貯蔵
装置1の内容とを照合する比較回路、5はアドレ
スレジスタ2のカウントアツプ信号を作成するタ
イミング発生回路、6は前記録フオーマツトの
ID、DATA各部の先頭(SYN1、SYN2)を検出
したことを示すSYNCフラグ、そして7は比較回
路4による照合不一致があつたことを示すSKIP
フラグである。
ツク図である。図において、1は前記制御情報を
格納する貯蔵装置、2は該貯蔵装置のアドレスレ
ジスタ、3は磁気デイスク装置から読取られたデ
ータのシリアル/パラレル変換を行なうシフトレ
ジスタ、4はシフトレジスタ3の出力信号と貯蔵
装置1の内容とを照合する比較回路、5はアドレ
スレジスタ2のカウントアツプ信号を作成するタ
イミング発生回路、6は前記録フオーマツトの
ID、DATA各部の先頭(SYN1、SYN2)を検出
したことを示すSYNCフラグ、そして7は比較回
路4による照合不一致があつたことを示すSKIP
フラグである。
上述の如く構成された本実施例機構の動作につ
き、以下に説明する。
き、以下に説明する。
磁気デイスク装置の動作にあたつては、プログ
ラムにより、アドレス情報、コマンド、データ伝
送数等の制御情報が上位装置より制御機構に与え
られる。このうち、アドレス情報の制御機構への
転送は、内部バス信号aを介して、アドレスレジ
スタ2により貯蔵装置1内の所定のアドレスに第
2図Aに示す如く格納することにより行なわれ
る。制御情報の転送終了後、上位装置より動作の
起動指示がなされ、アドレス検索動作に入る。
ラムにより、アドレス情報、コマンド、データ伝
送数等の制御情報が上位装置より制御機構に与え
られる。このうち、アドレス情報の制御機構への
転送は、内部バス信号aを介して、アドレスレジ
スタ2により貯蔵装置1内の所定のアドレスに第
2図Aに示す如く格納することにより行なわれ
る。制御情報の転送終了後、上位装置より動作の
起動指示がなされ、アドレス検索動作に入る。
まず、アドレスレジスタ2は前記検索動作開始
信号bによりリセツトされ、貯蔵装置1の“0”
番地に格納されている制御情報が読出され(信号
g)比較回路4の一方に入力される。磁気デイス
ク装置から情報を読取るための制御信号c(Read
Gate信号)により磁気デイスク装置から送出さ
れる信号d(Read Data信号)および信号e
(Read Clock信号)はシフトレジスタ3に入力
され、シリアル→パラレル変換が行なわれた後、
その出力信号fは前記比較回路4の他方の入力に
接続される。
信号bによりリセツトされ、貯蔵装置1の“0”
番地に格納されている制御情報が読出され(信号
g)比較回路4の一方に入力される。磁気デイス
ク装置から情報を読取るための制御信号c(Read
Gate信号)により磁気デイスク装置から送出さ
れる信号d(Read Data信号)および信号e
(Read Clock信号)はシフトレジスタ3に入力
され、シリアル→パラレル変換が行なわれた後、
その出力信号fは前記比較回路4の他方の入力に
接続される。
比較回路4においては、貯蔵装置1から出力さ
れるタイミング制御ビツト(信号h)が“1”で
あり、前記Read Gate信号(信号c)が“1”
でかつ、SYNCフラグ6の出力信号l(SYN
DICT信号)が“0”の期間は、信号eにより磁
気デイスク装置から前記Read Data信号が1ビ
ツト転送されるごとに前記信号gと信号fとが比
較され、両者が一致した時点で検出信号jが出力
される。この信号jが出力されると、SYNCフラ
グ6がセツトされてID部の先頭を検出したこと
を示す。
れるタイミング制御ビツト(信号h)が“1”で
あり、前記Read Gate信号(信号c)が“1”
でかつ、SYNCフラグ6の出力信号l(SYN
DICT信号)が“0”の期間は、信号eにより磁
気デイスク装置から前記Read Data信号が1ビ
ツト転送されるごとに前記信号gと信号fとが比
較され、両者が一致した時点で検出信号jが出力
される。この信号jが出力されると、SYNCフラ
グ6がセツトされてID部の先頭を検出したこと
を示す。
同時に、信号jによりタイミング発生回路5か
らカウントアツプ信号nが出力され、これにより
アドレスレジスタ2の内容が加算(+1)され、
貯蔵装置1から次の制御情報が読出される。
らカウントアツプ信号nが出力され、これにより
アドレスレジスタ2の内容が加算(+1)され、
貯蔵装置1から次の制御情報が読出される。
SYNCフラグ6がセツトされ、信号lが“1”
となつた時点以降、比較回路4における比較動作
は1バイトの区切りを示すタイミング信号t
(BYT CNT信号)により1バイトごとに行なわ
れ、各比較動作終了と同時にカウントアツプ信号
nが出力され、これによりアドレスレジスタ2の
内容が加算(+1)され、以後これらの動作が繰
返される。
となつた時点以降、比較回路4における比較動作
は1バイトの区切りを示すタイミング信号t
(BYT CNT信号)により1バイトごとに行なわ
れ、各比較動作終了と同時にカウントアツプ信号
nが出力され、これによりアドレスレジスタ2の
内容が加算(+1)され、以後これらの動作が繰
返される。
上記動作において、タイミング制御ビツト(信
号h)が“0”の場合には、比較動作は行なわれ
ず、アドレスレジスタ2の更新のみが行なわれ
る。また、比較回路4における比較の結果、不一
致を検出した場合には、不一致信号kが出力さ
れ、該信号によりSKIPフラグ7がセツトされる
ので、その出力信号m(SKIP信号)の状況を検出
することにより、目的セクタを検索できたか否か
を判別することができる。
号h)が“0”の場合には、比較動作は行なわれ
ず、アドレスレジスタ2の更新のみが行なわれ
る。また、比較回路4における比較の結果、不一
致を検出した場合には、不一致信号kが出力さ
れ、該信号によりSKIPフラグ7がセツトされる
ので、その出力信号m(SKIP信号)の状況を検出
することにより、目的セクタを検索できたか否か
を判別することができる。
上記実施例においては、磁気デイスク装置の制
御における特定の記録フオーマツトを用いる場合
を説明したが、本発明はこれに限定されるべきも
のではなく、他の記録フオーマツトを用いる磁気
デイスク装置の制御、あるいは回転磁気記録体を
用いる磁気記憶装置にひろく利用できることは言
うまでもない。
御における特定の記録フオーマツトを用いる場合
を説明したが、本発明はこれに限定されるべきも
のではなく、他の記録フオーマツトを用いる磁気
デイスク装置の制御、あるいは回転磁気記録体を
用いる磁気記憶装置にひろく利用できることは言
うまでもない。
以上述べた如く、本発明によれば、貯蔵装置に
は、アクセスすべきセクタに関するアドレス情報
を格納するエリアを最大数だけ設け、動作開始前
に上位装置よりセクタに関するアドレス情報をそ
のエリアに順次格納し、格納しないエリアは空き
エリアにして、アドレス情報が格納されているエ
リアには制御ビツトを立て、その制御ビツトが立
つているエリアに対してのみ比較回路を起動し、
貯蔵装置内の情報と回転磁気記録体から読み出さ
れた情報とを比較照合するようにしたので、記録
フオーマツトの異なるる磁気記憶装置を同一の制
御機構を用いて制御することが可能となるという
顕著な実用上の効果を奏する。
は、アクセスすべきセクタに関するアドレス情報
を格納するエリアを最大数だけ設け、動作開始前
に上位装置よりセクタに関するアドレス情報をそ
のエリアに順次格納し、格納しないエリアは空き
エリアにして、アドレス情報が格納されているエ
リアには制御ビツトを立て、その制御ビツトが立
つているエリアに対してのみ比較回路を起動し、
貯蔵装置内の情報と回転磁気記録体から読み出さ
れた情報とを比較照合するようにしたので、記録
フオーマツトの異なるる磁気記憶装置を同一の制
御機構を用いて制御することが可能となるという
顕著な実用上の効果を奏する。
更に、本発明の制御機構は回路構成が簡略化さ
れ、処理時間も短縮されるので経済的効果も大な
るものがある。
れ、処理時間も短縮されるので経済的効果も大な
るものがある。
第1図は磁気デイスク装置の記録フオーマツト
を示す図、第2図A,Bは本発明の実施例装置に
おける制御情報を格納する貯蔵装置の内容を示す
図、第3図は本発明の一実施例を示す制御機構の
ブロツク図である。 1:貯蔵装置、2:アドレスレジスタ、3:シ
フトレジスタ、4:比較回路、5:タイミング発
生回路、6:SYNCフラグ、7:SKIPフラグ。
を示す図、第2図A,Bは本発明の実施例装置に
おける制御情報を格納する貯蔵装置の内容を示す
図、第3図は本発明の一実施例を示す制御機構の
ブロツク図である。 1:貯蔵装置、2:アドレスレジスタ、3:シ
フトレジスタ、4:比較回路、5:タイミング発
生回路、6:SYNCフラグ、7:SKIPフラグ。
Claims (1)
- 1 回転磁気記憶装置上のアクセスすべきセクタ
に関するアドレス情報を格納する貯蔵装置と、該
貯蔵装置に格納するためのアドレスおよび該貯蔵
装置から読み出すためのアドレスを指定するアド
レスレジスタと、該回転磁気記憶装置から読み取
られたアドレス情報と該貯蔵装置から読み出され
たアドレス情報とを照合する比較回路とを設け、
該比較回路による照合が行われるごとに、該アド
レスレジスタの内容をあらかじめ定められた数だ
け加算あるいは減算することにより、該回転磁気
記憶装置上のアクセスすべきセクタを検索するよ
うにした磁気記憶装置の制御機構において、前記
貯蔵装置には、前記アクセスすべきセクタに関す
るアドレス情報を格納するエリアを最大数だけ設
け、動作開始前に上位装置よりセクタに関するア
ドレス情報を該エリアに順次格納し、格納しない
エリアは空きエリアにして、該アドレス情報が格
納されているエリアには制御ビツトを立て、該制
御ビツトが立つているエリアに対してのみ、上記
比較回路を起動して照合を行わしめるようにした
ことを特徴とする磁気記憶装置制御機構。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP56060352A JPS57176581A (en) | 1981-04-20 | 1981-04-20 | Control mechanism for magnetic storage device |
US06/369,648 US4507693A (en) | 1981-04-20 | 1982-04-19 | Control apparatus for rotation type storage device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP56060352A JPS57176581A (en) | 1981-04-20 | 1981-04-20 | Control mechanism for magnetic storage device |
Publications (2)
Publication Number | Publication Date |
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JPS57176581A JPS57176581A (en) | 1982-10-29 |
JPH0245271B2 true JPH0245271B2 (ja) | 1990-10-08 |
Family
ID=13139672
Family Applications (1)
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---|---|---|---|
JP56060352A Granted JPS57176581A (en) | 1981-04-20 | 1981-04-20 | Control mechanism for magnetic storage device |
Country Status (2)
Country | Link |
---|---|
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JP (1) | JPS57176581A (ja) |
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- 1982-04-19 US US06/369,648 patent/US4507693A/en not_active Expired - Fee Related
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Also Published As
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