JPH0239453A - 集積回路装置 - Google Patents

集積回路装置

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JPH0239453A
JPH0239453A JP19043088A JP19043088A JPH0239453A JP H0239453 A JPH0239453 A JP H0239453A JP 19043088 A JP19043088 A JP 19043088A JP 19043088 A JP19043088 A JP 19043088A JP H0239453 A JPH0239453 A JP H0239453A
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cell
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wiring
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Naoko Shirai
白井　直子
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    • H01—ELECTRIC ELEMENTS
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    • H01L27/00—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/02—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
    • H01L27/0203—Particular design considerations for integrated circuits
    • H01L27/0207—Geometrical layout of the components, e.g. computer aided design; custom LSI, semi-custom LSI, standard cell technique

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は集積回路装置に関し、特に大規模集積回路（以
下、ＬＳＩと記す）の実装密度を向上させるため、セル
内部の電源配線の幅の改善に関する。
〔従来の技術〕
従来、この種のＬＳＩにおいて、標準セルは第４図に示
すように、セル２２内部の電源配線２３の隣り合うセル
との接続部はセル内部の電源配線の幅と同じ幅で設定さ
れていた。
〔発明が解決しようとする課題〕
上述した従来の標準セルは、第４図に示すように標準セ
ル２２の内部の電源配線２３の隣り合うセルとの接続部
の幅ａと、セル内部の電流を供給するのに必要な最小の
電源配線の幅Ｗ（以下このＷをもってセル内部の電源配
線の幅と記す）が同じ幅で設定されているため、隣り合
うセル同志を電源配線２３に対し垂直方向にずらしてし
まうと電源配線の隣り合うセルとの接続部は、ａ≧Ｗの
条件を満たせず、セル内の素子を駆動するのに必要十分
な電流を供給することができないという欠７点がある。
このため、第５図のように、複数のセルフは電源配線９
が常に一直線となるように配列する必要があった。
〔課題を解決するための手段〕
本発明の集積回路装置は、セル内部の電源配線の隣り合
うセルとの接続部の幅すをセル内部の電源配線の幅Ｗに
対しｂ＞ｗとし、セル内部の電源配線の隣り合うセルと
の接続部の幅すの厚みＣをセル内部の電源配線の幅Ｗに
対しＣ≧テシとなるように設定した構造を有している。
〔実施例〕
次に、本発明について図面を参照して説明する。
第１図は、本発明の一実施例の平面図である。
第２図は複数の標準セル１を互いにズラして配置した場
合の例である。１が標準セルの外形であり、２が配線で
あり、３が電源配線である。電源配線３のセル１の端部
の接続部４で幅を広げることにより、セル１を電源配線
３に対し垂直方向にずらすことが可能となる。
第３図は本発明のセルを用いた他の例の平面図である。
１６が標準セルの外形であり、１７が配線であり、１８
が電源配線である。電源配線１８の隣り合うセルとの接
続部１９の幅を広げて設定することにより、セル１６を
電源配線１８に対し垂直方向にずらすことが可能となる
。この実施例ではセルの上部２１を横切る配線の領域２
０が得られるという利点がある。
〔発明の効果〕
以上説明したように本発明は、標準セル内の電源配線の
接続部の幅を広げて設定することにより、セルを電源配
線に対し垂直方向にずらすことが可能となり、第２のセ
ルの上部６を横切る配線の領域５が得られ、ＬＳＩ構成
素子及び配線の領域においてチップ面積の有効利用を計
ったＬＳＩができる。具体的には、同じ機能に対しては
面積を減らすことができ、同じ面積に対しては機能を増
加することができないという効果がある。
【図面の簡単な説明】
第１図は本発明の一実施例を示す平面図、第２図及び第
３図はそれぞれ本発明の応用例を示すセル配置図である
。第４図は従来の標準セルを示す平面図、第５図は従来
の標準セルの配置例を示すセル配置図である。 １．７，１６，２２．・・・・・・標準セル、２，８゜
１７・・・・・・配線、３，９，１８．２３・・・・・
・電源配線、５．２０・・・・・・配線等に使える領域
が増えた部分、４．１９・・・・・・電源配線の隣り合
うセルとの接続部。

Claims (1)

    【特許請求の範囲】
  1. ポリセル方式のレイアウトにおける標準セルにおいて、
    セル内部の電源配線の隣り合うセルとの隣接部の幅をセ
    ル内部の電源配線の幅よりも広くしたことを特徴とする
    集積回路装置。
JP63190430A 1988-07-28 1988-07-28 集積回路装置 Expired - Lifetime JP2508206B2 (ja)

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6114734A (ja) * 1984-06-29 1986-01-22 Fujitsu Ltd 半導体集積回路装置及びその製造方法

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* Cited by examiner, † Cited by third party
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JPS6114734A (ja) * 1984-06-29 1986-01-22 Fujitsu Ltd 半導体集積回路装置及びその製造方法

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