JPH0235399U - - Google Patents
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- Publication number
- JPH0235399U JPH0235399U JP11003888U JP11003888U JPH0235399U JP H0235399 U JPH0235399 U JP H0235399U JP 11003888 U JP11003888 U JP 11003888U JP 11003888 U JP11003888 U JP 11003888U JP H0235399 U JPH0235399 U JP H0235399U
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- JP
- Japan
- Prior art keywords
- writing
- memory
- writable
- cycle
- utility
- Prior art date
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- Pending
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- 238000010586 diagram Methods 0.000 description 2
Description
第１図は本考案の一実施例のブロツク図、第２
図は本考案の実施例の要部ブロツク図、第３図は
本考案の一実施例の動作を説明するためのフロー
チヤート、第４図は本考案の一実施例を説明する
ためのタイムチヤート、第５図は従来のメモリ書
込システムを説明するためのタイムチヤートであ
る。 ２……ＣＰＵ、７〜１４……メモリチツプ、１
５……メモリ選択回路、１６……バス。
図は本考案の実施例の要部ブロツク図、第３図は
本考案の一実施例の動作を説明するためのフロー
チヤート、第４図は本考案の一実施例を説明する
ためのタイムチヤート、第５図は従来のメモリ書
込システムを説明するためのタイムチヤートであ
る。 ２……ＣＰＵ、７〜１４……メモリチツプ、１
５……メモリ選択回路、１６……バス。
Claims (1)
- 書込み可能サイクルがΔＴである複数のメモリ
チツプと、前記書込み可能サイクルΔＴより短い
書込み時間でメモリ書込みを行う書込手段とを備
え、前記書込手段は前記複数のメモリチツプに所
定順序で１アドレス毎に書込みを行うようにした
ことを特徴とするメモリ書込システム。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11003888U JPH0235399U (ja) | 1988-08-24 | 1988-08-24 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11003888U JPH0235399U (ja) | 1988-08-24 | 1988-08-24 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0235399U true JPH0235399U (ja) | 1990-03-07 |
Family
ID=31346832
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11003888U Pending JPH0235399U (ja) | 1988-08-24 | 1988-08-24 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0235399U (ja) |
-
1988
- 1988-08-24 JP JP11003888U patent/JPH0235399U/ja active Pending
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