JPH0231560A - Digital color copying machine - Google Patents
Digital color copying machineInfo
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- JPH0231560A JPH0231560A JP63182282A JP18228288A JPH0231560A JP H0231560 A JPH0231560 A JP H0231560A JP 63182282 A JP63182282 A JP 63182282A JP 18228288 A JP18228288 A JP 18228288A JP H0231560 A JPH0231560 A JP H0231560A
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Landscapes
- Laser Beam Printer (AREA)
- Color Electrophotography (AREA)
- Storing Facsimile Image Data (AREA)
Abstract
Description
【発明の詳細な説明】
(産業上の利用分野)
本発明は、スーパーインポーズ機能を有するデジタルカ
ラー複写機に関する。DETAILED DESCRIPTION OF THE INVENTION (Field of Industrial Application) The present invention relates to a digital color copying machine having a superimpose function.
(従来の技術)
デジタルカラー複写機は、カラー撮像素子を用いて原稿
を読み取り印字出力信号(2値)に変換する読取部と、
この印字出力信号に対応してペーパーに電子写真法によ
り画像を印字するプリンタ部とからなり、複数色の印字
出力を行う場合、読取部による原稿の読み取りとプリン
タ部による同じペーパーへの画像の印字とを各色ごとに
面順次で行う。(Prior Art) A digital color copying machine includes a reading unit that reads a document using a color image sensor and converts it into a print output signal (binary);
It consists of a printer section that prints an image on paper using electrophotography in response to this print output signal, and when printing in multiple colors, the reading section reads the document and the printer section prints the image on the same paper. This is done in sequence for each color.
デジタルカラー複写機において、スーパーインポーズ機
能は有用な機能である。この機能においては、スーパー
インポーズ用の画像を原稿から読み取り、メモリに記憶
しておく。そして、別の原稿を複写する場合に、メモリ
から画像データを読み出して複写することにより、この
原稿の画像の一部に他の原稿の画像を重ねて複写できる
。The superimpose function is a useful function in digital color copying machines. In this function, an image for superimposition is read from a document and stored in memory. Then, when copying another document, by reading the image data from the memory and copying it, it is possible to copy the image of the other document overlapping a part of the image of this document.
(発明が解決しようとする課題)
従来のスーパーインポーズ機能付デジタルカラー複写機
においては、メモリに記憶されるスーパーインポーズ用
画像データは、読取データ(多値)の2値化処理後の2
値データであった。(Problem to be Solved by the Invention) In a conventional digital color copying machine with a superimpose function, the image data for superimposition stored in the memory is the 2-digit image data after the binarization processing of the read data (multivalued).
It was value data.
しかし、2値化処理前の多値データをメモリに記憶して
おければ、スーパーインポーズ用画像についても色調整
や変倍処理が行える。そこで、メモリに多値データを登
録しておいてスーパーインポーズを行うデジタルカラー
複写機も提案されている。However, if multivalued data before binarization processing is stored in memory, color adjustment and scaling processing can be performed on the superimpose image as well. Therefore, a digital color copying machine has been proposed that registers multi-value data in its memory and superimposes the data.
ところで、スーパーインポーズ用画像データの容量が登
録用メモリの容量より小さい場合、全メモリ容量を常に
使用するのではなく、必要分だけメモリ容量を使用する
ようにすれば、残りは別の画像の登録に使用できる。複
数個の画像登録が可能になれば、スーパーインポーズ機
能の使い勝手がさらに向上する。By the way, if the capacity of the image data for superimposing is smaller than the capacity of the registration memory, instead of always using the entire memory capacity, you can use only the necessary memory capacity, and the rest can be used for another image. Can be used for registration. If multiple images can be registered, the usability of the superimpose function will be further improved.
特に多値データとしても2値データとしても画像登録が
できる場合、2値での記憶によりメモリ容量が削減でき
るので、元々のメモリ容量に対し複数の画像が登録でき
る余地がある。また、多値データで登録する場合でも、
メモリ容量いっばいまで登録する必要がない場合がある
。そこで、残ったメモリ容量は2値の画像データを多値
データと混在して登録できればメモリが有効に使用でき
る。In particular, when images can be registered as both multivalued data and binary data, memory capacity can be reduced by storing them in binary form, so there is room for a plurality of images to be registered with respect to the original memory capacity. Also, even when registering multivalued data,
There are cases where it is not necessary to register until the memory capacity is full. Therefore, the remaining memory capacity can be used effectively if binary image data and multi-value data can be registered together.
本発明の目的は、複数個のスーパーインポーズ画像が登
録可能なデジタルカラー複写機を提供することである。An object of the present invention is to provide a digital color copying machine that can register a plurality of superimposed images.
(課題を解決するための手段)
本発明に係るデジタルカラー複写機は、画像データを記
憶する画像記憶手段と、原稿上の注目領域と複写用紙上
の禁止領域をそれぞれ設定する領域設定手段と、領域設
定手段により設定された注目領域の原稿画像を読み取り
、画像データを画像記憶手段に記憶する画像登録手段で
あって、画像記憶手段の記憶容儀が許すかぎり複数の注
目領域の原稿画像を登録できる画像登録手段と、画像印
字用データに基づき複写用紙に印字を行う印字手段と、
領域設定手段により設定された複写用紙上の禁止領域に
印字する際に、画像記憶手段に登録された登録画像、ま
たは複数の登録画像が登録されている場合には任意の登
録画像の画像データを読み出し、印字手段に画像印字用
データを送る登録画像印字制御手段を備えたことを特徴
とする。(Means for Solving the Problems) A digital color copying machine according to the present invention includes: an image storage means for storing image data; an area setting means for setting an attention area on a document and a prohibited area on a copy sheet; An image registration means that reads a document image of an attention area set by an area setting means and stores the image data in an image storage means, and is capable of registering document images of a plurality of attention areas as long as the storage capacity of the image storage means allows. an image registration means; a printing means for printing on copy paper based on the image printing data;
When printing in the prohibited area on copy paper set by the area setting means, the image data of the registered image registered in the image storage means, or any registered image if multiple registered images are registered, is printed. The present invention is characterized by comprising registered image printing control means for reading and sending image printing data to the printing means.
(作 用)
画像登録手段により複数の注目領域の画像を画像記憶手
段に登録できる。この場合、画像記憶手段にすでに登録
された画像があれば、画像データの記憶はそのメモリ空
間を避けて必要な記憶を行う。従って、画像記憶手段の
メモリ容量が許すかぎり複数の画像が登録可能である。(Function) Images of a plurality of regions of interest can be registered in the image storage means by the image registration means. In this case, if there is an image already registered in the image storage means, the image data is stored as necessary while avoiding that memory space. Therefore, a plurality of images can be registered as long as the memory capacity of the image storage means allows.
そして、複数の画像のうちの任意の画像を出力できる。Then, any image among the plurality of images can be output.
画像登録手段が、多値の画像読取データで62値の印字
色データでも注目画像の画像データを登録できる場合は
、画像記憶手段のアドレスを適当に設定して多値データ
と2値データとを混在して画像登録手段に登録できる。If the image registration means can register the image data of the image of interest even if it is multi-valued image reading data and 62-value printing color data, set the address of the image storage means appropriately and register the multi-valued data and the binary data. A mixture of images can be registered in the image registration means.
ここに、登録後の変倍、色補正の必要性から多値で記憶
するか2値で記憶するか選択できるようにしてもよい。Here, depending on the need for scaling and color correction after registration, it may be possible to select whether to store the image in multi-value or binary form.
(実施例)
以下、添付の図面を参照して本発明の実施例を次の順序
で説明する。(Embodiments) Hereinafter, embodiments of the present invention will be described in the following order with reference to the accompanying drawings.
(a)デジタルカラー複写機の構成
(b)スーパーインポーズ機能
(c)モザイクモニタ
(d)登録画像メモリ回路
<d−1>回路構成
<d−2>多値で記憶するスーパーインポーズモード
<d−3>変倍
<d−4>モザイクモニタモードでの書込みと読出し
くd−5>2値(カラー)で記憶するスーパーインポー
ズモード
<d−6>単色(2値)で記憶するスーパーインポーズ
モード
<d−7>多値記憶と2値記憶の混在
<d−8>領域判別回路とアドレス発生カウンタ
<d−9>複数画像の書込みと続出し
くe)画調設定回路
(f)複写制御のフロー
以下余白
(a)デジタルカラー複写機の構成
本発明に係るデジタルカラー複写機は、撮像素子を用い
て原稿を読み取り印字出力信号に変換する読取部と、こ
の印字出力信号に対応してペーパーに電子写真法により
画像を印字するプリンタ部とからなる。複数色の印字出
力を行う場合、各色ごとに読取部による原稿の読み取り
と同一のペーパーへのプリンタ部による画像の印字を面
順次で行う。(a) Configuration of digital color copying machine (b) Superimpose function (c) Mosaic monitor (d) Registered image memory circuit <d-1> Circuit configuration <d-2> Superimpose mode for storing in multi-values <d-3> Scaling change <d-4> Writing and reading in mosaic monitor mode d-5> Superimpose mode for storing in binary (color) <d-6> Super for storing in single color (binary) Impose mode <d-7> Mixture of multi-value storage and binary storage <d-8> Area discrimination circuit and address generation counter <d-9> Writing of multiple images and continuous output e) Picture setting circuit (f) Flow of copying control Margin below (a) Structure of digital color copying machine The digital color copying machine according to the present invention includes a reading section that reads a document using an image sensor and converts it into a print output signal, and a reading section that corresponds to this print output signal. and a printer section that prints images on paper using electrophotography. When printing out multiple colors, the reading unit reads the document for each color, and the printer unit prints the image on the same paper in a field-sequential manner.
第1図に本発明の実施例に係るデジタルカラー複写機の
全体構成を示す。スキャナIOは、原稿を照射する露光
ランプ12、原稿からの反射光を集光するロッドレンズ
アレー13及び集光された光を電気信号に変換する密着
型のCODカラーセンザ(イメージセンサ)14を備え
ている。スキャナ10は、原稿読取時にはモータ11に
より駆動されて矢印方向に移動し、プラテン15上に載
置された原稿を走査する。光源12で照射された原稿面
の画像は、CODカラーセンサ14で光電変換される。FIG. 1 shows the overall configuration of a digital color copying machine according to an embodiment of the present invention. The scanner IO includes an exposure lamp 12 that illuminates the original, a rod lens array 13 that collects reflected light from the original, and a contact type COD color sensor (image sensor) 14 that converts the collected light into an electrical signal. There is. When reading a document, the scanner 10 is driven by a motor 11 to move in the direction of the arrow, and scans the document placed on the platen 15. The image of the document surface illuminated by the light source 12 is photoelectrically converted by the COD color sensor 14 .
C’CDカラーセンサ14により得られたR、G、Bの
3色の電気信号(多値)は、読取信号処理部20により
、イエロー、マゼンタ、シアン、ブラックのいずれかの
印字出力信号(2値)に変換され、バッファメモリ30
に記憶される。プリントヘッド部31ではバッファメモ
リ30から読み出した印字信号に従い、LDドライブ回
路32が半導体レーザ(LD)33を点滅させる(第2
図参照)。The three-color electrical signals (multi-value) of R, G, and B obtained by the C'CD color sensor 14 are processed by the reading signal processing unit 20 to be converted into a print output signal (2) of yellow, magenta, cyan, or black. value) and stored in the buffer memory 30
is memorized. In the print head unit 31, an LD drive circuit 32 causes a semiconductor laser (LD) 33 to blink (second
(see figure).
印字信号に対応して半導体レーザ33の発生するレーザ
ビームは、第1図に示すように、反射鏡37を介して、
回転駆動される感光体ドラム4Iを露光する。これによ
り感光体ドラム41の感光体上に原稿の画像が描かれる
。感光体ドラム41は、1複写ごとに露光を受ける前に
イレーザランプ42で照射され、帯電チャージャ43に
より帯電され、サブイレーサランプ44で照射されてい
る。この−様に帯電した状態で露光を受けると、感光体
ドラム41上に静電潜像が形成される。イエロー、マゼ
ンタ、シアン、ブラックのトナー現像器45a〜45d
のうちいずれか一つだけが選択され、感光体ドラム41
上の静電潜像を現像する。As shown in FIG. 1, the laser beam generated by the semiconductor laser 33 in response to the print signal is transmitted through a reflecting mirror 37.
The rotationally driven photoreceptor drum 4I is exposed. As a result, an image of the document is drawn on the photoreceptor of the photoreceptor drum 41. Before being exposed for each copy, the photosensitive drum 41 is irradiated with an eraser lamp 42, charged with a charger 43, and irradiated with a sub-eraser lamp 44. When exposed to light in this charged state, an electrostatic latent image is formed on the photosensitive drum 41. Yellow, magenta, cyan, and black toner developers 45a to 45d
Only one of them is selected, and the photosensitive drum 41
Develop the upper electrostatic latent image.
現像された像は、転写チャージャ46により転写ドラム
5!上に巻きつけられたペーパーに転写される。The developed image is transferred to the transfer drum 5! by the transfer charger 46! It is transferred to the paper wrapped around the top.
通常は、このような印字過程をイエロー、マゼンタ、シ
アン及びブラックについて繰り返す。このとき、感光体
ドラム41と転写ドラム51の動作に同期してスキャナ
10はスキャン動作を繰り返す。その後、分離爪47を
作動させることによってペーパーは転写ドラム51から
分離され、定着装置48を通って定着され、排紙トレー
49に排紙される。Usually, this printing process is repeated for yellow, magenta, cyan, and black. At this time, the scanner 10 repeats the scanning operation in synchronization with the operations of the photosensitive drum 41 and the transfer drum 51. Thereafter, the paper is separated from the transfer drum 51 by operating the separation claw 47, passed through the fixing device 48, fixed, and discharged onto the paper discharge tray 49.
なお、ペーパーは用紙カセット50より給紙され、転写
ドラム51上のチャッキング機構52によりその先端が
チャッキングされ、転写時に位置ずれが生じないように
している。Note that the paper is fed from a paper cassette 50, and its leading edge is chucked by a chucking mechanism 52 on a transfer drum 51 to prevent misalignment during transfer.
次に、第2図により、CODカラーセンサ14の出力信
号を処理して2値画像信号を出力する信号処理部20に
ついて説明する。なお、登録画像メモリ回路lは、後に
第8図に示すように、2値記憶の場合は中間調処理回路
27の後にも(すなわち2値化処理の後に)挿入されろ
。Next, the signal processing section 20 that processes the output signal of the COD color sensor 14 and outputs a binary image signal will be explained with reference to FIG. Note that, as shown later in FIG. 8, the registered image memory circuit 1 should also be inserted after the halftone processing circuit 27 (that is, after the binarization process) in the case of binary storage.
通常の画像を出力する場合、CODカラーセンサ14に
上り光電変換された画像信号は、ログアンプ21で画像
濃度に変換され、次にA/D変換器22でデジタル値(
多値)に変換される。この数値変換された赤R1緑G、
青Bの画像信号は、シェーディング補正回路23でシェ
ーディング補正がされる。後4こ説明するように、スー
パーインボーズモード(多値記憶)やモザイクモニタモ
ードでは、シェーディング補正された設定領域の信号は
、登録画像メモリ回路lに記憶される。(通常の複写モ
ードやスーパーインポーズモード(2値記憶)では、画
像信号は登録画像メモリ回路1で処理されず、マスキン
グ処理回路24に送られる。)以上の処理は、R,01
Bの3色が並列に処理される。次に、マスキング処理回
路24は、面順次で印字するため、シェーディング補正
回路23または登録画像メモリ回路(多値記憶の場合)
lからの3人力信号よりいずれかの印字色(イエローマ
ゼンタ、シアン、ブラックのいずれか)の信号を印字ト
ナーの特性にあわせて生成する。いずれの印字色に関す
る信号を生成するかはCPU25からの制御信号により
決定される。マスキング処理回路24内には、下色除去
(U CR)回路及び墨加刷(BP)ffi発生回路が
設けられ、黒スキャンの際は墨量を発生する。(スーパ
ーインポーズモード(2値記憶)では、印字信号は一旦
登録画像メモリ回路lに記憶される。)画調設定回路2
は、スーパーインポーズモードやモザイクモニタモード
などで印字信号に色調整を施す回路である。標準の色調
整でよい場合は、マスキング処理回路24の出力信号は
、直ちに電気変倍回路26に進む。When outputting a normal image, the image signal that goes up to the COD color sensor 14 and undergoes photoelectric conversion is converted into an image density by the log amplifier 21, and then converted into a digital value by the A/D converter 22 (
multivalued). This numerically converted red R1 green G,
The blue B image signal is subjected to shading correction in a shading correction circuit 23. As will be explained in the next four sections, in the superimpose mode (multilevel storage) or mosaic monitor mode, the signal of the setting area that has undergone shading correction is stored in the registered image memory circuit l. (In normal copy mode or superimpose mode (binary storage), the image signal is not processed by the registered image memory circuit 1, but is sent to the masking processing circuit 24.)
The three colors of B are processed in parallel. Next, since the masking processing circuit 24 prints in field sequential manner, the shading correction circuit 23 or the registered image memory circuit (in the case of multi-value storage)
A signal for one of the printing colors (yellow-magenta, cyan, or black) is generated from the three human-powered signals from 1 in accordance with the characteristics of the printing toner. A control signal from the CPU 25 determines which print color a signal is to be generated. The masking processing circuit 24 includes an under color removal (UCR) circuit and a black printing (BP) ffi generation circuit, which generate a black amount during black scanning. (In superimpose mode (binary storage), the print signal is temporarily stored in the registered image memory circuit l.) Image setting circuit 2
is a circuit that performs color adjustment on print signals in superimpose mode, mosaic monitor mode, etc. If standard color adjustment is sufficient, the output signal of the masking processing circuit 24 is immediately passed to the electrical scaling circuit 26.
電気変倍回路26は、マスキング処理回路24または画
調設定回路2からの信号を電気的に処理して主走査方向
の変倍を電気的に行うものであり、その手法は周知であ
るのでここでは説明を省略する。一方、副走査方向の変
倍は、現像器とスキャナ10の相対運動の速度を可変に
することによって実現できる。中間調処理回路27は、
電気変倍回路26よりの信号を2値化処理して2値の擬
似中間調信号(印字出力信号)を生成し、バッファメモ
リ30に送る。LDドライブ回路32は、このバッファ
メモリ30の擬似中間調信号に対応してMjJ1体レー
ザ33を駆動してレーザビームを出射させる。The electric magnification circuit 26 electrically processes the signal from the masking processing circuit 24 or the image level setting circuit 2 to electrically change the magnification in the main scanning direction.The method is well known and will be described here. The explanation will be omitted here. On the other hand, variable magnification in the sub-scanning direction can be realized by varying the speed of relative movement between the developing device and the scanner 10. The halftone processing circuit 27 is
The signal from the electric variable magnification circuit 26 is binarized to generate a binary pseudo halftone signal (print output signal) and sent to the buffer memory 30. The LD drive circuit 32 drives the MjJ single body laser 33 in response to the pseudo halftone signal of the buffer memory 30 to emit a laser beam.
なお、クロック発生器28は、CODカラーセンサ14
の読取りと各回路の画像データ処理の水平方向の同期を
とるための水平同期信号1(syncとクロック信号C
KAを発生する。また、変倍用副走査クロック発生器2
9は、CPtJ25からの信号に応じた登録画像メモリ
回路lへの割込信号である変倍用副走査クロックを発生
する。Note that the clock generator 28 is connected to the COD color sensor 14.
Horizontal synchronization signal 1 (sync and clock signal C
Generates KA. In addition, the sub-scanning clock generator 2 for variable magnification
9 generates a sub-scanning clock for magnification change which is an interrupt signal to the registered image memory circuit l in response to a signal from the CPtJ25.
このデジタルカラー複写機は、後に説明するように、ス
ーパーインボーズ機能とモザイクモニタとよばれる色調
整機能を備えている。両機能とも画像データを記憶する
メモリを必要とし、また、画像処理も共通する点が多い
ため、画像登録・続出用の登録画像メモリ回路lと色調
整用の画調設定回路2とを共用し、CPU25により制
御して両機能を実現する。As will be explained later, this digital color copying machine is equipped with a superimpose function and a color adjustment function called a mosaic monitor. Both functions require a memory to store image data, and since the image processing is also common, the registration image memory circuit 1 for image registration and continuous output and the image tone setting circuit 2 for color adjustment are shared. , and are controlled by the CPU 25 to realize both functions.
信号処理部20内において、画像データは第3図のよう
なタイミングで処理されている。ここで、水平同期信号
Hsync及びクロック信号CKAは、クロック発生器
28にて発生され、CODカラーセンサ14からのR,
G、Bの画像データは、クロック信号CKAに同期して
シリアルに流れる(図において画像データの数字は、主
走査方向のアドレスを示す。)。水平同期信号Hsyn
cが発生する度に、主走査方向のラインnが更新される
。すなわち、スキャナ!0は副走査方向に単位距離だけ
進んだことになる。In the signal processing section 20, image data is processed at the timing shown in FIG. Here, the horizontal synchronization signal Hsync and the clock signal CKA are generated by the clock generator 28, and the R,
The G and B image data flow serially in synchronization with the clock signal CKA (in the figure, the numbers of the image data indicate addresses in the main scanning direction). Horizontal synchronization signal Hsyn
Each time c occurs, line n in the main scanning direction is updated. Namely, the scanner! 0 means that the object has advanced by a unit distance in the sub-scanning direction.
第4図は、複写機の上面に設けられた操作パネル70の
各種キーなどの配列を示す図である。FIG. 4 is a diagram showing the arrangement of various keys on the operation panel 70 provided on the top surface of the copying machine.
操作パネル70には、複写動作をスタートさせるための
プリント開始キー71、割込複写を指定する割込キー7
2、クリア・ストップキー73、オールリセットキー7
4、置数用のテンキー75、セットキー76、キャンセ
ルキー77、各種ファンクションキー78〜gB後述す
る領域を設定するためのジョグダイアル82,83、領
域を設定するために原稿画像を表示するとともに各種の
メツセージを表示する液晶などからなる表示部84が設
けられている。ここで、ファンクションキー78,79
.80は、それぞれ、モザイクモニタ選択キー、スーパ
ーインポーズモード選択キー濃度補正キーとして用いら
れる他、スーパーインポーズモードにおける多値記憶、
2値(カラー)記憶及び2値(単色)記憶、あるいはス
ーパーインポーズ登録済画像の選択、消去等の指示を行
うキーとして用いられる。The operation panel 70 includes a print start key 71 for starting the copying operation and an interrupt key 7 for specifying interrupt copying.
2. Clear/stop key 73, all reset key 7
4. Numeric keypad 75 for setting numbers, set key 76, cancel key 77, various function keys 78 to A display section 84 made of liquid crystal or the like for displaying messages is provided. Here, function keys 78, 79
.. 80 are used as a mosaic monitor selection key, a superimpose mode selection key, a density correction key, and a multi-value storage in the superimpose mode, respectively.
It is used as a key for instructing binary (color) storage, binary (single color) storage, or selection and deletion of superimposed registered images.
変倍率はテンキー75で設定する。また、画像モード(
多値記憶スーパーインポーズモードなど)やデータ消去
、登録済画像の選択なども表示部84のメソセージに応
じて設定できる。The magnification ratio is set using the numeric keypad 75. You can also use image mode (
Multivalue storage superimpose mode, etc.), data deletion, and selection of registered images can also be set according to messages on the display section 84.
後に説明するスーパーインポーズモードやモザイクモニ
タモードにおける書込領域、続出領域などの設定は、次
のように行う。たとえば、書込領域の設定の場合、原稿
をプラテン15に載置し、スキャナ10により予備スキ
ャンを行うことによって、第5図に示すように、操作パ
ネル70の表示部84の原稿領域EDに原稿画像が大ま
かに表示される。縦横の指示線LPY、LPXの交点が
書込領域(斜線部)EAの中心となる。ジョグダイヤル
82.83を操作すると、これらの指示線がそれぞれ左
右または上下に移動するので、これによって領域EAを
定め、セットキー76を押すことによってその領域が書
込領域として設定される。なお、この場合、書込領域E
Aの大きさは、予め一定の大きさとして与えられる。Settings for the write area, continuous area, etc. in the superimpose mode and mosaic monitor mode, which will be explained later, are performed as follows. For example, in the case of setting a writing area, by placing a document on the platen 15 and performing a preliminary scan with the scanner 10, the document is displayed in the document area ED on the display section 84 of the operation panel 70, as shown in FIG. The image is displayed roughly. The intersection of the vertical and horizontal direction lines LPY and LPX becomes the center of the writing area (shaded area) EA. When the jog dials 82 and 83 are operated, these indication lines move left and right or up and down, respectively, thereby defining the area EA, and by pressing the set key 76, that area is set as the writing area. In addition, in this case, the writing area E
The size of A is given in advance as a constant size.
(b)スーパーインポーズ機能
操作パネル70においてファンクションキー79を押す
と、スーパーインポーズモードが選択される。このモー
ドでは、あらかじめ原稿上で指定された領域(書込領域
という)の画像データ(登録画像データという)をメモ
リに登録しておき、この登録画像データを別の原稿の複
写に重ねて用紙上の任意の位置に印字する。このスーパ
ーインポーズ機能では、登録画像メモリ回路lを用いて
登録画像データの書込みと読出しを行う。(b) Superimpose function When the function key 79 is pressed on the operation panel 70, the superimpose mode is selected. In this mode, image data (referred to as registered image data) of a specified area (referred to as writing area) on the original is registered in memory in advance, and this registered image data is superimposed on a copy of another original and printed on the paper. Print at any position. This superimpose function uses the registered image memory circuit l to write and read registered image data.
登録画像の書込領域EAの設定方法について、すでに第
5図を参照して説明している。書込領域EAは、たとえ
ば2CI平方の大きさであり、登録画像メモリ回路1の
記憶容量は多値の登録画像データの場合に必要な記憶容
量に等しく設定されている。The method of setting the writing area EA of the registered image has already been described with reference to FIG. The write area EA has a size of, for example, 2CI square, and the storage capacity of the registered image memory circuit 1 is set equal to the storage capacity required for multivalued registered image data.
CPU25は、書込領域EAが、画像先端からみて何ラ
イン目の範囲にあるか、また主走査方向について何画素
目の範囲にあるかは、容易に計算することができ、書込
領域EAの位置(左上角の座標(xo、yo)と右下角
の座標(X’ + Y<υ)についてのデータ(書込領
域設定信号)を登録画像メモリ回路1に送る。The CPU 25 can easily calculate the range of lines in which the writing area EA is located as seen from the leading edge of the image and the range of pixels in the main scanning direction. Data (writing area setting signal) regarding the position (coordinates of the upper left corner (xo, yo) and coordinates of the lower right corner (X'+Y<υ) are sent to the registered image memory circuit 1.
再び、同じ原稿をスキャンすると、登録画像メモリ回路
lは、書込領域EAの画像データをメモリに記憶する。When the same document is scanned again, the registered image memory circuit 1 stores the image data of the writing area EA in the memory.
次に、複写すべき別の原稿をプラテン15に載置し、ス
キャナlOにより予備スキャンを行うと、書込領域設定
の場合と同様に、操作パネル70の表示部84に原稿画
像EDと指示線LPX、LPYが表示される。これら指
示線LPX、LPYの交点が登録画像を印字するスーパ
ーインポーズ領域EBの中心となる。ジョグダイヤル8
2.83を操作して所望の位置にスーパーインポーズ領
域を定め、セットキー76を押すと、スーパーインポー
ズ領域EBが設定される。CPU25は、スーパーイン
ポーズ領域EBの位置(左上角の座標(X、、Yo)と
右下角の座標(X 、、Y 、))についてのデータ(
続出領域設定信号)を登録画像メモリ回路1に送る。Next, when another document to be copied is placed on the platen 15 and a preliminary scan is performed by the scanner 10, the document image ED and the instruction line are displayed on the display section 84 of the operation panel 70, as in the case of writing area setting. LPX and LPY are displayed. The intersection of these instruction lines LPX and LPY becomes the center of the superimpose area EB in which the registered image is printed. jog dial 8
2.83 to define the superimpose area at a desired position and press the set key 76 to set the superimpose area EB. The CPU 25 generates data (
A continuous area setting signal) is sent to the registered image memory circuit 1.
再び、その原稿をスキャンすると、第6図(a)に示す
ように、その原稿の複写画像がスーパーインポーズ領域
EB(空白部)を除いて印字される。When the original is scanned again, the copied image of the original is printed except for the superimposed area EB (blank area), as shown in FIG. 6(a).
(領域EBでは゛白°データが印字される。)この印字
工程を最大4色分繰り返す。ベーパーは転写ドラム51
上に保持しておく。次に、再度複写動作を行わせると、
メモリの画像データが読出され、第6図(b)に示すよ
うに、同じペーパー上のスーパーインポーズ領域EBに
印字される。(領域EB以外では°白°データが印字さ
れる。)この印字工程を最大4色分繰り返す(なお、こ
の例ではスーパーインポーズ画像が拡大されている。)
。こうして、第6図(C)に示すように、メモリの画像
が原稿画像中に書き込まれることになる。(In area EB, "white data" is printed.) This printing process is repeated for up to four colors. The vapor is transferred to the transfer drum 51
Keep it on top. Next, when you perform the copy operation again,
The image data from the memory is read out and printed on the superimposed area EB on the same paper, as shown in FIG. 6(b). (°White° data is printed in areas other than area EB.) This printing process is repeated for up to four colors (note that in this example, the superimposed image is enlarged).
. In this way, the image in the memory is written into the original image as shown in FIG. 6(C).
登録画像が写真などの中間調画像であれば、登録画像デ
ータとして、シェーディング補正回路23のR,G、B
の出力値(多値)か登録画像メモリ回路1のメモリに記
憶される。If the registered image is a halftone image such as a photograph, R, G, B of the shading correction circuit 23 is used as the registered image data.
The output value (multi-value) of is stored in the memory of the registered image memory circuit 1.
しかし、登録画像が文字などの2値画像であれば、シェ
ーディング補正回路23の出力値(多値)を印字色Y、
M、Cの2値データに変換して記憶すれば、同じ容量の
メモリを使用しても、多値データを記憶する場合に比べ
て広い領域の登録画像データを記憶できることになる。However, if the registered image is a binary image such as a character, the output value (multivalue) of the shading correction circuit 23 is
By converting the data into M and C binary data and storing it, even if the same capacity of memory is used, a wider area of registered image data can be stored compared to the case where multi-value data is stored.
たとえば、シェーディング補正回路23の出力値が8ビ
ツトであれば、2値画像の場合には実質的に8倍の広さ
の登録画像がスーパーインポーズできることになる。For example, if the output value of the shading correction circuit 23 is 8 bits, then in the case of a binary image, a registered image that is substantially eight times wider can be superimposed.
そこで、使用者が2値記憶か多値記憶かを設定できるよ
うにしている。Therefore, the user is allowed to set binary storage or multi-value storage.
なお、原稿画像と、メモリ画像の変倍率が同じであれば
、上のような印字工程をとらなくてもよく、原稿画像と
メモリ画像を同時に出力することができる(第26図5
223〜5228参照)。Note that if the magnification ratio of the original image and the memory image are the same, it is not necessary to take the above printing process, and the original image and the memory image can be output at the same time (Fig. 26, 5).
223-5228).
また、原稿のスーパーインポーズ領域に該当する位置を
白地としておけば、スーパーインポーズ領域への書込を
禁止しなくても白地の上にスーパーインポーズ画像を重
ねて書き込んでもよい。Further, if the position corresponding to the superimposed area of the document is set as a white background, the superimposed image may be written on the white background without prohibiting writing in the superimposed area.
以上では、1箇所のスーパーインポーズ領域に書込でき
る場合を説明した。しかし、1箇所または複数箇所の書
込領域から登録し、複数箇所のスーパーインポーズ領域
に印字することも、後に説明する第8図に示すような書
込用または読出用の領域判別回路やアドレス発生カウン
タを登録画像メモリ回路1内に並列に設けてCPU25
よりそれぞれに書込領域設定信号や続出領域設定信号を
設定することにより容易に可能になる。The case where writing can be performed in one superimposed area has been described above. However, it is also possible to register from one or multiple write areas and print in multiple superimpose areas, or by using a write or read area discrimination circuit or an address area as shown in FIG. A generation counter is provided in parallel in the registered image memory circuit 1 and the CPU 25
This becomes possible easily by setting a write area setting signal and a successive area setting signal for each.
(c)モザイクモニタ
モザ、インモニタは、注目領域の画像を記憶するモニタ
画像メモリ回路lと、印字工程において色調整を行う画
調設定回路2とによって実現される。(c) Mosaic Monitor Mosaic and in-monitor are realized by a monitor image memory circuit 1 that stores an image of an area of interest, and an image tone setting circuit 2 that performs color adjustment in the printing process.
操作パネル70においてファンクションキー78を押す
とモザイクモニタモードが選択される。When function key 78 is pressed on operation panel 70, mosaic monitor mode is selected.
モザイクモニタモードにおいては、まず、使用者が操作
パネル70の表示部84に表示された予備スキャンによ
る原稿画像を見て、色調整を最もよ(行いたい注目領域
(たとえば第5図の斜線部EA)を設定する。これに対
応して登録画像メモリ回路lは、その注目領域の設定値
に対応し、次のスキャンにおいてその領域の画像データ
(多値)のみをメモリに記憶する。なお、注目領域の太
きさC(l X Q)は、前述したように、登録画像メ
モリ回路1の記憶容量に対応して定められている。In the mosaic monitor mode, the user first looks at the preliminary scanned document image displayed on the display section 84 of the operation panel 70 and selects the area of interest (for example, the shaded area EA in FIG. ). Correspondingly, the registered image memory circuit l stores only the image data (multi-value) of that area in the next scan, corresponding to the setting value of the area of interest. The thickness C(l×Q) of the area is determined in accordance with the storage capacity of the registered image memory circuit 1, as described above.
次に、画調設定回路2 ((e)節参照)は、メモリか
ら読み出されマスキング処理回路24で印字色に変換さ
れた画像データ■を処理して、各種色調の画像を同じ用
紙に印字させる印字データ1°=k。Next, the image tone setting circuit 2 (see section (e)) processes the image data read out from the memory and converted into print colors by the masking processing circuit 24, and prints images of various tones on the same paper. Print data 1°=k.
I (i=c、m、y)を発生する。第7図に出力フォ
ーマットの一例を示す。この例ではンアン(C)、マゼ
ンタ(M)、イエロー(Y)の3色とも3種の色調整係
数に、=k (c−+、co、C+)、k (m−+、
41o、m+)、k (Y−+、)’。Generate I (i=c, m, y). FIG. 7 shows an example of the output format. In this example, the three colors, magenta (C), magenta (M), and yellow (Y), have three color adjustment coefficients: =k (c-+, co, C+), k (m-+,
41o, m+), k (Y-+,)'.
I Cm Vy+)
を使用し、3x9=27種の画調の画像をペーパーPに
出力する。ここに0を付した係数C8゜mo+ y(l
は色調整の標準の色調整係数を表すし、1を付した色調
整係数C+ + m + 、’I +と=1を付した色
調整係数C−+*m−++’/−+は、それぞれ、標準
の色調整係数cO+ mo+ YOより大きい係数と小
さい係数を示す。I Cm Vy+)
is used to output images with 3x9=27 types of tones onto paper P. The coefficient C8゜mo+y(l
represents the standard color adjustment coefficient for color adjustment, and the color adjustment coefficient C+ + m + with 1 added, 'I + and the color adjustment coefficient C-+*m-++'/-+ with =1 added are as follows. The coefficients larger and smaller than the standard color adjustment coefficient cO+mo+YO are shown, respectively.
第7図に示した各種出力画像GM(モザイクモニタ画像
という)を見比べて、使用者は最適の色調を示す出力画
像を表示部84上で選択する。これによりモザイクモニ
タモードは終了する。The user compares the various output images GM (referred to as mosaic monitor images) shown in FIG. 7 and selects the output image showing the optimum color tone on the display unit 84. This ends the mosaic monitor mode.
モザイクモニタモードにおいて、表示部84に表示した
モザイクモニタ画像CMの中から選択した画像(色調)
を使用者が指定するには、たとえば、ファンクションキ
ー78〜81に選択機能を予め与えておき、表示部84
に表示されたメツセージに従ってファンクションキー7
8〜81を操作するようにすればよい。あるいは、表示
部84上に第7図の画像ブロックを表示し、ファンクシ
ジンキーあるいはテンキーによりブロック座標を指定し
て色調を選定してもよい。In the mosaic monitor mode, an image (color tone) selected from the mosaic monitor image CM displayed on the display unit 84
For the user to specify, for example, the function keys 78 to 81 are given selection functions in advance, and
Press function key 7 according to the message displayed on
8 to 81 may be operated. Alternatively, the image block shown in FIG. 7 may be displayed on the display unit 84, and the color tone may be selected by specifying the block coordinates using the funxigine keys or numeric keys.
次に、原稿が再び読み取られ、設定された色調で画像が
印字される。Next, the document is read again and the image is printed in the set color tone.
なお、前述のスーパーインポーズ機能もモザイクモニタ
機能も、どちらも画像登録用メモリを必要とし、また、
メモリの続出・書込に関連した回路も共通する部分が多
い。そこで、本実施例では、両機能を登録画像メモリ回
路1を共用して実現する。Note that both the superimpose function and mosaic monitor function described above require memory for image registration, and
There are many common parts in the circuits related to memory access and writing. Therefore, in this embodiment, both functions are realized by using the registered image memory circuit 1 in common.
以下余白
(d)登録画像メモリ回路
<d−1>回路構成
登録画像メモリ回路lは、スーパーインポーズモードに
おける原稿の指定された領域(モザイクモニタモードで
は原稿の注目領域)EAの登録画像をメモリに登録し、
複写のため用紙上の任意の指定された位置(スーパーイ
ンポーズ領域EB。Margin below (d) Registered image memory circuit <d-1> Circuit configuration The registered image memory circuit l stores the registered image of EA in the specified area of the document in superimpose mode (the area of interest in the document in mosaic monitor mode). Register at
Any designated position on the paper for copying (superimpose area EB).
モザイクモニタモードでは出力フォーマット(第7図)
で定まる印字領域)で読み出す回路である。Output format in mosaic monitor mode (Figure 7)
This is a circuit that reads out the print area (defined by the print area).
第8図は、登録画像メモリ回路1の回路図を示す。ここ
に、メモリ401a、40 lb、401c(以下、総
称する場合はメモリ401という)は、それぞれ登録画
像を記録するRAMである。各メモリともアドレスは共
通であり、書込み/読出しのタイミングも共通であり、
CSコントロール信号で選択される。FIG. 8 shows a circuit diagram of the registered image memory circuit 1. Here, the memories 401a, 40lb, and 401c (hereinafter collectively referred to as memories 401) are RAMs that each record a registered image. Each memory has the same address and write/read timing.
Selected by CS control signal.
なお、後に説明する2値記憶の場合、画像データの書込
の際は、印字色に合わせて書込みを行う必要がある。そ
こで、CPU25は、CSコントロール信号により書き
込むべきメモリを選択できるようにした。多値記憶の場
合はCSコントロール信号= ’o o o’とする。Note that in the case of binary storage, which will be explained later, when writing image data, it is necessary to write in accordance with the print color. Therefore, the CPU 25 is designed to be able to select the memory to be written to using the CS control signal. In the case of multi-value storage, the CS control signal is set to 'o o o'.
登録画像メモリ回路lは、スーパーインポーズモードと
モザイクモニタモードで用いられ、またスーパーインポ
ーズモードでも多値カラー記憶、2値カラー記憶、単色
2値記憶などがある。それぞれの場合に、メモリ401
へのアクセスの方法を変える必要がある。そこで、シェ
ーディング補正回路23からメモリ401へのデータ入
力とメモリ401からマスキング処理回路24へのデー
タ出力を、各種セレクタ421,426,427゜44
4.446.3−ステートバッファ422、データ選択
回路442などで処理する。セレクタ421はスーパー
インポーズモードでの続出信号が入力されたときに白デ
ータを選択し、他の場合にシェーディング補正回路23
からの画像データを選択する。セレクタ421の出力信
号は、バッファ422とセレクタ427に送られる。バ
ッファ422は、ANDゲート425がLレベルのとき
に能動状態になり、セレクタ421の出力をメモリ40
1のI10端子に送る。ANDゲート425の一方の入
力端子には、2値記憶/多値記憶信号がインバータ43
0を介して入力され、他方の入力端子には、ANDゲー
ト405の出力信号がインバータ423.424を介し
て入力される。The registered image memory circuit 1 is used in superimpose mode and mosaic monitor mode, and even in superimpose mode, there are multi-value color storage, binary color storage, monochrome binary storage, etc. In each case, memory 401
We need to change the way we access it. Therefore, data input from the shading correction circuit 23 to the memory 401 and data output from the memory 401 to the masking processing circuit 24 are controlled by various selectors 421, 426, 427° 44.
4.446.3-Processed by state buffer 422, data selection circuit 442, etc. The selector 421 selects white data when successive signals in superimpose mode are input, and selects white data from the shading correction circuit 23 in other cases.
Select image data from. The output signal of selector 421 is sent to buffer 422 and selector 427. The buffer 422 becomes active when the AND gate 425 is at L level, and transfers the output of the selector 421 to the memory 40.
Send it to the I10 terminal of 1. One input terminal of the AND gate 425 receives the binary storage/multi-value storage signal from the inverter 43.
0, and the output signal of AND gate 405 is input to the other input terminal via inverters 423 and 424.
従って、バッファ422がハイインピーダンス状態にな
るのは、2値記憶の場合と、続出時で続出領域内にある
場合である。いいかえれば、バッファ422が後段にデ
ータを伝えるのは、多値記憶の書込の場合であり、この
場合、シェーディング補正回路23の後にメモリ401
が位置することになる。多値記憶で続出の場合は、バッ
ファ422をハイインピーダンス状態にしてメモリ40
1からの読出を可能にする。他方、2値記憶の場合は、
バッファ422をハイインピーダンス状態にして画像デ
ータをセレクタ427を介してマスキング処理回路24
に送り、中間調処理回路27において2値化した後、メ
モリ401に記憶させる。Therefore, the buffer 422 is in a high impedance state when storing binary data and when it is in the successive region during successive data. In other words, the buffer 422 transmits data to the subsequent stage in the case of multilevel storage writing, and in this case, the memory 401 is transmitted after the shading correction circuit 23.
will be located. If multiple values are stored one after another, the buffer 422 is placed in a high impedance state and the memory 40
Enables reading from 1. On the other hand, in the case of binary memory,
The buffer 422 is set to a high impedance state and the image data is sent to the masking processing circuit 24 via the selector 427.
After being binarized in the halftone processing circuit 27, it is stored in the memory 401.
セレクタ426にはメモリ401の出力データ(A人ツ
ノ)と白データ(8人力)が入力され、セレクタ426
のセレクト信号はANDゲート428により供給され、
セレクトされた信号をセレクタ427のB入力に送る。The output data of the memory 401 (A person's horn) and the white data (8 people's power) are input to the selector 426.
The select signal of is provided by AND gate 428,
The selected signal is sent to the B input of selector 427.
ANDゲート428は、ANDゲート405の出力信号
がインバータ423を介してLレベルのとき(すなわち
、続出時に続出領域内にあるとき)であってかつトリミ
ングコントロール信号がLレベルのときのみB入力(白
データ)を選択する信号を出力する。従って、多値記憶
で続出領域内のときに、一般にはメモリ40Iの読出デ
ータ(A入力)が選択されるが、トリミングコントロー
ル信号がLレベルになると白データ(B入力)が選択さ
れることになる。The AND gate 428 receives the B input (white) only when the output signal of the AND gate 405 is at the L level via the inverter 423 (that is, when it is within the successive region at the time of successive output) and when the trimming control signal is at the L level. data) is output. Therefore, when in the successive region in multi-level storage, the read data (A input) of the memory 40I is generally selected, but when the trimming control signal goes to L level, the white data (B input) is selected. Become.
セレクタ427には、セレクタ421の出力信号(A入
力)とセレクタ426の出力信号(B入力)が入力され
、セレクタ427のセレクト信号は、ANDゲート42
9により供給され、セレクタ427の出力信号はマスキ
ング回路24に送られる。The output signal of the selector 421 (A input) and the output signal of the selector 426 (B input) are input to the selector 427, and the select signal of the selector 427 is input to the AND gate 42.
9, and the output signal of selector 427 is sent to masking circuit 24.
、A N Dゲート429の一方の入力端子には、2値
12fi/多値記憶信号がインバータ430を介して送
られ、他方の入力端子には、ANDゲート405の出力
信号がインバータ423を介して送られる。従って、多
値記憶でありかつ続出時の続出領域内である場合のみB
入力が選択される。いいかえれば、たとえば2値記憶の
場合は、セレクタ421から送られる画像データが選択
される。, the binary 12fi/multi-value storage signal is sent to one input terminal of the A N D gate 429 via the inverter 430, and the output signal of the AND gate 405 is sent via the inverter 423 to the other input terminal. Sent. Therefore, only when it is multi-valued storage and is within the successive area at the time of successive occurrence, B
Input is selected. In other words, in the case of binary storage, for example, the image data sent from the selector 421 is selected.
セレクタ446には、中間調処理回路27の出力信号(
へ入力)とP−S変換器445の出力信号(B入力)と
が入力され、ANDゲート448からセレクト信号が供
給され、選択された信号をバッファメモリ30に送る。The selector 446 receives the output signal (
input) and the output signal (B input) of the P-S converter 445 are input, a select signal is supplied from an AND gate 448, and the selected signal is sent to the buffer memory 30.
ANDゲート448の1つの入力端子には2値記憶/多
値記憶信号が人力され、他方の入力端子にはANDゲー
ト405の出力信号がインバータ423を介して出力さ
れる。A binary storage/multi-value storage signal is input to one input terminal of AND gate 448, and an output signal of AND gate 405 is outputted to the other input terminal via inverter 423.
セレクタ446がP−S変換器445の出力を選択する
のは、2値記憶であり、かつ、続出時に続出領域内にあ
るときである。その他の場合、たとえば多値記憶の場合
は、中間調処理回路27の出力信号(へ入力)が選択さ
れる。The selector 446 selects the output of the P-S converter 445 when it is in binary storage and is within the successive output region at the time of successive output. In other cases, for example, in the case of multilevel storage, the output signal (input to) of the halftone processing circuit 27 is selected.
S−P変換器441、データ選択回路442、セレクタ
444およびP−S変換器445は、2値記憶のために
設けられる。An S-P converter 441, a data selection circuit 442, a selector 444, and a P-S converter 445 are provided for binary storage.
データ選択回路442は、第29図に示すように、3−
ステートバッフy501a、501b、501c、50
4a、504b、504c及びゲート502.503a
、503b、503cから構成されている。3−ステー
トバッファ501a、50 lb。As shown in FIG. 29, the data selection circuit 442
State buffer y501a, 501b, 501c, 50
4a, 504b, 504c and gates 502.503a
, 503b, and 503c. 3-state buffer 501a, 50 lb.
501cは、それぞれ、ANDゲート503a、503
b、503cがLレベルのときに能動状態になり、S−
P変換器441からの入力をメモリ401に伝える。A
NDゲート50゛2の一方の入力端子には2値記憶/多
値記憶信号が人力され、他方の入力端子にはANDゲー
ト405の出力信号が入力される。また、ANDゲート
502の出力は、ANDゲート503a、503b、5
03cの一方の入力端子に接続されている。従って、多
値記憶の場合や続出時の続出領域外である場合には、バ
ッフy 501a、501b、501cはハイインピー
ダンス状態になる。即ち、3−ステートバッファ501
a、50 lb、501cは2値記憶の書込時のみ能動
状態となる。ANDゲート503a、503b。501c are AND gates 503a and 503, respectively.
b, becomes active when 503c is at L level, and S-
The input from the P converter 441 is transmitted to the memory 401. A
A binary storage/multi-value storage signal is input to one input terminal of the ND gate 50'2, and an output signal of the AND gate 405 is input to the other input terminal. Furthermore, the output of the AND gate 502 is
It is connected to one input terminal of 03c. Therefore, in the case of multi-value storage or outside the successive region at the time of successive data, the buffers 501a, 501b, and 501c are in a high impedance state. That is, 3-state buffer 501
a, 50 lb, and 501c become active only when writing binary memory. AND gates 503a, 503b.
503cの他方の入力端子には、メモリ401a。The other input terminal of 503c is a memory 401a.
401b、4QIcに対応したCSコントロール信号が
入力されている。また、このCSコントロール信号は3
−ステートバッフy 504a、504b。CS control signals corresponding to 401b and 4QIc are input. Also, this CS control signal is 3
- State buffer y 504a, 504b.
504cにも接続されていて、CSコントロール信号が
Lレベル(“0”)の時に、3−ステートバッファ 5
04a、504b、504cはメモリ401の出力をセ
レクタ444に伝える。504c, and when the CS control signal is at L level (“0”), the 3-state buffer 5
04a, 504b, and 504c transmit the output of the memory 401 to the selector 444.
セレクタ444は、メモリ401の出力信号(A人力)
と白データ(B入力)を選択する。ANDゲート447
は、CSコントロール信号に対応してセレクタ444に
セレクト信号を送る。従って、2値単色記憶などでCS
コントロール信号が111’のとき、すなわちどのメモ
リ40.1a、401b、401cも選択されていない
ときは、セレクタ444は゛白°データを選択し、他の
場合は、メモリ401の出力を選択する。The selector 444 outputs the output signal of the memory 401 (A human power)
and select white data (B input). AND gate 447
sends a select signal to selector 444 in response to the CS control signal. Therefore, CS with binary single color memory etc.
When the control signal is 111', that is, when none of the memories 40.1a, 401b, 401c are selected, the selector 444 selects the "white data", and otherwise selects the output of the memory 401.
シリアルデータをパラレルデータに変換するSP変換器
441は、2値記憶の書込の際に中間調処理回路27で
2値化された信号をメモリ401に記憶するためのビッ
ト数のデータに変換して、データ選択回路442に出力
する。The SP converter 441 that converts serial data into parallel data converts the signal binarized by the halftone processing circuit 27 into data with the number of bits to be stored in the memory 401 when writing binary storage. and outputs it to the data selection circuit 442.
パラレルデータをシリアルデータに変換するP−8変換
器445は、2値記憶の読出の際にセレクタ444から
送られたパラレルデータ(メモリ401の読出データ)
をシリアルデータに変換し、セレクタ446に送る。The P-8 converter 445, which converts parallel data into serial data, receives the parallel data (read data from the memory 401) sent from the selector 444 when reading binary storage.
is converted into serial data and sent to the selector 446.
2値記憶におひる書込と続出においてS−P変換とP−
S変換を行う必要があるので、他の部分では異なるクロ
ックが必要になる。すなわち、2値化信号は、S−P変
換器441とP−8変換器445ではクロックCKAに
同期して流れるが、パラレル変換した画像データをこの
クロックで処理できない。そこで、分周器452にてク
ロックCKAをパラレル化するビット数分だけ分周した
信号CKBをセレクタ451で選択して画像転送および
メモリ401に対するアドレス管理を行えばよい。第1
0図に2値記憶モードにおけるクロックCKA、CKB
、2値化信号、パラレル化信号の関係を示す(多値信号
のビット数−8の場合)。なお、多値記憶におけるスー
パーインポーズモードおよびモザイクモニタモードにお
いては、これまで通り、クロックCKAによりメモリ4
01をI及わなくてはならない。そこで、2値記憶/多
値記憶信号をセレクト信号とするセレクタ451を設け
、これらのモード(多値記憶)においてはCKB=CK
Aとなるようにしている。S-P conversion and P- in writing and writing in binary memory
Since it is necessary to perform S-conversion, different clocks are required in other parts. That is, although the binary signal flows in the S-P converter 441 and the P-8 converter 445 in synchronization with the clock CKA, parallel-converted image data cannot be processed using this clock. Therefore, the selector 451 selects the signal CKB obtained by dividing the frequency of the clock CKA by the number of bits to be parallelized by the frequency divider 452 to perform image transfer and address management for the memory 401. 1st
Figure 0 shows clocks CKA and CKB in binary storage mode.
, shows the relationship between a binary signal and a parallelized signal (in the case where the number of bits of the multi-level signal is −8). In addition, in the superimpose mode and mosaic monitor mode in multilevel storage, memory 4 is controlled by clock CKA as before.
01 must be exceeded. Therefore, a selector 451 is provided which uses a binary storage/multi-value storage signal as a selection signal, and in these modes (multi-value storage), CKB=CK.
I'm trying to get A.
次に、メモリ401へのデータの書込みと続出しについ
て説明する。(書込領域判別回路402、書込アドレス
発生カウンタ403、読出領域判別回路408および続
出アドレス発生カウンタ409の回路構成については、
後に詳細に説明する(第12図)。)
書込領域判別回路402は、原稿読取のスキャンにおい
て、画像先端信号を受信すると、クロックCKBと水平
同期信号Hsyncをそれぞれカウントし、CPU25
があらかじめ設定する書込領域設定信号に基づいて、主
走査方向(X)と副走査方向(Y)にそれぞれ書込領域
内にあると判別したときに判別信号WEX、WEYを発
生する。判別信号WEX、WEYは、ANDゲー)−4
07ニ出力され、また、書込アドレス発生カウンタ40
3に出力される。ANDゲート407においては、メモ
リ401のデータを保持すべきときにCPU25がトI
レベルを出力するデータ保持信号が入力さ、れ、さらに
インバータ406を介してクロックCKBが人力される
。従って、ANDゲート407は、データ保持信号がL
レベルであるときに、書込領域(WEX=WEY=’L
’ )内チクロックCKB(多値記憶ではCKA )を
メモリ401のWE端子に出力し、メモリ401を書込
可能にする。書込アドレス発生カウンタ403は、書込
時に、主走査方向に書込領域内のときにクロックCKB
をカウントし、副走査方向に書込領域内のときに水平同
期信号Hsyncをカウントして、書込領域内のX座標
とY座標を求め、両座標値より1次元の書込アドレスを
計算する。さらに、CPU25より設定されるメモリへ
の書込先頭アドレスとしての固定オフセット量を加算す
る。こうして得られた書込アドレスをセレクタ404に
出力する。Next, writing and writing data to the memory 401 will be explained. (For the circuit configurations of the write area discrimination circuit 402, write address generation counter 403, read area discrimination circuit 408, and successive address generation counter 409,
This will be explained in detail later (FIG. 12). ) When the writing area determination circuit 402 receives the image leading edge signal during scanning for document reading, it counts the clock CKB and the horizontal synchronization signal Hsync, and the CPU 25
Discrimination signals WEX and WEY are generated when it is determined that the write area is within the write area in the main scanning direction (X) and the sub-scanning direction (Y), respectively, based on a write area setting signal set in advance. Discrimination signals WEX and WEY are AND game)-4
07 is output, and the write address generation counter 40
3 is output. In the AND gate 407, when the data in the memory 401 is to be held, the CPU 25
A data holding signal that outputs a level is input, and a clock CKB is input via an inverter 406. Therefore, the AND gate 407 assumes that the data holding signal is L.
level, write area (WEX=WEY='L
' ) is outputted to the WE terminal of the memory 401 to make the memory 401 writable. The write address generation counter 403 receives the clock CKB when it is within the write area in the main scanning direction during writing.
, count the horizontal synchronizing signal Hsync when it is within the writing area in the sub-scanning direction, find the X coordinate and Y coordinate within the writing area, and calculate the one-dimensional writing address from both coordinate values. . Furthermore, a fixed offset amount set by the CPU 25 as the start address for writing to the memory is added. The write address thus obtained is output to the selector 404.
続出領域判別回路408は、書込領域判別回路402と
同様に、CPTJ25が設定する続出領域設定信号に基
づき、主走査方向(X)と副走査方向(Y)に続出領域
内にある場合にそれぞれ判別信号REX、REVを発生
する。両判別信号REX。Similar to the writing area determination circuit 402, the continuous area determination circuit 408 detects whether the continuous area is within the continuous area in the main scanning direction (X) and the sub-scanning direction (Y) based on the continuous area setting signal set by the CPTJ 25. Generates discrimination signals REX and REV. Both discrimination signal REX.
REVは、ANDゲート405の入力端子に送られると
ともに、続出アドレス発生カウンタ409に送られる。REV is sent to the input terminal of AND gate 405 and also to successive address generation counter 409.
ANDゲート405には、さらに、CPU25の設定す
る1囚/読出信号が入力される。従って、ANDゲート
405は、読出の場合に続出領域内でHレベルをセレク
タ404に出力し、インバータ423を介してLレベル
をメモリ401のOE端子に出力する。これにより、メ
モリ401は続出可能になる。また、続出アドレス発生
カウンタ409は、書込アドレス発生カウンタ403と
同様にi次元の続出アドレスを発生し、セレクタ404
に送る。セレクタ404は、ANDゲート405の出力
信号がHレベルのときに読出アドレスを選択し、他の場
合は書込アドレスを選択する。セレクタ404の出力端
子は、メモリ401のアドレス端子に接続される。従っ
て、メモリ401は、書込時には書込アドレスで、続出
時には続出アドレスでアクセスされる。なお、続出アド
レス発生カウンタ409は、後で説明するように、副走
査クロックを用いて変倍を可能としている。また、モザ
イクモニタモードにおける色調整の変更のためにオーバ
ーフロー信号X、Yを発生して後段の画調設定回路2に
送る。The AND gate 405 is further input with a 1/read signal set by the CPU 25 . Therefore, in the case of reading, the AND gate 405 outputs an H level to the selector 404 in the successive region, and outputs an L level to the OE terminal of the memory 401 via the inverter 423. This allows the memory 401 to be used continuously. Further, the successive address generation counter 409 generates i-dimensional successive addresses similarly to the write address generation counter 403, and selector 404
send to Selector 404 selects the read address when the output signal of AND gate 405 is at H level, and selects the write address in other cases. An output terminal of selector 404 is connected to an address terminal of memory 401. Therefore, the memory 401 is accessed by the write address when writing, and by the succeeding address when writing. Note that the successive address generation counter 409 is capable of scaling using a sub-scanning clock, as will be explained later. Further, in order to change the color adjustment in the mosaic monitor mode, overflow signals X and Y are generated and sent to the image tone setting circuit 2 at the subsequent stage.
なお、スーパーインポーズ続出信号は、スーパーインポ
ーズモードとモザイクモニタモードの読出時に“Loと
なる信号で、セレクタ421に白データを選択させるた
めに用いる。また、トリミングコントロール信号は、続
出領域に白を印字したいときに゛白°とする信号であり
、セレクタ426に白データを選択させる。The superimpose successive signal is a signal that becomes "Lo" when reading out the superimpose mode and mosaic monitor mode, and is used to make the selector 421 select white data.The trimming control signal is a signal that becomes "Lo" when reading out the superimpose mode and mosaic monitor mode. This is a signal that is set to white when it is desired to print, and causes the selector 426 to select white data.
<d−2>多値で記憶するスーパーインボーズモード
スーパーインポーズ機能を実現するのは、中間調処理後
にメモリを設けてらよいが、その場合は、すでに2値の
印字信号に変換されているので登録画像の色彩調整を後
から行うことはできない。特に、登録画像がフルカラー
画像であった場合、色彩調整が求められることが多い。<d-2> Superimpose mode that stores multi-values The superimpose function can be achieved by providing a memory after halftone processing, but in that case, the signal has already been converted to a binary print signal. Therefore, it is not possible to adjust the color of the registered image later. In particular, when the registered image is a full-color image, color adjustment is often required.
また、2値化処理後に変倍をかけると著しく画像か劣化
する。そこで、本実施例では、CPU25により2値記
憶/多値記憶信号をHレベルとして多値記憶を指定する
と、書込のときはi囚/読出信号をLレベルとしてセレ
クタ421,3−ステートバッファ422、データ選択
回路442からなる回路において、バッファ422を能
動状態にし、データ選択回路442内のバッフy501
a、50 lb、501Cをハイインピーダンス状態に
することにより、中間調処理回路27の前にメモリ40
1を介在させ、R,G、Bの多値データをメモリ401
に記憶させる。(なお、スーパーインボーズモードにお
ける色彩調整については、後で画調設定回路2に関連し
て説明する。)このとき、スーパーインポーズモード読
出信号はLレベルであり、セレクタ421は画像データ
を選択している。またCSコントロール信号は000′
である。Furthermore, when scaling is applied after binarization processing, the image deteriorates significantly. Therefore, in this embodiment, when the CPU 25 sets the binary storage/multi-value storage signal to H level to specify multi-value storage, when writing, the i/read signal is set to L level to selector 421, 3-state buffer 422. , in the circuit consisting of the data selection circuit 442, the buffer 422 is activated and the buffer y501 in the data selection circuit 442 is activated.
a, 50 lb, and 501C to a high impedance state, the memory 40 is placed in front of the halftone processing circuit 27.
1, the multivalued data of R, G, and B is stored in the memory 401.
to be memorized. (The color adjustment in the superimpose mode will be explained later in relation to the image setting circuit 2.) At this time, the superimpose mode read signal is at the L level, and the selector 421 selects the image data. are doing. Also, the CS control signal is 000'
It is.
登録画像の書込みにおいては、使用者が書込領域を指定
すると、CPU25はこの領域が画像先端からみて(副
走査方向について)何ラインの範囲の領域か、さらに主
走査方向(X方向)について何画素目の範囲にあるかを
算出し、この領域の左上角の座標と右上角の座標をX方
向とY方向の書込領域設定信号として書込領域判別回路
(詳細は第12図参照)402のX部402aと7部4
02bにそれぞれ設定する。X、Yはそれぞれ主走査方
向と副走査方向をさす。書込領域判別回路402のX部
402aと7部402bは、画像先端信号が入力される
と、水平同期信号HsyncおよびクロックCKBをカ
ウントするとともに、そのカウント値が上記書込領域設
定範囲にあるかどうかを比較する。主走査方向に範囲内
であれば、WEX=17°を出力し、副走査方向に範囲
内であればWEY=’L’を出力する。When writing a registered image, when the user specifies a writing area, the CPU 25 determines how many lines this area covers from the leading edge of the image (in the sub-scanning direction), and also what about the main scanning direction (X direction). A writing area determination circuit (see FIG. 12 for details) 402 calculates whether it is within the range of the pixel, and uses the coordinates of the upper left corner and the upper right corner of this area as writing area setting signals in the X direction and Y direction. X part 402a and 7 part 4
02b respectively. X and Y refer to the main scanning direction and the sub-scanning direction, respectively. When the image leading edge signal is input, the X section 402a and the 7 section 402b of the writing area determination circuit 402 count the horizontal synchronizing signal Hsync and the clock CKB, and check whether the count value is within the above writing area setting range. Compare how. If it is within the range in the main scanning direction, WEX=17° is output, and if it is within the range in the sub-scanning direction, WEY='L' is output.
書込アドレス発生カウンタ(詳細は第12図参照)40
3は、書込領域判別回路402が書込領域であると判別
したときに書込アドレスを発生し、セレクタ404を介
してメモリ401a、401b401cのアドレス端子
に送る。すなわち、書込アドレス発生カウンタのX部4
03aではWEX=°L°のときクロックCKBをカウ
ントし、主走査方向に関するアドレスを発生する。なお
、このアドレスは、水平同期信号H5yncでクリアさ
れる。Write address generation counter (see Figure 12 for details) 40
3 generates a write address when the write area determination circuit 402 determines that it is a write area, and sends it to the address terminals of the memories 401a, 401b and 401c via the selector 404. In other words, the X section 4 of the write address generation counter
In step 03a, when WEX=°L°, the clock CKB is counted and an address related to the main scanning direction is generated. Note that this address is cleared by the horizontal synchronization signal H5sync.
また、書込アドレス発生カウンタ403の7部403b
は、WEY=’L’のとき水平同期信号Hsyncをカ
ウントし、副走査方向に関するアドレスを発生する。な
お、このアドレスはCPU25が発生する画像先端信号
によりクリアされる。主走査方向と副走査方向の両アド
レスと固定オフセット量より1次元の書込アドレスが発
生される。Also, the seventh section 403b of the write address generation counter 403
counts the horizontal synchronizing signal Hsync when WEY='L' and generates an address in the sub-scanning direction. Note that this address is cleared by the image leading edge signal generated by the CPU 25. A one-dimensional write address is generated from both addresses in the main scanning direction and sub-scanning direction and a fixed offset amount.
このようにして書込アドレスを発生し、メモリ401a
、40 lb、401cに画像データを書き込む際は、
さらに、データ保持信号がL′、書込/読出信号が“L
oと設定されている。これにより、セレクタ404は、
ANDゲート405から選択信号が送られるので、書込
アドレス発生カウンタ403からのアドレス信号を選択
し、メモリ401a、401b、401cのアドレス端
子に伝える。In this way, a write address is generated and the memory 401a
, 40 lb, 401c, when writing image data to
Furthermore, the data holding signal is L' and the write/read signal is "L".
It is set as o. As a result, the selector 404
Since a selection signal is sent from the AND gate 405, the address signal from the write address generation counter 403 is selected and transmitted to the address terminals of the memories 401a, 401b, and 401c.
また、インバータ406とANDゲート407を介して
メモリ401a、40 lb、、401cのWE端子に
クロックCKBが伝えられ、メモリへの書込を可能にす
る。一方、スーパーインポーズモードとモザイクモニタ
モードでの読出しの場合以外ではCPTJ25からのス
ーパーインポーズ続出信号はL°と設定されているので
、セレクタ421は画像データを選択して出力する。ま
た、書込/読出信号がL゛と設定されているので、多値
記憶の場合(CPU25からの2値記憶/多値記憶信号
=’H’)、3−ステートバッファ422は、原稿画像
を書き込んでよい状態でのみANDゲート425を介し
て能動状態になり、画像データをメモリ401a、40
lb、401cのI10端子に伝える。これに上り書
込領域判別回路402が主走査方向、副走査方向としに
範囲内であると判定した領域についての画像だけをメモ
リ401に記憶させることができる。書込みが終了する
と、CPU25はデータ保持信号を“H”とし、AND
ゲート407を介して書き込みを禁止し、メモリ401
の内容を保持する。Further, the clock CKB is transmitted to the WE terminals of the memories 401a, 40lb, . On the other hand, since the superimpose successive signal from the CPTJ 25 is set to L° in cases other than reading in the superimpose mode and mosaic monitor mode, the selector 421 selects and outputs image data. Also, since the write/read signal is set to L, in the case of multi-value storage (binary storage/multi-value storage signal from the CPU 25 = 'H'), the 3-state buffer 422 stores the original image. It becomes active via the AND gate 425 only when it is allowed to write, and the image data is stored in the memories 401a, 40.
lb, transmit to I10 terminal of 401c. In addition, it is possible to store in the memory 401 only the image of the area that the upward writing area determination circuit 402 determines to be within the range in both the main scanning direction and the sub-scanning direction. When writing is completed, the CPU 25 sets the data holding signal to “H” and
Writing is prohibited through gate 407 and memory 401
Retains the contents of.
メモリ401に記憶されたデータを読出す際には、指定
された続出領域(スーパーインポーズ領域)に印字する
ようにデータを読出す必要がある。When reading the data stored in the memory 401, it is necessary to read the data so as to print it in a designated successive area (superimpose area).
続出しに必要な回路構成は、書込用の部分とほぼ同じで
ある。書込時と同じくCSコントロール信号は000
とする。The circuit configuration required for successive output is almost the same as that for writing. As with writing, the CS control signal is 000.
shall be.
以下余白
CPtJ25は、用紙に対し続出領域を判別する続出領
域判別回路408のX部408aと7部408bには、
それぞれ、主走査方向と副走査方向に続出領域範囲内で
あると判別できる設定値(X座標とY座標)を与えてお
く。続出領域判別回路408a、408bは、スキャン
の際に画像先端信号が入力されると、水平同期信号Hs
yncおよびクロックCKBをカウントするとともに、
そのカウント値が上記続出領域設定範囲にあるかどうか
を比較する。主走査方向が範囲内であればREX=゛L
′を出力し、副走査方向が範囲内であればREY=’L
’を出力する。The following margin CPtJ25 is stored in the
Setting values (X coordinates and Y coordinates) that can be determined to be within the successive region range in the main scanning direction and the sub-scanning direction are respectively given. When the image leading edge signal is input during scanning, the successive area determination circuits 408a and 408b output a horizontal synchronizing signal Hs.
Along with counting ync and clock CKB,
A comparison is made to see if the count value is within the above continuous area setting range. If the main scanning direction is within the range, REX=゛L
' is output, and if the sub-scanning direction is within the range, REY='L
' is output.
続出アドレス発生カウンタ409は、読出領域判別回路
408が続出領域であると判別したときに続出アドレス
を発生し、このアドレスは、続出時には書込/読出信号
が°H°なのでセレクタ404を介してメモリ401a
、40 lb、401cのアドレス端子に送られる。す
なわち、続出アドレス発生カウンタのx部409aは、
REX=’L’(7)ときクロックCKBをカウントし
、主走査方向に関するアドレスを発生する。なお、この
アドレスは水平同期信号H5yncでクリアされる。ま
た、続出アドレス発生カウンタの7部409bはREY
=“Loのとき変倍副走査クロック発生器29(第2図
)からの副走査クロックをカウントし、副走査方向に関
するアドレスを発生する。水平同期信号Hsyncでは
なく副走査クロックをカウントするのは、変倍を考慮し
たものである。なお、このアドレスはCPU25が発生
する画像先端信号によりクリアされる。両アドレスと固
定オフセット量より1次元の続出アドレスが発生される
。メモリ401をアクセスして読み出されたデータは後
段に伝えられる。The successive address generation counter 409 generates a successive address when the readout area determination circuit 408 determines that it is a successive area, and this address is sent to the memory via the selector 404 since the write/read signal is °H° at the time of successive reading. 401a
, 40 lb, and 401c. That is, the x section 409a of the successive address generation counter is
When REX='L' (7), the clock CKB is counted and an address related to the main scanning direction is generated. Note that this address is cleared by the horizontal synchronization signal H5sync. In addition, the seventh part 409b of the successive address generation counter is REY
= "When Lo, the sub-scanning clock from the variable magnification sub-scanning clock generator 29 (FIG. 2) is counted and an address related to the sub-scanning direction is generated. Counting the sub-scanning clock instead of the horizontal synchronizing signal Hsync is , in consideration of scaling. Note that this address is cleared by the image leading edge signal generated by the CPU 25. A one-dimensional successive address is generated from both addresses and a fixed offset amount. By accessing the memory 401, The read data is transmitted to the subsequent stage.
このモードにおける画像登録と読出しのフローチャート
は、第20図と第23図に示す。Flowcharts of image registration and readout in this mode are shown in FIGS. 20 and 23.
<d−3>変倍
多値記憶でスーパーインポーズ機能を実行する場合には
、変倍が可能である。変倍を行う際には、スーパーイン
ポーズする画像もその倍率に合わせて変倍したい場合も
あれば、原稿読取は変倍でもスーパーインポーズ画像は
等倍のままというように、互いに異なる倍率で行いたい
場合もある。CPU25により変倍用副走査クロック発
生器29を制御して変倍用の副走査クロックを変えるこ
とにより、どちらの場合にも対応できる(第26図参照
)。すなわち、スーパーインポーズ画像を変倍する場合
は、続出アドレス発生カウンタ409に変倍用走査クロ
ックを供給し、原稿読取データを変倍する場合は、電気
変倍回路26に変倍用副走査クロックを供給する。なお
、本実施例では、スーパーインポーズ画像の変倍率と原
稿画像の変倍率とが同じである場合は、両画像を同時に
印字できる。<d-3> Variable scaling When performing a superimpose function using multi-level storage, variable scaling is possible. When changing the magnification, you may want to change the magnification of the superimposed image to match that magnification, or you may want to change the magnification of the superimposed image to match the magnification of the superimposed image. Sometimes you want to do it. Either case can be handled by controlling the sub-scanning clock generator 29 for variable magnification by the CPU 25 to change the sub-scanning clock for variable magnification (see FIG. 26). That is, when scaling the superimposed image, a scanning clock for scaling is supplied to the successive address generation counter 409, and when scaling the document read data, a sub-scanning clock for scaling is supplied to the electric scaling circuit 26. supply. In this embodiment, if the magnification ratio of the superimposed image and the magnification ratio of the original image are the same, both images can be printed at the same time.
<d−4>モザイクモニタモードでの書込みと読出し
モザイクモニタモードにおける注目領域の画像データ(
多値)の書込みも、同様に行われる。この場合、CPU
25は書込領域設定信号を注目領域の座標から計算して
出力する。<d-4> Writing and reading in mosaic monitor mode Image data of the area of interest in mosaic monitor mode (
Writing of multi-value data is also performed in the same way. In this case, the CPU
25 calculates a write area setting signal from the coordinates of the area of interest and outputs it.
一方、モザイクモニタモードにお(Jるモザイクモニタ
画像の印字の際は、メモリ4、Ola、401b、40
1cに書込まれたデータを基に、第7図のフォーマット
のような印字ができるようにデータを読出す必要がある
。この場合、メモリ401からのデータ続出時以外では
画像データを゛白°にするため、スーパーインポーズ続
出信号をH’とし、セレクタ421により゛白°データ
を選択する。セレクタ426は、原稿上の画像データを
読み出す際に、メモリ401の内容を読み出す続出領域
においてはトリミングコントロール信号が゛H°レベル
なので、後段に゛白°データが流れないようになってい
る。このとき、続出領域判別回路408のX部408a
、Y部408bには、原稿読出の倍率MAGAとメモリ
401の内容の印字倍率MAGBとの違いを考慮した座
標がそれぞれ設定されている。なお、変倍用副走査クロ
ックは、原稿続出倍率MAGAと一致させておく。On the other hand, when printing a mosaic monitor image in mosaic monitor mode (J), memory 4, Ola, 401b, 40
Based on the data written in 1c, it is necessary to read out the data so that it can be printed in the format shown in FIG. In this case, in order to make the image data "white" except when data is continuously output from the memory 401, the superimpose succession signal is set to H', and the selector 421 selects "white" data. When the selector 426 reads the image data on the document, the trimming control signal is at the 'H' level in the successive area where the contents of the memory 401 are read, so that the 'white' data does not flow to the subsequent stage. At this time,
, Y portion 408b, coordinates are set in consideration of the difference between the magnification MAGA for reading the original and the printing magnification MAGB of the contents of the memory 401. Note that the sub-scanning clock for variable magnification is made to coincide with the document successive magnification MAGA.
今、第7図を例にとり3×9のブロックのモザイクモニ
タ画像を出力したい場合、メモリの読み出し方としては
、オーバーフロー信号Xを用いて主走査方向に3回同じ
ラインの内容を読み出し、副走査方向について全内容を
読み出すと、再び主走査方向を先頭ラインから読み出す
ことになる。Now, taking Figure 7 as an example, if you want to output a mosaic monitor image of 3 x 9 blocks, the way to read the memory is to use the overflow signal When all the contents in the direction are read out, the main scanning direction is read out again from the first line.
続出時においては、1囚/読出信号がH゛となっており
、セレクタ404は続出アドレスを選択し、メモリ40
1a、40 lb、401cは続出領域で出力可能状部
である。さらに、バッファ422はハイインピーダンス
状態となっている。ここで、CPU25は、出力フォー
マット(第7図参照)に対応して続出領域判別回路X部
408aには、KO≦X≦X、であるとき開回路Y部4
08bには、yo≦Y≦y1であるとき、続出範囲内で
あると判別できる設定値を与えておく。用紙に対し、続
出領域を判別する続出領域判別回路408のX部408
a、Y部408bの出力REX、REVがLレベルであ
るとき、続出アドレス発生カウンタ409のX部409
a、Y部409bにより続出アドレスを発生させ、その
続出アドレスを用いてメモリ401a。At the time of continuous output, the 1 prisoner/read signal is high, the selector 404 selects the continuous address, and the memory 40
1a, 40 lb, and 401c are continuous output areas. Furthermore, the buffer 422 is in a high impedance state. Here, in accordance with the output format (see FIG. 7), the CPU 25 sends the open circuit Y section 408a to the successive area discriminating circuit
08b is given a setting value that can be determined to be within the successive range when yo≦Y≦y1. X section 408 of the successive area determination circuit 408 that determines the successive area with respect to paper
a, when the outputs REX and REV of the Y section 408b are at L level, the X section 409 of the successive address generation counter 409
a, the Y unit 409b generates successive addresses, and the successive addresses are used to write the memory 401a.
40 lb、401cをアクセスし、保持してあった画
像データをセレクタ426,427を経て後段に伝える
。このとき、続出アドレス発生カウンタ409は、主走
査方向に1ブロック分をすぎ最大サイズを越えても続出
領域内であれば当然カウント要求がなされるわけである
か、続出アドレス発生カウンタ′409はオーバーフロ
ー信号XYを後段に配置される画調設定回路2に出力す
るとともに、次のブロックのため再び初期値からカウン
トをはじめるものとする。オーバーフロー信号X。40 lb and 401c, and transmit the retained image data to the subsequent stage via selectors 426 and 427. At this time, even if the successive address generation counter 409 passes one block in the main scanning direction and exceeds the maximum size, if it is within the successive area, a count request is naturally made, or the successive address generation counter '409 overflows. It is assumed that the signal XY is outputted to the image tone setting circuit 2 disposed at the subsequent stage, and counting is started again from the initial value for the next block. Overflow signal X.
Yは、モザイクモニタモードで複数の画像を水平方向と
副走査方向に並べて色調を異ならせて印字する場合に用
いる。後述の画調設定回路2においては、オーバーフロ
ー信号X、Yに対応して異なった色調整係数に、、kf
fl、kcがCPU25から設定されるので、各画像は
それぞれ異なった色調が施されて印字されることになる
。こうして、水平方向に3個の画像が印字され、これを
9回繰り返すことにより、3×9のモザイクモニタ画像
が印字される。Y is used when a plurality of images are arranged in the horizontal direction and the sub-scanning direction and printed with different color tones in the mosaic monitor mode. In the image tone setting circuit 2, which will be described later, different color adjustment coefficients are set according to the overflow signals X and Y.
Since fl and kc are set by the CPU 25, each image is printed with a different color tone. In this way, three images are printed in the horizontal direction, and by repeating this nine times, a 3×9 mosaic monitor image is printed.
<d−5>2値(カラー)で記憶するスーバーインボー
ズモード
これまで、多値でスーパーインポーズ用に画像を記憶す
る場合について説明したが、使用目的によっては、変倍
・色調整はできな(ても大きなエリアを記憶・書き込み
したい場合がある。そこで、本実施例では、2値記憶の
場合はCPU25が2(ik ai!、* /多値記憶
信号をLレベルとすることにより、メモリブロック40
1a〜401cを中間調処理後に挿入できる構成をとっ
ている。そして、2値記憶の場合は、以下に説明するよ
うに、2値化処理後の2値の画像データをメモリ401
に記憶する。これにより、たとえば多値信号が8ビツト
であれば、8倍のエリアの2値データが記憶できること
になる。<d-5> Superimpose mode for storing binary (color) images So far, we have explained the case of storing images for superimposition in multi-valued formats, but depending on the purpose of use, scaling and color adjustment may not be possible. There are cases where it is desired to store/write a large area. Therefore, in this embodiment, in the case of binary storage, the CPU 25 sets the 2(ikai!,*/multi-value storage signal to L level). memory block 40
The configuration is such that images 1a to 401c can be inserted after halftone processing. In the case of binary storage, the binary image data after the binarization process is stored in the memory 401 as described below.
to be memorized. As a result, if the multilevel signal is 8 bits, for example, binary data of 8 times the area can be stored.
書込記憶の場合、2値記憶/多値記憶信号をL°とし、
ti A /読出信号をL°とするので、バッファ42
2はハイインピーダンス状態になり、データ選択回路4
42内のバッフy501g、501b、501cは能動
状態になり、メモリ401はマスキング処理以前の段階
から切り離される。一方、セレクタ427は入力Aを選
択する。書込の場合、スーパーインポーズ続出信号は用
°なので、セレクタ421は画像データを選択している
。従って、画像データはセレクタ421.427を介し
て後段に送られ、回路24.2,26.27を経て2値
化される。一方、中間調処理回路27の後側では、2値
化された信号はS−P変換器441で変換されたパラレ
ルデータとしてデータ選択回路442内の3−ステート
バッフy 501a、50 lb、501cを介してメ
モリ401に伝えられる。In the case of write memory, the binary memory/multi-value memory signal is set to L°,
Since the ti A /read signal is set to L°, the buffer 42
2 becomes a high impedance state, and the data selection circuit 4
Buffers y501g, 501b, 501c in 42 become active, and memory 401 is disconnected from the previous stage of the masking process. On the other hand, selector 427 selects input A. In the case of writing, the superimpose successive signal is not used, so the selector 421 selects image data. Therefore, the image data is sent to the subsequent stage via selectors 421 and 427, and is binarized via circuits 24.2 and 26.27. On the other hand, on the rear side of the halftone processing circuit 27, the binarized signal is converted by the S-P converter 441 and sent as parallel data to 3-state buffers 501a, 50 lb, and 501c in the data selection circuit 442. The information is transmitted to the memory 401 via the memory 401.
ここで、画像信号は中間調処理回路27を通過した信号
であるから、半導体レーザ33をドライブできる信号、
すなわち、0N10FF(1ビツト)の2値化された信
号となっている。そこで、シリアル−パラレル変換器4
41をメモリ401の前段に配置し、2値化する前の多
値状態におけるビット数(8ビツト)毎のデータに変換
してメモリ401a、40 lb、401cのI10端
子に伝えられるようにしている。さらに、続出の際には
、パラレル−シリアル変換器445で1ビツトデータに
再変換して出力する。Here, since the image signal is a signal that has passed through the halftone processing circuit 27, the signal that can drive the semiconductor laser 33,
That is, it is a binary signal of 0N10FF (1 bit). Therefore, the serial-parallel converter 4
41 is placed in the front stage of the memory 401, and the data is converted into data for each number of bits (8 bits) in a multi-value state before binarization, and is transmitted to the I10 terminals of the memories 401a, 40lb, and 401c. . Furthermore, when outputting data one after another, the parallel-to-serial converter 445 reconverts it into 1-bit data and outputs it.
2値で記憶された信号は変倍ができないので、2値記憶
では変倍用副走査クロックは等倍に設定しておく。Since signals stored in binary format cannot be scaled, the sub-scanning clock for scaling is set to equal magnification in binary storage.
書込領域判別回路402と書込アドレス発生カウンタ4
03の動作については、クロックCKAが分周されたこ
とを除いて、多値記憶のときと何ら違いはないので説明
は省略する。Write area determination circuit 402 and write address generation counter 4
Regarding the operation of 03, there is no difference from that in multi-level storage except that the clock CKA is frequency-divided, so a description thereof will be omitted.
続出の際は、続出領域で3−ステートバッファ422及
びデータ選択回路442内の3−ステートバッフy 5
01a、50 lb、501cはハイインピーダンス状
態となり、メモリ401のデータは、CSコントロール
信号により能動状態になったデータ選択回路442内の
3−ステートバッファ504a、504bまたは504
cを通り、セレクタ444、P−9変換器445、セレ
クタ446を経て、バッファメモリ30に送られる。続
出領域外では、セレクタ421,427を通る゛白′デ
ータがセレクタ446から送られる。In the case of successive output, the 3-state buffer 422 and the 3-state buffer y5 in the data selection circuit 442 are used in the successive output area.
01a, 50 lb, and 501c are in a high impedance state, and the data in the memory 401 is transferred to the 3-state buffer 504a, 504b, or 504 in the data selection circuit 442 activated by the CS control signal.
c, and is sent to the buffer memory 30 via a selector 444, a P-9 converter 445, and a selector 446. Outside the continuous region, "white" data passing through selectors 421 and 427 is sent from selector 446.
さて、萌にも述べたように、今、対象としていて、中間
調処理回路27から出力される信号は、Y、M、C,に
のいずれかの印字信号である。これにより、2値記憶に
よってカラー画像を記憶するためには、印字工程と同じ
く、複数回同じエリアをスキャンしなければならない。Now, as mentioned by Moe, the signal outputted from the halftone processing circuit 27 is a Y, M, or C print signal. As a result, in order to store a color image using binary storage, the same area must be scanned multiple times, similar to the printing process.
このとき、当然のごとなから多値記憶に比べてメモリ容
量は少なくてもよいのでメモリ401を分割して書込/
読出を行うことが、多くの画像を記憶するために好まし
い。そこで、本実施例では多値記憶で3色分並列して書
込み/読出しを行っていたメモリ401a、401b、
401cを各々別個に扱えるようにしている。メモリ内
容の読出しら書込みも印字色に合わせて行わねばならな
い。At this time, as a matter of course, the memory capacity may be smaller than that of multilevel storage, so the memory 401 is divided and written/written.
Reading is preferred for storing many images. Therefore, in this embodiment, the memories 401a, 401b, which are multi-valued and write/read data for three colors in parallel,
401c can be handled separately. Reading and writing of memory contents must also be performed in accordance with the print color.
たとえば、Y、M、Cの像が各々メモリ401a。For example, Y, M, and C images are each stored in the memory 401a.
401b、401cに記憶されているとすると、実際に
スーパーインポーズを行う工程において、Y印字のとき
にメモリ401aを読み出すといったように対応がとれ
ていなくてはならない。そこで、CPU25は、CSコ
ントロール信号で続出すべては、メモリ401aをセレ
クトし、M信号に関しては、メモリ401bをセレクト
し、C信号に関しては、 メモリ401cをセレクトす
るようにCSコントロール信号をCPU25が管理して
やればよい(第27図のフローチャート参照)。If it is stored in the memory 401b and 401c, in the process of actually superimposing, correspondence must be established such as reading out the memory 401a when printing Y. Therefore, the CPU 25 manages the CS control signals so that the memory 401a is selected for all CS control signals, the memory 401b is selected for the M signal, and the memory 401c is selected for the C signal. (See the flowchart in Figure 27).
なお、複数の画像が登録されている場合は、選択された
画像を読出すようにアドレス(固定オフセットm)を設
定する(第25図8205参照)。Note that if a plurality of images are registered, an address (fixed offset m) is set to read the selected image (see 8205 in FIG. 25).
登録後の変倍、色補正の必要性がないときは、自動的に
2値で記憶することを選択できるようにしてもよい。If there is no need for scaling or color correction after registration, it may be possible to automatically select storage in binary format.
このモードにおける画像登録と読出しのフローチャート
を第20図と第27図に示す。Flowcharts of image registration and readout in this mode are shown in FIGS. 20 and 27.
<d−6>単色(2値)で記憶するスーパーインポーズ
モード
これまでは、スーパーインポーズにカラー画像を用いる
ことを前提として説明してきたが、用途によっては、ス
ーパーインポーズを行いたい画像は、たとえば、黒1色
といった1つの印字色のみの印字の場合がある。もちろ
ん、多値記憶した場合は、適当な色補正をして、黒1色
といった単色に変換することは容易である。<d-6> Superimpose mode that stores in single color (binary) Up until now, the explanation has been based on the assumption that a color image is used for superimposition, but depending on the application, the image you want to superimpose may be For example, there are cases where printing is performed using only one printing color, such as black. Of course, in the case of multi-value storage, it is easy to perform appropriate color correction and convert to a single color such as black.
しかし、本実施例では、フルカラー画像の2値記憶の場
合と同様に2値化された信号をメモリ401に書き込む
。2値化信号の書込と続出は、マルチカラー2値記憶の
場合とほぼ同様に行なわれるが、一部の点で相違がある
。However, in this embodiment, a binary signal is written into the memory 401 in the same way as in the case of binary storage of a full-color image. Writing and successive output of binary signals are performed in almost the same way as in the case of multicolor binary storage, but there are some differences.
2値記憶を用いる場合は、適当な色補正をした後の画像
を2値化した画像を記憶するわけであるから、フルカラ
ー画像を記憶するために、401a、40 lb、40
1cの3面分のメモリを必要としたのに対し、単色では
1面分だけを必要とする。When using binary storage, the image is binarized after appropriate color correction is stored, so in order to store a full color image, 401a, 40 lb, 40
1c requires memory for three pages, whereas monochrome requires only one memory.
従って、単色を記憶する場合には、1つの画像だけでは
なく、たとえば、3面分といった複数の画像を記憶して
おくことが可能となる。CPU25は、書込と続出にお
いてCSコントロール信号でメモリを指定し、かつ、固
定オフセット量と書込(続出)領域設定信号を出力する
。この場合、たとえば、メモリ画像を印字する領域内で
も、Y印字のときはメモリを読み出し、M印字のときは
何も印字しないといった操作が必要である。この動作を
実現するため、前述した如く、セレクタ444が設けら
れていて、CSコントロール信号が3ビツトともビのと
きは、セレクタ444がB入力側の“白゛データを選択
し、印字を禁止している。なお、変倍用副走査クロック
は等倍に設定しておく。Therefore, when storing a single color, it is possible to store not only one image but a plurality of images, for example three images. The CPU 25 specifies a memory using a CS control signal for writing and continuous writing, and also outputs a fixed offset amount and a writing (successive) area setting signal. In this case, for example, even within the area where the memory image is printed, it is necessary to read the memory for Y printing and not print anything for M printing. In order to realize this operation, as mentioned above, a selector 444 is provided, and when all three bits of the CS control signal are bits, the selector 444 selects "white data" on the B input side and prohibits printing. Note that the sub-scanning clock for scaling is set to the same magnification.
このモードにおける画像登録と読出しのフローを第21
図と第28図に示す。The flow of image registration and readout in this mode is explained in the 21st section.
As shown in FIG.
<d−7>多値記憶と2値記憶の混在 多値記憶と2値記憶の混在も可能である。<d-7> Mixture of multivalued storage and binary storage It is also possible to mix multi-value storage and binary storage.
本発明では、後に説明するように主・副走査方向のアド
レスをメモリにアクセスするための1次元アドレスに変
換する。画像登録の際に、CPU25はメモリ401の
空き容量を考慮してアドレス(固定オフセット量)を設
定すればよい(第18図S27,528)。ただし、2
値記憶の単色モードとフルカラー(多値および2値)モ
ードを混在させる場合には、若干の配慮を必要とする。In the present invention, addresses in the main and sub-scanning directions are converted into one-dimensional addresses for accessing the memory, as will be explained later. When registering the image, the CPU 25 may set the address (fixed offset amount) in consideration of the free space of the memory 401 (S27, 528 in FIG. 18). However, 2
Some consideration is required when monochrome mode and full color (multi-value and binary) mode of value storage are mixed.
第11図に示すように、フルカラー画像については、多
値、2値を問わずアドレスの先頭(各メモリ401a、
40 lb、401cの同じアドレス)から順に登録を
行う。一方、単色2値画像については、最上位アドレス
(L A)に登録画像データの後端がくるように書込ア
ドレスの固定オフセット量を算出し、登録する。その際
、各単色2値画像の登録画像データの先頭アドレスがで
きるだけ小さくならないよう、すなわち、各単色2値デ
ータがメモリ401a、40 lb、401cに平均的
に記憶されるよう配慮しながら登録を進める。何故なら
ば、たとえば、メモリ401aに集中的に単色2値画像
を登録すると、フルカラー(多値、2値)画像の登録可
能領域が急激に減少するからである。As shown in FIG. 11, for full-color images, regardless of whether they are multivalued or binary, the beginning of the address (each memory 401a,
40lb and 401c). On the other hand, for a monochromatic binary image, a fixed offset amount of the write address is calculated and registered so that the rear end of the registered image data is located at the highest address (LA). At this time, the registration is carried out while taking care not to make the start address of the registered image data of each monochrome binary image as small as possible, that is, to ensure that each monochrome binary data is stored evenly in the memories 401a, 40 lb, and 401c. . This is because, for example, if single-color binary images are intensively registered in the memory 401a, the area in which full-color (multi-value, binary) images can be registered will rapidly decrease.
第2図の例では、単色(モノカラー)2値画像2は、メ
モリ401aにおいてモノカラ−2値画像2の前につづ
けて記憶するのではなく、メモリ401bに最上位アド
レスLAから記憶する。In the example of FIG. 2, the monochrome binary image 2 is not stored successively before the monochrome binary image 2 in the memory 401a, but is stored in the memory 401b starting from the highest address LA.
<d−8>領域判別回路とアドレス発生カウンタ
次に、登録画像メモリ回路lを構成する書き込み(読み
出し)の領域判別回路402(408)お上びアドレス
発生カウンタ403(409)について第12図の詳細
回路図を用いて説明する。なお、書込みと読出しとて同
じ構成の領域判別回路とアドレス発生カウンタが使用さ
れ、両者の相違点は、続出の場合に変倍用副走査クロッ
クを用いることとオーバーフロー信号X、Yを出力する
ことだけである。<d-8> Area Discrimination Circuit and Address Generation Counter Next, we will discuss the write (read) area discrimination circuit 402 (408) and address generation counter 403 (409) that constitute the registered image memory circuit l as shown in FIG. This will be explained using a detailed circuit diagram. Note that the area discrimination circuit and address generation counter with the same configuration are used for writing and reading, and the difference between the two is that in the case of continuous writing, a sub-scanning clock for variable magnification is used and overflow signals X and Y are output. Only.
第12図において、書込領域(続出領域)判別回路のX
部402a(408a)はカウンタ回路601゜602
、D−7リツプフロツプ603,604およびANDゲ
ート605で構成している。In FIG. 12, X of the writing area (successive area) discrimination circuit
The section 402a (408a) is a counter circuit 601°602
, D-7 lip-flops 603, 604, and an AND gate 605.
ダウンカウンタであるカウンタ回路601,602のプ
リセット端子には、書込領域(続出領域)の左上角と右
下角のX座標の値を設定するための初期値データX。−
1,x+−1がCPU25より送られ、水平同期信号H
syncが1oad端子に送られる。Initial value data X for setting the values of the X coordinates of the upper left corner and the lower right corner of the write area (continuation area) is input to the preset terminals of the counter circuits 601 and 602, which are down counters. −
1, x+-1 is sent from the CPU 25, and the horizontal synchronization signal H
sync is sent to the 1oad terminal.
従って、水平同期信号Hsyncが出力されると、カウ
ンタ回路601,602にそれぞれ初期値データX。−
1,X、−1がプリセットされる。ここに、KO+X+
は、長方形である書込(続出)領域の左上角と右下角の
X座標値である。両カウンタ回路601.602のクロ
ック端子には、クロック信号CKBが人力される。従っ
て、クロック信号CKBが入力されるごとに、カウンタ
回路601.602はカウント値を1つ減らし、カウン
ト値が0をすぎると、ripple carry信号
を発生する。このripple carry信号は、そ
れぞれ、D−フリップ70ツブ603,604にクロッ
ク信号として送られる。両り−フリップフロップ603
,604においては、各CLR端子に同じ水平同期信号
Hsyncが人力されるが、D端子には、Lレベルと■
4レベルがそれぞれ入力される。D−フリップフロップ
603のQ出力は、水平同期信号Hsyncの正進行エ
ツジでHレベルになり、xo個のクロックをカウントし
た後、ripple carry信号の正進行エツジで
Lレベルに反転する。一方、D−フリップフロップ60
4のQ出力は、水平同期信号Hsyncの正進行エツジ
でLレベルになり、x1個のクロックをカウントした後
、ripple carry信号の正進行エツジでHレ
ベルになる。フリップフロップ603のQ出力とフリッ
プフロップ604のσ出力は、それぞれANDゲート6
05の入力端子に送られる。Therefore, when the horizontal synchronization signal Hsync is output, the initial value data X is input to the counter circuits 601 and 602, respectively. −
1, X, -1 are preset. Here, KO+X+
are the X coordinate values of the upper left corner and lower right corner of the rectangular writing (continuation) area. A clock signal CKB is input to the clock terminals of both counter circuits 601 and 602. Therefore, each time the clock signal CKB is input, the counter circuits 601 and 602 decrease the count value by one, and when the count value exceeds 0, they generate a ripple carry signal. This ripple carry signal is sent as a clock signal to the D-flip 70 tubes 603 and 604, respectively. Both flip-flops 603
, 604, the same horizontal synchronizing signal Hsync is manually input to each CLR terminal, but the D terminal has an L level and
Each of the four levels is input. The Q output of the D-flip-flop 603 becomes H level at the positive edge of the horizontal synchronization signal Hsync, and after counting xo clocks, is inverted to L level at the positive edge of the ripple carry signal. On the other hand, D-flip-flop 60
The Q output of No. 4 becomes L level at the positive edge of the horizontal synchronization signal Hsync, and after counting x1 clocks, becomes H level at the positive edge of the ripple carry signal. The Q output of the flip-flop 603 and the σ output of the flip-flop 604 are connected to the AND gate 6.
It is sent to the input terminal of 05.
従って、ANDゲート605の出力端子は、カウントX
。とxlの間でLレベルになる。Therefore, the output terminal of AND gate 605 is the count
. It becomes L level between and xl.
以下余白
第13図は、領域判別回路の動作のタイムチャートを示
す。CPU25が与えた初期データ゛X。FIG. 13 in the margin below shows a time chart of the operation of the area discriminating circuit. Initial data ゛X given by the CPU 25.
−1’を初期値としてカウンタ回路601はカウントを
始め、クロックCKBが入力される度にカウント値をデ
クリメントしていく。すると、カウンタ回路601はX
。だけクロックCKBが入力されると、ripple
carry信号を発生する。この信号が入力されると、
予めH゛にセットされていたフリップフロップ603は
そのQ出力を反転し、“L゛レベルANDゲート605
に伝える。また、カウンタ回路602についても同様に
初期データx、−1’を初期値としてX、だけクロック
CKBが入力されると、フリップフロップ604のQ出
力がL°から“H゛に反転し、°HルベルをANDゲー
ト605に伝える。(なお、フリップフロップ603.
604のQ出力とQ出力は、クリア時にはそれぞれ°H
°レベル、°Lルベルとなる。)今、Ko<X、である
と、書込領域(続出領域)であるX。とxlの間だけが
、ゲート605の出力(WEX(REX))がL°とな
る。The counter circuit 601 starts counting with -1' as an initial value, and decrements the count value every time the clock CKB is input. Then, the counter circuit 601
. When clock CKB is input, ripple
Generates a carry signal. When this signal is input,
The flip-flop 603, which was previously set to ``H'', inverts its Q output, and the ``L'' level AND gate 605
tell to. Similarly, for the counter circuit 602, when the clock CKB is input by X with the initial data x, -1' as the initial value, the Q output of the flip-flop 604 is inverted from L° to "H", and transmit the level to the AND gate 605 (note that the flip-flop 603.
Q output and Q output of 604 are respectively °H when cleared.
° level, ° L level. ) Now, if Ko<X, then X is the write area (successive area). Only between and xl, the output (WEX (REX)) of the gate 605 becomes L°.
書込(続出)アドレス発生カウンタ403(409)の
X部403a(409a)は、ANDゲート606とプ
ログラマブルカウンタ607からなる。The X section 403a (409a) of the write (successive) address generation counter 403 (409) consists of an AND gate 606 and a programmable counter 607.
ANDゲート606の出力信号は、クロック信号として
プログラマブルカウンタ607に送られる。The output signal of AND gate 606 is sent to programmable counter 607 as a clock signal.
従って、ANDゲート605の出力信号(WEX)が°
Lルベルのとき、ANDゲート606がもう1つの入力
CKBをプログラマブルカウンタ607に伝える。プロ
グラマブルカウンタ607はCPU25から与えられた
プログラムデータXを除数としてクロックCKBを循環
カウントする。Therefore, the output signal (WEX) of the AND gate 605 is
At L level, AND gate 606 passes another input CKB to programmable counter 607. The programmable counter 607 cyclically counts the clock CKB using the program data X given from the CPU 25 as a divisor.
今、登録画像の主走査方向の長さをクロックCKBのQ
カウント分とした場合、メモリ401に書き込むときに
おいては、CPU25が与えるデータXO+ Xl+
Xについて、
X=x、−XO=σ
としておけばよい。また、モザイクモニタモードの読み
出しにおいて、主走査方向にn回出力したい場合は(第
7図参照)、
X=(x+ xo)/ n=Q
としておけばよい。2値記憶の場合は、X=(x、−x
o)/8n=L’8
としておけばよい。Now, the length of the registered image in the main scanning direction is determined by the Q of the clock CKB.
In the case of counting, when writing to the memory 401, the data XO+ Xl+ given by the CPU 25
Regarding X, it is sufficient to set X=x, -XO=σ. Furthermore, when reading in the mosaic monitor mode, if you want to output n times in the main scanning direction (see FIG. 7), you may set X=(x+xo)/n=Q. In the case of binary storage, X = (x, -x
o)/8n=L'8.
書込(続出)領域判別回路の7部402b(408b)
は、カウンタ回路611,612、フリップフロップ6
13,614、ANDゲート615で構成している。ま
た、書込(続出)アドレス発生カウンタの7部403b
(409b)は、ANDゲート616とプログラマブル
カウンタ617からなる。7 parts 402b (408b) of the write (continuous) area determination circuit
are counter circuits 611, 612, flip-flop 6
13, 614, and an AND gate 615. In addition, the 7th section 403b of the write (continuous) address generation counter
(409b) consists of an AND gate 616 and a programmable counter 617.
その構成と動作については、書込(続出)領域判別回路
のX部402a(408a)と書込(続出)アドレス発
生カウンタのX部403a(409a)による主走査方
向の場合と全く同様である。ただし、カウンタ回路61
1,612にCPU25より与える初期値データをy。Its configuration and operation are exactly the same as those in the main scanning direction using the X section 402a (408a) of the write (successive) area determination circuit and the X section 403a (409a) of the write (successive) address generation counter. However, the counter circuit 61
The initial value data given by the CPU 25 to 1,612 is y.
−1,y+−1とし、ANDゲート616においてクロ
ックCKBの代りにHsyncまたは変倍用副走査クロ
ックというように、X方向とは異なった副走査(Y方向
)用の信号を用い、またカウンタ回路611,612の
ロード端子やフリップフロップ等のCLR端子に入力す
るHsynC信号を画像先端信号とし、プログラマブル
カウンタ617に与えるプログラムデータをY=12と
する。また、プログラマブルカウンタ607,617は
、それぞれオーバーフロー信号X、Yを発生する。-1, y+-1, and in the AND gate 616, a signal for sub-scanning (Y direction) different from the X direction, such as Hsync or a sub-scanning clock for variable magnification, is used instead of clock CKB, and a counter circuit It is assumed that the HsynC signal input to the load terminals 611 and 612 and the CLR terminal of a flip-flop etc. is an image leading edge signal, and the program data given to the programmable counter 617 is Y=12. Furthermore, programmable counters 607 and 617 generate overflow signals X and Y, respectively.
プログラマブルカウンタ607.617のカウント値と
して得られた値はそのままメモリ401のアドレスとし
て用いることもできる。たとえば。The values obtained as the count values of the programmable counters 607 and 617 can also be used as they are as addresses in the memory 401. for example.
プログラムデータXが2のべき乗であれば、下位ビット
をプログラマブルカウンタ607の出力とし、上位ビッ
トをプログラマブルカウンタ617の出力とするだけで
よい。しかしながら、そうでない場合は、上のような方
式をとるとメモリの使用効率が低下してしまう。If the program data X is a power of 2, it is only necessary to set the lower bits as the output of the programmable counter 607 and the upper bits as the output of the programmable counter 617. However, if this is not the case, using the above method will reduce memory usage efficiency.
そこで、本実施例においては、メモリの使用効率をあげ
るため、主副走査方向のアドレスを1次元の連続したメ
モリアドレスに変換している。そして、求められた領域
の縦横比がどのようなものであっても、その面積かメモ
リ総容量以内であれば(第18図526でYES)書込
、続出ができるようにしである。具体的方法としては、
書込(続出)アドレス発生カウンタ403(409)に
おいて、X部403a(409a)と7部403b(4
09b)の他にプログラムデータXとプログラマブルカ
ウンタ607の出力データをアドレスとして索弓する乗
算テーブル621を設け、CPU25が算出した固定オ
フセット量(第18図S27、第25図5205 )す
なわちメモリ先頭番地とプログラマブルカウンタ607
の出力と乗算テーブルの出力とを加算器622で加算す
ることにより、メモリ401の実アドレスを算出してい
る。こうして、Xの値が何であっても、メモリ401に
おいて画像データを1次元状に最密バッキングで記憶で
きる。Therefore, in this embodiment, in order to increase memory usage efficiency, addresses in the main and sub-scanning directions are converted into one-dimensional continuous memory addresses. No matter what the aspect ratio of the obtained area is, if the area is within the total memory capacity (YES at 526 in FIG. 18), writing and subsequent output are possible. As a specific method,
In the write (continuous) address generation counter 403 (409), the X section 403a (409a) and the 7 section 403b (4
In addition to 09b), a multiplication table 621 is provided that searches the program data Programmable counter 607
The real address of the memory 401 is calculated by adding the output of the multiplication table and the output of the multiplication table in an adder 622. In this way, regardless of the value of X, image data can be stored one-dimensionally in the memory 401 with close-packed backing.
また、上の説明で明らかなように、書込関係の領域判別
回路402、アドレス発生カウンタ403と、続出関係
の領域判別回路408、アドレス発生カウンタ409は
副走査クロック以外は全く同じ回路構成である。今まで
は説明を簡単にするため、これらの回路を別々に分けて
書込時と続出時でセレクタ404によりアドレスを選択
していたが、書込と続出は同時に行なわれないから、こ
の回路は共通で1つだけもっておけばよい。Furthermore, as is clear from the above description, the write-related area determination circuit 402 and address generation counter 403 and the continuation-related area determination circuit 408 and address generation counter 409 have exactly the same circuit configuration except for the sub-scanning clock. . Up until now, to simplify the explanation, these circuits have been separated and addresses have been selected by the selector 404 for writing and for successive output, but since writing and successive output are not performed at the same time, this circuit You only need to have one in common.
<d−9>複数画像の書込と続出
複数画像の書込と続出のため加算器622には、CPU
25からの固定オフセット量が与えられている。これは
次に登録される画像の先頭番地を与えるものであり、前
に登録した画像を消去せずに新たに画像を登録すること
ができる。たとえば、第14図に示すように登録画像の
必要容量がmであれば、固定オフセット量をm、2mと
して順次画像を登録できる。登録画像の必要容量がnで
ある場合も同様である。以上では、各登録画像の容量が
同じ場合を示したが、登録済画像lがMアドレス分、登
録済画像2がNアドレス分要していたとすると、第15
図に示すように、新規の画像は、MlNを固定オフセッ
ト量として登録を実行すればよい。<d-9> Writing of multiple images and continuous output In order to write and output multiple images, the adder 622 has a CPU.
A fixed offset amount from 25 is given. This gives the start address of the next image to be registered, and allows a new image to be registered without deleting the previously registered image. For example, as shown in FIG. 14, if the required capacity of the registered images is m, the images can be registered one after another with fixed offset amounts of m and 2 m. The same applies when the required capacity of the registered image is n. The above example shows the case where each registered image has the same capacity, but if registered image l requires M addresses and registered image 2 requires N addresses, then the 15th
As shown in the figure, a new image may be registered with MIN as a fixed offset amount.
CPU25は、画像登録時に登録済画像に関する固定オ
フセット量およびプログラムデータXYを記憶しておき
、使用者の選択に応じてそれらの値をセットすることに
より任意の登録済画像を読出ずことが可能である(第2
5図参照)。また、複数の登録済画像を読出すことも可
能である。The CPU 25 stores the fixed offset amount and program data XY regarding the registered image at the time of image registration, and sets these values according to the user's selection, thereby making it possible to avoid reading out any registered image. Yes (second
(See Figure 5). It is also possible to read out multiple registered images.
なお、以上に説明した領域判別回路とアドレス発生カウ
ンタを並列に複数個設ければ、メモリ401に登録され
た画像の中から複数のものを選択し、用紙上の複数の任
意の位置に合成できる。If a plurality of the above-described area discrimination circuits and address generation counters are provided in parallel, it is possible to select a plurality of images from among the images registered in the memory 401 and synthesize them at a plurality of arbitrary positions on the paper. .
(e)画調設定回路 第16図は、画調設定回路2の回路図である。(e) Picture setting circuit FIG. 16 is a circuit diagram of the image tone setting circuit 2.
画調設定回路2は、モザイクモニタ画像などの色補正(
色調整)を行う回路である。The picture setting circuit 2 performs color correction (
This is a circuit that performs color adjustment).
画調設定回路2の前段にあるマスキング処理回路24に
よって、B、G、Hの3色の各画像信号から、Y(イエ
ロー)、M(マゼンタ)、C(シアン)、お上びK(ブ
ラック)の各印字色に対応する印字のための画像信号(
印字信号)が現像器45a〜45dのトナーの特性に合
わせて生成される。A masking processing circuit 24 located before the image setting circuit 2 generates Y (yellow), M (magenta), C (cyan), and K (black) from each image signal of three colors B, G, and H. ) Image signal for printing corresponding to each printing color (
A print signal) is generated in accordance with the characteristics of the toner in the developing units 45a to 45d.
一般に、元の画像信号B、G、Rから印字信号Y。Generally, the printing signal Y is generated from the original image signals B, G, and R.
M、Cに変換するための変換式は次のように表わされる
。The conversion formula for converting into M and C is expressed as follows.
各変換係数a。O” a 2 ffiは、原稿画像にで
きるだけ近い色の画像が印字されるように、理論と実験
によって適切な値に予め設定されている。Each conversion coefficient a. O''a2ffi is preset to an appropriate value by theory and experiment so that an image with a color as close as possible to the original image is printed.
画調設定回路2における色調整は、上述の演算によって
求められたマスキング処理回路24の出力する各印字信
号Y、M、Cに対して、Y=kyXY
M、 = k□×M
CI=に、XC
の演算を行い、調整済みの印字信号Yl、 Ml、 C
Iを得ることである。ここで、k、に、には前述しmc
た色調整係数である。Color adjustment in the image tone setting circuit 2 is performed using the following formula for each print signal Y, M, and C output by the masking processing circuit 24 obtained by the above-mentioned calculation, Y=kyXY M, = k□×M CI=, Perform the calculation of XC and output the adjusted print signals Yl, Ml, C
It is to obtain I. Here, k is the color adjustment coefficient mc described above.
第7図に示すモザイクモニタ画像GMのフォーマットで
は、Y(イエロー)の色調整係数に、は、副走査方向に
は変化せず、主走査方向にy−++ Yo+y、と変化
し、M(マゼンタ)の色調整係数k は、主走査方向に
は変化せず、副走査方向の1ブロツク毎にmヨ+ m
O+ 1111 + l1l−H+ m O・・・と順
次変化し、C(シアン)の係数には、主走査方向には変
化せず、副走査方向の3ブロツク毎にe−1+・CO+
CIと変化する。In the format of the mosaic monitor image GM shown in FIG. ) color adjustment coefficient k does not change in the main scanning direction, and changes m+m for each block in the sub-scanning direction.
O+ 1111 + l1l-H+ m O..., and the C (cyan) coefficient does not change in the main scanning direction, but changes e-1+ CO+ every 3 blocks in the sub-scanning direction.
Changes with CI.
従って、画調設定回路2においては、各印字信号Y。Therefore, in the image tone setting circuit 2, each print signal Y.
M、Cに対して上述のようにモザイクモニタ画像のブロ
ックごとに色調整係数が順次変更可能になっている。As described above, the color adjustment coefficients for M and C can be changed sequentially for each block of the mosaic monitor image.
さて、第15図に示す画調設定回路2は、上述の印字信
号y、、M、、C+を得るための演算を実行する。画調
設定回路2には、主走査方向の3ブロツクについて3種
類の異なる係数を設定するために、第1ラッチ302.
第2ラッチ303.第3ラツチ304からなるラッチ回
路305が設けられており、これらのラッチ302〜3
04には、CPU25から出力される係数が設定される
ようになっている。Now, the image tone setting circuit 2 shown in FIG. 15 executes calculations to obtain the above-mentioned print signals y, , M, , C+. The image tone setting circuit 2 includes a first latch 302 . to set three different coefficients for three blocks in the main scanning direction.
Second latch 303. A latch circuit 305 consisting of a third latch 304 is provided, and these latches 302 to 3
04 is set to a coefficient output from the CPU 25.
3個のラッチ302〜304からなるラッチ回路305
を設けたのは、主走査方向については係数の変更周期が
短(、CPU25によってリアルタイムに設定すること
は速度的に困難であるからである。なお、係数をn種類
としたい場合には、パラレルにn個のラッチを設ければ
よい。Latch circuit 305 consisting of three latches 302 to 304
The reason for this is that the coefficient change cycle is short in the main scanning direction (and it is difficult to set it in real time by the CPU 25 in terms of speed. If you want n types of coefficients, parallel It suffices to provide n latches.
モザイクモニタモードでは、セレクタ306は、ラッチ
302,303.304の出力する係数を、セレクタ3
12を介して送られてくる信号S21に応じて選択し、
乗算器301に出力する。乗算器301は、マスキング
処理回路24から送られる画像データ(Y、M、C)に
係数を乗じて、得られた印字信号(Y 、、M、、CI
)を電気変倍回路26へ出力する。In the mosaic monitor mode, the selector 306 selects the coefficients output by the latches 302, 303, and 304 from the selector 3.
12 in response to a signal S21 sent through
Output to multiplier 301. The multiplier 301 multiplies the image data (Y, M, C) sent from the masking processing circuit 24 by a coefficient, and outputs the obtained print signal (Y, , M, , CI
) is output to the electric magnification circuit 26.
各ラッチ302〜304の設定入力には、次の3ブロツ
クに対する色調整係数が与えられている。The setting inputs of each latch 302-304 are provided with color adjustment coefficients for the following three blocks.
すなわち、CPU25に変倍用の副走査クロックが割込
信号として入力されるごとに、割込処理(第24図(a
) 、 (b)参照)がなされ、オーバーフロー信号Y
がセレクタ313を介してラッチ回路405にラッチ信
号りとして送られ、色調整係数が設定される。That is, each time the sub-scanning clock for scaling is input to the CPU 25 as an interrupt signal, the interrupt processing (FIG. 24(a)
), see (b)), and the overflow signal Y
is sent as a latch signal to the latch circuit 405 via the selector 313, and the color adjustment coefficient is set.
さらに、乗算器301に設定する係数の選択について説
明する。上述の登録画像メモリ回路lにおいて画像メモ
リ401a、40 lb、401cの読み出し時に発生
した主走査方向のオーバーフロー信号Xは、第1選択信
号発生回路3+1に人力され、第【選択信号発生回路3
11は、オーバーフロー信号Xが入力される度毎に、セ
レクタ306が各ラッチ302〜304の出力を順次選
択的に切り替えるための信号を出力する。セレクタ31
2は、モザイクモニタモードのときには、第1選択信号
発生回路311の出力S21をセレクタ30.6に伝え
る。従って、セレクタ306は、信号S21に対応して
、ラッチ回路305にラッチされている各係数をブロッ
クごとに乗算器301に選択的に順次送り込む。Furthermore, selection of coefficients to be set in the multiplier 301 will be explained. The overflow signal X in the main scanning direction generated when reading the image memories 401a, 40 lb, and 401c in the registered image memory circuit 1 described above is input to the first selection signal generation circuit 3+1, and is then input to the first selection signal generation circuit 3+1.
11 outputs a signal for the selector 306 to sequentially selectively switch the outputs of the latches 302 to 304 every time the overflow signal X is input. Selector 31
2 transmits the output S21 of the first selection signal generation circuit 311 to the selector 30.6 in the mosaic monitor mode. Therefore, the selector 306 selectively sequentially sends each coefficient latched in the latch circuit 305 to the multiplier 301 block by block in response to the signal S21.
一方、登録画像メモリ回路1において画像メモリ401
a、40 lb、401cの読み出し時に発生した副走
査方向のオーバーフロー信号Yは、セレクタ313に人
力されており、セレクタ313は、モザイクモニタモー
ドのときは、これをラッチ信号としてラッチ回路305
に伝える。これによって、オーバーフロー信号Yが出力
される度毎に、ラッチ302.303,304はその入
力データ(色調整係数)をラッチして更新する。従って
、副走査方向についてブロックが変わると、即座に係数
の組が変更される。On the other hand, in the registered image memory circuit 1, the image memory 401
The overflow signal Y in the sub-scanning direction that occurs when reading the signals 40 lb and 401c is input to the selector 313, and in the mosaic monitor mode, the selector 313 uses this as a latch signal to send the latch circuit 305 to the latch circuit 305.
tell to. As a result, each time the overflow signal Y is output, the latches 302, 303, and 304 latch and update their input data (color adjustment coefficients). Therefore, when the block changes in the sub-scanning direction, the set of coefficients is immediately changed.
各印字色Y、M、Cについて以上の色調整が行われる。The above color adjustment is performed for each print color Y, M, and C.
次に、スーパーインポーズモードでの色彩調整について
説明する。スーパーインポーズモードでは、初期設定と
して第1ラツチ302、第2ラツチ303の出力にそれ
ぞれ原稿複写用の係数およびスーパーインポーズ領域用
の係数を設定しておく。そして、ラッチ回路305の出
力にこの値を伝えるため、セレクタ313はCPU25
の発生するラッチ信号を選択しておく。また、セレクタ
312は第2選択信号発生回路314の出力を選択する
。第2選択信号発生回路314は、メモリ401のOE
=“H′のとき、セレクタ312が第1ラツチ302を
選択し、OE=”L’のときセレクタ312が第2ラツ
チ303を選択するように信号S21を発生する。この
ような回路によりスーパーインポーズモードでは、原稿
続出画像を印字する場合は、第1ラツチ302に設定さ
れた値に従い色調整を行い、メモリ401内の画像を読
み出す際には第2ラツチ303に設定された値に従い色
調整を行うことかできる。もちろん、印字色毎にラッチ
302,303の値は、設定しなおすことになる。Next, color adjustment in superimpose mode will be explained. In the superimpose mode, as an initial setting, a coefficient for original copying and a coefficient for the superimposed area are set in the outputs of the first latch 302 and the second latch 303, respectively. Then, in order to transmit this value to the output of the latch circuit 305, the selector 313
Select the latch signal that generates. Further, the selector 312 selects the output of the second selection signal generation circuit 314. The second selection signal generation circuit 314 selects the OE of the memory 401.
When OE="H', the selector 312 selects the first latch 302, and when OE="L', the selector 312 generates a signal S21 so as to select the second latch 303. With such a circuit, in the superimpose mode, when printing successive original images, color adjustment is performed according to the value set in the first latch 302, and when reading out the image in the memory 401, the color adjustment is performed in accordance with the value set in the second latch 303. You can adjust the color according to the set value. Of course, the values of the latches 302 and 303 must be reset for each print color.
なお、スーパーインポーズモードでもモザイクモニタモ
ードでもない場合は、画像データは画調設定回路2で処
理されず、直ちに電気変倍回路26に送られる。Note that when the mode is neither the superimpose mode nor the mosaic monitor mode, the image data is not processed by the image tone setting circuit 2 and is immediately sent to the electric scaling circuit 26.
(f)複写制御のフロー
第17図は、デジタルカラー複写機を制御するCPU2
5の複写動作制御のスーパーインポーズ機能とモザイク
モニタモードに係るメインフローを示す。操作パネル7
0においてファンクションキー78または79が押され
てスーパーインポーズモードまたはモザイクモニタモー
ドに入ると、このメインフローに入る。(f) Flow of copying control FIG. 17 shows the CPU 2 that controls the digital color copying machine.
5 shows the main flow related to the superimpose function and mosaic monitor mode of copy operation control in No. 5. Operation panel 7
When the function key 78 or 79 is pressed at 0 to enter the superimpose mode or mosaic monitor mode, this main flow is entered.
画像登録の要求があれば(ステップSlでYES、以下
「ステップ」を省略する)、画像登録処理を行う(S2
、第18図参照)。画像登録とは、指定した領域の画像
の内容を登録することである。If there is a request for image registration (YES in step Sl, hereinafter "step" will be omitted), image registration processing is performed (S2
, see Figure 18). Image registration means to register the contents of an image in a designated area.
画像登録処理(S2)においては、使用者の希望する領
域を設定し、その領域の内容をメモリに登録する。In the image registration process (S2), the user sets a desired area and registers the contents of the area in the memory.
通常は、モザイクモニタモードをセレクトするというこ
とは、画像登録要求(Sl)、モザイクモニタ出力要求
(S3)ともに°YES’である。また、スーパーイン
ポーズモードをセレクトするということは、画像登録要
求(Sl)、スーパーインポーズ出力要求(S5)とも
にYES’である。Normally, selecting the mosaic monitor mode means YES' for both the image registration request (Sl) and the mosaic monitor output request (S3). Furthermore, selecting the superimpose mode means YES' for both the image registration request (Sl) and the superimpose output request (S5).
モザイクモニタ出力要求があれば(S3でYES)、モ
ザイクモニタ出力処理(S4、第22図参照)を行う。If there is a mosaic monitor output request (YES in S3), mosaic monitor output processing (S4, see FIG. 22) is performed.
すなわち、登録した内容を読出し、それに各種色補正を
施してモザイク画像を出力する。次に、出力されたモザ
イク画像の中から使用者の希望するカラーバランスの画
像を選び、コピーを行うと、そのカラーバランスで全体
の画像が得られる。That is, the registered content is read out, various color corrections are performed on it, and a mosaic image is output. Next, when the user selects an image with the desired color balance from among the output mosaic images and copies it, the entire image is obtained with that color balance.
スーパーインポーズ出力要求の場合(S5でYES)、
スーパーインポーズ出力設定を行う(S6、第25図参
照)。すなわち、登録画像が複数あるかどうかのヂエッ
クの後、メモリからの続出設定を行う。次に、コピー要
求を行うと(S7でYES)、コピーが行われ(S8.
’S9)、登録画像が原稿画像に重ねて印字される。In the case of superimpose output request (YES in S5),
Superimpose output settings are performed (S6, see FIG. 25). That is, after checking whether there are a plurality of registered images, settings are made for successive retrieval from memory. Next, when a copy request is made (YES in S7), copying is performed (S8.
'S9), the registered image is printed over the original image.
画像登録要求、モザイクモニタ出力要求、スーパーイン
ポーズ出力要求がいずれもなければ(Sl、83.S5
でいずれもNo)、通常のコピーを行う(37〜S9)
。If there is no image registration request, mosaic monitor output request, or superimpose output request (Sl, 83.S5
(No in both cases), perform normal copying (37-S9)
.
第18図は、画像登録処理(S2)のフローを示す。FIG. 18 shows the flow of image registration processing (S2).
操作パネル70において、セットキー76が押されると
、そのときに表示部84で設定されていた領域設定値を
入力する(S21)。さらに、その他の各種入力値(倍
率、2値など)を設定する(S22)。そして、画像登
録がスタートできる状態であるか否かを判定する(S2
3)。否であれば、S31に進み、画像登録要求をクリ
アし、リターンする。When the set key 76 is pressed on the operation panel 70, the area setting value that was set on the display section 84 at that time is input (S21). Furthermore, various other input values (magnification, binary values, etc.) are set (S22). Then, it is determined whether image registration can be started (S2
3). If not, the process advances to S31, clears the image registration request, and returns.
画像登録をスタートするときは(S23でYES)、ま
ず、領域設定値(S21)より登録画像領域の頂点(左
上角と右下角)の座標を計算する(S24)。次に、登
録画像モードを読み取る(S25)。When starting image registration (YES in S23), first, the coordinates of the vertices (upper left corner and lower right corner) of the registered image area are calculated from the area setting values (S21) (S24). Next, the registered image mode is read (S25).
この登録画像モードには、(a)多値記憶(カラー)に
よるスーパーインポーズモード、(b)モザイクモニタ
モード、(c)2値記憶(カラー)によるスーパーイン
ポーズモードおよび(d)2値記憶(単色)によるスー
パーインポーズモードの4種がある。This registered image mode includes (a) superimpose mode with multi-value storage (color), (b) mosaic monitor mode, (c) superimpose mode with binary storage (color), and (d) binary storage. There are four types of superimpose modes (single color).
次に、メモリ401に必要な空白領域があると判定され
ると(S26でYES)、メモリアドレス設定のための
固定オフセット量を設定しかつ記憶しく527)、その
登録画像モードに応じて登録画像メモリ回路lに各種デ
ータをセットする(S28、第19図〜第21図参照)
。そして、画像登録要求をクリアして(S31)、リタ
ーンする。Next, if it is determined that there is a necessary blank area in the memory 401 (YES in S26), a fixed offset amount for setting the memory address is set and stored (527), and the registered image is set according to the registered image mode. Set various data in the memory circuit l (S28, see Figures 19 to 21)
. Then, the image registration request is cleared (S31), and the process returns.
メモリ401に必要な残り容量がなければ、前に登録し
た画像データを消去するか否かの入力を待ち、消去する
ときは(S29でYES )、消去を行った後(S30
)、S26に戻る。消去しない場合は(S 29でNO
)、ソノまま、S31に進み、画像登録要求をクリアし
て、リターンする。If the memory 401 does not have the necessary remaining capacity, it waits for input as to whether or not to erase the previously registered image data, and if it wants to erase it (YES in S29), it erases it (S30).
), the process returns to S26. If you do not want to delete it (NO in S29)
), the process proceeds to S31, clears the image registration request, and returns.
以下余白
第19図は、登録画像モードが多値記憶(カラー)によ
るスーパーインポーズモードまたはモザイクモニタモー
ドである場合の登録画像書込(828)のフローを示す
。はじめに、登録画像メモリ回路1に各種制御データを
設定する。すなわち、書込領域設定信号X、Yを書込領
域判別回路402に送り(S4I)、多値記憶を指定し
く542)、メモリ401についてデータ保持信号をL
゛としく543)、スーパーインポーズ続出信号とトリ
ミングコントロール信号をともにH°としく544)、
1因/読出信号をL°としく545)、ε丁コントロー
ル信号を000°として全メモリ401a、401b4
01cを選択する(S46)。そして、原稿のスキャン
を行い(S47)、画像登録領域(書込領域)の多値デ
ータをメモリ40 la、40 lb。The following blank FIG. 19 shows the flow of registered image writing (828) when the registered image mode is superimpose mode or mosaic monitor mode using multi-value storage (color). First, various control data are set in the registered image memory circuit 1. That is, the write area setting signals X and Y are sent to the write area determination circuit 402 (S4I) to specify multi-level storage (542), and the data holding signal for the memory 401 is set to L.
543), both the superimpose successive signal and the trimming control signal are set to H°544),
1 cause/read signal is set to L°545), ε control signal is set to 000°, all memories 401a, 401b4
01c is selected (S46). Then, the document is scanned (S47), and the multivalued data of the image registration area (writing area) is stored in the memories 40 la and 40 lb.
401cに書き込む。そして、CSコントロール信号を
I 11’としてメモリ401への書込を禁止し、デー
タ保持信号をH°として、メモリ401のデータを保持
しく94g)、リターンする。Write to 401c. Then, the CS control signal is set to I11' to inhibit writing to the memory 401, the data holding signal is set to H° to hold the data in the memory 401, and the process returns (94g).
第20図は、登録画像モードか2値記憶(カラー)によ
るスーパーインポーズモードである場合の登録画像書込
(S28)のフローを示す。はじめに登録画像メモリ回
路lに各種制御データを設定する。すなわち、書込領域
設定信号X、Yを書込領域判別回路402に送り(S6
1)、2値記憶を指定しく562)、メモリ401につ
いてデータ保持信号をL′としく563)、スーパーイ
ンポーズ続出信号とトリミングコントロール信号をとも
にH゛とじ(S64)、書込/読出信号を“Loとする
(S65)。次に、Y、M、Cの各印字色でのスキャン
を行い、画像データを記憶する。まず、CSコントロー
ル信号を11O°としてメモリ401aを選択しく56
6)、イエロー(Y)についてスキャンを行い、書込領
域の画像データを2値データとして記憶する(S67)
。同様に、マゼンタ(M)についてもメモリ401bを
選択しく568)、スキャンにより2値データを記憶す
る(S69)。さらに、シアン(C)についてもメモリ
401Cを選択しく570)、スキャンにより2値デー
タを記憶する(S71)。そして、CSコントロール信
号を°111’としてメモリ401への書込を禁止し、
データ保持信号をH’としてメモリ401のデータを保
持しく572)、リターンする。なお、S67、S69
、S71で登録済画像がある場合は、空き容量部分に記
憶するように固定オフセット量が設定されている(第1
8図927、第11図参照)。FIG. 20 shows the flow of registered image writing (S28) in the registered image mode or the superimpose mode using binary storage (color). First, various control data are set in the registered image memory circuit l. That is, the write area setting signals X and Y are sent to the write area determination circuit 402 (S6
1), specify binary storage 562), set the data holding signal to L' for the memory 401 563), set both the superimpose successive signal and the trimming control signal to H (S64), and set the write/read signal to "Lo" (S65). Next, scan is performed in each print color of Y, M, and C, and the image data is stored. First, the CS control signal is set to 110° and the memory 401a is selected.
6) Scan for yellow (Y) and store the image data in the write area as binary data (S67)
. Similarly, the memory 401b is selected for magenta (M) (568), and binary data is stored by scanning (S69). Furthermore, the memory 401C is selected for cyan (C) (570), and binary data is stored by scanning (S71). Then, the CS control signal is set to °111', and writing to the memory 401 is prohibited,
The data holding signal is set to H' to hold the data in the memory 401 (572), and the process returns. In addition, S67, S69
, if there is a registered image in S71, a fixed offset amount is set so that it is stored in the free space (first
(See Figure 8927 and Figure 11).
第21図は、登録画像モードか2値記憶(単色)による
スーパーインポーズモードである場合の登録画像書込(
S28)のフローを示す。はじめに、登録画像メモリ回
路lに各種制御データを設定する。すなわち、書込領域
設定信号X、Yを書込領域判別回路402に送り(S8
1)、2値記憶を指定しく582)、メモリについてデ
ータ保持信号を“Loとしく583)、スーパーインポ
ーズ続出信号とトリミングコントロール信号をともにH
°としく584)、第11図を用いて説明したように、
メモリ401の記憶8慎が最も有効に利用できるように
メモリを選択し、すなわち、メモリ選択データAを°1
10°、’101’または’011’としく585)、
1囚/読出信号をL°とする(S86)。FIG. 21 shows registered image writing (
The flow of S28) is shown. First, various control data are set in the registered image memory circuit l. That is, the write area setting signals X and Y are sent to the write area determination circuit 402 (S8
1), Specify binary storage 582), set the data retention signal for the memory to “Lo” 583), and set both the superimpose successive signal and trimming control signal to H.
584), as explained using Figure 11,
The memory is selected so that the storage capacity of the memory 401 can be used most effectively, that is, the memory selection data A is
10°, '101' or '011'585),
The 1 prisoner/read signal is set to L° (S86).
次に、CSコントロール信号をAとしく587)、メモ
リを指定し、マスキング処理回路24に対し、適当な色
補正(たとえば、比視感度にあった特性)を指定しく5
88)、スキャンを行う(S89)。そして、CSコン
トロール信号を°t t t’としてメモリ401への
書込を禁止し、データ保持信号をH’としてメモリ40
1のデータを保持しく590)、リターンする。Next, set the CS control signal to A (587), specify the memory, and specify appropriate color correction (for example, a characteristic that matches the relative luminous efficiency) to the masking processing circuit 24.
88), scan is performed (S89). Then, the CS control signal is set to °t t t' to inhibit writing to the memory 401, and the data holding signal is set to H' to inhibit writing to the memory 401.
1 data is retained (590) and returns.
第22図は、モザイクモニタ出力処理(S4)のフロー
を示す。まず、メモリ401に記憶した登録画像データ
を読出しくS I O1、第23図参照)、それに色補
正を施して(S I O2)、モザイクモニタ画像を印
字する(S103)。FIG. 22 shows the flow of mosaic monitor output processing (S4). First, the registered image data stored in the memory 401 is read out (SIO1, see FIG. 23), color correction is performed on it (SIO2), and a mosaic monitor image is printed (S103).
次に、使用者が希望色バランスを選択すると(S104
)、その色調整係数を設定する(S105)。Next, when the user selects the desired color balance (S104
), and set its color adjustment coefficient (S105).
次に、コピー要求があると(S I 06でYES)、
その希望色バランスで原稿のコピニを開始しく5107
)、Y、M、Cの印字を行う。そして、コピー終了(S
108でYES)を待って、リターンすモザイクモニ
タ出力処理におけるメモリ内容の続出しく5lot)は
、第23図に示すフローにより行われる。はじめに登録
画像メモリ回路1に各種制御データを設定する。すなわ
ち、使用者の指示に対応して続出領域設定信号X、Yを
続出領域判別回路408に送り(S121)、多値記憶
を指定しくS 122)、メモリ401についてデータ
保持信号をH゛としく5123)、スーパーインボーズ
読出信号を°L°としく5124)、トリミングコント
ロール信号を“Hoとしく5125)、読出を指定しく
5I26)、変倍用副走査クロック発生器29に等倍デ
ータをセットする(S127)。なお、モザイクモニタ
モードでは、登録画像は1つなので、固定オフセット量
は0゛とする。Next, when there is a copy request (YES in S I 06),
Start copying the original with the desired color balance 5107
), Y, M, and C are printed. Then, copy ends (S
After waiting for YES in step 108, the process returns to continue reading out the memory contents in the mosaic monitor output process (5lots) according to the flow shown in FIG. First, various control data are set in the registered image memory circuit 1. That is, in response to the user's instructions, the continuous area setting signals X and Y are sent to the continuous area determination circuit 408 (S121), multi-level storage is specified (S122), and the data holding signal for the memory 401 is set to H. 5123), set the superimposed read signal to °L° 5124), set the trimming control signal to "Ho" 5125), specify readout 5I26), and set equal-sized data to the sub-scanning clock generator 29 for scaling. (S127).In the mosaic monitor mode, there is only one registered image, so the fixed offset amount is set to 0.
次に、CSコントロール信号を000゛とじて(SI2
8)、全メモリを選択し、割込処理を許可して(SI2
9)、後述の色調整係数を設定するための割込処理ルー
チン(第24図(a)、 (b))を作動可能として、
Y、M、C,にのスキャンを行う(SI30)。Next, the CS control signal is set to 000゛ (SI2
8) Select all memory and enable interrupt processing (SI2
9) Enable the interrupt processing routine (FIGS. 24(a) and 24(b)) for setting color adjustment coefficients, which will be described later.
Scan Y, M, and C (SI30).
スキャン終了後は、割込処理を禁止しく5131 )、
CSコントロール信号を°111 としてメモリ401
への書込を禁止しくS I 32)、リターンする。After the scan is completed, interrupt processing is prohibited (5131),
The memory 401 sets the CS control signal to °111.
Disable writing to SI 32) and return.
第24図(a) 、 (b)は、色調整係数に、、 k
m、 kcの設定処理を行うフローチャートである。Figures 24(a) and (b) show the color adjustment coefficients, k
12 is a flowchart for performing a setting process for m and kc.
この処理は、水平同期信号Hsyncが発生ずる度毎に
CPU25に割り込みがかかり、これによる割り込みル
ーチンとして実行される。This process is executed as an interrupt routine by interrupting the CPU 25 every time the horizontal synchronization signal Hsync is generated.
この中で、カウンタCt+は、画像先端から副走査方向
への距離をカウントし、モザイクモニタ画11;Mの印
字初め及び印字路わりを検出する。カウンタCttは、
副走査方向の距離をカウントし、モザイクモニタ画像の
ブロックの変化を検出する。Among these, the counter Ct+ counts the distance from the leading edge of the image in the sub-scanning direction, and detects the beginning of printing and the end of the printing path of the mosaic monitor image 11;M. The counter Ctt is
The distance in the sub-scanning direction is counted and changes in blocks of the mosaic monitor image are detected.
Tは、画像先端からモザイクモニタ画像の印字位置まで
の副走査方向の距離を表し、ρはlブロックの副走査方
向の距離を表しく第7図参照)、画像登録処理(S2)
で設定されている。T represents the distance in the sub-scanning direction from the leading edge of the image to the print position of the mosaic monitor image, and ρ represents the distance in the sub-scanning direction of the l block (see Figure 7), image registration processing (S2)
is set.
まず、5300でステートが判断され、その値「0」〜
「4」に応じて分岐する。First, the state is determined at 5300, and its value is "0" ~
Branch according to "4".
ステートが「0」のときには、画像先端(用紙Pの先端
)であるか否かが判断され(S301)、画像先端が通
過したときには、カウンタCL、を初期化しく5302
)、ステートをrlJにする( 5303)。When the state is "0", it is determined whether or not it is the leading edge of the image (leading edge of the paper P) (S301), and when the leading edge of the image has passed, the counter CL is initialized (5302).
), set the state to rlJ (5303).
ステートが「1」のときには、カウンタCL、h<Tに
なるのを待ち(3311)、すなわちモザイクモニタ画
像GMの先端である座標y0の位置に達するのを待ち、
その後、使用する現像器のトナーの色によって、ステー
トr2j、r3JJ4Jのいずれかにジャンプする。When the state is "1", the counter CL waits for h<T (3311), that is, waits for the position of the coordinate y0, which is the tip of the mosaic monitor image GM, to be reached,
Thereafter, the process jumps to either state r2j or r3JJ4J depending on the toner color of the developing device used.
すなわち、Y(イエロー)のとき(S312でYES)
はステートを「2」とする(S313)。M(マゼンタ
)のとき(S321でYES)は、カウンタCt2を初
期化しくS 322)、変数iを「0」としく5323
)、ステートを「3」とする(S324)。C(シアン
)のとき(S321でNo)は、カウンタCL、を初期
化しく5331)、変数jを「0」としく5332)、
ステートを「4」とする(S333)。That is, when Y (yellow) (YES in S312)
sets the state to "2" (S313). When M (magenta) (YES in S321), initialize the counter Ct2 (S322) and set the variable i to "0"5323
), the state is set to "3" (S324). When C (cyan) (No in S321), initialize the counter CL (5331), set the variable j to "0" (5332),
The state is set to "4" (S333).
ステートが「2」のときには、ラッチ302.303.
304にそれぞれ設定する係数1〜3にY−+Yo、Y
+を代入しく5341)、カウンタCt、が(T+91
2)になるのを待ち、すなわちモザイクモニタ画像GM
の後端である座標y、の位置に達するのを待ち(S34
2)、ステートを「0」とする(S343)。When the state is "2", latches 302.303.
Y-+Yo, Y for coefficients 1 to 3 set in 304 respectively
+5341), the counter Ct is (T+91
2), that is, the mosaic monitor image GM
Wait until it reaches the position of coordinate y, which is the rear end of (S34
2) Set the state to "0" (S343).
ステートが「3」のときは、係数1〜3にm、を代入し
く5351)、カウンタCt4がQになるのを待ち、す
なわちモザイクモニタのlブロック分が終るのを待ち(
S352)、カウンタCt、を初期化しくS3・53)
、変数iを1つインクリメントする(S354 )。次
に、モザイクモニタ画像の後端に達するのを待ち(S3
55)、ステートを「0」とする(S356)。つまり
、ここでは、係数1〜3には互いに同じ値m、が設定さ
れるとともに、モザイクモニタ画像が副走査方向に1ブ
ロツク変わる毎に、係数1〜3が新しい値mi+1
に変更される。When the state is "3", substitute m into the coefficients 1 to 3 (5351), wait for the counter Ct4 to become Q, that is, wait for l blocks of the mosaic monitor to finish (5351).
S352), initialize the counter Ct, S3.53)
, the variable i is incremented by one (S354). Next, wait until the rear end of the mosaic monitor image is reached (S3
55), the state is set to "0" (S356). That is, here, coefficients 1 to 3 are set to the same value m, and each time the mosaic monitor image changes by one block in the sub-scanning direction, coefficients 1 to 3 are set to a new value mi+1.
will be changed to
ステートが「4」のときは、係数1〜3にCを代入しく
5361)、カウンタCt2が(3Q)になるのを待ち
、すなわちモザイクモニタの1ブロック分が終るのを待
ち(S362)、カウンタCL、を初期化しく9363
)、変数jを1つインクリメントする(9364)。次
に、モザイクモニタ画像の後端に達するのを待ち(S3
65)、ステートを「0」とする(9366)。つまり
、ここでは、係数1〜3には互いに同じ値C1が設定さ
れるとともに、モザイクモニタ画像が副走査方向に3ブ
ロツク変わる毎に、係数1〜3が新しい値C0に変更3
+t
される。When the state is "4", substitute C for coefficients 1 to 3 (5361), wait for the counter Ct2 to become (3Q), that is, wait for one block of the mosaic monitor to finish (S362), and Initialize CL9363
), the variable j is incremented by one (9364). Next, wait until the rear end of the mosaic monitor image is reached (S3
65), and the state is set to "0" (9366). That is, here, coefficients 1 to 3 are set to the same value C1, and each time the mosaic monitor image changes by three blocks in the sub-scanning direction, coefficients 1 to 3 are changed to a new value C0.
+t will be done.
各ステートでの処理が終わると、カウンタCt、。When the processing in each state is completed, the counter Ct.
c5をインクリメントする(S371)。Increment c5 (S371).
以上の処理によって、各印字色について種々の係数が設
定され、色調整が行われる。Through the above processing, various coefficients are set for each print color, and color adjustment is performed.
第25図は、スーパーインポーズ出力設定(S6)のフ
ローを示す。まず、登録画像が複数であるか否かを判定
する(S201)。複数であれば、操作パネル70で使
用者に選択を促がしく5202)、使用者の選択が終了
するのを待つ(S203)。FIG. 25 shows the flow of superimpose output setting (S6). First, it is determined whether there are a plurality of registered images (S201). If there are more than one, the user is prompted to make a selection on the operation panel 70 (5202) and waits for the user to complete the selection (S203).
登録画像が単数であれば、その登録画像を選択画像とす
る(S204)。If there is a single registered image, that registered image is set as the selected image (S204).
、次に、出力すべき登録画像に対応するアドレス設定用
の固定オフセットffiを設定しく5205)、さらに
登録画像モードに応じて選択画像に関するデータを登録
画像メモリ回路1にセットし印字データを出力して(S
206)、リターンする。Next, a fixed offset ffi for address setting corresponding to the registered image to be output is set (5205), and data regarding the selected image is set in the registered image memory circuit 1 according to the registered image mode, and print data is output. Te(S
206), return.
第26図は、多値記憶(カラー)によるスーパーインポ
ースモードでの画像出力(9206)のフローを示す。FIG. 26 shows the flow of image output (9206) in superimpose mode using multi-value storage (color).
ここにMAGAは原稿に対する画像の変倍率であり、M
AGBはメモリに対するスーパーインポーズ画像の変倍
率である。はじめに書込/読出信号をH′とし、多値記
憶を指定し、メモリ401に対するデータ保持信号を“
H”とし、スーパーインポーズ続出信号をH°とする(
S221)、。Here, MAGA is the magnification ratio of the image relative to the original, and M
AGB is the scaling factor of the superimposed image with respect to the memory. First, set the write/read signal to H', specify multi-value storage, and set the data retention signal for the memory 401 to "
H” and the superimposed successive signal is H° (
S221),.
次に、変倍率MAGA=MAGBであるか否かを判定す
る(S222)。Next, it is determined whether the magnification ratio MAGA=MAGB (S222).
同じ倍率である場合(S 222でYES)、変倍用副
走査クロック発生器29にMAGAデータをセットしく
5223)、トリミングコントロール信号をH°とじ(
S224)、続出領域判別回路4゜8に続出領域設定信
号X、Yを送り(S225)、電気変倍回路26にMA
GAデータをセットする(3226)。そして、CSコ
ントロール信号に“000°をセットしく5227)、
全メモリ401を選択して、Y、M、C,にのスキャン
を行う(S228)。If the magnifications are the same (YES in S222), MAGA data is set in the sub-scanning clock generator 29 for variable magnification (5223), and the trimming control signal is set to H° (5223).
S224), sends successive area setting signals X and Y to the successive area discrimination circuit 4.8 (S225), and sends MA to the electric magnification circuit 26.
Set GA data (3226). Then, set the CS control signal to “000°” (5227),
All memories 401 are selected and Y, M, and C are scanned (S228).
スキャン終了後は、CSコントロール信号を11ビとし
て(S229)、メモリ401の続出を禁止し、リター
ンする。After the scan is completed, the CS control signal is set to 11 bits (S229) to prohibit continuous data from the memory 401, and the process returns.
変倍率MAGA=MAGBでない場合は(S222でN
o)、まず、続出領域外で原稿画像を印字させる。すな
わち、変倍用副走査クロック発生器29にMAGAデー
タをセットしく5231)、トリミングコントロール信
号を°L°としく5232)、セレクタ426に続出領
域で゛白°データを選択させ、続出領域判別回路408
に続出領域設定信号X、YをMAGAとMAGBの違い
を考慮してセットしく5233)、電気変倍回路26に
MAGAデータをセットする(S234)。そして、C
Sコントロール信号に“000°をセットしく5235
)、全メモリを選択して、原稿についてY。If the magnification ratio MAGA=MAGB (N in S222)
o) First, the original image is printed outside the continuous printing area. That is, MAGA data is set in the sub-scanning clock generator 29 for variable magnification (5231), the trimming control signal is set to °L° (5232), the selector 426 is made to select "white data" in the successive region, and the successive region discrimination circuit 408
The area setting signals X and Y are set in consideration of the difference between MAGA and MAGB (5233), and MAGA data is set in the electric magnification circuit 26 (S234). And C
Set “000°” to S control signal 5235
), select all memories, and select Y for the original.
M、C,にのスキャンを行う(9236)。A scan is performed on M and C (9236).
次に、続出領域にメモリ401の画4’Qをスーパーイ
ンポーズする。すなわち、トリミングコントロール信号
をH゛とじ、スーパーインポーズ続出信号をL′としく
5237)、(rレクタ42++、:゛白゛データを選
択させ、続出領域判別回路408にMAGBに従う読出
領域信号をセットしく5238)、電気変倍回路26に
MAGBデータをセラ)L(S239)、変倍用副走査
クロック発生器29にMAGBデータをセットする(S
240)。そして、スーパーインポーズ画像についてY
、M、 CKのスキャンを行う(S241)。スキャ
ン終了後は、CSコントロール信号を°t t t’と
して(S229)、メモリ401の続出を禁止し、リタ
ンする。Next, the image 4'Q of the memory 401 is superimposed on the continuous area. That is, the trimming control signal is set to H, the superimpose successive signal is set to L' (5237), (r-rector 42++, :'white' data is selected, and the readout area signal according to MAGB is set in the successive area determination circuit 408. 5238), set the MAGB data to the electric scaling circuit 26)L (S239), and set the MAGB data to the sub-scanning clock generator 29 for scaling (S239).
240). And about the superimposed image Y
, M, and CK are scanned (S241). After the scan is completed, the CS control signal is set to t t t' (S229) to prohibit the memory 401 from continuing to be read, and the process returns.
第27図は、2値記憶(カラー)によるスーパーインポ
ーズモードにおける画像出力(9206)のフローを示
す。登録画像メモリ回路lにおいて、2値記憶を指定し
く5251)、データ保持信号をI]°としく5252
)、スーパーインポーズ続出信号を“Hoとしく525
3)、トリミングコントロール信号をH゛とする(S2
54)。また、変倍用副走査クロック発生器29に等倍
データをセットしくS 255)、続出領域判別回路4
08に続出領域設定信号x、Yを設定しく3256)、
続出を指定する(S257)。FIG. 27 shows the flow of image output (9206) in superimpose mode using binary storage (color). In the registered image memory circuit l, specify binary storage 5251) and set the data holding signal to I]° 5252
), superimpose successive signals as “Ho” 525
3) Set the trimming control signal to H (S2
54). Also, set the same-size data in the sub-scanning clock generator 29 for variable magnification (S255), and continue area discriminating circuit 4.
Please set successive area setting signals x and Y in 08 3256),
Continuation is specified (S257).
次に、CSコントロール信号を°110°とじて(92
6+)、メモリ401aを選択して、イエ。Next, the CS control signal is adjusted to 110° (92
6+), select memory 401a, and go.
−のスキャンを行う(9262)。次に、CSコントロ
ール信号を101゛とじて(8263)、メモリ401
bを選択して、マゼンタのスキャンを行う(9264)
。次に、CSコントロール信号を011’として(92
65)、メモリ401cを選択して、シアンのスキャン
を行い(S266)、さらに、CSコントロール信号を
Ill’として(8267)、ブラック・のスキャン
を行い(9268)、リターンする。- is scanned (9262). Next, the CS control signal is separated from 101 (8263), and the memory 401 is
Select b and scan magenta (9264)
. Next, set the CS control signal to 011' (92
65), selects the memory 401c, performs cyan scan (S266), sets the CS control signal to Ill' (8267), performs black scan (9268), and returns.
第28図は、2値記憶(単色)によるスーパーインポー
ズモードにおける画像出力(3206)のフローを示す
。モニタ画像メモリ回路!において、2@記憶を指定し
、データ保持信号を“1−T’とし、スーパーインポー
ズ続出信号をI(’とし、トリミングコントロール信号
を°H゛とする(928+)。FIG. 28 shows the flow of image output (3206) in the superimpose mode using binary storage (single color). Monitor image memory circuit! In , 2@ storage is specified, the data holding signal is set to "1-T', the superimpose successive signal is set to I(', and the trimming control signal is set to °H" (928+).
また、変倍用副走査クロック発生器29に等倍データを
セットしく3282)、続出領域判別回路408に続出
領域設定信号X、Yを設定しく9283)、メモリ選択
データAを110′、’I OI または011’と
しく9284)、続出を指定する(8285)。Also, set the same size data in the sub-scanning clock generator 29 for scaling 3282), set the successive area setting signals X and Y in the successive area determination circuit 408 (9283), and set the memory selection data A to 110', 'I'. OI or 011' (9284), and specify continuation (8285).
次に、メモリに登録された画像をイエローで印字するか
否かに対応して(S 286でYESかNO)、CSコ
ントロール信号をメモリ選択データA(9286)また
は11ビとしく9287)、イエローのスキャンを行う
(3289)。これにより、イエローで印字する場合に
は、登録画像がイエローでスーパーインポーズされる。Next, depending on whether the image registered in the memory is to be printed in yellow (YES or NO in S286), the CS control signal is set to memory selection data A (9286) or 11 bit (9287), yellow (3289). As a result, when printing in yellow, the registered image is superimposed in yellow.
マゼンタ、シアン、ブラックについても同様の処理を行
う。Similar processing is performed for magenta, cyan, and black.
最後に、CSコントロール信号を°Itビとし、データ
保持信号をH’として(S290)、リターンする。Finally, the CS control signal is set to °It Bi, the data holding signal is set to H' (S290), and the process returns.
以下余白
(発明の効果)
登録画像のメモリ各項が画像記憶手段の容量より小さい
場合、複数の画像が登録可能となるので、画像記憶手段
の使用効率がよくなる。Margin below (effects of the invention) If each memory item of the registered image is smaller than the capacity of the image storage means, a plurality of images can be registered, so the efficiency of use of the image storage means is improved.
第1図は、デジタルカラー複写機の概略断面図である。
第2図は、信号処理部のブロック図である。
第3図は、画像データ処理のタイミングチャートである
。
第4図は、操作パネルの平面図である。
第5図は、領域設定の図である。
第6図(a) 、 (b) 、 (c)は、それぞれ、
スーパーインポーズモードにおける原稿画像の複写の図
、登録画像の複写の図、スーパーインポーズ画像の図で
ある。
第7図は、モザイクモニタの出力フォーマットの図であ
る。
第8図は、登録画像メモリ回路の回路図である。
第9図は、データ選択回路の回路図である。
第10図は、S−P変換のタイミングチャートである。
第11図は、メモリに多値画像データと2値画像データ
を混在させて登録する方式を示す説明図である。
第12図は、領域判別回路とアドレス発生回路の回路図
である。
第13図は、領域判別回路のタイミングチャートである
。
第14図は、同じ容量の複数の画像データの登録の状況
を示す図である。
第15図は、異った容量の複数の画像データの登録の状
況を示す図である。
第16図は、画調設定回路の回路図である。
第17図は、デノタルカラー複写機のスーパーインポー
ズモードとモザイクモニタモードに係るメインフローの
図である。
第18図は、画像登録処理のフローチャートである。
第19図は、多値記憶によるスーパーインポーズモード
およびモザイクモニタモードにおける画像登録のフロー
チャートである。
第20図は、2値記憶(フルカラー)によるスーパーイ
ンポーズモードにおける画像登録のフローチャートであ
る。
第21図は、2値記憶によるスーパーインポーズモード
における単色での画像登録のフローチャートである。
第22図は、モザイクモニタ出力設定のフローチャート
である。
第23図は、メモリ内容続出のフローチャートである。
第24図(a) 、 (b)は、割込処理のフローチャ
ートである。
第25図は、スーパーインポーズ出力設定のフローチャ
ートである。
第26図は、多値記憶によるスーパーインポーズモード
での画像出力のフローチャートである。
第27図は、2値記憶(カラー)によるスーパーインポ
ーズモードでの画像出力のフローチャートである。
第28図は、2値記憶(単色)によるスーパーインポー
ズモードでの画像出力のフローチャートである。
I・・登録画像メモリ回路、2・・・画調設定回路、2
0・・・信号処理回路、 25・・CPU。
70・・・操作パネル、 84・・表示部、401
a、40 lb、401cmメモリ、402・・・書込
領域判別回路、
403・・・書込アドレス発生カウンタ、408・・・
続出領域判別回路、
409・・・続出アドレス発生カウンタ、422・・3
−ステートバッファ、
442・・・データ選択回路。
第5図
第6目
(b)
特許出願人 ミノルタカメラ株式会社代理人 弁理士
青 山 葆 はか1名CK8
第
0図
第14図
第15
図
(y18プログラマブル〃ウンタ617/l出かン第]
7図
第旧図
第21.1
第22図
蟇23図
第25図FIG. 1 is a schematic sectional view of a digital color copying machine. FIG. 2 is a block diagram of the signal processing section. FIG. 3 is a timing chart of image data processing. FIG. 4 is a plan view of the operation panel. FIG. 5 is a diagram of area setting. Figures 6(a), (b), and (c) are, respectively,
FIG. 7 is a diagram of copying a document image, a diagram of copying a registered image, and a diagram of a superimposed image in superimpose mode. FIG. 7 is a diagram of the output format of the mosaic monitor. FIG. 8 is a circuit diagram of the registered image memory circuit. FIG. 9 is a circuit diagram of the data selection circuit. FIG. 10 is a timing chart of SP conversion. FIG. 11 is an explanatory diagram showing a method of registering multivalued image data and binary image data in a mixed manner in a memory. FIG. 12 is a circuit diagram of an area discrimination circuit and an address generation circuit. FIG. 13 is a timing chart of the area discrimination circuit. FIG. 14 is a diagram showing the registration status of a plurality of image data of the same capacity. FIG. 15 is a diagram showing the registration status of a plurality of image data of different capacities. FIG. 16 is a circuit diagram of the image tone setting circuit. FIG. 17 is a diagram of the main flow related to the superimpose mode and mosaic monitor mode of the digital color copying machine. FIG. 18 is a flowchart of image registration processing. FIG. 19 is a flowchart of image registration in superimpose mode and mosaic monitor mode using multi-value storage. FIG. 20 is a flowchart of image registration in superimpose mode using binary storage (full color). FIG. 21 is a flowchart of monochrome image registration in superimpose mode using binary storage. FIG. 22 is a flowchart of mosaic monitor output settings. FIG. 23 is a flowchart of memory contents successive additions. FIGS. 24(a) and 24(b) are flowcharts of interrupt processing. FIG. 25 is a flowchart of superimpose output setting. FIG. 26 is a flowchart of image output in superimpose mode using multi-value storage. FIG. 27 is a flowchart of image output in superimpose mode using binary storage (color). FIG. 28 is a flowchart of image output in superimpose mode using binary storage (single color). I...Registered image memory circuit, 2...Picture setting circuit, 2
0...Signal processing circuit, 25...CPU. 70...Operation panel, 84...Display section, 401
a, 40 lb, 401 cm memory, 402...Writing area determination circuit, 403...Writing address generation counter, 408...
Successive area determination circuit, 409... Successive address generation counter, 422...3
-state buffer, 442...data selection circuit. Figure 5, item 6 (b) Patent applicant Minolta Camera Co., Ltd. agent Patent attorney Aoyama Ao Haka 1 person CK8 Figure 0 Figure 14 Figure 15 (y18 programmable counter 617/l output number)
Figure 7 Old Figure 21.1 Figure 22 Toad Figure 23 Figure 25
Claims (1)
注目領域と複写用紙上の禁止領域をそれぞれ設定する領
域設定手段と、 領域設定手段により設定された注目領域の原稿画像を読
み取り、画像データを画像記憶手段に記憶する画像登録
手段であって、画像記憶手段の記憶容量が許すかぎり複
数の注目領域の原稿画像を登録できる画像登録手段と、 画像印字用データに基づき複写用紙に印字を行う印字手
段と、 領域設定手段により設定された複写用紙上の禁止領域に
印字する際に、画像記憶手段に登録された登録画像、ま
たは複数の登録画像が登録されている場合には任意の登
録画像の画像データを読み出し、印字手段に画像印字用
データを送る登録画像印字制御手段を備えたことを特徴
とするデジタルカラー複写機。(1) An image storage means for storing image data, an area setting means for setting an area of interest on a document and a prohibited area on a copy sheet, and reading the original image of the area of interest set by the area setting means, An image registration means for storing data in an image storage means, the image registration means being capable of registering document images of a plurality of attention areas as long as the storage capacity of the image storage means allows, and printing on copy paper based on the image printing data. When printing in the prohibited area on the copy paper set by the area setting means, the registered image registered in the image storage means, or any registered image if multiple registered images are registered. A digital color copying machine characterized by comprising registered image printing control means for reading image data of an image and sending image printing data to a printing means.
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63182282A JPH0231560A (en) | 1988-07-20 | 1988-07-20 | Digital color copying machine |
US07/382,175 US5165071A (en) | 1988-07-20 | 1989-07-19 | Digital color copying machine |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63182282A JPH0231560A (en) | 1988-07-20 | 1988-07-20 | Digital color copying machine |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0231560A true JPH0231560A (en) | 1990-02-01 |
Family
ID=16115548
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP63182282A Pending JPH0231560A (en) | 1988-07-20 | 1988-07-20 | Digital color copying machine |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0231560A (en) |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5945765A (en) * | 1982-09-08 | 1984-03-14 | Canon Inc | Picture processor |
-
1988
- 1988-07-20 JP JP63182282A patent/JPH0231560A/en active Pending
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5945765A (en) * | 1982-09-08 | 1984-03-14 | Canon Inc | Picture processor |
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