JPH01253762A - Image forming device - Google Patents
Image forming deviceInfo
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- JPH01253762A JPH01253762A JP63081812A JP8181288A JPH01253762A JP H01253762 A JPH01253762 A JP H01253762A JP 63081812 A JP63081812 A JP 63081812A JP 8181288 A JP8181288 A JP 8181288A JP H01253762 A JPH01253762 A JP H01253762A
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Landscapes
- Control Or Security For Electrophotography (AREA)
- Semiconductor Integrated Circuits (AREA)
Abstract
Description
【発明の詳細な説明】
（８）産業上の利用分野
この発明は安定性と高精度を要求されるアナログ信号の
制御が、ＣＰＵによって行われる電子写真７Ｍ写機など
の画像形成装置に関する。DETAILED DESCRIPTION OF THE INVENTION (8) Field of Industrial Application This invention relates to an image forming apparatus such as an electrophotographic 7M camera in which control of analog signals requiring stability and high precision is performed by a CPU.
（ｂ）従来の技術
電子写真式複写機などの画像形成装置では、メインチャ
ージャに加える高電圧や現像部に印加されるバイアス電
圧などの制御を高安定度で且つ高精度に行う必要がある
。今日の電子写真式複写機では制御部にほとんどＣＰＵ
が使用され、このＣＰＵからのデータをアナログ量に変
換してメインチャージャ駆動部やバイアス電源回路に対
して供給するアナログ信号を形成している。デジタルデ
ータをアナログ信号に変換するには一般にＤ／Ａ変換器
が使用されるが、更にそのＤ／Ａ変換器にリファレンス
電圧を供給するためのリファレンス電源回路と変換され
たアナログ１３号を適当な電圧出力に変換するためのバ
ッファ増幅手段が用いられている。(b) Prior Art In image forming apparatuses such as electrophotographic copying machines, it is necessary to control the high voltage applied to the main charger, the bias voltage applied to the developing section, etc. with high stability and precision. Most of today's electrophotographic copying machines use a CPU in the control section.
is used to convert data from the CPU into analog quantities and form analog signals to be supplied to the main charger drive section and bias power supply circuit. A D/A converter is generally used to convert digital data into an analog signal, but a reference power supply circuit for supplying a reference voltage to the D/A converter and a suitable analog No. 13 converter are also used. Buffer amplification means are used to convert to voltage output.
（Ｃ）発明が解決しようとする課題
しかしながら従来の画像形成装置では、これらの各要素
が独立に、たとえばディスクリート部品で構成されてい
たために、動作の安定性を十分に高くできない問題があ
った。特にデジタルデータを正確なアナログ信号に変換
するには、リファレンス電源手段を高精度なものにする
必要があるとともに、バッファ増幅手段がオペアンプで
構成されることがらぞのオフセットと利得を適正なもの
にする必要があるが、従来の画像形成装置では、これら
の要素が独立に構成されるために電源調整とバッファ増
幅手段のオフセットおよび利得調整がずべ°ζ適正な状
態に調整するのが困難となり、しかも各要素の温度特性
が異なると動作中に特性が変わって高精度なり／Δ変換
を行うことが出来なくなる問題もあった。(C) Problems to be Solved by the Invention However, in conventional image forming apparatuses, each of these elements is independently composed of, for example, discrete parts, and therefore there is a problem in that the stability of operation cannot be sufficiently increased. In particular, in order to convert digital data into an accurate analog signal, the reference power supply means must be highly accurate, and the buffer amplification means must be composed of an operational amplifier, so the offset and gain must be appropriate. However, in conventional image forming apparatuses, these elements are configured independently, making it difficult to adjust the power supply and the offset and gain of the buffer amplification means to an appropriate state. Moreover, if the temperature characteristics of each element are different, the characteristics change during operation, making it impossible to perform high-accuracy/Δ conversion.
この発明の目的は、上記のような問題を解消し高安定性
で且つ高精度なアナログ信号を得ることのできる画像形
成装置を提供することにある。SUMMARY OF THE INVENTION An object of the present invention is to provide an image forming apparatus that can solve the above-mentioned problems and obtain highly stable and highly accurate analog signals.
（ｄ）課題を解決するだめの手段
この発明は、画像形成部に含まれるデータ処理手段から
のデジタルデータをラッチするラッチ手段と、そのラッ
チ手段の動作を制御するコントロール手段と、前記ラッ
チ手段に記憶されているデジタルデータをアナログ信号
に変換するＤ／Ａ変換手段と、−そのＤ／Ａ変換手段に
リファレンス電圧を供給するリファレンス電源手段と、
前記アナログ信号を電圧出力に変換するバッファ増幅手
段と、を一つの半導体チップ上に集積したことを特徴と
する。(d) Means for Solving the Problems This invention provides a latch means for latching digital data from a data processing means included in an image forming section, a control means for controlling the operation of the latch means, and a control means for controlling the operation of the latch means. D/A conversion means for converting stored digital data into analog signals; - reference power supply means for supplying a reference voltage to the D/A conversion means;
A buffer amplifying means for converting the analog signal into a voltage output is integrated on one semiconductor chip.
（ｅ）作用
この発明に係る画像形成装置では、ｃｐｕなどからなる
データ処理手段からのデジタルデータをラッチするラッ
チ手段と、そのコントロール手段と、ラッチされ°ζい
るデータをＤ／Ａ変換するＤ／Ａ手段と、リファレンス
手段と、バッファ増幅手段とをすべて一つの半導体チッ
プ上に集積して構成される。このため各要素の電気的特
性がほとんど同一となり、温度変化などがあっても特性
のずれに起因するＤ／Ａ変換特性のりニアリティの悪化
がほとんどない、すなわち安定したＤ／Ａ変換特性が得
られる。また各要素を同一の半導体チップ上に集積して
いるために、特性の調整などは公知のレーザートリミン
グ法などによって行うことができるために正確でしかも
高精度な特性調整が可能になる。(e) Function The image forming apparatus according to the present invention includes a latch means for latching digital data from a data processing means such as a CPU, a control means for the latch means, and a D/A converter for D/A converting the latched data. The A means, the reference means, and the buffer amplification means are all integrated on one semiconductor chip. Therefore, the electrical characteristics of each element are almost the same, and even if there is a temperature change, there is almost no deterioration in the linearity of the D/A conversion characteristics due to a deviation in characteristics, that is, stable D/A conversion characteristics can be obtained. . Furthermore, since each element is integrated on the same semiconductor chip, the characteristics can be adjusted by a well-known laser trimming method, etc., making it possible to adjust the characteristics accurately and with high precision.
（ｆｌ実施例
第１図はこの発明の実施例である画像形成装置のＤ／Ａ
変換回路のブロック図を示している。(FIG. 1 shows the D/A of an image forming apparatus which is an embodiment of this invention.
A block diagram of a conversion circuit is shown.
６は一個のＬＳＩを示し、このＬＳＩ６はラソヂ回路ｌ
、コントロールロジック２．Ｄ／Ａコンバータ３．リフ
ァレンス電源回路４及びバッファアンプ５で構成されて
いる。ラッチ回路ｌには図外のＣＰＵから８ビツトのデ
ジタルデータがＤ・と姓も
〜Ｄ７の端子に入力）＜。コントロールロジック２はラ
ッチ回路１に対してラッチタイミングパルスなどを供給
するコントロール手段である。このコントロールロジッ
ク２のチップセレクト端子２０はＣＰＬＪのデコード回
路に接続され、チップイネーブル端子２１はＣＰＵのラ
イトイネーブル端子に接続される０両方の端子２０．２
１が共に“Ｌ”の時にコントロールロジック２はラッチ
回路ｌの入力端子に入力するデータをそのままＤ／Ａコ
ンバータ３に出力する。チップセレクト端子２０または
チップイネーブル端子２１のいずれが電子に入力したデ
ータがラッチ回路ｌにラッチされる。すなわちコントロ
ールロジック２からラッチ回路１にラッチパルスが出力
される。Ｄ／Ａコンバータ３はラッチ回路１から取り込
んだデータをリファレンス電源回路４から出力される電
圧を参照してアナログ１８号に変換する。バッファアン
プ５ばＤ／Ａコンバータ３からの電流出力を電圧に変換
し■。いとして出力する。6 indicates one LSI, and this LSI 6 is a Lasoji circuit
, control logic 2. D/A converter 3. It is composed of a reference power supply circuit 4 and a buffer amplifier 5. To the latch circuit l, 8-bit digital data is input from a CPU (not shown) to the terminal D7. The control logic 2 is a control means that supplies latch timing pulses and the like to the latch circuit 1. The chip select terminal 20 of this control logic 2 is connected to the decoding circuit of the CPLJ, and the chip enable terminal 21 is connected to the write enable terminal of the CPU.
1 are both "L", the control logic 2 outputs the data input to the input terminal of the latch circuit 1 as is to the D/A converter 3. Data electronically input to either the chip select terminal 20 or the chip enable terminal 21 is latched into the latch circuit l. That is, a latch pulse is output from the control logic 2 to the latch circuit 1. The D/A converter 3 converts the data taken in from the latch circuit 1 into analog No. 18 by referring to the voltage output from the reference power supply circuit 4. The buffer amplifier 5 converts the current output from the D/A converter 3 into voltage. Output as
なおリファレンス電源回路４の出力電圧の調整やバッフ
ァアンプ５のオフセットおよび利得の調整は必要に応じ
てレーザートリミングによって同時に行われる。Note that the adjustment of the output voltage of the reference power supply circuit 4 and the adjustment of the offset and gain of the buffer amplifier 5 are simultaneously performed by laser trimming as necessary.
第２図は第１図に示したＬＳＩを電子写真式複写機の制
御回路に実装した場合のブロック図を示している。７は
電子写真式複写機の制御部でありこの基板上にＣＰＵを
含むマイクロコンピュータ７０と二つのＤ／八へ換ＬＳ
Ｉ７１．７２が実装される。Ｄ／Ａ変換ＬＳＩ７１の出
力アナログ信号はバイアス電源回路８に導かれ、現像部
のバイアス電圧を制御する。またＤ／Δ変ｊＡＬｓＴ１
２の出力アナログ信号はメインチャージャのグリフ１・
電源回路９に導かれ、メインチャージャグリフト電圧の
制御を行う。FIG. 2 shows a block diagram when the LSI shown in FIG. 1 is implemented in a control circuit of an electrophotographic copying machine. 7 is the control unit of the electrophotographic copying machine, and on this board there is a microcomputer 70 including a CPU and two D/8 converters LS.
I71.72 is implemented. The output analog signal of the D/A conversion LSI 71 is guided to a bias power supply circuit 8, which controls the bias voltage of the developing section. Also, D/Δ change jALsT1
The output analog signal of 2 is the glyph 1 of the main charger.
It is led to the power supply circuit 9 and controls the main charger lift voltage.
以上の構成によって本実施例においては現像部のバイア
ス電圧とメインチャージャのグリ・ノド電圧が高７１１
度で且つ高安定度で制御されるようになる。With the above configuration, in this embodiment, the bias voltage of the developing section and the green/node voltage of the main charger are high 711.
control at high speed and with high stability.
（ｇ）発明の効果
以上のようにこの発明によれば、一つの十４体チップ上
に高精度且つ高安定度の要求されるリファレンス電源手
段およびバッファ増幅手段を集積し、これらとともにＤ
／Ａ変換ＬＳＩを構成しているために、出力されるアナ
ログ信号が非常に高精度なものとなり、しかち安定度の
高いものとなる。また同一チップ上にリファレンス電源
回路やバッファ増幅手段を集積しているために、それら
の電圧３Ａ整、オフセントおよび利得調整がレーザート
リミングなどの公知の方法によって同時にしかも高精度
に行うことができるために、従来のような回Δ゛δを組
み立て後に行う必要がなく信頼性の高いものとなる利点
がある。更に部品点数が減るために多くのアナログ信号
を制ｉ１Ｄ ＬなｔＪればならない画像形成装置におい
ては基板の小型化と一層の高信頼性の確保を実現できる
利点がある。(g) Effects of the Invention As described above, according to the present invention, the reference power supply means and the buffer amplification means, which require high precision and high stability, are integrated on one 14-chip chip, and together with these, the D
Since it is configured as a /A conversion LSI, the output analog signal is extremely accurate and highly stable. In addition, since the reference power supply circuit and buffer amplification means are integrated on the same chip, voltage adjustment of 3A, offset, and gain adjustment can be performed simultaneously and with high precision using known methods such as laser trimming. There is an advantage that it is not necessary to carry out the conventional process Δ゛δ after assembly, resulting in high reliability. Further, since the number of parts is reduced, there is an advantage that in an image forming apparatus in which many analog signals must be controlled, the substrate can be made smaller and higher reliability can be ensured.
第１図はこの発明の実施例の電子写真式複写機に使用さ
れるＤ／Ａ変換回路のブロック図を示す。第２図は同り
／Ａ変換回路を使用した電子写真式？Ｍ写機の制御部の
ブロック図を示している。FIG. 1 shows a block diagram of a D/A conversion circuit used in an electrophotographic copying machine according to an embodiment of the present invention. Is Fig. 2 the same/electrophotographic type using the A conversion circuit? A block diagram of the control unit of the M-photograph is shown.
Claims (1)
タルデータをラッチするラッチ手段と、そのラッチ手段
の動作を制御するコントロール手段と、前記ラッチ手段
に記憶されているデジタルデータをアナログ信号に変換
するＤ／Ａ変換手段と、そのＤ／Ａ変換手段にリフアレ
ンス電圧を供給するリフアレンス電源手段と、前記アナ
ログ信号を電圧出力に変換するバッファ増幅手段と、を
一つの半導体チップ上に集積したことを特徴とする画像
形成装置。(1) A latch means for latching digital data from a data processing means included in the image forming section, a control means for controlling the operation of the latch means, and converting the digital data stored in the latch means into an analog signal. A D/A conversion means for converting the D/A conversion means, a reference power supply means for supplying a reference voltage to the D/A conversion means, and a buffer amplification means for converting the analog signal into a voltage output are integrated on one semiconductor chip. Features of the image forming device.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63081812A JPH01253762A (en) | 1988-04-01 | 1988-04-01 | Image forming device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63081812A JPH01253762A (en) | 1988-04-01 | 1988-04-01 | Image forming device |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01253762A true JPH01253762A (en) | 1989-10-11 |
Family
ID=13756910
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63081812A Pending JPH01253762A (en) | 1988-04-01 | 1988-04-01 | Image forming device |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01253762A (en) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH08330431A (en) * | 1995-05-31 | 1996-12-13 | Nec Corp | Semiconductor integrated circuit |
| JP2010079281A (en) * | 2008-08-29 | 2010-04-08 | Brother Ind Ltd | High voltage power supply employing pulse-width modulation and digital-to-analog converter, power supply control device, and method of manufacturing the same |
-
1988
- 1988-04-01 JP JP63081812A patent/JPH01253762A/en active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH08330431A (en) * | 1995-05-31 | 1996-12-13 | Nec Corp | Semiconductor integrated circuit |
| JP2010079281A (en) * | 2008-08-29 | 2010-04-08 | Brother Ind Ltd | High voltage power supply employing pulse-width modulation and digital-to-analog converter, power supply control device, and method of manufacturing the same |
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