JPH01228202A - モノリシックマイクロ波集積回路 - Google Patents

モノリシックマイクロ波集積回路

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JPH01228202A
JPH01228202A JP63054256A JP5425688A JPH01228202A JP H01228202 A JPH01228202 A JP H01228202A JP 63054256 A JP63054256 A JP 63054256A JP 5425688 A JP5425688 A JP 5425688A JP H01228202 A JPH01228202 A JP H01228202A
Authority
JP
Japan
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matching circuit
integrated circuit
substrate
fet12
vapor
Prior art date
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Pending
Application number
JP63054256A
Other languages
English (en)
Inventor
Koji Tsukada
浩司 塚田
Shinichi Katsu
勝 新一
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electronics Corp
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Filing date
Publication date
Application filed by Matsushita Electronics Corp filed Critical Matsushita Electronics Corp
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Publication of JPH01228202A publication Critical patent/JPH01228202A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L2224/16Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector

Landscapes

  • Microwave Amplifiers (AREA)
  • Semiconductor Integrated Circuits (AREA)
  • Junction Field-Effect Transistors (AREA)
  • Waveguides (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 本発明は、マイクロ波の増幅、変調、発振等に用いるこ
とのできるモノリシックマイクロ波集積回路(以下MM
 I Cと略す)に関するものである。
従来の技術 近年、マイクロ波帯の通信用デバイスに対し、小型軽量
と高信頼性の要求が高まってお9、それに伴なって、従
来のハイブリッド回路方式であるMIC(マイクロ波集
積回路)から、MM I Cにかわって来ている。(従
来の技術としては、例えば、今井哲二他「化合物半導体
デバイス■」。(昭60゜1、S)、工業調査会、P3
8) 以下、図面を参照しながら、上述したような従来のMM
ICについて説明する。
第3図は従来のMMICの概略図を示すものである。半
導体基板1の上に、能動素子2とバイアス回路兼用線路
3、キャパシタ4がいっしょにつくりつけられている構
成になっている。このMMICは、バイアス回路3で能
動素子2にバイアスを供給し、一方からの入力信号を能
動素子2で増幅し、他方の端子から取り出す増幅器とし
て動作する。
発明が解決しようとする課題 しかしながら上述のような構成では、整合回路になって
いる線路3の形状、長さを決めるのに、何度か試行錯誤
をくりかえさなければならず、開発に時間がかかること
と、−度線路と作ってしまうと、変更ができないこと、
そしてまた能動素子2を中心として製作に多大の時間が
かかるという欠点を有していた。
本発明は上記欠点に鑑み、整合回路を変更することので
きるMMICを提供するものである。
課題を解決するだめの手段 上記課題を解決するために、本発明のMMICm半導体
基板上の能動素子および受動素子、別の半導体基板上の
受動素子で構成されている。
作  用 この構成によ−〕で、マイクロ波の増幅、変調、発振等
の整合回路だけを取り変え、修正することができる。
実施例 以下、本発明の一実施例について、図面を参照しながら
説明する。
第1図は本発明の第1の実施例における増幅器のMMI
Cの分割した斜視図、第2図は断面図を示すものである
第1図において、11はG a A s基板で、大きさ
は、2肩肩×1WM×0.15胃肩、12はFETであ
り、ゲート長が05μm1ゲ一トフインガー長1501
zmでトータルゲート幅300μm114は線路および
整合回路で、TiとAuを蒸着、その上にAuを2μm
メツキしている。15は平行平板型キャパシタンスで下
側の金属はAI 、上側の金属はTiとAuで厚みはそ
れぞれ10000八、600人、10000人である。
誘電体として、厚さ3000への313N4膜を用いて
いる。16は金属薄1漢でCr、Auをそれぞれ500
人、3000人蒸着してつける。2つのG a A s
チップをはり合せ、線路どうしの接合には、i艮ペース
トをつけている。
以上のように構成されたMMICの動作は従来例と同じ
であるが、整合回路14がFET12部と別の基板につ
いているため、整合回路14を変えることができる。
以上のように本実施例によれば、受動素子を能動素子と
は別の基板につくり、接合することにより、受動素子を
何種類か取り変えることができ、異なる特性のMMIC
を簡便に作ることができる。
なお、上記実施例では基板としてG a A s半導体
を用いだが、SiでもInPでもよい。また増幅器とし
だが、これに限ることなく、発振器、変調器、移相器な
どの回路であってもよい。線路はスIIノブラインにし
たが池の種類のものでもよい。
発明の効果 以上のように本発明は、MMIC回路の受動素子の一部
を別の半導体チップに作る′ことにより、2つに分けた
回路に構成でき、その実用的効果は大なるものがある。
【図面の簡単な説明】
第1図は本発明の第1の実施例におけるM M r C
の斜視図、第2図はその断面図、第3図は従来のMMI
Cの概略図である。 11・・・・・・半導体チップ、12・・・・・・能動
素子、15・・・・・・ギヤパシタンス。 代理人の氏名 弁理士 中 尾 敏 男 ほか1名ばつ 法                  −″f−4

Claims (1)

    【特許請求の範囲】
  1. (1)第1の半導体基板上に形成され、能動素子と受動
    素子とからなる第1の集積回路と、第2の半導体基体上
    に形成され受動素子からなる第2の集積回路とが、第1
    、第2の半導体基板の主面がたがいに対向して電気的に
    接続されてなることを特徴とするモノリシックマイクロ
    波集積回路。
JP63054256A 1988-03-08 1988-03-08 モノリシックマイクロ波集積回路 Pending JPH01228202A (ja)

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