JPH01179000A - 音声合成装置 - Google Patents
音声合成装置Info
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- JPH01179000A JPH01179000A JP62333373A JP33337387A JPH01179000A JP H01179000 A JPH01179000 A JP H01179000A JP 62333373 A JP62333373 A JP 62333373A JP 33337387 A JP33337387 A JP 33337387A JP H01179000 A JPH01179000 A JP H01179000A
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- 230000015572 biosynthetic process Effects 0.000 claims description 18
- 238000003786 synthesis reaction Methods 0.000 claims description 18
- 238000001914 filtration Methods 0.000 claims description 4
- 230000002194 synthesizing effect Effects 0.000 claims description 2
- 230000000737 periodic effect Effects 0.000 abstract description 5
- 230000001360 synchronised effect Effects 0.000 abstract 1
- 238000010586 diagram Methods 0.000 description 4
- 230000000694 effects Effects 0.000 description 2
- 230000003595 spectral effect Effects 0.000 description 2
- 101100262441 Caenorhabditis elegans rfl-1 gene Proteins 0.000 description 1
- 230000010354 integration Effects 0.000 description 1
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-
- G—PHYSICS
- G10—MUSICAL INSTRUMENTS; ACOUSTICS
- G10L—SPEECH ANALYSIS TECHNIQUES OR SPEECH SYNTHESIS; SPEECH RECOGNITION; SPEECH OR VOICE PROCESSING TECHNIQUES; SPEECH OR AUDIO CODING OR DECODING
- G10L13/00—Speech synthesis; Text to speech systems
- G10L13/02—Methods for producing synthetic speech; Speech synthesisers
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、音源波形を生成してディジタルフィルタで濾
波することにより、音声を合成する音声合成装置に関す
るものである。
波することにより、音声を合成する音声合成装置に関す
るものである。
従来、離散時間系で実現され、音声等を合成する装置と
して、スペクトル情報により周波数特性が制御されるデ
ィジタル合成フィルタ(H数時間系で実現される合成フ
ィルタ、以下合成フィルタと略す)と、周期的音源波形
を生成する回路と、ランダム音源波形を生成する回路と
を個々に有し、これら音源波形を合成フィルタで濾波し
て音声を合成するものが知られている。この場合の音源
波形としては、有声音ではインパルス列をフィルタに入
力して周期的な音源波形を、無声音ではランダム音源波
形をそれぞれ別の回路で発生させて用いる。
して、スペクトル情報により周波数特性が制御されるデ
ィジタル合成フィルタ(H数時間系で実現される合成フ
ィルタ、以下合成フィルタと略す)と、周期的音源波形
を生成する回路と、ランダム音源波形を生成する回路と
を個々に有し、これら音源波形を合成フィルタで濾波し
て音声を合成するものが知られている。この場合の音源
波形としては、有声音ではインパルス列をフィルタに入
力して周期的な音源波形を、無声音ではランダム音源波
形をそれぞれ別の回路で発生させて用いる。
このような音声合成装置の一例(以下、従来例1という
)は、エル・アール・ラビナー(L、R。
)は、エル・アール・ラビナー(L、R。
Rabiner)とアール・ダブリュー・シエーファ−
(R。
(R。
W、5chafer)の共著「ディジタル プロセシン
グオブ スピーチ シグナルズ(Digital Pr
ocessingof 5peech Signals
)Jの第三量に示されている。
グオブ スピーチ シグナルズ(Digital Pr
ocessingof 5peech Signals
)Jの第三量に示されている。
また、ノイズの生成源となる乱数発生回路の一例(以下
、従来例2という)は、宮用、原島、今井共著の「情報
と符号の理論」の第7章IA3(C)に示されている。
、従来例2という)は、宮用、原島、今井共著の「情報
と符号の理論」の第7章IA3(C)に示されている。
これは、いわゆるM系列と呼ばれる系列を発生するもの
である。
である。
これら従来例によれば、音源の特徴を表す情報とスペク
トル情報とから音声を合成するので、少ない情報量から
音声を合成できることや、規則によって音声を合成する
装置にも通していると言った特徴がある。
トル情報とから音声を合成するので、少ない情報量から
音声を合成できることや、規則によって音声を合成する
装置にも通していると言った特徴がある。
しかしながら、従来例1の音声合成装置では有声音源と
しては周期的音源波形を、無声音源としてランダム音源
波形を発生させるために別々の生成回路を持たねばなら
ない。そのため、構成が複雑になり、フレキシビリティ
に欠けるという問題点があった。この点は、特にLSI
化をするには問題となることがあった。
しては周期的音源波形を、無声音源としてランダム音源
波形を発生させるために別々の生成回路を持たねばなら
ない。そのため、構成が複雑になり、フレキシビリティ
に欠けるという問題点があった。この点は、特にLSI
化をするには問題となることがあった。
また、従来例2の乱数発注回路は無声音のノイズを発生
するための回路であって、有声音に適した任意の周期の
信号を発生できない。
するための回路であって、有声音に適した任意の周期の
信号を発生できない。
本発明の目的は、上述のような問題点を解決し、構成が
比較的簡単で、フレキシビリティがあり、LSI化に適
している、よりコンパクトな音声合成装置を提供するこ
とにある。
比較的簡単で、フレキシビリティがあり、LSI化に適
している、よりコンパクトな音声合成装置を提供するこ
とにある。
C問題点を解決するための手段〕
本発明は、音源波形を生成してディジタルフィルタで濾
波することにより、音声を合成する装置において、 任意の係数と値を任意の時刻に設定できるシフトレジス
タ系列発生器と、 前記シフトレジスタ系列発生器のレジスタとビット長が
等しく任意の時刻に任意の値を設定できる第1のレジス
タと、 前記シフトレジスタ系列発生器のレジスタの値と前記第
1のレジスタの値を比較し、等しいか否かの判断をする
比較器と、 任意の時刻に任意の値を設定できる第2のレジスタと、 音源波形のサンプルデータを記憶し、前記シフトレジス
タ系列発生器のレジスタの一部の値と前記第2のレジス
タの値をアドレスとして音源波形を出力するメモリと、 前記メモリから出力された音源波形をもとに音声を合成
するディジタルフィルタと、 前記比較器の結果によって前記シフトレジスタ系列発生
、器の新たな係数と前記第1および第2のレジスタの値
の設定を制御する手段とを有することを特徴としている
。
波することにより、音声を合成する装置において、 任意の係数と値を任意の時刻に設定できるシフトレジス
タ系列発生器と、 前記シフトレジスタ系列発生器のレジスタとビット長が
等しく任意の時刻に任意の値を設定できる第1のレジス
タと、 前記シフトレジスタ系列発生器のレジスタの値と前記第
1のレジスタの値を比較し、等しいか否かの判断をする
比較器と、 任意の時刻に任意の値を設定できる第2のレジスタと、 音源波形のサンプルデータを記憶し、前記シフトレジス
タ系列発生器のレジスタの一部の値と前記第2のレジス
タの値をアドレスとして音源波形を出力するメモリと、 前記メモリから出力された音源波形をもとに音声を合成
するディジタルフィルタと、 前記比較器の結果によって前記シフトレジスタ系列発生
、器の新たな係数と前記第1および第2のレジスタの値
の設定を制御する手段とを有することを特徴としている
。
本発明は、周期的音源とランダム音源を比較的簡単な1
つのシフトレジスタ系列発生器と第1のレジスタと比較
器とで生成させることにより、構成が比較的簡単で、フ
レキシビリティがあり、LSI化に適している、よりコ
ンパクトな音声合成装置を提供する。
つのシフトレジスタ系列発生器と第1のレジスタと比較
器とで生成させることにより、構成が比較的簡単で、フ
レキシビリティがあり、LSI化に適している、よりコ
ンパクトな音声合成装置を提供する。
従来例2の乱数発生回路に示されているM系列を発生さ
せる係数およびレジスタの初期値をシフトレジスタ系列
発生器に与えることにより、ランダム信号が得られる。
せる係数およびレジスタの初期値をシフトレジスタ系列
発生器に与えることにより、ランダム信号が得られる。
一方、このシフトレジスタ系列発生器に、短い周期にな
る系列を発生させる係数とレジスタの初期値を与えてお
く。更にその初期値から始めて、指定の時間経過したと
きのレジスタの状態を第1のレジスタに設定しておく。
る系列を発生させる係数とレジスタの初期値を与えてお
く。更にその初期値から始めて、指定の時間経過したと
きのレジスタの状態を第1のレジスタに設定しておく。
この値は、予め実験的に求めておくことができる。
シフトレジスタ系列発生器に上記の条件を満たす係数を
与えておき、クロックに同期して演算を施し、信号を発
生させる。シフトレジスタ系列発生器のレジスタと前記
第1のレジスタの値を前記比較器に入力し、一致しなけ
れば、自立的にシフトレジスタ系列発生器が動かしてお
く。一致したら新たな係数をシフトレジスタ系列発生器
に入力する。これにより任意の周期のレジスタパタンを
生成できる。前記クロックに同期して、前記シフトレジ
スタ系列発生器のレジスタの一部の値と第2のレジスタ
の値をアドレスとして音源波形をメモリから読み出す、
このようにして、任意の音源波形を生成できる。しかも
、第2のレジスタの値とシフトレジスタ系列発生器の両
方のデータをアドレスとするので、複数の音源波形を生
成できる。
与えておき、クロックに同期して演算を施し、信号を発
生させる。シフトレジスタ系列発生器のレジスタと前記
第1のレジスタの値を前記比較器に入力し、一致しなけ
れば、自立的にシフトレジスタ系列発生器が動かしてお
く。一致したら新たな係数をシフトレジスタ系列発生器
に入力する。これにより任意の周期のレジスタパタンを
生成できる。前記クロックに同期して、前記シフトレジ
スタ系列発生器のレジスタの一部の値と第2のレジスタ
の値をアドレスとして音源波形をメモリから読み出す、
このようにして、任意の音源波形を生成できる。しかも
、第2のレジスタの値とシフトレジスタ系列発生器の両
方のデータをアドレスとするので、複数の音源波形を生
成できる。
この音源波形を合成フィルタに送り音声を合成する。
次に図面を用いて本発明の実施例について説明する。
第1図は本発明の一実施例のブロック図である。
この音声合成装置は、任意の係数と初期値を任意の時刻
に設定できるシフトレジスタ系列発生器2と、シフトレ
ジスタ系列発生器2のレジスタとビット長が等しく任意
の時刻に任意の値を設定できる第1のレジスタ6と、シ
フトレジスタ系列発生器2のレジスタの値と第1のレジ
スタ6の値を比較し、等しいか否かの判断をする比較器
7と、任意の時刻に任意の値を設定できる第2のレジス
タ3と、音源波形のサンプルデータを記憶し、シフトレ
ジスタ系列発生器2のレジスタの一部の値と第2のレジ
スタ3の値をアドレスとして音源波形を出力するメモリ
4と、メモリ4から出力された音源をもとに音声を合成
するディジタルフィルタである合成フィルタ5と、比較
器7の結果によって新たな係数の設定を制御する制御回
路1とから構成されている。
に設定できるシフトレジスタ系列発生器2と、シフトレ
ジスタ系列発生器2のレジスタとビット長が等しく任意
の時刻に任意の値を設定できる第1のレジスタ6と、シ
フトレジスタ系列発生器2のレジスタの値と第1のレジ
スタ6の値を比較し、等しいか否かの判断をする比較器
7と、任意の時刻に任意の値を設定できる第2のレジス
タ3と、音源波形のサンプルデータを記憶し、シフトレ
ジスタ系列発生器2のレジスタの一部の値と第2のレジ
スタ3の値をアドレスとして音源波形を出力するメモリ
4と、メモリ4から出力された音源をもとに音声を合成
するディジタルフィルタである合成フィルタ5と、比較
器7の結果によって新たな係数の設定を制御する制御回
路1とから構成されている。
第2図は、シフトレジスタ系列発生器2の詳細な回路図
である。このシフトレジスタ系列発生器は、(n+1)
個の係数レジスタに0〜に、、と、(n+1)個のデー
タレジスタr0〜rnと、(n+1)個の論理積回路a
0〜a7と、n個の排他的論理和回路e、〜e□1とか
ら構成されている。
である。このシフトレジスタ系列発生器は、(n+1)
個の係数レジスタに0〜に、、と、(n+1)個のデー
タレジスタr0〜rnと、(n+1)個の論理積回路a
0〜a7と、n個の排他的論理和回路e、〜e□1とか
ら構成されている。
このようなシフトレジスタ系列発生器2において、入力
線100からデータレジスタr、〜r7に初期値を設定
し、入力線101から係数レジスタに0〜に、に係数、
を設定する。論理積回路a0〜a、1において、データ
レジスタr、の値と係数レジスタに、〜kn−1の値と
の論理積をとり、それらの値とデータレジスタrlxr
、、の値の排他的論理和をとり、これらの値を隣りのデ
ータレジスタr(。
線100からデータレジスタr、〜r7に初期値を設定
し、入力線101から係数レジスタに0〜に、に係数、
を設定する。論理積回路a0〜a、1において、データ
レジスタr、の値と係数レジスタに、〜kn−1の値と
の論理積をとり、それらの値とデータレジスタrlxr
、、の値の排他的論理和をとり、これらの値を隣りのデ
ータレジスタr(。
〜rfl−1に入力する。データレジスタrfiには、
データレジスタr、の値と、係数レジスタに7の値との
論理積を論理積回路a7でとって入力する。
データレジスタr、の値と、係数レジスタに7の値との
論理積を論理積回路a7でとって入力する。
データレジスタro−r7の値を出力線109に出力す
る。これら値は、比較器7へ送られる。また、一部のデ
ータレジスタ(第2図では、データレジスタr0とrt
)の値を出力線110に出力する。
る。これら値は、比較器7へ送られる。また、一部のデ
ータレジスタ(第2図では、データレジスタr0とrt
)の値を出力線110に出力する。
これらの値は、アドレスデータとしてメモリ4へ送られ
る。
る。
次に、第1図の音声合成装置の動作を説明する。
入力端子8からは、シフトレジスタ系列発生器2の係数
、初期値と、第1のレジスタ6の値と、第2のレジスタ
3の値と、合成フィルタ5の係数が入力される。これら
値は、制御回路1によってシフトレジスタ系列発生器2
、第1および第2のレジスタ6.3、合成フィルタ5に
設定される。
、初期値と、第1のレジスタ6の値と、第2のレジスタ
3の値と、合成フィルタ5の係数が入力される。これら
値は、制御回路1によってシフトレジスタ系列発生器2
、第1および第2のレジスタ6.3、合成フィルタ5に
設定される。
シフトレジスタ系列発生器2では、クロックに同期して
前述のような演算が施される。シフトレジスタ系列発生
器2のレジスタの一部の値と第2のレジスタ3の値をア
ドレスとし、音源波形のサンプルデータを記憶しておく
メモリ4に入力する。
前述のような演算が施される。シフトレジスタ系列発生
器2のレジスタの一部の値と第2のレジスタ3の値をア
ドレスとし、音源波形のサンプルデータを記憶しておく
メモリ4に入力する。
メモリ4ではそのアドレスに従って音源波形を出力し、
合成フィルタ5に入力する。合成フィルタ5では、音源
波形を濾波して音声を合成し、出力端子9から出力する
0以上の動作をクロックに同期して繰り返す。
合成フィルタ5に入力する。合成フィルタ5では、音源
波形を濾波して音声を合成し、出力端子9から出力する
0以上の動作をクロックに同期して繰り返す。
比較器7では、第1のレジスタ6と、シフトレジスタ系
列発生器2のレジスタを比較し、等しいか否かを判定し
、結果を示す信号を制御回路lに送る。制御回路lは、
比較器7から送られる比較結果の信号が一致しているこ
とを示していたら、新たなデータをシフトレジスタ系列
発生器に入力する。
列発生器2のレジスタを比較し、等しいか否かを判定し
、結果を示す信号を制御回路lに送る。制御回路lは、
比較器7から送られる比較結果の信号が一致しているこ
とを示していたら、新たなデータをシフトレジスタ系列
発生器に入力する。
なお、本実施例においてメモリ4の内容を外部から与え
られるような構成にしておけばよりフレキシビリティが
向上する。
られるような構成にしておけばよりフレキシビリティが
向上する。
以上説明したように、本発明によれば、周期的音源とラ
ンダム音源を比較的簡単な1つのシフトレジスタ系列発
生器で生成させることにより、構成が比較的簡単で、フ
レキシビリティがあり、LSI化に適している、よりコ
ンパクトな音声合成装置を提供することができる。
ンダム音源を比較的簡単な1つのシフトレジスタ系列発
生器で生成させることにより、構成が比較的簡単で、フ
レキシビリティがあり、LSI化に適している、よりコ
ンパクトな音声合成装置を提供することができる。
第1図は、本発明の一実施例を示すブロック図、第2図
は、第1図におけるシフトレジスタ系列発生器の詳細な
回路図である。 1・・・・・・制御回路 2・・・・・・シフトレジスタ系列発生器3・・・・・
・第2のレジスタ 4・・・・・・メモリ 5・・・・・・合成フィルタ 6・・・・・・第1のレジスタ 7・・・・・・比較器 8・・・・・・入力端子 9・・・・・・出力端子 100、101 ・・・入力線 109.110 ・・・出力線 に0〜に7・・・係数レジスタ r0〜r7・・・データレジスタ a0〜a7・・・論理積回路 00〜e+s−1・・排他的論理和回路代理人 弁理士
岩 佐 義 幸 第1図 第2図
は、第1図におけるシフトレジスタ系列発生器の詳細な
回路図である。 1・・・・・・制御回路 2・・・・・・シフトレジスタ系列発生器3・・・・・
・第2のレジスタ 4・・・・・・メモリ 5・・・・・・合成フィルタ 6・・・・・・第1のレジスタ 7・・・・・・比較器 8・・・・・・入力端子 9・・・・・・出力端子 100、101 ・・・入力線 109.110 ・・・出力線 に0〜に7・・・係数レジスタ r0〜r7・・・データレジスタ a0〜a7・・・論理積回路 00〜e+s−1・・排他的論理和回路代理人 弁理士
岩 佐 義 幸 第1図 第2図
Claims (1)
- (1)音源波形を生成してディジタルフィルタで濾波す
ることにより、音声を合成する装置において、 任意の係数と値を任意の時刻に設定できるシフトレジス
タ系列発生器と、 前記シフトレジスタ系列発生器のレジスタとビット長が
等しく任意の時刻に任意の値を設定できる第1のレジス
タと、 前記シフトレジスタ系列発生器のレジスタの値と前記第
1のレジスタの値を比較し、等しいか否かの判断をする
比較器と、 任意の時刻に任意の値を設定できる第2のレジスタと、 音源波形のサンプルデータを記憶し、前記シフトレジス
タ系列発生器のレジスタの一部の値と前記第2のレジス
タの値をアドレスとして音源波形を出力するメモリと、 前記メモリから出力された音源波形をもとに音声を合成
するディジタルフィルタと、 前記比較器の結果によって前記シフトレジスタ系列発生
器の新たな係数と前記第1および第2のレジスタの値の
設定を制御する手段とを有することを特徴とする音声合
成装置。
Priority Applications (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62333373A JP2590997B2 (ja) | 1987-12-29 | 1987-12-29 | 音声合成装置 |
CA000587155A CA1334870C (en) | 1987-12-29 | 1988-12-28 | Speech synthesizer using shift register sequence generator |
US07/291,827 US4959866A (en) | 1987-12-29 | 1988-12-29 | Speech synthesizer using shift register sequence generator |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62333373A JP2590997B2 (ja) | 1987-12-29 | 1987-12-29 | 音声合成装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH01179000A true JPH01179000A (ja) | 1989-07-17 |
JP2590997B2 JP2590997B2 (ja) | 1997-03-19 |
Family
ID=18265383
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP62333373A Expired - Lifetime JP2590997B2 (ja) | 1987-12-29 | 1987-12-29 | 音声合成装置 |
Country Status (3)
Country | Link |
---|---|
US (1) | US4959866A (ja) |
JP (1) | JP2590997B2 (ja) |
CA (1) | CA1334870C (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5369730A (en) * | 1991-06-05 | 1994-11-29 | Hitachi, Ltd. | Speech synthesizer |
Family Cites Families (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
GB1541429A (en) * | 1975-12-19 | 1979-02-28 | Int Computers Ltd | Speech synthesising apparatus |
US4344148A (en) * | 1977-06-17 | 1982-08-10 | Texas Instruments Incorporated | System using digital filter for waveform or speech synthesis |
CA1123955A (en) * | 1978-03-30 | 1982-05-18 | Tetsu Taguchi | Speech analysis and synthesis apparatus |
US4296279A (en) * | 1980-01-31 | 1981-10-20 | Speech Technology Corporation | Speech synthesizer |
JPS6040632B2 (ja) * | 1980-03-12 | 1985-09-11 | 松下電器産業株式会社 | デイジタルフイルタ |
JPS5940700A (ja) * | 1982-08-31 | 1984-03-06 | 株式会社東芝 | 音声合成装置 |
-
1987
- 1987-12-29 JP JP62333373A patent/JP2590997B2/ja not_active Expired - Lifetime
-
1988
- 1988-12-28 CA CA000587155A patent/CA1334870C/en not_active Expired - Fee Related
- 1988-12-29 US US07/291,827 patent/US4959866A/en not_active Expired - Lifetime
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5369730A (en) * | 1991-06-05 | 1994-11-29 | Hitachi, Ltd. | Speech synthesizer |
Also Published As
Publication number | Publication date |
---|---|
JP2590997B2 (ja) | 1997-03-19 |
US4959866A (en) | 1990-09-25 |
CA1334870C (en) | 1995-03-21 |
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