JPH0114674B2 - - Google Patents
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- JPH0114674B2 JPH0114674B2 JP55020477A JP2047780A JPH0114674B2 JP H0114674 B2 JPH0114674 B2 JP H0114674B2 JP 55020477 A JP55020477 A JP 55020477A JP 2047780 A JP2047780 A JP 2047780A JP H0114674 B2 JPH0114674 B2 JP H0114674B2
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- Protection Of Static Devices (AREA)
Description
本発明はアレスタ監視方法に係り、特にギヤツ
プレスのアレスタの異常を検知するに好適なアレ
スタ監視方法に関する。
酸化亜鉛等の焼結体から成るギヤツプレスのア
レスタは、劣化が発生し温度が上昇すると、この
アレスタを流れる抵抗分電流により発熱し、さら
にアレスタの温度を上昇させるという悪循環が生
ずる。発熱量が放熱量を上まわるようになると、
アレスタは熱暴走状態になり、ついには破壊して
しまうことになる。
これを未然に防止するため、従来ではギヤツプ
レスのアレスタの温度を測定したり、アレスタの
温度とアレスタの抵抗分電流の間に第１図の関係
のあることに着目し第２図のようにこの電流を測
定する方法がとられていた。すなわち、一端を高
圧側である母線１に接続するアレスタ２の他端で
ある接地側に接続された検出器３の出力を信号処
理器４により処理し、アレスタの抵抗分電流を分
離して表示器５で表示させたものである。ところ
で、ギヤツプレスのアレスタ２の温度は、外気温
の上昇や母線１に侵入したサージの処理により上
昇するが、この上昇した温度において、ギヤツプ
レスのアレスタが熱暴走するか否かを判定しなけ
ればならない。上記の従来技術では、時々刻々の
温度は表示するものの、上昇した温度において熱
暴走するか否かの判定を行うことができないとい
う欠点を有していた。
本発明の目的は、アレスタのいかなる温度にお
いても熱暴走状態にあるか否かを確実に判定でき
るアレスタ監視方法を提供することにある。
本発明は次の原理に基づいている。ギヤツプレ
スアレスタが正常な状態にあるときは、その温度
Ｔ（または抵抗分電流Ｉ）の時刻ｔに対する変化
ΔT／Δt（またはΔI／Δt）は常に零または負である。
す
なわち、時間が経つにつれ冷却される。ギヤツプ
レスのアレスタが異常（熱暴走）状態にあると
き、時間が経つにつれ温度が上昇して行くので常
にΔT／Δt＞０（またはΔI／Δt＞０）になる。したが
つ
て、所定の時間Δtをおいて温度変化ΔT（または
抵抗分電流の変化ΔI）をとり、温度変化ΔT（ま
たは抵抗分電流の変化ΔI）の判定を行うことに
より正常と異常の監視を確実に行うことができ
る。第３図は或る時刻t0でサージ電流を処理した
ときのアレスタの温度Ｔ（または抵抗分電流Ｉ）
の時間変化の概略図であり、１回のサージ電流処
理により20〜60℃温度上昇する。
次に、本発明の方法の各実施例を第４図及び第
５図によつて順に説明する。本発明の第４図に示
す実施例は、サージ電流処理時の温度上昇を対像
にしたものである。酸化亜鉛等の焼結体で構成さ
れたギヤツプレスのアレスタ２は、変電所の高電
圧の母線１に上方の一端を接続されている。アレ
スタ２の他端はこれを流れる電流を検出するため
の検出器３を介して接地されている。検出器３の
出力は、信号処理器４に入力され、ここで抵抗分
電流が分離され出力される。この抵抗分電流は、
表示器５により表示されている。一方、信号処理
器４の出力は、ゲート回路１２を経てメモリ６に
記憶される。このゲート回路１２は、サージを処
理したか否かを検出するアレスタ２の動作検出器
７の出力により駆動されるパルス回路１１からの
パルス出力を受け、瞬間的に信号処理器４とメモ
リ６を導通状態にするもので、それ以外は両者は
絶縁状態にある。パルス回路１１のパルス出力
は、同時にタイマ８にも入力される。このタイマ
８は、パルス回路１１からのパルス出力を受けた
のち、所定時間経過したときにゲート回路１３に
パルス電圧を出力する。このパルス出力を受けて
ゲート回路１３は、メモリ６と比較回路９を瞬間
的に導通状態にする。それ以外の時には、ゲート
回路１３は両者を絶縁状態にすると共に、メモリ
６の内容をクリアする作用をする。信号処理器４
の出力とメモリ６の出力とが比較回路９において
比較され、前者の方が後者より小ならば正常、前
者の方が後者より大ならば異常（熱暴走中）と判
定され、異常表示器１０により表示される。
今、第３図において時刻t0にサージ電圧が母線
１に侵入し、アレスタ２がこれを処理したとす
る。アレスタ２が動作したのち、時刻t1に動作検
出器７に応動するパルス回路１１により、ゲート
回路１２が導通状態にされ、このときの信号処理
器４の出力I1（またはI1′）がメモリ６に記憶され
る。また、タイマ８により所定時間経つたのち、
時刻t2にゲート回路１３が導通状態にされ、この
ときの信号処理器４の出力I2（またはI2′）とメモ
リ６の記憶I1（またはI1′）が、比較回路９で比較
される。I1≧I2のときは、時間が経つにつれて冷
却されて行く状態であるので正常と判定され、異
常表示器１０に正常と表示される。I1′≦I2′のと
きは、時間が経つにつれて温度が上昇して行く状
態であるので異常と判定され、異常表示器１０に
異常と表示される。
本実施例によればアレスタ２にてサージを処理
した時刻t0後である一定の時刻t1の時点が再判定
を行うので、サージ処理時の電磁誘導により生じ
易い各測定器具の誤動作を防止できるという長所
がある。
別の実施例である第５図に示すものは、サージ
処理時のみならず一般の温度上昇（たとえば外気
温の上昇）を対像にしたものである。第４図の実
施例と異なる点は、アレスタ２の温度上昇に基づ
く抵抗分電流が、許容値以下にあるか否かを判定
するための比較回路１４を設けた点と、その電流
が許容値以上になつたとき、時間が経つにつれて
増加傾向にあるか否かを判定するための比較回路
１５を設けた点およびパルス回路１１の入力を比
較回路１４からとつた点である。信号処理器４の
出力は、比較回路１４に入力される。比較回路１
４では、あらかじめ設定された許容される抵抗分
電流値（または温度）と信号処理器４の出力が比
較される。前者の方が後者より大ならば、比較回
路１４の出力は０となり、パルス回路１１は不動
作状態をつづける。また、この出力はAND回路
に入力レベル０として入力される。一方、このと
き比較回路１５の出力は、レベル０となつて
AND回路１６に入力される。したがつて、この
ときのAND回路１６の出力は、後述する真理値
表に応じて０となり、表示器１０は正常と表示す
る。次に、信号処理器４の出力が許容抵抗分電流
値（または温度）より大の場合、比較回路１４の
出力Ｖ（≠０）となり、パルス回路１１を駆動す
る。それによつて、パルス回路１１からゲート回
路１２とタイマ８にパルス電圧を送り、前者を導
通状態に、これと同時に後者を始動させる。この
ため、所定時間経つたのち、タイマ８からゲート
１３に対しパルス電圧が出力され、メモリ６の記
憶した電圧が、比較回路１５に入力される。この
入力と信号処理器４の出力が比較回路１５で比較
され、前者の方が後者より大のときは、比較回路
１５の出力はレベル０となり、逆に前者の方が後
者より小のときは、レベル１となつてAND回路
１６に入力する。AND回路１６のもう一つの入
力は、比較回路１４の出力であり、Ｖ≠０すなわ
ちレベル１になつている。したがつて、同様に真
理値表より、AND回路１６の出力は順にレベル
０、レベル１と出力され、それぞれ正常・異常と
表示器１０で表示される。したがつて、比較回路
１４で異常と出力されても、この異常値が時間と
ともに減少している（冷却しつつある）場合には
正常の判断を下し、逆に時間とともに増加してい
る（温度上昇しつつある）場合には異常の判断を
下すことになる。
下表で０は正常を、また１は異常を示す。
The present invention relates to an arrester monitoring method, and particularly to an arrester monitoring method suitable for detecting an abnormality in an arrester of a gear press. When a gear press arrester made of a sintered body of zinc oxide or the like deteriorates and its temperature rises, the resistive current flowing through the arrester generates heat, causing a vicious cycle in which the temperature of the arrester further rises. When the amount of heat generated exceeds the amount of heat dissipated,
The arrester goes into a state of thermal runaway and is eventually destroyed. In order to prevent this from happening, conventional methods have been to measure the temperature of the arrester of the gear press, or to focus on the relationship shown in Figure 1 between the arrester temperature and the resistance current of the arrester, and to measure this as shown in Figure 2. A method was used to measure current. That is, the output of the detector 3, which has one end connected to the high-voltage side bus 1, and the other end of the arrester 3 connected to the ground side, is processed by the signal processor 4, and the arrester resistance current is separated and displayed. This is what was displayed on instrument 5. By the way, the temperature of the arrester 2 of the gear press increases due to the increase in outside temperature and the treatment of surges that have entered the bus bar 1, but it is necessary to determine whether or not the arrester of the gear press will go into thermal runaway at this increased temperature. . Although the above-mentioned conventional technology displays the temperature from time to time, it has the disadvantage that it is not possible to determine whether or not thermal runaway occurs when the temperature rises. An object of the present invention is to provide an arrester monitoring method that can reliably determine whether or not the arrester is in a thermal runaway state at any temperature. The invention is based on the following principle. When the gear press arrester is in a normal state, the change ΔT/Δt (or ΔI/Δt) in its temperature T (or resistance component current I) with respect to time t is always zero or negative.
That is, it cools down over time. When the gear press arrester is in an abnormal state (thermal runaway), the temperature increases over time, so ΔT/Δt>0 (or ΔI/Δt>0). Therefore, normality and abnormality can be monitored by taking the temperature change ΔT (or resistance current change ΔI) after a predetermined time Δt and determining the temperature change ΔT (or resistance current change ΔI). It can be done reliably. Figure 3 shows the arrester temperature T (or resistance current I) when a surge current is processed at a certain time t0 .
Fig. 2 is a schematic diagram of the change in temperature over time, and the temperature increases by 20 to 60°C by one surge current treatment. Next, each embodiment of the method of the present invention will be explained in turn with reference to FIGS. 4 and 5. The embodiment shown in FIG. 4 of the present invention deals with the temperature rise during surge current processing. A gear press arrester 2 made of a sintered body of zinc oxide or the like is connected at one upper end to a high voltage bus 1 of a substation. The other end of the arrester 2 is grounded via a detector 3 for detecting the current flowing through it. The output of the detector 3 is input to a signal processor 4, where the resistance current is separated and output. This resistance current is
It is displayed on the display 5. On the other hand, the output of the signal processor 4 is stored in the memory 6 via the gate circuit 12. This gate circuit 12 receives a pulse output from a pulse circuit 11 driven by the output of the operation detector 7 of the arrester 2, which detects whether or not the surge has been processed, and instantaneously switches on the signal processor 4 and the memory 6. This is used to make them conductive, but otherwise the two are insulated. The pulse output of the pulse circuit 11 is also input to the timer 8 at the same time. After receiving the pulse output from the pulse circuit 11, the timer 8 outputs a pulse voltage to the gate circuit 13 when a predetermined period of time has elapsed. Upon receiving this pulse output, the gate circuit 13 instantaneously brings the memory 6 and the comparator circuit 9 into a conductive state. At other times, the gate circuit 13 serves to insulate the two and clear the contents of the memory 6. Signal processor 4
The output of the memory 6 is compared with the output of the memory 6 in the comparator circuit 9, and if the former is smaller than the latter, it is determined to be normal, and if the former is larger than the latter, it is determined to be abnormal (during thermal runaway), and the abnormality indicator 10 is determined. Displayed by Now, suppose that a surge voltage enters the bus bar 1 at time t 0 in FIG. 3, and the arrester 2 handles it. After the arrester 2 operates, the gate circuit 12 is made conductive by the pulse circuit 11 responding to the operation detector 7 at time t1 , and the output I 1 (or I 1 ') of the signal processor 4 at this time becomes It is stored in the memory 6. Also, after a predetermined time has elapsed by timer 8,
At time t 2 , the gate circuit 13 is made conductive, and the output I 2 (or I 2 ') of the signal processor 4 at this time and the memory I 1 (or I 1 ') of the memory 6 are compared in the comparison circuit 9. be done. When I 1 ≧I 2 , the state is being cooled over time, so it is determined to be normal, and the abnormality indicator 10 displays normal. When I 1 '≦I 2 ', the temperature is rising over time, so it is determined that there is an abnormality, and the abnormality is displayed on the abnormality indicator 10. According to this embodiment, re-judgment is performed at a certain time t 1 after the time t 0 when the surge is processed by the arrester 2, thereby preventing malfunctions of each measuring instrument that are likely to occur due to electromagnetic induction during surge processing. It has the advantage of being possible. Another embodiment, shown in FIG. 5, deals not only with surge processing but also with general temperature increases (for example, increases in outside temperature). The difference from the embodiment shown in FIG. 4 is that a comparison circuit 14 is provided to determine whether the resistance current due to the temperature rise of the arrester 2 is below the allowable value, and that the current is within the allowable value. The point is that a comparison circuit 15 is provided to determine whether or not there is an increasing tendency as time passes when the number of pulses increases, and the input of the pulse circuit 11 is taken from the comparison circuit 14. The output of the signal processor 4 is input to a comparison circuit 14. Comparison circuit 1
4, the output of the signal processor 4 is compared with a preset allowable resistance current value (or temperature). If the former is greater than the latter, the output of the comparator circuit 14 becomes 0 and the pulse circuit 11 continues to be inactive. Further, this output is input to the AND circuit as an input level 0. On the other hand, at this time, the output of the comparison circuit 15 becomes level 0.
It is input to the AND circuit 16. Therefore, the output of the AND circuit 16 at this time becomes 0 according to a truth table described later, and the display 10 indicates normal. Next, when the output of the signal processor 4 is larger than the allowable resistance current value (or temperature), the output of the comparison circuit 14 becomes V (≠0), and the pulse circuit 11 is driven. Thereby, a pulse voltage is sent from the pulse circuit 11 to the gate circuit 12 and the timer 8, making the former conductive and simultaneously starting the latter. Therefore, after a predetermined period of time has elapsed, a pulse voltage is output from the timer 8 to the gate 13, and the voltage stored in the memory 6 is input to the comparator circuit 15. This input and the output of the signal processor 4 are compared in a comparison circuit 15, and when the former is larger than the latter, the output of the comparison circuit 15 becomes level 0, and conversely, when the former is smaller than the latter, the output of the comparison circuit 15 becomes level 0. , becomes level 1 and input to the AND circuit 16. Another input of the AND circuit 16 is the output of the comparison circuit 14, and V≠0, that is, level 1. Therefore, similarly, according to the truth table, the output of the AND circuit 16 is output as level 0 and level 1 in order, and the display 10 indicates normality and abnormality, respectively. Therefore, even if the comparator circuit 14 outputs an abnormality, if this abnormal value is decreasing over time (cooling down), it is determined to be normal, and conversely, it is increasing over time ( If the temperature is rising), it is determined that there is an abnormality. In the table below, 0 indicates normality and 1 indicates abnormality.
【表】
本発明のアレスタ監視方法によれば、アレスタ
の温度が外気温度やサージ処理により上昇して
も、それが時間が経つにつれ増加傾向にあるのか
減少傾向にあるのかということが正確に判定でき
るようになるため、アレスタが熱暴走中であるか
否か正確に判断できるという効果がある。[Table] According to the arrester monitoring method of the present invention, even if the arrester temperature rises due to outside air temperature or surge processing, it can be accurately determined whether the arrester temperature is increasing or decreasing over time. This has the effect of accurately determining whether or not the arrester is experiencing thermal runaway.
第１図はアレスタの抵抗分電流と温度の関係を
示す特性図、第２図は従来のアレスタを示す概略
図、第３図はサージ処理したときのアレスタの抵
抗分電流（または温度）の時間変化特性図、第４
図は本発明の監視方法を適用したアレスタの一実
施例を示すブロツク図、第５図は本発明の監視方
法を適用したアレスタの別の実施例のブロツク図
である。
１…母線、２…アレスタ、３…検出器、７…動
作検出器、８…タイマ、９…比較回路、１０…異
常表示器。
Figure 1 is a characteristic diagram showing the relationship between the arrester resistance current and temperature, Figure 2 is a schematic diagram showing a conventional arrester, and Figure 3 is the time change of the arrester resistance current (or temperature) during surge processing. Change characteristic diagram, 4th
This figure is a block diagram showing one embodiment of the arrester to which the monitoring method of the present invention is applied, and FIG. 5 is a block diagram of another embodiment of the arrester to which the monitoring method of the present invention is applied. DESCRIPTION OF SYMBOLS 1...Bus bar, 2...Arrester, 3...Detector, 7...Operation detector, 8...Timer, 9...Comparison circuit, 10...Error indicator.
Claims (1)
端を母線に接続すると共に他端を接地し、前記母
線に侵入したサージをアレスタにて処理した時刻
におけるアレスタ温度または抵抗分電流を、所定
時間後に測定したアレスタ温度または抵抗分電流
とを比較することにより、アレスタの正常・異常
の判定を行うようにしたことを特徴とするアレス
タ監視方法。1 One end of the arrester of a gear press made of a sintered body was connected to the bus bar, and the other end was grounded, and the arrester temperature or resistance current at the time when the surge that entered the bus bar was treated with the arrester was measured after a predetermined time. An arrester monitoring method characterized by determining whether the arrester is normal or abnormal by comparing the arrester temperature or resistance current.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2047780A JPS56117535A (en) | 1980-02-22 | 1980-02-22 | Arrester monitor |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2047780A JPS56117535A (en) | 1980-02-22 | 1980-02-22 | Arrester monitor |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS56117535A JPS56117535A (en) | 1981-09-16 |
| JPH0114674B2 true JPH0114674B2 (en) | 1989-03-13 |
Family
ID=12028186
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2047780A Granted JPS56117535A (en) | 1980-02-22 | 1980-02-22 | Arrester monitor |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS56117535A (en) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5243961A (en) * | 1975-10-03 | 1977-04-06 | Tokyo Electric Power Co Inc:The | Prevention device of miss operation |
-
1980
- 1980-02-22 JP JP2047780A patent/JPS56117535A/en active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5243961A (en) * | 1975-10-03 | 1977-04-06 | Tokyo Electric Power Co Inc:The | Prevention device of miss operation |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS56117535A (en) | 1981-09-16 |
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