JPH01114092A - 埋込み型半導体レーザ - Google Patents
埋込み型半導体レーザInfo
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- JPH01114092A JPH01114092A JP27012887A JP27012887A JPH01114092A JP H01114092 A JPH01114092 A JP H01114092A JP 27012887 A JP27012887 A JP 27012887A JP 27012887 A JP27012887 A JP 27012887A JP H01114092 A JPH01114092 A JP H01114092A
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Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01S—DEVICES USING THE PROCESS OF LIGHT AMPLIFICATION BY STIMULATED EMISSION OF RADIATION [LASER] TO AMPLIFY OR GENERATE LIGHT; DEVICES USING STIMULATED EMISSION OF ELECTROMAGNETIC RADIATION IN WAVE RANGES OTHER THAN OPTICAL
- H01S5/00—Semiconductor lasers
- H01S5/20—Structure or shape of the semiconductor body to guide the optical wave ; Confining structures perpendicular to the optical axis, e.g. index or gain guiding, stripe geometry, broad area lasers, gain tailoring, transverse or lateral reflectors, special cladding structures, MQW barrier reflection layers
- H01S5/22—Structure or shape of the semiconductor body to guide the optical wave ; Confining structures perpendicular to the optical axis, e.g. index or gain guiding, stripe geometry, broad area lasers, gain tailoring, transverse or lateral reflectors, special cladding structures, MQW barrier reflection layers having a ridge or stripe structure
- H01S5/227—Buried mesa structure ; Striped active layer
-
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- H01S5/227—Buried mesa structure ; Striped active layer
- H01S5/2275—Buried mesa structure ; Striped active layer mesa created by etching
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、特に寄生容量が小さく、超高速変調に好適な
埋込み型半導体レーザに関する。
埋込み型半導体レーザに関する。
(従来の技術〕
光フアイバー通信の大容量化のために、超高速変調(1
0〜30 G Hz )の可能な半導体レーザが望まれ
ている。これまでの光フアイバー通信に用いられている
半導体レーザは、埋込み型半導体レーザ(Buried
Heterostructure : B H)であ
り。
0〜30 G Hz )の可能な半導体レーザが望まれ
ている。これまでの光フアイバー通信に用いられている
半導体レーザは、埋込み型半導体レーザ(Buried
Heterostructure : B H)であ
り。
これは、低しきい電流で、縦モード、横モード共に単一
であり、さらに他の半導体レーザに比べて寄生インピー
ダンスが小さいためである。しかし、このBHレーザに
おいても、その変調帯域は、ストライプ外部の寄生容量
により、約3 G Hzに制限されている。寄生容量を
低減するためには、ストライプ外部の半導体接合面積を
小さくすることが考えられる。その1つの方法として、
ストライブの近傍以外の埋込み層をエツチング等により
、除去することが、上手他により、昭和61年度電子通
信学会光・電波部門全国大会請演論文集NQ232にて
発表されている。この報告では、残存しているメサ幅は
5μmであり、ストライプ外部の埋込み層の残存してい
る幅は片側約2μmとなる。この寄生容量は89Fであ
り、これによる変調帯域は4〜5GHzに制限されてい
る。
であり、さらに他の半導体レーザに比べて寄生インピー
ダンスが小さいためである。しかし、このBHレーザに
おいても、その変調帯域は、ストライプ外部の寄生容量
により、約3 G Hzに制限されている。寄生容量を
低減するためには、ストライプ外部の半導体接合面積を
小さくすることが考えられる。その1つの方法として、
ストライブの近傍以外の埋込み層をエツチング等により
、除去することが、上手他により、昭和61年度電子通
信学会光・電波部門全国大会請演論文集NQ232にて
発表されている。この報告では、残存しているメサ幅は
5μmであり、ストライプ外部の埋込み層の残存してい
る幅は片側約2μmとなる。この寄生容量は89Fであ
り、これによる変調帯域は4〜5GHzに制限されてい
る。
上記従来技術は、ストライプ外部の寄生容量を低減する
ために、−度成長した埋込み層をエツチングにより除去
する方法である。10GHz以上の変調帯域を実現する
ためには、残存させる埋込み層の幅を0.5μm程度に
する必要があり、上記従来技術では、エツチングマスク
の合わせ精度・寸法精度、及びサイドエッチの点で不可
能であった。
ために、−度成長した埋込み層をエツチングにより除去
する方法である。10GHz以上の変調帯域を実現する
ためには、残存させる埋込み層の幅を0.5μm程度に
する必要があり、上記従来技術では、エツチングマスク
の合わせ精度・寸法精度、及びサイドエッチの点で不可
能であった。
本発明の目的は、ストライプ外部の埋込み層の幅を1.
0μm以下、寄生容量を3pF以下程度に形成すること
を容易にし、10〜30GHzの変調帯域を有する半導
体レーザを提供することにある。
0μm以下、寄生容量を3pF以下程度に形成すること
を容易にし、10〜30GHzの変調帯域を有する半導
体レーザを提供することにある。
上記目的の第1の達成手段は、埋込み層の形状をメサス
トライプの両側に埋込んだ活性層より屈折率の小さい結
晶層中に設ける側面が垂直な溝により規定することであ
る。溝は臭素、塩素などのハロゲン系ガスを使用して反
応性イオンエツチング法あるいは反応性イオンビームエ
ツチング法により形成する。
トライプの両側に埋込んだ活性層より屈折率の小さい結
晶層中に設ける側面が垂直な溝により規定することであ
る。溝は臭素、塩素などのハロゲン系ガスを使用して反
応性イオンエツチング法あるいは反応性イオンビームエ
ツチング法により形成する。
また、上記目的の第2の達成手段は、埋込み層をメサス
トライプに被着形成した膜厚3μm以下の活性層より屈
折率の小さい半導体薄膜とすることである。薄膜はMO
CVD法、ハライド系VPE法、クロライド系VPE法
、あるいはMBE法などにより形成する。
トライプに被着形成した膜厚3μm以下の活性層より屈
折率の小さい半導体薄膜とすることである。薄膜はMO
CVD法、ハライド系VPE法、クロライド系VPE法
、あるいはMBE法などにより形成する。
上記第1の達成手段においては、臭素、塩素などのハロ
ゲン系ガスを使用した。反応性イオンエツチング法ある
いは、反応性イオンビームエツチング法により、側面が
ほぼ垂直な溝を形成することができる。これにより、活
性層の両側1μm以内のところに、再現性よく基板結晶
に達する溝を作製することができる。その結果1例えば
電流ブロック層のpnpもしくはnpn接合よりなる埋
込み層の寄生容量を10〜40pFから1〜3pFにま
で低減することができる。従来の埋込み型半導体レーザ
の変調帯域は電気的特性により制限されており、接合容
量をC2直列抵抗をRとすると、遮断周波数fは、f=
L/C2πCR)で与えられる。本発明により、fを一
桁改善することができる。さらに、作製した溝の表面を
基板結晶材料と接着性がよく、熱膨張係数がほぼ等しい
。
ゲン系ガスを使用した。反応性イオンエツチング法ある
いは、反応性イオンビームエツチング法により、側面が
ほぼ垂直な溝を形成することができる。これにより、活
性層の両側1μm以内のところに、再現性よく基板結晶
に達する溝を作製することができる。その結果1例えば
電流ブロック層のpnpもしくはnpn接合よりなる埋
込み層の寄生容量を10〜40pFから1〜3pFにま
で低減することができる。従来の埋込み型半導体レーザ
の変調帯域は電気的特性により制限されており、接合容
量をC2直列抵抗をRとすると、遮断周波数fは、f=
L/C2πCR)で与えられる。本発明により、fを一
桁改善することができる。さらに、作製した溝の表面を
基板結晶材料と接着性がよく、熱膨張係数がほぼ等しい
。
基板結晶材料と同種の元素を少なくとも一種類含んだ酸
化物で被うことにより、寿命信頼性を向上させることが
できる。
化物で被うことにより、寿命信頼性を向上させることが
できる。
上記第2の達成手段においては、上記成長法によれば、
メサ形状をほぼ保存しながら埋込み層が成長するので、
活性層の両側にほぼ同様の膜厚の埋込み層が成長し、ま
たこの薄膜埋込み層の幅は、その成長時間のみにより、
厳密に制御できる。従って、0.5μm以下の埋込み層
形成が十分制御よく形成でき、その寄生容量は主に埋込
み層のキャリア濃度により決まる。埋込み層をアンドー
プ。
メサ形状をほぼ保存しながら埋込み層が成長するので、
活性層の両側にほぼ同様の膜厚の埋込み層が成長し、ま
たこの薄膜埋込み層の幅は、その成長時間のみにより、
厳密に制御できる。従って、0.5μm以下の埋込み層
形成が十分制御よく形成でき、その寄生容量は主に埋込
み層のキャリア濃度により決まる。埋込み層をアンドー
プ。
あるいは意図的に不純物を導入して高抵抗化を行ったと
ころ、寄生容量は1pF程度に低減できた。
ころ、寄生容量は1pF程度に低減できた。
さらには、埋込み層を通り流れるリーク電流も1mA以
下に押さえることができた結果高出力動作も可能となり
、緩和振動周波数の増大も可能となった。また、ストラ
イプ外部の埋めこみ層と電極の間にS x Ox、 S
i Nx膜等の絶縁膜を設けてストライプ内外の絶縁
を行うことにより、寄生容量の低減効果は、さらに顕著
となる。以上の構成により、20〜30GHzの変調帯
域を有する半導体レーザを可能ならしめた。
下に押さえることができた結果高出力動作も可能となり
、緩和振動周波数の増大も可能となった。また、ストラ
イプ外部の埋めこみ層と電極の間にS x Ox、 S
i Nx膜等の絶縁膜を設けてストライプ内外の絶縁
を行うことにより、寄生容量の低減効果は、さらに顕著
となる。以上の構成により、20〜30GHzの変調帯
域を有する半導体レーザを可能ならしめた。
以下、本発明の詳細な説明する。
実施例1
第1図は本発明の実施例の断面図である。n型InP基
板1の表面に、n型InGaAsP光ガイド層2、アン
ドープInGaAsP活性層3yP型InGaAsPバ
ツフアー層4tP型InPクラッド層5を順次液相成長
法により形成した後1幅1μm程度の活性層3を残した
メサストライプ13を形成する。
板1の表面に、n型InGaAsP光ガイド層2、アン
ドープInGaAsP活性層3yP型InGaAsPバ
ツフアー層4tP型InPクラッド層5を順次液相成長
法により形成した後1幅1μm程度の活性層3を残した
メサストライプ13を形成する。
その後、メサストライプ13の両側にp型In、P埋込
み層6.n型InP埋込み層7を液相成長法により成長
させて電流ブロック層を形成し、続いて全面にp型In
Pクラッド層ayP型InGaAsPキャップ層9を液
相成長法により形成する0次に。
み層6.n型InP埋込み層7を液相成長法により成長
させて電流ブロック層を形成し、続いて全面にp型In
Pクラッド層ayP型InGaAsPキャップ層9を液
相成長法により形成する0次に。
上面および下面にそれぞれp側電極10(Au/Cr)
およびn側電極11 (A u /AuGeN1)を蒸
着法により形成した6次に、臭素、塩素などのハロゲン
系ガスを用いた反応性イオンエツチング法あるいは反応
性イオンビームエツチング法に′より、活性層の両側近
傍に、側面が活性層に対し、はぼ垂直な溝14を形成し
た。エツチングのマスクには、5iOzもしくはホトレ
ジストを使用した。
およびn側電極11 (A u /AuGeN1)を蒸
着法により形成した6次に、臭素、塩素などのハロゲン
系ガスを用いた反応性イオンエツチング法あるいは反応
性イオンビームエツチング法に′より、活性層の両側近
傍に、側面が活性層に対し、はぼ垂直な溝14を形成し
た。エツチングのマスクには、5iOzもしくはホトレ
ジストを使用した。
このように溝14を活性層3近傍に形成することにより
、寄生容量を10〜40PFから1〜39Fに低減する
ことができた。直列抵抗は5Ωであり、変調帯域20G
Hz (−3dBバンド幅)を得た。
、寄生容量を10〜40PFから1〜39Fに低減する
ことができた。直列抵抗は5Ωであり、変調帯域20G
Hz (−3dBバンド幅)を得た。
実施例2
第2図は本発明の実施例2の断面図である。実施例2は
、基板1に達する深さを有する溝14を設けた点に特徴
がある0本実施例では、寄生容量を10〜40pFから
1〜3pFに低減でき、変調帯域20GHz (−3d
Bバンド幅)を得た。
、基板1に達する深さを有する溝14を設けた点に特徴
がある0本実施例では、寄生容量を10〜40pFから
1〜3pFに低減でき、変調帯域20GHz (−3d
Bバンド幅)を得た。
実施例3
第3図は本発明の実施例3の断面図である。実施例3は
、基板に達する深さを有する溝14を活性層3近傍に設
けた後、酸素およびリン気流の下で、200〜400℃
で熱処理することにより、溝14表面を基板結晶材料の
酸化物被膜12で覆ったことを特徴としている。本実施
例では、寄生容量は、1〜3pFと低く、変調帯域20
G Hz(−3dBバンド幅)を得ることが出来た。
、基板に達する深さを有する溝14を活性層3近傍に設
けた後、酸素およびリン気流の下で、200〜400℃
で熱処理することにより、溝14表面を基板結晶材料の
酸化物被膜12で覆ったことを特徴としている。本実施
例では、寄生容量は、1〜3pFと低く、変調帯域20
G Hz(−3dBバンド幅)を得ることが出来た。
溝14の表面を、基板結晶材料と同種の元素を少なくと
も1種類含んだ酸化物で覆うことにより1表面の安定化
がなされた。この結果、温度50℃光出力10mW時間
1000hrの加速寿命試験を行なった後も変調帯域の
劣化は生じなかった。
も1種類含んだ酸化物で覆うことにより1表面の安定化
がなされた。この結果、温度50℃光出力10mW時間
1000hrの加速寿命試験を行なった後も変調帯域の
劣化は生じなかった。
上記実施例1〜3では、溝表面を高温・酸素およびリン
気流下で酸化することにより、酸化被膜を得たが、CV
D法もしくは光CVD法により溝表面に酸化被膜を形成
しても、同様に寿命信頼性を向上させることができた。
気流下で酸化することにより、酸化被膜を得たが、CV
D法もしくは光CVD法により溝表面に酸化被膜を形成
しても、同様に寿命信頼性を向上させることができた。
実施例4
第4図は本発明の実施例4の断面図である。n型InP
基板101上にn型InPバッファ層102 、 In
GaAsP活性層(厚さ0.1−0.4um)103t
p型InP層104.p型InGaAsP保護層10
5を順次成長する。その後、幅1μm程度の幅の活性層
103を残したメサストライプ113を形成する。この
時、突出したメサストライプ113の機械的保護のため
に、ストライプから両側に10μm以上離れた領域では
エツチングを行なわず、成長層を残しておく、この後、
MOCVD法により、アンドープInP層106を0.
3μm成長した。MOCVD法の非平衡な成長メカニズ
ムを有する成長法は、メサストライプ113の形状をほ
ぼ保存しながら膜成長するので活性層の両側にも0.3
μmのアンドープInP層106が成長する。この後、
SiOx膜7を4000人堆積して、ストライプ113
外部の電気絶縁を行ない、メサストライプ113上部の
S i Ox膜107を除去し、これをマスクにしてメ
サ上部の埋込みInP層106を除去し、Zn拡散領域
108を設けた。この後、p側電極109.n側電極1
10を形成したのち、へき開法により共振器長200μ
mの半導体レーザ装置を得た。
基板101上にn型InPバッファ層102 、 In
GaAsP活性層(厚さ0.1−0.4um)103t
p型InP層104.p型InGaAsP保護層10
5を順次成長する。その後、幅1μm程度の幅の活性層
103を残したメサストライプ113を形成する。この
時、突出したメサストライプ113の機械的保護のため
に、ストライプから両側に10μm以上離れた領域では
エツチングを行なわず、成長層を残しておく、この後、
MOCVD法により、アンドープInP層106を0.
3μm成長した。MOCVD法の非平衡な成長メカニズ
ムを有する成長法は、メサストライプ113の形状をほ
ぼ保存しながら膜成長するので活性層の両側にも0.3
μmのアンドープInP層106が成長する。この後、
SiOx膜7を4000人堆積して、ストライプ113
外部の電気絶縁を行ない、メサストライプ113上部の
S i Ox膜107を除去し、これをマスクにしてメ
サ上部の埋込みInP層106を除去し、Zn拡散領域
108を設けた。この後、p側電極109.n側電極1
10を形成したのち、へき開法により共振器長200μ
mの半導体レーザ装置を得た。
、 試作した素子は波長1.3μmにおいてしきい°
電流10mAで発振した。室温における光出力10mW
時における小信号周波数特性の測定結果を第7図中の一
点鎖線で示す、緩和振動に伴う共振状ピークが15 G
Hz付近に現われ、3dB低下周波数は20 G H
zまで達した。また素子の寄生インピーダンスによるロ
ールオフ3dB低下周波数は約16GHzであり、測定
により得られた寄生容量C=1.5pF 、直列抵抗R
=60から求まるf=(2πCR)−”の17GH2と
ほぼ一致した。またアンドープInP層106を通って
流れるリーク電流は約2mAであり、重大な問題は生じ
なかった0以上のように、MOCVD法により形成され
た薄膜InPによる埋込み型半導体レーザは、寄生容量
が大幅に低減でき、秀れた高周波特性を実現できた。
電流10mAで発振した。室温における光出力10mW
時における小信号周波数特性の測定結果を第7図中の一
点鎖線で示す、緩和振動に伴う共振状ピークが15 G
Hz付近に現われ、3dB低下周波数は20 G H
zまで達した。また素子の寄生インピーダンスによるロ
ールオフ3dB低下周波数は約16GHzであり、測定
により得られた寄生容量C=1.5pF 、直列抵抗R
=60から求まるf=(2πCR)−”の17GH2と
ほぼ一致した。またアンドープInP層106を通って
流れるリーク電流は約2mAであり、重大な問題は生じ
なかった0以上のように、MOCVD法により形成され
た薄膜InPによる埋込み型半導体レーザは、寄生容量
が大幅に低減でき、秀れた高周波特性を実現できた。
実施例5
第5図は本発明の実施例5の断面図である。本実施例の
構成及び製作方法は実施例4とほぼ同様であるが異なる
点は次の2点である。まず、活性層が厚さ10nmのI
no、saG ao*4tPウェル層と厚さ10nm
のInPバリア層を各々1層層ずつ交互に積層した多重
量子井戸活性層111となっている。さらに、メサスト
ライプ113形成後の埋込み層112形成をハライド系
VPE法により行い、0.5μm厚さのFeドープIn
P層を形成したことである。この埋込み時には、メサス
トライプ113形成用のSi0gマスクを残しておいた
ために、メサストライプ113上部には埋込み層112
は成長していない。
構成及び製作方法は実施例4とほぼ同様であるが異なる
点は次の2点である。まず、活性層が厚さ10nmのI
no、saG ao*4tPウェル層と厚さ10nm
のInPバリア層を各々1層層ずつ交互に積層した多重
量子井戸活性層111となっている。さらに、メサスト
ライプ113形成後の埋込み層112形成をハライド系
VPE法により行い、0.5μm厚さのFeドープIn
P層を形成したことである。この埋込み時には、メサス
トライプ113形成用のSi0gマスクを残しておいた
ために、メサストライプ113上部には埋込み層112
は成長していない。
本実施例においては、波長1.5μmにおいて、しきい
電流5 m Aで発振した。実施例4に比べてしきい電
流が低減した理由は2点であり、まず、第1点は多重量
子井戸活性層の量子サイズ効果により、低キヤリア密度
で発振可能となった。第2点は埋込み層112にFeド
ープInP層を用いたために高抵抗(ρ>106Ωc1
1)化したため、リーク電流が押さえられた(<0.1
mA)ためである。本素子の室温における光出力9mW
時の小信号周波数特性を第7図中の実線で示す。まず、
量子サイズ効果により、緩和振動周波数は25GHzま
で増大した。また、埋込み層が高抵抗化できたため、そ
の寄生容量はIpF程度に低減し、寄生インピーダンス
によるロールオフ3dB低下周波数は25 G Hzま
で達した。
電流5 m Aで発振した。実施例4に比べてしきい電
流が低減した理由は2点であり、まず、第1点は多重量
子井戸活性層の量子サイズ効果により、低キヤリア密度
で発振可能となった。第2点は埋込み層112にFeド
ープInP層を用いたために高抵抗(ρ>106Ωc1
1)化したため、リーク電流が押さえられた(<0.1
mA)ためである。本素子の室温における光出力9mW
時の小信号周波数特性を第7図中の実線で示す。まず、
量子サイズ効果により、緩和振動周波数は25GHzま
で増大した。また、埋込み層が高抵抗化できたため、そ
の寄生容量はIpF程度に低減し、寄生インピーダンス
によるロールオフ3dB低下周波数は25 G Hzま
で達した。
実施例6
第6図は本発明をGaA Q As系半導体レーザに適
用した場合の実施例6の断面図である。n型GaAs基
板121上にn型GaA (l Asクラッド層122
゜厚さ7層mのGaAsウェルとI X 10 ”am
−’のpドーピングを行った厚さ7層mのGao、aA
’n o、zAsバリヤを交互にそれぞれ5層ずつ積
層した変調ドープMQW活性層123.p型GaA Q
Asクラッド層124.p型G a A sキャップ
層125を順次。
用した場合の実施例6の断面図である。n型GaAs基
板121上にn型GaA (l Asクラッド層122
゜厚さ7層mのGaAsウェルとI X 10 ”am
−’のpドーピングを行った厚さ7層mのGao、aA
’n o、zAsバリヤを交互にそれぞれ5層ずつ積
層した変調ドープMQW活性層123.p型GaA Q
Asクラッド層124.p型G a A sキャップ
層125を順次。
MOCVD法あるいはMBE法により成長する。
本実施例では特に緩和振動周波数を増大するために、活
性層に変調ドープMQWを導入した。、この後、実施例
4と同様のメサストライプ113を形成し、MOCVD
法により、アンドープである高抵抗GaA n As層
126を0.3 μm成長する。この後、5ift層1
27を3000人堆積し、その上にポリイミド膜128
を塗布し、表面を平坦化する。その後、メサストライプ
113上部の5ins膜127とポリイミド膜128を
除去して、これをマスクにして、GaA Q As埋込
み層126をエツチングにより除去し、p側電極129
.n側電極130を形成する。素子はへき間長150μ
mとした。
性層に変調ドープMQWを導入した。、この後、実施例
4と同様のメサストライプ113を形成し、MOCVD
法により、アンドープである高抵抗GaA n As層
126を0.3 μm成長する。この後、5ift層1
27を3000人堆積し、その上にポリイミド膜128
を塗布し、表面を平坦化する。その後、メサストライプ
113上部の5ins膜127とポリイミド膜128を
除去して、これをマスクにして、GaA Q As埋込
み層126をエツチングにより除去し、p側電極129
.n側電極130を形成する。素子はへき間長150μ
mとした。
′試作した素子は波長830nmにおいて、しきい電流
4mAで発振した。光出力13mWにおける緩和振動周
波数は、変WRpドープの効果により、30 G Hz
を超え、測定不能であった。また、素子の寄生容量は約
1.5pF 、直列抵抗は4Ωで、これらの寄生インピ
ーダンスによるロールオフ3dB低下周波数は約22
G Hzであった。
4mAで発振した。光出力13mWにおける緩和振動周
波数は、変WRpドープの効果により、30 G Hz
を超え、測定不能であった。また、素子の寄生容量は約
1.5pF 、直列抵抗は4Ωで、これらの寄生インピ
ーダンスによるロールオフ3dB低下周波数は約22
G Hzであった。
また、上記実施例4〜6において、ストライプ外部の絶
縁は5ins膜のみを示したが、他の絶縁膜(SiNつ
膜)を用いても、はぼ同様の効果が得られた。
縁は5ins膜のみを示したが、他の絶縁膜(SiNつ
膜)を用いても、はぼ同様の効果が得られた。
以上のように本発明による薄膜の埋込み層を有する半導
体レーザは高速変調特性に秀れ、しかもリーク電流を低
減できることがわかった。また。
体レーザは高速変調特性に秀れ、しかもリーク電流を低
減できることがわかった。また。
本発明は、グレーティングのブラッグ反射を用いたDF
BあるいはDBRレーザに対しても適用できることは言
うまでもない。
BあるいはDBRレーザに対しても適用できることは言
うまでもない。
また、上記各実施例1〜6において導電型を反対にした
構造(pをnに、nをpに)においてもほぼ同様の効果
が得られた。
構造(pをnに、nをpに)においてもほぼ同様の効果
が得られた。
また、本発明はその技術的手段から判断して、室温連続
発振ができる全範囲の半導体レーザの構成に対して適用
できることは当業者が容易に理解し得るところである。
発振ができる全範囲の半導体レーザの構成に対して適用
できることは当業者が容易に理解し得るところである。
本発明によれば、ストライプ外部の埋込み層の幅を制御
良く簡便に1.0μm以下特には0.5μm程度にでき
、寄生容量を大幅に低減できるので、従来の半導体レー
ザに比べてはるかに秀れた20G Hz以上の超高速変
調可能で、寿命信頼性の高い半導体レーザを作製するこ
とができる。
良く簡便に1.0μm以下特には0.5μm程度にでき
、寄生容量を大幅に低減できるので、従来の半導体レー
ザに比べてはるかに秀れた20G Hz以上の超高速変
調可能で、寿命信頼性の高い半導体レーザを作製するこ
とができる。
第1図、第2図、第3図、第4図、第5図および第6図
は各々本発明の実施例1.実施例2.実施例3.実施例
4.実施例5および実施例6の半導体レーザ装置の断面
図である。第7図は本発明の実施例4および実施例5の
半導体レーザ装置の高速変調特性の測定結果を示す図で
ある。 1−n型InP基板、2− n型InGaAsP光ガイ
ド層、3・・・アンドープInGaAsP活性層、4・
・・p型InGaAsPバアファー層、5・・・p型I
nPクラッド層、6・・・p型1.nP埋込み層、7・
・・n型InP埋込み層、8・・・p型InPクラッド
層、9・・・p型InGaAsPキャップ層、10−
p側電極、11− n側電極、12・・・酸化被膜、1
3・・・メサストライプ、14−・・溝、103−In
GaAsP活性層、106−・・MoCVD法によるア
ンドープInP層、107゜127−8 i Ox膜、
109”’P電極、111 ・・・多重量子井戸活性層
、112・・・FeドープInP層、113・・・メサ
ストライプ、123・・・変調ドープMQW層、126
−MoCVDによる高抵抗第1図 第2図 ′$41¥1 第5図 118メ1八r74ノ 周仮牧 (G)(z) 128不′リイミトliI喪
は各々本発明の実施例1.実施例2.実施例3.実施例
4.実施例5および実施例6の半導体レーザ装置の断面
図である。第7図は本発明の実施例4および実施例5の
半導体レーザ装置の高速変調特性の測定結果を示す図で
ある。 1−n型InP基板、2− n型InGaAsP光ガイ
ド層、3・・・アンドープInGaAsP活性層、4・
・・p型InGaAsPバアファー層、5・・・p型I
nPクラッド層、6・・・p型1.nP埋込み層、7・
・・n型InP埋込み層、8・・・p型InPクラッド
層、9・・・p型InGaAsPキャップ層、10−
p側電極、11− n側電極、12・・・酸化被膜、1
3・・・メサストライプ、14−・・溝、103−In
GaAsP活性層、106−・・MoCVD法によるア
ンドープInP層、107゜127−8 i Ox膜、
109”’P電極、111 ・・・多重量子井戸活性層
、112・・・FeドープInP層、113・・・メサ
ストライプ、123・・・変調ドープMQW層、126
−MoCVDによる高抵抗第1図 第2図 ′$41¥1 第5図 118メ1八r74ノ 周仮牧 (G)(z) 128不′リイミトliI喪
Claims (1)
- 【特許請求の範囲】 1、埋込み型半導体レーザにおいて、埋込み層はメサス
トライプの両側に埋込んだ活性層より屈折率の小さい半
導体結晶層中に設けた溝により形状が規定されているこ
とを特徴とする埋込み型半導体レーザ。 2、上記溝は、基板に達する深さを有する特許請求の範
囲第1項記載の埋込み型半導体レーザ。 3、上記溝の表面を基板結晶材料と同様の元素を少なく
とも1種類含んだ酸化物によつて被つた特許請求の範囲
第1項または第2項記載の埋込み型半導体レーザ。 4、埋込み型半導体レーザにおいて、埋込み層はメサス
トライプに被着形成した膜厚3μm以下の活性層より屈
折率の小さい半導体薄膜であることを特徴とする埋込み
型半導体レーザ。 5、上記埋込み層は、MOCVD法、MBE法、ハライ
ド系VPE法、クロライド系VPE法、光CVD法のい
ずれかの成長法により形成した特許請求の範囲第1項記
載の埋込み型半導体レーザ。 6、上記埋込み層は、アンドープもしくはFe、Cr、
O等の不純物を導入して高抵抗化し、半絶縁化したもの
である特許請求の範囲第4項記載の埋込み型半導体レー
ザ。 7、上記埋込み層は、GaAlAs系半導体レーザでは
GaAlAs、InP/InGaAsP系半導体レーザ
ではInPである特許請求の範囲第4項記載の埋込み型
半導体レーザ。 8、上記活性層は、電子のドウ・ブロイ波長以下の厚さ
のウェル層と、該ウェル層よりも禁制帯幅の大きいバリ
ア層とを交互に重ね合わせた多重量子井戸活性層である
特許請求の範囲第4項記載の埋込み型半導体レーザ。 9、上記埋込みメサストライプの上部以外の領域の上記
埋込み層上にSiO_2あるいはSiN_x膜等の絶縁
膜を堆積した特許請求の範囲第4項記載の埋込み型半導
体レーザ。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP27012887A JPH01114092A (ja) | 1987-10-28 | 1987-10-28 | 埋込み型半導体レーザ |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP27012887A JPH01114092A (ja) | 1987-10-28 | 1987-10-28 | 埋込み型半導体レーザ |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH01114092A true JPH01114092A (ja) | 1989-05-02 |
Family
ID=17481942
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP27012887A Pending JPH01114092A (ja) | 1987-10-28 | 1987-10-28 | 埋込み型半導体レーザ |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH01114092A (ja) |
Cited By (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO1992005576A1 (en) * | 1990-09-14 | 1992-04-02 | Gte Laboratories Incorporated | New structure and method for fabricating indium phosphide/indium gallium arsenide phosphide buried heterostructure semiconductor lasers |
JPH0685405A (ja) * | 1992-01-24 | 1994-03-25 | American Teleph & Telegr Co <Att> | 埋込みヘテロ構造レーザ |
JP2008000694A (ja) * | 2006-06-22 | 2008-01-10 | Chugoku Electric Power Co Inc:The | 清掃装置 |
JP2008227287A (ja) * | 2007-03-14 | 2008-09-25 | Sumitomo Electric Ind Ltd | 半導体光素子の製造方法 |
JP2011077221A (ja) * | 2009-09-30 | 2011-04-14 | Oki Electric Industry Co Ltd | 半導体レーザ及びその高周波特性測定方法 |
JP2013214762A (ja) * | 2008-09-19 | 2013-10-17 | Fujitsu Ltd | 光導波路 |
JP2016213323A (ja) * | 2015-05-08 | 2016-12-15 | 三菱電機株式会社 | 半導体装置の製造方法、半導体装置 |
Citations (4)
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JPS61194889A (ja) * | 1985-02-25 | 1986-08-29 | Sumitomo Electric Ind Ltd | 半導体レ−ザ |
JPS6218782A (ja) * | 1985-07-18 | 1987-01-27 | Kokusai Denshin Denwa Co Ltd <Kdd> | 埋込み構造半導体レ−ザ |
JPS6425494A (en) * | 1987-07-21 | 1989-01-27 | Mitsubishi Electric Corp | Semiconductor laser device and manufacture thereof |
-
1987
- 1987-10-28 JP JP27012887A patent/JPH01114092A/ja active Pending
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JP2008227287A (ja) * | 2007-03-14 | 2008-09-25 | Sumitomo Electric Ind Ltd | 半導体光素子の製造方法 |
JP2013214762A (ja) * | 2008-09-19 | 2013-10-17 | Fujitsu Ltd | 光導波路 |
JP2011077221A (ja) * | 2009-09-30 | 2011-04-14 | Oki Electric Industry Co Ltd | 半導体レーザ及びその高周波特性測定方法 |
JP2016213323A (ja) * | 2015-05-08 | 2016-12-15 | 三菱電機株式会社 | 半導体装置の製造方法、半導体装置 |
US10116121B2 (en) | 2015-05-08 | 2018-10-30 | Mitsubishi Electric Corporation | Semiconductor device manufacturing method and semiconductor device |
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