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Description
本開示の実施の形態の説明に先立ち、本開示の基礎となった知見について説明する。
[1-1.表示装置の構成]
本実施の形態に係る表示装置の構成について、図1~図3を参照しながら説明する。図1は、本実施の形態に係る表示装置1の機能的な構成の一例を示すブロック図である。図2は、図1の破線領域Rを拡大して示す図である。
上述したような表示装置1を用いて、有機EL素子111の第1電極の電位を初期化する初期化動作を行う場合に、輝度ムラが発生することについて図面を参照しながら説明する。図4は、比較例に係る表示部11aにおいて生じる輝度ムラの一例を示す概略図である。図4において、ドットハッチングの密度は、表示部11aが表示する画像の明るさを示す。ドットハッチングの密度が低いほど、画像が明るいことを意味する。なお、比較例に係る表示装置の構成は、表示装置1と同様であり、セレクタ回路を有する。
そこで、本実施の形態に係る表示装置1は、上述したような輝度ムラを低減することを目的とする。図10は、本実施の形態に係る画素110の駆動タイミングの一例を示す図である。なお、図10に示す時点T40から時点T43までの動作については、図5に示す時点T0から時点T3までのそれぞれと同様であり説明を省略する。
以上のように、本実施の形態に係る表示装置1は、行列状に配置された複数の画素110と、複数の画素110における互いに異なる第1画素行及び第2画素行を含む画素行ごとに配置され、画像データに対応したデータ電圧を書き込む画素行を選択するための複数の書込み信号線WS(ゲート信号線の一例)と、複数の書込み信号線WSにゲート信号を供給するゲートドライバ12と、複数の画素110における画素列ごとに配置され、画像データに対応したデータ電圧を書き込むための複数のデータ信号線SIGと、複数のデータ信号線SIGにデータ電圧を供給するデータドライバ13と、複数のデータ信号線SIGのうち1以上のデータ信号線SIGごとに時分割でデータドライバ13からのデータ電圧を供給するデータセレクタ回路120と、ゲートドライバ12及びデータドライバ13を制御する制御部20とを備える。複数の画素110の各々は、第1電極及び第2電極を有する有機EL素子111(発光素子の一例)と、電圧を保持するための容量素子112と、有機EL素子111の第1電極と接続され、容量素子112に保持された電圧に応じた電流を有機EL素子111に供給する駆動トランジスタTDとを有する。そして、制御部20は、第1画素行の画素110にデータ電圧を書き込む書き込み動作を行う期間の後に、第2画素行の画素110の有機EL素子111の第1電極の電位を初期化する初期化動作を行うように、ゲートドライバ12及びデータドライバ13を制御する。
以下、本実施の形態に係る表示装置について、図面を参照しながら説明する。本実施の形態に係る表示装置は、初期化動作が行われる画素110において、参照トランジスタTREFがオンされるタイミングに特徴を有する。
図11は、本実施の形態に係る画素110の駆動タイミングの一例を示す図である。図11に示す「REFx」は、書込み信号線WS1に接続された画素110(例えば、画素110a1)において書き込み動作が行われているときに、初期化動作が行われる画素110(例えば、画素110ax)の参照信号線REFに供給される信号の波形を示している。また、図11に示す「REFx+1」は、書込み信号線WS2に接続された画素110(例えば、画素110a2)において書き込み動作が行われているときに、初期化動作が行われる画素110(例えば、画素110ax+1)の参照信号線REFに供給される信号の波形を示している。
以上のように、本実施の形態に係る表示装置1は、行列状に配置された複数の画素110と、複数の画素110における互いに異なる第1画素行及び第2画素行を含む画素行ごとに配置され、画像データに対応したデータ電圧を書き込む画素行を選択するための複数の書込み信号線WS(ゲート信号線の一例)と、複数の書込み信号線WSにゲート信号を供給するゲートドライバ12と、複数の画素110における画素列ごとに配置され、画像データに対応したデータ電圧を書き込むための複数のデータ信号線SIGと、複数のデータ信号線SIGにデータ電圧を供給するデータドライバ13と、複数のデータ信号線SIGのうち1以上のデータ信号線SIGごとに時分割でデータドライバ13からのデータ電圧を供給するデータセレクタ回路120と、ゲートドライバ12及びデータドライバ13を制御する制御部20とを備える。複数の画素110の各々は、第1電極及び第2電極を有する有機EL素子111(発光素子の一例)と、電圧を保持するための容量素子112と、有機EL素子111の第1電極と接続され、容量素子112に保持された電圧に応じた電流を有機EL素子に供給する駆動トランジスタTDと、参照電圧が印加される参照電源線VREFと、参照電源線VREFと駆動トランジスタTDのゲート電極gとの間に接続される参照トランジスタTREFと、当該画素110に接続されたデータ信号線SIGと駆動トランジスタTDのゲート電極gとの間に接続される書込みトランジスタTWSとを有する。そして、制御部20は、第1画素行の画素110にデータ電圧を書き込む書き込み動作を行う第1期間に、第2画素行の画素110の有機EL素子111の第1電極の電位を初期化する初期化動作を行い、かつ、初期化動作の開始時点には参照トランジスタTREFがオンしているように、ゲートドライバ12及びデータドライバ13を制御する。
以上、本開示に係る表示装置について、実施の形態に基づいて説明してきたが、本開示に係る表示装置は、上記実施の形態に限定されるものではない。実施の形態における任意の構成要素を組み合わせて実現される別の実施の形態や、実施の形態に対して本開示の主旨を逸脱しない範囲で当業者が思いつく各種変形を施して得られる変形例や、本実施の形態に係る表示装置を内蔵した各種機器も本開示に含まれる。
10 表示パネル
11、11a 表示部
11a1、11a2、11a3 領域
12 ゲートドライバ
13 データドライバ
20 制御部
30 電源
110、110a1、110a2、110ax、100ax+1、110b1、110b2、100bx、100bx+1 画素
111 有機EL素子(発光素子)
112 容量素子
120 データセレクタ回路
200 薄型ディスプレイ装置
d ドレイン電極
g ゲート電極
INI、INIx、INIx+1 初期化信号線
s ソース電極
SEL セレクタ制御線
SEL1 第1セレクタ制御線
SEL2 第2セレクタ制御線
SIG データ信号線
SIG1 第1信号線
SIG2 第2信号線
SIG3 第3信号線
REF 参照信号線
R1a~R1g、R2a~R2c、R2e~R2g 行
TD 駆動トランジスタ
TINI 初期化トランジスタ
TS1、TS2 選択トランジスタ
TREF 参照トランジスタ
TWS 書込みトランジスタ
VCATH カソード電源線
VCC アノード電源線
VINI 初期化電源線
VREF 参照電源線
WS、WS1、WS2、WSx、WSx+1 書込み信号線(ゲート信号線)
Claims (8)
- 行列状に配置された複数の画素と、
前記複数の画素における互いに異なる第1画素行及び第2画素行を含む画素行ごとに配置され、画像データに対応したデータ電圧を書き込む画素行を選択するための複数のゲート信号線と、
前記複数のゲート信号線にゲート信号を供給するゲートドライバと、
前記複数の画素における画素列ごとに配置され、画像データに対応したデータ電圧を書き込むための複数のデータ信号線と、
前記複数のデータ信号線に前記データ電圧を供給するデータドライバと、
前記複数のデータ信号線のうち1以上のデータ信号線ごとに時分割で前記データドライバからの前記データ電圧を供給するデータセレクタ回路と、
前記ゲートドライバ及び前記データドライバを制御する制御部とを備え、
前記複数の画素の各々は、
第1電極及び第2電極を有する発光素子と、
電圧を保持するための容量素子と、
前記発光素子の第1電極と接続され、前記容量素子に保持された電圧に応じた電流を前記発光素子に供給する駆動トランジスタとを有し、
前記容量素子は、前記第1電極と前記駆動トランジスタのゲート電極との間に接続され、
前記制御部は、前記第1画素行の画素に前記データ電圧を書き込む書き込み動作を行う期間の後に、前記第2画素行の画素の前記発光素子の前記第1電極の電位を初期化する初期化動作を行うように、前記ゲートドライバ及び前記データドライバを制御し、
前記第1画素行の書き込み動作は、前記複数のデータ信号線のそれぞれに当該データ信号線に応じた前記データ電圧が供給された後、かつ、前記データセレクタ回路が前記複数のデータ信号線と前記データドライバとを非導通とするオフ状態に切り替わった後で行われ、
前記第2画素行の前記初期化動作は、前記第1画素行における前記期間の後であって、かつ、前記データセレクタ回路が前記オフ状態を維持する際に行われる
表示装置。 - 前記複数の画素の各々は、データ信号線と前記駆動トランジスタの前記ゲート電極との間に接続される書込みトランジスタを有し、
前記複数の画素は、前記第1画素行及び前記第2画素行と異なる第3画素行であって、前記第1画素行の書き込み動作の後に書き込み動作が行われる第3画素行を有し、
前記制御部は、前記第2画素行における前記初期化動作において、当該第2画素行の画素の前記書込みトランジスタがオンした後、前記第3画素行における前記書き込み動作の開始前に前記第2画素行の前記書込みトランジスタがオフするタイミングで前記第2画素行における前記初期化動作を開始するように、前記ゲートドライバ及び前記データドライバを制御する
請求項1に記載の表示装置。 - 前記制御部は、前記第1画素行における前記書き込み動作を行う前記期間の直後に、前記第2画素行における前記初期化動作を開始させるように、前記ゲートドライバ及び前記データドライバを制御する
請求項1に記載の表示装置。 - 行列状に配置された複数の画素と、
前記複数の画素における互いに異なる第1画素行及び第2画素行を含む画素行ごとに配置され、画像データに対応したデータ電圧を書き込む画素行を選択するための複数のゲート信号線と、
前記複数のゲート信号線にゲート信号を供給するゲートドライバと、
前記複数の画素における画素列ごとに配置され、画像データに対応したデータ電圧を書き込むための複数のデータ信号線と、
前記複数のデータ信号線に前記データ電圧を供給するデータドライバと、
前記複数のデータ信号線のうち1以上のデータ信号線ごとに時分割で前記データドライバからの前記データ電圧を供給するデータセレクタ回路と、
前記ゲートドライバ及び前記データドライバを制御する制御部とを備え、
前記複数の画素の各々は、
第1電極及び第2電極を有する発光素子と、
電圧を保持するための容量素子と、
前記発光素子の第1電極と接続され、前記容量素子に保持された電圧に応じた電流を前記発光素子に供給する駆動トランジスタと、
前記データ信号線と前記駆動トランジスタのゲート電極との間に接続される書込みトランジスタと、
参照電圧が印加される参照電源線と、
前記参照電源線と、前記書込みトランジスタ及び前記駆動トランジスタのゲート電極の間とに接続される参照トランジスタとを有し、
前記容量素子は、前記第1電極と前記駆動トランジスタの前記ゲート電極との間に接続され、
前記制御部は、前記第1画素行の画素に前記データ電圧を書き込む書き込み動作を行う第1期間に、前記第2画素行の画素の前記発光素子の前記第1電極の電位を初期化する初期化動作を行い、かつ、前記初期化動作の開始時点には前記参照トランジスタがオンしているように、前記ゲートドライバ及び前記データドライバを制御し、
前記第1画素行の書き込み動作は、前記複数のデータ信号線のそれぞれに当該データ信号線に応じた前記データ電圧が供給された後、かつ、前記データセレクタ回路が前記複数のデータ信号線と前記データドライバとを非導通とするオフ状態に切り替わった後で行われる
表示装置。 - 前記制御部は、前記第1期間の終了時点に前記第2画素行の画素の前記参照トランジスタをオフするように、前記ゲートドライバ及び前記データドライバを制御する
請求項4に記載の表示装置。 - 前記制御部は、前記第1電極の電位が初期化電位になる時点に前記参照トランジスタをオフするように、前記ゲートドライバ及び前記データドライバを制御する
請求項4に記載の表示装置。 - 前記制御部は、前記第1期間の終了時点である第1時点、及び、前記第1電極の電位が初期化電位になる第2時点のうち、早い方の時点において、前記参照トランジスタをオフするように、前記ゲートドライバ及び前記データドライバを制御する
請求項4に記載の表示装置。 - 前記発光素子は、有機EL素子である
請求項1~7のいずれか1項に記載の表示装置。
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