JP7080113B2 - 薄膜製造方法、スパッタリング装置 - Google Patents
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Description
また、本発明は、前記停止時間の経過によって前記停止状態から前記スパッタ状態に移行した後に、前記異常端子とは異なる出力端子を前記低電位側直流電圧端子に接続する前に、前記異常端子が前記低電位側直流電圧端子に接続する薄膜製造方法である。
また、本発明は、前記停止時間の経過によって前記停止状態から前記スパッタ状態に移行した後に、前記異常端子を前記低電位側直流電圧端子に接続する前に、前記異常端子とは異なる出力端子を前記低電位側直流電圧端子に接続する薄膜製造方法である。
また、本発明は、前記停止状態に移行された後前記停止時間が経過する前に、前記異常端子とは異なる出力端子が前記低電位側直流電圧端子に接続される薄膜製造方法である。
また、本発明は、前記停止時間が経過する前に、前記測定値を測定して前記測定値によってスパッタリングを異常と判断すると、前記異常端子とは異なる出力端子を接地電位に接続する薄膜製造方法である。
また、本発明は、真空槽と、前記真空槽内に配置され、スパッタ電源のA相側出力端子に接続されたA相カソード電極と、B相側出力端子に接続されたB相カソード電極と、前記A相カソード電極に配置されたA相ターゲットと、前記B相カソード電極に配置されたB相ターゲットとを有し、前記スパッタ電源は、低電位側直流電圧端子から直流のスパッタ電圧を出力する直流電圧源と、前記A相側出力端子と前記B相側出力端子のうちの少なくともいずれか一方を前記低電位側直流電圧端子に接続するように動作する主スイッチ回路と、少なくとも前記主スイッチ回路の動作を制御する制御回路と、前記主スイッチ回路に流れた電流の電流値と、前記A相側出力端子と前記B相側出力端子とのうちの少なくとも前記低電位側直流電圧端子に接続された出力端子に発生した電圧の電圧値のいずれか一方又は両方の値を測定する測定装置と、を有し、前記測定装置は、前記A相側出力端子と前記B相側出力端子とが交互に前記低電位側直流電圧端子に所定の導通時間ずつ接続されるスパッタ状態中に前記電流値又は前記電圧値のいずれか一方又は両方を測定値として測定し、前記測定値によってスパッタリングが正常と判断されると前記スパッタ状態が維持されて前記真空槽の内部に搬入された成膜対象物の表面に薄膜が成長され、異常と判断されると前記A相側出力端子と前記B相側出力端子とのうち、前記測定値が得られたときに前記低電位側直流電圧端子に接続されていた方である異常端子が接地電位に接続される停止状態に前記導通時間が経過する前に移行され、所定の停止時間が経過した後前記停止状態から前記スパッタ状態に移行されるスパッタリング装置であって、前記停止時間は前記導通時間よりも長時間に設定され、前記停止時間の経過によって前記停止状態から前記スパッタ状態に移行した後、前記異常端子が前記低電位側直流電圧端子に接続されて前記測定値が測定され、前記測定値によってスパッタリングが異常と判断された場合には、前記停止時間の時間は増加されて前記スパッタ状態から前記停止状態に移行されるスパッタリング装置である。
また、本発明は、前記停止時間の経過によって前記停止状態から前記スパッタ状態に移行された後は、前記異常端子とは異なる出力端子が前記低電位側直流電圧端子に接続される前に、前記異常端子が前記低電位側直流電圧端子に接続されるスパッタリング装置である。
また、本発明は、前記停止時間の経過によって前記停止状態から前記スパッタ状態に移行された後は、前記異常端子が前記低電位側直流電圧端子に接続される前に、前記異常端子とは異なる出力端子が前記低電位側直流電圧端子に接続されるスパッタリング装置である。
また、本発明は、前記停止状態に移行された後前記停止時間が経過する前に、前記異常端子とは異なる出力端子が前記低電位側直流電圧端子に接続されるスパッタリング装置である。
また、本発明は、前記停止時間が経過する前に、前記測定値が測定され、前記測定値によってスパッタリングが異常と判断されると、前記異常端子とは異なる出力端子は接地電位に接続されるスパッタリング装置である。
復帰時間は短時間から徐々に長くされるので、異常状態から確実に復帰することができる。
また、停止時間が繰り返された場合もプラズマを完全消滅させる前に復帰できる確率が高くなっている。
また、本発明は主スイッチ回路を利用して異常放電から復帰させる技術であるため、主スイッチ回路とは別の回路を設ける必要が無く、単純な構成で実施することができる。
10……スパッタ電源
11……直流電圧源
13a……A相カソード電極
13b……B相カソード電極
14a……A相ターゲット
14b……B相ターゲット
15a……A相側出力端子
15b……B相側出力端子
21……主スイッチ回路
24……測定装置
28L……低電位側直流電圧端子
28H……高電位側直流電圧端子
40……真空槽
Claims (4)
- 真空槽と、
前記真空槽内に配置され、スパッタ電源のA相側出力端子に接続されたA相カソード電極と、B相側出力端子に接続されたB相カソード電極と、
前記A相カソード電極に配置されたA相ターゲットと、前記B相カソード電極に配置されたB相ターゲットとを有し、
前記スパッタ電源は、
低電位側直流電圧端子から直流のスパッタ電圧を出力する直流電圧源と、
前記A相側出力端子と前記B相側出力端子のうちの少なくともいずれか一方を前記低電位側直流電圧端子に接続するように動作する主スイッチ回路と、
少なくとも前記主スイッチ回路の動作を制御する制御回路と、
前記主スイッチ回路に流れた電流の電流値と、前記A相側出力端子と前記B相側出力端子とのうちの少なくとも前記低電位側直流電圧端子に接続された出力端子に発生した電圧の電圧値のいずれか一方又は両方の値を測定する測定装置と、
を有するスパッタリング装置を用い、
前記測定装置によって、前記A相側出力端子と前記B相側出力端子とが交互に前記低電位側直流電圧端子に所定の導通時間ずつ接続されるスパッタ状態中に前記電流値又は前記電圧値のいずれか一方又は両方を測定値として測定し、
前記測定値によってスパッタリングが正常か異常かを判断し、
正常と判断すると前記スパッタ状態を維持して前記真空槽内に搬入した成膜対象物の表面に薄膜を成長させ、
異常と判断すると前記A相側出力端子と前記B相側出力端子とのうち、前記測定値が得られたときに前記低電位側直流電圧端子に接続されていた方である異常端子を接地電位に接続する停止状態に前記導通時間が経過する前に移行させ、
所定の停止時間が経過した後前記停止状態から前記スパッタ状態に移行させる薄膜製造方法であって、
前記停止時間は前記導通時間よりも長時間にしておき、
前記停止時間の経過によって前記停止状態から前記スパッタ状態に移行した後、前記異常端子が前記低電位側直流電圧端子に接続されて前記測定値を測定し、
前記測定値によってスパッタリングを異常と判断した場合には、前記停止時間の時間を増加させて前記スパッタ状態から前記停止状態に移行し、
前記停止状態に移行された後前記停止時間が経過する前に、前記異常端子とは異なる出力端子が前記低電位側直流電圧端子に接続される
薄膜製造方法。 - 前記停止時間が経過する前に、前記測定値を測定して前記測定値によってスパッタリングを異常と判断すると、前記異常端子とは異なる出力端子を接地電位に接続する請求項1記載の薄膜製造方法。
- 真空槽と、
前記真空槽内に配置され、スパッタ電源のA相側出力端子に接続されたA相カソード電極と、B相側出力端子に接続されたB相カソード電極と、
前記A相カソード電極に配置されたA相ターゲットと、前記B相カソード電極に配置されたB相ターゲットとを有し、
前記スパッタ電源は、
低電位側直流電圧端子から直流のスパッタ電圧を出力する直流電圧源と、
前記A相側出力端子と前記B相側出力端子のうちの少なくともいずれか一方を前記低電位側直流電圧端子に接続するように動作する主スイッチ回路と、
少なくとも前記主スイッチ回路の動作を制御する制御回路と、
前記主スイッチ回路に流れた電流の電流値と、前記A相側出力端子と前記B相側出力端子とのうちの少なくとも前記低電位側直流電圧端子に接続された出力端子に発生した電圧の電圧値のいずれか一方又は両方の値を測定する測定装置と、
を有し、
前記測定装置は、前記A相側出力端子と前記B相側出力端子とが交互に前記低電位側直流電圧端子に所定の導通時間ずつ接続されるスパッタ状態中に前記電流値又は前記電圧値のいずれか一方又は両方を測定値として測定し、
前記測定値によってスパッタリングが正常と判断されると前記スパッタ状態が維持されて前記真空槽の内部に搬入された成膜対象物の表面に薄膜が成長され、異常と判断されると前記A相側出力端子と前記B相側出力端子とのうち、前記測定値が得られたときに前記低電位側直流電圧端子に接続されていた方である異常端子が接地電位に接続される停止状態に前記導通時間が経過する前に移行され、
所定の停止時間が経過した後前記停止状態から前記スパッタ状態に移行されるスパッタリング装置であって、
前記停止時間は前記導通時間よりも長時間に設定され、
前記停止時間の経過によって前記停止状態から前記スパッタ状態に移行した後、前記異常端子が前記低電位側直流電圧端子に接続されて前記測定値が測定され、
前記測定値によってスパッタリングが異常と判断された場合には、前記停止時間の時間は増加されて前記スパッタ状態から前記停止状態に移行され、
前記停止状態に移行された後前記停止時間が経過する前に、前記異常端子とは異なる出力端子が前記低電位側直流電圧端子に接続される
スパッタリング装置。 - 前記停止時間が経過する前に、前記測定値が測定され、前記測定値によってスパッタリングが異常と判断されると、前記異常端子とは異なる出力端子は接地電位に接続される請求項3記載のスパッタリング装置。
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JP2018120067A JP7080113B2 (ja) | 2018-06-25 | 2018-06-25 | 薄膜製造方法、スパッタリング装置 |
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JP2020002392A JP2020002392A (ja) | 2020-01-09 |
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---|---|---|---|---|
JP2005526184A (ja) | 2002-05-17 | 2005-09-02 | アプライド、フィルム、コーパレイシャン | スパッタ・デポジション工程を制御するためのシステムおよび方法 |
JP2009284734A (ja) | 2008-05-26 | 2009-12-03 | Ulvac Japan Ltd | バイポーラパルス電源及びこのバイポーラパルス電源を複数台並列接続してなる電源装置 |
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2018
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