JP7051425B2 - 送信回路及び該送信回路の制御方法 - Google Patents
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Description
VOD_EMP=VODSEL×250μA×50Ω ・・・(1)
また、終端抵抗RTの電圧VOD[mV]は、以下の式(2)で算出される。
VOD=(VODSEL-EMPSEL×2)×250μA×50Ω ・・・(2)
EMP[%]は、以下の式(3)で算出される。
EMP=(VOD_EMP-VOD)÷VOD×100 ・・・(3)
尚、EMP[%]は、プリエンファシスの率に換算している。本発明に係る送信機100は、回路の動作としてはディエンファシスであるが、エンファシスの効果の大きさを感覚的に理解する上ではプリエンファシスの率の方が理解しやすいためである。
20 プリバッファ
30 バイアス回路
40 制御回路
100 送信機
200 受信機
OUTN及びOUTP 出力端子
N1~N3及びP1~P3 ドライバユニットのトランジスタ
RT 終端抵抗
RT1 送信側終端抵抗
RT2 受信側終端抵抗
SW1及びSW2 スイッチ
Claims (12)
- 終端抵抗に並列に接続され、前記終端抵抗に所定の電流を流すとともに前記終端抵抗に流れる電流の方向を制御し、ドライバ選択信号に従って個々にON/OFF可能に構成されている複数のドライバ回路と、
前記複数のドライバ回路の各々に接続され、制御選択信号に従って、第1の制御信号対又は前記第1の制御信号対を論理反転かつ遅延させた第2の制御信号対のいずれかを選択して前記複数のドライバ回路の各々へ出力する選択回路と、
入力信号に基づいて前記第1の制御信号対及び前記第2の制御信号対を生成して前記選択回路へ出力し、前記終端抵抗の電圧波形が所望の電圧波形になるように前記ドライバ選択信号及び前記制御選択信号を出力する制御回路と、
前記複数のドライバ回路の各々の出力電流に対して定電流制御を行う定電流制御回路と、を備え、
前記複数のドライバ回路は、前記ドライバ選択信号及び前記制御選択信号によってメインドライバ回路として動作する第1の前記ドライバ回路とエンファシスドライバ回路として動作する第2の前記ドライバ回路とを含み、
前記入力信号が連続した同じビットパターンであるタイミングの間、その2ビット目以降に前記終端抵抗の電圧波形が所望の電圧波形になるように、前記第1の制御信号対及び前記第2の制御信号対の論理に従って、前記第1のドライバ回路による前記電流の方向と前記第2のドライバ回路による前記電流の方向とが制御される、
送信回路。 - 請求項1に記載の送信回路であって、前記制御回路は、前記複数のドライバ回路のうち、一又は二以上のドライバ回路を第1のドライバ回路として選択してONするとともに、前記第1のドライバ回路以外の一又は二以上のドライバ回路を第2のドライバ回路として選択してONし、前記第1のドライバ回路及び前記第2のドライバ回路以外のドライバ回路をOFFする前記ドライバ選択信号を出力し、
前記第1のドライバ回路へ前記第1の制御信号対が出力され、前記第2のドライバ回路へ前記第2の制御信号対が出力される前記制御選択信号を出力するように構成されている、送信回路。 - 請求項1又は2に記載の送信回路であって、前記制御回路は、前記第1の制御信号対に対する前記第2の制御信号対の遅延量を調整可能に構成されている、送信回路。
- 請求項1~3のいずれか1項に記載の送信回路であって、前記制御回路は、前記第1の制御信号対を前記第2の制御信号対と異なる遅延量で遅延させた第3の制御信号対を出力し、
前記選択回路は、前記第1の制御信号対、前記第2の制御信号対又は前記第3の制御信号対のいずれかを制御選択信号に従って選択して前記複数のドライバ回路へ出力する、送信回路。 - 請求項1~4のいずれか1項に記載の送信回路であって、前記複数のドライバ回路は、全てのドライバ回路の出力電流の電流値が同一である、送信回路。
- 請求項1~4のいずれか1項に記載の送信回路であって、前記複数のドライバ回路は、出力電流が第1の電流値であるドライバ回路と、出力電流が第2の電流値であるドライバ回路とを含む、送信回路。
- 請求項1~6のいずれか1項に記載の送信回路であって、前記複数のドライバ回路の各々は、コンプリメンタリ出力の定電流差動回路であり、
前記第1の制御信号対は、前記入力信号及び前記入力信号を論理反転させた信号を含み、前記第2の制御信号対は、前記入力信号を遅延させた信号及び前記入力信号を論理反転かつ遅延させた信号を含む、送信回路。 - 請求項1に記載の送信回路であって、前記定電流制御回路は、前記複数のドライバ回路の各々の出力電流を調整可能であり、
前記定電流制御回路は、前記終端抵抗の抵抗値に応じて前記複数のドライバ回路の各々の出力電流を調整する、送信回路。 - 請求項1~8のいずれか1項に記載の送信回路であって、前記第1の制御信号対の一方と前記第2の制御信号対の一方とが異なる論理であり、前記第1の制御信号対の他方と前記第2の制御信号対の他方とが異なる論理であるとき、前記第1のドライバ回路による前記電流の方向と前記第2のドライバ回路による前記電流の方向とが相反する方向となるように制御される、送信回路。
- 請求項1~9のいずれか1項に記載の送信回路と、
前記送信回路から所定の差動信号を受信する受信回路と、を含む、
送受信システム。 - 終端抵抗に並列に接続され、前記終端抵抗に所定の電流を流すとともに前記終端抵抗に流れる電流の方向を制御する複数のドライバ回路を備える送信回路の制御方法であって、
入力信号に基づいて第1の制御信号対及び前記第1の制御信号対を論理反転かつ遅延させた第2の制御信号対を生成することと、
前記終端抵抗の電圧波形が所望の電圧波形になるように、前記複数のドライバ回路を個々にON/OFFすることと、
前記複数のドライバ回路の各々に対し、前記第1の制御信号対又は前記第2の制御信号対のいずれかを選択して出力することと、
前記複数のドライバ回路の各々の出力電流に対して定電流制御を行うことと、を含み、
前記複数のドライバ回路は、前記ドライバ選択信号及び前記制御選択信号によってメインドライバ回路として動作する第1の前記ドライバ回路とエンファシスドライバ回路として動作する第2の前記ドライバ回路とを含み、
前記入力信号が連続した同じビットパターンであるタイミングの間、その2ビット目以降に前記終端抵抗の電圧波形が所望の電圧波形になるように、前記第1の制御信号対及び前記第2の制御信号対の論理に従って、前記第1のドライバ回路による前記電流の方向と前記第2のドライバ回路による前記電流の方向とが制御される、
送信回路の制御方法。 - 請求項11に記載の送信回路の制御方法であって、
前記ON/OFFすることは、
前記複数のドライバ回路のうち、一又は二以上のドライバ回路を第1のドライバ回路として選択してONすることと、
前記第1のドライバ回路以外の一又は二以上のドライバ回路を第2のドライバ回路として選択してONすることと、
前記第1のドライバ回路及び前記第2のドライバ回路以外のドライバ回路をOFFすることと、を含み、
前記出力することは、
前記第1のドライバ回路へ前記第1の制御信号を出力することと、
前記第2のドライバ回路へ前記第2の制御信号を出力することと、を含む、
送信回路の制御方法。
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