JP7040542B2 - 共振型コンバータのバースト制御装置 - Google Patents
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Description
図5は出力電圧制御回路の構成例を示す回路図である。
連続制御回路20は、図6に示したように、VFB端子を有し、このVFB端子は、電圧制御発振器(VCO:Voltage Controlled Oscillator )21の入力に接続されている。電圧制御発振器21の出力は、遅延回路22の入力と論理積回路AND1の一方の入力とに接続されている。遅延回路22の出力は、論理積回路AND1の他方の入力に接続され、論理積回路AND1の出力は、Vlow_c端子に接続されている。Vlow_c端子は、連続制御に使用されるローサイド用の信号Vlow_cを出力する。
分流回路60は、Vcr端子を有し、このVcr端子には、コンデンサC21の一方の端子が接続され、コンデンサC21の他方の端子は、抵抗R21の一方の端子に接続され、抵抗R21の他方の端子は、グランドに接続されている。
バースト停止期間設定回路90は、出力電圧制御回路30からフィードバック信号VFBを受けるVFB端子と、分流回路60から電流検出信号ISを受けるIS端子と、オンパルス生成回路80から信号SW_endを受けるSW_end端子とを有している。バースト停止期間設定回路90は、また、オンパルス生成回路80へ信号SW_startを出力するSW_start端子を有している。
オンパルス生成回路80は、図11に示したように、入力端子としてSW_start端子、Vi端子、CA端子、Vcr端子およびIS端子を有し、出力端子としてVlow_b端子、Vhigh_b端子およびSW_end端子を有している。
連続/バースト切替判定回路100は、図14に示したように、入力端子としてCA端子を有し、出力端子としてSbur端子を有している。CA端子は、比較器COMP21の反転入力端子に接続され、比較器COMP21の出力端子は、Sbur端子に接続されている。連続/バースト切替判定回路100は、また、抵抗R91,R92を有している。抵抗R91の一方の端子は、電源Vddに接続され、抵抗R91の他方の端子は、比較器COMP21の非反転入力端子と抵抗R92の一方の端子とに接続され、抵抗R92の他方の端子は、グランドに接続されている。ここで、電源Vddの電圧を抵抗R91,R92で分圧して得られた電圧値は、共振型コンバータを連続制御とバースト制御とを切り替える第1の負荷閾値に相当する。
10 起動回路
20 連続制御回路
21 電圧制御発振器
22,23 遅延回路
30 出力電圧制御回路
40 連続/バースト切替回路
50 駆動回路
60 分流回路
70 負荷検出回路
80 オンパルス生成回路
81 オフ閾値決定回路
82 ポジティブエッジ検出回路
83 遅延回路
84 ネガティブエッジ検出回路
85 ポジティブエッジ検出回路
86 遅延回路
87 ネガティブエッジ検出回路
90 バースト停止期間設定回路
91 ポジティブエッジ検出回路
100 連続/バースト切替判定回路
AND1,AND2,AND11,AND12,AND21,AND31,AND32,AND33,AND34 論理積回路
C11,C21,C22,C31 コンデンサ
COMP1,COMP2 比較器
COMP11 比較器(第1の比較器)
COMP12 比較器(第2の比較器)
COMP13 比較器(第4の比較器)
COMP14 比較器(第3の比較器)
COMP21 比較器
Co 出力コンデンサ
Cr 共振コンデンサ
D1,D2 ダイオード
EP エンドパルス
INV1,INV2,INV11,INV12,INV13,INV21,INV22,INV23,INV31 インバータ回路
Lm 励磁インダクタ
Lr 共振インダクタ
MP メインパルス
OP1,OP2,OP11 オペアンプ
OR1,OR11,OR12 論理和回路
PC1 フォトカプラ
Q1 スイッチング素子(第1のスイッチング素子)
Q2 スイッチング素子(第2のスイッチング素子)
Q11 スイッチ素子
R1,R2,R3,R4,R5,R11,R21,R22,R31,R32,R33,R34,R35,R36,R37,R38,R39,R40,R41,R81,R82,R83,R84,R85,R86,R87,R91,R92 抵抗
RSFF1,RSFF2 RSフリップフロップ
RSFF11 RSフリップフロップ(第1のフリップフロップ)
RSFF12 RSフリップフロップ(第2のフリップフロップ)
RSFF13 RSフリップフロップ
RSFF14 RSフリップフロップ(第3のフリップフロップ)
Ro 負荷
S1,S2 二次巻線
SP スタートパルス
SR1 シャントレギュレータ
SW1,SW2,SW11,SW12 スイッチ
T トランス
Vth1 第1のオフ閾値電圧
Vth2 第2のオフ閾値電圧
Claims (15)
- 負荷が第1の負荷閾値よりも軽負荷になったときに、ハイサイドに配置された第1のスイッチング素子およびローサイドに配置された第2のスイッチング素子のオン・オフを繰り返すスイッチング期間と前記第1のスイッチング素子および前記第2のスイッチング素子をオフするスイッチング停止期間とを含むバースト周期で動作する共振型コンバータのバースト制御装置において、
前記負荷の重さを検出する負荷検出回路と、
前記バースト周期の前記スイッチング期間に、前記第2のスイッチング素子をターンオンするスタートパルス、前記第1のスイッチング素子をターンオンするメインパルスおよび前記第2のスイッチング素子をターンオンするエンドパルスの3つのパルスを生成するとともに、前記負荷が前記第1の負荷閾値より小さな第2の負荷閾値よりも軽負荷になったときに前記メインパルスのオン幅を短くするオンパルス生成回路と、
を備え、
前記オンパルス生成回路は、
前記スイッチング期間の開始時に、前記スタートパルスを生成して前記第2のスイッチング素子をターンオンして前記共振型コンバータの共振電流を負方向に増加させ、
前記スタートパルスを終了し、さらに前記メインパルスを生成して前記第1のスイッチング素子をターンオンして前記共振電流を正方向に増加させ、その後さらに前記共振電流を負から正へ反転させ、
前記メインパルスを終了し、さらに前記エンドパルスを生成して前記第2のスイッチング素子をターンオンすることで前記共振電流が減少し、その後前記共振電流がゼロとなった所で前記エンドパルスを終了する、
共振型コンバータのバースト制御装置。 - 前記オンパルス生成回路が前記エンドパルスをオフしてから所定時間経過後に前記共振型コンバータの前記共振電流の符号が反転すると前記バースト周期の前記スイッチング停止期間を終了させて次の前記バースト周期の前記スタートパルスをターンオンするためのオントリガ信号を出力するバースト停止期間設定回路をさらに備えた、請求項1記載の共振型コンバータのバースト制御装置。
- 出力電圧と目標電圧との誤差をフィードバックして前記出力電圧に応じたフィードバック信号を出力する出力電圧制御回路と、前記フィードバック信号の電圧に応じた周波数のパルス信号を生成し、前記パルス信号から前記第1のスイッチング素子および前記第2のスイッチング素子をオン・オフする連続制御信号を出力する連続制御回路と、前記負荷が前記第1の負荷閾値よりも軽負荷になったときに前記連続制御回路からの前記連続制御信号を前記オンパルス生成回路が生成した前記スタートパルス、前記メインパルスおよび前記エンドパルスに切り替える連続/バースト切替回路とをさらに備えた、請求項2記載の共振型コンバータのバースト制御装置。
- 前記負荷検出回路は、前記共振電流を分流した電流検出信号を電圧信号に変換して平均化した信号を前記負荷の重さを表す負荷検出信号として出力する、請求項2記載の共振型コンバータのバースト制御装置。
- 前記バースト停止期間設定回路は、前記所定時間を前記出力電圧制御回路が出力する前記フィードバック信号に応じて変化させる、請求項3記載の共振型コンバータのバースト制御装置。
- 負荷が第1の負荷閾値よりも軽負荷になったときに、ハイサイドに配置された第1のスイッチング素子およびローサイドに配置された第2のスイッチング素子のオン・オフを繰り返すスイッチング期間と前記第1のスイッチング素子および前記第2のスイッチング素子をオフするスイッチング停止期間とを含むバースト周期で動作する共振型コンバータのバースト制御装置において、
前記負荷の重さを検出する負荷検出回路と、
前記バースト周期の前記スイッチング期間に、前記第2のスイッチング素子をターンオンするスタートパルス、前記第1のスイッチング素子をターンオンするメインパルスおよび前記第2のスイッチング素子をターンオンするエンドパルスの3つのパルスを生成するとともに、前記負荷が前記第1の負荷閾値より小さな第2の負荷閾値よりも軽負荷になったときに前記メインパルスのオン幅を短くするオンパルス生成回路と、
前記オンパルス生成回路が前記エンドパルスをオフしてから所定時間経過後に前記共振型コンバータの共振電流の符号が反転すると前記バースト周期の前記スイッチング停止期間を終了させて次の前記バースト周期の前記スタートパルスをターンオンするためのオントリガ信号を出力するバースト停止期間設定回路と、
を備えた、共振型コンバータのバースト制御装置。 - 出力電圧と目標電圧との誤差をフィードバックして前記出力電圧に応じたフィードバック信号を出力する出力電圧制御回路と、前記フィードバック信号の電圧に応じた周波数のパルス信号を生成し、前記パルス信号から前記第1のスイッチング素子および前記第2のスイッチング素子をオン・オフする連続制御信号を出力する連続制御回路と、前記負荷が前記第1の負荷閾値よりも軽負荷になったときに前記連続制御回路からの前記連続制御信号を前記オンパルス生成回路が生成した前記スタートパルス、前記メインパルスおよび前記エンドパルスに切り替える連続/バースト切替回路とをさらに備えた、請求項6記載の共振型コンバータのバースト制御装置。
- 前記負荷検出回路は、前記共振電流を分流した電流検出信号を電圧信号に変換して平均化した信号を前記負荷の重さを表す負荷検出信号として出力する、請求項6記載の共振型コンバータのバースト制御装置。
- 前記バースト停止期間設定回路は、前記所定時間を前記出力電圧制御回路が出力する前記フィードバック信号に応じて変化させる、請求項7記載の共振型コンバータのバースト制御装置。
- 負荷が第1の負荷閾値よりも軽負荷になったときに、ハイサイドに配置された第1のスイッチング素子およびローサイドに配置された第2のスイッチング素子のオン・オフを繰り返すスイッチング期間と前記第1のスイッチング素子および前記第2のスイッチング素子をオフするスイッチング停止期間とを含むバースト周期で動作する共振型コンバータのバースト制御装置において、
前記負荷の重さを検出する負荷検出回路と、
前記バースト周期の前記スイッチング期間に、前記第2のスイッチング素子をターンオンするスタートパルス、前記第1のスイッチング素子をターンオンするメインパルスおよび前記第2のスイッチング素子をターンオンするエンドパルスの3つのパルスを生成するとともに、前記負荷が前記第1の負荷閾値より小さな第2の負荷閾値よりも軽負荷になったときに、前記スタートパルスのオン幅を保ち、前記メインパルスおよび前記エンドパルスのオン幅を短くするオンパルス生成回路と、
を備えた、共振型コンバータのバースト制御装置。 - 前記オンパルス生成回路が前記エンドパルスをオフしてから所定時間経過後に前記共振型コンバータの共振電流の符号が反転すると前記バースト周期の前記スイッチング停止期間を終了させて次の前記バースト周期の前記スタートパルスをターンオンするためのオントリガ信号を出力するバースト停止期間設定回路をさらに備えた、請求項10記載の共振型コンバータのバースト制御装置。
- 出力電圧と目標電圧との誤差をフィードバックして前記出力電圧に応じたフィードバック信号を出力する出力電圧制御回路と、前記フィードバック信号の電圧に応じた周波数のパルス信号を生成し、前記パルス信号から前記第1のスイッチング素子および前記第2のスイッチング素子をオン・オフする連続制御信号を出力する連続制御回路と、前記負荷が前記第1の負荷閾値よりも軽負荷になったときに前記連続制御回路からの前記連続制御信号を前記オンパルス生成回路が生成した前記スタートパルス、前記メインパルスおよび前記エンドパルスに切り替える連続/バースト切替回路とをさらに備えた、請求項11記載の共振型コンバータのバースト制御装置。
- 前記負荷検出回路は、前記共振電流を分流した電流検出信号を電圧信号に変換して平均化した信号を前記負荷の重さを表す負荷検出信号として出力する、請求項11記載の共振型コンバータのバースト制御装置。
- 前記バースト停止期間設定回路は、前記所定時間を前記出力電圧制御回路が出力する前記フィードバック信号に応じて変化させる、請求項12記載の共振型コンバータのバースト制御装置。
- 前記オンパルス生成回路は、
前記メインパルスの生成を開始することで、前記共振電流を減少から増加に反転させつつ、前記共振型コンバータの2次側電流をゼロから増加を開始させ、
前記メインパルスを終了させることで、前記2次側電流をゼロにする、
請求項1記載の共振型コンバータのバースト制御装置。
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