JP7001728B2 - Photoelectric element - Google Patents
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Description
本発明は発光素子アレイに関する。 The present invention relates to a light emitting device array.
固体照明素子のうち、発光ダイオードは低消費電力、低発熱、長寿命、耐衝突、小型、快速応答及び安定した波長の単色光の発出可能などの良好な光電特性を有しているため、家電、メーターの表示灯及び光電製品等に幅広く適用されている。光電技術の発展において、固体照明素子は発光効率、寿命及び輝度に注視し、近い将来に照明の適用において主流になると予期される。 Among solid-state lighting elements, light-emitting diodes have good photoelectric characteristics such as low power consumption, low heat generation, long life, collision resistance, small size, fast response, and stable wavelength monochromatic light. , Widely applied to meter indicator lights and photoelectric products. With the development of photoelectric technology, solid-state lighting devices pay attention to luminous efficiency, life and brightness, and are expected to become mainstream in the application of lighting in the near future.
現在、ＬＥＤはアレイ型発光素子の形で用いられ、高い駆動電圧の応用によく適用され、ＬＥＤの体積及び重量を減少することができる。ＬＥＤ製造者は、高い駆動電圧ＬＥＤに対するユーザーの要求に応じるように、アレイ型発光素子に対して異なる電極配置構造を設計し、これにより、コストを下げ、製造率を向上させる。 Currently, LEDs are used in the form of array-type light emitting devices and are often applied to high drive voltage applications, which can reduce the volume and weight of LEDs. LED manufacturers design different electrode arrangement structures for array-type light emitting devices to meet the user's demand for high drive voltage LEDs, thereby lowering costs and increasing manufacturing rates.
本発明は光電素子を提供する。 The present invention provides a photoelectric element.
本発明の光電素子であって、基板と、この基板に位置し、それぞれ第一半導体層、第二半導体層及びその間にある活性領域を有し、相互電気的に接続されている複数の半導体ユニットと、それぞれ第一半導体層に位置する複数の第一電極と、この複数の半導体ユニットに形成されて複数の半導体ユニットを電気的に直列につなぐ連結部と、それぞれ第二半導体層に位置する複数の第二電極と、を含み、一つの第一電極が第一延在部を有し、一つの第二電極が第二延在部を有する。 A plurality of semiconductor units of the present invention, which are located on a substrate and have an active region between the first semiconductor layer and the second semiconductor layer, respectively, and are electrically connected to each other. A plurality of first electrodes located in the first semiconductor layer, a connecting portion formed in the plurality of semiconductor units and electrically connecting the plurality of semiconductor units in series, and a plurality of components located in the second semiconductor layer, respectively. One first electrode has a first extension and one second electrode has a second extension.
本発明の光電素子であって、基板と、この基板に位置し、それぞれ第一半導体層、第二半導体層及びその間にある活性領域を有し、相互電気的に接続されている複数の半導体ユニットと、それぞれ第一半導体層に位置する複数の第一電極と、この複数の半導体ユニットに形成されて複数の半導体ユニットを電気的に直列につなぐ連結部と、それぞれ第二半導体層に位置する複数の第二電極と、を含み、一つの第一電極が第一延在部を有し、一つの第二電極が第二延在部を有し、この複数の半導体ユニットの駆動電圧は大体同様である。 A plurality of semiconductor units of the present invention, which are located on a substrate and have an active region between the first semiconductor layer and the second semiconductor layer, respectively, and are electrically connected to each other. A plurality of first electrodes located in the first semiconductor layer, a connecting portion formed in the plurality of semiconductor units and electrically connecting the plurality of semiconductor units in series, and a plurality of components located in the second semiconductor layer, respectively. One first electrode has a first extending portion and one second electrode has a second extending portion, and the drive voltages of the plurality of semiconductor units are almost the same. Is.
本発明の光電素子であって、基板と、この基板に位置し、それぞれ第一半導体層、第二半導体層及びその間にある活性領域を有し、相互電気的に接続されている複数の半導体ユニットと、それぞれ第一半導体層に位置する複数の第一電極と、それぞれ第二半導体層に位置する複数の第二電極とを含み、複数の半導体ユニットは第一半導体ユニットと、第二半導体ユニットと、第三半導体ユニットを含み、第一電極の中の少なくとも一つは基板の最外側にある第一半導体ユニットに位置する第一電極パッドを有し、第二電極の中の少なくとも一つは基板の最外側にある第二半導体ユニットに位置する第二電極パッドを有し、第一電極及び第二電極は電極パッドがない第三半導体ユニットに位置する第一延在部及び第二延在部を有する。 A plurality of semiconductor units of the present invention, which are located on a substrate and have an active region between the first semiconductor layer and the second semiconductor layer, respectively, and are electrically connected to each other. A plurality of first electrodes located in the first semiconductor layer and a plurality of second electrodes each located in the second semiconductor layer are included, and the plurality of semiconductor units are the first semiconductor unit and the second semiconductor unit. , At least one of the first electrodes has a first electrode pad located on the outermost first semiconductor unit of the substrate, and at least one of the second electrodes is the substrate. The first electrode and the second electrode have the second electrode pad located in the second semiconductor unit located on the outermost side of the semiconductor unit, and the first electrode and the second electrode are the first extending portion and the second extending portion located in the third semiconductor unit having no electrode pad. Has.
本発明の光電素子であって、基板と、この基板に位置し、それぞれ第一半導体層、第二半導体層及びその間にある活性領域を有し、相互電気的に接続されている複数の半導体ユニットと、それぞれ複数の半導体ユニットに位置する複数の第一電極及び複数の第二電極とを含み、各半導体ユニットは第一半導体ユニット、第二半導体ユニット及び第三半導体ユニットを含み、第一電極の中の少なくとも一つは第一半導体ユニットの第二半導体層に位置する第一電極パッドを有し、第二電極の中の少なくとも一つは第二半導体ユニットの第二半導体層に位置する第二電極パッドを有し、第一電極及び第二電極は電極パッドがない第三半導体ユニットに位置する第一延在部及び第二延在部を有する。 A plurality of semiconductor units of the present invention, which are located on a substrate and have an active region between the first semiconductor layer and the second semiconductor layer, respectively, and are electrically connected to each other. Each of the semiconductor units includes a plurality of first electrodes and a plurality of second electrodes located in a plurality of semiconductor units, and each semiconductor unit includes a first semiconductor unit, a second semiconductor unit, and a third semiconductor unit of the first electrode. At least one of them has a first electrode pad located in the second semiconductor layer of the first semiconductor unit, and at least one of the second electrodes has a second electrode located in the second semiconductor layer of the second semiconductor unit. The first electrode and the second electrode have an electrode pad, and have a first extending portion and a second extending portion located in the third semiconductor unit without the electrode pad.
図１は本発明の実施例による光電素子１０の上面図である。光電素子１０は、例えば発光ダイオード（ＬＥＤ）、レーザーダイオード（ＬＤ）又は太陽電池であり、基板１１に形成された複数の半導体ユニットを含み、第一電極１４１、第二電極１４２及び連結部１４３が半導体ユニットに形成されている。本実施例において、光電素子１０は発光ダイオード（ＬＥＤ）である。図２は図１に示された光電素子１０のＡ－Ａ′線の断面図である。各半導体ユニットは第一半導体層１２１、第二半導体層１２３及び第一半導体層１２１と第二半導体層１２３の間に形成された活性領域１２２を含む。第一半導体層１２１と第二半導体層１２３は、ｐ型又はｎ型の不純物を混合したＩＩＩ－Ｖ半導体材料から構成され、電気特性が相互異なる。活性領域１２２は、単一へテロ構造（ＳＨ）、ダブルへテロ構造（ＤＨ）又は多重量子井戸構造（ＭＱＷ）である。スロット１７０は半導体ユニットをエッチングすることによって半導体ユニットに形成され、一部の第一半導体層１２１を露出する。半導体ユニット間に複数の隔溝１１１が形成され、一部の基板１１を露出する。光電素子１０は複数の第一電極１４１及び第二電極１４２を有し、第一電極１４１は露出された第一半導体層１２１に形成され、第二電極１４２は第二半導体層１２３に形成される。第一電極１４１は第一延在部１４１１を有し、第二電極１４２は第二延在部１４２１を有する。また、複数の半導体ユニット中の一つの半導体ユニットの第一電極１４１は第一電極パッド１４１２を有し、別の一つの半導体ユニットの第二電極１４２は第二電極パッド１４２２を有する。
FIG. 1 is a top view of the
光電素子の特定面積、電流及び駆動電圧に対するユーザーの要求を満足するために、半導体ユニット及び電極の配置を特別に設計する必要がある。半導体ユニットの数量は基本的に式
（数１）ｎ＝ｖ／ｖｆ－１
（数２）ｎ＝ｖ／ｖｆ
又は、
（数３）ｎ＝ｖ／ｖｆ＋１
（その内、ｎは半導体ユニットの数量、Ｖは光電素子の駆動電圧、Ｖｆは半導体ユニットの駆動電圧を示す）によって設計する。本実施例において、光電素子１０の寸法は８５×８５ｍｉｌ２であり、その駆動電圧は７２Ｖである。個々の半導体ユニットの駆動電圧は実に３Ｖであるが、半導体ユニットの駆動電圧は工程に対する制御及びエピタキシャル層の品質によって変化することがある。通常、光電素子の電気特性の効率上、半導体ユニットの駆動電圧は低いほどよい。各半導体ユニットの面積はほぼ同様である。上記の式によると、光電素子１０は２４個の半導体ユニットを有し、それぞれ行１０５、１０６、１０７、１０８及び１０９に配置される。第一行１０５には五個の半導体ユニット１５１、１５２、１５３、１５４及び１５５を有し、第一方向に沿って直列につながり、第二行１０６には五個の半導体ユニット１６１、１６２、１６３、１６４及び１６５を有し、第二方向に沿って直列につながり、第三行１０７には四個の半導体ユニット１７１、１７２、１７３及び１７４を有し、第一方向に沿って直列につながり、第四行１０８には五個の半導体ユニット１８１、１８２、１８３、１８４及び１８５を有し、第二方向に沿って直列につながり、第五行１０９には五個の半導体ユニット１９１、１９２、１９３、１９４及び１９５を有し、第一方向に沿って直列につながる。第一方向及び第二方向は相反する方向であり、異なる行に異なる数量の半導体ユニットを有する配置構造は、配置上ユーザーの要求をさらに容易に満たすことができる。
In order to meet the user's requirements for a specific area, current and drive voltage of the photoelectric element, it is necessary to specially design the arrangement of the semiconductor unit and the electrodes. The number of semiconductor units is basically the formula (Equation 1) n = v / v f -1.
(Number 2) n = v / v f
Or,
(Number 3) n = v / v f +1
(Of these, n is the number of semiconductor units, V is the drive voltage of the photoelectric element, and V f is the drive voltage of the semiconductor unit). In this embodiment, the dimension of the
第三行１０７において、半導体ユニットの形状は長方形（矩形）で、他の行にある半導体ユニットの形状と異なる。このように設計することによって、電極の配置構造を更に容易にすることができる。図１及び図３を参考するに、第一行１０５及び第五行１０９において、基板１１のコーナー領域にある半導体ユニット１５１、１５５、１９１及び１９５を除いて、他の半導体ユニットの電極の配置構造は類似している。第二行１０６及び第四行１０８において、基板１１の縁に近接する半導体ユニット１６１、１６５、１８１及び１８５を除いて、他の半導体ユニットの電極配置構造は同様である。第三行１０７にある半導体ユニットは、その電極配置構造が他の行にある半導体ユニットと比べて大きく相違し、その中の半導体ユニット１７２及び１７３の電極配置構造は同様であるが、基板１１の縁に近接する半導体ユニット１７１及び１７４の電極配置構造は相互異なる。
In the
第一延在部１４１１は第一曲線延在部１４１１ａを有し、第二延在部１４２１は第二曲線延在部１４２１ａを有し、行１０５、１０６、１０８及び１０９にある半導体ユニットの第二延在部１４２１はさらに直線延在部１４２１ｂを有し、第一曲線延在部１４１１ａ及び／又は第二曲線延在部１４２１ａは半導体ユニットの何れかの一辺にも平行しない。第一行１０５、第三行１０７及び第五行１０９にある半導体ユニット上の第一延在部１４１１は、スロット１７０の中に位置し、半導体ユニットの第一辺から第一辺に相対する第二辺へ延び、第二延在部１４２１は半導体ユニットの第二辺から第一辺へ延びる。第二行１０６及び第四行１０８の半導体ユニット上の第一延在部１４１１は、半導体ユニットの第二辺から第一辺へ延び、第二延在部１４２１は半導体ユニットの第一辺から第二辺へ延びる。本実施例において、第二延在部１４２１は大体半導体ユニットの縁に近接して設けられ、第一延在部１４１１は半導体ユニットのスロット１７０の中に配置されて、第一半導体層１２１と電気接続されている。延在部の数量は半導体ユニットの面積によって調整され、半導体ユニットの面積が大きい場合、数多くの延在部が必要になる。さらに、延在部は第一曲線延在部１４１１ａから延びて形成された二級延在部１４１１ｃ及び／又は第二曲線延在部１４２１ａから延びて形成された二級延在部１４２１ｃを有して、電流分散を増加することができる。
The
第一電極パッド１４１２及び第二電極パッド１４２２は、それぞれ基板１１の相対するコーナーにある半導体ユニット１５５及び１９１に位置し、第一電極パッド１４１２は半導体ユニット１５５にある第一延在部１４１１と接続し、第二電極パッド１４２２は半導体ユニット１９１にある第二延在部１４２１と接続する。電極パッドは、ワイヤボンディング（ｗｉｒｅ ｂｏｎｄｉｎｇ）又はフリップチップ型ボンディング（ｆｌｉｐ ｃｈｉｐ ｔｙｐｅ ｂｏｎｄｉｎｇ）に用いられる。接続の難度を下げるために、電極パッドはそれぞれ基板１１の一番外側にある異なる半導体ユニットに配置されるのが好ましい。
The
各半導体ユニットを電気接続するために、各半導体ユニットの間に連結部１４３を形成する。連結部１４３は、例えば第一半導体ユニットの第一延在部１４１１及びそれに隣接する第二半導体ユニットの第二延在部１４２１と接続する。本実施例において、連結部１４３は第一行１０５、第三行１０７及び第五行１０９で半導体ユニットを第一方向へ直列させ、第二行１０６及び第四行１０８で半導体ユニットを逆方向としての第二方向へ直列させる。各行の間は、連結部１４３を介して半導体ユニット１５１と１６１、１６５と１７４、１７１と１８１及び１８５と１９５を直列につなぐ。第一行１０５、第二行１０６、第四行１０８及び第五行１０９において、二つ毎の半導体ユニットの間に二つの連結部１４３が存在し、第三行１０７において、二つ毎の半導体ユニットの間に一つの連結部１４３が存在する。図４は図１に示された光電素子１０の等価回路図である。
In order to electrically connect each semiconductor unit, a connecting
光電素子１０の第二半導体層１２３と第二電極１４２の間に更に透明導電層を含み、透明導電層の材料は、例えば酸化インジウム錫（ＩＴＯ）、酸化カドミウム錫（ＣＴＯ）、酸化アンチモンスズ、酸化インジウム亜鉛、酸化亜鉛アルミニウム又は亜鉛－スズ酸化物のような金属酸化材料を用いることができる。一方、金属層が光束を透過させる厚さを有する場合、この金属層を透明導電層として用いることもできる。
A transparent conductive layer is further included between the
また、基板１１と第一半導体層１２１の間に更に接合層を含み、半導体ユニットを基板１１に接合することができる。接合層は透明絶縁接合層又は透明導電接合層である。透明絶縁接合層である場合、その材料はポリイミド（ｐｏｌｙｉｍｉｄｅ）、ベンゾシクロブテン（ＢＣＢ）又は過フルオロシクロブタン（ＰＦＣＢ）であり、導電接合層である場合、その材料は金属酸化材料又は金属である。金属酸化材料として、酸化インジウム錫（ＩＴＯ）、酸化カドミウム錫（ＣＴＯ）、酸化アンチモンスズ、酸化インジウム亜鉛、酸化亜鉛アルミニウム又は亜鉛－スズ酸化物を含み、金属材料として、ニッケル、金、チタン、クロム、アルミニウム又は白金を含む。隔溝１１１は各半導体ユニットの間に形成され、一部の基板１１及び／又は透明絶縁接合層を露出する。接合層が導電接合層である場合、隔溝１１１は導電接合層を通り抜いて基板１１を露出し、各半導体ユニットが互いに電気的に絶縁されるようにする。この場合、基板１１は、窒化アルミニウム（ＡｌＮ）、サファイア又はガラスである。
Further, a bonding layer is further included between the
図５は本発明の第二実施例による光電素子２０の上面図である。図５、図６を参照するに、光電素子２０は基板２１に形成され、且つ複数の隔溝２１１によって仕切った複数の半導体ユニットを含み、第一電極２４１、第二電極２４２及び連結部２４３が半導体ユニットに形成される。半導体ユニットの構造は光電素子１０の半導体ユニットと同様であり、第一半導体層１２１と、第二半導体層１２３と、第一半導体層１２１及び第二半導体層１２３の間に設けられた活性領域１２２を含む。複数の隔溝２１１は各半導体ユニットの間に形成される。光電素子２０には複数の第一電極２４１及び第二電極２４２が設けられ、第一電極２４１は露出された第一半導体層１２１に形成され、第二電極２４２は第二半導体層１２３に形成される。第一電極２４１は第一延在部２４１１を有し、第二電極２４２は第二延在部２４２１を有する。更に、複数の半導体ユニットにおいて、一つの半導体ユニットの第一電極２４１は第一電極パッド２４１２を含み、別の一つの半導体ユニットの第二電極２４２は第二電極パッド２４２２を含む。
FIG. 5 is a top view of the
本実施例において、光電素子２０の寸法は８５×８５ｍｉｌ２であり、駆動電圧は７２Ｖであり、個々の半導体ユニットの面積はほぼ同様であり、上記の式（数１を参照）によって、光電素子２０は２３個の半導体ユニットを含み、それぞれ行２０５、２０６、２０７、２０８及び２０９に配置されている。第一行２０５には第一方向に沿って直列につながる五個の半導体ユニット２５１、２５２、２５３、２５４及び２５５を有し、電極の配置構造は光電素子１０の第一行１０５の半導体ユニットにある電極配置構造と等しい。第二行２０６には第二方向に沿って直列につながる四個の半導体ユニット２６１、２６２、２６３及び２６４を有し、電極の配置構造は光電素子１０の第三行１０７の半導体ユニットにある電極配置構造と等しい。第三行２０７には第一方向に沿って直列につながる五個の半導体ユニット２７１、２７２、２７３、２７４及び２７５を有し、電極の配置構造は光電素子１０の第一行１０５の半導体ユニットにある電極配置構造と等しい。第四行２０８には第二方向に沿って直列につながる四個の半導体ユニット２８１、２８２、２８３及び２８４を有し、電極の配置構造は光電素子１０の第三行１０７の半導体ユニットにある電極配置構造と等しい。第五行２０９には第一方向に沿って直列につながる五個の半導体ユニット２９１、２９２、２９３、２９４及び２９５を有し、電極の配置構造は光電素子１０の第一行１０５の半導体ユニットにある電極配置構造と等しい。
In this embodiment, the dimensions of the
第二行２０６及び第四行２０８において、半導体ユニットの形状は長方形で、他の行にある半導体ユニットの形状と異なる。図５及び図６を参照するに、第一行２０５、第三行２０７及び第五行２０９の半導体ユニットの電極配置構造は、半導体ユニット２５１、２５５、２７１、２７５、２９１及び２９５の電極を除いて、他の半導体ユニットの電極配置構造がほぼ類似し、第二行２０６及び第四行２０８の半導体ユニットの電極配置構造は、半導体ユニット２６１、２６４、２８１及び２８４の電極を除いて、他の半導体ユニットの電極配置構造がほぼ類似する。第一延在部２４１１は第一曲線延在部２４１１ａを含み、第二延在部２４２１は第二曲線延在部２４２１ａを含む。行２０５、２０７及び２０９の半導体ユニットにおいて、第二延在部２４２１は更に直線延在部２４２１ｂを含む。第一曲線延在部２４１１ａ及び第二曲線延在部２４２１ａは、半導体ユニットのいずれかの一辺にも平行しない。第一行２０５、第三行２０７及び第五行２０９の半導体ユニットの第一延在部２４１１は第一半導体層１２１に設けられ、半導体ユニットの第一辺から第一辺に相対する第二辺へ延び、第二延在部２４２１は半導体ユニットの第二辺から第一辺へ延びる。第二行２０６及び第四行２０８の半導体ユニット上の第一延在部２４１１は、半導体ユニットの第二辺から第一辺へ延び、第二延在部２４２１は半導体ユニットの第一辺から第二辺へ延びる。本実施例において、第二延在部２４２１は大体半導体ユニットの縁に近接して設けられ、第一延在部２４１１は半導体ユニットに配置されて、第一半導体層と電気接続されている。さらに、延在部は第一曲線延在部２４１１ａから延びて形成された二級延在部２４１１ｃを有して、電流分散を増加することができる。
In the
第一電極パッド２４１２及び第二電極パッド２４２２はそれぞれ半導体ユニット２５５及び２９１に形成され、第一電極パッド２４１２は半導体ユニット２５５の第一延在部２４１１と接続し、第二電極パッド２４２２は半導体ユニット２９１の第二延在部２４２１と接続する。電極パッドはボンディング用として、それぞれ基板２１のコーナー領域にある異なる半導体ユニットに配置される。
The
本実施例において、連結部２４３は第一行２０５、第三行２０７及び第五行２０９で半導体ユニットを第一方向へ直列させ、第二行２０６及び第四行２０８で半導体ユニットを逆方向としての第二方向へ直列させる。各行の間は、連結部２４３を介して半導体ユニット２５１と２６１、２６４と２７５、２７１と２８１及び２８４と２９５を直列につなぐ。第一行２０５、第三行２０７及び第五行２０９において、二つ毎の半導体ユニットの間に二つの連結部２４３が存在し、第二行２０６及び第四行２０８において、二つ毎の半導体ユニットの間に一つの連結部２４３が存在する。図７は図５に示された光電素子２０の等価回路図である。
In this embodiment, the connecting
図８は本発明の第三実施例による光電素子３０の上面図である。図８、図９を参照するに、光電素子３０は基板３１に形成された複数の半導体ユニットを含み、第一電極３４１、第二電極３４２及び連結部３４３が半導体ユニットに形成される。半導体ユニットは第一半導体層１２１と、第二半導体層１２３と、第一半導体層１２１及び第二半導体層１２３の間に設けられた活性領域１２２を含む。また、複数の隔溝３１１が各半導体ユニットの間に形成される。光電素子３０には複数の第一電極３４１及び第二電極３４２が設けられ、第一電極３４１は第一延在部３４１１を有し、半導体ユニット３５５以外の半導体ユニットに形成され、第二電極３４２は第二延在部３４２１を有する。更に、半導体ユニット３５５上の第一電極３４１は第一電極パッド３４１２を含み、半導体ユニット３９１上の第二電極３４２は第二電極パッド３４２２を含む。本実施例において、光電素子３０の寸法は５０×５０ｍｉｌ２であり、駆動電圧は７２Ｖであり、半導体ユニットの駆動電圧は３Ｖであり、各半導体ユニットの面積はほぼ同様である。光電素子３０は２３個の半導体ユニットを含み、それぞれ行３０５、３０６、３０７、３０８及び３０９に配置されている。第一行３０５には第一方向に沿って直列につながる五個の半導体ユニット３５１、３５２、３５３、３５４及び３５５を有し、第二行３０６には第二方向に沿って直列につながる四個の半導体ユニット３６１、３６２、３６３及び３６４を有し、第三行３０７には第一方向に沿って直列につながる五個の半導体ユニット３７１、３７２、３７３、３７４及び３７５を有し、第四行３０８には第二方向に沿って直列につながる四個の半導体ユニット３８１、３８２、３８３及び３８４を有し、第五行３０９には第一方向に沿って直列につながる五個の半導体ユニット３９１、３９２、３９３、３９４及び３９５を有する。
FIG. 8 is a top view of the
第二行３０６及び第四行３０８において、半導体ユニットの形状は他の行にある半導体ユニットの形状と異なる。図８及び図９を参照するに、第一行３０５、第三行３０７及び第五行３０９の半導体ユニットの電極配置構造は、半導体ユニット３５１、３５５、３７１、３７５、３９１及び３９５の電極を除いて、他の半導体ユニットの電極配置構造がほぼ類似し、第二行３０６及び第四行３０８の半導体ユニットの電極配置構造は、半導体ユニット３６１、３６４、３８１及び３８４の電極を除いて、他の半導体ユニットの電極配置構造がほぼ類似する。第一延在部３４１１は、基板３１の周囲に近接する半導体ユニット３６１、３７５、３８１、３９１及び３９５に設けられた曲線延在部３４１１ａであり、他の半導体ユニットに設けられた直線延在部３４１１ｂでもある。第二延在部３４２１は曲線延在部である。 第一行３０５、第三行３０７及び第五行３０９において、半導体ユニット３７５、３９５を除く他の半導体ユニットの第一延在部３４１１は、半導体ユニットの第一辺から第一辺に相対する第二辺へ延び、第二延在部３４２１は半導体ユニットの第二辺から第一辺へ延びる。半導体ユニット３７５及び３９５の第一延在部３４１１は半導体ユニットの第三辺から第二辺へ延びる。第二行３０６及び第四行３０８において、半導体ユニット３６１及び３８１を除くほかの半導体ユニットの第一延在部３４１１は、半導体ユニットの第二辺から第一辺へ延び、第二延在部３４２１は半導体ユニットの第一辺から第二辺へ延びる。半導体ユニット３６１及び３８１の第一延在部３４１１は半導体ユニット３６１及び３８１の第三辺から第一辺へ延びる。第一延在部３４１１の曲線延在部及び第二延在部３４２１は半導体ユニットのいずれかの一辺にも平行しない。本実施例において、第二延在部３４２１は大体半導体ユニットの縁に近接して設けられ、第一延在部３４１１は半導体ユニットに配置されて、第一半導体層と電気接続されている。さらに、延在部は曲線延在部３４１１ａ及び直線延在部３４１１ｂから延びて形成された二級延在部３４１１ｃを有して、電流分散を増加することができる。
In the
第一電極パッド３４１２及び第二電極パッド３４２２はそれぞれ半導体ユニット３５５及び３９１に形成され、第二電極パッド３４２２は半導体ユニット３９１の第二延在部３４２１と接続する。電極パッドはワイヤボンディング（ｗｉｒｅ ｂｏｎｄｉｎｇ）又はフリップチップ型ボンディング（ｆｌｉｐ ｃｈｉｐ ｔｙｐｅ ｂｏｎｄｉｎｇ）に用いられ、それぞれ基板３１のコーナー領域にある異なる半導体ユニットに配置される。
The
本実施例において、連結部３４３は第一行３０５、第三行３０７及び第五行３０９で半導体ユニットを第一方向へ直列させ、第二行３０６及び第四行３０８で半導体ユニットを逆方向としての第二方向へ直列させる。各行の間は、連結部３４３を介して半導体ユニット３５１と３６１、３６４と３７５、３７１と３８１及び３８４と３９５を直列につなぐ。二つ毎の半導体ユニットの間に一つの連結部３４３が存在する。図１０は図８に示された光電素子３０の等価回路図である。
In this embodiment, the connecting
図１１は本発明の第四実施例による光電素子４０の上面図である。図１１、図１２を参照するに、光電素子４０は基板４１に形成された複数の半導体ユニットを含み、第一電極４４１、第二電極４４２及び連結部４４３が半導体ユニットに形成される。半導体ユニットは第一半導体層１２１と、第二半導体層１２３と、第一半導体層１２１及び第二半導体層１２３の間に設けられた活性領域１２２を含む。また、複数の隔溝４１１が各半導体ユニットの間に形成される。光電素子４０には複数の第一電極４４１及び第二電極４４２が設けられ、第一電極４４１は第一延在部４４１１を有し、半導体ユニット４５５以外の半導体ユニットに形成され、半導体ユニット４７１以外の半導体ユニットに形成された第二電極４４２は第二延在部４４２１を有する。更に、半導体ユニット４５５上の第一電極４４１は第一電極パッド４４１２を含み、半導体ユニット４７１上の第二電極４４２は第二電極パッド４４２２を含む。 本実施例において、光電素子４０の寸法は４５×４５ｍｉｌ２であり、駆動電圧は４８Ｖであり、半導体ユニットの駆動電圧は３Ｖである。上記の式によって、光電素子４０は１６個の半導体ユニットを含み、それぞれ行４０５、４０６及び４０７に配置されている。第一行４０５には第一方向に沿って直列につながる五個の半導体ユニット４５１、４５２、４５３、４５４及び４５５を有し、第二行４０６には第二方向に沿って直列につながる六個の半導体ユニット４６１、４６２、４６３、４６４、４６５及び４６６を有し、第三行４０７には第一方向に沿って直列につながる五個の半導体ユニット４７１、４７２、４７３、４７４及び４７５を有する。
FIG. 11 is a top view of the
第二行４０６にある半導体ユニットの形状は他の行にある半導体ユニットの形状と異なる。図１１及び図１２を参照するに、第一行４０５及び第三行４０７の半導体ユニットの電極配置構造は、半導体ユニット４５１、４５５、４７１及び４７５上の電極を除いて、他の半導体ユニットの電極配置構造がほぼ類似する。第一延在部４４１１は直線延在部４４１１ａ及び二級延在部４４１１ｃを含み、全ての第二延在部４４２１は曲線の延在部である。第一行４０５及び第三行４０７にある半導体ユニットの第一延在部４４１１は、半導体ユニットの第一辺から第一辺に隣接する第三辺及び第四辺へ延び、第二延在部４４２１は半導体ユニットの第二辺から第三辺及び第四辺へ延びる。第二行４０６にある半導体ユニット上の第一延在部４４１１は、半導体ユニットの第二辺から第三辺及び第四辺へ延び、第二延在部４４２１は半導体ユニットの第一辺から第三辺及び第四辺へ延びる。曲線延在部４４１１及び４４２１は半導体ユニットのいずれかの一辺にも平行しない。
The shape of the semiconductor unit in the
第一電極パッド４４１２及び第二電極パッド４４２２はそれぞれ半導体ユニット４５５及び４７１に形成され、連結部４４３は半導体ユニットを直列につなぐ。図１３は図１１に示された光電素子４０の等価回路図である。 図１４は本発明の第五実施例による光電素子５０の上面図である。図１５は光電素子５０の３Ｄ斜視図である。光電素子５０の寸法は４０×４０ｍｉｌ２であり、駆動電圧は３６Ｖであり、半導体ユニットの駆動電圧は約３Ｖである。式（数１を参照）によって、本実施例で、光電素子５０は１１個の半導体ユニットを含み、それぞれ行５０５、５０６及び５０７に配置されている。第一行５０５には第一方向に沿って直列につながる四個の半導体ユニット５５１、５５２、５５３及び５５４を有し、第二行５０６には第二方向に沿って直列につながる三個の半導体ユニット５６１、５６２及び５６３を有し、第三行５０７には第一方向に沿って直列につながる四個の半導体ユニット５７１、５７２、５７３及び５７４を有する。第一延在部５４１１を有する第一電極５４１は半導体ユニット５５４以外の半導体ユニットに形成され、第二延在部５４２１を有する第二電極５４２は全ての半導体ユニットに形成される。半導体ユニット５５４上の第一電極５４１は第一電極パッド５４１２を含み、半導体ユニット５７１上の第二電極５４２は第二電極パッド５４２２を含む。連結部５４３は半導体ユニットを直列につなぐ。図１６は図１４に示された光電素子５０の等価回路図である。
The
図１７は本発明の第六実施例による光電素子６０の上面図である。図１８は光電素子６０の３Ｄ斜視図である。光電素子６０の寸法は１２０×１２０ｍｉｌ２であり、駆動電圧は２４Ｖであり、半導体ユニットの駆動電圧は約３Ｖである。式（数２を参照）によって、本実施例で、光電素子６０は８個の半導体ユニットを含み、それぞれ行６０５、６０６及び６０７に配置されている。第一行６０５には第一方向に沿って直列につながる二個の半導体ユニット６５１及び６５２を有し、第二行６０６には第二方向に沿って直列につながる四個の半導体ユニット６６１、６６２、６６３及び６６４を有し、第三行６０７には第一方向に沿って直列につながる二個の半導体ユニット６７１及び６７２を有する。第一電極６４１は第一延在部６４１１を有し、第二電極６４２は第二延在部６４２１を有する。さらに、複数の半導体ユニットの中、一つの半導体ユニットにある第一電極６４１は二つの第一電極パッド６４１２を有し、別の一つの半導体ユニットにある第二電極６４２は二つの第二電極パッド６４２２を有する。連結部６４３は半導体ユニットを直列につなぐ。図１９は図１７に示された光電素子６０の等価回路図である。
FIG. 17 is a top view of the
図２０は本発明の第七実施例による光電素子７０の上面図である。図２１は光電素子７０の３Ｄ斜視図である。光電素子７０の寸法は１２０×１２０ｍｉｌ２であり、駆動電圧は２４Ｖであり、半導体ユニットの駆動電圧は約３Ｖである。式（数１を参照）によって、本実施例で、光電素子７０は７個の半導体ユニットを含み、それぞれ行７０５、７０６及び７０７に配置されている。第一行７０５には第一方向に沿って直列につながる二個の半導体ユニット７５１及び７５２を有し、第二行７０６には第二方向に沿って直列につながる三個の半導体ユニット７６１、７６２及び７６３を有し、第三行７０７には第一方向に沿って直列につながる二個の半導体ユニット７７１及び７７２を有する。第一電極７４１は第一延在部７４１１を有し、第二電極７４２は第二延在部７４２１を有する。さらに、複数の半導体ユニットの中、一つの半導体ユニットにある第一電極７４１は二つの第一電極パッド７４１２を有し、別の一つの半導体ユニットにある第二電極７４２は二つの第二電極パッド７４２２を有する。連結部７４３は半導体ユニットを直列につなぐ。図２２は図２０に示された光電素子７０の等価回路図である。
FIG. 20 is a top view of the
図２３は本発明の第八実施例による光電素子８０の上面図である。図２４は光電素子８０の３Ｄ斜視図である。光電素子８０の寸法は８５×８５ｍｉｌ２であり、駆動電圧は１４４Ｖであり、半導体ユニットの駆動電圧は約３Ｖである。式（数２を参照）によって、本実施例で、光電素子８０は４８個の半導体ユニットを含み、それぞれ行８０１、８０２、８０３、８０４、８０５、８０６及び８０７に配置されている。行８０１、８０３、８０５及び８０７には第一方向に沿って直列につながる七個の半導体ユニットを有し、行８０２及び８０６には第二方向に沿って直列につながる七個の半導体ユニットを有し、第四行８０４には第一方向に沿って直列につながる六個の半導体ユニットを有する。複数の半導体ユニットの中、一つの半導体ユニットにある第一電極８４１は半導体ユニット８１１の第一半導体層１２１に位置する第一電極パッド８４１２を含み、半導体ユニット８７１にある第二電極８４２は第二半導体層１２３に位置する第二電極パッド８４２２を含む。さらに、第一延在部８４１１を有する第一電極８４１は、第一電極パッド８４１２が位置した半導体ユニット以外の半導体ユニットに位置し、第二延在部８４２１を有する第二電極８４２は全ての半導体ユニットに位置する。連結部８４３は半導体ユニットを直列につなぐ。第一電極パッド８４１２が位置する半導体ユニット８１１上の第二電極８４２は第二半導体層１２３に位置し、連結部８４３を介して半導体ユニット８１２の第一電極８４１に連結される。第二電極パッド８４２２が位置する半導体ユニット８７１上の第一電極８４１は第一半導体層１２１に位置し、連結部８４３を介して半導体ユニット８７２の第二電極８４２に連結される。
FIG. 23 is a top view of the
図２５は本発明の第九実施例による光電素子９０の上面図である。光電素子９０は４８個の半導体ユニットを含み、それぞれ行８０１、８０２、８０３、８０４、８０５、８０６及び８０７に配置されている。本実施例の光電素子９０は、その形状及び電極配置構造が光電素子８０と類似するが、第一電極パッド９４１２は半導体ユニット８１１の第二半導体層１２３に形成され、連結部８４３を介して半導体ユニット８１２の第一電極８４１と直列につながり、第二電極パッド９４２２は半導体ユニット８７１の第二半導体層１２３に形成され、連結部８４３を介して半導体ユニット８７２の第二電極８４２と直列につながる点で光電素子８０と相違する。ある外部電源から電流を供給し、第二電極パッド９４２２から入力して更に第一電極パッド９４１２から出力する場合、第二電極パッド９４２２の下の半導体ユニット８７１の抵抗が連結部８４３及び半導体ユニット８１２の第一電極８４１の直列接続抵抗より大きいため、電流は直接第二電極パッド９４２２から連結部８４３を経由して半導体ユニット８１２の第一電極８４１に流れ、半導体ユニット８７１の下の第一半導体層１２１、活性領域１２２及び第二半導体層１２３に流れない。同様な電流は、半導体ユニット８１２の第一電極８４１まで流れ、連結部８４３を経由して第一電極パッド９４１２に流れた後、半導体ユニット８１１の下方の第一半導体層１２１、活性領域１２２及び第二半導体層１２３に流れず、直接外部電源に出力される。従って、第一電極パッド９４１２及び第二電極パッド９４２２の下方の半導体ユニット８１１及び８７１には光が生じない。電極パッド及び下方の半導体ユニットを更に電気的に絶縁するために、電極パッド及び半導体ユニットの間に絶縁層が形成され、大電流によって電極パッドの下方にある半導体層を電流が突き抜けて短路になることを避ける。
FIG. 25 is a top view of the
第一電極パッド９４１２及び第二電極パッド９４２２の下方の半導体ユニットが発光しないため、第一電極パッド９４１２の面積は半導体ユニット８１１の面積とほぼ同様に形成され、第二電極パッド９４２２の面積は半導体ユニット８７１の面積とほぼ同様に形成されて、ワイヤー工程の歩留まりを向上させることができる。一方、光電素子９０において、第一電極パッド９４１２は光電素子８０中の第二電極パッド８４２２と組み合わせることができる。この場合、第一電極パッド９４１２は半導体ユニット８１１の第二半導体層１２３を全体的に覆うように形成され、第二電極パッド８４２２は半導体ユニット８７１の一部第二半導体層１２３に形成される。第一電極パッド９４１２の下方にある半導体ユニットには電流が流れないため、発光しない。第二電極パッド８４２２が位置する半導体ユニット８７１上の第一電極８４１は、連結部８４３を介して半導体ユニット８７２の第二電極８４２と連結され、電流が流れると、第二電極パッド８４２２が位置する半導体ユニット８７１は発光する。同様に、光電素子９０において、第二電極パッド９４２２は光電素子８０中の第一電極パッド８４１２と組み合わせることができる。この場合、第一電極パッド８４１２は半導体ユニット８１１の一部第一半導体層１２１に位置され、第二電極パッド９４２２は半導体ユニット８７１の第二半導体層１２３を全体的に覆うように形成される。第一電極パッドが位置する半導体ユニット８１１上の第二電極８４２は、連結部８４３を介して半導体ユニット８１２の第一電極８４１と連結され、電流が流れると、第一電極パッド８４２２が位置する半導体ユニット８１１は発光する。しかし、第二電極パッド９４２２に流れる電流は半導体ユニット８７１の活性領域１２２を通らず、直接連結部８４３を介して半導体ユニット８７２に流れるため、第二電極パッド９４２２が位置する半導体ユニット８７１は発光しない。
Since the semiconductor unit below the
第一半導体層、活性層及び第二半導体層の材料は、Ｇａ、Ａｌ、Ｉｎ、Ａｓ、Ｐ、Ｎ及びＳｉから構成された群から選択された一つ又は複数の元素を含み、例えば、ＧａＮ、ＡｌＧａＮ、ＩｎＧａＮ、ＡｌＧａＩｎＮ、ＧａＰ、ＧａＡｓ、ＧａＡｓＰ、ＧａＮＡｓ又はＳｉである。基板の材料は、サファイア、ＧａＡｓ、ＧａＰ、ＳｉＣ、ＺｎＯ、ＧａＮ、ＡｌＮ、Ｃｕ又はＳｉを含む。 The material of the first semiconductor layer, the active layer and the second semiconductor layer contains one or more elements selected from the group composed of Ga, Al, In, As, P, N and Si, for example, GaN. , AlGaN, InGaN, AlGaInN, GaP, GaAs, GaAsP, GaN As or Si. Substrate materials include sapphire, GaAs, GaP, SiC, ZnO, GaN, AlN, Cu or Si.
上記に挙げられた各実施例は、本発明を説明するためのものであり、本発明の範囲を制限するものではない。本発明に対して行った各種変更と修飾は、依然として本発明の範囲に属する。 Each of the examples given above is for the purpose of explaining the present invention and does not limit the scope of the present invention. Various modifications and modifications made to the present invention still fall within the scope of the present invention.
１０、２０、３０、４０、５０、６０、７０、８０、９０ 光電素子
１１、２１、３１、４１、５１、６１、７１、８１ 基板
１４１、２４１、３４１、４４１、５４１、６４１、７４１、８４１ 第一電極
１４２、２４２、３４２、４４２、５４２、６４２、７４２、８４２ 第二電極
１４３、２４３、３４３、４４３、５４３、６４３、７４３、８４３ 連結部
１２１ 第一半導体層
１２３ 第二半導体層
１２２ 活性領域
１７０ スロット
１１１、３１１ 隔溝
１４１１、２４１１、３４１１、４４１１、５４１１、６４１１、７４１１、８４１１ 第一延在部
１４２１、２４２１、３４２１、４４２１、５４２１、６４２１、７４２１、８４２１ 第二延在部
１４１２、２４１２、３４１２、４４１２、５４１２、６４１２、７４１２、８４１２、９４１２ 第一電極パット
１４２２、２４２２、３４２２、４４２２、５４２２、６４２２、７４２２、８４２２、９４２２ 第二電極パット
１０５～１０９、２０５～２０９、３０５～３０９、４０５～４０７、５０５～５０７、６０５～６０７、７０５～７０７、８０１～８０７ 行
１５１～１５５、１６１～１６５、１７１～１７４、１８１～１８５、１９１～１９５、２５１～２５５、２６１～２６４、２７１～２７５、２８１～２８４、２９１～２９５、３５１～３５５、３６１～３６４、３７１～３７５、３８１～３８４、３９１～３９５、４５１～４５５、４６１～４６６、４７１～４７５、５５１～５５４、５６１～５６３、５７１～５７４、６５１～６５２、６６１～６６４、６７１～６７２、７５１～７５２、７６１～７６２、７６９、７７１～７７２、８１１～８１２、８７１～８７２ 半導体ユニット
１４１１ａ、２４１１ａ 第一曲線延在部
１４２１ａ、２４２１ａ 第二曲線延在部
１４２１ｂ、２４２１ｂ、３４１１ｂ、４４１１ａ 直線延在部
１４１１ｃ、１４２１ｃ、２４１１ｃ、３４１１ｃ、４４１１ｃ 二級延在部
３４１１ａ 曲線延在部
10, 20, 30, 40, 50, 60, 70, 80, 90 Photoelectric elements 11, 21, 31, 41, 51, 61, 71, 81 Substrate 141, 241, 341, 441, 541, 641, 741, 841 First electrode 142, 242, 342, 442, 542, 642, 742, 842 Second electrode 143, 243, 343, 443, 543, 643, 743, 843 Connecting part 121 First semiconductor layer 123 Second semiconductor layer 122 Active Area 170 Slot 111, 311 Diagonal groove 1411, 2411, 3411, 4411, 5411, 6411, 7411, 8411 First extension part 1421, 2421, 3421, 4421, 5421, 6421, 7421, 8421 Second extension part 1412, 2412, 3412, 4412, 5412, 6412, 7412, 8412, 9412 1st electrode pad 1422, 2422, 3422, 4422, 5422, 6422, 7422, 8422, 9422 2nd electrode pad 105-109, 205-209, 305- 309, 405 to 407, 505 to 507, 605 to 607, 705 to 707, 801 to 807 lines 151 to 155, 161 to 165, 171 to 174, 181 to 185, 191 to 195, 251 to 255, 261 to 264, 271 to 275, 281 to 284, 291 to 295, 351 to 355, 361 to 364, 371 to 375, 381 to 384, 391 to 395, 451 to 455, 461 to 466, 471 to 475, 551 to 554, 561 to 563, 571 to 574, 651 to 652, 661 to 664, 671 to 672, 751 to 752, 761 to 762, 769, 771 to 772, 811 to 812, 871 to 872 Semiconductor units 1411a, 2411a First curve extension 1421a, 2421a Second curve extension part 1421b, 2421b, 3411b, 4411a Straight extension part 1411c, 1421c, 2411c, 3411c, 4411c Secondary curve extension part 3411a Curve extension part
Claims (10)
基板；
前記基板に配置される複数の半導体ユニットであって、
前記複数の半導体ユニットが、第一行に位置する第一半導体ユニット及び第二半導体ユニット、並びに、第二行に位置する第三半導体ユニット及び第四半導体ユニットを含み、
前記複数の半導体ユニットの各々が、第一半導体層及び第二半導体層を含み、前記第一半導体層が、前記第一半導体層の周囲を構成する複数の辺を含み、前記複数の辺のうちの隣接する２つが、コーナーを構成する、複数の半導体ユニット；
前記複数の半導体ユニットのうちの隣接する２つの間に位置し、前記基板の表面を露出させる隔溝；
前記複数の半導体ユニットの各々に位置し、前記第一半導体層の第一表面を露出させるスロットであって、
前記スロットが、前記第一半導体ユニットの前記第一半導体層の前記コーナー以外の領域に位置する第一スロット、及び、前記第二半導体ユニットの前記第一半導体層の前記コーナーに位置する第二スロットを含む、スロット；
前記複数の半導体ユニットの各々の前記スロットに位置する第一電極であって、
前記第一電極が、前記第一半導体ユニットの前記第一スロット内に位置する第一の第一延在電極、及び、前記第二半導体ユニットの前記第二スロット内に位置する第二の第一延在電極を含む、第一電極；
前記複数の半導体ユニットの各々の前記第二半導体層に位置する複数の第二延在電極を含む第二電極；
前記第一半導体ユニット及び前記第二半導体ユニット間の前記隔溝に位置し、前記第一スロット内の前記第一の第一延在電極に連結される第一連結部；及び
前記第二半導体ユニット及び前記第三半導体ユニット間の前記隔溝に位置し、前記第二スロット内の前記第二の第一延在電極に連結される第二連結部を含み、
前記第一連結部は、前記第一半導体ユニットの前記第一半導体層から第一方向に沿って前記第二半導体ユニットの前記第二半導体層に延在し、前記第二連結部は、前記第二半導体ユニットの前記第一半導体層から第二方向に沿って前記第三半導体ユニットの前記第二半導体層に延在し、前記第二方向は、前記第一方向に平行でなく、
前記光電素子の上面図において、前記第一の第一延在電極は、前記第一連結部と直接接触し、且つ前記第一方向に沿って延在し、
前記光電素子の前記上面図において、前記第二の第一延在電極は、前記第二連結部と直接接触し、前記第二の第一延在電極は、前記第一方向に平行な第一部分、及び、前記第一方向に平行でない第二部分を含み、前記第二部分は、前記第一部分と前記第二連結部との間に位置し、
前記光電素子の前記上面図において、前記第一連結部及び前記第二連結部は、曲がった部分を含まず、前記第一連結部は、前記第一スロット内に位置する第一表面積を有し、前記第二連結部は、前記第二スロット内に位置する第二表面積を有し、前記第一表面積は、前記第二表面積よりも小さい、光電素子。 It is a photoelectric element
substrate;
A plurality of semiconductor units arranged on the substrate.
The plurality of semiconductor units include a first semiconductor unit and a second semiconductor unit located in the first row, and a third semiconductor unit and a fourth semiconductor unit located in the second row.
Each of the plurality of semiconductor units includes a first semiconductor layer and a second semiconductor layer, and the first semiconductor layer includes a plurality of sides constituting the periphery of the first semiconductor layer, and among the plurality of sides. Two adjacent semiconductor units that make up a corner;
A groove that is located between two adjacent semiconductor units and exposes the surface of the substrate;
A slot located in each of the plurality of semiconductor units and exposing the first surface of the first semiconductor layer.
The slot is a first slot located in a region other than the corner of the first semiconductor layer of the first semiconductor unit, and a second slot located in the corner of the first semiconductor layer of the second semiconductor unit. Including, slot;
A first electrode located in the slot of each of the plurality of semiconductor units.
The first electrode is a first extending electrode located in the first slot of the first semiconductor unit, and a second first electrode located in the second slot of the second semiconductor unit. First electrode, including extending electrode;
A second electrode including a plurality of second extending electrodes located in the second semiconductor layer of each of the plurality of semiconductor units;
A first connecting portion located in the gap between the first semiconductor unit and the second semiconductor unit and connected to the first extending electrode in the first slot; and the second semiconductor unit. And a second connecting portion located in the gap between the third semiconductor units and connected to the second extending electrode in the second slot.
The first connecting portion extends from the first semiconductor layer of the first semiconductor unit to the second semiconductor layer of the second semiconductor unit along the first direction, and the second connecting portion extends from the first semiconductor layer to the second semiconductor layer of the second semiconductor unit. (Ii) It extends from the first semiconductor layer of the semiconductor unit to the second semiconductor layer of the third semiconductor unit along the second direction, and the second direction is not parallel to the first direction.
In the top view of the photoelectric element, the first extending electrode is in direct contact with the first connecting portion and extends along the first direction.
In the top view of the photoelectric element, the second extending electrode is in direct contact with the second connecting portion, and the second extending electrode is a first portion parallel to the first direction. , And a second portion that is not parallel to the first direction, the second portion being located between the first portion and the second connecting portion.
In the top view of the photoelectric element, the first connecting portion and the second connecting portion do not include a bent portion, and the first connecting portion has a first surface area located in the first slot. , The second connecting portion has a second surface area located in the second slot, the first surface area being smaller than the second surface area, a photoelectric element.
基板；
前記基板に配置される複数の半導体ユニットであって、
前記複数の半導体ユニットが、第一行に位置する第一半導体ユニット及び第二半導体ユニット、並びに、第二行に第三半導体ユニット及び第四半導体ユニットを含み、
前記複数の半導体ユニットの各々が、第一半導体層及び第二半導体層を含み、前記第一半導体層が、前記第一半導体層の周囲を構成する複数の辺を含み、前記複数の辺のうちの隣接する２つが、コーナーを構成する、複数の半導体ユニット；
前記複数の半導体ユニットのうちの隣接する２つの間に位置し、前記基板の表面を露出させる隔溝；
前記複数の半導体ユニットの各々に位置し、前記第一半導体層の第一表面を露出させるスロットであって、
前記スロットが、前記第一半導体ユニットの前記第一半導体層の前記コーナー以外の領域に位置する第一スロット、及び、前記第二半導体ユニットの前記第一半導体層の前記コーナーに位置する第二スロットを含む、スロット；
前記複数の半導体ユニットの各々の前記第一半導体層に位置する第一電極であって、
前記第一電極が、前記第一半導体ユニットの前記第一スロット内の前記第一半導体層に位置する第一の第一延在電極、及び、前記第二半導体ユニットの前記第二スロット内の前記第一半導体層に位置する第二の第一延在電極を含む、第一電極；
前記複数の半導体ユニットの各々の前記第二半導体層に位置する第二電極であって、
前記第二電極が、前記第一半導体ユニットの前記第二半導体層に位置する第一の第二延在電極、前記第二半導体ユニットの前記第二半導体層に位置する第二の第二延在電極、及び、前記第三半導体ユニットの前記第二半導体層に位置する第三の第二延在電極を含む、第二電極；
前記第一半導体ユニット及び前記第二半導体ユニット間の前記隔溝に位置し、前記第一スロット内の前記第一の第一延在電極に連結される第一連結部；及び
前記第二半導体ユニット及び前記第三半導体ユニット間の前記隔溝に位置し、前記第二スロット内の前記第二の第一延在電極に連結される第二連結部を含み、
前記第一連結部は、前記第一半導体ユニットの前記第一半導体層から第一方向に沿って前記第二半導体ユニットの前記第二半導体層に延在し、前記第二連結部は、前記第二半導体ユニットの前記第一半導体層から第二方向に沿って前記第三半導体ユニットの前記第二半導体層に延在し、前記第二方向は、前記第一方向に平行でなく、
前記光電素子の上面図において、前記第一連結部は、前記第一の第一延在電極の幅よりも大きく且つ前記第二の第二延在電極の幅よりも大きい幅を有し、前記第二連結部は、前記第二の第一延在電極の幅よりも大きく且つ前記第三の第二延在電極の幅よりも大きい幅を有し、
前記光電素子の前記上面図において、前記第二の第一延在電極及び前記第三の第二延在電極がそれぞれ前記第二連結部と直接接触する部分は、前記第二連結部の対角線にのみ位置する、光電素子。 It is a photoelectric element
substrate;
A plurality of semiconductor units arranged on the substrate.
The plurality of semiconductor units include a first semiconductor unit and a second semiconductor unit located in the first row, and a third semiconductor unit and a fourth semiconductor unit in the second row.
Each of the plurality of semiconductor units includes a first semiconductor layer and a second semiconductor layer, and the first semiconductor layer includes a plurality of sides constituting the periphery of the first semiconductor layer, and among the plurality of sides. Two adjacent semiconductor units that make up a corner;
A groove that is located between two adjacent semiconductor units and exposes the surface of the substrate;
A slot located in each of the plurality of semiconductor units and exposing the first surface of the first semiconductor layer.
The slot is a first slot located in a region other than the corner of the first semiconductor layer of the first semiconductor unit, and a second slot located in the corner of the first semiconductor layer of the second semiconductor unit. Including, slot;
A first electrode located in the first semiconductor layer of each of the plurality of semiconductor units.
The first electrode is a first extending electrode located in the first semiconductor layer in the first slot of the first semiconductor unit, and the second electrode in the second slot of the second semiconductor unit. A first electrode, including a second first extending electrode located in the first semiconductor layer;
A second electrode located in the second semiconductor layer of each of the plurality of semiconductor units.
The second electrode is a first second extending electrode located in the second semiconductor layer of the first semiconductor unit, and a second second extending electrode located in the second semiconductor layer of the second semiconductor unit. A second electrode comprising an electrode and a third second extending electrode located in the second semiconductor layer of the third semiconductor unit;
A first connecting portion located in the gap between the first semiconductor unit and the second semiconductor unit and connected to the first extending electrode in the first slot; and the second semiconductor unit. And a second connecting portion located in the gap between the third semiconductor units and connected to the second extending electrode in the second slot.
The first connecting portion extends from the first semiconductor layer of the first semiconductor unit to the second semiconductor layer of the second semiconductor unit along the first direction, and the second connecting portion extends from the first semiconductor layer to the second semiconductor layer of the second semiconductor unit. (Ii) It extends from the first semiconductor layer of the semiconductor unit to the second semiconductor layer of the third semiconductor unit along the second direction, and the second direction is not parallel to the first direction.
In the top view of the photoelectric element, the first connecting portion has a width larger than the width of the first first extending electrode and larger than the width of the second extending electrode, and the width thereof is larger than the width of the second extending electrode. The second connecting portion has a width larger than the width of the second extending electrode and larger than the width of the third extending electrode.
In the top view of the photoelectric element, the portions where the second extending electrode and the third extending electrode are in direct contact with the second connecting portion are diagonally aligned with the second connecting portion. A photoelectric element located only.
基板；
前記基板に配置される複数の半導体ユニットであって、
前記複数の半導体ユニットが、第一行に位置する第一半導体ユニット及び第二半導体ユニット、並びに、第二行に位置する第三半導体ユニット及び第四半導体ユニットを含み、
前記複数の半導体ユニットの各々が、第一半導体層及び第二半導体層を含み、前記第一半導体層が、前記第一半導体層の周囲を構成する複数の辺を含み、前記複数の辺のうちの隣接する２つが、コーナーを構成する、複数の半導体ユニット；
前記複数の半導体ユニットのうちの隣接する２つの間に位置し、前記基板の表面を露出させる隔溝；
前記第一半導体ユニットに位置し、前記第一半導体ユニットの前記第一半導体層を露出させる第一スロットであって、
前記第一スロットが、前記第一半導体ユニットの前記コーナー以外の領域に位置する、第一スロット；
前記第二半導体ユニットに位置し、前記第二半導体ユニットの前記第一半導体層を露出させる第二スロットであって、
前記第二スロットが、前記第二半導体ユニットの前記コーナーを含む、第二スロット；
前記第一半導体ユニットの前記第一スロットに位置する第一の第一延在電極、及び、前記第二半導体ユニットの前記第二スロットに位置する第二の第一延在電極を含む第一電極；
前記第一半導体ユニットの前記第二半導体層に位置する第一の複数の第二延在電極、及び、前記第二半導体ユニットの前記第二半導体層に位置する第二の複数の第二延在電極を含む第二電極であって、
前記第一の複数の第二延在電極が、対称パターンで前記第一の第一延在電極の両側に位置し、前記第二の複数の第二延在電極が、非対称パターンで前記第二の第一延在電極の両側に位置する、第二電極；
前記第一半導体ユニット及び前記第二半導体ユニット間の前記隔溝に位置する第一連結部；及び
前記第二半導体ユニット及び前記第三半導体ユニット間の前記隔溝に位置する第二連結部であって、
前記第一連結部が、前記第一スロット内に位置する第一表面積を有し、前記第二連結部が、前記第二スロット内に位置する第二表面積を有し、前記第一表面積が前記第二表面積よりも小さい、第二連結部、を含む、光電素子。 It is a photoelectric element
substrate;
A plurality of semiconductor units arranged on the substrate.
The plurality of semiconductor units include a first semiconductor unit and a second semiconductor unit located in the first row, and a third semiconductor unit and a fourth semiconductor unit located in the second row.
Each of the plurality of semiconductor units includes a first semiconductor layer and a second semiconductor layer, and the first semiconductor layer includes a plurality of sides constituting the periphery of the first semiconductor layer, and among the plurality of sides. Two adjacent semiconductor units that make up a corner;
A groove that is located between two adjacent semiconductor units and exposes the surface of the substrate;
A first slot located in the first semiconductor unit and exposing the first semiconductor layer of the first semiconductor unit.
The first slot is located in a region other than the corner of the first semiconductor unit;
A second slot located in the second semiconductor unit and exposing the first semiconductor layer of the second semiconductor unit.
The second slot comprises the corner of the second semiconductor unit;
A first electrode including a first extending electrode located in the first slot of the first semiconductor unit and a second first extending electrode located in the second slot of the second semiconductor unit. ;
A first plurality of second extending electrodes located in the second semiconductor layer of the first semiconductor unit, and a second plurality of second extending electrodes located in the second semiconductor layer of the second semiconductor unit. A second electrode that includes an electrode
The first plurality of second extending electrodes are located on both sides of the first first extending electrode in a symmetric pattern, and the second plurality of second extending electrodes are arranged in an asymmetric pattern. Second electrodes located on both sides of the first extending electrode of
A first connecting portion located in the gap between the first semiconductor unit and the second semiconductor unit; and a second connecting portion located in the gap between the second semiconductor unit and the third semiconductor unit. hand,
The first connecting portion has a first surface area located in the first slot, the second connecting portion has a second surface area located in the second slot, and the first surface area is said. A photoelectric element containing a second connecting portion, which is smaller than the second surface area.
前記第二部分が、前記第一部分の長さよりも大きい長さを有する、光電素子。 The photoelectric element according to claim 1.
A photoelectric device in which the second portion has a length larger than the length of the first portion.
前記第一半導体ユニット及び前記第二半導体ユニットが同じ面積を有し、前記第三半導体ユニット及び前記第四半導体ユニットが同じ面積を有する、光電素子。 The photoelectric element according to claim 1.
A photoelectric element in which the first semiconductor unit and the second semiconductor unit have the same area, and the third semiconductor unit and the fourth semiconductor unit have the same area.
前記第一半導体ユニットに位置する前記複数の第二延在電極が、前記第一半導体ユニットの前記第一の第一延在電極の両側に位置する、光電素子。 The photoelectric element according to claim 1.
A photoelectric element in which the plurality of second extending electrodes located in the first semiconductor unit are located on both sides of the first extending electrode of the first semiconductor unit.
前記光電素子の前記上面図において、前記第一の第一延在電極及び前記第二の第二延在電極がそれぞれ前記第一連結部と直接接触する部分は、前記第一連結部の相対する辺に位置する、光電素子。 The photoelectric element according to claim 2.
In the top view of the photoelectric element, the portions where the first extending electrode and the second extending electrode are in direct contact with the first connecting portion face each other of the first connecting portion. A photoelectric element located on the side.
前記スロットが、前記隔溝の最小幅よりも大きい最小幅を有する、光電素子。 The photoelectric element according to claim 2.
A photoelectric element in which the slot has a minimum width larger than the minimum width of the groove.
前記第一スロット又は前記第二スロットが、前記隔溝の最小幅よりも大きい最小幅を有する、光電素子。 The photoelectric element according to claim 3, wherein the photoelectric element is used.
A photoelectric element in which the first slot or the second slot has a minimum width larger than the minimum width of the partition groove.
前記第一半導体ユニット及び前記第二半導体ユニットが同じ形状を有し、前記第三半導体ユニット及び前記第四半導体ユニットが同じ形状を有する、光電素子。 The photoelectric element according to claim 3, wherein the photoelectric element is used.
A photoelectric element in which the first semiconductor unit and the second semiconductor unit have the same shape, and the third semiconductor unit and the fourth semiconductor unit have the same shape.
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