JP7001236B2

JP7001236B2 - 情報処理装置、障害監視方法及び障害監視用コンピュータプログラム

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Publication number: JP7001236B2
Application number: JP2019052459A
Authority: JP
Inventors: 耕一末木
Original assignee: NEC Platforms Ltd
Current assignee: NEC Platforms Ltd
Priority date: 2019-03-20
Filing date: 2019-03-20
Publication date: 2022-01-19
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Also published as: JP2020154705A

Description

本発明は、情報処理装置、障害監視方法及び障害監視用コンピュータプログラムに関する。

サーバ等の情報処理装置において、オペレーティングシステム（ＯＳ）から独立して、ソフトウェア、ハードウェアの監視を行うコントローラとして、ベースボードマネジメントコントローラ（ＢＭＣ）がある。より具体的には、ＢＭＣは情報処理装置の電源制御、温度や電圧の監視機能、システムの動作監視機能などを持つ。さらに、近年の情報処理装置は、リモートコンピュータからのシステムの電源制御、リモートメディア制御、マルチタスク化などの機能も備え、それら機能に対応するためＢＭＣの機能も多様化、複雑化してきている。その結果、ＢＭＣ自身に異常が生じストールして停止状態となる場合も増えてきた。関連する技術において、ＢＭＣがストールした場合、ＢＭＣがストールした原因を追求する方法が特許文献１に開示されている。

特開２０１１－０１４０７５号公報

ところで、ＢＭＣにおいて、ソフトウェアトラブルの原因の特定が重要な機能の１つである。しかし、ＢＭＣがストール中に、ＯＳ（Operating System）やＢＩＯＳ（Basic Input/Output System）がストールする場合もある。この場合、原因を究明するための情報が取れず、ＢＭＣの本来の機能を果たすことができない。そこで本発明は、上述の課題を解決する情報処理装置、障害監視方法及び障害監視用コンピュータプログラムを提供することを目的としている。

本発明の第１の態様によれば、情報処理装置は、オペレーティングシステムあるいはＢＩＯＳが停止状態となった際の原因解析に利用される情報である有益情報を記憶する不揮発性メモリと、指示に従って前記不揮発性メモリに前記有益情報を保存または削除する有益情報処理部を備えた制御回路と、前記オペレーティングシステムあるいは前記ＢＩＯＳの一方または双方に備えられ、所定のタイマ期間毎に前記有益情報を前記制御回路に送信して保存を指示するとともに、電源オフ時の処理の際に、前記有益情報の削除の指示を前記制御回路に対して行う制御回路指示部と、前記オペレーティングシステムから独立して情報処理装置の状態監視を行うコントローラと、を備え、前記コントローラは、該コントローラが起動した際、前記不揮発性メモリに前記有益情報が保存されているかを確認するメモリチェック部と、前記不揮発性メモリに前記有益情報が保存されている場合、保存されている前記有益情報に基づきログを登録するログ処理部と、前記制御回路指示部により前記不揮発性メモリに前記有益情報が保存された後、次の所定のタイマ期間の開始前に保存された前記有益情報の削除がなされるよう前記制御回路に対して指示を行う削除処理部とを備える、ことを特徴とする。

本発明の第２の態様によれば、障害監視方法は、オペレーティングシステムあるいはＢＩＯＳが停止状態となった際の原因解析に利用される情報である有益情報を記憶する不揮発性メモリと、指示に従って、前記不揮発性メモリに前記有益情報を保存または削除する有益情報処理部を備えた制御回路と、前記オペレーティングシステムあるいは前記ＢＩＯＳの一方または双方に備えられ、所定のタイマ期間毎に前記有益情報を前記制御回路に送信して保存を指示するとともに、電源オフ時の処理の際に、前記有益情報の削除の指示を前記制御回路に対して行う制御回路指示部と、を備えた情報処理装置によって、オペレーティングシステムから独立して前記情報処理装置の状態監視を行い、起動した際、前記不揮発性メモリに前記有益情報が保存されているかを確認し、前記不揮発性メモリに前記有益情報が保存されている場合、保存されている前記有益情報に基づきログを登録し、前記制御回路指示部により前記不揮発性メモリに前記有益情報が保存された後、次の所定のタイマ期間の開始前に保存された前記有益情報の削除がなされるよう前記制御回路に対して指示を行う、ことを特徴とする。

本発明の第３の態様によれば、障害監視用コンピュータプログラムは、オペレーティングシステムあるいはＢＩＯＳが停止状態となった際の原因解析に利用される情報である有益情報を記憶する不揮発性メモリと、指示に従って前記不揮発性メモリに前記有益情報を保存または削除する有益情報処理部を備えた制御回路と、前記オペレーティングシステムあるいは前記ＢＩＯＳの一方または双方に備えられ、所定のタイマ期間毎に前記有益情報を前記制御回路に送信して保存を指示するとともに、電源オフ時の処理の際に、前記有益情報の削除の指示を前記制御回路に対して行う制御回路指示部と、を備えた情報処理装置のための障害監視用コンピュータプログラムであって、オペレーティングシステムから独立して前記情報処理装置の状態監視を行い、起動した際、前記不揮発性メモリに前記有益情報が保存されているかを確認し、前記不揮発性メモリに前記有益情報が保存されている場合、保存されている前記有益情報に基づきログを登録し、前記制御回路指示部により前記不揮発性メモリに前記有益情報が保存された後、次の所定のタイマ期間の開始前に保存された前記有益情報の削除がなされるよう前記制御回路に対して指示を行うことをコンピュータに実行させる、ことを特徴とする。

これにより、ＢＭＣがストール中に情報処理装置のＯＳやＢＩＯＳがストールしても、ＯＳやＢＩＯＳのストールの原因を究明するための情報を取得することができる、という効果が得られる。

本発明の一実施形態によるサーバの機能ブロック図である。本発明の一実施形態によるＢＭＣのハードウェア構成を示す図である。本発明の一実施形態によるＯＳ、ＢＩＳＯの有益情報に関する処理フローを示す図である。本発明の一実施形態による制御回路の有益情報に関する処理フローを示す図である。本発明の一実施形態によるＢＭＣの有益情報に関する処理フローを示す図である。本発明の一実施形態による正常時における各モジュールの動作の一例を示す図である。本発明の一実施形態によるＢＭＣのストール時の各モジュールの動作の一例を示す図である。本発明の一実施形態によるＢＭＣのストール時にＯＳ／ＢＩＯＳがストールし、ＮＭＩで復活したときの各モジュールの動作の一例を示す図である。本発明の一実施形態によるＢＭＣのストール時にＯＳ／ＢＩＯＳがストールし、ＮＭＩで復活しなかったときの各モジュールの動作の一例を示す図である。本発明の一実施形態によるＢＭＣの起動時の各モジュールの動作の一例を示す図である。本発明の一実施形態による情報処理装置の最小構成図を示す図である。

以下、本発明の一実施形態によるサーバについて図面を参照して説明する。図１は本発明の一実施形態によるサーバの機能ブロック図である。図１において、符号１はサーバを示す。符号２は制御回路を、符号３はオペレーティングシステム（ＯＳ）を、符号４はＢＩＯＳ（Basic Input/Output System）を示す。また、符号５はベースボードマネジメントコントローラ（ＢＭＣ：Baseboard Management Controller）を示す。

サーバ１は、制御回路２、ＯＳ・３、ＢＩＯＳ・４、ＢＭＣ・５を備え、これらはＩ２Ｃ（Inter-Integrated Circuit）のようなシリアルバスの通信路１１により接続される。また、サーバ１は、制御回路２から図示しないＣＰＵ（Central Processing Unit）に対してＮＭＩ（Non Maskable Interrupt）を発行するための通信路１２をさらに備える。ここで、ＮＭＩとは、ＣＰＵに対して外部から要求される割り込みの一種で、どのような場合でも強制的に割り込みが行われ、制御命令によりマスク（禁止）できない割り込みを指す。ＮＭＩは、サーバ１の機能に深刻な障害発生した場合など、緊急時や特殊な場合に用いられる。本実施の形態において、ＮＭＩは、ＯＳ・３またはＢＩＯＳ・４がストールし、操作を受け付けなくフリーズした状態（停止状態）での復活のために用いられるが、ＮＭＩの使用の詳細は別途説明する。以下では、情報処理装置の一例として、サーバ１を用いて説明するが、情報処理装置は、パーソナルコンピュータや、その他、ＣＰＵ、ＯＳ、ＢＩＯＳ等を備えた他の電子機器であってもよい。

制御回路２は、ＯＳ・３やＢＩＯＳ・４がストールした際の解析に有益な情報である有益情報の管理を行う。制御回路２は、有益情報処理部２１、復活処理部２２、不揮発性メモリ２３を備える。また、不揮発性メモリ２３は、前述の有益情報２４を記憶する。有益情報としては、有益情報を取得した時刻に関するタイムスタンプ、ＯＳ・３におけるその時点でのシステム構成/システムログ/カーネル情報、ＢＩＯＳ・４におけるその時点でのタスクコード（Task Code）などである。

不揮発性メモリ２３は、読み書き可能なメモリで、例えば、フラッシュメモリ等である。
有益情報処理部２１は、ＯＳ・３、ＢＩＯＳ・４、ＢＭＣ・５からの指示に応じて、不揮発性メモリ２３に有益情報２４を保存する処理、または、不揮発性メモリ２３から有益情報２４を削除する処理を行う。
復活処理部２２は、不揮発性メモリ２３に記憶された有益情報２４が一定期間更新されない場合、ＯＳ・３あるいはＢＩＯＳ・４のストールからの復活のためのマスク不可な割り込み命令をサーバ１のＣＰＵに対して発生する処理を行う。

ＯＳ・３は、サーバ１の基本的な管理や制御のための機能や、多くのソフトウェアが共通して利用する基本的な機能などを実装した、サーバ１全体を管理するソフトウェアである。ＯＳ・３は、制御回路指示部３１と、タイマ処理部３２をデーモンまたはドライバとして備える。

制御回路指示部３１は、所定のタイマ期間毎に、ＯＳ・３に関する有益情報を収集して、収集した有益情報を制御回路２に送信し、保存を指示する処理を行う。さらに、制御回路指示部３１は、サーバ１の回路に対する直流電源が切られることによる電源オフ（シャットダウン）のための処理をする際に、不揮発性メモリ２３に記憶される有益情報２４の削除の指示を制御回路２に対して行う処理をする。

タイマ処理部３２は、定期的に設けられる所定のタイマ期間に対する応答をする処理を行う。ここで、「定期的に設けられる所定のタイマ期間」は、ＯＳ・３やＢＩＯＳ・４が正常に機能しているかどうかを定期的に監視するためのタイマ期間である。ＷＤＴ（Watch Dog Timer）は、このタイマ期間の間に所定の応答（リセット信号）の有無を監視する。なお、ＷＤＴは、所定のタイマ期間に対して、ＯＳ・３やＢＩＯＳ・４から応答がある際、タイマがリセットされる。一方、ＯＳ・３やＢＩＯＳ・４のストールにより所定期間を経過してもＯＳ・３やＢＩＯＳ・４からの応答がない場合、タイマがリセットされない。このようにＷＤＴは、タイマがリセットされない期間が長いと、ＯＳ・３やＢＩＯＳ・４がストールしているもとの判断するために用いられる。

ＢＩＯＳ・４は、ＯＳ・３の起動や、サーバ１とサーバ１に対する接続機器の入出力を制御するソフトウェアである。ＢＩＯＳ・４は、制御回路指示部４１と、タイマ処理部４２をソフトウェアモジュールとして備える。制御回路指示部４１とタイマ処理部４２は、ＯＳ・３の制御回路指示部３１、タイマ処理部３２と同等の機能を備える。

ＢＭＣ・５は、ＯＳ・３から独立してサーバ１のハード面での監視や、システムの動作監視、ＯＳ・３やＢＩＯＳ・４のストールの原因の特定等をするためのものである。本実施の形態では、ＢＭＣ・５による、ＯＳ・３やＢＩＯＳ・４のストールの原因の特定に関する機能を説明する。ＢＭＣ・５に関し、ＩＰＭＩ（Intelligent Platform Management Interface）という情報処理装置の基本コンポーネントの監視や遠隔地からの制御などを行うためのインターフェース仕様がある。ＢＭＣ・５は、ＩＰＭＩに基づき、ＷＤＴを用いてＯＳ・３やＢＩＯＳ・４がストールした際の原因解析のための有益情報を収集する。ＢＭＣ・５は、メモリチェック部５１、ログ処理部５２、削除処理部５３を備える。

メモリチェック部５１は、起動のためＡＣ電源の投入やサーバ１のリセットで、ＢＭＣ・５が再起動した際、不揮発性メモリ２３に有益情報２４が保存されているかを確認する処理を行う。なお、ＢＭＣ・５が起動した際、不揮発性メモリ２３に有益情報２４が保存されている場合とは、ＢＭＣ・５の起動前に、ＢＭＣ・５がストールし、さらに、ＯＳ・３ないしはＢＩＯＳ・４がストールした状況となる。

ログ処理部５２は、メモリチェック部５１の処理により、不揮発性メモリ２３に有益情報２４が保存されている場合、保存されている有益情報２４に関するログを登録する処理を行う。

削除処理部５３は、ＯＳ・３の制御回路指示部３１やＢＩＯＳ・４の制御回路指示部４１により不揮発性メモリ２３に有益情報２４が保存された後、次の所定のタイマの期間の開始前に保存された有益情報の削除がなされるよう制御回路２に対して指示を行う処理をする。

図２は本発明の一実施形態によるＢＭＣ・５のハードウェア構成を示す図である。ＢＭＣ・５は、ＣＰＵ・６１、ＲＯＭ（Read Only Memory）６２、ＲＡＭ（Random Access Memory）６３、フラッシュメモリ６４、通信モジュール６５を備える。
ＣＰＵ６１は、ＲＯＭ・６２またはフラッシュメモリ６４等の記録媒体に記憶されるプログラムを実行することで、ＢＭＣ・５の各機能を実現する。
フラッシュメモリ６４には、ＢＭＣ・５の機能を実現するため必要となる有益情報２４やその他のデータ等も記憶する。

通信モジュール６５は、制御回路２、ＯＳ・３、ＢＩＯＳ・４等と通信路１１を介した通信が行えるようにする。また、サーバ１の稼動状態に依存せず、基本的なリモート操作ができるようにするための機能も備える。
なお、ＢＭＣ・５は、これらハードの機能を含んだ、オンボードチップとして提供されるものであってもよい。

図３は、本発明の一実施形態によるＯＳ・３、ＢＩＳＯ・４の有益情報に関する処理フローを示す図である。ＯＳ・３、ＢＩＳＯ・４の動作について処理フローを追って説明する。

サーバ１の起動に伴い、ＯＳ・３、ＢＩＳＯ・４も起動し、ストール時の解析に利用される有益情報に関する処理が開始する。また、ＯＳ・３、ＢＩＳＯ・４の起動後、ＯＳ・３、ＢＩＳＯ・４が正常に機能しているかを監視するため、ＷＤＴに関連しシステム・タイマが定期的に発せられる。

ＯＳ・３、ＢＩＳＯ・４における有益情報に関する処理は同等である。そこで、以下では、ＯＳ・３の処理フローについて説明し、ＢＩＳＯ・４における有益情報に関する処理フローに関する説明を省略する。

ＯＳ・３のタイマ処理部３２は、所定のタイマ期間毎に、ＷＤＴのタイマリセットのための応答（更新処理）をする（ステップＳ３１）。

ＯＳ・３の制御回路指示部３１は、有益情報を収集する（ステップＳ３２）。なお、ＯＳ・３における有益情報としては、有益情報を収集した時刻に関するタイムスタンプ、その時点でのシステム構成/システムログ/カーネル情報等となる。なお、ＢＩＯＳ・４における有益情報としては、有益情報を収集した時刻に関するタイムスタンプ、その時点でタスクコード（Task Code）等となる。

制御回路指示部３１は、収集した有益情報を制御回路２に送信するとともに、制御回路２に対して送信した有益情報の保存を指示する（ステップＳ３３）。

制御回路指示部３１は、ＯＳ・３のストールがない限り、ステップＳ３１からＳ３３の処理をタイマ期間毎に行う。

さらに、サーバ１の回路に対する直流電源が切られるＤＣ－ＯＦＦの状態への移行がなければ（ステップＳ３４：Ｎｏ）、ＯＳ・３のストールがない限り、ＯＳ・３は、ステップＳ３１からＳ３３の処理を各タイマ期間に行う。

サーバ１の回路に対する直流電源が切られるＤＣ－ＯＦＦの状態へ移行する場合（ステップＳ３４：Ｙｅｓ）、制御回路指示部３１は、不揮発性メモリ２３に記憶される有益情報２４の削除の指示を制御回路２に対して行う。これにより、ＯＳ・３は、ストールすることなく正常終了する場合、不揮発性メモリ２３に有益情報２４を残すことなく、有益情報に関する処理を終了することができる。

図４は、本発明の一実施形態による制御回路２の有益情報に関する処理フローを示す図である。図４のフローは、制御回路２の起動により開始する。

制御回路２の有益情報処理部２１は、ＯＳ・３、ＢＩＯＳ・４からの有益情報の保存の指示があるか判断する（ステップＳ４１）。

保存の指示がある場合（ステップＳ４１：Ｙｅｓ）、有益情報処理部２１は、ＯＳ・３あるいはＢＩＯＳ・４から送信された有益情報を、不揮発性メモリ２３に保存する（ステップＳ４２）。一方、保存の指示がない場合（ステップＳ４１：Ｎｏ）、有益情報処理部２１は処理をステップＳ４３に移す。

有益情報処理部２１は、ＯＳ・３、ＢＩＯＳ・４、ＢＭＣ・５からの削除の指示があるか判断する（ステップＳ４３）。

削除の指示がある場合（ステップＳ４３：Ｙｅｓ）、有益情報処理部２１は、不揮発性メモリ２３に保存される有益情報２４を不揮発性メモリ２３から削除する（ステップＳ４４）。一方、削除の指示がない場合（ステップＳ４３：Ｎｏ）、有益情報処理部２１は処理をステップＳ４５に移す。

制御回路２は、ＯＳ・３またはＢＩＯＳ・４の一方、あるいは、双方がストールしたか判断する（ステップＳ４５）。この判断は、ＷＤＴにおいて、タイマが所定のタイマ期間を超えてリセットされていないか否かで判断する。ＷＤＴにおいて、タイマが所定のタイマ期間を超えてリセットされていない場合は、ＯＳ・３またはＢＩＯＳ・４の一方、あるいは、双方がストールしたと判断する。

ＯＳ・３やＢＩＯＳ・４がストールしたと判断した場合（ステップＳ４５：Ｙｅｓ）、制御回路２の復活処理部２２は、ＯＳ・３やＢＩＯＳ・４におけるストールからの復活のため、ＮＭＩをサーバ１のＣＰＵに対して発行する（ステップＳ４６）。これにより、ＯＳ・３やＢＩＯＳ・４の復活のための処理が行われる。この処理により、ＯＳ・３やＢＩＯＳ・４が復活し、正常に機能し始める場合もある。

ＢＩＯＳ・４の一方、あるいは、双方がストールしていないと判断した場合（ステップＳ４５：Ｎｏ）、制御回路２は、処理をステップＳ４７に移す。ＢＭＣ・５は、サーバ１の回路に対する直流電源が切られシャットダウンがなされると（ステップＳ４７：Ｙｅｓ）、有益情報に関する処理を終了する。一方、処理が継続する場合（ステップＳ４７：Ｎｏ）、制御回路２は、ステップＳ４１からＳ４７の有益情報に関する処理を繰り返す。

図５は、本発明の一実施形態によるＢＭＣ・５の有益情報に関する処理フローを示す図である。

起動のためＡＣ電源の投入やサーバ１のリセットによりＢＭＣ・５が起動した際、ＢＭＣ・５のメモリチェック部５１は、不揮発性メモリ２３に有益情報２４が保存されているかを確認する（ステップＳ５１）。不揮発性メモリ２３に有益情報２４が保存されていない場合（ステップＳ５１：Ｎｏ）、ＢＭＣ・５は、処理をステップＳ５４に移す。

一方、不揮発性メモリ２３に有益情報２４が保存されている場合（ステップＳ５１：Ｙｅｓ）、ＢＭＣ・５の起動前に、ＢＭＣ・５がストールし、さらに、ＯＳ・３／ＢＩＯＳ・４がストールした状況であったことを示す。

この場合、ログ処理部５２は、保存されている有益情報２４に基づきログを登録する（ステップＳ５２）。この処理により、ＢＭＣ・５がストールし、さらに、ＯＳ・３ないしはＢＩＯＳ・４がストールした状況であっても、ＯＳ・３ないしはＢＩＯＳ・４におけるストールの原因を解析するための有益情報を取得することができる。

削除処理部５３は、ステップＳ５２の処理の後、有益情報２４を不揮発性メモリ２３から削除する指示を制御回路２に対して行う（ステップＳ５３）。

削除処理部５３は、ＯＳ・３やＢＩＯＳ・４からの所定のタイマの期間に対する応答があるか判断する（ステップＳ５４）。なお、この応答は、前述の通り、ＯＳ・３やＢＩＯＳ・４が正常に機能していることを示すためのＷＤＴのタイマリセットのための処理として行われる通知である。

ＯＳ・３やＢＩＯＳ・４からの所定のタイマ期間に対する応答がある場合（ステップＳ５４：Ｙｅｓ）、削除処理部５３は、不揮発性メモリ２３に保存される有益情報２４を削除するよう制御回路２に対して指示を行う（ステップＳ５５）。この処理により、ＯＳ・３やＢＩＯＳ・４が正常に動作している際、そのタイマ期間における有益情報２４を残すことなく、次の所定のタイマ期間の処理に移行できる。

一方、ＯＳ・３やＢＩＯＳ・４からの所定のタイマ期間に対する応答がない場合（ステップＳ５４：Ｎｏ）、ＯＳ・３あるいはＢＩＯＳ・４の一方、または、双方にストールが生じている可能性がある。そこで、削除処理部５３は、保存された有益情報２４を用いた解析が行えるように、有益情報２４を削除することなく、ステップＳ５６に移行する。

サーバ１の回路に対する直流電源が切られてシャットダウンされると（ステップＳ５６：Ｙｅｓ）、ＢＭＣ・５は、有益情報に関する処理を終了する。一方、処理が継続する場合（ステップＳ５６：Ｎｏ）、ＢＭＣ・５は、ステップＳ５４からＳ５６の処理を繰り返す。

図６は、本発明の一実施形態による正常時における各モジュールの動作の一例を示す図である。
図６において、所定のタイマ期間は“００：０１”であり、時刻“０９：００”から処理が開始している例を示している。図６に示すように、ＯＳ・３の制御回路指示部３１やＢＩＯＳ・４の制御回路指示部４１が、所定のタイマ期間“００：０１”毎に、有益情報の保存を制御回路２に対して指示する。その結果、制御回路２の有益情報処理部２１は、受け取った有益情報を不揮発性メモリ２３に保存する。

また、ＯＳ・３のタイマ処理部３２やＢＩＯＳ・４のタイマ処理部４２は、ＷＤＴのリセットのための応答を行う。これに対応して、ＢＭＣ・５の削除処理部５３は、不揮発性メモリ２３に保存される有益情報２４の削除を制御回路２に対して指示する。

サーバ１の回路に対する直流電源が切られて電源オフ（ＤＣ－ＯＦＦ）に移行する際、ＯＳ・３の制御回路指示部３１やＢＩＯＳ・４の制御回路指示部４１は、保存される有益情報２４の削除を制御回路２に対して指示する。

このように、ＯＳ・３、ＢＩＯＳ・４、ＢＭＣ・５が正常に動作している際、ＯＳ・３やＢＩＯＳ・４は、ＷＤＴの更新時に制御回路２の不揮発性メモリ２３に有益情報２４を設定するが、ＢＭＣ・５の処理の処理により有益情報２４が直ぐに削除される。また、ＤＣ－ＯＦＦ時に、ＯＳ・３の制御回路指示部３１やＢＩＯＳ・４の制御回路指示部４１は、保存される有益情報２４の削除を制御回路２に対して指示する。

よって、ＯＳ・３、ＢＩＯＳ・４、ＢＭＣ・５が正常に動作し、処理を終了した際、不揮発性メモリに有益情報は残らない。

図７は、本発明の一実施形態によるＢＭＣ・５のストール時の各モジュールの動作の一例を示す図である。図７の例では、時刻“１０:００”におけるＢＭＣ・５による有益情報２４の削除の後、符号７１に示すタイミングで、ＢＭＣ・５がストールした例を示す。

図７の例では、ＯＳ・３、ＢＩＯＳ・４は正常に動作し、最後にサーバ１の回路に対する直流電源が切られて電源オフとなる（ＤＣ－ＯＦＦ）。この場合、ＯＳ・３の制御回路指示部３１やＢＩＯＳ・４の制御回路指示部４１は、保存される有益情報２４の削除を制御回路２に対して指示する。よって、ＢＭＣ・５がストールしても、ＯＳ・３やＢＩＯＳ・４が正常に動作していれば、ＤＣ－ＯＦＦ時にＯＳ・３やＢＩＯＳ・４が不揮発性メモリ２３内の有益情報２４の削除の処理をするので、ＤＣ－ＯＦＦ時に不揮発性メモリ２３に有益情報は残らない。

図８は、本発明の一実施形態によるＢＭＣ・５のストール時にＯＳ・３／ＢＩＯＳ・４がストールし、ＮＭＩで復活したときの各モジュールの動作の一例を示す図である。図８の例では、時刻“１１:００”におけるＢＭＣ・５による有益情報２４の削除の後、符号８１に示すタイミングで、ＢＭＣ・５がストールする。さらに、時刻“１１：０２”において、この時刻の有益情報の保存の後、符号８２で示すタイミングでＯＳ・３／ＢＩＯＳ・４がストールする。

この場合、次の所定のタイマ期間“１１：０３”が開始するまでに、制御回路２の復活処理部２２は、ＯＳ・３／ＢＩＯＳ・４によるＷＤＴの更新のための通知を確認できない。そのため、復活処理部２２は、符号８３で示すタイミングで、ＯＳ・３／ＢＩＯＳ・４の復活のためＮＭＩを発行する。図８の例では、符号８４で示すタイミングで、ＮＭＩによる復活処理で、ＯＳ・３／ＢＩＯＳ・４が復活する例を示している。

ＯＳ・３、ＢＩＯＳ・４は、符号８４に示すタイミングでの復活の後、正常に動作する。サーバ１の回路に対する直流電源が切られて電源オフに移行する際（ＤＣ－ＯＦＦ）、ＯＳ・３の制御回路指示部３１やＢＩＯＳ・４の制御回路指示部４１は、保存される有益情報２４の削除を制御回路２に対して指示する。よって、ＢＭＣ・５がストールしても、ＯＳ・３やＢＩＯＳ・４が正常であれば、ＤＣ－ＯＦＦ時にＯＳ・３やＢＩＯＳ・４が不揮発性メモリ２３に保存される有益情報２４の削除の処理をするので、ＤＣ－ＯＦＦ時に不揮発性メモリ２３に有益情報２４は残らない。なお、ＮＭＩにより、ＯＳ・３やＢＩＯＳ・４が復活すれば、ＯＳ・３やＢＩＯＳ・４自身が持つ機能でストールの原因解析のための必要なログを保存することができる。

図９は、本発明の一実施形態によるＢＭＣ・５のストール時にＯＳ・３／ＢＩＯＳ・４がストールし、ＮＭＩで復活しなかったときの各モジュールの動作の一例を示す図である。図９の例では、時刻“１２:００”におけるＢＭＣ・５による有益情報２４の削除の後、符号９１に示すタイミングで、ＢＭＣ・５がストールする。さらに、時刻“１２：０２”において、この時刻の有益情報の保存の後、符号９２で示すタイミングでＯＳ・３／ＢＩＯＳ・４がストールする。

この場合、次の所定のタイマ期間“１２：０３”が開始するまでに、制御回路２の復活処理部２２は、ＯＳ・３／ＢＩＯＳ・４からＷＤＴの更新のための通知を確認できない。そのため、復活処理部２２は、符号９３で示すタイミングで、ＯＳ・３／ＢＩＯＳ・４の復活のためＮＭＩを発行する。図９の例では、符号９３で示すタイミングのＮＭＩによる復活ができない状況を示している。そのため、図９に示すように、ＢＭＣ・５がストールしたときに、ＯＳ・３やＢＩＯＳ・４がストールした場合、ＮＭＩでＯＳ・３やＢＩＯＳ・４が復活しなければ、不揮発性メモリ２３にはＯＳ・３／ＢＩＯＳ・４のストール直前の有益情報２４が不揮発性メモリ２３に保存されている。

図１０は、本発明の一実施形態によるＢＭＣ・５の起動時の各モジュールの動作の一例を示す図である。図１０は、図９に示す状態の後における、サーバ１の再起動時の例を示す。ＢＭＣ・５のメモリチェック部５１は、起動後に不揮発性メモリ２３をチェックすると、有益情報２４が保存されていることを確認する。ＢＭＣ・５のログ処理部５２は、保存されている有益情報２４を、ログとして登録する。

これにより、ＢＭＣ・５がストールして、ＯＳ・３やＢＩＯＳ・４と通信できない時に、ＯＳ・３やＢＩＯＳ・４がストールし復活できない場合でも、ＯＳ・３やＢＩＯＳ・４がストールした直前の情報を取得することができる。しがって、このような場合でも、ＯＳ・３やＢＩＯＳ・４のストールの原因究明を進めることができる。

なお、ＯＳ・３あるいはＢＩＯＳ・４はそれぞれ、制御回路指示部３１、４１、タイマ処理部３２，４２を備えるものとして説明した。これに限定されるものではなく、ＯＳ・３またはＢＩＯＳ・４の一方のストールの原因の解析のみでよい場合、ＯＳ・３あるいはＢＩＯＳ・４のどちらか一方が、制御回路指示部、タイマ処理部を備えるようにしてもよい。

制御回路２が不揮発性メモリ２３を備えるものとして説明した。制御回路２が直接、不揮発性メモリ２３に対する有益情報２４の保存、削除をできる構成であれば、制御回路２が不揮発性メモリ２３を内部に備えなくてもよい。

図１１は、本発明の一実施形態による情報処理装置であるサーバ１の最小構成図を示す図である。サーバ１は、制御回路２と、ＯＳ・３と、ＢＩＯＳ・４と、コントローラであるＢＭＣ・５とを備える。

サーバ１は、ＯＳ・３あるいはＢＩＯＳ・４が停止状態となった際の原因解析に利用される情報である有益情報を記憶する不揮発性メモリ２３を備える。
制御回路２は、指示に従って、不揮発性メモリ２３に有益情報２４を保存または削除する有益情報処理部２１を備える。

ＯＳ・３あるいはＢＩＯＳ・４の一方または双方は、所定のタイマ期間毎に有益情報を制御回路２に送信して保存を指示するとともに、電源オフ時の処理の際に、有益情報２４の削除の指示を制御回路２に対して行う制御回路指示部３１、４１を備える。

ＢＭＣ・５は、ＯＳ・３から独立してサーバ１の状態監視を行い、ＢＭＣ・５が起動した際、不揮発性メモリ２３に有益情報２４が保存されているかを確認するメモリチェック部５１と、不揮発性メモリ２３に有益情報２４が保存されている場合、保存されている有益情報２４に基づきログを登録するログ処理部５２と、制御回路指示部３１、４１により不揮発性メモリ２３に有益情報２４が保存された後、次の所定のタイマ期間の開始前に保存された有益情報２４の削除がなされるよう制御回路２に対して指示を行う削除処理部５３とを備える。

１・・・サーバ
２・・・制御回路
３・・・ＯＳ
４・・・ＢＩＯＳ
５・・・ＢＭＣ
２１・・・有益情報処理部
２２・・・復活処理部
２３・・・不揮発性メモリ
２４・・・有益情報
３１・・・制御回路指示部
３２・・・タイマ処理部
４１・・・制御回路指示部
４２・・・タイマ処理部
５１・・・メモリチェック部
５２・・・ログ処理部
５３・・・削除処理部

Claims

オペレーティングシステムあるいはＢＩＯＳが停止状態となった際の原因解析に利用される情報である有益情報を記憶する不揮発性メモリと、
指示に従って、前記不揮発性メモリに前記有益情報を保存または削除する有益情報処理部を備えた制御回路と、
前記オペレーティングシステムあるいは前記ＢＩＯＳの一方または双方に備えられ、所定のタイマ期間毎に前記有益情報を前記制御回路に送信して保存を指示するとともに、電源オフ時の処理の際に、前記有益情報の削除の指示を前記制御回路に対して行う制御回路指示部と、
前記オペレーティングシステムから独立して情報処理装置の状態監視を行うコントローラと、
を備え、
前記コントローラは、
該コントローラが起動した際、前記不揮発性メモリに前記有益情報が保存されているかを確認するメモリチェック部と、
前記不揮発性メモリに前記有益情報が保存されている場合、保存されている前記有益情報に基づきログを登録するログ処理部と、
前記制御回路指示部により前記不揮発性メモリに前記有益情報が保存された後、次の所定のタイマ期間の開始前に保存された前記有益情報の削除がなされるよう前記制御回路に対して指示を行う削除処理部と
を備える情報処理装置。
前記制御回路は、
前記不揮発性メモリに記憶された前記有益情報が一定期間更新されない場合、前記オペレーティングシステムあるいは前記ＢＩＯＳの停止状態からの復活のためのマスク不可な割り込み命令を前記情報処理装置の中央処理装置に対して発生する復活処理部
を備える、請求項１に記載の情報処理装置。
前記オペレーティングシステムあるいは前記ＢＩＯＳの一方または双方は、前記所定のタイマ期間に応答を行うタイマ処理部、をさらに備え、
前記コントローラの削除処理部は、前記タイマ処理部からの応答に対応して、前記次の所定のタイマ期間の開始前に保存された前記有益情報の削除を行う
請求項１または請求項２に記載の情報処理装置。
前記コントローラの前記削除処理部は、前記ログ処理部による前記ログの登録の後、前記不揮発性メモリに保存された前記有益情報の削除の指示を前記制御回路に対して行う処理をさらに行う、
請求項１から請求項３のいずれか一項に記載の情報処理装置。
オペレーティングシステムあるいはＢＩＯＳが停止状態となった際の原因解析に利用される情報である有益情報を記憶する不揮発性メモリと、
指示に従って、前記不揮発性メモリに前記有益情報を保存または削除する有益情報処理部を備えた制御回路と、
前記オペレーティングシステムあるいは前記ＢＩＯＳの一方または双方に備えられ、所定のタイマ期間毎に前記有益情報を前記制御回路に送信して保存を指示するとともに、電源オフ時の処理の際に、前記有益情報の削除の指示を前記制御回路に対して行う制御回路指示部と、を備えた情報処理装置によって、
オペレーティングシステムから独立して前記情報処理装置の状態監視を行い、
起動した際、前記不揮発性メモリに前記有益情報が保存されているかを確認し、
前記不揮発性メモリに前記有益情報が保存されている場合、保存されている前記有益情報に基づきログを登録し、
前記制御回路指示部により前記不揮発性メモリに前記有益情報が保存された後、次の所定のタイマ期間の開始前に保存された前記有益情報の削除がなされるよう前記制御回路に対して指示を行う
障害監視方法。
オペレーティングシステムあるいはＢＩＯＳが停止状態となった際の原因解析に利用される情報である有益情報を記憶する不揮発性メモリと、
指示に従って、前記不揮発性メモリに前記有益情報を保存または削除する有益情報処理部を備えた制御回路と、
前記オペレーティングシステムあるいは前記ＢＩＯＳの一方または双方に備えられ、所定のタイマ期間毎に前記有益情報を前記制御回路に送信して保存を指示するとともに、電源オフ時の処理の際に、前記有益情報の削除の指示を前記制御回路に対して行う制御回路指示部と、を備えた情報処理装置のための障害監視用コンピュータプログラムであって、
オペレーティングシステムから独立して前記情報処理装置の状態監視を行い、
起動した際、前記不揮発性メモリに前記有益情報が保存されているかを確認し、
前記不揮発性メモリに前記有益情報が保存されている場合、保存されている前記有益情報に基づきログを登録し、
前記制御回路指示部により前記不揮発性メモリに前記有益情報が保存された後、次の所定のタイマ期間の開始前に保存された前記有益情報の削除がなされるよう前記制御回路に対して指示を行う
ことをコンピュータに実行させる、障害監視用コンピュータプログラム。