JP6937957B1 - 半導体装置、表示装置、表示モジュール、及び電子機器 - Google Patents
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Abstract
Description
、マニュファクチャ、または組成物(コンポジション・オブ・マター)に関する。特に、
本発明は、例えば、半導体、半導体装置、表示装置、発光装置、照明装置、蓄電装置、記
憶装置またはプロセッサに関する。または、半導体、半導体装置、表示装置、発光装置、
照明装置、蓄電装置、記憶装置またはプロセッサの製造方法に関する。または、半導体装
置、表示装置、発光装置、照明装置、蓄電装置、記憶装置またはプロセッサの駆動方法に
関する。
全般を指す。表示装置、発光装置、照明装置、電気光学装置、半導体回路および電子機器
は、半導体装置を有する場合がある。
る。当該トランジスタは集積回路や表示装置のような半導体装置に広く応用されている。
トランジスタに適用可能な半導体としてシリコンが知られている。
リコン、単結晶シリコンなどが使い分けられている。例えば、大型の表示装置を構成する
トランジスタに適用する場合、大面積基板への成膜技術が確立されている非晶質シリコン
を用いると好適である。一方、駆動回路と画素回路とを同一基板上に形成するような高機
能の表示装置を構成するトランジスタに適用する場合、高い電界効果移動度を有するトラ
ンジスタを作製可能な多結晶シリコンを用いると好適である。また、集積回路などを構成
するトランジスタに適用する場合、さらに高い電界効果移動度を有する単結晶シリコンを
用いると好適である。多結晶シリコンは、非晶質シリコンに対し高温での熱処理、または
レーザ光処理を行うことで形成する方法が知られる。
を用いて成膜できるため、大型の表示装置を構成するトランジスタの半導体に用いること
ができる。また、酸化物半導体を用いたトランジスタは、高い電界効果移動度を有するた
め、駆動回路と画素回路とを同一基板上に形成するような高機能の表示装置を実現できる
。また、非晶質シリコンを用いたトランジスタの生産設備の一部を改良して利用すること
が可能であるため、設備投資を抑えられるメリットもある。
が小さいことが知られている。例えば、酸化物半導体を用いたトランジスタのリーク特性
を応用した低消費電力のCPUなどが開示されている(特許文献1参照。)。このように
、CPUなどの集積回路に酸化物半導体を用いたトランジスタを応用する場合、トランジ
スタを縮小し、高集積化することが好ましい。
れる寄生容量の影響が無視できなくなる場合がある。特許文献2には、導体電極から半導
体中に電子を流入させることで、オフセット領域が設けられても優れた電気特性を有する
トランジスタが得られることが開示されている。特許文献2に開示された技術を用いるこ
とで、配線や電極などが重なり合うことに起因して形成される寄生容量を低減することが
できる。
移動度を有するトランジスタが得られることが開示されている(特許文献3参照。)。
時の電流の小さいトランジスタを提供することを課題の一とする。または、導通時の電流
の大きいトランジスタを提供することを課題の一とする。または、当該トランジスタを有
する半導体装置を提供することを課題の一とする。または、集積度の高い半導体装置を提
供することを課題の一とする。または、丈夫な半導体装置を提供することを課題の一とす
る。または、新規な半導体装置を提供することを課題の一とする。
態様は、これらの課題の全てを解決する必要はないものとする。なお、これら以外の課題
は、明細書、図面、請求項などの記載から、自ずと明らかとなるものであり、明細書、図
面、請求項などの記載から、これら以外の課題を抽出することが可能である。
本発明の一態様は、半導体と、絶縁体と、第1の導電体と、第2の導電体と、を有する半
導体装置であって、半導体の上面は、絶縁体と接する領域を有し、半導体の側面は、絶縁
体と接する領域を有し、第1の導電体は、絶縁体を介して第1の導電体と半導体とが互い
に重なる第1の領域を有し、第1の領域は、半導体の上面と面する領域と、半導体の側面
と面する領域と、を有し、第2の導電体は、半導体と接する第2の領域を有し、第1の領
域と、第2の領域と、は互いに重ならない半導体装置である。
本発明の一態様は、半導体と、絶縁体と、第1の導電体と、第2の導電体と、第3の導電
体と、を有する半導体装置であって、半導体の上面は、絶縁体と接する領域を有し、半導
体の側面は、絶縁体と接する領域を有し、第1の導電体は、絶縁体を介して第1の導電体
と半導体とが互いに重なる第1の領域を有し、第1の領域は、半導体の上面と面する領域
と、半導体の側面と面する領域と、を有し、第2の導電体は、半導体と接する第2の領域
を有し、第3の導電体は、半導体と接する第3の領域を有し、第2の領域と、第3の領域
と、は互いに重なる領域を有し、第1の領域と、第2の領域と、は互いに重ならない半導
体装置である。
本発明の一態様は、半導体と、第1の絶縁体と、第2の絶縁体と、第1の導電体と、第2
の導電体と、を有する半導体装置であって、半導体は、第1の絶縁体と接する領域と、第
1の導電体および第2の導電体と互いに重ならない第1の領域と、を有し、第1の導電体
は、絶縁体を介して第1の導電体と半導体とが互いに重なる第2の領域を有し、第2の導
電体は、半導体と接する第3の領域を有し、第2の絶縁体は、第1の領域と接する領域を
有する半導体装置である。
本発明の一態様は、第2の絶縁体は、第1の絶縁体よりも比誘電率が高い(3)に記載の
半導体装置である。
本発明の一態様は、半導体上における第1の導電体と、半導体上における第2の導電体と
の間の距離が30nm以下である領域を有する(1)乃至(4)のいずれか一に記載の半
導体装置である。
本発明の一態様は、半導体は、第1の層および第2の層を有し、第1の層の電子親和力と
、第2の層の電子親和力と、は大きさが異なる(1)乃至(5)のいずれか一に記載の半
導体装置である。
本発明の一態様は、半導体が、インジウムおよび酸素を有する(1)乃至(6)のいずれ
か一に記載の半導体装置である。
本発明の一態様は、表示装置、バッテリーまたはセンサーと、(1)乃至(7)のいずれ
か一に記載の半導体装置と、を有する電子機器である。
いトランジスタを提供することができる。または、導通時の電流が大きいトランジスタを
提供することができる。または、当該トランジスタを有する半導体装置を提供することが
できる。または、集積度の高い半導体装置を提供することができる。または、丈夫な半導
体装置を提供することができる。または、新規な半導体装置を提供することができる。
態様は、これらの効果の全てを有する必要はない。なお、これら以外の効果は、明細書、
図面、請求項などの記載から、自ずと明らかとなるものであり、明細書、図面、請求項な
どの記載から、これら以外の効果を抽出することが可能である。
明に限定されず、その形態および詳細を様々に変更し得ることは、当業者であれば容易に
理解される。また、本発明は以下に示す実施の形態の記載内容に限定して解釈されるもの
ではない。なお、図面を用いて発明の構成を説明するにあたり、同じものを指す符号は異
なる図面間でも共通して用いる。なお、同様のものを指す際にはハッチパターンを同じく
し、特に符号を付さない場合がある。
いる場合がある。
との電位差のことを示す場合が多い。よって、電圧を電位と言い換えることが可能である
。
順を示すものではない。そのため、例えば、「第1の」を「第2の」または「第3の」な
どと適宜置き換えて説明することができる。また、本明細書等に記載されている序数詞と
、本発明の一態様を特定するために用いられる序数詞は一致しない場合がある。
ての特性を有する場合がある。また、「半導体」と「絶縁体」は境界が曖昧であり、厳密
に区別できない場合がある。したがって、本明細書に記載の「半導体」は、「絶縁体」と
言い換えることができる場合がある。同様に、本明細書に記載の「絶縁体」は、「半導体
」と言い換えることができる場合がある。
ての特性を有する場合がある。また、「半導体」と「導電体」は境界が曖昧であり、厳密
に区別できない場合がある。したがって、本明細書に記載の「半導体」は、「導電体」と
言い換えることができる場合がある。同様に、本明細書に記載の「導電体」は、「半導体
」と言い換えることができる場合がある。
が0.1原子%未満の元素は不純物である。不純物が含まれることにより、例えば、半導
体にDOS(Density of State)が形成されることや、キャリア移動度
が低下することや、結晶性が低下することなどが起こる場合がある。半導体が酸化物半導
体である場合、半導体の特性を変化させる不純物としては、例えば、第1族元素、第2族
元素、第14族元素、第15族元素、主成分以外の遷移金属などがあり、特に、例えば、
水素(水にも含まれる)、リチウム、ナトリウム、シリコン、ホウ素、リン、炭素、窒素
などがある。酸化物半導体の場合、例えば水素などの不純物の混入によって酸素欠損を形
成する場合がある。また、半導体がシリコンである場合、半導体の特性を変化させる不純
物としては、例えば、酸素、水素を除く第1族元素、第2族元素、第13族元素、第15
族元素などがある。
、これに限定されるものではない。例えば、半導体として、多結晶構造、単結晶構造など
のシリコン、ゲルマニウム、などを用いてもよい。または、歪みシリコンなどの歪みを有
する半導体を用いてもよい。または、半導体としてHEMTに適用可能なヒ化ガリウム、
ヒ化アルミニウムガリウム、ヒ化インジウムガリウム、窒化ガリウム、リン化インジウム
、シリコンゲルマニウムなどを用いてもよい。これらの半導体を用いることで、高速動作
をすることに適したトランジスタとすることができる。
る領域における深さ方向全体の濃度がBである場合、Aのある領域における深さ方向の濃
度の平均値がBである場合、Aのある領域における深さ方向の濃度の中央値がBである場
合、Aのある領域における深さ方向の濃度の最大値がBである場合、Aのある領域におけ
る深さ方向の濃度の最小値がBである場合、Aのある領域における深さ方向の濃度の収束
値がBである場合、測定上Aそのものの確からしい値の得られる領域における濃度がBで
ある場合などを含む。
する、と記載する場合、例えば、Aのある領域における全体の大きさ、長さ、厚さ、幅、
または距離がBである場合、Aのある領域における大きさ、長さ、厚さ、幅、または距離
の平均値がBである場合、Aのある領域における大きさ、長さ、厚さ、幅、または距離の
中央値がBである場合、Aのある領域における大きさ、長さ、厚さ、幅、または距離の最
大値がBである場合、Aのある領域における大きさ、長さ、厚さ、幅、または距離の最小
値がBである場合、Aのある領域における大きさ、長さ、厚さ、幅、または距離の収束値
がBである場合、測定上Aそのものの確からしい値の得られる領域での大きさ、長さ、厚
さ、幅、または距離がBである場合などを含む。
以下では、トランジスタ構造と電気特性の関係について、計算による結果を図1乃至図6
を用いて説明する。
A)の一点鎖線A1−A2および一点鎖線A3−A4に対応する断面図の一例を図1(B
)に示す。なお、図1(A)では、理解を容易にするため、絶縁体などの一部を省略して
示す。
6aと、半導体106a上の半導体106bと、半導体106bと接する領域を有する導
電体116aおよび導電体116bと、導電体116a上、導電体116b上および半導
体106b上にあり、半導体106bの上面および側面、ならびに半導体106aの側面
と接する領域を有する半導体106cと、絶縁体102上および半導体106c上の絶縁
体112と、絶縁体112上にあり、半導体106a、半導体106bおよび半導体10
6cと互いに重なる領域を有する導電体104と、絶縁体102上、導電体116a上、
導電体116b上、半導体106c上および導電体104上の絶縁体108と、を有する
。なお、半導体106bは、導電体116aおよび導電体116bと互いに重なる領域に
、それぞれ領域124aおよび領域124bを有する。なお、本明細書において、半導体
、絶縁体、導電体は、それぞれ半導体層、絶縁層、導電層ともいう。
絶縁体112はゲート絶縁体としての機能を有する。また、導電体104はゲート電極と
しての機能を有する。また、導電体116aおよび導電体116bは、ソース電極および
ドレイン電極としての機能を有する。また、領域124aおよび領域124bは、ソース
領域およびドレイン領域としての機能を有する。また、半導体106bの一部はチャネル
形成領域としての機能を有する。また、半導体106aおよび半導体106cは、半導体
106bに含まれるチャネル形成領域を絶縁体102および絶縁体112から離間させる
機能を有する。
領域124aと領域124bとの間の領域または間隔をLと呼ぶ。また、A1−A2断面
における導電体104と領域124aとの間の領域または間隔をLoff1、導電体10
4と領域124bとの間の領域または間隔をLoff2と呼ぶ。また、A3−A4断面に
おける半導体106bの幅をWと呼ぶ。また、A3−A4断面における導電体104の最
下面から半導体106bの下面までの高さをhと呼ぶ。半導体106bにおいて、導電体
104と互いに重なる領域のみをチャネル形成領域とすれば、Loff1およびLoff
2はオフセット領域となる。
図2(A)の一点鎖線B1−B2および一点鎖線B3−B4に対応する断面図の一例を図
2(B)に示す。なお、図2(A)では、理解を容易にするため、絶縁体などの一部を省
略して示す。
06a上の半導体106bと、半導体106bと接する領域を有する導電体116aおよ
び導電体116bと、導電体116a上、導電体116b上および半導体106b上にあ
り、半導体106bの上面および側面、ならびに半導体106aの側面と接する領域を有
する半導体106cと、絶縁体102上、半導体106c上、導電体116a上および導
電体116b上の絶縁体112と、絶縁体112上にあり、半導体106a、半導体10
6bおよび半導体106cと互いに重なる領域を有する導電体104と、絶縁体102上
、導電体116a上、導電体116b上および導電体104上の絶縁体108と、を有す
る。なお、半導体106bは、導電体116aおよび導電体116bと互いに重なる領域
に、それぞれ領域124aおよび領域124bを有する。
絶縁体112はゲート絶縁体としての機能を有する。また、導電体104はゲート電極と
しての機能を有する。また、導電体116aおよび導電体116bは、ソース電極および
ドレイン電極としての機能を有する。また、領域124aおよび領域124bは、ソース
領域およびドレイン領域としての機能を有する。また、半導体106bの一部はチャネル
形成領域としての機能を有する。また、半導体106aおよび半導体106cは、半導体
106bに含まれるチャネル形成領域を絶縁体102および絶縁体112から離間させる
機能を有する。
領域124aと領域124bとの間隔をLと呼ぶ。また、B1−B2断面における導電体
104と領域124aとの間の領域またはその間隔をLoff1、導電体104と領域1
24bとの間の領域またはその間隔をLoff2と呼ぶ。また、B3−B4断面における
半導体106bの幅をWと呼ぶ。また、B3−B4断面における導電体104の最下面か
ら半導体106bの下面までの高さをhと呼ぶ。半導体106bにおいて、導電体104
と互いに重なる領域のみをチャネル形成領域とすれば、Loff1およびLoff2はオ
フセット領域となる。
。
図3(A)の一点鎖線C1−C2および一点鎖線C3−C4に対応する断面図の一例を図
3(B)に示す。なお、図3(A)では、理解を容易にするため、絶縁体などの一部を省
略して示す。
06a上の半導体106bと、半導体106bと接する領域を有する導電体116aおよ
び導電体116bと、導電体116a上、導電体116b上および半導体106b上にあ
り、半導体106bの上面および側面、ならびに半導体106aの側面と接する領域を有
する半導体106cと、絶縁体102上、半導体106c上、導電体116a上および導
電体116b上の絶縁体112と、絶縁体112上にあり、半導体106a、半導体10
6b、半導体106c、導電体116aおよび導電体116bと互いに重なる領域を有す
る導電体104と、絶縁体102上、導電体116a上、導電体116b上および導電体
104上の絶縁体108と、を有する。なお、半導体106bは、導電体116aおよび
導電体116bと重なる領域に、それぞれ領域124aおよび領域124bを有する。
絶縁体112はゲート絶縁体としての機能を有する。また、導電体104はゲート電極と
しての機能を有する。また、導電体116aおよび導電体116bは、ソース電極および
ドレイン電極としての機能を有する。また、領域124aおよび領域124bは、ソース
領域およびドレイン領域としての機能を有する。また、半導体106bの一部はチャネル
形成領域としての機能を有する。また、半導体106aおよび半導体106cは、半導体
106bに含まれるチャネル形成領域を絶縁体102および絶縁体112から離間させる
機能を有する。
bとの間隔をLと呼ぶ。また、C1−C2断面における導電体104と領域124aとが
互いに重なる領域またはその幅をLov1、導電体104と領域124bとが互いに重な
る領域またはその幅をLov2と呼ぶ。また、C3−C4断面における半導体106bの
幅をWと呼ぶ。また、C3−C4断面における導電体104の最下面から半導体106b
の下面までの高さをhと呼ぶ。半導体106bにおいて、領域124aと領域124bと
の間の導電体104と重なる領域をチャネル形成領域とすれば、Lov1およびLov2
はオーバーラップ領域となる。
導電体104の形状が異なる。具体的には、トランジスタ構造Aおよびトランジスタ構造
Bは、導電体116aおよび導電体116bと導電体104とが互いに重なる領域を有さ
ない構造であるが、トランジスタ構造Cは、導電体116aおよび導電体116bと導電
体104とが互いに重なる領域を有する構造である。
は、オーバーラップ領域を有する構造(トランジスタ構造C)よりもオン電流(Ionと
も表記する。)が小さくなると推測される。これは、オフセット領域がトランジスタのオ
ン抵抗となることに起因する。一方、オーバーラップ領域を有する構造は、オフセット領
域を有する構造よりも寄生容量が大きくなる。なお、オン電流とは、トランジスタのゲー
ト電極にしきい値電圧以上の電圧を印加した際に、ソース−ドレイン間を流れる電流をい
う。
いて、Lの違いによる電気特性の変化を計算により評価する。なお、計算には、syno
psys社のSentaurusを用い、三次元構造を用いる。
状態密度を示す。
ではLgを60nmとし、トランジスタ構造CではLovを20nmとしている。このと
き、Lを60nm、80nm、100nm、120nm、140nmまたは260nmと
して電気特性の計算を行う。また、トランジスタ構造Aおよびトランジスタ構造Bにおけ
るLoff1およびLoff2は、LからLgを差し引いた値を2で除した値となり、具
体的には0nm、10nm、20nm、30nm、40nmまたは100nmとなる。な
お、半導体106aおよび半導体106bの、L方向における長さは、Lに120nmを
加えた値としている。
する)特性を図4に示す。なお、図4において、点線はトランジスタ構造A、破線はトラ
ンジスタ構造B、実線はトランジスタ構造Cを示す。また、図4に示したVg−Id特性
から、各Lにおけるオン電流およびサブスレッショルドスイング値(S値とも表記する。
)を導出し、図5に示す。なお、オン電流は、ドレイン電圧(Vdとも表記する。)を1
Vとし、ゲート電圧をしきい値電圧(Vthとも表記する。)に1.5V加えた電圧とし
たとき、またはゲート電圧が2.7Vのときのドレイン電流を示す。また、サブスレッシ
ョルドスイング値は、ドレイン電圧を1Vとしたとき、または0.1Vとしたときの値を
示す。
タ構造Bのオン電流の比を示す。Lが大きくなるほど、トランジスタ構造Cとのオン電流
の差が広がっていく。
0%程度のオン電流が得られることが示された。また、Lが120nmであってもトラン
ジスタ構造Cの90%程度のオン電流が得られることが示された。また、Lが100nm
であってもトランジスタ構造Cの98%程度のオン電流が得られることが示された。なお
、トランジスタ構造Aは、Lが80nm以下のとき、トランジスタ構造Cよりもオン電流
が高くなることが示された。したがって、オフセット領域がある程度以下の大きさであれ
ば、トランジスタ構造Aとトランジスタ構造Cとはオン電流の差がほとんど見られないこ
とがわかった。具体的には、トランジスタ構造Aにおいて、Loff1およびLoff2
が40nm以下、好ましくは30nm以下、さらに好ましくは20nm以下であるとき、
オン電流が高く、かつ寄生容量の小さいトランジスタが実現できることがわかる。
0%程度のオン電流が得られることが示された。また、Lが100nmであってもトラン
ジスタ構造Cの90%程度のオン電流が得られることが示された。また、Lが80nmで
あってもトランジスタ構造Cの95%程度のオン電流が得られることが示された。したが
って、オフセット領域がある程度以下の大きさであれば、トランジスタ構造Bとトランジ
スタ構造Cとはオン電流の差がほとんど見られないことがわかった。具体的には、トラン
ジスタ構造Cにおいて、Loff1およびLoff2が30nm以下、好ましくは20n
m以下、さらに好ましくは10nm以下であるとき、オン電流が高く、かつ寄生容量の小
さいトランジスタが実現できることがわかる。
ど差のないオン電流が得られた理由としては、ゲート電極(導電体104)によるフリン
ジ電界の寄与が示唆される。即ち、フリンジ電界によって、オフセット領域にもキャリア
が誘起され、大きな抵抗とならなかった可能性がある。
ることで理解できる。トランジスタ構造Aは、トランジスタ構造Bとは絶縁体112をオ
フセット領域上に有さない点が異なる。また、絶縁体108は、絶縁体112よりも高い
比誘電率を有する。そのため、フリンジ電界によるオフセット領域へのキャリアの誘起が
多くなり、よりオン電流の低下が抑制された可能性が高い。このことから、オフセット領
域を有するトランジスタのオン電流には、フリンジ電界が寄与していることがわかる。
4が厚いほど好ましい。例えば、導電体104の厚さを20nm以上、好ましくは30n
m以上、さらに好ましくは50nm以上、より好ましくは100nm以上とすればよい。
体108の比誘電率が高いほど高まる。したがって、半導体106cおよび絶縁体108
の比誘電率が高いほど好ましい。例えば、半導体106cの比誘電率を10以上、好まし
くは15以上、さらに好ましくは20以上、より好ましくは25以上とすればよい。また
、例えば、絶縁体108の比誘電率を5以上、好ましくは10以上、さらに好ましくは1
5以上、より好ましくは20以上とすればよい。
12および絶縁体108の比誘電率が高いほど高まる。したがって、半導体106c、絶
縁体112および絶縁体108の比誘電率が高いほど好ましい。例えば、絶縁体112の
比誘電率を3以上、好ましくは4以上、さらに好ましくは6以上、より好ましくは10以
上とすればよい。また、例えば、半導体106cの比誘電率を10以上、好ましくは15
以上、さらに好ましくは20以上、より好ましくは25以上とすればよい。また、例えば
、絶縁体108の比誘電率を5以上、好ましくは10以上、さらに好ましくは15以上、
より好ましくは20以上とすればよい。
半導体106bを電気的に取り囲むことができる(導電体から生じる電界によって、半導
体を電気的に取り囲むトランジスタの構造を、surrounded channel(
s−channel)構造とよぶ。)。そのため、半導体106bの全体(バルク)にチ
ャネルが形成される場合がある。s−channel構造では、トランジスタのソース−
ドレイン間に大電流を流すことができ、導通時の電流(オン電流)を高くすることができ
る。
で及ぶ。したがって、s−channel構造は、フリンジ電界によるオフセット領域の
低抵抗化に適した構造であることがわかる。
図7(A)は、本発明の一態様に係るトランジスタの上面図の一例である。図7(A)の
一点鎖線D1−D2および一点鎖線D3−D4に対応する断面図の一例を図7(B)に示
す。なお、図7(A)では、理解を容易にするため、絶縁体などの一部を省略して示す。
板400上および導電体413上の凸部を有する絶縁体402と、絶縁体402の凸部上
の半導体406aと、半導体406a上の半導体406bと、半導体406b上の半導体
406cと、半導体406c上の絶縁体412と、絶縁体412上の導電体404と、絶
縁体402上、半導体406b上および導電体404上の絶縁体408と、を有する。な
お、ここでは、導電体413をトランジスタの一部としているが、これに限定されない。
例えば、導電体413がトランジスタとは独立した構成要素であるとしてもよい。
、導電体404は、トランジスタの第1のゲート電極(フロントゲート電極ともいう。)
としての機能を有する。また、導電体413は、トランジスタの第2のゲート電極(バッ
クゲート電極ともいう。)としての機能を有する。また、絶縁体408は、バリア層とし
ての機能を有する。絶縁体408は、例えば、酸素または/および水素をブロックする機
能を有する。または、絶縁体408は、例えば、半導体406aまたは/および半導体4
06cよりも、酸素または/および水素をブロックする能力が高い。
よび導電体424bとそれぞれ電気的に接続していても構わない。なお、導電体426a
および導電体426bは、絶縁体408と、絶縁体408上の絶縁体418と、絶縁体4
18上の絶縁体428と、に設けられた開口部を介して、それぞれトランジスタのソース
領域およびドレイン領域と電気的に接続する。また、導電体424aおよび導電体424
bは、例えば、半導体装置の配線としての機能を有する。
よび側面と接する領域を有する。また、導電体404は、D3−D4断面において、半導
体406cおよび絶縁体412を介して半導体406bの上面および側面と面する。また
、導電体413は、絶縁体402を介して半導体406bの下面と面する。また、絶縁体
402が凸部を有さなくても構わない。また、半導体406cを有さなくても構わない。
また、絶縁体408を有さなくても構わない。
の導電体404と重なる箇所との間の領域が高抵抗であっても、導電体404のフリンジ
電界によって該領域の抵抗が低減されるためトランジスタのオン電流の低下が起こりにく
い構造である。フリンジ電界については、図1乃至図6などの説明を参照する。
、例えば、希ガスなどの不活性な元素、酸素との結合エネルギーの高い元素、酸素との反
応性の高い元素、または酸素と反応して安定な酸化物を形成する元素を含む領域であって
も構わない。また、該領域が、例えば、ヘリウム、ホウ素、炭素、窒素、ネオン、マグネ
シウム、アルミニウム、シリコン、リン、アルゴン、カルシウム、チタン、バナジウム、
クロム、マンガン、鉄、コバルト、ゲルマニウム、クリプトン、ストロンチウム、イット
リウム、ジルコニウム、ニオブ、モリブデン、キセノン、ランタン、セリウム、ネオジム
、ハフニウム、タンタルまたはタングステンから選択された一種以上を含む領域であって
も構わない。該領域が、例えば、上述の元素を5×1019atoms/cm3以上、好
ましくは1×1020atoms/cm3以上、さらに好ましくは2×1020atom
s/cm3以上、より好ましくは5×1020atoms/cm3以上含む領域であって
も構わない。本明細書中では、上述の元素を不純物と呼ぶこともある。
である場合について説明するが、半導体406a、半導体406bおよび半導体406c
が酸化物半導体以外の半導体であってもよい。
である。例えば、過剰酸素を含む酸化シリコンは、加熱処理などによって酸素を放出する
ことができる酸化シリコンである。したがって、絶縁体402は膜中を酸素が移動可能な
絶縁体である。即ち、絶縁体402は酸素透過性を有する絶縁体とすればよい。例えば、
絶縁体402は、半導体406aよりも酸素透過性の高い絶縁体とすればよい。
ある。半導体406b中で酸素欠損は、DOSを形成し、正孔トラップなどとなる。また
、酸素欠損のサイトに水素が入ることによって、キャリアである電子を生成することがあ
る。したがって、半導体406b中の酸素欠損を低減することで、トランジスタに安定し
た電気特性を付与することができる。
0℃以下または100℃以上500℃以下の表面温度の範囲で1×1018atoms/
cm3以上、1×1019atoms/cm3以上または1×1020atoms/cm
3以上の酸素(酸素原子数換算)を放出することもある。
例する。そして標準試料との比較により、気体の全放出量を計算することができる。
測定試料のTDS分析結果から、測定試料の酸素分子の放出量(NO2)は、下に示す式
で求めることができる。ここで、TDS分析で得られる質量電荷比32で検出されるガス
の全てが酸素分子由来と仮定する。CH3OHの質量電荷比は32であるが、存在する可
能性が低いものとしてここでは考慮しない。また、酸素原子の同位体である質量数17の
酸素原子および質量数18の酸素原子を含む酸素分子についても、自然界における存在比
率が極微量であるため考慮しない。
料をTDS分析したときのイオン強度の積分値である。ここで、標準試料の基準値を、N
H2/SH2とする。SO2は、測定試料をTDS分析したときのイオン強度の積分値で
ある。αは、TDS分析におけるイオン強度に影響する係数である。上に示す式の詳細に
関しては、特開平6−275697公報を参照する。なお、上記酸素の放出量は、電子科
学株式会社製の昇温脱離分析装置EMD−WA1000S/Wを用い、標準試料として、
例えば1×1016atoms/cm2の水素原子を含むシリコン基板を用いて測定する
。
子の比率は、酸素分子のイオン化率から算出することができる。なお、上述のαは酸素分
子のイオン化率を含むため、酸素分子の放出量を評価することで、酸素原子の放出量につ
いても見積もることができる。
の放出量の2倍となる。
具体的には、過酸化ラジカルに起因するスピン密度が、5×1017spins/cm3
以上であることをいう。なお、過酸化ラジカルを含む絶縁体は、ESRにて、g値が2.
01近傍に非対称の信号を有することもある。
あってもよい。酸素が過剰な酸化シリコン(SiOX(X>2))は、シリコン原子数の
2倍より多い酸素原子を単位体積当たりに含むものである。単位体積当たりのシリコン原
子数および酸素原子数は、ラザフォード後方散乱法(RBS:Rutherford B
ackscattering Spectrometry)により測定した値である。
できるs−channel構造である。そのため、トランジスタのソース−ドレイン間に
大電流を流すことができ、導通時の電流(オン電流)を高くすることができる。
適した構造といえる。トランジスタを微細化できるため、該トランジスタを有する半導体
装置は、集積度の高い、高密度化された半導体装置とすることが可能となる。例えば、ト
ランジスタは、チャネル長が好ましくは40nm以下、さらに好ましくは30nm以下、
より好ましくは20nm以下の領域を有し、かつ、トランジスタは、チャネル幅が好まし
くは40nm以下、さらに好ましくは30nm以下、より好ましくは20nm以下の領域
を有する。
ジスタがオン状態のときに半導体の中で電流の流れる部分)とゲート電極とが互いに重な
る領域、またはチャネルが形成される領域における、ソース(ソース領域またはソース電
極)とドレイン(ドレイン領域またはドレイン電極)との間の距離をいう。なお、一つの
トランジスタにおいて、チャネル長が全ての領域で同じ値をとるとは限らない。即ち、一
つのトランジスタのチャネル長は、一つの値に定まらない場合がある。そのため、本明細
書では、チャネル長は、チャネルの形成される領域における、いずれか一の値、最大値、
最小値または平均値とする。
に半導体の中で電流の流れる部分)とゲート電極とが互いに重なる領域、またはチャネル
が形成される領域における、ソースとドレインとが向かい合っている部分の長さをいう。
なお、一つのトランジスタにおいて、チャネル幅がすべての領域で同じ値をとるとは限ら
ない。即ち、一つのトランジスタのチャネル幅は、一つの値に定まらない場合がある。そ
のため、本明細書では、チャネル幅は、チャネルの形成される領域における、いずれか一
の値、最大値、最小値または平均値とする。
ル幅(以下、実効的なチャネル幅と呼ぶ。)と、トランジスタの上面図において示される
チャネル幅(以下、見かけ上のチャネル幅と呼ぶ。)と、が異なる場合がある。例えば、
立体的な構造を有するトランジスタでは、実効的なチャネル幅が、トランジスタの上面図
において示される見かけ上のチャネル幅よりも大きくなり、その影響が無視できなくなる
場合がある。例えば、微細かつ立体的な構造を有するトランジスタでは、半導体の上面に
形成されるチャネル領域の割合に対して、半導体の側面に形成されるチャネル領域の割合
が大きくなる場合がある。その場合は、上面図において示される見かけ上のチャネル幅よ
りも、実際にチャネルの形成される実効的なチャネル幅の方が大きくなる。
による見積もりが困難となる場合がある。例えば、設計値から実効的なチャネル幅を見積
もるためには、半導体の形状が既知という仮定が必要である。したがって、半導体の形状
が正確にわからない場合には、実効的なチャネル幅を正確に測定することは困難である。
重なる領域における、ソースとドレインとが向かい合っている部分の長さである見かけ上
のチャネル幅を、「囲い込みチャネル幅(SCW:Surrounded Channe
l Width)」と呼ぶ場合がある。また、本明細書では、単にチャネル幅と記載した
場合には、囲い込みチャネル幅または見かけ上のチャネル幅を指す場合がある。または、
本明細書では、単にチャネル幅と記載した場合には、実効的なチャネル幅を指す場合があ
る。なお、チャネル長、チャネル幅、実効的なチャネル幅、見かけ上のチャネル幅、囲い
込みチャネル幅などは、断面TEM像などを取得して、その画像を解析することなどによ
って、値を決定することができる。
る場合、囲い込みチャネル幅を用いて計算する場合がある。その場合には、実効的なチャ
ネル幅を用いて計算する場合とは異なる値をとる場合がある。
タのしきい値電圧をプラス方向またはマイナス方向へ変動させてもよい。例えば、トラン
ジスタのしきい値電圧をプラス方向に変動させることで、ゲート電圧が0Vであってもト
ランジスタが非導通状態(オフ状態)となる、ノーマリーオフが実現できる場合がある。
なお、導電体413に印加する電圧は、可変であってもよいし、固定であってもよい。導
電体413に印加する電圧を可変にする場合、電圧を制御する回路を導電体413と電気
的に接続してもよい。
て説明する。
例えば、インジウムを含むと、キャリア移動度(電子移動度)が高くなる。また、半導体
406bは、元素Mを含むと好ましい。元素Mは、好ましくは、アルミニウム、ガリウム
、イットリウムまたはスズなどとする。そのほかの元素Mに適用可能な元素としては、ホ
ウ素、シリコン、チタン、鉄、ニッケル、ゲルマニウム、イットリウム、ジルコニウム、
モリブデン、ランタン、セリウム、ネオジム、ハフニウム、タンタル、タングステンなど
がある。ただし、元素Mとして、前述の元素を複数組み合わせても構わない場合がある。
元素Mは、例えば、酸素との結合エネルギーが高い元素である。例えば、酸素との結合エ
ネルギーがインジウムよりも高い元素である。または、元素Mは、例えば、酸化物半導体
のエネルギーギャップを大きくする機能を有する元素である。また、半導体406bは、
亜鉛を含むと好ましい。酸化物半導体は、亜鉛を含むと結晶化しやすくなる場合がある。
6bは、例えば、亜鉛スズ酸化物、ガリウムスズ酸化物などの、インジウムを含まず、亜
鉛を含む酸化物半導体、ガリウムを含む酸化物半導体、スズを含む酸化物半導体などであ
っても構わない。
bのエネルギーギャップは、例えば、2.5eV以上4.2eV以下、好ましくは2.8
eV以上3.8eV以下、さらに好ましくは3eV以上3.5eV以下とする。
元素のうち一種以上、または二種以上から構成される酸化物半導体である。半導体406
bを構成する酸素以外の元素のうち一種以上、または二種以上から半導体406aおよび
半導体406cが構成されるため、半導体406aと半導体406bとの界面、および半
導体406bと半導体406cとの界面において、界面準位が形成されにくい。
と好ましい。なお、半導体406aがIn−M−Zn酸化物のとき、InおよびMの和を
100atomic%としたとき、好ましくはInが50atomic%未満、Mが50
atomic%以上、さらに好ましくはInが25atomic%未満、Mが75ato
mic%以上とする。また、半導体406bがIn−M−Zn酸化物のとき、Inおよび
Mの和を100atomic%としたとき、好ましくはInが25atomic%以上、
Mが75atomic%未満、さらに好ましくはInが34atomic%以上、Mが6
6atomic%未満とする。また、半導体406cがIn−M−Zn酸化物のとき、I
nおよびMの和を100atomic%としたとき、好ましくはInが50atomic
%未満、Mが50atomic%以上、さらに好ましくはInが25atomic%未満
、Mが75atomic%以上とする。なお、半導体406cは、半導体406aと同種
の酸化物を用いても構わない。
物を用いる。例えば、半導体406bとして、半導体406aおよび半導体406cより
も電子親和力の0.07eV以上1.3eV以下、好ましくは0.1eV以上0.7eV
以下、さらに好ましくは0.15eV以上0.4eV以下大きい酸化物を用いる。なお、
電子親和力は、真空準位と伝導帯下端のエネルギーとの差である。
。そのため、半導体406cがインジウムガリウム酸化物を含むと好ましい。ガリウム原
子割合[Ga/(In+Ga)]は、例えば、70%以上、好ましくは80%以上、さら
に好ましくは90%以上とする。
のうち、電子親和力の大きい半導体406bにチャネルが形成される。
との混合領域を有する場合がある。また、半導体406bと半導体406cとの間には、
半導体406bと半導体406cとの混合領域を有する場合がある。混合領域は、界面準
位密度が低くなる。そのため、半導体406a、半導体406bおよび半導体406cの
積層体は、それぞれの界面近傍において、エネルギーが連続的に変化する(連続接合とも
いう。)バンド構造となる。なお、図32(A)は、半導体406a、半導体406bお
よび半導体406cが、この順番に積層した断面図である。図32(B)は、図32(A
)の一点鎖線P1−P2に対応する伝導帯下端のエネルギー(Ec)であり、半導体40
6aより半導体406cの電子親和力が大きい場合を示す。また、図32(C)は、半導
体406aより半導体406cの電子親和力が小さい場合を示す。
中を主として移動する。上述したように、半導体406aおよび半導体406bの界面に
おける界面準位密度、半導体406bと半導体406cとの界面における界面準位密度を
低くすることによって、半導体406b中で電子の移動が阻害されることが少なく、トラ
ンジスタのオン電流を高くすることができる。
できる。例えば、電子の移動を阻害する要因のない場合、効率よく電子が移動すると推定
される。電子の移動は、例えば、チャネル形成領域の物理的な凹凸が大きい場合にも阻害
される。
(被形成面、ここでは半導体406a)の、1μm×1μmの範囲における二乗平均平方
根(RMS:Root Mean Square)粗さが1nm未満、好ましくは0.6
nm未満、さらに好ましくは0.5nm未満、より好ましくは0.4nm未満とすればよ
い。また、1μm×1μmの範囲における平均面粗さ(Raともいう。)が1nm未満、
好ましくは0.6nm未満、さらに好ましくは0.5nm未満、より好ましくは0.4n
m未満とすればよい。また、1μm×1μmの範囲における最大高低差(P−Vともいう
。)が10nm未満、好ましくは9nm未満、さらに好ましくは8nm未満、より好まし
くは7nm未満とすればよい。RMS粗さ、RaおよびP−Vは、エスアイアイ・ナノテ
クノロジー株式会社製走査型プローブ顕微鏡システムSPA−500などを用いて測定す
ることができる。
がある。よって、チャネル形成領域における酸素欠損を低減することがトランジスタに安
定した電気特性を付与するためには重要となる。一方、トランジスタのソース領域および
ドレイン領域に酸化物半導体を用いる場合、酸素欠損に起因して酸化物半導体を低抵抗化
させることができる。よって、トランジスタのオン電流を大きくするために酸素欠損を有
するほうがよい場合がある。
水素が入り込むことでドナー準位を形成することがある。以下では酸素欠損のサイトに水
素が入り込んだ状態をVOHと表記する場合がある。なお、酸素欠損のサイトは、水素が
入るよりも酸素が入る方が安定する。したがって、酸化物半導体に酸素を供給することで
、VOHを低減することができる。
ャネルが形成される。したがって、半導体406bが厚いほどチャネル領域は大きくなる
。即ち、半導体406bが厚いほど、トランジスタのオン電流を高くすることができる。
例えば、20nm以上、好ましくは40nm以上、さらに好ましくは60nm以上、より
好ましくは100nm以上の厚さの領域を有する半導体406bとすればよい。ただし、
半導体装置の生産性が低下する場合があるため、例えば、300nm以下、好ましくは2
00nm以下、さらに好ましくは150nm以下の厚さの領域を有する半導体406bと
すればよい。
好ましい。例えば、10nm未満、好ましくは5nm以下、さらに好ましくは3nm以下
の領域を有する半導体406cとすればよい。一方、半導体406cは、チャネルの形成
される半導体406bへ、隣接する絶縁体を構成する酸素以外の元素(水素、シリコンな
ど)が入り込まないようブロックする機能を有する。そのため、半導体406cは、ある
程度の厚さを有することが好ましい。例えば、0.3nm以上、好ましくは1nm以上、
さらに好ましくは2nm以上の厚さの領域を有する半導体406cとすればよい。また、
半導体406cは、絶縁体402などから放出される酸素の外方拡散を抑制するために、
酸素をブロックする性質を有すると好ましい。
好ましい。例えば、10nm以上、好ましくは20nm以上、さらに好ましくは40nm
以上、より好ましくは60nm以上の厚さの領域を有する半導体406aとすればよい。
半導体406aの厚さを、厚くすることで、隣接する絶縁体と半導体406aとの界面か
らチャネルの形成される半導体406bまでの距離を離すことができる。ただし、半導体
装置の生産性が低下する場合があるため、例えば、200nm以下、好ましくは120n
m以下、さらに好ましくは80nm以下の厚さの領域を有する半導体406aとすればよ
い。
IMS:Secondary Ion Mass Spectrometry)において
、1×1019atoms/cm3未満、好ましくは5×1018atoms/cm3未
満、さらに好ましくは2×1018atoms/cm3未満のシリコン濃度となる領域を
有する。また、半導体406bと半導体406cとの間に、SIMSにおいて、1×10
19atoms/cm3未満、好ましくは5×1018atoms/cm3未満、さらに
好ましくは2×1018atoms/cm3未満のシリコン濃度となる領域を有する。
cの水素濃度を低減すると好ましい。半導体406aおよび半導体406cは、SIMS
において、2×1020atoms/cm3以下、好ましくは5×1019atoms/
cm3以下、より好ましくは1×1019atoms/cm3以下、さらに好ましくは5
×1018atoms/cm3以下の水素濃度となる領域を有する。また、半導体406
bの窒素濃度を低減するために、半導体406aおよび半導体406cの窒素濃度を低減
すると好ましい。半導体406aおよび半導体406cは、SIMSにおいて、5×10
19atoms/cm3未満、好ましくは5×1018atoms/cm3以下、より好
ましくは1×1018atoms/cm3以下、さらに好ましくは5×1017atom
s/cm3以下の窒素濃度となる領域を有する。
プは、トランジスタのしきい値電圧をプラス方向へ変動させる場合がある。したがって、
半導体406bの表面または内部における銅濃度は低いほど好ましい。例えば、半導体4
06bは、銅濃度が1×1019atoms/cm3以下、5×1018atoms/c
m3以下、または1×1018atoms/cm3以下となる領域を有すると好ましい。
また、半導体406aの表面または内部における銅濃度は低いほど好ましい。例えば、半
導体406aは、銅濃度が1×1019atoms/cm3以下、5×1018atom
s/cm3以下、または1×1018atoms/cm3以下となる領域を有すると好ま
しい。また、半導体406cの表面または内部における銅濃度は低いほど好ましい。例え
ば、半導体406cは、銅濃度が1×1019atoms/cm3以下、5×1018a
toms/cm3以下、または1×1018atoms/cm3以下となる領域を有する
と好ましい。
構造としても構わない。または、半導体406aの上もしくは下、または半導体406c
上もしくは下に、半導体406a、半導体406bおよび半導体406cとして例示した
半導体のいずれか一を有する4層構造としても構わない。または、半導体406aの上、
半導体406aの下、半導体406cの上、半導体406cの下のいずれか二箇所以上に
、半導体406a、半導体406bおよび半導体406cとして例示した半導体のいずれ
か一を有するn層構造(nは5以上の整数)としても構わない。
れている状態をいう。したがって、−5°以上5°以下の場合も含まれる。また、「略平
行」とは、二つの直線が−30°以上30°以下の角度で配置されている状態をいう。ま
た、「垂直」とは、二つの直線が80°以上100°以下の角度で配置されている状態を
いう。したがって、85°以上95°以下の場合も含まれる。また、「略垂直」とは、二
つの直線が60°以上120°以下の角度で配置されている状態をいう。
。
以下では、酸化物半導体の構造について説明する。
る。非単結晶酸化物半導体としては、CAAC−OS(C Axis Aligned
Crystalline Oxide Semiconductor)、多結晶酸化物半
導体、nc−OS(nanocrystalline Oxide Semicondu
ctor)、擬似非晶質酸化物半導体(a−like OS:amorphous li
ke Oxide Semiconductor)、非晶質酸化物半導体などがある。
導体とに分けられる。結晶性酸化物半導体としては、単結晶酸化物半導体、CAAC−O
S、多結晶酸化物半導体、nc−OSなどがある。
て不均質構造を持たないことなどが知られている。また、結合角度が柔軟であり、短距離
秩序性は有するが、長距離秩序性を有さない構造と言い換えることもできる。
ely amorphous)酸化物半導体と呼ぶことはできない。また、等方的でない
(例えば、微小な領域において周期構造を有する)酸化物半導体を、完全な非晶質酸化物
半導体と呼ぶことはできない。ただし、a−like OSは、微小な領域において周期
構造を有するものの、鬆を有し、不安定な構造である。そのため、物性的には非晶質酸化
物半導体に近いといえる。
まずは、CAAC−OSについて説明する。
導体の一つである。
scope)によって、CAAC−OSの明視野像と回折パターンとの複合解析像(高分
解能TEM像ともいう。)を観察すると、複数のペレットを確認することができる。一方
、高分解能TEM像ではペレット同士の境界、即ち結晶粒界(グレインバウンダリーとも
いう。)を明確に確認することができない。そのため、CAAC−OSは、結晶粒界に起
因する電子移動度の低下が起こりにくいといえる。
試料面と略平行な方向から観察したCAAC−OSの断面の高分解能TEM像を示す。高
分解能TEM像の観察には、球面収差補正(Spherical Aberration
Corrector)機能を用いた。球面収差補正機能を用いた高分解能TEM像を、
特にCs補正高分解能TEM像と呼ぶ。Cs補正高分解能TEM像の取得は、例えば、日
本電子株式会社製原子分解能分析電子顕微鏡JEM−ARM200Fなどによって行うこ
とができる。
図27(B)より、ペレットにおいて、金属原子が層状に配列していることを確認できる
。金属原子の各層の配列は、CAAC−OSの膜を形成する面(被形成面ともいう。)ま
たは上面の凹凸を反映しており、CAAC−OSの被形成面または上面と平行となる。
は、特徴的な原子配列を、補助線で示したものである。図27(B)および図27(C)
より、ペレット一つの大きさは1nm以上3nm以下程度であり、ペレットとペレットと
の傾きにより生じる隙間の大きさは0.8nm程度であることがわかる。したがって、ペ
レットを、ナノ結晶(nc:nanocrystal)と呼ぶこともできる。また、CA
AC−OSを、CANC(C−Axis Aligned nanocrystals)
を有する酸化物半導体と呼ぶこともできる。
ト5100の配置を模式的に示すと、レンガまたはブロックが積み重なったような構造と
なる(図27(D)参照。)。図27(C)で観察されたペレットとペレットとの間で傾
きが生じている箇所は、図27(D)に示す領域5161に相当する。
補正高分解能TEM像を示す。図28(A)の領域(1)、領域(2)および領域(3)
を拡大したCs補正高分解能TEM像を、それぞれ図28(B)、図28(C)および図
28(D)に示す。図28(B)、図28(C)および図28(D)より、ペレットは、
金属原子が三角形状、四角形状または六角形状に配列していることを確認できる。しかし
ながら、異なるペレット間で、金属原子の配列に規則性は見られない。
AC−OSについて説明する。例えば、InGaZnO4の結晶を有するCAAC−OS
に対し、out−of−plane法による構造解析を行うと、図29(A)に示すよう
に回折角(2θ)が31°近傍にピークが現れる場合がある。このピークは、InGaZ
nO4の結晶の(009)面に帰属されることから、CAAC−OSの結晶がc軸配向性
を有し、c軸が被形成面または上面に略垂直な方向を向いていることが確認できる。
近傍のピークの他に、2θが36°近傍にもピークが現れる場合がある。2θが36°近
傍のピークは、CAAC−OS中の一部に、c軸配向性を有さない結晶が含まれることを
示している。より好ましいCAAC−OSは、out−of−plane法による構造解
析では、2θが31°近傍にピークを示し、2θが36°近傍にピークを示さない。
e法による構造解析を行うと、2θが56°近傍にピークが現れる。このピークは、In
GaZnO4の結晶の(110)面に帰属される。CAAC−OSの場合は、2θを56
°近傍に固定し、試料面の法線ベクトルを軸(φ軸)として試料を回転させながら分析(
φスキャン)を行っても、図29(B)に示すように明瞭なピークは現れない。これに対
し、InGaZnO4の単結晶酸化物半導体であれば、2θを56°近傍に固定してφス
キャンした場合、図29(C)に示すように(110)面と等価な結晶面に帰属されるピ
ークが6本観察される。したがって、XRDを用いた構造解析から、CAAC−OSは、
a軸およびb軸の配向が不規則であることが確認できる。
nO4の結晶を有するCAAC−OSに対し、試料面に平行にプローブ径が300nmの
電子線を入射させると、図30(A)に示すような回折パターン(制限視野透過電子回折
パターンともいう。)が現れる場合がある。この回折パターンには、InGaZnO4の
結晶の(009)面に起因するスポットが含まれる。したがって、電子回折によっても、
CAAC−OSに含まれるペレットがc軸配向性を有し、c軸が被形成面または上面に略
垂直な方向を向いていることがわかる。一方、同じ試料に対し、試料面に垂直にプローブ
径が300nmの電子線を入射させたときの回折パターンを図30(B)に示す。図30
(B)より、リング状の回折パターンが確認される。したがって、電子回折によっても、
CAAC−OSに含まれるペレットのa軸およびb軸は配向性を有さないことがわかる。
なお、図30(B)における第1リングは、InGaZnO4の結晶の(010)面およ
び(100)面などに起因すると考えられる。また、図30(B)における第2リングは
(110)面などに起因すると考えられる。
晶性は不純物の混入や欠陥の生成などによって低下する場合があるため、逆の見方をする
とCAAC−OSは不純物や欠陥(酸素欠損など)の少ない酸化物半導体ともいえる。
元素などがある。例えば、シリコンなどの、酸化物半導体を構成する金属元素よりも酸素
との結合力の強い元素は、酸化物半導体から酸素を奪うことで酸化物半導体の原子配列を
乱し、結晶性を低下させる要因となる。また、鉄やニッケルなどの重金属、アルゴン、二
酸化炭素などは、原子半径(または分子半径)が大きいため、酸化物半導体の原子配列を
乱し、結晶性を低下させる要因となる。
る。例えば、酸化物半導体に含まれる不純物は、キャリアトラップとなる場合や、キャリ
ア発生源となる場合がある。また、酸化物半導体中の酸素欠損は、キャリアトラップとな
る場合や、水素を捕獲することによってキャリア発生源となる場合がある。
る。具体的には、キャリア密度を8×1011/cm3未満、好ましくは1×1011/
cm3未満、さらに好ましくは1×1010/cm3未満であり、1×10−9/cm3
以上とすることができる。そのような酸化物半導体を、高純度真性または実質的に高純度
真性な酸化物半導体と呼ぶ。CAAC−OSは、不純物濃度が低く、欠陥準位密度が低い
。即ち、安定な特性を有する酸化物半導体であるといえる。
次に、nc−OSについて説明する。
な結晶部を確認することのできない領域と、を有する。nc−OSに含まれる結晶部は、
1nm以上10nm以下、または1nm以上3nm以下の大きさであることが多い。なお
、結晶部の大きさが10nmより大きく100nm以下である酸化物半導体を微結晶酸化
物半導体と呼ぶことがある。nc−OSは、例えば、高分解能TEM像では、結晶粒界を
明確に確認できない場合がある。なお、ナノ結晶は、CAAC−OSにおけるペレットと
起源を同じくする可能性がある。そのため、以下ではnc−OSの結晶部をペレットと呼
ぶ場合がある。
nm以下の領域)において原子配列に周期性を有する。また、nc−OSは、異なるペレ
ット間で結晶方位に規則性が見られない。そのため、膜全体で配向性が見られない。した
がって、nc−OSは、分析方法によっては、a−like OSや非晶質酸化物半導体
と区別が付かない場合がある。例えば、nc−OSに対し、ペレットよりも大きい径のX
線を用いた場合、out−of−plane法による解析では、結晶面を示すピークは検
出されない。また、nc−OSに対し、ペレットよりも大きいプローブ径(例えば50n
m以上)の電子線を用いる電子回折を行うと、ハローパターンのような回折パターンが観
測される。一方、nc−OSに対し、ペレットの大きさと近いかペレットより小さいプロ
ーブ径の電子線を用いるナノビーム電子回折を行うと、スポットが観測される。また、n
c−OSに対しナノビーム電子回折を行うと、円を描くように(リング状に)輝度の高い
領域が観測される場合がある。さらに、リング状の領域内に複数のスポットが観測される
場合がある。
OSを、RANC(Random Aligned nanocrystals)を有す
る酸化物半導体、またはNANC(Non−Aligned nanocrystals
)を有する酸化物半導体と呼ぶこともできる。
nc−OSは、a−like OSや非晶質酸化物半導体よりも欠陥準位密度が低くなる
。ただし、nc−OSは、異なるペレット間で結晶方位に規則性が見られない。そのため
、nc−OSは、CAAC−OSと比べて欠陥準位密度が高くなる。
a−like OSは、nc−OSと非晶質酸化物半導体との間の構造を有する酸化物半
導体である。
場合がある。また、高分解能TEM像において、明確に結晶部を確認することのできる領
域と、結晶部を確認することのできない領域と、を有する。
OSが、CAAC−OSおよびnc−OSと比べて不安定な構造であることを示すため
、電子照射による構造の変化を示す。
試料Bと表記する。)およびCAAC−OS(試料Cと表記する。)を準備する。いずれ
の試料もIn−Ga−Zn酸化物である。
は、いずれも結晶部を有することがわかる。
InGaZnO4の結晶の単位格子は、In−O層を3層有し、またGa−Zn−O層を
6層有する、計9層がc軸方向に層状に重なった構造を有することが知られている。これ
らの近接する層同士の間隔は、(009)面の格子面間隔(d値ともいう。)と同程度で
あり、結晶構造解析からその値は0.29nmと求められている。したがって、格子縞の
間隔が0.28nm以上0.30nm以下である箇所を、InGaZnO4の結晶部と見
なすことができる。なお、格子縞は、InGaZnO4の結晶のa−b面に対応する。
。ただし、上述した格子縞の長さを結晶部の大きさとしている。図31より、a−lik
e OSは、電子の累積照射量に応じて結晶部が大きくなっていくことがわかる。具体的
には、図31中に(1)で示すように、TEMによる観察初期においては1.2nm程度
の大きさだった結晶部(初期核ともいう。)が、累積照射量が4.2×108e−/nm
2においては2.6nm程度の大きさまで成長していることがわかる。一方、nc−OS
およびCAAC−OSは、電子照射開始時から電子の累積照射量が4.2×108e−/
nm2までの範囲で、結晶部の大きさに変化が見られないことがわかる。具体的には、図
31中の(2)および(3)で示すように、電子の累積照射量によらず、nc−OSおよ
びCAAC−OSの結晶部の大きさは、それぞれ1.4nm程度および2.1nm程度で
あることがわかる。
る。一方、nc−OSおよびCAAC−OSは、電子照射による結晶部の成長がほとんど
見られないことがわかる。即ち、a−like OSは、nc−OSおよびCAAC−O
Sと比べて、不安定な構造であることがわかる。
て密度の低い構造である。具体的には、a−like OSの密度は、同じ組成の単結晶
の密度の78.6%以上92.3%未満となる。また、nc−OSの密度およびCAAC
−OSの密度は、同じ組成の単結晶の密度の92.3%以上100%未満となる。単結晶
の密度の78%未満となる酸化物半導体は、成膜すること自体が困難である。
面体晶構造を有する単結晶InGaZnO4の密度は6.357g/cm3となる。よっ
て、例えば、In:Ga:Zn=1:1:1[原子数比]を満たす酸化物半導体において
、a−like OSの密度は5.0g/cm3以上5.9g/cm3未満となる。また
、例えば、In:Ga:Zn=1:1:1[原子数比]を満たす酸化物半導体において、
nc−OSの密度およびCAAC−OSの密度は5.9g/cm3以上6.3g/cm3
未満となる。
単結晶を組み合わせることにより、所望の組成における単結晶に相当する密度を見積もる
ことができる。所望の組成の単結晶に相当する密度は、組成の異なる単結晶を組み合わせ
る割合に対して、加重平均を用いて見積もればよい。ただし、密度は、可能な限り少ない
種類の単結晶を組み合わせて見積もることが好ましい。
お、酸化物半導体は、例えば、非晶質酸化物半導体、a−like OS、nc−OS、
CAAC−OSのうち、二種以上を有する積層膜であってもよい。
を用いればよい。絶縁体基板としては、例えば、ガラス基板、石英基板、サファイア基板
、安定化ジルコニア基板(イットリア安定化ジルコニア基板など)、樹脂基板などがある
。また、半導体基板としては、例えば、シリコン、ゲルマニウムなどの単体半導体基板、
または炭化シリコン、シリコンゲルマニウム、ヒ化ガリウム、リン化インジウム、酸化亜
鉛、酸化ガリウムなどの化合物半導体基板などがある。さらには、前述の半導体基板内部
に絶縁体領域を有する半導体基板、例えばSOI(Silicon On Insula
tor)基板などがある。導電体基板としては、黒鉛基板、金属基板、合金基板、導電性
樹脂基板などがある。または、金属の窒化物を有する基板、金属の酸化物を有する基板な
どがある。さらには、絶縁体基板に導電体または半導体が設けられた基板、半導体基板に
導電体または絶縁体が設けられた基板、導電体基板に半導体または絶縁体が設けられた基
板などがある。または、これらの基板に素子が設けられたものを用いてもよい。基板に設
けられる素子としては、容量素子、抵抗素子、スイッチ素子、発光素子、記憶素子などが
ある。
ジスタを設ける方法としては、非可とう性の基板上にトランジスタを作製した後、トラン
ジスタを剥離し、可とう性基板である基板400に転置する方法もある。その場合には、
非可とう性基板とトランジスタとの間に剥離層を設けるとよい。なお、基板400として
、繊維を編みこんだシート、フィルムまたは箔などを用いてもよい。また、基板400が
伸縮性を有してもよい。また、基板400は、折り曲げや引っ張りをやめた際に、元の形
状に戻る性質を有してもよい。または、元の形状に戻らない性質を有してもよい。基板4
00の厚さは、例えば、5μm以上700μm以下、好ましくは10μm以上500μm
以下、さらに好ましくは15μm以上300μm以下とする。基板400を薄くすると、
半導体装置を軽量化することができる。また、基板400を薄くすることで、ガラスなど
を用いた場合にも伸縮性を有する場合や、折り曲げや引っ張りをやめた際に、元の形状に
戻る性質を有する場合がある。そのため、落下などによって基板400上の半導体装置に
加わる衝撃などを緩和することができる。即ち、丈夫な半導体装置を提供することができ
る。
たはそれらの繊維などを用いることができる。可とう性基板である基板400は、線膨張
率が低いほど環境による変形が抑制されて好ましい。可とう性基板である基板400とし
ては、例えば、線膨張率が1×10−3/K以下、5×10−5/K以下、または1×1
0−5/K以下である材質を用いればよい。樹脂としては、例えば、ポリエステル、ポリ
オレフィン、ポリアミド(ナイロン、アラミドなど)、ポリイミド、ポリカーボネート、
アクリルなどがある。特に、アラミドは、線膨張率が低いため、可とう性基板である基板
400として好適である。
ニウム、チタン、クロム、マンガン、コバルト、ニッケル、銅、亜鉛、ガリウム、イット
リウム、ジルコニウム、モリブデン、ルテニウム、銀、インジウム、スズ、タンタルおよ
びタングステンを一種以上含む導電体を、単層で、または積層で用いればよい。例えば、
合金や化合物であってもよく、アルミニウムを含む導電体、銅およびチタンを含む導電体
、銅およびマンガンを含む導電体、インジウム、スズおよび酸素を含む導電体、チタンお
よび窒素を含む導電体などを用いてもよい。
ルミニウム、シリコン、リン、塩素、アルゴン、ガリウム、ゲルマニウム、イットリウム
、ジルコニウム、ランタン、ネオジム、ハフニウムまたはタンタルを含む絶縁体を、単層
で、または積層で用いればよい。なお、絶縁体402が、窒化酸化シリコン、窒化シリコ
ンなどの窒素を含む絶縁体を含んでも構わない。
半導体406bが酸化物半導体である場合、絶縁体402は、半導体406bに酸素を供
給する役割を担うことができる。
ルミニウム、シリコン、リン、塩素、アルゴン、ガリウム、ゲルマニウム、イットリウム
、ジルコニウム、ランタン、ネオジム、ハフニウムまたはタンタルを含む絶縁体を、単層
で、または積層で用いればよい。
ニウム、チタン、クロム、マンガン、コバルト、ニッケル、銅、亜鉛、ガリウム、イット
リウム、ジルコニウム、モリブデン、ルテニウム、銀、インジウム、スズ、タンタルおよ
びタングステンを一種以上含む導電体を、単層で、または積層で用いればよい。例えば、
合金や化合物であってもよく、アルミニウムを含む導電体、銅およびチタンを含む導電体
、銅およびマンガンを含む導電体、インジウム、スズおよび酸素を含む導電体、チタンお
よび窒素を含む導電体などを用いてもよい。
ルミニウム、シリコン、リン、塩素、アルゴン、ガリウム、ゲルマニウム、イットリウム
、ジルコニウム、ランタン、ネオジム、ハフニウムまたはタンタルを含む絶縁体を、単層
で、または積層で用いればよい。絶縁体408は、好ましくは酸化アルミニウム、窒化酸
化シリコン、窒化シリコン、酸化ガリウム、酸化イットリウム、酸化ジルコニウム、酸化
ランタン、酸化ネオジム、酸化ハフニウムまたは酸化タンタルを含む絶縁体を、単層で、
または積層で用いればよい。
ルミニウム、シリコン、リン、塩素、アルゴン、ガリウム、ゲルマニウム、イットリウム
、ジルコニウム、ランタン、ネオジム、ハフニウムまたはタンタルを含む絶縁体を、単層
で、または積層で用いればよい。絶縁体418は、好ましくは酸化シリコンまたは酸化窒
化シリコンを含む絶縁体を、単層で、または積層で用いればよい。
ルミニウム、シリコン、リン、塩素、アルゴン、ガリウム、ゲルマニウム、イットリウム
、ジルコニウム、ランタン、ネオジム、ハフニウムまたはタンタルを含む絶縁体を、単層
で、または積層で用いればよい。絶縁体428は、好ましくは酸化シリコンまたは酸化窒
化シリコンを含む絶縁体を、単層で、または積層で用いればよい。
シリコン、リン、アルミニウム、チタン、クロム、マンガン、コバルト、ニッケル、銅、
亜鉛、ガリウム、イットリウム、ジルコニウム、モリブデン、ルテニウム、銀、インジウ
ム、スズ、タンタルおよびタングステンを一種以上含む導電体を、単層で、または積層で
用いればよい。例えば、合金や化合物であってもよく、アルミニウムを含む導電体、銅お
よびチタンを含む導電体、銅およびマンガンを含む導電体、インジウム、スズおよび酸素
を含む導電体、チタンおよび窒素を含む導電体などを用いてもよい。
シリコン、リン、アルミニウム、チタン、クロム、マンガン、コバルト、ニッケル、銅、
亜鉛、ガリウム、イットリウム、ジルコニウム、モリブデン、ルテニウム、銀、インジウ
ム、スズ、タンタルおよびタングステンを一種以上含む導電体を、単層で、または積層で
用いればよい。例えば、合金や化合物であってもよく、アルミニウムを含む導電体、銅お
よびチタンを含む導電体、銅およびマンガンを含む導電体、インジウム、スズおよび酸素
を含む導電体、チタンおよび窒素を含む導電体などを用いてもよい。
極である導電体413とが、電気的に接続しない例を示したが、本発明の一態様に係るト
ランジスタの構造はこれに限定されない。例えば、図8(A)に示すように、導電体40
4と導電体413とが導電体405などを介して電気的に接続する構造であっても構わな
い。このような構成とすることで、導電体404と導電体413とに同じ電位が供給され
るため、トランジスタのスイッチング特性を向上させることができる。または、図8(B
)に示すように、導電体413を有さない構造であっても構わない。
電体426aおよび導電体426bが、半導体406bと接する領域を有する例を示した
が、本発明の一態様に係るトランジスタの構造はこれに限定されない。例えば、図9(A
)に示すように、導電体426aおよび導電体426bが半導体406bおよび半導体4
06aを貫通して、絶縁体402と接する領域を有していても構わない。または、図9(
B)に示すように、半導体406bを貫通して、半導体406aと接する領域を有してい
ても構わない。
のみ配置される例を示したが、本発明の一態様に係るトランジスタの構造はこれに限定さ
れない。例えば、図10(A)に示すように、半導体406cおよび絶縁体412を、半
導体406bおよび半導体406aを覆うように配置しても構わない。または、図10(
B)に示すように、半導体406cを半導体406bと重なるように配置し、絶縁体41
2を半導体406c、半導体406bおよび半導体406aを覆うように配置しても構わ
ない。
図11(A)は、本発明の一態様に係るトランジスタの上面図の一例である。図11(A
)の一点鎖線E1−E2および一点鎖線E3−E4に対応する断面図の一例を図11(B
)に示す。なお、図11(A)では、理解を容易にするため、絶縁体などの一部を省略し
て示す。
、基板400上および導電体413上の凸部を有する絶縁体402と、絶縁体402の凸
部上の半導体406aと、半導体406a上の半導体406bと、半導体406bの上面
と接する領域を有し、半導体406bの側面と接しない導電体416aおよび導電体41
6bと、半導体406b上の、導電体416aおよび導電体416bと重ならない領域に
配置された半導体406cと、半導体406c上の絶縁体412と、絶縁体412上の導
電体404と、絶縁体402上、半導体406b上および導電体404上の絶縁体408
と、を有する。なお、ここでは、導電体413をトランジスタの一部としているが、これ
に限定されない。例えば、導電体413がトランジスタとは独立した構成要素であるとし
てもよい。
ッ素、シリコン、リン、アルミニウム、チタン、クロム、マンガン、コバルト、ニッケル
、銅、亜鉛、ガリウム、イットリウム、ジルコニウム、モリブデン、ルテニウム、銀、イ
ンジウム、スズ、タンタルおよびタングステンを一種以上含む導電体を、単層で、または
積層で用いればよい。例えば、合金や化合物であってもよく、アルミニウムを含む導電体
、銅およびチタンを含む導電体、銅およびマンガンを含む導電体、インジウム、スズおよ
び酸素を含む導電体、チタンおよび窒素を含む導電体などを用いてもよい。
および導電体416bを有する点が異なるが、そのほかの構成については類似している。
したがって、図11に示すトランジスタの詳細は、図7などに示したトランジスタについ
ての記載を参酌することができる。
および導電体416bを有する分だけ、オン電流の大きいトランジスタを実現することが
できる場合がある。
図12(A)は、本発明の一態様に係るトランジスタの上面図の一例である。図12(A
)の一点鎖線F1−F2および一点鎖線F3−F4に対応する断面図の一例を図12(B
)に示す。なお、図12(A)では、理解を容易にするため、絶縁体などの一部を省略し
て示す。
、基板400上および導電体413上の凸部を有する絶縁体402と、絶縁体402の凸
部上の半導体406aと、半導体406a上の半導体406bと、半導体406bの上面
および側面と接する領域を有する導電体416aおよび導電体416bと、半導体406
b上の、導電体416aおよび導電体416bと重ならない領域に配置された半導体40
6cと、半導体406c上の絶縁体412と、絶縁体412上の導電体404と、絶縁体
402上、半導体406b上および導電体404上の絶縁体408と、を有する。なお、
ここでは、導電体413をトランジスタの一部としているが、これに限定されない。例え
ば、導電体413がトランジスタとは独立した構成要素であるとしてもよい。
よび導電体416bが半導体406bの側面と接する領域を有する点が異なるが、そのほ
かの構成については類似している。したがって、図12に示すトランジスタの詳細は、図
11などに示したトランジスタについての記載を参酌することができる。
aおよび導電体416bが半導体406bの側面に接する領域を有する分だけ、オン電流
の大きいトランジスタを実現することができる場合がある。
電極である導電体413とが、電気的に接続しない例を示したが、本発明の一態様に係る
トランジスタの構造はこれに限定されない。例えば、図13(A)に示すように、導電体
404と導電体413とが接する領域を有する構造であっても構わない。このような構成
とすることで、導電体404と導電体413とに同じ電位が供給されるため、トランジス
タのスイッチング特性を向上させることができる。または、図13(B)に示すように、
導電体413を有さない構造であっても構わない。
にのみ配置される例を示したが、本発明の一態様に係るトランジスタの構造はこれに限定
されない。例えば、図14(A)に示すように、半導体406cを、半導体406bおよ
び半導体406aを覆うように配置しても構わない。または、図14(B)に示すように
、半導体406cを、半導体406bおよび半導体406aを覆うように配置し、絶縁体
412を導電体416a、導電体416b、半導体406c、半導体406bおよび半導
体406aを覆うように配置しても構わない。
図15(A)は、本発明の一態様に係るトランジスタの上面図の一例である。図15(A
)の一点鎖線G1−G2および一点鎖線G3−G4に対応する断面図の一例を図15(B
)に示す。なお、図15(A)では、理解を容易にするため、絶縁体などの一部を省略し
て示す。
、基板400上および導電体413上の凸部を有する絶縁体402と、絶縁体402の凸
部上の半導体406aと、半導体406a上の半導体406bと、半導体406bの上面
および側面と接する領域を有する導電体416aおよび導電体416bと、半導体406
b上の、導電体416aと重ならず、導電体416bと重なる領域に配置された半導体4
06cと、半導体406c上の絶縁体412と、絶縁体412上の導電体404と、絶縁
体402上、半導体406b上および導電体404上の絶縁体408と、を有する。なお
、図15に示すトランジスタは、導電体404が導電体416bと重なる領域を有する。
なお、ここでは、導電体413をトランジスタの一部としているが、これに限定されない
。例えば、導電体413がトランジスタとは独立した構成要素であるとしてもよい。
電体416bと重なる領域を有する点が異なるが、そのほかの構成については類似してい
る。したがって、図15に示すトランジスタの詳細は、図12などに示したトランジスタ
についての記載を参酌することができる。
る導電体404と、チャネル形成領域としての機能を有する半導体406bとが互いに重
なる領域をLov領域と呼ぶ。
を低下させる場合がある。したがって、図15(B)に示すLov領域の大きさは、チャ
ネル形成領域の大きさの100%未満、好ましくは80%未満、さらに好ましくは50%
未満とする。例えば、Lov領域の大きさは、50nm未満、好ましくは20nm未満、
さらに好ましくは10nm未満とする。
が導電体416bと重なる領域を有する分だけ、オン電流の大きいトランジスタを実現す
ることができる場合がある。
態様の範疇に含まれる。
以下では、本発明の一態様に係る半導体装置を例示する。
する。
装置は、下部に第1の半導体を用いたトランジスタ2200を有し、上部に第2の半導体
を用いたトランジスタ2100を有している。図16(A)では、第2の半導体を用いた
トランジスタ2100として、図11で例示したトランジスタを適用した例を示している
。
。例えば、第1の半導体を酸化物半導体以外の半導体とし、第2の半導体を酸化物半導体
とする。第1の半導体として多結晶構造、単結晶構造などのシリコン、ゲルマニウム、な
どを用いてもよい。または、歪みシリコンなどの歪みを有する半導体を用いてもよい。ま
たは、第1の半導体として高電子移動度トランジスタ(HEMT:High Elect
ron Mobility Transistor)に適用可能なヒ化ガリウム、ヒ化ア
ルミニウムガリウム、ヒ化インジウムガリウム、窒化ガリウム、リン化インジウム、シリ
コンゲルマニウムなどを用いてもよい。これらの半導体を第1の半導体に用いることで、
高速動作をすることに適したトランジスタ2200とすることができる。また、酸化物半
導体を第2の半導体に用いることで、オフ電流の小さいトランジスタ2100とすること
ができる。
によって適切なトランジスタを用いる。また、トランジスタ2100または/およびトラ
ンジスタ2200として、上述したトランジスタや図16(A)に示したトランジスタを
用いなくても構わない場合がある。
ンジスタ2200の上部にトランジスタ2100を有する。また、トランジスタ2200
とトランジスタ2100の間には、配線として機能する複数の導電体2202が配置され
ている。また各種絶縁体に埋め込まれた複数の導電体2203により、上層と下層にそれ
ぞれ配置された配線や電極が電気的に接続されている。また、該半導体装置は、トランジ
スタ2100上の絶縁体2204と、絶縁体2204上の導電体2205と、トランジス
タ2100のソース電極およびドレイン電極と同一層に(同一工程を経て)形成された導
電体2206と、を有する。
ニウム、シリコン、リン、塩素、アルゴン、ガリウム、ゲルマニウム、イットリウム、ジ
ルコニウム、ランタン、ネオジム、ハフニウムまたはタンタルを含む絶縁体を、単層で、
または積層で用いればよい。なお、絶縁体2204が、窒化酸化シリコン、窒化シリコン
などの窒素を含む絶縁体を含んでも構わない。
クリル、シリコーンなどを含む樹脂を用いればよい。樹脂を用いることで、絶縁体220
4の上面を平坦化処理しなくてもよい場合がある。また、樹脂は短い時間で厚い膜を成膜
することができるため、生産性を高めることができる。
とができる。
結晶シリコンを用いた場合、トランジスタ2200の第1の半導体の近傍の絶縁体の水素
濃度が高いことが好ましい。該水素により、シリコンのダングリングボンドを終端させる
ことで、トランジスタ2200の信頼性を向上させることができる。一方、トランジスタ
2100に用いる第2の半導体に酸化物半導体を用いた場合、トランジスタ2100の第
2の半導体の近傍の絶縁体の水素濃度が低いことが好ましい。該水素は、酸化物半導体中
にキャリアを生成する要因の一つとなるため、トランジスタ2100の信頼性を低下させ
る要因となる場合がある。したがって、単結晶シリコンを用いたトランジスタ2200、
および酸化物半導体を用いたトランジスタ2100を積層する場合、これらの間に水素を
ブロックする機能を有する絶縁体2207を配置することは両トランジスタの信頼性を高
めるために有効である。
ム、酸化窒化ガリウム、酸化イットリウム、酸化窒化イットリウム、酸化ハフニウム、酸
化窒化ハフニウム、イットリア安定化ジルコニア(YSZ)などを含む絶縁体を、単層で
、または積層で用いればよい。
上に水素をブロックする機能を有する絶縁体を形成することが好ましい。絶縁体としては
、絶縁体2207と同様の絶縁体を用いることができ、特に酸化アルミニウムを適用する
ことが好ましい。酸化アルミニウム膜は、水素、水分などの不純物および酸素の双方に対
して膜を透過させない遮断効果が高い。したがって、トランジスタ2100を覆う絶縁体
2208として酸化アルミニウム膜を用いることで、トランジスタ2100に含まれる酸
化物半導体からの酸素の脱離を防止するとともに、酸化物半導体への水および水素の混入
を防止することができる。
トランジスタとすることができる。例えば、FIN(フィン)型のトランジスタなどとす
ることができる。その場合の断面図の例を、図16(B)に示す。半導体基板2211の
上に、絶縁体2212が配置されている。半導体基板2211は、先端の細い凸部(フィ
ンともいう。)を有する。なお、凸部は、先端が細くなくてもよく、例えば、略直方体の
凸部であってもよいし、先端が太い凸部であってもよい。半導体基板2211の凸部の上
には、ゲート絶縁体2214が配置され、その上には、ゲート電極2213が配置されて
いる。半導体基板2211には、ソース領域およびドレイン領域2215が形成されてい
る。なお、ここでは、半導体基板2211が、凸部を有する例を示したが、本発明の一態
様に係る半導体装置は、これに限定されない。例えば、SOI基板を加工して、凸型の半
導体領域を形成しても構わない。
せることにより、様々な回路を構成することができる。以下では、本発明の一態様の半導
体装置を用いることにより実現できる回路構成の例を説明する。
ランジスタ2100を直列に接続し、かつそれぞれのゲートを接続した、いわゆるCMO
Sインバータの構成を示している。
ぞれのソースとドレインを接続した構成を示している。このような構成とすることで、い
わゆるCMOSアナログスイッチとして機能させることができる。
持が可能で、かつ、書き込み回数にも制限が無い半導体装置(記憶装置)の一例を図18
に示す。
半導体を用いたトランジスタ3300、および容量素子3400を有している。なお、ト
ランジスタ3300としては、上述したトランジスタを用いることができる。
00のオフ電流が小さいことにより、半導体装置の特定のノードに長期にわたり記憶内容
を保持することが可能である。つまり、リフレッシュ動作を必要としない、またはリフレ
ッシュ動作の頻度が極めて少なくすることが可能となるため、消費電力の低い半導体装置
となる。
接続され、第2の配線3002はトランジスタ3200のドレインと電気的に接続される
。また、第3の配線3003はトランジスタ3300のソース、ドレインの一方と電気的
に接続され、第4の配線3004はトランジスタ3300のゲートと電気的に接続されて
いる。そして、トランジスタ3200のゲート、およびトランジスタ3300のソース、
ドレインの他方は、容量素子3400の電極の一方と電気的に接続され、第5の配線30
05は容量素子3400の電極の他方と電気的に接続されている。
う特性を有することで、以下に示すように、情報の書き込み、保持、読み出しが可能であ
る。
ンジスタ3300が導通状態となる電位にして、トランジスタ3300を導通状態とする
。これにより、第3の配線3003の電位が、トランジスタ3200のゲート、および容
量素子3400の電極の一方と電気的に接続するノードFGに与えられる。すなわち、ト
ランジスタ3200のゲートには、所定の電荷が与えられる(書き込み)。ここでは、異
なる二つの電位レベルを与える電荷(以下Lowレベル電荷、Highレベル電荷という
。)のどちらかが与えられるものとする。その後、第4の配線3004の電位を、トラン
ジスタ3300が非導通状態となる電位にして、トランジスタ3300を非導通状態とす
ることにより、ノードFGに電荷が保持される(保持)。
って保持される。
えた状態で、第5の配線3005に適切な電位(読み出し電位)を与えると、第2の配線
3002は、ノードFGに保持された電荷量に応じた電位をとる。これは、トランジスタ
3200をnチャネル型とすると、トランジスタ3200のゲートにHighレベル電荷
が与えられている場合の見かけ上のしきい値電圧Vth_Hは、トランジスタ3200の
ゲートにLowレベル電荷が与えられている場合の見かけ上のしきい値電圧Vth_Lよ
り低くなるためである。ここで、見かけ上のしきい値電圧とは、トランジスタ3200を
「導通状態」とするために必要な第5の配線3005の電位をいうものとする。したがっ
て、第5の配線3005の電位をVth_HとVth_Lの間の電位V0とすることによ
り、ノードFGに与えられた電荷を判別できる。例えば、書き込みにおいて、ノードFG
にHighレベル電荷が与えられていた場合には、第5の配線3005の電位がV0(>
Vth_H)となれば、トランジスタ3200は「導通状態」となる。一方、ノードFG
にLowレベル電荷が与えられていた場合には、第5の配線3005の電位がV0(<V
th_L)となっても、トランジスタ3200は「非導通状態」のままである。このため
、第2の配線3002の電位を判別することで、ノードFGに保持されている情報を読み
出すことができる。
を読み出さなくてはならない。ほかのメモリセルの情報を読み出さないためには、ノード
FGに与えられた電荷によらずトランジスタ3200が「非導通状態」となるような電位
、つまり、Vth_Hより低い電位を第5の配線3005に与えればよい。または、ノー
ドFGに与えられた電荷によらずトランジスタ3200が「導通状態」となるような電位
、つまり、Vth_Lより高い電位を第5の配線3005に与えればよい。
示した半導体装置と異なる。この場合も図18(A)に示した半導体装置と同様の動作に
より情報の書き込みおよび保持動作が可能である。
タ3300が導通状態になると、浮遊状態である第3の配線3003と容量素子3400
とが導通し、第3の配線3003と容量素子3400の間で電荷が再分配される。その結
果、第3の配線3003の電位が変化する。第3の配線3003の電位の変化量は、容量
素子3400の電極の一方の電位(または容量素子3400に蓄積された電荷)によって
、異なる値をとる。
の配線3003が有する容量成分をCB、電荷が再分配される前の第3の配線3003の
電位をVB0とすると、電荷が再分配された後の第3の配線3003の電位は、(CB×
VB0+C×V)/(CB+C)となる。したがって、メモリセルの状態として、容量素
子3400の電極の一方の電位がV1とV0(V1>V0)の2つの状態をとるとすると
、電位V1を保持している場合の第3の配線3003の電位(=(CB×VB0+C×V
1)/(CB+C))は、電位V0を保持している場合の第3の配線3003の電位(=
(CB×VB0+C×V0)/(CB+C))よりも高くなることがわかる。
ができる。
ンジスタを用い、トランジスタ3300として第2の半導体が適用されたトランジスタを
駆動回路上に積層して配置する構成とすればよい。
を適用することで、長期にわたって記憶内容を保持することが可能となる。つまり、リフ
レッシュ動作が不要となるか、またはリフレッシュ動作の頻度を極めて低くすることが可
能となるため、消費電力の低い半導体装置を実現することができる。また、電力の供給が
ない場合(ただし、電位は固定されていることが好ましい)であっても、長期にわたって
記憶内容を保持することが可能である。
りにくい。例えば、従来の不揮発性メモリのように、フローティングゲートへの電子の注
入や、フローティングゲートからの電子の引き抜きを行わないため、絶縁体の劣化といっ
た問題が生じない。すなわち、本発明の一態様に係る半導体装置は、従来の不揮発性メモ
リで問題となっている書き換え可能回数に制限はなく、信頼性が飛躍的に向上した半導体
装置である。さらに、トランジスタの導通状態、非導通状態によって、情報の書き込みが
行われるため、高速な動作が可能となる。
以下では、上述したトランジスタ、または記憶装置を含むRFタグについて、図19を用
いて説明する。
接触手段、例えば無線通信を用いて外部と情報の授受を行うものである。このような特徴
から、RFタグは、物品などの個体情報を読み取ることにより物品の識別を行う個体認証
システムなどに用いることが可能である。なお、これらの用途に用いるためには高い信頼
性が要求される。
ロック図である。
いう)に接続されたアンテナ802から送信される無線信号803を受信するアンテナ8
04を有する。またRFタグ800は、整流回路805、定電圧回路806、復調回路8
07、変調回路808、論理回路809、記憶回路810、ROM811を有している。
なお、復調回路807に含まれる整流作用を示すトランジスタの半導体には、逆方向電流
を十分に抑制することが可能な、例えば、酸化物半導体を用いてもよい。これにより、逆
方向電流に起因する整流作用の低下を抑制し、復調回路の出力が飽和することを防止でき
る。つまり、復調回路の入力に対する復調回路の出力を線形に近づけることができる。な
お、データの伝送形式は、一対のコイルを対向配置して相互誘導によって交信を行う電磁
結合方式、誘導電磁界によって交信する電磁誘導方式、電波を利用して交信する電波方式
の3つに大別される。RFタグ800は、そのいずれの方式に用いることも可能である。
テナ802との間で無線信号803の送受信を行うためのものである。また、整流回路8
05は、アンテナ804で無線信号を受信することにより生成される入力交流信号を整流
、例えば、半波2倍圧整流し、後段の容量素子により、整流された信号を平滑化すること
で入力電位を生成するための回路である。なお、整流回路805の入力側または出力側に
は、リミッタ回路を有してもよい。リミッタ回路とは、入力交流信号の振幅が大きく、内
部生成電圧が大きい場合に、ある電力以上の電力を後段の回路に入力しないように制御す
るための回路である。
回路である。なお、定電圧回路806は、内部にリセット信号生成回路を有していてもよ
い。リセット信号生成回路は、安定した電源電圧の立ち上がりを利用して、論理回路80
9のリセット信号を生成するための回路である。
るための回路である。また、変調回路808は、アンテナ804より出力するデータに応
じて変調をおこなうための回路である。
入力された情報を保持する回路であり、ロウデコーダ、カラムデコーダ、記憶領域などを
有する。また、ROM811は、固有番号(ID)などを格納し、処理に応じて出力を行
うための回路である。
係る記憶装置は、電源が遮断された状態であっても情報を保持できるため、RFタグに好
適である。さらに本発明の一態様に係る記憶装置は、データの書き込みに必要な電力(電
圧)が従来の不揮発性メモリに比べて低いため、データの読み出し時と書込み時の最大通
信距離の差を生じさせないことも可能である。さらに、データの書き込み時に電力が不足
し、誤動作または誤書込みが生じることを抑制することができる。
ため、ROM811に適用することもできる。その場合には、生産者がROM811にデ
ータを書き込むためのコマンドを別途用意し、ユーザが自由に書き換えできないようにし
ておくことが好ましい。生産者が出荷前に固有番号を書込んだのちに製品を出荷すること
で、作製したRFタグすべてについて固有番号を付与するのではなく、出荷する良品にの
み固有番号を割り当てることが可能となり、出荷後の製品の固有番号が不連続になること
がなく出荷後の製品に対応した顧客管理が容易となる。
以下では、本発明の一態様に係るRFタグの使用例について図20を用いて説明する。R
Fタグの用途は広範にわたるが、例えば、紙幣、硬貨、有価証券類、無記名債券類、証書
類(運転免許証や住民票等、図20(A)参照。)、包装用容器類(包装紙やボトル等、
図20(C)参照。)、記録媒体(DVDやビデオテープ等、図20(B)参照。)、乗
り物類(自転車等、図20(D)参照。)、身の回り品(鞄や眼鏡等)、食品類、植物類
、動物類、人体、衣類、生活用品類、薬品や薬剤を含む医療品、または電子機器(液晶表
示装置、EL表示装置、テレビジョン装置、または携帯電話)等の物品、もしくは各物品
に取り付ける荷札(図20(E)および図20(F)参照。)等に設けて使用することが
できる。
品に固定される。例えば、本であれば紙に埋め込み、有機樹脂からなるパッケージであれ
ば当該有機樹脂の内部に埋め込み、各物品に固定される。本発明の一態様に係るRFタグ
4000は、小型、薄型、軽量を実現するため、物品に固定した後もその物品自体のデザ
イン性を損なうことがない。また、紙幣、硬貨、有価証券類、無記名債券類、または証書
類等に本発明の一態様に係るRFタグ4000により、認証機能を付与することができ、
この認証機能を活用すれば、偽造を防止することができる。また、包装用容器類、記録媒
体、身の回り品、食品類、衣類、生活用品類、または電子機器等に本発明の一態様に係る
RFタグ4000を取り付けることにより、検品システム等のシステムの効率化を図るこ
とができる。また、乗り物類であっても、本発明の一態様に係るRFタグ4000を取り
付けることにより、盗難などに対するセキュリティ性を高めることができる。
できる。
以下では、上述したトランジスタや上述した記憶装置などの半導体装置を含むCPUにつ
いて説明する。
ある。
ic logic unit、演算回路)、ALUコントローラ1192、インストラク
ションデコーダ1193、インタラプトコントローラ1194、タイミングコントローラ
1195、レジスタ1196、レジスタコントローラ1197、バスインターフェース1
198(Bus I/F)、書き換え可能なROM1199、およびROMインターフェ
ース1189(ROM I/F)を有している。基板1190は、半導体基板、SOI基
板、ガラス基板などを用いる。ROM1199およびROMインターフェース1189は
、別チップに設けてもよい。もちろん、図21に示すCPUは、その構成を簡略化して示
した一例にすぎず、実際のCPUはその用途によって多種多様な構成を有している。例え
ば、図21に示すCPUまたは演算回路を含む構成を一つのコアとし、当該コアを複数含
み、それぞれのコアが並列で動作するような構成としてもよい。また、CPUが内部演算
回路やデータバスで扱えるビット数は、例えば8ビット、16ビット、32ビット、64
ビットなどとすることができる。
デコーダ1193に入力され、デコードされた後、ALUコントローラ1192、インタ
ラプトコントローラ1194、レジスタコントローラ1197、タイミングコントローラ
1195に入力される。
ラ1197、タイミングコントローラ1195は、デコードされた命令に基づき、各種制
御を行なう。具体的にALUコントローラ1192は、ALU1191の動作を制御する
ための信号を生成する。また、インタラプトコントローラ1194は、CPUのプログラ
ム実行中に、外部の入出力装置や、周辺回路からの割り込み要求を、その優先度やマスク
状態から判断し、処理する。レジスタコントローラ1197は、レジスタ1196のアド
レスを生成し、CPUの状態に応じてレジスタ1196の読み出しや書き込みを行なう。
2、インストラクションデコーダ1193、インタラプトコントローラ1194、および
レジスタコントローラ1197の動作のタイミングを制御する信号を生成する。例えばタ
イミングコントローラ1195は、基準クロック信号CLK1を元に、内部クロック信号
CLK2を生成する内部クロック生成部を備えており、内部クロック信号CLK2を上記
各種回路に供給する。
1196のメモリセルとして、上述したトランジスタや記憶装置などを用いることができ
る。
指示に従い、レジスタ1196における保持動作の選択を行う。すなわち、レジスタ11
96が有するメモリセルにおいて、フリップフロップによるデータの保持を行うか、容量
素子によるデータの保持を行うかを、選択する。フリップフロップによるデータの保持が
選択されている場合、レジスタ1196内のメモリセルへの、電源電圧の供給が行われる
。容量素子におけるデータの保持が選択されている場合、容量素子へのデータの書き換え
が行われ、レジスタ1196内のメモリセルへの電源電圧の供給を停止することができる
。
である。記憶素子1200は、電源遮断で記憶データが揮発する回路1201と、電源遮
断で記憶データが揮発しない回路1202と、スイッチ1203と、スイッチ1204と
、論理素子1206と、容量素子1207と、選択機能を有する回路1220と、を有す
る。回路1202は、容量素子1208と、トランジスタ1209と、トランジスタ12
10と、を有する。なお、記憶素子1200は、必要に応じて、ダイオード、抵抗素子、
インダクタなどのその他の素子をさらに有していてもよい。
への電源電圧の供給が停止した際、回路1202のトランジスタ1209のゲートにはG
ND(0V)、またはトランジスタ1209がオフする電位が入力され続ける構成とする
。例えば、トランジスタ1209のゲートが抵抗等の負荷を介して接地される構成とする
。
て構成され、スイッチ1204は、一導電型とは逆の導電型(例えば、pチャネル型)の
トランジスタ1214を用いて構成した例を示す。ここで、スイッチ1203の第1の端
子はトランジスタ1213のソースとドレインの一方に対応し、スイッチ1203の第2
の端子はトランジスタ1213のソースとドレインの他方に対応し、スイッチ1203は
トランジスタ1213のゲートに入力される制御信号RDによって、第1の端子と第2の
端子の間の導通または非導通(つまり、トランジスタ1213の導通状態または非導通状
態)が選択される。スイッチ1204の第1の端子はトランジスタ1214のソースとド
レインの一方に対応し、スイッチ1204の第2の端子はトランジスタ1214のソース
とドレインの他方に対応し、スイッチ1204はトランジスタ1214のゲートに入力さ
れる制御信号RDによって、第1の端子と第2の端子の間の導通または非導通(つまり、
トランジスタ1214の導通状態または非導通状態)が選択される。
ちの一方、およびトランジスタ1210のゲートと電気的に接続される。ここで、接続部
分をノードM2とする。トランジスタ1210のソースとドレインの一方は、低電源電位
を供給することのできる配線(例えばGND線)に電気的に接続され、他方は、スイッチ
1203の第1の端子(トランジスタ1213のソースとドレインの一方)と電気的に接
続される。スイッチ1203の第2の端子(トランジスタ1213のソースとドレインの
他方)はスイッチ1204の第1の端子(トランジスタ1214のソースとドレインの一
方)と電気的に接続される。スイッチ1204の第2の端子(トランジスタ1214のソ
ースとドレインの他方)は電源電位VDDを供給することのできる配線と電気的に接続さ
れる。スイッチ1203の第2の端子(トランジスタ1213のソースとドレインの他方
)と、スイッチ1204の第1の端子(トランジスタ1214のソースとドレインの一方
)と、論理素子1206の入力端子と、容量素子1207の一対の電極のうちの一方と、
は電気的に接続される。ここで、接続部分をノードM1とする。容量素子1207の一対
の電極のうちの他方は、一定の電位が入力される構成とすることができる。例えば、低電
源電位(GND等)または高電源電位(VDD等)が入力される構成とすることができる
。容量素子1207の一対の電極のうちの他方は、低電源電位を供給することのできる配
線(例えばGND線)と電気的に接続される。容量素子1208の一対の電極のうちの他
方は、一定の電位が入力される構成とすることができる。例えば、低電源電位(GND等
)または高電源電位(VDD等)が入力される構成とすることができる。容量素子120
8の一対の電極のうちの他方は、低電源電位を供給することのできる配線(例えばGND
線)と電気的に接続される。
積極的に利用することによって省略することも可能である。
びスイッチ1204は、制御信号WEとは異なる制御信号RDによって第1の端子と第2
の端子の間の導通状態または非導通状態を選択され、一方のスイッチの第1の端子と第2
の端子の間が導通状態のとき他方のスイッチの第1の端子と第2の端子の間は非導通状態
となる。
に対応する信号が入力される。図22では、回路1201から出力された信号が、トラン
ジスタ1209のソースとドレインの他方に入力される例を示した。スイッチ1203の
第2の端子(トランジスタ1213のソースとドレインの他方)から出力される信号は、
論理素子1206によってその論理値が反転された反転信号となり、回路1220を介し
て回路1201に入力される。
レインの他方)から出力される信号は、論理素子1206および回路1220を介して回
路1201に入力する例を示したがこれに限定されない。スイッチ1203の第2の端子
(トランジスタ1213のソースとドレインの他方)から出力される信号が、論理値を反
転させられることなく、回路1201に入力されてもよい。例えば、回路1201内に、
入力端子から入力された信号の論理値が反転した信号が保持されるノードが存在する場合
に、スイッチ1203の第2の端子(トランジスタ1213のソースとドレインの他方)
から出力される信号を当該ノードに入力することができる。
タ1209以外のトランジスタは、酸化物半導体以外の半導体でなる膜または基板119
0にチャネルが形成されるトランジスタとすることができる。例えば、シリコンまたはシ
リコン基板にチャネルが形成されるトランジスタとすることができる。また、記憶素子1
200に用いられるトランジスタ全てを、チャネルが酸化物半導体で形成されるトランジ
スタとすることもできる。または、記憶素子1200は、トランジスタ1209以外にも
、チャネルが酸化物半導体で形成されるトランジスタを含んでいてもよく、残りのトラン
ジスタは酸化物半導体以外の半導体でなる層または基板1190にチャネルが形成される
トランジスタとすることもできる。
また、論理素子1206としては、例えばインバータやクロックドインバータ等を用いる
ことができる。
、回路1201に記憶されていたデータを、回路1202に設けられた容量素子1208
によって保持することができる。
えば、酸化物半導体にチャネルが形成されるトランジスタのオフ電流は、結晶性を有する
シリコンにチャネルが形成されるトランジスタのオフ電流に比べて著しく小さい。そのた
め、当該トランジスタをトランジスタ1209として用いることによって、記憶素子12
00に電源電圧が供給されない間も容量素子1208に保持された信号は長期間にわたり
保たれる。こうして、記憶素子1200は電源電圧の供給が停止した間も記憶内容(デー
タ)を保持することが可能である。
作を行うことを特徴とする記憶素子であるため、電源電圧供給再開後に、回路1201が
元のデータを保持しなおすまでの時間を短くすることができる。
1210のゲートに入力される。そのため、記憶素子1200への電源電圧の供給が再開
された後、容量素子1208によって保持された信号を、トランジスタ1210の状態(
導通状態、または非導通状態)に変換して、回路1202から読み出すことができる。そ
れ故、容量素子1208に保持された信号に対応する電位が多少変動していても、元の信
号を正確に読み出すことが可能である。
記憶装置に用いることで、電源電圧の供給停止による記憶装置内のデータの消失を防ぐこ
とができる。また、電源電圧の供給を再開した後、短時間で電源供給停止前の状態に復帰
することができる。よって、プロセッサ全体、もしくはプロセッサを構成する一つ、また
は複数の論理回路において、短い時間でも電源停止を行うことができるため、消費電力を
抑えることができる。
Digital Signal Processor)、カスタムLSI、PLD(Pr
ogrammable Logic Device)等のLSI、RF−ID(Radi
o Frequency Identification)にも応用可能である。
以下では、本発明の一態様に係る表示装置の構成例について説明する。
図23(A)には、本発明の一態様に係る表示装置の上面図を示す。また、図23(B)
には、本発明の一態様に係る表示装置の画素に液晶素子を用いた場合における画素回路を
示す。また、図23(C)には、本発明の一態様に係る表示装置の画素に有機EL素子を
用いた場合における画素回路を示す。
nチャネル型のトランジスタを用いる例を示す。なお、画素に用いたトランジスタと、同
一工程を経て作製したトランジスタを駆動回路として用いても構わない。このように、画
素や駆動回路に上述したトランジスタを用いることにより、表示品位が高い、または/お
よび信頼性の高い表示装置となる。
5000上には、画素部5001、第1の走査線駆動回路5002、第2の走査線駆動回
路5003、信号線駆動回路5004が配置される。画素部5001は、複数の信号線に
よって信号線駆動回路5004と電気的に接続され、複数の走査線によって第1の走査線
駆動回路5002、および第2の走査線駆動回路5003と電気的に接続される。なお、
走査線と信号線とによって区切られる領域には、それぞれ表示素子を有する画素が配置さ
れている。また、表示装置の基板5000は、FPC(Flexible Printe
d Circuit)等の接続部を介して、タイミング制御回路(コントローラ、制御I
Cともいう)に電気的に接続されている。
004は、画素部5001と同じ基板5000上に形成される。そのため、駆動回路を別
途作製する場合と比べて、表示装置を作製するコストを低減することができる。また、駆
動回路を別途作製した場合、配線間の接続数が増える。したがって、同じ基板5000上
に駆動回路を設けることで、配線間の接続数を減らすことができ、信頼性の向上、または
/および歩留まりの向上を図ることができる。
また、画素の回路構成の一例を図23(B)に示す。ここでは、VA型液晶表示装置の画
素などに適用することができる画素回路を示す。
素電極は異なるトランジスタに接続され、各トランジスタは異なるゲート信号で駆動でき
るように構成されている。これにより、マルチドメイン設計された画素の個々の画素電極
に印加する信号を、独立して制御できる。
13には、異なるゲート信号を与えることができるように分離されている。一方、データ
線として機能するソース電極またはドレイン電極5014は、トランジスタ5016とト
ランジスタ5017で共通に用いられている。トランジスタ5016とトランジスタ50
17は上述したトランジスタを適宜用いることができる。これにより、表示品位が高い、
または/および信頼性の高い液晶表示装置を提供することができる。
気的に接続する第2の画素電極の形状について説明する。第1の画素電極と第2の画素電
極の形状は、スリットによって分離されている。第1の画素電極はV字型に広がる形状を
有し、第2の画素電極は第1の画素電極の外側を囲むように形成される。
スタ5017のゲート電極はゲート配線5013と電気的に接続されている。ゲート配線
5012とゲート配線5013に異なるゲート信号を与えてトランジスタ5016とトラ
ンジスタ5017の動作タイミングを異ならせ、液晶の配向を制御することができる。
は第2の画素電極と電気的に接続する容量電極とで容量素子を形成してもよい。
える。第1の液晶素子5018は第1の画素電極と対向電極とその間の液晶層とで構成さ
れ、第2の液晶素子5019は第2の画素電極と対向電極とその間の液晶層とで構成され
る。
例えば、図23(B)に示す画素回路に新たにスイッチ、抵抗素子、容量素子、トランジ
スタ、センサー、または論理回路などを追加してもよい。
画素の回路構成の他の一例を図23(C)に示す。ここでは、有機EL素子を用いた表示
装置の画素構造を示す。
極の一方から電子が、他方から正孔がそれぞれ発光性の有機化合物を含む層に注入され、
電流が流れる。そして、電子および正孔が再結合することにより、発光性の有機化合物が
励起状態を形成し、その励起状態が基底状態に戻る際に発光する。このようなメカニズム
から、このような発光素子は、電流励起型の発光素子と呼ばれる。
トランジスタを2つ用いる例を示す。なお、nチャネル型のトランジスタには、上述した
トランジスタを用いることができる。また、当該画素回路は、デジタル時間階調駆動を適
用することができる。
いて説明する。
発光素子5024および容量素子5023を有する。スイッチング用トランジスタ502
1は、ゲート電極が走査線5026に接続され、第1電極(ソース電極、ドレイン電極の
一方)が信号線5025に接続され、第2電極(ソース電極、ドレイン電極の他方)が駆
動用トランジスタ5022のゲート電極に接続されている。駆動用トランジスタ5022
は、ゲート電極が容量素子5023を介して電源線5027に接続され、第1電極が電源
線5027に接続され、第2電極が発光素子5024の第1電極(画素電極)に接続され
ている。発光素子5024の第2電極は共通電極5028に相当する。共通電極5028
は、同一基板上に形成される共通電位線と電気的に接続される。
ンジスタを用いることができる。これにより、表示品位の高い、または/および信頼性の
高い有機EL表示装置となる。
、低電源電位とは、電源線5027に供給される高電源電位より低い電位であり、例えば
GND、0Vなどを低電源電位として設定することができる。発光素子5024の順方向
のしきい値電圧以上となるように高電源電位と低電源電位を設定し、その電位差を発光素
子5024に印加することにより、発光素子5024に電流を流して発光させる。なお、
発光素子5024の順方向電圧とは、所望の輝度とする場合の電圧を指しており、少なく
とも順方向しきい値電圧を含む。
り省略できる場合がある。駆動用トランジスタ5022のゲート容量については、チャネ
ル形成領域とゲート電極との間で容量が形成されていてもよい。
方式の場合、駆動用トランジスタ5022がオンまたはオフの二つの状態となるようなビ
デオ信号を、駆動用トランジスタ5022に入力する。なお、駆動用トランジスタ502
2を線形領域で動作させるために、電源線5027の電圧よりも高い電圧を駆動用トラン
ジスタ5022のゲート電極に与える。また、信号線5025には、電源線電圧に駆動用
トランジスタ5022のしきい値電圧Vthを加えた値以上の電圧をかける。
24の順方向電圧に駆動用トランジスタ5022のしきい値電圧Vthを加えた値以上の
電圧をかける。なお、駆動用トランジスタ5022が飽和領域で動作するようにビデオ信
号を入力し、発光素子5024に電流を流す。また、駆動用トランジスタ5022を飽和
領域で動作させるために、電源線5027の電位を、駆動用トランジスタ5022のゲー
ト電位より高くする。ビデオ信号をアナログとすることで、発光素子5024にビデオ信
号に応じた電流を流し、アナログ階調駆動を行うことができる。
例えば、図23(C)に示す画素回路にスイッチ、抵抗素子、容量素子、センサー、トラ
ンジスタまたは論理回路などを追加してもよい。
第1の電極)、高電位側にドレイン電極(第2の電極)がそれぞれ電気的に接続される構
成とする。さらに、制御回路等により第1のゲート電極の電位を制御し、第2のゲート電
極にはソース電極に与える電位よりも低い電位など、上記で例示した電位を入力可能な構
成とすればよい。
子、および発光素子を有する装置である発光装置は、様々な形態を用いること、または様
々な素子を有することが出来る。表示素子、表示装置、発光素子または発光装置は、例え
ば、EL素子(有機物および無機物を含むEL素子、有機EL素子、無機EL素子)、L
ED(白色LED、赤色LED、緑色LED、青色LEDなど)、トランジスタ(電流に
応じて発光するトランジスタ)、電子放出素子、液晶素子、電子インク、電気泳動素子、
グレーティングライトバルブ(GLV)、プラズマディスプレイパネル(PDP)、ME
MS(マイクロ・エレクトロ・メカニカル・システム)を用いた表示素子、デジタルマイ
クロミラーデバイス(DMD)、DMS(デジタル・マイクロ・シャッター)、IMOD
(インターフェアレンス・モジュレーション)素子、シャッター方式のMEMS表示素子
、光干渉方式のMEMS表示素子、エレクトロウェッティング素子、圧電セラミックディ
スプレイ、カーボンナノチューブを用いた表示素子などの少なくとも一つを有している。
これらの他にも、電気的または磁気的作用により、コントラスト、輝度、反射率、透過率
などが変化する表示媒体を有していてもよい。EL素子を用いた表示装置の一例としては
、ELディスプレイなどがある。電子放出素子を用いた表示装置の一例としては、フィー
ルドエミッションディスプレイ(FED)またはSED方式平面型ディスプレイ(SED
:Surface−conduction Electron−emitter Dis
play)などがある。液晶素子を用いた表示装置の一例としては、液晶ディスプレイ(
透過型液晶ディスプレイ、半透過型液晶ディスプレイ、反射型液晶ディスプレイ、直視型
液晶ディスプレイ、投射型液晶ディスプレイ)などがある。電子インク、または電気泳動
素子を用いた表示装置の一例としては、電子ペーパーなどがある。なお、半透過型液晶デ
ィスプレイや反射型液晶ディスプレイを実現する場合には、画素電極の一部または全部が
、反射電極としての機能を有するようにすればよい。例えば、画素電極の一部または全部
が、アルミニウム、銀などを有するようにすればよい。さらに、その場合、反射電極の下
に、SRAMなどの記憶回路を設けることも可能である。これにより、消費電力をさらに
低減することができる。
)を用いて表示装置をフルカラー表示させるために、着色層(カラーフィルターともいう
。)を用いてもよい。着色層は、例えば、レッド(R)、グリーン(G)、ブルー(B)
、イエロー(Y)などを適宜組み合わせて用いることができる。着色層を用いることで、
着色層を用いない場合と比べて色の再現性を高くすることができる。このとき、着色層を
有する領域と、着色層を有さない領域と、を配置することによって、着色層を有さない領
域における白色光を直接表示に利用しても構わない。一部に着色層を有さない領域を配置
することで、明るい表示の際に、着色層による輝度の低下を少なくでき、消費電力を2割
から3割程度低減できる場合がある。ただし、有機EL素子や無機EL素子などの自発光
素子を用いてフルカラー表示する場合、R、G、B、Y、Wを、それぞれの発光色を有す
る素子から発光させても構わない。自発光素子を用いることで、着色層を用いた場合より
も、さらに消費電力を低減できる場合がある。
以下では、本発明の一態様に係る半導体装置を適用した表示モジュールについて、図24
を用いて説明を行う。
間に、FPC8003に接続されたタッチパネル8004、FPC8005に接続された
セル8006、バックライトユニット8007、フレーム8009、プリント基板801
0、バッテリー8011を有する。なお、バックライトユニット8007、バッテリー8
011、タッチパネル8004などを有さない場合もある。
06のサイズに合わせて、形状や寸法を適宜変更することができる。
に重畳して用いることができる。また、セル8006の対向基板(封止基板)に、タッチ
パネル機能を持たせるようにすることも可能である。または、セル8006の各画素内に
光センサーを設け、光学式のタッチパネルとすることも可能である。または、セル800
6の各画素内にタッチセンサー用電極を設け、静電容量方式のタッチパネルとすることも
可能である。
ユニット8007の端部に設け、光拡散板を用いる構成としてもよい。
発生する電磁波を遮断するための電磁シールドとしての機能を有してもよい。またフレー
ム8009は、放熱板としての機能を有していてもよい。
号処理回路を有する。電源回路に電力を供給する電源としては、外部の商用電源であって
もよいし、別途設けたバッテリー8011による電源であってもよい。商用電源を用いる
場合には、バッテリー8011を有さなくてもよい。
加して設けてもよい。
本発明の一態様に係る半導体装置は、表示機器、パーソナルコンピュータ、記録媒体を備
えた画像再生装置(代表的にはDVD:Digital Versatile Disc
等の記録媒体を再生し、その画像を表示しうるディスプレイを有する装置)に用いること
ができる。その他に、本発明の一態様に係る半導体装置を用いることができる電子機器と
して、携帯電話、携帯型を含むゲーム機、携帯データ端末、電子書籍端末、ビデオカメラ
、デジタルスチルカメラ等のカメラ、ゴーグル型ディスプレイ(ヘッドマウントディスプ
レイ)、ナビゲーションシステム、音響再生装置(カーオーディオ、デジタルオーディオ
プレイヤー等)、複写機、ファクシミリ、プリンタ、プリンタ複合機、現金自動預け入れ
払い機(ATM)、自動販売機などが挙げられる。これら電子機器の具体例を図25に示
す。
904、マイクロフォン905、スピーカー906、操作キー907、スタイラス908
等を有する。なお、図25(A)に示した携帯型ゲーム機は、2つの表示部903と表示
部904とを有しているが、携帯型ゲーム機が有する表示部の数は、これに限定されない
。
13、第2表示部914、接続部915、操作キー916等を有する。第1表示部913
は第1筐体911に設けられており、第2表示部914は第2筐体912に設けられてい
る。そして、第1筐体911と第2筐体912とは、接続部915により接続されており
、第1筐体911と第2筐体912の間の角度は、接続部915により変更が可能である
。第1表示部913における映像を、接続部915における第1筐体911と第2筐体9
12との間の角度にしたがって、切り替える構成としてもよい。また、第1表示部913
および第2表示部914の少なくとも一方に、位置入力装置としての機能が付加された表
示装置を用いるようにしてもよい。なお、位置入力装置としての機能は、表示装置にタッ
チパネルを設けることで付加することができる。または、位置入力装置としての機能は、
フォトセンサーとも呼ばれる光電変換素子を表示装置の画素部に設けることでも、付加す
ることができる。
ーボード923、ポインティングデバイス924等を有する。
3等を有する。
操作キー944、レンズ945、接続部946等を有する。操作キー944およびレンズ
945は第1筐体941に設けられており、表示部943は第2筐体942に設けられて
いる。そして、第1筐体941と第2筐体942とは、接続部946により接続されてお
り、第1筐体941と第2筐体942の間の角度は、接続部946により変更が可能であ
る。表示部943における映像を、接続部946における第1筐体941と第2筐体94
2との間の角度にしたがって切り替える構成としてもよい。
イト954等を有する。
以下では、本発明の一態様に係る電子機器の一例である表示領域または発光領域に曲面を
有する電子機器について、図26を参照しながら説明する。なお、ここでは、電子機器の
一例として、情報機器、特に携帯性を有する情報機器(携帯機器)について説明する。携
帯性を有する情報機器としては、例えば、携帯電話機(ファブレット、スマートフォン(
スマホ))、タブレット端末(スレートPC)なども含まれる。
2)は、携帯機器1300Aの上面図である。図26(A−3)は、携帯機器1300A
の使用状態を説明する図である。
図である。
図である。
携帯機器1300Aは、例えば電話、電子メール作成閲覧、手帳または情報閲覧などの機
能から選ばれた一つまたは複数の機能を有する。
う性を有する表示装置を、筐体の内側に沿うように配置することで表示部を設ければよい
。これにより、文字情報や画像情報などを第1の領域1311または/および第2の領域
1312に表示することができる。
26(A−1)参照。)。また、図中に破線の矩形で示すように文字情報などを第2の領
域1312に表示することができる(図26(A−2)参照。)。
洋服の胸ポケットに収納したままの状態で、携帯機器1300Aの第2の領域1312に
表示された文字や画像情報を、使用者は容易に確認することができる(図26(A−3)
参照。)。例えば、着信した電話の発信者の電話番号または氏名などを、携帯機器130
0Aの上方から観察できる。
置などを有してもよい。入力装置は、例えば、タッチセンサー、光センサー、超音波セン
サーなどを用いればよい。入力装置を表示装置と筐体との間または筐体上に配置する場合
、マトリクススイッチ方式、抵抗膜方式、超音波表面弾性波方式、赤外線方式、電磁誘導
方式、静電容量方式などのタッチパネルを用いればよい。また、入力装置を表示装置内に
配置する場合、インセルタイプのセンサー、またはオンセルタイプのセンサーなどを用い
ればよい。
振動に基づいて、着信を拒否するモードに移行するプログラムを記憶した記憶装置を備え
ることができる。これにより、使用者は携帯機器1300Aを洋服の上から軽く叩いて振
動を与えることにより着信を拒否するモードに移行させることができる。
、表示部を支持する筐体1310を有する。
域1311と第2の領域1312に挟まれる。
向けて使用することができる。
、表示部を支持する筐体1310を有する。
の領域1311と第2の領域1312に挟まれる。
104 導電体
106a 半導体
106b 半導体
106c 半導体
108 絶縁体
112 絶縁体
116a 導電体
116b 導電体
124a 領域
124b 領域
400 基板
402 絶縁体
404 導電体
405 導電体
406a 半導体
406b 半導体
406c 半導体
408 絶縁体
412 絶縁体
413 導電体
416a 導電体
416b 導電体
418 絶縁体
424a 導電体
424b 導電体
426a 導電体
426b 導電体
428 絶縁体
800 RFタグ
801 通信器
802 アンテナ
803 無線信号
804 アンテナ
805 整流回路
806 定電圧回路
807 復調回路
808 変調回路
809 論理回路
810 記憶回路
811 ROM
901 筐体
902 筐体
903 表示部
904 表示部
905 マイクロフォン
906 スピーカー
907 操作キー
908 スタイラス
911 筐体
912 筐体
913 表示部
914 表示部
915 接続部
916 操作キー
921 筐体
922 表示部
923 キーボード
924 ポインティングデバイス
931 筐体
932 冷蔵室用扉
933 冷凍室用扉
941 筐体
942 筐体
943 表示部
944 操作キー
945 レンズ
946 接続部
951 車体
952 車輪
953 ダッシュボード
954 ライト
1189 ROMインターフェース
1190 基板
1191 ALU
1192 ALUコントローラ
1193 インストラクションデコーダ
1194 インタラプトコントローラ
1195 タイミングコントローラ
1196 レジスタ
1197 レジスタコントローラ
1198 バスインターフェース
1199 ROM
1200 記憶素子
1201 回路
1202 回路
1203 スイッチ
1204 スイッチ
1206 論理素子
1207 容量素子
1208 容量素子
1209 トランジスタ
1210 トランジスタ
1213 トランジスタ
1214 トランジスタ
1220 回路
1300A 携帯機器
1300B 携帯機器
1300C 携帯機器
1310 筐体
1311 領域
1312 領域
2100 トランジスタ
2200 トランジスタ
2201 絶縁体
2202 導電体
2203 導電体
2204 絶縁体
2205 導電体
2206 導電体
2207 絶縁体
2208 絶縁体
2211 半導体基板
2212 絶縁体
2213 ゲート電極
2214 ゲート絶縁体
2215 ソース領域およびドレイン領域
3001 配線
3002 配線
3003 配線
3004 配線
3005 配線
3200 トランジスタ
3300 トランジスタ
3400 容量素子
4000 RFタグ
5000 基板
5001 画素部
5002 走査線駆動回路
5003 走査線駆動回路
5004 信号線駆動回路
5010 容量配線
5012 ゲート配線
5013 ゲート配線
5014 ドレイン電極
5016 トランジスタ
5017 トランジスタ
5018 液晶素子
5019 液晶素子
5020 画素
5021 スイッチング用トランジスタ
5022 駆動用トランジスタ
5023 容量素子
5024 発光素子
5025 信号線
5026 走査線
5027 電源線
5028 共通電極
5100 ペレット
5120 基板
5161 領域
8000 表示モジュール
8001 上部カバー
8002 下部カバー
8003 FPC
8004 タッチパネル
8005 FPC
8006 セル
8007 バックライトユニット
8008 光源
8009 フレーム
8010 プリント基板
8011 バッテリー
Claims (13)
- アレイ状に配置された複数の回路を有する半導体装置であって、
前記複数の回路の各々は、
第1のチャネル形成領域と、
前記第1のチャネル形成領域上の第1の絶縁層と、
前記第1の絶縁層上に位置し、前記第1のチャネル形成領域と重なる第1のゲート電極と、
前記第1のゲート電極上の第2の絶縁層と、
前記第2の絶縁層上に位置し、水素をブロックする機能を有する第3の絶縁層と、
前記第3の絶縁層上の第4の絶縁層と、
前記第4の絶縁層上に位置し、第2のチャネル形成領域を有する半導体層と、
前記第2のチャネル形成領域上の第5の絶縁層と、
前記第5の絶縁層上に位置し、前記第2のチャネル形成領域と重なる第2のゲート電極と、
前記第2のチャネル形成領域を挟んで前記第2のゲート電極と互いに重なる領域を有し、且つ前記第2のゲート電極と直接接続された第3のゲート電極と、
前記第2のゲート電極上に位置し、前記半導体層の第1の領域と重なる領域に開口部を有する第6の絶縁層と、
前記第6の絶縁層上及び前記開口部に位置し、前記半導体層と前記開口部を介して直接接続された第1の導電層と、を有し、
前記半導体層は、前記開口部と重ならない第2の領域を有し、
前記第1の領域における前記半導体層の膜厚は、前記第2の領域における前記半導体層の膜厚よりも小さく、
前記第1のチャネル形成領域は、シリコンを有し、
前記第2のチャネル形成領域は、酸化物半導体層を有し、
前記第2のチャネル形成領域におけるチャネル長方向の断面視において、前記第2のゲート電極の第1の端部と、前記半導体層の第1の端部との間の距離は、前記第2のゲート電極の第2の端部と、前記半導体層の第2の端部との間の距離よりも大きく、
前記第2のゲート電極の一部は、前記半導体層の前記第2のチャネル形成領域上に配置され、
前記第2のゲート電極の下面の一部は、前記半導体層の上面よりも下方に配置される半導体装置。 - アレイ状に配置された複数の回路を有する半導体装置であって、
前記複数の回路の各々は、
第1のチャネル形成領域と、
前記第1のチャネル形成領域上の第1の絶縁層と、
前記第1の絶縁層上に位置し、前記第1のチャネル形成領域と重なる第1のゲート電極と、
前記第1のゲート電極上の第2の絶縁層と、
前記第2の絶縁層上に位置し、水素をブロックする機能を有する第3の絶縁層と、
前記第3の絶縁層上の第4の絶縁層と、
前記第4の絶縁層上に位置し、第2のチャネル形成領域を有する半導体層と、
前記第2のチャネル形成領域上の第5の絶縁層と、
前記第5の絶縁層上に位置し、前記第2のチャネル形成領域と重なる第2のゲート電極と、
前記第2のチャネル形成領域を挟んで前記第2のゲート電極と互いに重なる領域を有し、且つ前記第2のゲート電極と直接接続された第3のゲート電極と、
前記第2のゲート電極上に位置し、前記半導体層の第1の領域と重なる領域に開口部を有する第6の絶縁層と、
前記第6の絶縁層上及び前記開口部に位置し、前記半導体層と前記開口部を介して直接接続された第1の導電層と、を有し、
前記半導体層は、前記開口部と重ならない第2の領域を有し、
前記第1の領域における前記半導体層の膜厚は、前記第2の領域における前記半導体層の膜厚よりも小さく、
前記第1のチャネル形成領域は、単結晶シリコンを有し、
前記第2のチャネル形成領域は、酸化物半導体層を有し、
前記第2のチャネル形成領域におけるチャネル長方向の断面視において、前記第2のゲート電極の第1の端部と、前記半導体層の第1の端部との間の距離は、前記第2のゲート電極の第2の端部と、前記半導体層の第2の端部との間の距離よりも大きく、
前記第2のゲート電極の一部は、前記半導体層の前記第2のチャネル形成領域上に配置され、
前記第2のゲート電極の下面の一部は、前記半導体層の上面よりも下方に配置される半導体装置。 - アレイ状に配置された複数の回路を有する半導体装置であって、
前記複数の回路の各々は、
第1のチャネル形成領域と、
前記第1のチャネル形成領域上の第1の絶縁層と、
前記第1の絶縁層上に位置し、前記第1のチャネル形成領域と重なる第1のゲート電極と、
前記第1のゲート電極上の第2の絶縁層と、
前記第2の絶縁層上の第3の絶縁層と、
前記第3の絶縁層上の第4の絶縁層と、
前記第4の絶縁層上に位置し、第2のチャネル形成領域を有する半導体層と、
前記第2のチャネル形成領域上の第5の絶縁層と、
前記第5の絶縁層上に位置し、前記第2のチャネル形成領域と重なる第2のゲート電極と、
前記第2のチャネル形成領域を挟んで前記第2のゲート電極と互いに重なる領域を有し、且つ前記第2のゲート電極と直接接続された第3のゲート電極と、
前記第2のゲート電極上に位置し、前記半導体層の第1の領域と重なる領域に開口部を有する第6の絶縁層と、
前記第6の絶縁層上及び前記開口部に位置し、前記半導体層と前記開口部を介して直接接続された第1の導電層と、を有し、
前記半導体層は、前記開口部と重ならない第2の領域を有し、
前記第1の領域における前記半導体層の膜厚は、前記第2の領域における前記半導体層の膜厚よりも小さく、
前記第1のチャネル形成領域は、シリコンを有し、
前記第2のチャネル形成領域は、酸化物半導体層を有し、
前記第2のチャネル形成領域におけるチャネル長方向の断面視において、前記第2のゲート電極の第1の端部と、前記半導体層の第1の端部との間の距離は、前記第2のゲート電極の第2の端部と、前記半導体層の第2の端部との間の距離よりも大きく、
前記第2のゲート電極の一部は、前記半導体層の前記第2のチャネル形成領域上に配置され、
前記第2のゲート電極の下面の一部は、前記半導体層の上面よりも下方に配置される半導体装置。 - アレイ状に配置された複数の回路を有する半導体装置であって、
前記複数の回路の各々は、
第1のチャネル形成領域と、
前記第1のチャネル形成領域上の第1の絶縁層と、
前記第1の絶縁層上に位置し、前記第1のチャネル形成領域と重なる第1のゲート電極と、
前記第1のゲート電極上の第2の絶縁層と、
前記第2の絶縁層上の第3の絶縁層と、
前記第3の絶縁層上の第4の絶縁層と、
前記第4の絶縁層上に位置し、第2のチャネル形成領域を有する半導体層と、
前記第2のチャネル形成領域上の第5の絶縁層と、
前記第5の絶縁層上に位置し、前記第2のチャネル形成領域と重なる第2のゲート電極と、
前記第2のチャネル形成領域を挟んで前記第2のゲート電極と互いに重なる領域を有し、且つ前記第2のゲート電極と直接接続された第3のゲート電極と、
前記第2のゲート電極上に位置し、前記半導体層の第1の領域と重なる領域に開口部を有する第6の絶縁層と、
前記第6の絶縁層上及び前記開口部に位置し、前記半導体層と前記開口部を介して直接接続された第1の導電層と、を有し、
前記半導体層は、前記開口部と重ならない第2の領域を有し、
前記第1の領域における前記半導体層の膜厚は、前記第2の領域における前記半導体層の膜厚よりも小さく、
前記第1のチャネル形成領域は、単結晶シリコンを有し、
前記第2のチャネル形成領域は、酸化物半導体層を有し、
前記第2のチャネル形成領域におけるチャネル長方向の断面視において、前記第2のゲート電極の第1の端部と、前記半導体層の第1の端部との間の距離は、前記第2のゲート電極の第2の端部と、前記半導体層の第2の端部との間の距離よりも大きく、
前記第2のゲート電極の一部は、前記半導体層の前記第2のチャネル形成領域上に配置され、
前記第2のゲート電極の下面の一部は、前記半導体層の上面よりも下方に配置される半導体装置。 - 請求項1乃至4のいずれか一において、
前記第3の絶縁層の下方に位置する第2の絶縁層の水素濃度は、前記第3の絶縁層の上方に位置する第4の絶縁層の水素濃度より高濃度である半導体装置。 - 請求項1乃至5のいずれか一において、
前記第1のチャネル形成領域を有するトランジスタは、pチャネル型トランジスタである半導体装置。 - 請求項1乃至5のいずれか一において、
前記第1のチャネル形成領域を有するトランジスタは、nチャネル型トランジスタである半導体装置。 - 請求項1乃至7のいずれか一において、
前記第1の導電層は、前記半導体層を貫通する領域を有する半導体装置。 - 請求項1乃至8のいずれか一において、
前記第3のゲート電極は、前記第3の絶縁層上に位置する半導体装置。 - 請求項1乃至9のいずれか一において、
前記第2のゲート電極の第1の端部は、前記第3のゲート電極と重なる半導体装置。 - 請求項1乃至10のいずれか一に記載の半導体装置を有する表示装置。
- 請求項1乃至10のいずれか一に記載の半導体装置と、FPCと、フレームとを有する表示モジュール。
- 請求項12に記載の表示モジュールと、バッテリーと、タッチパネルと、バックライトユニットとを有する電子機器。
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