JP6916875B2 - ハーフブリッジインバーターモジュールのための単線バス複数グループ異常通信 - Google Patents
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Description
Claims (38)
- システム制御装置と、
複数のデバイスと、
異常バスと、
を備え、
前記複数のデバイスのうちの各デバイスが、単一の異常端子を含み、
前記異常バスが、前記システム制御装置と前記複数のデバイスとに結合された単線のみからなり、
前記異常バスが、前記複数のデバイスと前記システム制御装置との間における複数方向複数異常グループ通信を提供するように結合されており、
各前記デバイスが、新しいシステムまたはデバイス異常検出が報告される場合に、バス調停処理を使用して前記異常バスのオーナーシップを取得するものであり、
前記複数のデバイスのうちの各デバイスの前記単一の異常端子が、前記複数のデバイスと前記システム制御装置との間における前記複数方向複数異常グループ通信を提供するように、前記異常バスに結合されている、
異常通信システム。 - 前記複数のデバイスのうちの各デバイスが、識別端子を含み、
前記識別端子が、前記複数のデバイスのうちの各デバイスの、それぞれの前記識別端子の各々の既定の識別状態を通して前記複数のデバイスのうちのそれぞれのデバイスの各々を一意的に識別するように結合されている、
請求項1に記載の異常通信システム。 - 前記複数のデバイスのうちのそれぞれのデバイスの各々に対する前記既定の識別状態が、前記異常バス上の前記複数のデバイスのうちの前記それぞれのデバイスを識別するために各異常バス通信期間の開始時に送信されるように結合されている、
請求項2に記載の異常通信システム。 - 各前記異常バス通信期間の開始時に識別される前記複数のデバイスのうちの前記それぞれのデバイスが、識別された後、前記異常バスを制御するように結合されている、
請求項3に記載の異常通信システム。 - 前記複数のデバイスのうちの各デバイスの前記単一の異常端子が、前記異常バス上で前記複数のデバイスと前記システム制御装置との間において、複数ビットデジタル異常ワードとして、デバイスレベルおよびシステムレベルステータス、または、前記複数のデバイスのうちのそれぞれのデバイスの各々における異常情報を通信するように結合されている、
請求項1に記載の異常通信システム。 - 異常通信システムにおける使用のためのハーフブリッジスイッチングモジュールであって、
前記ハーフブリッジスイッチングモジュールが、複数のハーフブリッジスイッチングモジュールのうちの1つであり、
前記複数のハーフブリッジスイッチングモジュールが、入力電圧に結合されており、システム制御装置に応答して負荷に対する所望の出力を生成し、
前記ハーフブリッジスイッチングモジュールが、
ロー側スイッチと、
前記ロー側スイッチを制御するように結合されたロー側制御回路と、
前記ロー側スイッチに結合されたハイ側スイッチと、
前記ハイ側スイッチを制御するように結合されたハイ側制御回路と、
単一の異常端子と、
を備え、
前記ロー側制御回路が、ロー側基準グランドを基準とし、
前記ハイ側制御回路が、前記ハーフブリッジスイッチングモジュールの浮遊ノードを基準とするように結合されており、
前記単一の異常端子が、前記複数のハーフブリッジスイッチングモジュールと前記システム制御装置との間における複数方向複数異常グループ通信を提供するように、前記システム制御装置に結合された単線のみからなる異常バスに結合されている、
異常通信システムにおける使用のためのハーフブリッジスイッチングモジュール。 - 各異常バス通信の開始時に、前記異常バス上の前記ハーフブリッジスイッチングモジュールを一意的に識別するように既定の状態になるように結合された単一の識別端子をさらに備える、
請求項6に記載のハーフブリッジスイッチングモジュール。 - 前記ハーフブリッジスイッチングモジュールが、各前記異常バス通信の開始時に識別された後、前記異常バスを制御するように結合されている、
請求項7に記載のハーフブリッジスイッチングモジュール。 - 前記システム制御装置が、マイクロ制御装置、マイクロプロセッサ、またはデジタル信号プロセッサ制御装置のうちの1つである、
請求項6に記載のハーフブリッジスイッチングモジュール。 - 前記ハイ側スイッチと前記ロー側スイッチとの間に結合された中点端子をさらに備え、
前記中点端子が、AC多相負荷の1つの相に結合されている、
請求項6に記載のハーフブリッジスイッチングモジュール。 - 前記AC多相負荷が、多相モーターであり、
前記中点端子が、前記多相モーターのそれぞれの相端子に結合された、
請求項10に記載のハーフブリッジスイッチングモジュール。 - 前記多相モーターが、ブラシレスDCモーターである、
請求項11に記載のハーフブリッジスイッチングモジュール。 - 複数のハーフブリッジインバーターモジュールとともに使用するための異常通信システムであって、
異常通信システムが、
単線のみからなる異常バスと、
前記異常バスに結合されたシステム制御装置と、
を備え、
前記複数のハーフブリッジインバーターモジュールが、前記システム制御装置に応答して、AC負荷に結合され、
前記複数のハーフブリッジインバーターモジュールの各ハーフブリッジインバーターモジュールが、
単一の異常端子と、
スイッチングブロックと、
単一の識別端子と、
を備え、
前記単一の異常端子が、前記複数のハーフブリッジインバーターモジュールと前記システム制御装置との間における複数方向の複数異常グループ通信を提供するように、前記異常バスに結合されており、
前記スイッチングブロックが、ロー側スイッチに結合されたハイ側スイッチを含み、
前記ハイ側スイッチと前記ロー側スイッチとの間における中点端子が、多相負荷のそれぞれの相端子に結合されており、
前記単一の識別端子が、前記異常バス上の前記複数のハーフブリッジインバーターモジュールのうちのそれぞれのハーフブリッジインバーターモジュールを一意的に識別するように、前記複数のハーフブリッジインバーターモジュールのうちの前記それぞれのハーフブリッジインバーターモジュールに対する既定の状態になるように構成されている、
複数のハーフブリッジインバーターモジュールとともに使用するための異常通信システム。 - 前記システム制御装置が、マイクロ制御装置である、
請求項13に記載の異常通信システム。 - 前記複数のハーフブリッジインバーターモジュールが、多相モーターを駆動するように結合されている、
請求項13に記載の異常通信システム。 - 前記多相モーターが、前記システム制御装置と前記複数のハーフブリッジインバーターモジュールとに応答して駆動されるように結合された三相モーター駆動器を備える、
請求項15に記載の異常通信システム。 - 前記複数のハーフブリッジインバーターモジュールのうちの各ハーフブリッジインバーターモジュールの前記単一の異常端子が、前記異常バス上で前記複数のハーフブリッジインバーターモジュールと前記システム制御装置との間において、複数ビットデジタル異常ワードとして、デバイスレベルおよびシステムレベルステータス、または、異常情報を通信するように結合されている、
請求項13に記載の異常通信システム。 - 前記複数のハーフブリッジインバーターモジュールのうちの前記それぞれのハーフブリッジインバーターモジュールに対する前記既定の状態が、前記異常バス上の前記複数のハーフブリッジインバーターモジュールのうちの前記それぞれのハーフブリッジインバーターモジュールを識別するために、各異常バス通信の開始時に送信されるように結合されている、
請求項17に記載の異常通信システム。 - 各前記異常バス通信の開始時に識別された前記複数のハーフブリッジインバーターモジュールのうちの前記それぞれのハーフブリッジインバーターモジュールが、識別された後、前記異常バスを制御するように結合されている、
請求項18に記載の異常通信システム。 - 前記複数のハーフブリッジインバーターモジュールと前記システム制御装置との間における前記複数異常グループ通信が、前記ハイ側スイッチまたは前記ロー側スイッチにおける、シャットダウンおよび過電流異常警告、過電圧異常警告、複数レベル不足電圧異常警告、および/または、デバイスまたはシステムレベル高温異常警告のうちの1つを含む、
請求項13に記載の異常通信システム。 - 前記複数異常グループ通信が、前記システム制御装置における、制御パラメータの変更、ラッチ、またはシャットダウンをもたらすように、複数ビットを含んで異常を通信するデジタル異常ワードを符号化することにより、前記異常バスを介して報告されるように結合されている、
請求項20に記載の異常通信システム。 - 前記システム制御装置が、ステータス要求更新を相互に通信するように、または、前記異常バスを通してアンラッチコマンドを送信するように結合されている、
請求項20に記載の異常通信システム。 - 前記複数のハーフブリッジインバーターモジュールにより検出されるデバイスレベルまたはシステムレベル異常が、前記異常バスを介して報告される異常グループに分類され、1つの異常グループが、同時に発生しない異常を含む、
請求項20に記載の異常通信システム。 - 前記デジタル異常ワードが、前記デジタル異常ワードを二進値に符号化するパルス幅変調(PWM)された論理レベルパルスを含む、
請求項21に記載の異常通信システム。 - 論理ハイパルスの短い持続期間と長い持続期間とが、二進値の前記デジタル異常ワードにおける論理0(ゼロ)と論理1(いち)との間を差別化し得る、
請求項24に記載の異常通信システム。 - 前記デジタル異常ワードが、7ビットデジタル異常ワードを含む、
請求項21に記載の異常通信システム。 - 複数の相入力端子を含む多相モーターと、
単線のみからなる異常バスと、
前記異常バスに結合されたシステム制御装置と、
高電圧バスと、
前記高電圧バスと前記異常バスとに結合された複数のハーフブリッジインバーターモジュールと、
を備え、
前記複数のハーフブリッジインバーターモジュールのうちの各ハーフブリッジインバーターモジュールが、
単一の異常端子と、
スイッチングブロックと、
ハイ側制御ブロックと、
ロー側制御および通信ブロックと、
単一の識別端子と、
を備え、
前記単一の異常端子が、前記複数のハーフブリッジインバーターモジュールと前記システム制御装置との間における複数方向の複数異常グループ通信を提供するように前記異常バスに結合されており、
前記スイッチングブロックが、前記高電圧バスに結合されており、
前記スイッチングブロックが、ロー側スイッチに結合されたハイ側スイッチを含み、
前記ハイ側スイッチと前記ロー側スイッチとの間における中点端子が、前記多相モーターの前記複数の相入力端子のうちのそれぞれの相入力端子に結合されており、
前記ハイ側制御ブロックが、前記システム制御装置からのハイ側ゲーティング信号に応答して、前記ハイ側スイッチを駆動するように結合されており、
前記ロー側制御および通信ブロックが、システムマイクロ制御装置からのロー側ゲーティング信号に応答して、前記ロー側スイッチを駆動するように結合されており、
前記単一の識別端子が、前記異常バス上の前記複数のハーフブリッジインバーターモジュールのうちのそれぞれのハーフブリッジインバーターモジュールを一意的に識別するように、前記複数のハーフブリッジインバーターモジュールのうちの前記それぞれのハーフブリッジインバーターモジュールに対する既定の状態になるように構成されている、
多相モーター駆動システム。 - 前記多相モーターが、前記システム制御装置と前記複数のハーフブリッジインバーターモジュールとに応答して駆動されるように結合された三相モーター駆動器を備える、
請求項27に記載の多相モーター駆動システム。 - 前記複数のハーフブリッジインバーターモジュールのうちの各ハーフブリッジインバーターモジュールの前記単一の異常端子が、前記異常バス上で、前記複数のハーフブリッジインバーターモジュールと前記システム制御装置との間において、複数ビットデジタル異常ワードとして、デバイスレベルおよびシステムレベル異常情報を通信するように結合されている、
請求項27に記載の多相モーター駆動システム。 - 前記複数のハーフブリッジインバーターモジュールのうちの前記それぞれのハーフブリッジインバーターモジュールに対する前記既定の状態が、前記異常バス上の前記複数のハーフブリッジインバーターモジュールのうちの前記それぞれのハーフブリッジインバーターモジュールを識別するために各異常バス通信の開始時に送信されるように結合された、
請求項29に記載の多相モーター駆動システム。 - 各前記異常バス通信の開始時に識別された前記複数のハーフブリッジインバーターモジュールのうちの前記それぞれのハーフブリッジインバーターモジュールが、識別された後、前記異常バスを制御するように結合されている、
請求項30に記載の多相モーター駆動システム。 - 前記複数のハーフブリッジインバーターモジュールと前記システム制御装置との間における前記複数異常グループ通信が、前記ハイ側スイッチまたは前記ロー側スイッチにおける、シャットダウンおよび過電流異常警告、過電圧異常警告、複数レベル不足電圧異常警告、および/または、デバイスまたはシステムレベル高温異常警告のうちの1つを含む、
請求項27に記載の多相モーター駆動システム。 - 前記複数異常グループ通信が、前記システム制御装置における、制御パラメータの変更、ラッチ、またはシャットダウンをもたらすように、複数ビットデジタル異常ワードを符号化することにより、前記異常バスを介して報告されるように結合されている、
請求項32に記載の多相モーター駆動システム。 - 前記システム制御装置が、ステータス要求更新を相互に通信するように、または、前記異常バスを通してアンラッチコマンドを送信するように結合されている、
請求項32に記載の多相モーター駆動システム。 - 前記複数のハーフブリッジインバーターモジュールにより検出されるデバイスレベルまたはシステムレベル異常が、前記異常バスを介して報告される異常グループに分類され、1つの異常グループが、同時に発生しない異常を含み得る、
請求項32に記載の多相モーター駆動システム。 - 前記複数ビットデジタル異常ワードが、前記複数ビットデジタル異常ワードを二進値に符号化するパルス幅変調(PWM)された論理レベルパルスを含む、
請求項33に記載の多相モーター駆動システム。 - 前記複数ビットデジタル異常ワードにおいて、短いローパルスの前の比較的短い論理ハイパルスが、論理ゼロを示し、短い論理ローパルスの前の比較的長い論理ハイパルスが、論理1を示す、
請求項36に記載の多相モーター駆動システム。 - 前記複数ビットデジタル異常ワードが、7ビットデジタル異常ワードを含む、
請求項29に記載の多相モーター駆動システム。
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