JP6800310B2 - Goa回路 - Google Patents
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Description
n及びmはいずれも正の整数とし、第1段、第2段、最後から2番目の段、及び最終段のGOAユニット以外に、第n段のGOAユニットにおいて、
前記走査制御モジュールは、正方向走査制御信号又は逆方向走査制御信号を利用して前記GOA回路が正方向走査又は逆方向走査を行うように制御し、
前記出力モジュールは、第m+1本のクロック信号に接続され、第n段のGOAユニットの作用期間に第m+1本のクロック信号を利用して第n段のGOAユニットのゲート走査信号を出力し、
前記プルダウンモジュールは、第n段のGOAユニットの非作用期間に前記第n段のGOAユニットのゲート走査信号の電位をプルダウンし、
前記プルダウン制御モジュールは、第m本のクロック信号、第m+2本のクロック信号、第1の定電圧電位、第2の定電圧電位に接続され、第n段のGOAユニットの作用期間にプルダウンモジュールをオフにし、出力モジュールをオンに維持し、第n段のGOAユニットの非作用期間にプルダウンモジュールをオンにし、出力モジュールをオフにし、同時に第m本のクロック信号及び第m+2本のクロック信号を利用して第1の定電圧電位及び第2の定電圧電位を制御してプルダウンモジュールのスイッチノードに対してタイミング充放電を行い、
前記第1の定電圧電位と第2の定電圧電位の電位は逆であり、前記正方向走査制御信号と逆方向走査制御信号の電位は逆である。
前記第1の薄膜トランジスタのゲートは、上2段である第n−2段のGOAユニットのゲート走査信号に接続され、ソースは、正方向走査制御信号に接続され、ドレインは、第1のノードに電気的に接続され、
前記第2の薄膜トランジスタのゲートは、第2のノードに電気的に接続され、ソースは、第m+1本のクロック信号に電気的に接続され、ドレインは、ゲート走査信号に電気的に接続され、前記第3の薄膜トランジスタT3のゲートは、下2段である第n+2段のGOAユニットのゲート走査信号に接続され、ソースは、逆方向走査制御信号に接続され、ドレインは、第1のノードに電気的に接続され、前記第4の薄膜トランジスタのゲートは、第3のノードに電気的に接続され、ソースは、第n段のGOAユニットのゲート走査信号に接続され、ドレインは、第2の定電圧電位に電気的に接続され、前記第5の薄膜トランジスタのゲートは、第1の定電圧電位に電気的に接続され、ソースは、第1のノードに電気的に接続され、ドレインは、第2のノードに電気的に接続され、前記第6の薄膜トランジスタのゲートは、第1のノードに電気的に接続され、ソースは、第3のノードに電気的に接続され、ドレインは、第2の定電圧電位に電気的に接続され、前記第7の薄膜トランジスタのゲートは、第3のノードに電気的に接続され、ソースは、第2のノードに電気的に接続され、ドレインは、第2の定電圧電位に電気的に接続され、前記第8の薄膜トランジスタのゲートは、第m+3本のクロック信号に電気的に接続され、ソースは、第n段のGOAユニットのゲート走査信号に接続され、ドレインは、第2の定電圧電位に電気的に接続され、前記第9の薄膜トランジスタのゲートは、第m本のクロック信号に電気的に接続され、ソースは、第1の定電圧電位に電気的に接続され、ドレインは、抵抗の一端に電気的に接続され、前記第10の薄膜トランジスタのゲートは、第m+2本のクロック信号に電気的に接続され、ソースは、第2の定電圧電位に電気的に接続され、ドレインは、抵抗の他端に電気的に接続され、前記第2のコンデンサの一端は、第3のノードに電気的に接続され、他端は、第2の定電圧電位に電気的に接続され、前記第1のコンデンサの一端は、第2のノードに電気的に接続され、他端は、ゲート走査信号に電気的に接続され、
前記第3のノードは、前記プルダウンモジュールのスイッチノードである。
最後から2番目の段及び最終段のGOAユニットにおいて、前記第3の薄膜トランジスタのゲートは、回路のスタート信号に電気的に接続される。
逆方向走査を行う場合に、前記正方向走査制御信号は低電位であり、逆方向走査制御信号は高電位である。
逆方向走査を行う場合に、前記正方向走査制御信号は高電位であり、逆方向走査制御信号は低電位である。
n及びmはいずれも正の整数とし、第1段、第2段、最後から2番目の段、及び最終段のGOAユニット以外に、第n段のGOAユニットにおいて、
前記走査制御モジュールは、正方向走査制御信号又は逆方向走査制御信号を利用して前記GOA回路が正方向走査又は逆方向走査を行うように制御し、
前記出力モジュールは、第m+1本のクロック信号に接続され、第n段のGOAユニットの作用期間に第m+1本のクロック信号を利用して第n段のGOAユニットのゲート走査信号を出力し、
前記プルダウンモジュールは、第n段のGOAユニットの非作用期間に前記第n段のGOAユニットのゲート走査信号の電位をプルダウンし、
前記プルダウン制御モジュールは、第m本のクロック信号、第m+2本のクロック信号、第1の定電圧電位、第2の定電圧電位に接続され、第n段のGOAユニットの作用期間にプルダウンモジュールをオフにし、出力モジュールをオンに維持し、第n段のGOAユニットの非作用期間にプルダウンモジュールをオンにし、出力モジュールをオフにし、同時に第m本のクロック信号及び第m+2本のクロック信号を利用して第1の定電圧電位及び第2の定電圧電位を制御してプルダウンモジュールのスイッチノードに対してタイミング充放電を行い、
前記第1の定電圧電位と第2の定電圧電位の電位は逆であり、前記正方向走査制御信号と逆方向走査制御信号の電位は逆であり、
前記走査制御モジュールは、第1の薄膜トランジスタ、及び第3の薄膜トランジスタを含み、前記出力モジュールは、第2の薄膜トランジスタ、及び第1のコンデンサを含み、前記プルダウンモジュールは、第4の薄膜トランジスタ、第8の薄膜トランジスタ、及び第2のコンデンサを含み、前記プルダウン制御モジュールは、第6の薄膜トランジスタ、第7の薄膜トランジスタ、第9の薄膜トランジスタ、第10の薄膜トランジスタ、及び抵抗を含み、前記GOA回路は、さらに電圧安定化モジュールを含み、前記電圧安定化モジュールは、第5の薄膜トランジスタを含み、
前記第1の薄膜トランジスタのゲートは、上2段である第n−2段のGOAユニットのゲート走査信号に接続され、ソースは、正方向走査制御信号に接続され、ドレインは、第1のノードに電気的に接続され、
前記第2の薄膜トランジスタのゲートは、第2のノードに電気的に接続され、ソースは、第m+1本のクロック信号に電気的に接続され、ドレインは、第n段のGOAユニットのゲート走査信号に接続され、前記第3の薄膜トランジスタのゲートは、下2段である第n+2段のGOAユニットのゲート走査信号に接続され、ソースは、逆方向走査制御信号に接続され、ドレインは、第1のノードに電気的に接続され、前記第4の薄膜トランジスタのゲートは、第3のノードに電気的に接続され、ソースは、第n段のGOAユニットのゲート走査信号に接続され、ドレインは、第2の定電圧電位に電気的に接続され、前記第5の薄膜トランジスタのゲートは、第1の定電圧電位に電気的に接続され、ソースは、第1のノードに電気的に接続され、ドレインは、第2のノードに電気的に接続され、前記第6の薄膜トランジスタのゲートは、第1のノードに電気的に接続され、ソースは、第3のノードに電気的に接続され、ドレインは、第2の定電圧電位に電気的に接続され、前記第7の薄膜トランジスタのゲートは、第3のノードに電気的に接続され、ソースは、第2のノードに電気的に接続され、ドレインは、第2の定電圧電位に電気的に接続され、前記第8の薄膜トランジスタのゲートは、第m+3本のクロック信号に電気的に接続され、ソースは、第n段のGOAユニットのゲート走査信号に接続され、ドレインは、第2の定電圧
電位に電気的に接続され、前記第9の薄膜トランジスタのゲートは、第m本のクロック信号に電気的に接続され、ソースは、第1の定電圧電位に電気的に接続され、ドレインは、抵抗の一端に電気的に接続され、前記第10の薄膜トランジスタのゲートは、第m+2本のクロック信号に電気的に接続され、ソースは、第2の定電圧電位に電気的に接続され、ドレインは、抵抗の他端に電気的に接続され、前記第1のコンデンサの一端は、第2のノードに電気的に接続され、他端は、第n段のGOAユニットのゲート走査信号に接続され、前記第2のコンデンサの一端は、第3のノードに電気的に接続され、他端は、第2の定電圧電位に電気的に接続され、
前記第3のノードは、前記プルダウンモジュールのスイッチノードであり、
第1段及び第2段のGOAユニットにおいて、前記第1の薄膜トランジスタのゲートは、回路のスタート信号に電気的に接続され、
最後から2番目の段及び最終段のGOAユニットにおいて、前記第3の薄膜トランジスタのゲートは、回路のスタート信号に電気的に接続され、
前記各薄膜トランジスタは、いずれも低温ポリシリコン薄膜トランジスタである。
れたプルダウン制御モジュール400とを含み、
n及びmはいずれも正の整数とし、第1段、第2段、最後から2番目の段、及び最終段のGOAユニット以外に、第n段のGOAユニットにおいて、
前記走査制御モジュール100は、正方向走査制御信号U2D又は逆方向走査制御信号D2Uを利用して前記GOA回路が正方向走査又は逆方向走査を行うように制御し、
前記出力モジュール200は、第m+1本のクロック信号CK(m+1)に接続され、第n段のGOAユニットの作用期間に第m+1本のクロック信号CK(m+1)を利用して第n段のGOAユニットのゲート走査信号G(n)を出力し、
前記プルダウンモジュール300は、第n段のGOAユニットの非作用期間に前記第n段のGOAユニットのゲート走査信号G(n)の電位をプルダウンし、
前記プルダウン制御モジュール400は、第m本のクロック信号CK(m)、第m+2本のクロック信号CK(m+2)、第1の定電圧電位、第2の定電圧電位に接続され、第n段のGOAユニットの作用期間にプルダウンモジュール300をオフにし、出力モジュール200をオンに維持し、第n段のGOAユニットの非作用期間にプルダウンモジュール300をオンにし、出力モジュール200をオフにし、同時に第m本のクロック信号CK(m)及び第m+2本のクロック信号CK(m+2)を利用して第1の定電圧電位及び第2の定電圧電位を制御してプルダウンモジュール400のスイッチノードに対してタイミング充放電を行い、
前記第1の定電圧電位と第2の定電圧電位の電位は逆であり、前記正方向走査制御信号U2Dと逆方向走査制御信号D2Uの電位は逆である。
前記第3のノードP(n)は、すなわち前記プルダウンモジュール400のスイッチノードである。
Claims (17)
- カスケード接続された多段のGOAユニットを含むGOA回路であって、各段のGOAユニットは、いずれも走査制御モジュールと、前記走査制御モジュールに電気的に接続された出力モジュールと、前記出力モジュールに電気的に接続されたプルダウンモジュールと、前記走査制御モジュール、出力モジュール及びプルダウンモジュールにいずれも電気的に接続されたプルダウン制御モジュールと、
を含み、
n及びmはいずれも正の整数とし、第1段、第2段、最後から2番目の段、及び最終段のGOAユニット以外に、第n段のGOAユニットにおいて、
前記走査制御モジュールは、正方向走査制御信号又は逆方向走査制御信号を利用して前記GOA回路が正方向走査又は逆方向走査を行うように制御し、
前記出力モジュールは、第m+1本のクロック信号に接続され、第n段のGOAユニットの作用期間に第m+1本のクロック信号を利用して第n段のGOAユニットのゲート走査信号を出力し、
前記プルダウンモジュールは、第m+3本のクロック信号に接続され、第n段のGOAユニットの非作用期間に前記第n段のGOAユニットのゲート走査信号の電位をプルダウンし、
前記プルダウン制御モジュールは、第m本のクロック信号、第m+2本のクロック信号、第1の定電圧電位、第2の定電圧電位に接続され、第n段のGOAユニットの作用期間にプルダウンモジュールをオフにし、出力モジュールをオンに維持し、第n段のGOAユニットの非作用期間にプルダウンモジュールをオンにし、出力モジュールをオフにし、同時に第m本のクロック信号及び第m+2本のクロック信号を利用して第1の定電圧電位及び第2の定電圧電位を制御してプルダウンモジュールのスイッチノードに対してタイミング充放電を行い、
前記第1の定電圧電位と第2の定電圧電位の電位は逆であり、前記正方向走査制御信号と逆方向走査制御信号の電位は逆であり、
第m本のクロック信号と、第m+1本のクロック信号と、第m+2本のクロック信号と、第m+3本のクロック信号とは、パルスの立ち上がり及び立ち下がりの位相がπ/2(90°)ずつこの順にずれた4つのクロック信号であって、各パルスのハイレベル期間は重畳しないGOA回路。 - 前記走査制御モジュールは、第1の薄膜トランジスタ、及び第3の薄膜トランジスタを含み、前記出力モジュールは、第2の薄膜トランジスタ、及び第1のコンデンサを含み、前記プルダウンモジュールは、第4の薄膜トランジスタ、第8の薄膜トランジスタ、及び第2のコンデンサを含み、前記プルダウン制御モジュールは、第6の薄膜トランジスタ、第7の薄膜トランジスタ、第9の薄膜トランジスタ、第10の薄膜トランジスタ、及び抵抗を含み、前記GOA回路は、さらに電圧安定化モジュールを含み、前記電圧安定化モジュールは、第5の薄膜トランジスタを含み、
前記第1の薄膜トランジスタのゲートは、第n−2段のGOAユニットのゲート走査信号に接続され、ソースは、正方向走査制御信号に接続され、ドレインは、第1のノードに電気的に接続され、前記第2の薄膜トランジスタのゲートは、第2のノードに電気的に接続され、ソースは、第m+1本のクロック信号に電気的に接続され、ドレインは、第n段のGOAユニットのゲート走査信号に接続され、前記第3の薄膜トランジスタのゲートは、第n+2段のGOAユニットのゲート走査信号に接続され、ソースは、逆方向走査制御信号に接続され、ドレインは、第1のノードに電気的に接続され、前記第4の薄膜トランジスタのゲートは、第3のノードに電気的に接続され、ソースは、第n段のGOAユニットのゲート走査信号に接続され、ドレインは、第2の定電圧電位に電気的に接続され、前記第5の薄膜トランジスタのゲートは、第1の定電圧電位に電気的に接続され、ソースは、第1のノードに電気的に接続され、ドレインは、第2のノードに電気的に接続され、前記第6の薄膜トランジスタのゲートは、第1のノードに電気的に接続され、ソースは、第3のノードに電気的に接続され、ドレインは、第2の定電圧電位に電気的に接続され、前記第7の薄膜トランジスタのゲートは、第3のノードに電気的に接続され、ソースは、第2のノードに電気的に接続され、ドレインは、第2の定電圧電位に電気的に接続され、前記第8の薄膜トランジスタのゲートは、第m+3本のクロック信号に電気的に接続され、ソースは、第n段のGOAユニットのゲート走査信号に接続され、ドレインは、第2の定電圧電位に電気的に接続され、前記第9の薄膜トランジスタのゲートは、第m本のクロック信号に電気的に接続され、ソースは、第1の定電圧電位に電気的に接続され、ドレインは、抵抗の一端に電気的に接続され、前記第10の薄膜トランジスタのゲートは、第m+2本のクロック信号に電気的に接続され、ソースは、第2の定電圧電位に電気的に接続され、ドレインは、抵抗の他端に電気的に接続され、前記第1のコンデンサの一端は、第2のノードに電気的に接続され、他端は、第n段のGOAユニットのゲート走査信号に接続され、前記第2のコンデンサの一端は、第3のノードに電気的に接続され、他端は、第2の定電圧電位に電気的に接続され、
前記第3のノードは、前記プルダウンモジュールのスイッチノードである請求項1に記載のGOA回路。 - 第1段及び第2段のGOAユニットにおいて、前記第1の薄膜トランジスタのゲートは、回路のスタート信号に電気的に接続され
最後から2番目の段及び最終段のGOAユニットにおいて、前記第3の薄膜トランジスタのゲートは、回路のスタート信号に電気的に接続される請求項2に記載のGOA回路。 - 第1、第2、第3、及び第4本のクロック信号という4本のクロック信号を含み、前記第m本のクロック信号が第2本のクロック信号である場合に、第m+3本のクロック信号は第1本のクロック信号であり、前記第m本のクロック信号が第3本のクロック信号である場合に、第m+2本のクロック信号は第1本のクロック信号であり、第m+3本のクロック信号は第2本のクロック信号であり、前記第m本のクロック信号が第4本のクロック信号である場合に、第m+1本のクロック信号は第1本のクロック信号であり、第m+2本のクロック信号は第2本のクロック信号であり、第m+3本のクロック信号は第3本のクロック信号である請求項1に記載のGOA回路。
- 前記第1、第2、第3、及び第4本のクロック信号のパルス周期は同じであり、前の1本のクロック信号の立ち下がりエッジと次の1本のクロック信号の立ち上がりエッジとは同時に発生する請求項4に記載のGOA回路。
- 前記各薄膜トランジスタは、いずれもN型薄膜トランジスタであり、前記第1の定電圧電位は定電圧高電位であり、第2の定電圧電位は定電圧低電位である請求項2に記載のGOA回路。
- 前記各薄膜トランジスタは、いずれもP型薄膜トランジスタであり、前記第1の定電圧電位は定電圧低電位であり、第2の定電圧電位は定電圧高電位である請求項2に記載のGOA回路。
- 前記各薄膜トランジスタは、いずれも低温ポリシリコン薄膜トランジスタである請求項2に記載のGOA回路。
- 正方向走査を行う場合に、前記正方向走査制御信号は高電位であり、逆方向走査制御信号は低電位であり、
逆方向走査を行う場合に、前記正方向走査制御信号は低電位であり、逆方向走査制御信号は高電位である請求項6に記載のGOA回路。 - 正方向走査を行う場合に、前記正方向走査制御信号は低電位であり、逆方向走査制御信号は高電位であり、
逆方向走査を行う場合に、前記正方向走査制御信号は高電位であり、逆方向走査制御信号は低電位である請求項7に記載のGOA回路。 - カスケード接続された多段のGOAユニットを含むGOA回路であって、各段のGOAユニットは、いずれも走査制御モジュールと、前記走査制御モジュールに電気的に接続された出力モジュールと、前記出力モジュールに電気的に接続されたプルダウンモジュールと、前記走査制御モジュール、出力モジュール及びプルダウンモジュールにいずれも電気的に接続されたプルダウン制御モジュールと、を含み、
n及びmはいずれも正の整数とし、第1段、第2段、最後から2番目の段、及び最終段のGOAユニット以外に、第n段のGOAユニットにおいて、
前記走査制御モジュールは、正方向走査制御信号又は逆方向走査制御信号を利用して前記GOA回路が正方向走査又は逆方向走査を行うように制御し、
前記出力モジュールは、第m+1本のクロック信号に接続され、第n段のGOAユニットの作用期間に第m+1本のクロック信号を利用して第n段のGOAユニットのゲート走査信号を出力し、
前記プルダウンモジュールは、第m+3本のクロック信号に接続され、第n段のGOAユニットの非作用期間に前記第n段のGOAユニットのゲート走査信号の電位をプルダウンし、
前記プルダウン制御モジュールは、第m本のクロック信号、第m+2本のクロック信号、第1の定電圧電位、第2の定電圧電位に接続され、第n段のGOAユニットの作用期間にプルダウンモジュールをオフにし、出力モジュールをオンに維持し、第n段のGOAユニットの非作用期間にプルダウンモジュールをオンにし、出力モジュールをオフにし、同時に第m本のクロック信号及び第m+2本のクロック信号を利用して第1の定電圧電位及び第2の定電圧電位を制御してプルダウンモジュールのスイッチノードに対してタイミング充放電を行い、
前記第1の定電圧電位と第2の定電圧電位の電位は逆であり、前記正方向走査制御信号と逆方向走査制御信号の電位は逆であり、
前記走査制御モジュールは、第1の薄膜トランジスタ、及び第3の薄膜トランジスタを含み、前記出力モジュールは、第2の薄膜トランジスタ、及び第1のコンデンサを含み、前記プルダウンモジュールは、第4の薄膜トランジスタ、第8の薄膜トランジスタ、及び第2のコンデンサを含み、前記プルダウン制御モジュールは、第6の薄膜トランジスタ、第7の薄膜トランジスタ、第9の薄膜トランジスタ、第10の薄膜トランジスタ、及び抵抗を含み、前記GOA回路は、さらに電圧安定化モジュールを含み、前記電圧安定化モジュールは、第5の薄膜トランジスタを含み、
前記第1の薄膜トランジスタのゲートは、第n−2段のGOAユニットのゲート走査信号に接続され、ソースは、正方向走査制御信号に接続され、ドレインは、第1のノードに電気的に接続され、前記第2の薄膜トランジスタのゲートは、第2のノードに電気的に接続され、ソースは、第m+1本のクロック信号に電気的に接続され、ドレインは、第n段のGOAユニットのゲート走査信号に接続され、前記第3の薄膜トランジスタのゲートは、第n+2段のGOAユニットのゲート走査信号に接続され、ソースは、逆方向走査制御信号に接続され、ドレインは、第1のノードに電気的に接続され、前記第4の薄膜トランジスタのゲートは、第3のノードに電気的に接続され、ソースは、第n段のGOAユニットのゲート走査信号に接続され、ドレインは、第2の定電圧電位に電気的に接続され、前記第5の薄膜トランジスタのゲートは、第1の定電圧電位に電気的に接続され、ソースは、第1のノードに電気的に接続され、ドレインは、第2のノードに電気的に接続され、前記第6の薄膜トランジスタのゲートは、第1のノードに電気的に接続され、ソースは、第3のノードに電気的に接続され、ドレインは、第2の定電圧電位に電気的に接続され、前記第7の薄膜トランジスタのゲートは、第3のノードに電気的に接続され、ソースは、第2のノードに電気的に接続され、ドレインは、第2の定電圧電位に電気的に接続され、前記第8の薄膜トランジスタのゲートは、第m+3本のクロック信号に電気的に接続され、ソースは、第n段のGOAユニットのゲート走査信号に接続され、ドレインは、第2の定電圧電位に電気的に接続され、前記第9の薄膜トランジスタのゲートは、第m本のクロック信号に電気的に接続され、ソースは、第1の定電圧電位に電気的に接続され、ドレインは、抵抗の一端に電気的に接続され、前記第10の薄膜トランジスタのゲートは、第m+2本のクロック信号に電気的に接続され、ソースは、第2の定電圧電位に電気的に接続され、ドレインは、抵抗の他端に電気的に接続され、前記第1のコンデンサの一端は、第2のノードに電気的に接続され、他端は、第n段のGOAユニットのゲート走査信号に接続され、前記第2のコンデンサの一端は、第3のノードに電気的に接続され、他端は、第2の定電圧電位に電気的に接続され、
前記第3のノードは、前記プルダウンモジュールのスイッチノードであり、
第1段及び第2段のGOAユニットにおいて、前記第1の薄膜トランジスタのゲートは、回路のスタート信号に電気的に接続され、
最後から2番目の段及び最終段のGOAユニットにおいて、前記第3の薄膜トランジスタのゲートは、回路のスタート信号に電気的に接続され、
前記各薄膜トランジスタは、いずれも低温ポリシリコン薄膜トランジスタであり、
第m本のクロック信号と、第m+1本のクロック信号と、第m+2本のクロック信号と、第m+3本のクロック信号とは、パルスの立ち上がり及び立ち下がりの位相がπ/2(90°)ずつこの順にずれた4つのクロック信号であって、各パルスのハイレベル期間は重畳しないGOA回路。 - 第1、第2、第3、及び第4本のクロック信号という4本のクロック信号を含み、前記第m本のクロック信号が第2本のクロック信号である場合に、第m+3本のクロック信号は第1本のクロック信号であり、前記第m本のクロック信号が第3本のクロック信号である場合に、第m+2本のクロック信号は第1本のクロック信号であり、第m+3本のクロック信号は第2本のクロック信号であり、前記第m本のクロック信号が第4本のクロック信号である場合に、第m+1本のクロック信号は第1本のクロック信号であり、第m+2本のクロック信号は第2本のクロック信号であり、第m+3本のクロック信号は第3本のクロック信号である請求項11に記載のGOA回路。
- 前記第1、第2、第3、及び第4本のクロック信号のパルス周期は同じであり、前の1本のクロック信号の立ち下がりエッジと次の1本のクロック信号の立ち上がりエッジとは同時に発生する請求項12に記載のGOA回路。
- 前記各薄膜トランジスタは、いずれもN型薄膜トランジスタであり、前記第1の定電圧電位は定電圧高電位であり、第2の定電圧電位は定電圧低電位である請求項11に記載のGOA回路。
- 前記各薄膜トランジスタは、いずれもP型薄膜トランジスタであり、前記第1の定電圧電位は定電圧低電位であり、第2の定電圧電位は定電圧高電位である請求項11に記載のGOA回路。
- 正方向走査を行う場合に、前記正方向走査制御信号は高電位であり、逆方向走査制御信号は低電位であり、
逆方向走査を行う場合に、前記正方向走査制御信号は低電位であり、逆方向走査制御信号は高電位である請求項14に記載のGOA回路。 - 正方向走査を行う場合に、前記正方向走査制御信号は低電位であり、逆方向走査制御信号は高電位であり、
逆方向走査を行う場合に、前記正方向走査制御信号は高電位であり、逆方向走査制御信号は低電位である請求項15に記載のGOA回路。
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