JP6785573B2 - A method for manufacturing a substrate having a coating and a substrate having a corresponding coating. - Google Patents
A method for manufacturing a substrate having a coating and a substrate having a corresponding coating. Download PDFInfo
- Publication number
- JP6785573B2 JP6785573B2 JP2016093159A JP2016093159A JP6785573B2 JP 6785573 B2 JP6785573 B2 JP 6785573B2 JP 2016093159 A JP2016093159 A JP 2016093159A JP 2016093159 A JP2016093159 A JP 2016093159A JP 6785573 B2 JP6785573 B2 JP 6785573B2
- Authority
- JP
- Japan
- Prior art keywords
- substrate
- silicon layer
- layer
- manufacturing
- coating
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Active
Links
- 239000000758 substrate Substances 0.000 title claims description 53
- 238000004519 manufacturing process Methods 0.000 title claims description 25
- 239000011248 coating agent Substances 0.000 title claims description 23
- 238000000576 coating method Methods 0.000 title claims description 23
- 238000000034 method Methods 0.000 title claims description 10
- 229910021417 amorphous silicon Inorganic materials 0.000 claims description 30
- 229910021420 polycrystalline silicon Inorganic materials 0.000 claims description 30
- 229910052738 indium Inorganic materials 0.000 claims description 20
- APFVFJFRJDLVQX-UHFFFAOYSA-N indium atom Chemical compound [In] APFVFJFRJDLVQX-UHFFFAOYSA-N 0.000 claims description 20
- WATWJIUSRGPENY-UHFFFAOYSA-N antimony atom Chemical compound [Sb] WATWJIUSRGPENY-UHFFFAOYSA-N 0.000 claims description 19
- 239000013078 crystal Substances 0.000 claims description 17
- 238000005224 laser annealing Methods 0.000 claims description 7
- 238000005229 chemical vapour deposition Methods 0.000 claims description 4
- 238000004544 sputter deposition Methods 0.000 claims description 3
- 238000007740 vapor deposition Methods 0.000 claims description 2
- WPYVAWXEWQSOGY-UHFFFAOYSA-N indium antimonide Chemical compound [Sb]#[In] WPYVAWXEWQSOGY-UHFFFAOYSA-N 0.000 description 11
- 238000002425 crystallisation Methods 0.000 description 7
- 230000008025 crystallization Effects 0.000 description 7
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 4
- 239000002800 charge carrier Substances 0.000 description 4
- 238000000623 plasma-assisted chemical vapour deposition Methods 0.000 description 4
- 229910052710 silicon Inorganic materials 0.000 description 4
- 239000010703 silicon Substances 0.000 description 4
- 230000015572 biosynthetic process Effects 0.000 description 3
- 239000004065 semiconductor Substances 0.000 description 2
- 229910021419 crystalline silicon Inorganic materials 0.000 description 1
- 230000001419 dependent effect Effects 0.000 description 1
- 238000007687 exposure technique Methods 0.000 description 1
- 230000001678 irradiating effect Effects 0.000 description 1
- 239000002245 particle Substances 0.000 description 1
- 238000007711 solidification Methods 0.000 description 1
- 230000008023 solidification Effects 0.000 description 1
- 238000001947 vapour-phase growth Methods 0.000 description 1
- 238000001429 visible spectrum Methods 0.000 description 1
Images
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02436—Intermediate layers between substrates and deposited layers
- H01L21/02439—Materials
- H01L21/02441—Group 14 semiconducting materials
- H01L21/0245—Silicon, silicon germanium, germanium
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02518—Deposited layers
- H01L21/02521—Materials
- H01L21/02524—Group 14 semiconducting materials
- H01L21/02532—Silicon, silicon germanium, germanium
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02518—Deposited layers
- H01L21/02521—Materials
- H01L21/02538—Group 13/15 materials
- H01L21/02549—Antimonides
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02656—Special treatments
- H01L21/02664—Aftertreatments
- H01L21/02667—Crystallisation or recrystallisation of non-monocrystalline semiconductor materials, e.g. regrowth
- H01L21/02675—Crystallisation or recrystallisation of non-monocrystalline semiconductor materials, e.g. regrowth using laser beams
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10N—ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10N52/00—Hall-effect devices
- H10N52/01—Manufacture or treatment
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02612—Formation types
- H01L21/02617—Deposition types
- H01L21/0262—Reduction or decomposition of gaseous compounds, e.g. CVD
Description
本発明は、コーティングを有する基板の製造方法、及び、対応するコーティングを有する基板に関する。 The present invention relates to a method for producing a substrate having a coating and a substrate having a corresponding coating.
多くの能動MEMSデバイスにおいて、高い電荷担体移動度が有利である。特に、応答の迅速なスイッチングエレメント又は磁界センサ(ホールセンサ)では、高い電荷担体移動度が必要である。この場合、アンチモン化インジウムInSbは、約78000cm2/(V・s)の極めて高い電荷担体移動度を有するので、特に適する。 High charge carrier mobility is advantageous in many active MEMS devices. In particular, rapid response switching elements or magnetic field sensors (hall sensors) require high charge carrier mobility. In this case, indium antimonide InSb is particularly suitable because it has an extremely high charge carrier mobility of about 78,000 cm 2 / (V · s).
米国特許第5668395号明細書から、アンチモン化インジウム層を基板上に形成するための製造方法が公知である。 From U.S. Pat. No. 5,668,395, a manufacturing method for forming an indium antimonide layer on a substrate is known.
典型的には、アンチモン化インジウム層の形成に必要とされる温度は、200℃をはるかに上回り、例えば500℃である。このため、アンチモン化インジウム層は、例えば特定用途向け集積回路ASICにおける温度に敏感なデバイス上には、全く形成できないか、又は、温度に敏感な構造体を設ける前にしか形成できない。 Typically, the temperature required to form the indium antimonide layer is well above 200 ° C, for example 500 ° C. For this reason, the indium antimonide layer cannot be formed at all on a temperature-sensitive device, for example, in an application-specific integrated circuit ASIC, or can be formed only before a temperature-sensitive structure is provided.
本発明は、請求項1に記載の特徴を有するコーティングを有する基板の製造方法と、請求項7に記載の特徴を有するコーティングを有する基板とを開示する。
The present invention discloses a method for producing a substrate having a coating having the characteristics according to
相応に、コーティングを有する基板の製造方法として、基板の表面上にアモルファスシリコン層を形成するステップと、アモルファスシリコン層を多結晶シリコン層へ結晶化するステップと、多結晶シリコン層上にアンチモン化インジウム層を形成するステップとを含む方法が提案される。 Correspondingly, as a method for manufacturing a substrate having a coating, a step of forming an amorphous silicon layer on the surface of the substrate, a step of crystallizing the amorphous silicon layer into a polycrystalline silicon layer, and an antimonized indium on the polycrystalline silicon layer. A method including a step of forming a layer is proposed.
さらに、コーティングを有する基板として、基板の表面上に形成された多結晶シリコン層と、多結晶シリコン層上に形成されたアンチモン化インジウム層とを備えている基板が提案される。 Further, as a substrate having a coating, a substrate having a polycrystalline silicon layer formed on the surface of the substrate and an antimonide indium layer formed on the polycrystalline silicon layer is proposed.
好ましい実施形態は、各従属請求項の対象となっている。 Preferred embodiments are subject to each dependent claim.
発明の利点
本発明により、基板上にアンチモン化インジウム層を製造する低コストの方法が実現される。当該方法では、温度は、少なくとも基板表面の反対側の基板裏面において、例外なく、低い領域、好ましくは200℃を下回る領域に保持される。これにより、温度に敏感なデバイス、例えばASICにも、アンチモン化インジウム層を形成することができる。特に、充分に大きな電荷担体移動度を有するInSb層を製造することができる。
Advantages of the Invention The present invention realizes a low cost method for producing an indium antimonide layer on a substrate. In this method, the temperature is, without exception, maintained in a low region, preferably below 200 ° C., at least on the back surface of the substrate opposite the surface of the substrate. As a result, the indium antimonide layer can be formed even in a temperature-sensitive device such as an ASIC. In particular, an InSb layer having a sufficiently large charge carrier mobility can be produced.
本発明に係る製造方法の別の態様によれば、アモルファスシリコン層を形成するステップが、プラズマ利用型の化学気相成長(以下、プラズマ化学気相成長とする。)PECVDによって行われる。これにより、特に、基板が強く加熱されることがなくなる。好ましくは、この場合、基板裏面は、200℃を超える温度には加熱されない。従って、本発明に係る方法の当該ステップは、温度に敏感なデバイスと組み合わせた適用乃至利用にも適する。 According to another aspect of the manufacturing method according to the present invention, the step of forming the amorphous silicon layer is performed by plasma-based chemical vapor deposition (hereinafter referred to as plasma chemical vapor deposition) PECVD. As a result, the substrate is not particularly strongly heated. Preferably, in this case, the back surface of the substrate is not heated to a temperature above 200 ° C. Therefore, the steps of the method according to the invention are also suitable for application or use in combination with temperature sensitive devices.
本発明に係る製造方法の別の態様によれば、アモルファスシリコン層を結晶化するステップが、基板表面とは反対側の基板裏面の温度が200℃を超えて上昇しないように、レーザアニーリングによって行われる。これにより、アモルファスシリコン層の結晶化ステップにおいても基板は強くは加熱されず、従って、このステップも温度に敏感なデバイスでの適用に適する。 According to another aspect of the manufacturing method according to the present invention, the step of crystallizing the amorphous silicon layer is performed by laser annealing so that the temperature of the back surface of the substrate opposite to the surface of the substrate does not rise above 200 ° C. Will be As a result, the substrate is not strongly heated even in the crystallization step of the amorphous silicon layer, and therefore this step is also suitable for application in temperature-sensitive devices.
本発明に係る製造方法の別の態様によれば、レーザアニーリングの前に、アモルファスシリコン層の上方にマスクが形成される。この場合、レーザアニーリングによって結晶化された被覆なしの領域が、マスクで覆われた隣接領域の結晶化の核として用いられる。 According to another aspect of the manufacturing method according to the present invention, a mask is formed above the amorphous silicon layer prior to laser annealing. In this case, the uncoated region crystallized by laser annealing is used as the crystallization core of the masked adjacent region.
本発明に係る製造方法の別の態様によれば、マスクは、条片パターンを形成している。 According to another aspect of the manufacturing method according to the present invention, the mask forms a strip pattern.
本発明に係る製造方法の別の態様によれば、アンチモン化インジウム層を形成するステップがスパッタリング及び/又は気相成長によって行われる。当該ステップも、特に、基板裏面が200℃を超える温度まで加熱されないように実行可能である。 According to another aspect of the production method according to the present invention, the step of forming the antimonide indium layer is carried out by sputtering and / or vapor deposition. The step can also be performed, in particular, so that the back surface of the substrate is not heated to a temperature above 200 ° C.
本発明に係る、コーティングを有する基板の別の態様によれば、多結晶シリコン層の結晶粒組織は、アンチモン化インジウム層の結晶粒組織に連続している。このため、多結晶シリコン層の結晶粒組織即ち各単結晶の幅を、例えばレーザアニーリングの際のレーザの光強度の適合化によってアライメントすることにより、アンチモン化インジウム層の結晶粒組織を調整することができる。 According to another aspect of the substrate having a coating according to the present invention, the grain structure of the polycrystalline silicon layer is continuous with the grain structure of the indium antimonide layer. Therefore, the grain structure of the antimonide indium layer is adjusted by aligning the grain structure of the polycrystalline silicon layer, that is, the width of each single crystal, for example, by adjusting the light intensity of the laser during laser annealing. Can be done.
図中、同じ要素及び装置、又は、同様の機能を有する要素及び装置には、特段のことわりがない限り、同じ参照番号を付してある。方法ステップの参照番号は、理解し易くするために付したものであって、特段のことわりがない限り、定められた時間順序を特に意味するものではない。特に、複数の方法ステップを同時に実行することができる。 In the figure, the same elements and devices, or elements and devices having similar functions are designated by the same reference numbers unless otherwise specified. The reference numbers for the method steps are given for ease of understanding and do not specifically imply a defined time sequence unless otherwise noted. In particular, multiple method steps can be performed simultaneously.
図1には、コーティングを有する基板の製造方法を説明するフローチャートが示されている。第1のステップS1では、図2に示されているように、基板10の表面10aにアモルファスシリコン層11が形成される。ここでは、基板は、特に半導体基板、例えばシリコン基板を含み得る。基板10は、さらに裏面10bを有する。
FIG. 1 shows a flowchart illustrating a method of manufacturing a substrate having a coating. In the first step S1, as shown in FIG. 2, the
アモルファスシリコン層11の形成は、ここでは例えばプラズマ化学気相成長(plasma enhanced chemical vapour deposition, PECVD)によって行うことができる。これにより、アモルファスシリコン層11を形成する際のウェーハ温度は低く保持され、例えば300℃を下回り、好ましくは200℃を下回る。
The formation of the
第2のステップS2では、アモルファスシリコン層11が結晶化される。これにより、アモルファスシリコン層11は、図3に示されているように、多結晶シリコン層12へ変換される。多結晶シリコン層12は、複数の単結晶13から形成されている。この場合、各単結晶13の平均幅dは、例えば0.1μmから100μmの領域、好ましくは1μmから10μmの領域にあり、多結晶シリコン層12の結晶粒組織を形成している。
In the second step S2, the
多結晶シリコンは、特に、連続粒界結晶シリコンCGSを含み得る。 Polycrystalline silicon may particularly include continuous grain boundary crystalline silicon CGS.
一実施形態によれば、当該結晶化は、レーザアニーリングによって行うことができる。特に、当該結晶化は、“Sequential Lateral Solidification”プロセス(SLSプロセス)によって実行可能である。このために、図4に示されているように、マスク30がアモルファスシリコン層11上に配置される。この場合、マスクは、アモルファスシリコン層11に対して間隔をおいて配置される。ここで、図4には、アモルファスシリコン層11を上部に形成した基板10を上から見た図が示されている。
According to one embodiment, the crystallization can be performed by laser annealing. In particular, the crystallization can be performed by a "Sequential Lateral Solidification" process (SLS process). For this purpose, the
マスク30は、不透光性の複数の条片30aから形成されている。各条片は、この場合、例えば数マイクロメートルの領域の幅d1を有する。マスク30の条片30aの相互間隔d2は、各条片そのものの幅d1と等しいが、本発明は、この形態に限定されない。
The
マスク30が条片パターンを有することは必須ではなく、他の形状を有してもよい。
It is not essential that the
図5には、アモルファスシリコン層11と(この図では見えていない)マスク30とを備えた基板10の、図4に示されているI−I線に沿った断面図が示されている。
FIG. 5 shows a cross-sectional view of the
アモルファスシリコン層11の上方にマスク30を導入した後、アモルファスシリコン層11及びその前方に存在するマスク30に、レーザ20によってレーザビーム21が照射される。このために、好ましくは、レーザ20として、マスク30を含むアモルファスシリコン層11を数ナノ秒間隔で照射するエキシマレーザが使用される。レーザ20から放出される光ビーム21は、この場合、例えば100μmから300μmの領域の幅Dを有する。
After introducing the
但し、本発明は、この形態に限定されず、特に、レーザ20は、可視スペクトルの固体レーザであってもよい。
However, the present invention is not limited to this form, and in particular, the
アモルファスシリコン層11のうちレーザ20の照射を受けた部分は、多結晶シリコン層12に変換される。この場合、レーザは、図4のI−I線に対して平行なX軸線に沿ってガイドされる。但し、本発明は、この形態に限定されない。特に、レーザは、マスク30の各条片30aに対して垂直な軸線、即ち、図4のI−I線に対して垂直な軸線に沿って、又は、任意の曲線に沿って、ガイド可能である。
The portion of the
レーザは、連続して又は部分ごとに移動可能である。特に、レーザ20の移動は、アモルファスシリコン層11の各領域に正確に1回ずつレーザビーム21が入射するように設定可能である。この場合、レーザ20の移動は、レーザ20の周波数に基づいて設定される。
The laser can move continuously or piece by piece. In particular, the movement of the
レーザ20での照射により、アモルファスシリコン層11のうちマスク30によって覆われていない部分が多結晶シリコン層12に変換される。多結晶シリコン層12は、アモルファスシリコン層11のうちマスク30によって覆われた部分の結晶化の核として用いられ、これにより、当該部分が多結晶シリコン層12に変換されて、図3に示されている構造が生じる。このようにして、アモルファスシリコン層11の全体が多結晶シリコン層12に変換される。
By irradiation with the
シリコン層11に、2回以上、光ビーム21が入射してもよい。特に、シリコン層11が光ビーム21に露光される回数によって、多結晶シリコン層12の粒径を変化させることができる。
The
好ましくは、アモルファスシリコン層11をレーザ20で照射する際の光強度及び周波数を調整することにより、基板裏面10bの温度を、所定の設定値、例えば300℃、好ましくは200℃より低く保持することができる。
Preferably, the temperature of the
但し、本発明は、この形態に限定されない。特に、アモルファスシリコン層11の結晶化は、他の露光技術を用いて、例えばスキャナを使用して、行うこともできる。
However, the present invention is not limited to this form. In particular, the crystallization of the
さらなるステップS3では、多結晶シリコン層12上にアンチモン化インジウム層(InSb層)14が形成され、これにより、図6に示されているコーティングを有する基板16が得られる。例えば、アンチモン化インジウム層14の形成は、気相成長によって行われる。特に、アンチモン化インジウム層14は、プラズマ化学気相成長PECVDによって行われる。但し、アンチモン化インジウム層14の形成は、スパッタリングによって行うこともできる。
In a further step S3, an antimonide indium layer (InSb layer) 14 is formed on the
多結晶シリコン層12の各単結晶13は、アンチモン化インジウム層14の結晶化の核として用いられる。よって、アンチモン化インジウム層14の各単結晶15は、多結晶シリコン層12の各単結晶13に対応する。特に、アンチモン化インジウム層14の単結晶15の幅d3は、多結晶シリコン層12の対応する単結晶13の幅dと同等である。
Each
好ましくは、アンチモン化インジウム層14は、基板裏面10bの温度が、所定の設定値、例えば300℃、好ましくは200℃より低く保持されるように形成される。
Preferably, the
また、本発明は、図6に示されているコーティングを有する基板16にも関する。コーティングを有する基板16は、基板10、好ましくは半導体基板、例えばシリコン基板から形成されている。基板10の表面10aには、複数の単結晶13を含む多結晶シリコン層12が形成されている。多結晶シリコン層12上にはさらに、複数の単結晶15を含むアンチモン化インジウム層14が形成されている。
The present invention also relates to a
一実施形態によれば、多結晶シリコン層12の結晶粒組織は、アンチモン化インジウム層14の結晶粒組織に連続している。これは、アンチモン化インジウム層14の各単結晶15、即ち、特にその幅が、多結晶シリコン層12の各単結晶13に対応することを意味する。
According to one embodiment, the grain structure of the
本発明に係る装置は、例えば、LCDスクリーンでの使用に適する。 The device according to the present invention is suitable for use on, for example, an LCD screen.
さらに、上記製造方法及び上記装置は、磁気センサ(磁界センサエレメント)、特にホールセンサでの使用にも適する。この場合、アンチモン化インジウム層14は、全体として又は部分的に、磁気センサとしての動作及び磁気センサの駆動の双方、及び/又は、磁気センサパラメータの処理のいずれにも使用可能である。また、こうした層又はこうした構造を方位磁石に利用することもできる。
Further, the manufacturing method and the apparatus are also suitable for use in a magnetic sensor (magnetic field sensor element), particularly a Hall sensor. In this case, the
さらに、当該装置は、ホールセンサでの使用に適する。 In addition, the device is suitable for use with Hall sensors.
Claims (8)
基板(10)の表面(10a)上にアモルファスシリコン層(11)を形成するステップ(S1)と、
前記アモルファスシリコン層(11)を多結晶シリコン層(12)へ結晶化するステップ(S2)と、
前記多結晶シリコン層(12)上にアンチモン化インジウム層(14)を形成するステップ(S3)と、
を含み、
前記多結晶シリコン層(12)の結晶粒組織は、前記アンチモン化インジウム層(14)の結晶粒組織に連続している、
ことを特徴とする製造方法。 A method for manufacturing a substrate (16) having a coating.
The step (S1) of forming the amorphous silicon layer (11) on the surface (10a) of the substrate (10),
The step (S2) of crystallizing the amorphous silicon layer (11) into the polycrystalline silicon layer (12),
In the step (S3) of forming the antimonide indium layer (14) on the polycrystalline silicon layer (12),
Only including,
The crystal grain structure of the polycrystalline silicon layer (12) is continuous with the crystal grain structure of the antimonide indium layer (14).
A manufacturing method characterized by that.
請求項1に記載の製造方法。 The step (S1) for forming the amorphous silicon layer (11) is performed by plasma chemical vapor deposition.
The manufacturing method according to claim 1.
請求項1又は2に記載の製造方法。 In the step (S2) of crystallizing the amorphous silicon layer (11), the temperature of the back surface (10b) of the substrate (10) opposite to the front surface (10a) of the substrate (10) is 200 ° C. Perform by laser annealing so that it does not rise beyond
The manufacturing method according to claim 1 or 2.
請求項3に記載の製造方法。 Prior to the laser annealing, a mask (30) is provided above the amorphous silicon layer (11).
The manufacturing method according to claim 3.
請求項4に記載の製造方法。 The mask (30) forms a strip pattern.
The manufacturing method according to claim 4.
請求項1乃至5のいずれか一項に記載の製造方法。 The step (S3) of forming the antimonide indium layer (14) is carried out by sputtering and / or vapor deposition.
The manufacturing method according to any one of claims 1 to 5.
基板(10)の表面上に形成された多結晶シリコン層(12)と、
前記多結晶シリコン層(12)上に形成されたアンチモン化インジウム層(14)と、
を備えており、
前記多結晶シリコン層(12)の結晶粒組織は、前記アンチモン化インジウム層(14)の結晶粒組織に連続している、
ことを特徴とするコーティングを有する基板(16)。 Substrate (16) with coating
The polycrystalline silicon layer (12) formed on the surface of the substrate (10) and
The antimonide indium layer (14) formed on the polycrystalline silicon layer (12) and
Equipped with a,
The crystal grain structure of the polycrystalline silicon layer (12) is continuous with the crystal grain structure of the antimonide indium layer (14).
A substrate having a coating, characterized in that (16).
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE102015208519.8 | 2015-05-07 | ||
DE102015208519.8A DE102015208519B4 (en) | 2015-05-07 | 2015-05-07 | Manufacturing process for a coated substrate |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2016213462A JP2016213462A (en) | 2016-12-15 |
JP6785573B2 true JP6785573B2 (en) | 2020-11-18 |
Family
ID=57178782
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2016093159A Active JP6785573B2 (en) | 2015-05-07 | 2016-05-06 | A method for manufacturing a substrate having a coating and a substrate having a corresponding coating. |
Country Status (2)
Country | Link |
---|---|
JP (1) | JP6785573B2 (en) |
DE (1) | DE102015208519B4 (en) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE102020127431A1 (en) * | 2020-10-19 | 2022-04-21 | Fraunhofer-Gesellschaft zur Förderung der angewandten Forschung eingetragener Verein | Process for producing a crystalline silicon layer on a substrate with integrated electronic components |
Family Cites Families (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5014276A (en) | 1973-06-06 | 1975-02-14 | ||
US5668395A (en) | 1994-11-22 | 1997-09-16 | Northwestern University | Composition for InSB and GaAs thin film on silicon substrate for use in photodetectors |
US20060024442A1 (en) | 2003-05-19 | 2006-02-02 | Ovshinsky Stanford R | Deposition methods for the formation of polycrystalline materials on mobile substrates |
US20090315551A1 (en) | 2008-06-20 | 2009-12-24 | Jingshi Hu | Linear magnetoresistance sensor |
-
2015
- 2015-05-07 DE DE102015208519.8A patent/DE102015208519B4/en active Active
-
2016
- 2016-05-06 JP JP2016093159A patent/JP6785573B2/en active Active
Also Published As
Publication number | Publication date |
---|---|
JP2016213462A (en) | 2016-12-15 |
DE102015208519B4 (en) | 2022-05-19 |
DE102015208519A1 (en) | 2016-11-10 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
KR100578787B1 (en) | semiconductor device and method of manufacturing the same | |
JP2002246312A (en) | Method for optimizing channel characteristics using multiple masks for forming laterally crystallized ela polycrystalline si film | |
JP2011505685A5 (en) | ||
KR100753432B1 (en) | Apparatus and crystallization method for polycrystalline silicon | |
US20040134417A1 (en) | Mask for crystallizing, method of crystallizing amorphous silicon and method of manufacturing array substrate using the same | |
KR20140043021A (en) | Polysilicon thin film and manufacturing method thereof, array substrate and display device | |
MX2012005204A (en) | Systems and methods for non-periodic pulse partial melt film processing. | |
TW201248691A (en) | Laser processing device | |
JP6785573B2 (en) | A method for manufacturing a substrate having a coating and a substrate having a corresponding coating. | |
JP2004119971A (en) | Laser processing method and laser processing device | |
JP2008227077A (en) | Masking structure for laser light, laser processing method, tft element, and laser processing apparatus | |
EP3097578B1 (en) | Method for forming polysilicon | |
JP6221088B2 (en) | Laser annealing apparatus and laser annealing method | |
JP2005064487A5 (en) | ||
TW201832367A (en) | Laser irradiation device, manufacturing method of thin film transistor, computer readable recording medium, and projection mask | |
CN106373908B (en) | Polysilicon deposition method and precipitation equipment for it | |
KR101764877B1 (en) | Polysilicon depositing method and depositing apparatus therefor | |
JP2007207896A (en) | Laser beam projection mask, laser processing method using same, laser processing apparatus | |
KR101814763B1 (en) | Polysilicon depositing method and depositing apparatus therefor | |
KR101764876B1 (en) | Polysilicon depositing method and depositing apparatus therefor | |
KR20120006821A (en) | Manufacturing method for thin film of poly-crystalline silicon | |
KR100575235B1 (en) | Optical system using laser and crystallization method using thereof | |
JP2006054222A (en) | Optical modulation element, crystallization device, crystallization method, manufacturing device of thin-film semiconductor substrate, manufacturing method of thin-film semiconductor substrate, thin-film semiconductor device, manufacturing method of thin-film semiconductor device, and display device | |
KR100691247B1 (en) | Method and apparatus for laser crystallization having uniform grain size with lattice mask | |
JP2011139082A (en) | Optical modulation element, crystallizing device, crystallizing method, apparatus for manufacturing thin-film semiconductor substrate, method for manufacturing thin-film semiconductor substrate, thin-film semiconductor device, method for manufacturing thin-film semiconductor device, and display device |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20160624 |
|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20190129 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20200206 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20200212 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20200512 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20201012 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20201027 |
|
R150 | Certificate of patent or registration of utility model |
Ref document number: 6785573 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |