JP6659805B2 - 昇圧回路の制御方法 - Google Patents
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Description
以下では、図面を参照して、本実施の形態を詳細に説明する。
[第2の実施の形態]
本実施の形態の昇圧回路10全体の構成は、第1の実施の形態の昇圧回路10(図1)と同様の構成であるため、昇圧回路10全体の構成については、説明を省略する。本実施の形態の昇圧回路10では、コンパレータの構成が第1の実施の形態と異なるので、本実施の形態のコンパレータの構成について説明する。
[第3の実施の形態]
図6には、本実施の形態の昇圧回路の一例の概略構成図を示す。
12 昇圧回路制御部 (昇圧制御部)
22 昇圧部
14 コンパレータ (制御回路)
16 スイッチ素子 (スイッチ)
23 グラウンド線 (第3の電位線)
25 基準電圧線 (第1の電位線)
27 昇圧電圧線 (第2の電位線)
30 PMOSトランジスタ (第1のPMOSトランジスタ)
32 PMOSトランジスタ (第2のPMOSトランジスタ)
34 PMOSトランジスタ (第5のPMOSトランジスタ)
36 PMOSトランジスタ (第6のPMOSトランジスタ)
38 PMOSトランジスタ (第3のPMOSトランジスタ)
40 PMOSトランジスタ (第4のPMOSトランジスタ)
42 NMOSトランジスタ (第1のNMOSトランジスタ)
44 NMOSトランジスタ (第2のNMOSトランジスタ)
46 NMOSトランジスタ (第3のNMOSトランジスタ)
48 NMOSトランジスタ (第4のNMOSトランジスタ)
59 電流制御部 (切替部)
60 スイッチ素子 (制御スイッチ)
80 LCDドライバ (半導体装置)
86、88 駆動回路
Claims (1)
- 基準電圧発生回路により、第1の電位線と第2の電位線とに接続されるスイッチがオフの状態において、第1の電位を発生させて前記第1の電位線に供給するステップと、
制御回路により、前記スイッチをオンの状態に制御して、前記第1の電位線に供給された第1の電位を前記第2の電位線に供給するステップと、
前記第2の電位線に接続された昇圧制御部が、前記第2の電位線を介して電源電圧として供給される前記第1の電位により起動し、チャージポンプ型の昇圧部を制御するステップと、
前記昇圧部により、前記第1の電位を昇圧した第2の電位を前記第2の電位線に供給するステップと、
前記制御回路により、前記第1の電位と前記第2の電位との電位差に基づいて、前記スイッチを制御するステップと、
を備えた昇圧回路の制御方法。
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