JP6650459B2 - 表示パネル及びその駆動回路 - Google Patents

Description

本発明は、表示技術分野に関し、特に表示パネル及びその駆動回路に関する。

従来の表示パネルは、一般的に駆動回路を含み、従来の駆動回路は、前記表示パネルの画素ユニットを制御して相応する画像を表示した。

従来の駆動回路は、前記表示パネルに対し駆動する方法として一般的に、
前記駆動回路生成走査信号、データ信号及び選択信号を有し、前記走査信号は、走査線を介して前記画素ユニットに送信され、前記データ信号は、データ線を介して前記画素ユニットに送信され、前記選択信号は、前記データ信号の前記画素ユニットへの出力を選択的に制御する。

実践において、発明者は、従来技術には以下のような問題が存在することに気付いた。

前記走査信号を介して前記表示パネルの画素ユニットを走査する過程において、前記選択信号は、走査対象が一行の画素から他行の画素に転換する際に、いずれもレベル変換を行う必要があるため、前記選択信号のレベル変換頻度が高い。
従って、上記の技術課題を解決する必要があった。

本発明は、駆動回路の選択信号のレベル変換頻度を低減することができる、表示パネル及びその駆動回路を提供することを目的としている。

上記の問題を解決するために、本発明の技術手段は、以下のとおりである。
駆動回路であって、
前記駆動回路は、相応する表示パネルの画素配列を制御して画像を表示し、前記駆動回路は、
前記画素配列に提供されるデータ信号を生成する、データ信号提供モジュールと、
第一選択信号を提供する、第一選択信号生成モジュールと、
第二選択信号を提供する、第二選択信号生成モジュールと、
選択モジュールと、を含み、
前記選択モジュールは、少なくとも二つの選択スイッチスイッチの組み合わせを含み、
前記選択スイッチの組み合わせは、前記第一選択信号生成モジュールと、前記第二選択信号生成モジュールと、前記データ信号提供モジュール及び前記画素配列と電気的に接続され、前記選択スイッチの組み合わせは、前記第一選択信号と、前記第二選択信号及び前記データ信号を受信し、前記第一選択信号及び前記第二選択信号により前記データ信号を前記画素配列に出力し、
前記選択スイッチの組み合わせは、第一スイッチと、第二スイッチと、第三スイッチと、第四スイッチと、を含み、
前記第一スイッチは、前記第一選択信号生成モジュールと、前記データ信号提供モジュールと、前記画素配列中の第一画素列と、電気的に接続され、
前記第二スイッチは、前記第二選択信号生成モジュールと、前記データ信号提供モジュールと、前記画素配列中の第二画素列と、電気的に接続され、
前記第三スイッチは、前記第一選択信号生成モジュールと、前記データ信号提供モジュールと、電気的に接続され、
前記第四スイッチは、前記第二選択信号生成モジュールと、前記第三スイッチと、前記画素配列中の第三画素列と、電気的に接続され、
前記駆動回路は、さらに走査信号提供モジュールを含み、前記走査信号提供モジュールは、前記画素配列と電気的に接続され、前記走査信号提供モジュールは、走査信号を生成し、前記走査信号を前記画素配列に送信する。

前記駆動回路において、
前記第一スイッチは、第一制御端と、第一入力端と、第一出力端とを含み、
前記第一制御端と前記第一選択信号生成モジュールとは、電気的に接続され、
前記第一入力端と前記データ信号提供モジュールとは、電気的に接続され、
前記第一出力端と前記第一画素列とは、電気的に接続され、
前記第一制御端は、前記第一選択信号を受信し、前記第一選択信号により、前記第一入力端と前記第一出力端との間の第一電流通路のオン及びオフを制御し、
前記第二スイッチは、第二制御端と、第二入力端と、第二出力端とを含み、
前記第二制御端と前記第二選択信号生成モジュールとは、電気的に接続され、
前記第二入力端と前記データ信号提供モジュールとは、電気的に接続され、
前記第二出力端と前記第二画素列とは、電気的に接続され、
前記第二制御端は、前記第二選択信号を受信し、前記第二選択信号により、前記第二入力端と前記第二出力端との間の第二電流通路のオン及びオフを制御し、
前記第三スイッチは、第三制御端と、第三入力端と、第三出力端とを含み、
前記第三制御端と前記第一選択信号生成モジュールとは、電気的に接続され、
前記第三入力端と前記データ信号提供モジュールとは、電気的に接続され、
前記第三出力端と前記第四スイッチとは、電気的に接続され、
前記第三制御端は、前記第一選択信号を受信し、前記第一選択信号により、前記第三入力端と前記第三出力端との間の第三電流通路のオン及びオフを制御し、
前記第四スイッチは、第四制御端と、第四入力端と、第四出力端とを含み、
前記第四制御端と前記第二選択信号生成モジュールとは、電気的に接続され；
前記第四入力端と前記第三出力端とは、電気的に接続され、
前記第四出力端と前記第三画素列とは、電気的に接続され、
前記第四制御端は、前記第二選択信号を受信し、前記第二選択信号により、前記第四入力端と前記第四出力端との間の第四電流通路のオン及びオフを制御する。

前記駆動回路において、
前記第一電流通路は、前記第三電流通路がオンする時にオフし、且つ、前記第三電流通路がオフする時にオンし、
前記第二電流通路は、前記第四電流通路がオンする時にオフし、且つ、前記第四電流通路がオフする時にオンし、
前記第三電流通路は、前記第一電流通路がオンする時にオフ、且つ、前記第一電流通路がオフする時にオンし、
前記第四電流通路は、前記第二電流通路オンする時にオフし、且つ、前記第二電流通路がオフする時にオンする。

前記駆動回路において、
前記第一選択信号のハイレベルの持続時間と前記第二選択信号のハイレベルの持続時間は同一であり、前記第一選択信号のローレベルの持続時間と前記第二選択信号のローレベルの持続時間は同一であり、
前記第一選択信号のハイレベルの持続時間と前記第二選択信号のハイレベルの持続時間ともに2K個のクロックユニット周期であり、前記第一選択信号のローレベルの持続時間と前記第二選択信号のローレベルの持続時間ともに4K個のクロックユニット周期であり、前記Kは正整数であり、
前記画素配列の走査信号のハイレベルの上がりエッジの開始時間は、前記第一選択信号のハイレベルの持続時間内、または、前記第二選択信号のハイレベルの持続時間内に位置する。

駆動回路であって、
前記駆動回路は、相応する表示パネル中の画素配列を正規化して画像を表示し、前記駆動回路は、
前記画素配列に提供するデータ信号を生成するデータ信号提供モジュールと、
第一選択信号を提供する第一選択信号生成モジュールと、
第二選択信号を提供する第二選択信号生成モジュールと、
選択モジュールと、を含み、
前記選択モジュールは、
少なくとも二つの選択スイッチの組み合わせを含み、
前記選択スイッチの組み合わせは、前記第一選択信号生成モジュールと、前記第二選択信号生成モジュールと、前記データ信号提供モジュールと、前記画素配列と、電気的に接続され、
前記選択スイッチの組み合わせは、前記第一選択信号と、前記第二選択信号及び前記データ信号を受信し、前記第一選択信号及び前記第二選択信号により、前記データ信号を前記画素配列に出力する。

前記駆動回路において、
前記選択スイッチの組み合わせは、第一スイッチと、第二スイッチと、第三スイッチと、第四スイッチと、を含み、
前記第一スイッチは、前記第一選択信号生成モジュールと、前記データ信号提供モジュール及び前記画素配列中の第一画素列と、電気的に接続され、
前記第二スイッチは、前記第二選択信号生成モジュールと、前記データ信号提供モジュール及び前記画素配列中の第二画素列と、電気的に接続され、
前記第三スイッチは、前記第一選択信号生成モジュール及び前記データ信号提供モジュールと、電気的に接続され、
前記第四スイッチは、前記第二選択信号生成モジュールと、前記第三スイッチ及び前記画素配列中の第三画素列と、電気的に接続される。

前記駆動回路において、
前記第一スイッチは、第一制御端と、第一入力端と、第一出力端と、を含み、
前記第一制御端と前記第一選択信号生成モジュールとは、電気的に接続され、
前記第一入力端と前記データ信号提供モジュールとは、電気的に接続され、
前記第一出力端と前記第一画素列とは、電気的に接続され、
前記第一制御端は、前記第一選択信号を受信し、前記第一選択信号により、前記第一入力端と前記第一出力端との間の第一電流通路のオン及びオフを制御し、
前記第二スイッチは、第二制御端と、第二入力端と、第二出力端と、を含み、
前記第二制御端と前記第二選択信号生成モジュールとは、電気的に接続され、
前記第二入力端と前記データ信号提供モジュールとは、電気的に接続され、
前記第二出力端と前記第二画素列とは、電気的に接続され、
前記第二制御端は、前記第二選択信号を受信し、前記第二選択信号により、前記第二入力端と前記第二出力端との間の第二電流通路のオン及びオフ制御し、
前記第三スイッチは、
前記第三制御端と前記第一選択信号生成モジュールとは、電気的に接続され、
前記第三入力端と前記データ信号提供モジュールとは、電気的に接続され、
前記第三出力端と前記第四スイッチとは、電気的に接続され、
前記第三制御端は、前記第一選択信号を受信し、前記第一選択信号により、前記第三入力端と前記第三出力端との間の第三電流通路のオン及びオフを制御し、
前記第四スイッチは、第四制御端と、第四入力端と、第四出力端と、を含み、
前記第四制御端と前記第二選択信号生成モジュールとは、電気的に接続され、
前記第四入力端と前記第三出力端とは、電気的に接続され、
前記第四出力端と前記第三画素列とは、電気的に接続され、
前記第四制御端は、前記第二選択信号を受信し、前記第二選択信号により、前記第四入力端と前記第四出力端との間の第四電流通路のオン及びオフを制御する。

前記駆動回路において、
前記第一制御端は、第一信号線を介して前記第一選択信号生成モジュールと電気的に接続され、
前記第二制御端は、第二信号線を介して前記第二選択信号生成モジュールと電気的に接続され、
前記第三制御端は、前記第一信号線を介して前記第一選択信号生成モジュールと電気的に接続され、
前記第四制御端は、前記第二信号線を介して前記第二選択信号生成モジュールと電気的に接続される。

前記駆動回路において、
前記第一電流通路は、前記第三電流通路がオンする時にオフし、且つ、前記第三電流通路オフする時にオンし、
前記第二電流通路は、前記第四電流通路がオンする時にオフし、且つ、前記第四電流通路がオフする時にオンし、
前記第三電流通路は、前記第一電流通路オンする時にオフし、且つ、前記第一電流通路がオフする時にオンし、
前記第四電流通路は、前記第二電流通路オンする時にオフし、且つ、前記第二電流通路がオフする時にオンする。

前記駆動回路において、
前記第一スイッチと前記第二スイッチともにＮチャンネル金属酸化物半導体トランジスタであり、前記第三スイッチと前記第四スイッチともにPチャンネル金属酸化物半導体トランジスタであり、または、
前記第一スイッチと前記第二スイッチともにPチャンネル金属酸化物半導体トランジスタであり、前記第三スイッチと前記第四スイッチともにＮチャンネル金属酸化物半導体トランジスタである。

前記駆動回路において、
前記第一選択信号のハイレベルの持続時間と前記第二選択信号のハイレベルの持続時間は同一であり、前記第一選択信号のローレベルの持続時間と前記第二選択信号のローレベルの持続時間は同一であり、
前記第一選択信号のハイレベルの持続時間と前記第二選択信号のハイレベル持続時間とともに2K個のクロックユニット周期であり、前記第一選択信号のローレベルの持続時間と前記第二選択信号のローレベル持続時間ともに4K個のクロックユニット周期であり、前記Kは正整数であり、
前記画素配列の走査信号のハイレベルの上がりエッジの開始時間は、前記第一選択信号のハイレベルの持続時間内または、前記第二選択信号のハイレベルの持続時間内に位置する。

前記駆動回路において、
前記走査信号のハイレベルの持続時間は、3K個のクロックユニット周期であり、前記走査信号のローレベルの持続時間も3K個のクロックユニット周期である。

表示パネルであって、
前記表示パネルは、
画素配列、及び、前記画素配列を制御して画像を表示する駆動回路を含み、
前記駆動回路は、
前記画素配列に提供するデータ信号を生成するデータ信号提供モジュールと、
第一選択信号を提供する第一選択信号生成モジュールと、
第二選択信号を提供する第二選択信号生成モジュールと、
選択モジュールと、を含み、
前記選択モジュールは、
少なくとも二つの選択スイッチの組み合わせを含み、
前記選択スイッチの組み合わせは、前記第一選択信号生成モジュールと、前記第二選択信号生成モジュールと、前記データ信号提供モジュール及び前記画素配列と、電気的に接続され、
前記選択スイッチの組み合わせは、前記第一選択信号と、前記第二選択信号と、前記データ信号と、を受信し、前記第一選択信号及び前記第二選択信号により、前記データ信号を前記画素配列に出力する。

前記表示パネルにおいて、
前記選択スイッチの組み合わせは、第一スイッチと、第二スイッチと、第三スイッチと、第四スイッチと、を含み、
前記第一スイッチは、前記第一選択信号生成モジュールと、前記データ信号提供モジュール及び前記画素配列中の第一画素列と、電気的に接続され、
前記第二スイッチは、前記第二選択信号生成モジュールと、前記データ信号提供モジュール及び前記画素配列中の第二画素列と、電気的に接続され、
前記第三スイッチは、前記第一選択信号生成モジュール及び前記データ信号提供モジュールと、電気的に接続され、
前記第四スイッチは、前記第二選択信号生成モジュールと、前記第三スイッチ及び前記画素配列中の第三画素列と、電気的に接続される。

前記表示パネルにおいて、
前記第一スイッチは、第一制御端と、第一入力端と、第一出力端と、を含み、
前記第一制御端は、前記第一選択信号生成モジュールと電気的に接続され、
前記第一入力端は、前記データ信号提供モジュールと電気的に接続され、
前記第一出力端は、前記第一画素列と電気的に接続され、
前記第一制御端は、前記第一選択信号を受信し、且つ、前記第一選択信号により、前記第一入力端と前記第一出力端との間の第一電流通路のオン及びオフを制御し、
前記第二スイッチは、第二制御端と、第二入力端と、第二出力端と、を含み、
前記第二制御端は、前記第二選択信号生成モジュールと電気的に接続され、
前記第二入力端は、前記データ信号提供モジュールと電気的に接続され、
前記第二出力端は、前記第二画素列と電気的に接続され、
前記第二制御端は、前記第二選択信号受信し、且つ前記第二選択信号により、前記第二入力端と前記第二出力端との間の第二電流通路のオン及びオフを制御し、
前記第三スイッチは、第三制御端と、第三入力端と、第三出力端と、を含み、
前記第三制御端は、前記第一選択信号生成モジュールと電気的に接続され、
前記第三入力端は、前記データ信号提供モジュールと電気的に接続され、
前記第三出力端は、前記第四スイッチと電気的に接続され、
前記第三制御端は、前記第一選択信号を受信し、且つ、前記第一選択信号により、前記第三入力端と前記第三出力端との間の第三電流通路のオン及びオフを制御し、
前記第四スイッチは、第四制御端と、第四入力端と、第四出力端と、を含み、
前記第四制御端は、前記第二選択信号生成モジュールと電気的に接続され、
前記第四入力端は、前記第三出力端と電気的に接続され、
前記第四出力端は、前記第三画素列と電気的に接続され、
前記第四制御端は、前記第二選択信号を受信し、且つ、前記第二選択信号により、前記第四入力端と前記第四出力端との間の第四電流通路のオン及びオフを制御する。

前記表示パネルにおいて、
前記第一制御端は、第一信号線を介して前記第一選択信号生成モジュールと電気的に接続され、
前記第二制御端は、第二信号線を介して前記第二選択信号生成モジュールと電気的に接続され、
前記第三制御端は、前記第一信号線を介して前記第一選択信号生成モジュールと電気的に接続され、
前記第四制御端は、前記第二信号線を介して前記第二選択信号生成モジュールと電気的に接続される。

前記表示パネルにおいて、
前記第一電流通路は、前記第三電流通路がオンする時にオフし、且つ前記第三電流通路がオフする時にオンし、
前記第二電流通路は、前記第四電流通路がオンする時にオフし、且つ、前記第四電流通路がオフする時にオンし、
前記第三電流通路は、前記第一電流通路がオンする時にオフし、且つ、前記第一電流通路がオフする時にオンし、
前記第四電流通路は、前記第二電流通路がオンする時にオフし、且つ、前記第二電流通路がオフする時にオンする。

前記表示パネルにおいて、
前記第一スイッチと前記第二スイッチともにＮチャンネル金属酸化物半導体トランジスタであり、前記第三スイッチと前記第四スイッチともにPチャンネル金属酸化物半導体トランジスタであり、または、
前記第一スイッチと前記第二スイッチともにPチャンネル金属酸化物半導体トランジスタであり、前記第三スイッチと前記第四スイッチともにＮチャンネル金属酸化物半導体トランジスタである。

前記表示パネルにおいて、
前記第一選択信号のハイレベルの持続時間と前記第二選択信号のハイレベルの持続時間が同一であり、前記第一選択信号のローレベルの持続時間と前記第二選択信号のローレベルの持続時間が同一であり、；
前記第一選択信号のハイレベルの持続時間と前記第二選択信号のハイレベル持続時間ともに2K個のクロックユニット周期であり、前記第一選択信号のローレベルの持続時間と前記第二選択信号のローレベル持続時間ともに4K個のクロックユニット周期であり、前記Kは正整数であり、
前記画素配列の走査信号のハイレベルの上がりエッジの開始時間は、前記第一選択信号のハイレベルの持続時間内、または、前記第二選択信号のハイレベルの持続時間内に位置する。

前記表示パネルにおいて、
前記走査信号のハイレベルの持続時間が、3K個のクロックユニット周期であり、前記走査信号のローレベルの持続時間も、3K個のクロックユニット周期である。

従来技術に比較すると、本発明は、前記駆動回路の選択信号のレベル変換頻度を有効に減少することができる。
本発明の内容を理解しやすくするために、以下に好ましい実施例を挙げながら、図面を参照して説明する。

本発明の表示パネルのブロック図である。 図1に示す表示パネルの第一実施例の回路図である。 図2に示す表示パネルの駆動信号の波形図である。

以下、図面を参照しながら本発明の実施可能な特定実施例について説明する。本発明において方向を表す用語、例えば、「上」、「下」、「前」、「後」、「左」、「右」、「頂」、「底」、「水平」、「垂直」等は、図面における方向を示すだけである。よって、使用する方向用語は、本発明を説明及び理解するためのものであり、本発明を限定するものではない。

図1に示すように、図1は、本発明の表示パネルのブロック図である。
本発明の表示パネルは、例えばTFT-LCD（Thin Film Transistor Liquid Crystal Display、薄膜トランジスタ液晶表示パネル）、OLED（Organic Light Emitting Diode、有機LED表示パネル）等である。

本発明の表示パネルは、画素配列10及び駆動回路20を含む。
前記駆動回路20は、前記表示パネル中の前記画素配列10と電気的に接続され、前記駆動回路20は、前記画素配列10を制御して画像を表示し、前記駆動回路20は、データ信号提供モジュール201と、第一選択信号生成モジュール202と、第二選択信号生成モジュール203及び選択モジュール204を含む。

前記データ信号提供モジュール201は、生成データ信号を生成し、前記データ信号は、前記画素配列10に提供される。前記第一選択信号生成モジュール202は、第一選択信号MUX1を提供する。前記第二選択信号生成モジュール203は、第二選択信号MUX2を提供する。前記選択モジュール204は、少なくとも二つの選択スイッチの組み合わせを含み、前記選択スイッチの組み合わせは、前記第一選択信号生成モジュール202と、前記第二選択信号生成モジュール203と、前記データ信号提供モジュール201及び前記画素配列10と、電気的に接続され、前記選択スイッチの組み合わせは、前記第一選択信号MUX1、前記第二選択信号MUX2及び前記データ信号を受信し、且つ前記第一選択信号MUX1及び前記第二選択信号MUX2により、前記データ信号を前記画素配列10に出力する。

前記駆動回路20は、さらに走査信号提供モジュールを含み、前記走査信号提供モジュールは、前記画素配列10と電気的に接続され、前記走査信号提供モジュールは、走査信号（ゲート信号）を生成し、且つ、前記走査信号を前記画素配列10に送信する。

図2に示すように、図2は、図1に示す表示パネルの第一実施例の回路図である。
本実施例において、前記画素配列10は、少なくとも一つの第一画素行101及び少なくとも一つの第二画素行102を含み、前記第一画素行101及び前記第二画素行102は、第一方向30に沿って配列（一次元配列）の形式に配列する。前記第一画素行101は、少なくとも一つの第一画素R1と、少なくとも一つの第二画素G1及び少なくとも一つの第三画素B1を含み、前記第一画素R1と、前記第二画素G1及び前記第三画素B1は、第二方向40に沿って配列（一次元配列）の形式に配列する。前記第二画素行102は、少なくとも一つの第四画素R2、少なくとも一つの第五画素G2及び少なくとも一つの第六画素B2を含み、前記第四画素R2と、前記第五画素G2及び前記第六画素B2は、前記第二方向40に沿って配列（一次元配列）の形式に配列する。前記画素配列10は、さらに、少なくとも一つの第一画素列103と、少なくとも一つの第二画素列104及び少なくとも一つの第三画素列105を含み、前記第一画素列103は、前記第一画素R1及び前記第四画素R2を含み、前記第二画素列104は、前記第二画素G1及び前記第五画素G2を含み、前記第三画素列105は、前記第三画素B1及び前記第六画素B2を含む。前記第一方向30は、前記第二方向40に垂直になる。

本実施例において、前記選択スイッチの組み合わせは、第一スイッチ2041と、第二スイッチ2042と、第三スイッチ2043及び第四スイッチ2044を含む。前記第一スイッチ2041は、前記第一選択信号生成モジュール202と、前記データ信号提供モジュール201及び前記画素配列10中の第一画素列103と、電気的に接続される。前記第二スイッチ2042は、前記第二選択信号生成モジュール203と、前記データ信号提供モジュール201及び前記画素配列10中の第二画素列104と、電気的に接続される。前記第三スイッチ2043は、前記第一選択信号生成モジュール202と、前記データ信号提供モジュール201及び前記第四スイッチ2044と、電気的に接続される。前記第四スイッチ2044は、前記第二選択信号生成モジュール203と、前記第三スイッチ2043及び前記画素配列10中の第三画素列105と、電気的に接続される。

本実施例において、前記第一スイッチ2041と、前記第二スイッチ2042と、前記第三スイッチ2043及び前記第四スイッチ2044ともに三極管であってもよい。前記第一スイッチ2041は、第一制御端20411と、第一入力端20412及び第一出力端20413を含む。前記第一制御端20411は、前記第一選択信号生成モジュール202と電気的に接続され、具体的に、前記第一制御端20411は、第一信号線2021を介して前記第一選択信号生成モジュール202と電気的に接続される。前記第一入力端20412は、前記データ信号提供モジュール201と電気的に接続される。前記第一出力端20413は、前記第一画素列103と電気的に接続される。なお、前記第一制御端20411は、前記第一選択信号MUX1を受信し、且つ前記第一選択信号MUX1により、前記第一入力端20412と前記第一出力端20413との間の第一電流通路のオン及びオフを制御する。

前記第二スイッチ2042は、第二制御端20421と、第二入力端20422及び第二出力端20423を含む。前記第二制御端20421は、前記第二選択信号生成モジュール203と電気的に接続され、具体的に、前記第二制御端20421は、第二信号線2031を介して前記第二選択信号生成モジュール203と電気的に接続される。前記第二入力端20422は、前記データ信号提供モジュール201と電気的に接続される。前記第二出力端20423は、前記第二画素列104と電気的に接続される。なお、前記第二制御端20421は、前記第二選択信号MUX2を受信し、且つ、前記第二選択信号MUX2により、前記第二入力端20422と前記第二出力端20423との間の第二電流通路のオン及びオフを制御する。

前記第三スイッチ2043は、第三制御端20431と、第三入力端20432及び第三出力端20433を含む。前記第三制御端20431は、前記第一選択信号生成モジュール202と電気的に接続され、具体的には、前記第三制御端20431は、前記第一信号線2021を介して前記第一選択信号生成モジュール202と電気的に接続される。前記第三入力端20432与前記データ信号提供モジュール201電気的に接続される。前記第三出力端20433は、前記第四スイッチ2044と電気的に接続される。なお、前記第三制御端20431は、前記第一選択信号MUX1を受信し、且つ、前記第一選択信号MUX1により、前記第三入力端20432と前記第三出力端20433との間の第三電流通路のオン及びオフを制御する。

前記第四スイッチ2044は、第四制御端20441と、第四入力端20442及び第四出力端20443を含む。前記第四制御端20441は、前記第二選択信号生成モジュール203と電気的に接続され、具体的には、前記第四制御端20441は、前記第二信号線2031を介して前記第二選択信号生成モジュール203と電気的に接続される。前記第四入力端20442は、前記第三出力端20433と電気的に接続される。前記第四出力端20443は、前記第三画素列105と電気的に接続される。なお、前記第四制御端20441は、前記第二選択信号MUX2を受信し、且つ、前記第二選択信号MUX2により前記第四入力端20442と前記第四出力端20443との間の第四電流通路のオン及びオフを制御する。

本実施例において、前記第一スイッチ2041と前記第二スイッチ2042とともにNMOS（Negative channel Metal Oxide Semiconductor、Ｎチャンネル金属酸化物半導体）トランジスタ、前記第三スイッチ2043と前記第四スイッチ2044とともにPMOS（Positive channel Metal Oxide Semiconductor、Pチャンネル金属酸化物半導体）トランジスタである。

前記第一電流通路は、前記第三電流通路がオンする時にオフし、且つ、前記第三電流通路がオフする時にオンする。
前記第二電流通路は、前記第四電流通路がオンする時にオフし、且つ、前記第四電流通路がオフする時にオンする。
前記第三電流通路は、前記第一電流通路がオンする時にオフし、且つ、前記第一電流通路がオフする時にオンする。
前記第四電流通路は、前記第二電流通路がオンする時にオフし、且つ、前記第二電流通路がオフする時にオンする。
本実施例において、前記第一選択信号MUX1のハイレベルの持続時間と前記第二選択信号MUX2のハイレベルの持続時間が同一であり、前記第一選択信号MUX1のローレベルの持続時間と前記第二選択信号MUX2のローレベルの持続時間が同一である。

前記第一選択信号MUX1のハイレベルの持続時間と前記第二選択信号MUX2のハイレベルの持続時間とともに2K個のクロックユニット周期であり、前記第一選択信号MUX1のローレベルの持続時間と前記第二選択信号MUX2のローレベルの持続時間とともに4K個のクロックユニット周期であり、前記走査信号（前記第一画素行101が対応する第一走査信号Gate1、前記第二画素行102が対応する第二走査信号Gate2を含む）のハイレベルの持続時間が3K個のクロックユニット周期であり、前記走査信号のローレベルの持続時間も3K個のクロックユニット周期である。なお、前記Kは正の整数である。例えば、前記K=1である。

前記画素配列10の走査信号のハイレベルの上がりエッジの開始時間は、前記第一選択信号MUX1のハイレベルの持続時間内、または、前記第二選択信号MUX2のハイレベルの持続時間内に位置する。

図3に示すように、図3は、図2に示す表示パネルの駆動信号の波形図である。

以下、前記第一画素行101が対応する第一走査信号Gate1と、前記第二画素行102が対応する第二走査信号Gate2がハイレベル時に、前記画素配列10中の画素のスイッチをオンし、ローレベル時に前記画素のスイッチをオフする例を一例として説明する。逆も同様である。

一個目のクロックユニット周期301において、
前記走査信号提供モジュールが生成した前記第一走査信号Gate1はハイレベルであり、前記第二走査信号Gate2はローレベルである。この際、前記第一画素R1と、前記第二画素G1及び前記第三画素B1のスイッチともにオンし、前記第四画素R2と、前記第五画素G2及び前記第六画素B2のスイッチともにオフする。

前記第一選択信号MUX1がハイレベルであり、前記第二選択信号MUX2がローレベルである。この際、前記第一スイッチ2041の前記第一電流通路がオンし、前記第二スイッチ2042の前記第二電流通路がオフし、前記第三スイッチ2043の前記第三電流通路がオフし、前記第四スイッチ2044の前記第四電流通路がオンする。前記データ信号は、前記第一電流通路を介して前記第一画素列103の前記第一画素R1中に入力され、前記第一画素R1に対し電圧を印加する。

二個目のクロックユニット周期302において、
前記第一走査信号Gate1は依然としてハイレベルであり、前記第二走査信号Gate2は依然としてローレベルである。この際、前記第一画素R1と、前記第二画素G1及び前記第三画素B1のスイッチともにオンし、前記第四画素R2と、前記第五画素G2及び前記第六画素B2のスイッチともにオフする。

前記第一選択信号MUX1がローレベルであり、前記第二選択信号MUX2がローレベルである。この際、前記第一電流通路がオフし、前記第二電流通路がオフし、前記第三電流通路がオンし、前記第四電流通路がオンする。前記データ信号は、前記第三電流通路及び前記第四電流通路を介して前記第三画素列105の前記第三画素B1中に入力され、前記第三画素B1に対し電圧を印加する。

三個目クのロックユニット周期303において、
前記第一走査信号Gate1は依然としてハイレベルであり、前記第二走査信号Gate2は依然としてローレベルである。この際、前記第一画素R1と、前記第二画素G1及び前記第三画素B1のスイッチともにオンし、前記第四画素R2と、前記第五画素G2及び前記第六画素B2のスイッチともにオフする。
前記第一選択信号MUX1がローレベルであり、前記第二選択信号MUX2がハイレベルである。この際、前記第一電流通路がオフし、前記第二電流通路がオンし、前記第三電流通路がオンし、前記第四電流通路がオフする。前記データ信号は、前記第二電流通路を介して前記第二画素列104の前記第二画素G1中に入力され、前記第二画素G1に対し電圧を印加する。

四個目のクロックユニット周期304において、
前記第一走査信号Gate1がローレベルであり、前記第二走査信号Gate2がハイレベルである。この際、前記第一画素R1と、前記第二画素G1及び前記第三画素B1のスイッチともにオフし、前記第四画素R2と、前記第五画素G2及び前記第六画素B2のスイッチともにオンする。

前記第一選択信号MUX1はローレベルに保持し、前記第二選択信号MUX2はハイレベルに保持する。この際、前記第一電流通路がオフし、前記第二電流通路がオンし、前記第三電流通路がオンし、前記第四電流通路がオフする。前記データ信号は、前記第二電流通路を介して前記第二画素列104の前記第五画素G2中に入力され、前記第五画素G2に対し電圧を印加する。

五個目のクロックユニット周期305において、
前記第一走査信号Gate1は依然としてローレベルであり、前記第二走査信号Gate2は依然としてハイレベルである。この際、前記第一画素R1と、前記第二画素G1及び前記第三画素B1のスイッチともにオフし、前記第四画素R2と、前記第五画素G2及び前記第六画素B2のスイッチともにオンする。

前記第一選択信号MUX1はローレベルに保持し、前記第二選択信号MUX2はローレベルである。この際、前記第一電流通路がオフし、前記第二電流通路がオフし、前記第三電流通路がオンし、前記第四電流通路がオンする。前記データ信号は、前記第三電流通路及び前記第四電流通路を介して前記第三画素列105の前記第六画素B2中に入力され、前記第六画素B2に対し電圧を印加する。

六個目のクロックユニット周期306において、
前記第一走査信号Gate1は依然としてローレベルであり、前記第二走査信号Gate2は依然としてハイレベルである。この際、前記第一画素R1と、前記第二画素G1及び前記第三画素B1のスイッチともにオフし、前記第四画素R2と、前記第五画素G2及び前記第六画素B2のスイッチともにオンする。

前記第一選択信号MUX1がハイレベルであり、前記第二選択信号MUX2は依然としてローレベルである。この際、前記第一電流通路がオンし、前記第二電流通路がオフし、前記第三電流通路がオフし、前記第四電流通路がオンする。前記データ信号は、前記第一電流通路を介して前記第一画素列103の前記第四画素R2中に入力され、前記第四画素R2に対し電圧を印加する。

このように、全体画面の更新を完成するまで、以下これによって類推する。
前述した技術手段により、前記選択信号のレベル変換頻度を有効に減少させることができ、即ち、前記選択信号のレベル変換頻度をN次/フレームから（N/2）次/フレームに減少させる。ここで、前記Nは、前記画素配列の画素行の数である。

また、前述した技術手段により、前記表示パネルの配線の数を減少させることで、前記表示パネルの解像度の向上が前記配線数の制限を受けない。

本発明の表示パネルの第二実施例は、上記の第一実施例に相似するが、以下の点で相違する。

前記第一スイッチ2041と前記第二スイッチ2042とともにPMOS（Positive channel Metal Oxide Semiconductor、Pチャンネル金属酸化物半導体）トランジスタであり、前記第三スイッチ2043と前記第四スイッチ2044とともにNMOS（Negative channel Metal Oxide Semiconductor、Ｎチャンネル金属酸化物半導体）トランジスタである。

一または多数の実施形態を例示して本発明を説明したが、当業者であれば、本発明の明細書及び図面に基づいて、変更や改良を想到するが、本発明は、このような変更や改良を含むものであり、且つ、特許請求の範囲に制限される。特に、上記の部材より執行する各機能に関して、これら部材を説明するための用語は、当該部材の機能（例えば、機能が相等するなど）執行するための任意部材（特別な指定する場合を除く）を説明するためであり、構造的に、本明細書において例示した実施形態の機能の構造と異なる場合も含む。さらに、本願明細書の特定特徴において、幾つかの実施形態の一例のみ開示したが、このような特徴は、他の実施形態と組み合わせることができる。さらに、「含む」、「有する」、「含有」または、発明を実施するための形態あるいは特許請求の範囲において使用される他の用語は、「包含」と同一または類似する意味である。

上記により、本発明は好ましい実施例により開示されたが、上記の好ましい実施例は本発明を限定するものでなく、本発明の趣旨及び範囲を脱出しない限り、当業者であれば、様々な変更及び修飾を加えることができるため、本発明の保護範囲は、特許請求の範囲に基づくものである。

Claims (10)

1. 駆動回路であって、前記駆動回路は、相応する表示パネルの画素配列を制御して画像を表示し、
   前記駆動回路は、
   前記画素配列に提供されるデータ信号を生成する、データ信号提供モジュールと、
   第一選択信号を提供する、第一選択信号生成モジュールと、
   第二選択信号を提供する、第二選択信号生成モジュール、及び、
   選択モジュールを含み、
   前記選択モジュールは、少なくとも二つの選択スイッチの組み合わせを含み、
   前記選択スイッチの組み合わせは、前記第一選択信号生成モジュールと、前記第二選択信号生成モジュールと、前記データ信号提供モジュール及び前記画素配列と、電気的に接続され、前記選択スイッチの組み合わせは、前記第一選択信号と、前記第二選択信号及び前記データ信号を受信し、前記第一選択信号及び前記第二選択信号により前記データ信号を前記画素配列に出力し、
   前記選択スイッチの組み合わせは、第一スイッチと、第二スイッチと、第三スイッチと、第四スイッチと、を含み、
   前記第一スイッチは、前記第一選択信号生成モジュールと、前記データ信号提供モジュールと、前記画素配列中の第一画素列と、電気的に接続され、且つ前記第一スイッチは、前記第一画素列と前記データ信号提供モジュールとの間に配置され、前記第一画素列と前記データ信号提供モジュールと直接に電気的に接続され、
   前記第二スイッチは、前記第二選択信号生成モジュールと、前記データ信号提供モジュールと、前記画素配列中の第二画素列と、電気的に接続され、且つ前記第二スイッチは、前記第二画素列と前記データ信号提供モジュールとの間に配置され、前記第二画素列と前記データ信号提供モジュールと直接に電気的に接続され、
   前記第三スイッチは、前記第一選択信号生成モジュールと、前記データ信号提供モジュールと、電気的に接続され、
   前記第四スイッチは、前記第二選択信号生成モジュールと、前記第三スイッチと、前記画素配列中の第三画素列と、電気的に接続され、
   前記駆動回路は、さらに走査信号提供モジュールを含み、
   前記走査信号提供モジュールは、前記画素配列と電気的に接続され、
   前記走査信号提供モジュールは、走査信号を生成し、前記走査信号を前記画素配列に送信し、
   前記第一選択信号生成モジュールが、データ信号を前記画素配列中の第一画素列に入力するように制御し、前記第二選択信号生成モジュールが、データ信号を前記画素配列中の第二画素列に入力するように制御し、前記第一選択信号生成モジュールと前記第二選択信号生成モジュールとが、データ信号を前記画素配列中の第三画素列に入力するように制御し、
   前記第一選択信号がハイレベルである時に、前記第一スイッチがオンであり、前記第三スイッチがオフであり、前記第一選択信号がローレベルである時に、前記第一スイッチがオフであり、前記第三スイッチがオンであり、前記第二選択信号がハイレベルである時に、前記第二スイッチがオンであり、前記第四スイッチがオフであり、前記第二選択信号がローレベルである時に、前記第二スイッチがオフであり、前記第四スイッチがオンであり、前記第一スイッチと前記第二スイッチとがＮチャンネル金属酸化物半導体であり、前記第三スイッチと前記第四スイッチとがＰチャンネル金属酸化物半導体である、
   ことを特徴とする駆動回路。
2. 前記第一スイッチは、第一制御端と、第一入力端と、第一出力端とを含み、
   前記第一制御端と前記第一選択信号生成モジュールとは、電気的に接続され、
   前記第一入力端と前記データ信号提供モジュールとは、電気的に接続され、
   前記第一出力端と前記第一画素列とは、電気的に接続され、
   前記第一制御端は、前記第一選択信号を受信し、前記第一選択信号により、前記第一入力端と前記第一出力端との間の第一電流通路のオン及びオフを制御し、
   前記第二スイッチは、第二制御端と、第二入力端と、第二出力端とを含み、
   前記第二制御端と前記第二選択信号生成モジュールとは、電気的に接続され、
   前記第二入力端と前記データ信号提供モジュールとは、電気的に接続され、
   前記第二出力端と前記第二画素列とは、電気的に接続され、
   前記第二制御端は、前記第二選択信号を受信し、前記第二選択信号により、前記第二入力端と前記第二出力端との間の第二電流通路のオン及びオフを制御し、
   前記第三スイッチは、第三制御端と、第三入力端と、第三出力端とを含み、
   前記第三制御端と前記第一選択信号生成モジュールとは、電気的に接続され、
   前記第三入力端と前記データ信号提供モジュールとは、電気的に接続され、
   前記第三出力端と前記第四スイッチとは、電気的に接続され、
   前記第三制御端は、前記第一選択信号を受信し、前記第一選択信号により、前記第三入力端と前記第三出力端との間の第三電流通路のオン及びオフを制御し、
   前記第四スイッチは、第四制御端と、第四入力端と、第四出力端とを含み、
   前記第四制御端と前記第二選択信号生成モジュールとは、電気的に接続され、
   前記第四入力端と前記第三出力端とは、電気的に接続され、
   前記第四出力端と前記第三画素列とは、電気的に接続され、
   前記第四制御端は、前記第二選択信号を受信し、前記第二選択信号により、前記第四入力端と前記第四出力端との間の第四電流通路のオン及びオフを制御する、ことを特徴とする請求項１に記載の駆動回路。
3. 駆動回路であって、前記駆動回路は、相応する表示パネル中の画素配列を制御して画像を表示し、
   前記駆動回路は、
   前記画素配列に提供するデータ信号を生成するデータ信号提供モジュールと、
   第一選択信号を提供する第一選択信号生成モジュールと、
   第二選択信号を提供する第二選択信号生成モジュール、及び、
   選択モジュール、を含み、
   前記選択モジュールは、少なくとも二つの選択スイッチの組み合わせを含み、
   前記選択スイッチの組み合わせは、前記第一選択信号生成モジュールと、前記第二選択信号生成モジュールと、前記データ信号提供モジュールと、前記画素配列と、電気的に接続され、前記選択スイッチの組み合わせは、前記第一選択信号と、前記第二選択信号及び前記データ信号を受信し、前記第一選択信号及び前記第二選択信号により、前記データ信号を前記画素配列に出力し、
   前記選択スイッチの組み合わせは、第一スイッチと、第二スイッチと、第三スイッチと、第四スイッチと、を含み、
   前記第一スイッチは、前記第一選択信号生成モジュールと、前記データ信号提供モジュールと、前記画素配列中の第一画素列と、電気的に接続され、且つ前記第一スイッチは、前記第一画素列と前記データ信号提供モジュールとの間に配置され、前記第一画素列と前記データ信号提供モジュールと直接に電気的に接続され、
   前記第二スイッチは、前記第二選択信号生成モジュールと、前記データ信号提供モジュールと、前記画素配列中の第二画素列と、電気的に接続され、且つ前記第二スイッチは、前記第二画素列と前記データ信号提供モジュールとの間に配置され、前記第二画素列と前記データ信号提供モジュールと直接に電気的に接続され、
   前記第三スイッチは、前記第一選択信号生成モジュールと、前記データ信号提供モジュールと、電気的に接続され、
   前記第四スイッチは、前記第二選択信号生成モジュールと、前記第三スイッチと、前記画素配列中の第三画素列と、電気的に接続され、
   前記第一選択信号生成モジュールが、データ信号を前記画素配列中の第一画素列に入力するように制御し、前記第二選択信号生成モジュールが、データ信号を前記画素配列中の第二画素列に入力するように制御し、前記第一選択信号生成モジュールと前記第二選択信号生成モジュールとが、データ信号を前記画素配列中の第三画素列に入力するように制御し、
   前記第一選択信号がハイレベルである時に、前記第一スイッチがオンであり、前記第三スイッチがオフであり、前記第一選択信号がローレベルである時に、前記第一スイッチがオフであり、前記第三スイッチがオンであり、前記第二選択信号がハイレベルである時に、前記第二スイッチがオンであり、前記第四スイッチがオフであり、前記第二選択信号がローレベルである時に、前記第二スイッチがオフであり、前記第四スイッチがオンであり、前記第一スイッチと前記第二スイッチとがＮチャンネル金属酸化物半導体であり、前記第三スイッチと前記第四スイッチとがＰチャンネル金属酸化物半導体である、
   ことを特徴とする駆動回路。
4. 前記選択スイッチの組み合わせは、第一スイッチと、第二スイッチと、第三スイッチと、第四スイッチと、を含み、
   前記第一スイッチは、前記第一選択信号生成モジュールと、前記データ信号提供モジュール及び前記画素配列中の第一画素列と、電気的に接続され、
   前記第二スイッチは、前記第二選択信号生成モジュールと、前記データ信号提供モジュール及び前記画素配列中の第二画素列と、電気的に接続され、
   前記第三スイッチは、前記第一選択信号生成モジュール及び前記データ信号提供モジュールと、電気的に接続され、
   前記第四スイッチは、前記第二選択信号生成モジュールと、前記第三スイッチ及び前記画素配列中の第三画素列と、電気的に接続される、ことを特徴とする請求項３に記載の駆動回路。
5. 前記第一スイッチは、第一制御端と、第一入力端と、第一出力端と、を含み、
   前記第一制御端と前記第一選択信号生成モジュールとは、電気的に接続され、
   前記第一入力端と前記データ信号提供モジュールとは、電気的に接続され、
   前記第一出力端と前記第一画素列とは、電気的に接続され、
   前記第一制御端は、前記第一選択信号を受信し、前記第一選択信号により、前記第一入力端と前記第一出力端との間の第一電流通路のオン及びオフを制御し、
   前記第二スイッチは、第二制御端と、第二入力端と、第二出力端と、を含み、
   前記第二制御端と前記第二選択信号生成モジュールとは、電気的に接続され、
   前記第二入力端と前記データ信号提供モジュールとは、電気的に接続され、
   前記第二出力端と前記第二画素列とは、電気的に接続され、
   前記第二制御端は、前記第二選択信号を受信し、前記第二選択信号により、前記第二入力端と前記第二出力端との間の第二電流通路のオン及びオフ制御し、
   前記第三スイッチは、第三制御端と、第三入力端と、第三出力端と、を含み、
   前記第三制御端と前記第一選択信号生成モジュールとは、電気的に接続され、
   前記第三入力端と前記データ信号提供モジュールとは、電気的に接続され、
   前記第三出力端と前記第四スイッチとは、電気的に接続され、
   前記第三制御端は、前記第一選択信号を受信し、前記第一選択信号により、前記第三入力端と前記第三出力端との間の第三電流通路のオン及びオフを制御し、
   前記第四スイッチは、第四制御端と、第四入力端と、第四出力端と、を含み、
   前記第四制御端と前記第二選択信号生成モジュールとは、電気的に接続され、
   前記第四入力端と前記第三出力端とは、電気的に接続され、
   前記第四出力端と前記第三画素列とは、電気的に接続され、
   前記第四制御端は、前記第二選択信号を受信し、前記第二選択信号により、前記第四入力端と前記第四出力端との間の第四電流通路のオン及びオフを制御する、
   ことを特徴とする請求項４に記載の駆動回路。
6. 前記第一制御端は、第一信号線を介して前記第一選択信号生成モジュールと電気的に接続され、
   前記第二制御端は、第二信号線を介して前記第二選択信号生成モジュールと電気的に接続され、
   前記第三制御端は、前記第一信号線を介して前記第一選択信号生成モジュールと電気的に接続され、
   前記第四制御端は、前記第二信号線を介して前記第二選択信号生成モジュールと電気的に接続される、ことを特徴とする請求項５に記載の駆動回路。
7. 表示パネルであって、
   前記表示パネルは、
   画素配列、及び、前記画素配列を制御して画像を表示する駆動回路を含み、
   前記駆動回路は、
   前記画素配列に提供するデータ信号を生成するデータ信号提供モジュールと、
   第一選択信号を提供する第一選択信号生成モジュールと、
   第二選択信号を提供する第二選択信号生成モジュールと、
   選択モジュールと、を含み、
   前記選択モジュールは、少なくとも二つの選択スイッチの組み合わせを含み、
   前記選択スイッチの組み合わせは、前記第一選択信号生成モジュールと、前記第二選択信号生成モジュールと、前記データ信号提供モジュール及び前記画素配列と、電気的に接続され、
   前記選択スイッチの組み合わせは、前記第一選択信号と、前記第二選択信号と、前記データ信号と、を受信し、前記第一選択信号及び前記第二選択信号により、前記データ信号を前記画素配列に出力し、
   前記選択スイッチの組み合わせは、第一スイッチと、第二スイッチと、第三スイッチと、第四スイッチと、を含み、
   前記第一スイッチは、前記第一選択信号生成モジュールと、前記データ信号提供モジュールと、前記画素配列中の第一画素列と、電気的に接続され、且つ前記第一スイッチは、前記第一画素列と前記データ信号提供モジュールとの間に配置され、前記第一画素列と前記データ信号提供モジュールと直接に電気的に接続され、
   前記第二スイッチは、前記第二選択信号生成モジュールと、前記データ信号提供モジュールと、前記画素配列中の第二画素列と、電気的に接続され、且つ前記第二スイッチは、前記第二画素列と前記データ信号提供モジュールとの間に配置され、前記第二画素列と前記データ信号提供モジュールと直接に電気的に接続され、
   前記第三スイッチは、前記第一選択信号生成モジュールと、前記データ信号提供モジュールと、電気的に接続され、
   前記第四スイッチは、前記第二選択信号生成モジュールと、前記第三スイッチと、前記画素配列中の第三画素列と、電気的に接続され、
   前記第一選択信号生成モジュールが、データ信号を前記画素配列中の第一画素列に入力するように制御し、前記第二選択信号生成モジュールが、データ信号を前記画素配列中の第二画素列に入力するように制御し、前記第一選択信号生成モジュールと前記第二選択信号生成モジュールとが、データ信号を前記画素配列中の第三画素列に入力するように制御し、
   前記第一選択信号がハイレベルである時に、前記第一スイッチがオンであり、前記第三スイッチがオフであり、前記第一選択信号がローレベルである時に、前記第一スイッチがオフであり、前記第三スイッチがオンであり、前記第二選択信号がハイレベルである時に、前記第二スイッチがオンであり、前記第四スイッチがオフであり、前記第二選択信号がローレベルである時に、前記第二スイッチがオフであり、前記第四スイッチがオンであり、前記第一スイッチと前記第二スイッチとがＮチャンネル金属酸化物半導体であり、前記第三スイッチと前記第四スイッチとがＰチャンネル金属酸化物半導体である、
   ことを特徴とする表示パネル。
8. 前記選択スイッチの組み合わせは、第一スイッチと、第二スイッチと、第三スイッチと、第四スイッチと、を含み、
   前記第一スイッチは、前記第一選択信号生成モジュールと、前記データ信号提供モジュール及び前記画素配列中の第一画素列と、電気的に接続され、
   前記第二スイッチは、前記第二選択信号生成モジュールと、前記データ信号提供モジュール及び前記画素配列中の第二画素列と、電気的に接続され、
   前記第三スイッチは、前記第一選択信号生成モジュール及び前記データ信号提供モジュールと、電気的に接続され、
   前記第四スイッチは、前記第二選択信号生成モジュールと、前記第三スイッチ及び前記画素配列中の第三画素配列と、電気的に接続される、ことを特徴とする請求項７に記載の表示パネル。
9. 前記第一スイッチは、第一制御端と、第一入力端と、第一出力端と、を含み、
   前記第一制御端は、前記第一選択信号生成モジュールと電気的に接続され、
   前記第一入力端は、前記データ信号提供モジュールと電気的に接続され、
   前記第一出力端は、前記第一画素列と電気的に接続され、
   前記第一制御端は、前記第一選択信号を受信し、且つ、前記第一選択信号により、前記第一入力端と前記第一出力端との間の第一電流通路のオン及びオフを制御し、
   前記第二スイッチは、第二制御端と、第二入力端と、第二出力端と、を含み、
   前記第二制御端は、前記第二選択信号生成モジュールと電気的に接続され、
   前記第二入力端は、前記データ信号提供モジュールと電気的に接続され、
   前記第二出力端は、前記第二画素列と電気的に接続され、
   前記第二制御端は、前記第二選択信号受信し、且つ前記第二選択信号により、前記第二入力端と前記第二出力端との間の第二電流通路のオン及びオフを制御し、
   前記第三スイッチは、第三制御端と、第三入力端と、第三出力端と、を含み、
   前記第三制御端は、前記第一選択信号生成モジュールと電気的に接続され、
   前記第三入力端は、前記データ信号提供モジュールと電気的に接続され、
   前記第三出力端は、前記第四スイッチと電気的に接続され、
   前記第三制御端は、前記第一選択信号を受信し、且つ、前記第一選択信号により、前記第三入力端と前記第三出力端との間の第三電流通路のオン及びオフを制御し、
   前記第四スイッチは、第四制御端と、第四入力端と、第四出力端と、を含み、
   前記第四制御端は、前記第二選択信号生成モジュールと電気的に接続され、
   前記第四入力端は、前記第三出力端と電気的に接続され、
   前記第四出力端は、前記第三画素列と電気的に接続され、
   前記第四制御端は、前記第二選択信号を受信し、且つ、前記第二選択信号により、前記第四入力端と前記第四出力端との間の第四電流通路のオン及びオフを制御する、ことを特徴とする請求項８に記載の表示パネル。
10. 前記第一制御端は、第一信号線を介して前記第一選択信号生成モジュールと電気的に接続され、
    前記第二制御端は、第二信号線を介して前記第二選択信号生成モジュールと電気的に接続され、
    前記第三制御端は、前記第一信号線を介して前記第一選択信号生成モジュールと電気的に接続され、
    前記第四制御端は、前記第二信号線を介して前記第二選択信号生成モジュールと電気的に接続される、ことを特徴とする請求項９に記載の表示パネル。