JP6526360B2 - 高周波分波器及びこれを用いた高周波回路 - Google Patents
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Description
実施の形態1.
図1は、本実施の形態による高周波分波器の構成図である。
本実施の形態による高周波分波器は、図1に示すように、入力端子100と、入力端子100から入力された高周波電力を等分配し、位相差を与える移相回路3と、第1から第4の端子21、22、23、24を備えた90°ハイブリッド回路2を備える。移相回路3は、入力端子100に入力された高周波を同相分配器31にて等分配して、一方の出力を90°ハイブリッド回路2の第1の端子21に与え、他方の出力を基本波で1/4波長となる伝送線路32を介して90°ハイブリッド回路2の第2の端子22に与える。ここで、90°ハイブリッド回路2の第1の端子21を入力(IN)端子としたとき、第2の端子22はアイソレーション(ISO)端子、第3の端子23は0°出力端子、第4の端子24は−90°出力端子となる関係にある。90°ハイブリッド回路2としては、例えば、ランゲカプラなどで構成する。
入力端子100から入力された第1の周波数である基本波と第2の周波数である3倍波は移相回路3において同相分配器31によりそれぞれ等振幅で2分配される。同相分配器31の一方の出力は90°ハイブリッド回路2の第1の端子21に入力され、同相分配器31の他方の出力は基本波で1/4波長となる伝送線路32を介して90°ハイブリッド回路2の第2の端子22に入力される。このとき、90°ハイブリッド回路2の第2の端子22に入力される基本波は第1の端子21に入力される基本波よりも90°位相が遅れており、第2の端子22に入力される3倍波は第1の端子21に入力される3倍波よりも90°位相が進んでいる。
従って、入力端子100に入力された基本波と3倍波は分波され、それぞれ第4の端子24と第3の端子23から出力される。
図6は、実施の形態2の高周波回路として、実施の形態1の高周波分波器を用いた高周波増幅器を示す構成図である。
図6において、高周波分波器1aは実施の形態1の図4に示す高周波分波器であり、対応する部分に同一符号を付してその説明を省略する。高周波分波器1aにおける入力端子100には増幅器5の出力が与えられるよう構成され、高周波分波器1aにおける90°ハイブリッド回路2の第3の端子23には3倍波で1/4波長のオープンスタブ43を備えている。
高周波分波器1aの動作は実施の形態1と同様である。ただし、図6に示す高周波分波器1aにおいては、基本波及び3倍波と独立にショートスタブ41で2倍波を短絡して反射させ、基本波及び2倍波と独立にオープンスタブ43により3倍波を反射させて、入力端子100に戻すことができる。このため、増幅器5からショートスタブ41までの電気長で2倍波の位相を、増幅器5からオープンスタブ43までの電気長で3倍波の位相を独立に設計することができる。
図7は、実施の形態3の高周波回路として、実施の形態1の高周波分波器を用いた高周波発振器を示す構成図である。
図7において、高周波分波器1は図1に示す高周波分波器であり、対応する部分に同一符号を付してその説明を省略する。高周波分波器1における入力端子100にはトランジスタ60のドレイン端子が接続され、高周波分波器1における第4の端子24は開放となっている。トランジスタ60はそのソース端子とゲート端子にそれぞれ帰還回路61と帰還回路62を備えている。
高周波分波器1の動作は実施の形態1の図1に示した構成の動作と同様である。ただし、図7に示す高周波分波器1は、発振器の帰還回路の一つとして動作しており、90°ハイブリッド回路2の第4の端子24で反射した基本波は入力端子100に戻り、トランジスタ60に入力される。実施の形態3の高周波発振器では、基本波を直列帰還している。トランジスタ60のゲート端子に入力される高周波(最初は雑音)はトランジスタ60で増幅されてドレイン端子に出力され、ドレイン端子側回路(ここでは高周波分波器1)で反射された当該高周波はトランジスタ60のドレイン・ソース間を介して帰還回路61に入力されて反射する。さらにトランジスタ60のゲート・ソース間を介して帰還回路62に入力されて反射して、トランジスタ60のゲート端子に同相となるように帰還する。この高周波が発振周波数となる。
なお、ここでは高周波分波器を帰還回路の一つとしてドレイン端子に接続した例を示したが、ゲート端子またはソース端子に当該高周波分波器を備えた場合でも良い。
図8は、実施の形態4の高周波回路として、実施の形態1の高周波分波器を用いたPLLシンセサイザを示す構成図である。
図8において、高周波分波器1は図1に示す高周波分波器であり、対応する部分に同一符号を付してその説明を省略する。高周波分波器1における入力端子100には位相同期回路(PLL)の電圧制御発振器(VCO)70を接続し、90°ハイブリッド回路2の第4の端子24から出力される基本波をPLL回路部71に入力して、PLL回路部71の出力を電圧制御発振器70に与えて負帰還制御を行う構成である。ここで、PLL回路部71は、位相比較器、基準発振器、ループフィルタ及びプリスケーラ等で構成される回路であり、電圧制御発振器70とPLL回路部71で、公知の位相同期回路を構成している。
高周波分波器1の動作は実施の形態1と同様である。電圧制御発振器70は電圧を制御することで発振周波数が変化する回路であり、基本波で発振動作を行っている。電圧制御発振器70から出力された基本波は高周波分波器1を介して90°ハイブリッド回路2の第4の端子24から出力される。第4の端子24から出力された基本波はPLL回路部71において基準発振器から出力される基準周波数と位相比較され、PLL回路部71はその位相誤差に応じた電圧を電圧制御発振器70に与える。電圧制御発振器70では与えられた電圧に応じて発振周波数を補正する。この発振動作で生じる3倍波は、90°ハイブリッド回路2の第4の端子24からは出力されず、第3の端子23から出力される。
Claims (9)
- 第1から第4の端子を備え、前記第1の端子を入力端子としたとき、前記第2の端子はアイソレーション端子、前記第3の端子は0°出力端子、前記第4の端子は−90°出力端子となる関係にある90°ハイブリッド回路と、
入力される電波のうち、第1の周波数に関して、前記第1の端子に与える電波よりも90°位相を遅らせた電波を前記第2の端子に与え、第2の周波数に関して、前記第1の端子に与える電波よりも90°位相を進めた電波を前記第2の端子に与える移相回路とを備えたことを特徴とする高周波分波器。 - 前記第1の周波数は基本波、前記第2の周波数は3倍波であり、
前記移相回路は、前記基本波及び前記3倍波を、前記第1の端子と前記第2の端子とに同相かつ等振幅で分配する同相分配器と、
前記同相分配器と前記第2の端子との間に設けられ、前記同相分配器と前記第1の端子との間の電気長よりも前記基本波で1/4波長長い伝送線路とを備えたことを特徴とする請求項1記載の高周波分波器。 - 前記第4の端子に前記第1の周波数で1/4波長となるオープンスタブを備えたことを特徴とする請求項1記載の高周波分波器。
- 前記移相回路の入力端子に前記第1の周波数で1/4波長となるショートスタブを備えたことを特徴とする請求項1記載の高周波分波器。
- 前記ショートスタブの前記第1の周波数で開放となる先端に抵抗を備えたことを特徴とする請求項4記載の高周波分波器。
- 請求項4の高周波分波器を用い、前記移相回路の入力端子に増幅器を接続すると共に、前記第3の端子に前記第2の周波数で1/4波長となるオープンスタブを備えたことを特徴とする高周波回路。
- トランジスタの端子のうち少なくとも一つに、帰還回路として構成される請求項1記載の高周波分波器の入力端子が接続され、発振動作を行うことを特徴とする高周波回路。
- 前記第4の端子を開放としたことを特徴とする請求項7記載の高周波回路。
- 請求項1記載の高周波分波器を用いると共に、当該高周波分波器の前記第4の端子の出力を基準周波数の電波と位相比較する電波として入力する位相同期回路を備え、前記位相同期回路の電圧制御発振器の出力を当該高周波分波器の入力端子に接続したことを特徴とする高周波回路。
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