JP6332905B2 - プラント制御装置 - Google Patents
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Description
一方、非反転論理パルスと反転論理パルスをペアラインにて伝送し、受信部でペアラインにて送られてきた非反転論理パルスと反転論理パルスとが逆相の関係にある時はいずれか一方のパルスを出力し、同相の関係にあるときは前の論理を保持するペアラインによるパルス伝送方式が提案されている(例えば、特許文献1参照)。
二重化された伝送路により接続される演算処理装置とプロセス入出力装置とを有するプラント制御装置であって、
前記演算処理装置は、パルス列発生部と演算処理部とを有するものであって、
前記パルス列発生部は、パルス列を発生するものであり、
前記プロセス入出力装置は、パルス信号検出部と動作制御部とプロセス入出力部とを有するものであって、
前記パルス信号検出部は、第1及び第2のパルス列検出部を有し、
前記演算処理部は、前記プロセス入出力部を介してプラントのプロセスを制御するものであり、
前記パルス列発生部と前記パルス信号検出部とが前記二重化された伝送路にて接続され、
前記第1及び第2のパルス列検出部は、前記二重化された伝送路のそれぞれを介して送信される前記パルス列をそれぞれ検出し、
前記動作制御部は、前記第1及び第2のパルス列検出部の少なくとも一方において前記パルス列が検出されているときは前記プロセス入出力部の動作を許容し、前記第1及び第2のパルス列検出部のいずれにおいても前記パルス列が検出されないときは前記プロセス入出力部の動作を禁止するものである。
図1は、この発明を実施するための実施の形態1を示すものであり、図1はプラント制御装置の構成を示す構成図である。図1において、演算処理装置としてのCPU盤10は、パルス発生部11と演算処理部12とを有する。プロセス入出力装置としてのリモート盤20は、第1及び第2のパルス列検出部としてのパルス検出部21,22、OR回路23、タイマ24、信号処理部25、プロセス入出力部26を有する。なお、OR回路23、タイマ24、信号処理部25がこの発明における動作制御部である。プロセス入出力部26は、DIモジュール(Digital Input Module)27と汎用モジュール28とDOモジュール(Digital Output Module)29とを有する。パルス検出部21及びパルス検出部22の出力はOR回路23へ入力される。OR回路23の出力はタイマ24及び信号処理部25を介してプロセス入出力部26へ入力される。
図2は、この発明の実施の形態2であるプラント制御装置の構成を示す構成図である。図2において、プロセス入出力装置としてのリモート盤40は、入力側と出力側とを電気的に絶縁する信号絶縁部としてのフォトカプラ41及びフォトカプラ42を有する。その他の構成については、図1に示した実施の形態1と同様のものであるので、相当するものに同じ符号を付して説明を省略する。第1伝送ライン31及び第2伝送ライン32からのパルス列A,Bは、フォトカプラ41及びフォトカプラ42を介してそれぞれパルス検出部21及びパルス検出部22に入力される。フォトカプラ41及びフォトカプラ42により、出力信号が電気的に絶縁されるので、例えばフォトカプラ41の入力側である信号線31bの接地とフォトカプラ41の出力側であるパルス検出部21の接地とを独立して行うことができ、グランドレベルが異なる場合にも対応できる。また、リモート盤20への伝送途中に第1伝送ライン31や第2伝送ライン32が受けたノイズの影響も軽減することができる。フォトカプラ42の機能についても、フォトカプラ41と同様である。
図3は、この発明の実施の形態3であるプラント制御装置の構成を示す構成図である。図3において、演算処理装置としてのCPU盤50は、断線表示部51を有する。プロセス入出力装置としてのリモート盤60は、断線検出部としてのAND回路61、タイマ62、信号処理部65を有する。なお、OR回路23、タイマ24、AND回路61、タイマ62、信号処理部65がこの発明における動作制御部である。その他の構成については、図1に示した実施の形態1と同様のものであるので、相当するものに同じ符号を付して説明を省略する。パルス検出部21及びパルス検出部22からの出力信号S1,S2はOR回路23に入力されるとともに、AND回路61にも入力される。AND回路61は、出力信号S1及び出力信号S2の両方のレベルがHであればその出力信号S5のレベルをHとし、出力信号S1及び出力信号S2のうちの一方のレベルがLであればその出力信号S5のレベルをLとする。
図4は、この発明の実施の形態4であるプラント制御装置の構成を示す構成図である。図4において、演算処理装置としてのCPU盤70は、故障表示部71を有する。プロセス入出力装置としてのリモート盤80は故障検出部81を有する。故障検出部81は,プロセス入出力部26のDIモジュール27,汎用モジュール28,DOモジュール29の動作を監視し、異常があればパルス検出部21及びパルス検出部22の動作を停止してパルス列を検出しないようにし、OR回路23、タイマ24、信号処理部25を介してDOモジュール29のうちの図示しないプラントの構成機器を制御するための信号を出力するDOモジュール29の動作を禁止する。併せて動作の禁止されていないDOモジュール29、光ケーブル35を介してCPU盤70へ故障信号を送り、故障表示部71に故障の旨表示する。以上のように、プロセス入出力部26内での故障をリモート盤80内で検出することができる。
なお、本発明は、その発明の範囲内において、上述した各実施の形態を自由に組み合わせたり、各実施の形態を適宜、変更、省略することが可能である。
21,22 パルス検出部、23 OR回路、24 タイマ、25 信号処理部、
26 プロセス入出力部、27 DIモジュール、29 DOモジュール、
31 第1伝送ライン、32 第2伝送ライン、40 リモート盤、
41,42 フォトカプラ、50 CPU盤、51 断線表示部、60 リモート盤、
61 AND回路、62 タイマ、65 信号処理部、70 CPU盤、
71 故障表示部、80 リモート盤、81 故障検出部。
Claims (4)
- 二重化された伝送路により接続される演算処理装置とプロセス入出力装置とを有するプラント制御装置であって、
前記演算処理装置は、パルス列発生部と演算処理部とを有するものであって、
前記パルス列発生部は、パルス列を発生するものであり、
前記プロセス入出力装置は、パルス信号検出部と動作制御部とプロセス入出力部とを有するものであって、
前記パルス信号検出部は、第1及び第2のパルス列検出部を有し、
前記演算処理部は、前記プロセス入出力部を介してプラントのプロセスを制御するものであり、
前記パルス列発生部と前記パルス信号検出部とが前記二重化された伝送路にて接続され、
前記第1及び第2のパルス列検出部は、前記二重化された伝送路のそれぞれを介して送信される前記パルス列をそれぞれ検出し、
前記動作制御部は、前記第1及び第2のパルス列検出部の少なくとも一方において前記パルス列が検出されているときは前記プロセス入出力部の動作を許容し、前記第1及び第2のパルス列検出部のいずれにおいても前記パルス列が検出されないときは前記プロセス入出力部の動作を禁止するものである
プラント制御装置。 - 前記動作制御部は、前記第1及び第2のパルス列検出部の少なくとも一方において前記パルス列が検出されないときに前記伝送路が断線したと判定する断線検出部を有するものである
請求項1に記載のプラント制御装置。 - 前記プロセス入出力装置は、入力側と出力側とを電気的に絶縁する信号絶縁部を有するものであって、前記信号絶縁部を介して前記パルス列が前記第1及び第2のパルス列検出部に入力されるものである
請求項1または請求項2に記載のプラント制御装置。 - 前記プロセス入出力装置は、前記プロセス入出力部の故障を検出し前記第1及び第2のパルス列検出部が前記パルス列を検出しないように動作を停止させる故障検出部を有するものである
請求項1から請求項3のいずれか1項に記載のプラント制御装置。
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2012
- 2012-12-12 JP JP2012270911A patent/JP6332905B2/ja active Active
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