JP6318769B2 - ストレージ制御装置、制御プログラム、および制御方法 - Google Patents
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Description
[第1の実施形態]
まず、第1の実施形態のストレージ制御装置について図1を用いて説明する。図1は、第1の実施形態のストレージ制御装置の構成の一例を示す図である。
次に、第2の実施形態のストレージサーバについて図2を用いて説明する。図2は、第2の実施形態のストレージサーバの構成の一例を示す図である。
データブロックは、512byteのサイズであり、この512byteごとに8byteのBCCが生成される。データブロックは、一意に特定可能なLBAが付される。たとえば、ユーザデータ領域252は、LBA#1、LBA#2、LBA#3、LBA#4、…を含み、ユーザデータを記憶する。また、メタ領域251は、LBA#mを含み、BCCを記憶する。なお、HDD25,26は、256byte、64byteなど、アクセス単位(512byte)より小さな単位で、データブロック内のデータを区分可能にする。
[ステップS12]CA13は、書込対象データについてデータブロックごとのBCCを生成する。
[ステップS14]CA13は、キャッシュメモリ19のBCC領域191に、生成したBCCを書き込む。
次に、第2の実施形態のライトバック処理について図8を用いて説明する。図8は、第2の実施形態のライトバック処理のフローチャートを示す図である。ライトバック処理は、CA13,14がライト要求受付処理を終了した後に、CM17,18が実行する処理である。以下、CM17がライトバック処理を実行する場合について説明するが、CM18についても同様である。
[ステップS22]CM17は、キャッシュメモリ19のBCC領域191からBCCを読み出す。
[ステップS24]CM17は、HDD25のメタ領域251にBCCを書き込む。
ストレージサーバ10(CA13)は、ホスト11から、DATA1、DATA2、DATA3、およびDATA4を書込対象データとするライト要求を受け付ける。
ストレージサーバは、ホストから、DATA1、DATA2、DATA3、およびDATA4を書込対象データとするライト要求を受け付ける。
すなわち、ストレージサーバは、HDDのブロックライト失敗を検出できない。このような、ストレージサーバは、データ書込失敗の検出精度が不十分である。一方、第2の実施形態のストレージサーバ10は、図9を用いて説明したように、HDD25のユーザデータ領域252におけるブロックライト失敗を検出できることから、データ書込失敗の検出精度が比較例と比較して高い。
[ステップS33]CA13は、キャッシュメモリ19のBCC領域191からBCCを読み出す。
[ステップS36]CA13は、ホストにエラー応答を送信して、リード要求受付処理を終了する。
ストレージサーバ10は、ホストから、DATA1、DATA2、DATA3、およびDATA4を読出対象データとするリード要求を受け付ける。このとき、HDDは、LBA#2のブロックライト失敗により、LBA#1にDATA1とBCC1を記憶し、LBA#2にDATA02とBCC02を記憶し、LBA#3にDATA3とBCC3を記憶し、LBA#4にDATA4とBCC4を記憶する。
次に、第3の実施形態のストレージ制御装置について図13を用いて説明する。図13は、第3の実施形態のストレージ制御装置の構成の一例を示す図である。
メタ情報領域51は、HDDがメタ領域に記憶するメタ情報を記憶する領域である。ユーザデータ領域53は、ユーザデータをデータブロックごとに記憶する領域である。BCC領域52は、ユーザデータ領域53が記憶するユーザデータのデータブロックごとのBCCを記憶する領域である。
[ステップS42]ノード#1は、HDD54からメタ情報を読み出して、キャッシュメモリ50のメタ情報領域51に書き込む。これにより、ノード#1は、メタ情報領域51に、データ位置情報とBCC位置情報とを記憶する。
[ステップS45]ノード#1は、キャッシュメモリ50のBCC領域52に、生成したBCCを書き込む。
[ステップS47]ノード#1は、メタ情報のうちのデータアドレス(データ位置情報)を取得する。
[ステップS50]ノード#1は、BCCアドレスから特定される担当ノードにBCCを送信する。たとえば、ノード#1は、ノード#2にBCCを送信する。BCCを受信した担当ノードは、BCCアドレスから特定されるHDDの所定アドレスにデータを書き込む。ノード#1は、担当ノードにBCCを送信した後、ライト要求受付処理を終了する。
2 誤り検出情報格納部
3 データ格納部
4 検出部
5 記憶装置
6 第1の記憶領域
7 第2の記憶領域
10 ストレージサーバ
11,12 ホスト
13,14 CA
15,16,23,24 スイッチ
17,18 CM
19,20,50 キャッシュメモリ
21,22 DA
25,26,54,55,56,60,61,62,70,71,72 HDD
101 プロセッサ
102 RAM
103 不揮発性メモリ
104 入出力インタフェース
105 機器接続インタフェース
106 通信インタフェース
107 DMA
109 バス
Claims (6)
- 書込対象データについてアクセス単位となるデータブロックごとに誤り検出情報を生成し、ディスクドライブ装置のメタ情報を格納する第1の記憶領域に前記誤り検出情報を格納し、
前記ディスクドライブ装置のユーザデータを格納するユーザデータ記憶領域である第2の記憶領域に前記書込対象データを格納し、
前記第1の記憶領域から読み出した前記誤り検出情報と、前記第2の記憶領域から読み出した前記書込対象データとから前記データブロックごとの誤り検出をおこなう制御部を備えることを特徴とするストレージ制御装置。 - 前記書込対象データは、キャッシュメモリに記憶されていることを特徴とする請求項1記載のストレージ制御装置。
- 前記キャッシュメモリは、前記誤り検出情報を格納するキャッシュメモリ誤り検出情報格納部と、前記キャッシュメモリの前記誤り検出情報を格納する記憶領域と異なる書込対象データ記憶領域に前記書込対象データを格納するキャッシュメモリデータ格納部と、
を備えることを特徴とする請求項2記載のストレージ制御装置。 - 前記制御部は、
前記誤り検出情報の格納先である誤り検出情報格納先情報と、前記書込対象データの格納先である書込対象データ格納先情報とを、前記第1の記憶領域および前記第2の記憶領域と異なる第3の記憶領域に格納し、
前記誤り検出情報格納先情報にもとづいて前記第1の記憶領域に前記誤り検出情報を格納し、
前記書込対象データ格納先情報にもとづいて前記第2の記憶領域に前記書込対象データを格納する、
ことを特徴とする請求項1記載のストレージ制御装置。 - コンピュータに、
書込対象データについてアクセス単位となるデータブロックごとに誤り検出情報を生成し、ディスクドライブ装置のメタ情報を格納する第1の記憶領域に前記誤り検出情報を格納し、
前記ディスクドライブ装置のユーザデータを格納するユーザデータ記憶領域である第2の記憶領域に前記書込対象データを格納し、
前記第1の記憶領域から読み出した前記誤り検出情報と、前記第2の記憶領域から読み出した前記書込対象データとから前記データブロックごとの誤り検出をおこなう、
処理を実行させることを特徴とする制御プログラム。 - コンピュータが、
書込対象データについてアクセス単位となるデータブロックごとに誤り検出情報を生成し、ディスクドライブ装置のメタ情報を格納する第1の記憶領域に前記誤り検出情報を格納し、
前記ディスクドライブ装置のユーザデータを格納するユーザデータ記憶領域である第2の記憶領域に前記書込対象データを格納し、
前記第1の記憶領域から読み出した前記誤り検出情報と、前記第2の記憶領域から読み出した前記書込対象データとから前記データブロックごとの誤り検出をおこなう、
処理を実行することを特徴とする制御方法。
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