JP6217870B2 - Structure, wiring board, and method of manufacturing wiring board - Google Patents

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Description

本発明は、配線基板の製造に用いられる構造体、配線基板および配線基板の製造方法に関する。   The present invention relates to a structure used for manufacturing a wiring board, a wiring board, and a method for manufacturing the wiring board.

半導体素子の最外層におけるパッド部の開口形成プロセスとして、以下の文献に記載されたプロセスが知られている。   A process described in the following document is known as a process for forming an opening in a pad portion in the outermost layer of a semiconductor element.

特許文献1には、以下のようなプロセスが記載されている。
まず、熱硬化性樹脂組成物を用いてソルダーレジスト層を形成する。次いで、ソルダーレジスト層を、基板上に形成された導電パッドの表面を覆うように積層させて構造体(積層体)を得る。次に、上記導電パッドが露出するように、たとえば、炭酸ガスレーザーをソルダーレジスト層に対して照射して開口部を形成する。この後、デスミア処理とプラズマ処理をこの順で行うことにより、露出した導電パッド表面に付着している樹脂残留物(スミア)を除去して配線基板を得る。つづいて、露出した導電パッド上にハンダバンプやボンディングワイヤを接続させる。
Patent Document 1 describes the following process.
First, a solder resist layer is formed using a thermosetting resin composition. Next, a solder resist layer is laminated so as to cover the surface of the conductive pad formed on the substrate to obtain a structure (laminated body). Next, for example, a carbon dioxide gas laser is irradiated to the solder resist layer so that the conductive pad is exposed to form an opening. Thereafter, the desmear process and the plasma process are performed in this order to remove the resin residue (smear) adhering to the exposed conductive pad surface and obtain a wiring board. Subsequently, solder bumps and bonding wires are connected to the exposed conductive pads.

特開2013−129170号公報JP 2013-129170 A

しかしながら、特許文献1等に記載されている従来のプロセスは、以下の技術的課題を有していた。配線基板の製造現場においては、実際、当該配線基板として、複数の回路と複数の導電パッドとを備えたものを作製する場合がほとんどである。そのため、従来のプロセスにおいても、作業性や生産性の観点から、複数の開口部を一回のエッチング処理により同時に形成する必要があった。そして、複数の開口部を同時に形成する場合、各開口部間でエッチング処理度合いにバラつきが生じることがあった。   However, the conventional process described in Patent Document 1 has the following technical problems. In the manufacturing site of a wiring board, in fact, in most cases, a wiring board having a plurality of circuits and a plurality of conductive pads is produced. Therefore, also in the conventional process, from the viewpoint of workability and productivity, it is necessary to simultaneously form a plurality of openings by one etching process. When forming a plurality of openings at the same time, the degree of etching treatment may vary between the openings.

こうした事情を踏まえると、従来のプロセスでは、形成する全ての開口部において導電パッドを確実に露出させるため、先に導電パッドが露出した開口部についてもエッチング処理を継続する必要が有った。その結果、いくつかの開口部においては導電パッドやコア基板の表面に対してエッチングダメージが加わる可能性があった。さらに、エッチングダメージのある、導電パッドやコア基板を備えた配線基板を用いて作製された半導体パッケージは、コア基板の耐久性や、導電パッドと当該導電パッド上に形成される、ハンダバンプやボンディングワイヤとの接続信頼性という点について、改善の余地を有していた。言い換えれば、従来のプロセスは、耐久性および接続信頼性に優れた半導体パッケージの歩留りが十分に向上しないという問題があった。   In view of such circumstances, in the conventional process, in order to surely expose the conductive pads in all the openings to be formed, it is necessary to continue the etching process for the openings in which the conductive pads were previously exposed. As a result, etching damage may be applied to the surface of the conductive pad and the core substrate in some openings. Further, a semiconductor package manufactured using a wiring board having a conductive pad and a core substrate, which is damaged by etching, has a durability of the core substrate and a solder bump or bonding wire formed on the conductive pad and the conductive pad. There was room for improvement in terms of connection reliability. In other words, the conventional process has a problem that the yield of a semiconductor package excellent in durability and connection reliability is not sufficiently improved.

そこで、本発明は、耐久性および接続信頼性に優れた半導体パッケージを歩留りよく作製することが可能な配線基板の製造に用いられる構造体、係る構造体を用いた配線基板、および、係る配線基板の製造方法を提供する。   Therefore, the present invention provides a structure used for manufacturing a wiring board capable of producing a semiconductor package excellent in durability and connection reliability with a high yield, a wiring board using such a structure, and such a wiring board. A manufacturing method is provided.

本発明によれば、コア基板と、
前記コア基板の少なくとも一方の面上に設けられた導電パターンと、
前記導電パターンおよび前記コア基板の前記一方の面を覆うようにかつ、これらに直接接触して設けられたソルダーレジスト層とを有し、
前記コア基板の前記一方の面は、前記導電パターンが接触する第1の領域と、前記第1の領域と隣接する第2の領域とを備え、少なくとも前記第2の領域のブラスト処理に対するエッチング耐性が、前記ソルダーレジスト層の前記ブラスト処理に対するエッチング耐性より高いことを特徴とする構造体が提供される。
According to the present invention, a core substrate;
A conductive pattern provided on at least one surface of the core substrate;
The conductive patterns and to cover the one surface of the core substrate, and, and a solder resist layer provided in contact these directly,
The one surface of the core substrate includes a first region in contact with the conductive pattern, and a second region adjacent to the first region, and at least etching resistance to blasting of the second region However, the structure is characterized in that the solder resist layer has higher etching resistance to the blasting process.

さらに、本発明によれば、コア基板と、前記コア基板の少なくとも一方の面上に設けられた導電パターンと、前記導電パターンおよび前記コア基板の前記一方の面を覆うようにかつ、これらに直接接触して設けられたソルダーレジスト層とを有する構造体であって、かつ前記ソルダーレジスト層が前記構造体の最外層に積層されてなる前記構造体を準備する工程と、
前記ソルダーレジスト層に対してブラスト処理を実施することにより、前記ソルダーレジスト層を貫通して、前記コア基板の前記一方の面の一部と前記導電パターンの一部とが露出する少なくとも1つの開口部を形成する工程と、
をこの順に有し、
前記開口部を形成する工程は、前記ソルダーレジスト層のうち、前記開口部を形成する領域にブラスト処理を行うことによって開口を形成する工程を含み、
前記コア基板の前記一方の面は、前記導電パターンが接触する第1の領域と、前記第1の領域と隣接する第2の領域とを備え、少なくとも前記第2の領域の前記ブラスト処理に対するエッチング耐性が、前記ソルダーレジスト層の前記ブラスト処理に対するエッチング耐性より高いことを特徴とする配線基板の製造方法が提供される。
Furthermore, according to the present invention, so as to cover the core substrate, and a conductive pattern provided on at least one surface of the core substrate, the conductive pattern and the one surface of the core substrate, and these Preparing a structure having a solder resist layer provided in direct contact with and having the solder resist layer laminated on the outermost layer of the structure;
By performing a blast process on the solder resist layer, at least one opening penetrating the solder resist layer and exposing a part of the one surface of the core substrate and a part of the conductive pattern is exposed. Forming a part;
In this order,
The step of forming the opening includes a step of forming an opening by performing a blasting process on a region of the solder resist layer in which the opening is formed,
The one surface of the core substrate includes a first region in contact with the conductive pattern and a second region adjacent to the first region, and at least etching of the second region with respect to the blast treatment There is provided a method for manufacturing a wiring board, wherein the resistance of the solder resist layer is higher than the etching resistance of the solder resist layer to the blast treatment.

本発明によれば、耐久性および接続信頼性に優れた半導体パッケージを歩留りよく作製することが可能な配線基板の製造に用いられる構造体、係る構造体を用いた配線基板、および係る配線基板の製造方法を提供することができる。   ADVANTAGE OF THE INVENTION According to this invention, the structure used for manufacture of the wiring board which can produce the semiconductor package excellent in durability and connection reliability with a sufficient yield, the wiring board using such a structure, and such a wiring board A manufacturing method can be provided.

図1(a)は、本実施形態に係る構造体の例を模式的に示す断面図である。図1(b)は、本実施形態に係る配線基板の例を模式的に示す断面図である。FIG. 1A is a cross-sectional view schematically showing an example of a structure according to this embodiment. FIG. 1B is a cross-sectional view schematically showing an example of the wiring board according to the present embodiment. 図2は、本実施形態に係る半導体パッケージの一例を模式的に示す断面図である。FIG. 2 is a cross-sectional view schematically showing an example of a semiconductor package according to the present embodiment. 図3は、本実施形態に係る電子装置の一例を模式的に示す断面図である。FIG. 3 is a cross-sectional view schematically showing an example of the electronic apparatus according to the present embodiment. 図4は、本実施形態に係る配線基板の製造方法の流れの一例を示すフローチャートである。FIG. 4 is a flowchart showing an example of the flow of the manufacturing method of the wiring board according to the present embodiment. 図5(a)および(b)は、本実施形態に係る配線基板の製造方法の一例を示す模式図である。5A and 5B are schematic views showing an example of a method for manufacturing a wiring board according to the present embodiment. 図6(a)および(b)は、本実施形態に係る配線基板の製造方法の一例を示す模式図である。6A and 6B are schematic views showing an example of a method for manufacturing a wiring board according to the present embodiment. 図7は、本実施形態に係るソルダーレジスト層の表面形態の例を模式的に示す断面図である。FIG. 7 is a cross-sectional view schematically showing an example of the surface form of the solder resist layer according to this embodiment.

以下、本発明の好適な実施形態について、図面を用いて説明する。尚、すべての図面において、同様な構成要素には同様の符号を付し、適宜説明を省略する。
まず、本実施形態に係る構造体および配線基板について説明する。
Hereinafter, preferred embodiments of the present invention will be described with reference to the drawings. In all the drawings, the same reference numerals are given to the same components, and the description will be omitted as appropriate.
First, the structure and wiring board according to this embodiment will be described.

<構造体および配線基板>
図1(a)は、本実施形態に係る構造体の一例を模式的に示す断面図であり、図1(b)は、本実施形態に係る配線基板の一例を模式的に示す断面図である。
本実施形態に係る構造体1000は、本実施形態の配線基板20の製造に用いられる。構造体1000は、図1(a)に示すように、コア基板22と、コア基板22の少なくとも一方の面上(本実施形態では、コア基板22の各表面上)に設けられた導電パターン24と、導電パターン24を覆うように、コア基板22の各表面上に設けられたソルダーレジスト層10と、を有する。この構造体1000のソルダーレジスト層10の所定領域にブラスト処理を実施することにより、構造体1000(ソルダーレジスト層10)に開口部28が形成された配線基板20を得ることができる(図1(b)参照)。すなわち、配線基板20は、上記構造体1000のソルダーレジスト層10を貫通して設けられ、コア基板22の各表面の一部と導電パターン24の一部とが露出する複数の開口部28を有している。
<Structure and wiring board>
FIG. 1A is a cross-sectional view schematically showing an example of a structure according to this embodiment, and FIG. 1B is a cross-sectional view schematically showing an example of a wiring board according to this embodiment. is there.
The structure 1000 according to the present embodiment is used for manufacturing the wiring board 20 of the present embodiment. As shown in FIG. 1A, the structure 1000 includes a core substrate 22 and a conductive pattern 24 provided on at least one surface of the core substrate 22 (in this embodiment, on each surface of the core substrate 22). And a solder resist layer 10 provided on each surface of the core substrate 22 so as to cover the conductive pattern 24. By performing a blasting process on a predetermined region of the solder resist layer 10 of the structure 1000, the wiring substrate 20 in which the opening 28 is formed in the structure 1000 (solder resist layer 10) can be obtained (FIG. 1 ( b)). That is, the wiring board 20 is provided through the solder resist layer 10 of the structure 1000 and has a plurality of openings 28 through which a part of each surface of the core board 22 and a part of the conductive pattern 24 are exposed. doing.

そして、本実施形態に係る構造体1000においては、コア基板22の両面は、導電パターン24が接触する第1の領域と、第1の領域と隣接する第2の領域とを備え、少なくとも第2の領域のブラスト処理に対するエッチング耐性が、ソルダーレジスト層10のブラスト処理に対するエッチング耐性より高い。このような構造体1000を用いることにより、開口部28に露出した導電パッド24やコア基板22の表面に対するエッチングダメージが抑えられた配線基板20を得ることができる。したがって、かかる配線基板20を用いることにより、耐久性および接続信頼性に優れた半導体パッケージを歩留りよく作製することができる。なお、本実施形態の構造体1000では、後述するように、コア基板22の最外層(最上層)をエッチング阻止膜で構成することができる。かかる構造体1000では、上記第1の領域および上記第2の領域のブラスト処理に対するエッチング耐性を、ソルダーレジスト層10のブラスト処理に対するエッチング耐性よりも高くすることができる。かかる構成とすることで、耐久性および接続信頼性に優れた半導体パッケージを、より容易に、かつ、より高い歩留りで作成することができる配線基板20を得ることができる。   In the structure 1000 according to the present embodiment, both surfaces of the core substrate 22 include a first region in contact with the conductive pattern 24 and a second region adjacent to the first region, and at least a second region. The etching resistance to the blasting process in the region is higher than the etching resistance to the blasting process of the solder resist layer 10. By using such a structure 1000, it is possible to obtain the wiring substrate 20 in which etching damage to the conductive pad 24 exposed to the opening 28 and the surface of the core substrate 22 is suppressed. Therefore, by using the wiring substrate 20, a semiconductor package excellent in durability and connection reliability can be manufactured with a high yield. In the structure 1000 of the present embodiment, as will be described later, the outermost layer (uppermost layer) of the core substrate 22 can be formed of an etching stopper film. In the structure 1000, the etching resistance of the first region and the second region with respect to the blasting process can be made higher than the etching resistance of the solder resist layer 10 with respect to the blasting process. With this configuration, it is possible to obtain the wiring substrate 20 that can easily and more easily produce a semiconductor package having excellent durability and connection reliability.

本発明者は、従来の構造体に対して開口部を形成することにより得られた配線基板について、複数ある開口部の内いくつかの開口部においては導電パッドやコア基板の表面に対してエッチングダメージが加わる可能性があることを見出した。さらに、本発明者は、上記従来の構造体を用いて作製された半導体パッケージは、コア基板の耐久性や、導電パッドと、当該導電パッド上に形成されるハンダバンプやボンディングワイヤとの接続信頼性について、改善の余地を有していることも見出した。   The present inventor, with respect to a wiring board obtained by forming openings in a conventional structure, etches the surface of a conductive pad or core substrate in some of the openings. I found that there is a possibility of damage. Further, the present inventor has found that the semiconductor package manufactured using the above-described conventional structure has the durability of the core substrate and the connection reliability between the conductive pad and the solder bump or bonding wire formed on the conductive pad. I also found that there is room for improvement.

本発明者は、上述した不都合が生じることのない半導体パッケージを実現するための設計指針について鋭意検討した結果、耐久性および接続信頼性に優れた半導体パッケージを歩留りよく作製することが可能な構造体を実現するためには、ブラスト処理に対するコア基板22の最外層と、ソルダーレジスト層10とのエッチング耐性度合のバランスを制御することが有効であることを見出した。したがって、本実施形態では、上記構造体1000を用いて製造される配線基板20が、ブラスト処理を実施することにより得られた複数の開口部28を有することを前提としている。
また、コア基板22の最外層のうち、導電パターン24が接触しない上記第2の領域のエッチング耐性が、ソルダーレジスト層10のエッチング耐性よりも高ければ、露出した導電パッド24やコア基板22の表面に対するエッチングダメージを抑えることができる。したがって、かかる構成でも、コア基板22の最外層全体のエッチング耐性を、ソルダーレジスト層10のエッチング耐性よりも高くした場合と同様の効果を得ることができる。
As a result of intensive studies on design guidelines for realizing a semiconductor package that does not cause the above-described disadvantages, the inventor has a structure capable of manufacturing a semiconductor package excellent in durability and connection reliability with a high yield. In order to realize the above, it has been found effective to control the balance of the etching resistance between the outermost layer of the core substrate 22 and the solder resist layer 10 with respect to the blasting process. Therefore, in the present embodiment, it is assumed that the wiring board 20 manufactured using the structure 1000 has a plurality of openings 28 obtained by performing the blasting process.
Further, if the etching resistance of the second region of the outermost layer of the core substrate 22 where the conductive pattern 24 does not contact is higher than the etching resistance of the solder resist layer 10, the exposed conductive pads 24 and the surface of the core substrate 22 are exposed. Etching damage can be suppressed. Therefore, even in this configuration, the same effect as that obtained when the etching resistance of the entire outermost layer of the core substrate 22 is made higher than the etching resistance of the solder resist layer 10 can be obtained.

ここで、構造体1000に開口部28を形成して配線基板20を得る際に実施するブラスト処理とは、平均粒子径(D50)が1μm以上70μm以下の粒子を吹き付けて該当箇所を研磨加工する手法であるサンドブラスト処理やウェットブラスト処理等が挙げられる。本実施形態では、ブラスト処理として、上記ブラスト処理の中でもたとえば、平均粒子径(D50)が1μm以上25μm以下の微細粒子を吹き付けて該当箇所を研磨加工するマイクロブラスト処理を用いることが好ましい。マイクロブラスト処理では、平均粒子径(D50)が30μm以上の粒子を吹き付けるサンドブラスト処理よりも研磨する力(研磨力)が抑えられるため、露出した導電パッド24やコア基板22の表面に対するエッチングダメージをより確実に抑えることができる。また、研磨される開口部28の深さや、開口部28を規定する側壁部分の形状を、高い精度で制御することができる。すなわち、高い研磨精度(加工精度)で開口部28を形成することができる。   Here, the blasting process performed when the opening 28 is formed in the structure 1000 to obtain the wiring substrate 20 is performed by spraying particles having an average particle diameter (D50) of 1 μm or more and 70 μm or less to polish the corresponding portion. Examples thereof include sand blasting and wet blasting. In the present embodiment, as the blasting process, it is preferable to use, for example, a microblasting process in which fine particles having an average particle diameter (D50) of 1 μm or more and 25 μm or less are sprayed and the corresponding portion is polished. In the microblasting process, the polishing force (polishing power) is suppressed more than in the sandblasting process in which particles having an average particle diameter (D50) of 30 μm or more are sprayed. It can be surely suppressed. In addition, the depth of the opening 28 to be polished and the shape of the side wall portion that defines the opening 28 can be controlled with high accuracy. That is, the opening 28 can be formed with high polishing accuracy (processing accuracy).

次に、上述したエッチング耐性とは、エッチング処理として本実施形態に係るブラスト処理を採用した場合における、各種部材が当該処理により選択的に除去される効率、例えば、表面加工量、表面加工速度等で示される。   Next, the above-described etching resistance refers to the efficiency with which various members are selectively removed by the processing when the blast processing according to the present embodiment is used as the etching processing, for example, the surface processing amount, the surface processing speed, etc. Indicated by

本実施形態に係る構造体1000は、上述したようにコア基板22の最外層のブラスト処理に対するエッチング耐性が、ソルダーレジスト層10のブラスト処理に対するエッチング耐性より高くなるよう制御した構成を採用するものである。こうすることで、従来の半導体パッケージにおいて生じていた不都合を抑制することができる。そのため、本実施形態に係る構造体1000を用いた場合、耐久性および接続信頼性に優れた半導体パッケージを歩留まり良く作製することが可能な配線基板20を得ることができる。   The structure 1000 according to the present embodiment employs a configuration in which the etching resistance to the blasting process of the outermost layer of the core substrate 22 is controlled to be higher than the etching resistance to the blasting process of the solder resist layer 10 as described above. is there. By doing so, inconveniences that have occurred in the conventional semiconductor package can be suppressed. Therefore, when the structure 1000 according to this embodiment is used, it is possible to obtain the wiring board 20 capable of manufacturing a semiconductor package excellent in durability and connection reliability with a high yield.

そして、本実施形態に係る構造体1000において、上述したエッチング耐性を表面加工量で示す場合、コア基板22の最外層のブラスト処理に対する表面加工量は、ソルダーレジスト層10のブラスト処理に対する表面加工量の10倍以上であることが好ましい。こうすることで、配線基板20を構成する全ての開口部28において導電パッド22を確実に露出させるため、配線基板20の製造時にオーバーエッチングした場合であっても、全ての開口部28において、導電パターン24やコア基板22の表面に対するエッチングダメージをより確実に抑制することができる。それ故、かかる構成を採用した構造体1000を用いた場合、耐久性および接続信頼性に優れた半導体パッケージを歩留りよく作製することが可能な配線基板20を得ることができる。   In the structure 1000 according to the present embodiment, when the etching resistance described above is indicated by the surface processing amount, the surface processing amount for the blast processing of the outermost layer of the core substrate 22 is the surface processing amount for the blast processing of the solder resist layer 10. It is preferable that it is 10 times or more. In this way, the conductive pads 22 are surely exposed in all the openings 28 constituting the wiring board 20, so that even if overetching is performed at the time of manufacturing the wiring board 20, the conductive pads 22 are conductive in all the openings 28. Etching damage to the pattern 24 and the surface of the core substrate 22 can be more reliably suppressed. Therefore, when the structure 1000 adopting such a configuration is used, it is possible to obtain the wiring substrate 20 capable of manufacturing a semiconductor package excellent in durability and connection reliability with a high yield.

本実施形態に係る構造体1000は、上述したように、コア基板22の最外層およびソルダーレジスト層10のそれぞれのブラスト処理に対するエッチング耐性度合を制御した構成を採用している。そのため、かかるコア基板22の最外層は、ブラスト処理に対応したエッチング阻止膜により形成されていることが好ましい。
このエッチング阻止膜は、少なくとも1つの絶縁層を含む公知のコア基板を作製する工程において後述する所定の樹脂材料(熱硬化性樹脂組成物(X))で形成した最外層自体であってもよいし、少なくとも1つの絶縁層を含む公知のコア基板の最外層に対して積層した、後述する所定の樹脂材料(熱硬化性樹脂組成物(X))で形成した樹脂膜であってもよい。なお、コア基板22が備える絶縁層は、たとえば繊維基材に樹脂組成物を含浸してなる樹脂基材を指す。また、本実施形態に係るコア基板22は、熱硬化性樹脂で形成することができる。かかるコア基板22はリジッドな基板でも良いし、フレキシブルな基板でも良い。コア基板22の厚さは、たとえば10μm以上300μm以下とすることができる。また、コア基板22における最外層の厚さは、たとえば、3μm以上20μm以下とすることができる。
As described above, the structure 1000 according to the present embodiment employs a configuration in which the degree of etching resistance with respect to the blast processing of the outermost layer of the core substrate 22 and the solder resist layer 10 is controlled. Therefore, it is preferable that the outermost layer of the core substrate 22 is formed of an etching stopper film corresponding to blast processing.
This etching stopper film may be the outermost layer itself formed of a predetermined resin material (thermosetting resin composition (X)) to be described later in the process of producing a known core substrate including at least one insulating layer. Further, it may be a resin film formed of a predetermined resin material (thermosetting resin composition (X)), which will be described later, laminated on the outermost layer of a known core substrate including at least one insulating layer. In addition, the insulating layer with which the core board | substrate 22 is provided points out the resin base material formed by impregnating a fiber base material with a resin composition, for example. Further, the core substrate 22 according to the present embodiment can be formed of a thermosetting resin. The core substrate 22 may be a rigid substrate or a flexible substrate. The thickness of the core substrate 22 can be, for example, not less than 10 μm and not more than 300 μm. Moreover, the thickness of the outermost layer in the core substrate 22 can be, for example, 3 μm or more and 20 μm or less.

また、コア基板22は、1つの絶縁層のみを有し、その片面のみに導電パターン24が形成された片面板でも良いし、1つの絶縁層のみを有し、その表裏面の両方に導電パターン24が設けられた両面板でも良いし、2層以上の絶縁層を有する多層板でもよい。コア基板22が多層板である場合、コア基板22内には2つの絶縁層に挟まれた配線層が一層以上形成される。
また、コア基板22が両面板もしくは多層板である場合、コア基板22の一方の面(最外面)上に設けられた導電パターン24は、コア基板22の他方の面(最外面)上に設けられた導電パターン24やコア基板22の内部に設けられた配線層と、少なくとも一部の絶縁層を貫通するスルーホールを介して互いに電気的に接続されている。
The core substrate 22 may be a single-sided plate having only one insulating layer and having a conductive pattern 24 formed on only one side thereof, or having only one insulating layer and having a conductive pattern on both the front and back surfaces. A double-sided board provided with 24 or a multilayer board having two or more insulating layers may be used. When the core substrate 22 is a multilayer board, one or more wiring layers sandwiched between two insulating layers are formed in the core substrate 22.
When the core substrate 22 is a double-sided board or a multilayer board, the conductive pattern 24 provided on one surface (outermost surface) of the core substrate 22 is provided on the other surface (outermost surface) of the core substrate 22. The conductive layer 24 and the wiring layer provided inside the core substrate 22 are electrically connected to each other through a through hole penetrating at least a part of the insulating layer.

コア基板22の表面と裏面の少なくとも一方の面(最外面)には、導電パターン24が設けられている。導電パターン24はたとえばコア基板22に積層された銅膜を選択エッチングして形成されたパターンである。導電パターン24は、導電部として少なくともランド244とライン242とを含む。ランド244は主に、配線基板20に実装される素子や部品と導電パターン24とを電気的に接続する接続部であり、たとえば導電パターン24の他の部分もしくはコア基板22内の配線層に接続された円形や四角形の部分である。なお、ランド244の中心には電子部品の端子等を挿入するホールが設けられていても良い。そして、ライン242は主に、ランド244同士を互いに電気的に接続する線状の部分である。   A conductive pattern 24 is provided on at least one surface (outermost surface) of the front surface and the back surface of the core substrate 22. The conductive pattern 24 is, for example, a pattern formed by selectively etching a copper film laminated on the core substrate 22. The conductive pattern 24 includes at least a land 244 and a line 242 as a conductive portion. The land 244 is a connection part that electrically connects elements and components mounted on the wiring board 20 and the conductive pattern 24, and is connected to, for example, another part of the conductive pattern 24 or a wiring layer in the core substrate 22. It is a round or square part. Note that a hole for inserting a terminal of an electronic component or the like may be provided at the center of the land 244. The line 242 is mainly a linear portion that electrically connects the lands 244 to each other.

導電パターン24上には、後述する熱硬化性樹脂組成物(P)により形成されたソルダーレジスト層10が積層されている。ソルダーレジスト層10には、主にランド244が設けられた領域に開口部28が設けられており、ランド244はソルダーレジスト層10に被覆されていない。すなわち、ランド244の上にはソルダーレジスト層10が設けられておらず、ランド244が開口部28に露出している。なお、ランド244の上には、たとえばニッケルおよび金のめっき膜や半田のめっき膜などの導電膜が積層されていてもよい。本実施形態に係る配線基板20では、開口部28に位置するランド244の上にめっき膜246がさらに設けられている。ソルダーレジスト層10にはさらにランド244以外の部分に開口部が設けられていても良いし、ライン242の一部を露出させるような開口部があってもよい。また、ランド244の全てが開口部に位置する必要は無く、ソルダーレジスト層10に覆われたランド244があってもよい。   On the conductive pattern 24, a solder resist layer 10 formed of a thermosetting resin composition (P) described later is laminated. The solder resist layer 10 is provided with an opening 28 mainly in a region where the land 244 is provided, and the land 244 is not covered with the solder resist layer 10. That is, the solder resist layer 10 is not provided on the land 244, and the land 244 is exposed to the opening 28. Note that a conductive film such as a nickel and gold plating film or a solder plating film may be laminated on the land 244. In the wiring board 20 according to the present embodiment, a plating film 246 is further provided on the land 244 located in the opening 28. The solder resist layer 10 may be further provided with an opening in a portion other than the land 244, or an opening that exposes a part of the line 242. Further, it is not necessary for all of the lands 244 to be located in the openings, and there may be lands 244 covered with the solder resist layer 10.

構造体1000のソルダーレジスト層10は、その表面の算術平均粗さRaが0.08μm以上であることが好ましく、0.25μm以上であることがより好ましい。また、Raは0.50μm以下とすることが好ましく、0.40μm以下とすることがより好ましい。算術平均粗さRaはJIS−B0601に準拠して測定することができる。Raが上記下限以上、上限以下であることによって、温度変化によるソルダーレジスト層10と封止樹脂との密着性の変動が小さく、安定した耐久性が得られる。また、Raが上記上限以下であれば、ソルダーレジスト層10上に液状封止樹脂の転写を行う場合に、高いパターニング精度が得られる。よって、トランスファー成形などに限らず、プロセスの選択自由度に優れる。たとえばパターニング精度が十分得られない場合、樹脂封止する際にソルダーレジスト層10上の不要な部分に封止樹脂が形成されてしまい、パッケージが不良となるため、塗布法や転写法での封止樹脂の成形ができない。従って、Raが上記上限値以下であり、かつ上記下限値以上であることにより、パターニング精度との耐久性の性能バランスの良い配線基板20を実現できる。   The solder resist layer 10 of the structure 1000 preferably has an arithmetic average roughness Ra of 0.08 μm or more, more preferably 0.25 μm or more. Further, Ra is preferably 0.50 μm or less, and more preferably 0.40 μm or less. The arithmetic average roughness Ra can be measured according to JIS-B0601. When Ra is not less than the above lower limit and not more than the upper limit, variation in adhesion between the solder resist layer 10 and the sealing resin due to temperature change is small, and stable durability can be obtained. Moreover, if Ra is below the said upper limit, when patterning liquid sealing resin on the soldering resist layer 10, high patterning precision will be obtained. Therefore, it is excellent not only in transfer molding but also in the degree of freedom of process selection. For example, when sufficient patterning accuracy is not obtained, sealing resin is formed in unnecessary portions on the solder resist layer 10 when sealing with resin, resulting in defective packages. Stop molding is not possible. Therefore, when Ra is equal to or lower than the upper limit value and equal to or higher than the lower limit value, it is possible to realize the wiring board 20 having a good performance balance of durability with patterning accuracy.

ソルダーレジスト層10のガラス転移温度(Tg)は、たとえば150℃以上であることが好ましい。これにより、ソルダーレジスト層10の耐熱性および耐リフロー性の向上等を図ることが可能となる。一方で、上記Tgの上限値は、とくに限定されないが、たとえば280℃とすることができる。   The glass transition temperature (Tg) of the solder resist layer 10 is preferably 150 ° C. or higher, for example. As a result, it is possible to improve the heat resistance and reflow resistance of the solder resist layer 10. On the other hand, the upper limit value of the Tg is not particularly limited, but can be, for example, 280 ° C.

ソルダーレジスト層10の25℃における貯蔵弾性率は1GPa以上であることが好ましく、5GPa以上であることがより好ましい。また、20GPa以下であることが好ましい。上記上限値以下であり、かつ上記下限値以上であれば、耐久性に優れるパッケージをより歩留りよく製造可能な配線基板20を得ることができる。   The storage elastic modulus at 25 ° C. of the solder resist layer 10 is preferably 1 GPa or more, and more preferably 5 GPa or more. Moreover, it is preferable that it is 20 GPa or less. If it is not more than the above upper limit value and not less than the above lower limit value, it is possible to obtain the wiring board 20 capable of manufacturing a package having excellent durability with a higher yield.

本実施形態において、上記貯蔵弾性率および上記Tgは、たとえば、ソルダーレジスト層10を構成する熱硬化性樹脂組成物(P)の樹脂膜に対して、動的粘弾性測定装置を用いて周波数1Hz、昇温速度5℃/分の条件で動的粘弾性試験を行うことにより得られる測定結果から、算出することができる。動的粘弾性測定装置としては、とくに限定されないが、たとえばTAインスツルメント社製、DMA983を用いることができる。   In the present embodiment, the storage elastic modulus and the Tg are, for example, a frequency of 1 Hz using a dynamic viscoelasticity measuring device for the resin film of the thermosetting resin composition (P) constituting the solder resist layer 10. It can be calculated from the measurement result obtained by conducting a dynamic viscoelasticity test at a temperature rising rate of 5 ° C./min. Although it does not specifically limit as a dynamic viscoelasticity measuring apparatus, For example, TA Instruments company make and DMA983 can be used.

ソルダーレジスト層10の線膨張率は、Tg以下において、10ppm/℃以上であることが好ましい。また、50ppm/℃以下であることが好ましい。上記上限値以下であり、かつ上記下限値以上であれば、耐久性に優れるパッケージをより歩留りよく製造可能な配線基板20を得ることができる。 本実施形態においては、熱硬化性樹脂組成物(P)の樹脂膜に対して、たとえば熱機械測定装置を用いて昇温速度10℃/分の条件で測定することにより得られる線膨張係数の、25〜50℃における平均を算出して、これをTg以下における上記線膨張率とすることができる。   The linear expansion coefficient of the solder resist layer 10 is preferably 10 ppm / ° C. or higher at Tg or lower. Moreover, it is preferable that it is 50 ppm / degrees C or less. If it is not more than the above upper limit value and not less than the above lower limit value, it is possible to obtain the wiring board 20 capable of manufacturing a package having excellent durability with a higher yield. In the present embodiment, for the resin film of the thermosetting resin composition (P), for example, the linear expansion coefficient obtained by measuring at a temperature rising rate of 10 ° C./min using a thermomechanical measuring device. The average in 25-50 degreeC can be calculated, and this can be made into the said linear expansion coefficient in Tg or less.

なお、本実施形態では、たとえば後述する熱硬化性樹脂組成物(P)中に含まれる各成分の種類や配合量、熱硬化性樹脂組成物(P)の調製方法等を適切に選択することにより、上記貯蔵弾性率、上記Tg、および上記線膨張率を制御することが可能である。   In the present embodiment, for example, the type and blending amount of each component contained in the thermosetting resin composition (P) described later, a method for preparing the thermosetting resin composition (P), and the like are appropriately selected. Thus, the storage elastic modulus, the Tg, and the linear expansion coefficient can be controlled.

また、構造体1000を用いて製造される配線基板20は、たとえばインターポーザもしくはマザーボードとして用いることができる。   Moreover, the wiring board 20 manufactured using the structure 1000 can be used as an interposer or a mother board, for example.

パッケージや電子装置の製造のためには、構造体1000から配線基板20を製造した後、配線基板20上に封止樹脂を形成する。かかる配線基板20を用いたパッケージ等の完成品においては、ソルダーレジスト層10と封止樹脂との間の高い密着性を、歩留まり良く確保できる。よって、耐久性、耐湿性に優れ、信頼性の高いパッケージや電子装置を安定して製造することができる。なお、パッケージとは、配線基板20上に種々のパーツが搭載され、たとえば封止樹脂で一括封止されたものをいう。半導体パッケージはパッケージの一例であり、パッケージには、一括封止されたECU(Electric Control Unit)等も含む。   In order to manufacture a package or an electronic device, the wiring substrate 20 is manufactured from the structure 1000 and then a sealing resin is formed on the wiring substrate 20. In a finished product such as a package using such a wiring substrate 20, high adhesion between the solder resist layer 10 and the sealing resin can be secured with a high yield. Therefore, it is possible to stably manufacture highly reliable packages and electronic devices that are excellent in durability and moisture resistance. The package refers to a package in which various parts are mounted on the wiring board 20 and are collectively sealed with a sealing resin, for example. The semiconductor package is an example of a package, and the package includes an ECU (Electric Control Unit) that is collectively sealed.

<半導体パッケージ>
図2は本実施形態に係る半導体パッケージ102の構造の一例を模式的に示す断面図である。
図2に示すように、本実施形態に係る半導体パッケージ102は、上述した構造体1000を用いて製造した配線基板20と、配線基板20上に配設された半導体素子60と、配線基板20における半導体素子60を設けた面および半導体素子60を覆う封止樹脂40とを備える。なお、配線基板20におけるソルダーレジスト層10の吸水率は、0.7%以下であることが好ましい。こうすることで、長期絶縁信頼性に優れた半導体パッケージ102を実現することができる。
<Semiconductor package>
FIG. 2 is a cross-sectional view schematically showing an example of the structure of the semiconductor package 102 according to the present embodiment.
As shown in FIG. 2, the semiconductor package 102 according to the present embodiment includes a wiring board 20 manufactured using the structure 1000 described above, a semiconductor element 60 disposed on the wiring board 20, and a wiring board 20. A surface provided with the semiconductor element 60 and a sealing resin 40 covering the semiconductor element 60. In addition, it is preferable that the water absorption rate of the soldering resist layer 10 in the wiring board 20 is 0.7% or less. By doing so, the semiconductor package 102 having excellent long-term insulation reliability can be realized.

本実施形態に係る半導体パッケージ102では、上述した配線基板20の一方の面(以下では「上面」と呼ぶ)のソルダーレジスト層10の上に、少なくとも1つの半導体素子60が配設されている。半導体パッケージ102において、配線基板20はたとえばインターポーザであり、半導体素子60は、たとえば半導体ウエハから切り出されたLSIチップである。また、配線基板20の上面には半導体素子60に加えて、たとえば抵抗や容量として機能する電子部品などがさらに配設されていてもよい。半導体素子60はダイアタッチ材62を介してソルダーレジスト層10の上に固定されている。   In the semiconductor package 102 according to the present embodiment, at least one semiconductor element 60 is disposed on the solder resist layer 10 on one surface (hereinafter referred to as “upper surface”) of the wiring substrate 20 described above. In the semiconductor package 102, the wiring board 20 is, for example, an interposer, and the semiconductor element 60 is, for example, an LSI chip cut out from a semiconductor wafer. In addition to the semiconductor element 60, for example, an electronic component functioning as a resistor or a capacitor may be further disposed on the upper surface of the wiring board 20. The semiconductor element 60 is fixed on the solder resist layer 10 via a die attach material 62.

半導体素子60にはその表面に電気的な接続パッド(不図示)が設けられており、接続パッドはたとえば半導体素子60の内部に作り込まれた回路に接続されている。配線基板20に設けられた導電体パターン24の一部分であるランド244は、ソルダーレジスト層10の開口部28に設けられている。そして、ランド244と、半導体素子60上の接続パッドとは、ボンディングワイヤ50によって接続されている。なお、本実施形態に係る半導体パッケージ102では、ランド244の上にめっき膜246がさらに設けられており、ランド244はめっき膜246を介してボンディングワイヤ50に接続されているが、これに限定されない。また、ボンディングワイヤ50で接続される代わりにリード線や半田により接続されていても良い。   The semiconductor element 60 is provided with an electrical connection pad (not shown) on the surface thereof, and the connection pad is connected to a circuit built in the semiconductor element 60, for example. A land 244 which is a part of the conductor pattern 24 provided on the wiring board 20 is provided in the opening 28 of the solder resist layer 10. The land 244 and the connection pad on the semiconductor element 60 are connected by a bonding wire 50. In the semiconductor package 102 according to the present embodiment, the plating film 246 is further provided on the land 244, and the land 244 is connected to the bonding wire 50 through the plating film 246. However, the present invention is not limited to this. . Further, instead of being connected by the bonding wire 50, it may be connected by a lead wire or solder.

封止樹脂40は、配線基板20の上面に露出するソルダーレジスト層10と、コア基板22と、めっき膜246(めっき膜246を設けない場合はランド244)と、半導体素子60のうちダイアタッチ材62で配線基板20と接合された面以外の面と、ボンディングワイヤ50とを覆っている。なお、封止樹脂40は配線基板20の半導体素子60が設けられた面の全面を覆っていても良いし、当該面の一部を露出させて覆っていても良い。   The sealing resin 40 includes a solder resist layer 10 exposed on the upper surface of the wiring substrate 20, the core substrate 22, a plating film 246 (land 244 if no plating film 246 is provided), and a die attach material among the semiconductor elements 60. 62 covers the bonding wire 50 and the surface other than the surface bonded to the wiring board 20. The sealing resin 40 may cover the entire surface of the wiring substrate 20 on which the semiconductor element 60 is provided, or may cover a part of the surface exposed.

半導体パッケージ102の配線基板20には、上面とは反対側の面(以下では「下面」と呼ぶ)にさらに複数の開口部28と、開口部28の内部のランド244が設けられている。そして、それぞれのランド244はめっき膜246に覆われ、さらにめっき膜246を覆うハンダバンプ(半田ボール)30が設けられている。
ここでは、本実施形態に係る半導体パッケージ102としてワイヤボンディングされたパッケージの例について説明したが、これに限定されず、フリップチップ接続やTAB(Tape Automated Bonding)接続されるパッケージでもよい。
The wiring substrate 20 of the semiconductor package 102 is further provided with a plurality of openings 28 and lands 244 inside the openings 28 on the surface opposite to the upper surface (hereinafter referred to as “lower surface”). Each land 244 is covered with a plating film 246, and solder bumps (solder balls) 30 that cover the plating film 246 are further provided.
Here, an example of a wire-bonded package as the semiconductor package 102 according to the present embodiment has been described. However, the present invention is not limited to this, and a package connected by flip-chip connection or TAB (Tape Automated Bonding) may be used.

半導体パッケージ102において、ソルダーレジスト層10と封止樹脂40との間の、25℃におけるせん断強度をSとしたとき、Sは15N/mm以上であることが好ましく、29N/mm以上であることがより好ましい。当該せん断強度が、上記下限以上であれば、密着性に優れ、半導体パッケージ102の耐久性がより確実に向上する。In the semiconductor package 102, between the solder resist layer 10 and the sealing resin 40, 25 when the shear strength at ℃ was S 1, it is preferred that S 1 is 15N / mm 2 or more, 29N / mm 2 or more It is more preferable that If the shear strength is equal to or higher than the lower limit, the adhesiveness is excellent, and the durability of the semiconductor package 102 is more reliably improved.

半導体パッケージ102において、ソルダーレジスト層10と封止樹脂40との間の、260℃におけるせん断強度をSとしたとき、Sは8N/mm以上であることが好ましい。上記下限以上であれば、半導体パッケージ102の耐久性がより確実に向上する。高温環境下での使用や、回路動作における発熱で半導体パッケージ102の温度が上がっても高い密着性が保たれるからである。In the semiconductor package 102, between the solder resist layer 10 and the sealing resin 40, when the shear strength at 260 ° C. was S 2, it is preferred that S 2 is 8N / mm 2 or more. If it is more than the said minimum, durability of the semiconductor package 102 will improve more reliably. This is because high adhesion is maintained even when the temperature of the semiconductor package 102 rises due to use in a high temperature environment or heat generation in circuit operation.

さらに、半導体パッケージ102において、S/Sは0.1以上であることが好ましく、0.2以上であることがより好ましい。また、S/Sは0.9以下とすることができる。S/Sが上記下限以上であれば、半導体パッケージ102の耐久性がより確実に向上する。高温下での密着性の低下が効果的に抑制されるからである。
各温度におけるソルダーレジスト層10と封止樹脂40との間のせん断強度はたとえばせん断強度測定装置(DAGE社製、PC2400)を用いて測定することができる。
Furthermore, in the semiconductor package 102, S 2 / S 1 is preferably 0.1 or more, and more preferably 0.2 or more. Further, S 2 / S 1 can be set to 0.9 or less. When S 2 / S 1 is equal to or greater than the above lower limit, the durability of the semiconductor package 102 is more reliably improved. This is because a decrease in adhesion at high temperatures is effectively suppressed.
The shear strength between the solder resist layer 10 and the sealing resin 40 at each temperature can be measured using, for example, a shear strength measuring device (PC2400, manufactured by DAGE).

<電子装置>
図3は、本実施形態に係る電子装置の構造の一例を模式的に示す断面図である。
本実施形態に係る電子装置70は、上述した半導体パッケージ102を備える。
<Electronic device>
FIG. 3 is a cross-sectional view schematically showing an example of the structure of the electronic device according to the present embodiment.
The electronic device 70 according to this embodiment includes the semiconductor package 102 described above.

電子装置70では、配線基板であるマザーボード710上に少なくとも1つの半導体パッケージ102が配設されている。マザーボード710は、上述した配線基板20であっても良いし、異なる配線基板であっても良い。半導体パッケージ102は、上述した配線基板20を含む半導体パッケージ102である。マザーボード710上には、半導体パッケージ102に加えてコネクタ、抵抗、容量などの必要な電子部品720が1つ以上配設されていても良い。   In the electronic device 70, at least one semiconductor package 102 is disposed on a mother board 710 that is a wiring board. The motherboard 710 may be the wiring board 20 described above, or may be a different wiring board. The semiconductor package 102 is a semiconductor package 102 including the wiring board 20 described above. On the motherboard 710, in addition to the semiconductor package 102, one or more necessary electronic components 720 such as a connector, a resistor, and a capacitor may be disposed.

マザーボード710上に配設された半導体パッケージ102や、その他の電子部品720などは、ハンダバンプ30によって、マザーボード710の導電体パターン712のうち露出した導電部714に接続されている。半導体パッケージ102や電子部品720はマザーボード710に設けられた導電パターン712(配線)により互いに接続され、電子回路を構成する。   The semiconductor package 102 disposed on the motherboard 710, other electronic components 720, and the like are connected to the exposed conductive portions 714 in the conductor pattern 712 of the motherboard 710 by solder bumps 30. The semiconductor package 102 and the electronic component 720 are connected to each other by a conductive pattern 712 (wiring) provided on the mother board 710 to constitute an electronic circuit.

<配線基板の製造方法>
本実施形態に係る配線基板20の製造方法は、少なくとも一方の面上に導電パターン24が設けられたコア基板22を準備し、上記導電パターン24を覆うようにコア基板22の最外層に対してソルダーレジスト層10を設けた構造体1000を準備する工程と、ソルダーレジスト層10を貫通して、コア基板22の上記一方の面の一部と、導電パターン24の一部とが露出する開口部28を形成する工程と、をこの順に含む。また、上記開口部28を形成する工程は、ソルダーレジスト層10のうち、開口部28を形成する領域にブラスト処理を行うことによって開口を形成する工程を含む。さらに、前述したように、コア基板22の少なくとも第2の領域(本実施形態では、コア基板22の最外層)のブラスト処理に対するエッチング耐性が、ソルダーレジスト層10のブラスト処理に対するエッチング耐性より高いことを特徴としている。
<Manufacturing method of wiring board>
In the method for manufacturing the wiring board 20 according to the present embodiment, a core substrate 22 having a conductive pattern 24 provided on at least one surface is prepared, and the outermost layer of the core substrate 22 is covered so as to cover the conductive pattern 24. A step of preparing the structure 1000 provided with the solder resist layer 10 and an opening through which the part of the one surface of the core substrate 22 and a part of the conductive pattern 24 are exposed through the solder resist layer 10. And 28, in this order. Further, the step of forming the opening 28 includes a step of forming an opening by performing a blasting process on a region of the solder resist layer 10 where the opening 28 is to be formed. Furthermore, as described above, the etching resistance of the at least second region of the core substrate 22 (in this embodiment, the outermost layer of the core substrate 22) with respect to the blasting process is higher than the etching resistance of the solder resist layer 10 with respect to the blasting process. It is characterized by.

また、上述したエッチング耐性をソルダーレジスト層10とコア基板22の最外層に対して同一条件でブラスト処理を実施した場合におけるエッチング速度で示す場合、ソルダーレジスト層10に対するエッチング速度が、コア基板22の最外層に対するエッチング速度より速い。こうすることで、配線基板20を構成する全ての開口部28においてコア基板22を確実に露出させるため、開口部形成時にオーバーエッチングした場合であっても、全ての開口部28において導電パターン24やコア基板22の表面に対するエッチングダメージをより確実に抑制することができる。それ故、かかる構成を採用した配線基板20を用いた場合、耐久性および接続信頼性に優れた半導体パッケージを歩留りよく作製することが可能である。   In addition, when the etching resistance described above is indicated by the etching rate when the blast treatment is performed on the outermost layer of the solder resist layer 10 and the core substrate 22 under the same conditions, the etching rate with respect to the solder resist layer 10 is It is faster than the etching rate for the outermost layer. In this way, the core substrate 22 is surely exposed in all the openings 28 constituting the wiring board 20, so that the conductive patterns 24 and Etching damage to the surface of the core substrate 22 can be more reliably suppressed. Therefore, when the wiring board 20 adopting such a configuration is used, it is possible to manufacture a semiconductor package excellent in durability and connection reliability with a high yield.

同様に、上述したエッチング耐性をソルダーレジスト層10とコア基板22の最外層に対して同一条件でマイクロブラスト処理を実施した場合における表面加工量で示す場合、ソルダーレジスト層10の表面加工量をX1とし、コア基板の最外層の表面加工量をX2としたとき、X1>X2となる。   Similarly, when the etching resistance described above is indicated by the surface processing amount when the microblast treatment is performed on the outermost layer of the solder resist layer 10 and the core substrate 22 under the same conditions, the surface processing amount of the solder resist layer 10 is represented by X1. When the surface processing amount of the outermost layer of the core substrate is X2, X1> X2.

図4は、本実施形態に係る配線基板の製造方法の流れの一例を示すフローチャートである。図5および6は、本実施形態に係る配線基板の製造方法の一例を示す模式図である。
図4に示すように、本実施形態に係る配線基板20の製造方法は、上述した本実施形態の構造体1000を準備する工程(S102)と、ソルダーレジスト層10に開口部28を形成する工程(S104)とをこの順に含む。
FIG. 4 is a flowchart showing an example of the flow of the manufacturing method of the wiring board according to the present embodiment. 5 and 6 are schematic views showing an example of a method for manufacturing a wiring board according to the present embodiment.
As shown in FIG. 4, the method for manufacturing the wiring board 20 according to the present embodiment includes the step of preparing the structure 1000 according to the present embodiment (S102) and the step of forming the opening 28 in the solder resist layer 10. (S104) are included in this order.

構造体1000を準備する工程(S102)では、少なくとも一方の面上に導電パターン24が設けられたコア基板22と、上記導電パターン24を覆うようにコア基板22の上記一方の面上に設けられたソルダーレジスト層10とを有する構造体1000を準備する。なお、かかる構造体1000は、ソルダーレジスト層10が構造体1000の最外層に積層されている(図5(b)参照)。   In the step of preparing the structure 1000 (S102), the core substrate 22 provided with the conductive pattern 24 on at least one surface and the one surface of the core substrate 22 so as to cover the conductive pattern 24 are provided. A structure 1000 having the solder resist layer 10 is prepared. In this structure 1000, the solder resist layer 10 is laminated on the outermost layer of the structure 1000 (see FIG. 5B).

ソルダーレジスト層10に開口部28を形成する工程(S104)では、導電パターン24の一部を露出させる開口部28を形成する。また、ソルダーレジスト層10の所定の領域に開口部28を形成する工程(S104)は、ソルダーレジスト層10のうち、開口部28とする所定の領域に開口を形成する工程を含む。また、ソルダーレジスト層10の所定の領域に開口部28を形成する工程(S104)において、ソルダーレジスト層は、硬化状態であることが好ましいが、半硬化状態であってもよい。上記工程(S104)においてソルダーレジスト層が半硬化状態である場合、開口部28を形成した後工程において、当該半硬化状態にあるソルダーレジスト層を完全硬化させるためのポストキュア工程を有する。   In the step of forming the opening 28 in the solder resist layer 10 (S104), the opening 28 that exposes a part of the conductive pattern 24 is formed. Further, the step (S104) of forming the opening 28 in a predetermined region of the solder resist layer 10 includes a step of forming an opening in a predetermined region of the solder resist layer 10 as the opening 28. In the step of forming the opening 28 in a predetermined region of the solder resist layer 10 (S104), the solder resist layer is preferably in a cured state, but may be in a semi-cured state. When the solder resist layer is in a semi-cured state in the above step (S104), a post-cure process for completely curing the solder resist layer in the semi-cured state is provided in a step after forming the opening 28.

さらに、本実施形態に係る製造方法によれば、図6(a)に示すように複数の開口部28を形成する。本実施形態に係る製造方法によれば、開口形状や開口の深さにバラつきなく複数の開口部28を形成することができる。   Furthermore, according to the manufacturing method according to the present embodiment, a plurality of openings 28 are formed as shown in FIG. According to the manufacturing method according to the present embodiment, the plurality of openings 28 can be formed without variation in the opening shape and the opening depth.

ここで、本実施形態に係る配線基板20の製造方法において、開口部28の形成方法として、ブラスト法を用いる。そのため、開口部28の深さを高度に制御することが可能である。このようにして開口部28の深さを高度に制御した場合には、ソルダーレジスト層10の導電パターン24の側方に存在する部分を除去することなく残すことができる。言い換えれば、開口部28の深さを高度に制御することによって、導電パターン24の側面に接するようにソルダーレジスト層10を残存させることができる。これにより、微細回路を露出させることなく開口部28を形成することができる。そのため、配線基板20や半導体パッケージ102を製造する際に衝撃が加わった場合においても、微細回路が基板22から剥離することのない高い密着性を実現することができる。   Here, in the method for manufacturing the wiring board 20 according to the present embodiment, a blast method is used as a method for forming the opening 28. For this reason, the depth of the opening 28 can be controlled to a high degree. In this way, when the depth of the opening 28 is highly controlled, it is possible to leave the portion of the solder resist layer 10 present on the side of the conductive pattern 24 without removing it. In other words, the solder resist layer 10 can be left in contact with the side surface of the conductive pattern 24 by highly controlling the depth of the opening 28. Thereby, the opening 28 can be formed without exposing the fine circuit. Therefore, even when an impact is applied when the wiring substrate 20 or the semiconductor package 102 is manufactured, high adhesion without causing the fine circuit to peel from the substrate 22 can be realized.

以下、図4〜図6を参照して、本実施形態に係る配線基板20の製造方法について詳細に説明する。   Hereinafter, with reference to FIGS. 4 to 6, the method for manufacturing the wiring board 20 according to the present embodiment will be described in detail.

まず、構造体1000を準備する工程(S102)では、表裏の少なくとも一方の面(最外面)上に導電パターン24が設けられたコア基板22を準備する。図5(a)に示すように、本実施形態では、コア基板22の両面に導電パターン24が形成された両面板を使用している。   First, in the step of preparing the structure 1000 (S102), the core substrate 22 provided with the conductive pattern 24 on at least one surface (outermost surface) of the front and back is prepared. As shown in FIG. 5A, in the present embodiment, a double-sided plate in which conductive patterns 24 are formed on both sides of the core substrate 22 is used.

次に、図5(b)のように、コア基板22の導電パターン24を覆うように、導電パターン24上にソルダーレジスト層10を形成(積層)する。具体的には、コア基板22の導電パターン24が設けられた最も外側に位置する面上に、ワニス状の熱硬化性樹脂組成物(P)(ソルダーレジスト)を塗布する。その後、塗布したソルダーレジストを乾燥させて、ソルダーレジスト層10を形成する。以上のようにして、本実施形態に係る製造方法においては、構造体1000を作製する。ソルダーレジスト層10の膜厚は、とくに限定されないが、たとえば5μm以上300μm以下とすることができる。   Next, as shown in FIG. 5B, the solder resist layer 10 is formed (laminated) on the conductive pattern 24 so as to cover the conductive pattern 24 of the core substrate 22. Specifically, a varnish-like thermosetting resin composition (P) (solder resist) is applied on the outermost surface provided with the conductive pattern 24 of the core substrate 22. Thereafter, the applied solder resist is dried to form the solder resist layer 10. As described above, the structure 1000 is manufactured in the manufacturing method according to the present embodiment. Although the film thickness of the soldering resist layer 10 is not specifically limited, For example, it can be set as 5 micrometers or more and 300 micrometers or less.

次いで、図6(a)に示すように、ソルダーレジスト層10の所定の領域に導電パターン24の一部を露出させる開口部28を形成する(S104)。具体的には、ソルダーレジスト層10の所定の領域に導電パターン24のランド244を露出させるように開口部28を形成する。本実施形態に係る製造方法によれば、この開口部28を形成する際に、ソルダーレジスト層10における開口部28を形成すべき所定の領域に対してブラスト処理(サンドブラスト処理、ウェットブラスト処理等)を行う。これにより、アンダーエッチングが発生することなく、均一にソルダーレジスト層10を短時間で効率よく除去することができる。また、ブラスト法を用いて開口部28を形成することにより、後工程において導電パターン24上にハンダバンプ30やボンディングワイヤ50を接続させる際に、導電パターン24とハンダバンプ30やボンディングワイヤ50との接続関係を強固にすることができる。この場合、配線基板20や半導体パッケージ102を製造する際に衝撃が加わった場合においても、微細回路が基板22から剥離することのない高い密着性を実現することができる。   Next, as shown in FIG. 6A, an opening 28 for exposing a part of the conductive pattern 24 is formed in a predetermined region of the solder resist layer 10 (S104). Specifically, the opening 28 is formed in a predetermined region of the solder resist layer 10 so as to expose the land 244 of the conductive pattern 24. According to the manufacturing method according to the present embodiment, when the opening 28 is formed, a blasting process (sand blasting process, wet blasting process, etc.) is performed on a predetermined region in the solder resist layer 10 where the opening 28 is to be formed. I do. Thereby, the solder resist layer 10 can be uniformly and efficiently removed in a short time without under-etching. In addition, by forming the opening 28 using the blast method, when the solder bump 30 or the bonding wire 50 is connected on the conductive pattern 24 in a later process, the connection relationship between the conductive pattern 24 and the solder bump 30 or the bonding wire 50 is achieved. Can be strengthened. In this case, even when an impact is applied when the wiring substrate 20 or the semiconductor package 102 is manufactured, high adhesion without causing the fine circuit to peel from the substrate 22 can be realized.

次いで、デスミア処理する工程(S106)では、開口部28の形成などで生じたスミアを除去する。具体的には、ソルダーレジスト層10の開口部28を規定する側壁部分と導電パターン24の上面部分(開口部28に露出する部分)に付着したスミアを除去する。
デスミア処理の方法は特に限定されないが、たとえば、以下のように行うことができる。まず、導電体パターン24やソルダーレジスト層10を積層したコア基板22を有機溶剤を含む膨潤液に浸漬する。次いで、アルカリ性過マンガン酸塩水溶液に浸漬して処理する。
Next, in the step of desmearing (S106), smear generated due to the formation of the opening 28 is removed. Specifically, the smear attached to the side wall portion defining the opening portion 28 of the solder resist layer 10 and the upper surface portion (portion exposed to the opening portion 28) of the conductive pattern 24 is removed.
The method of the desmear treatment is not particularly limited, and can be performed as follows, for example. First, the core substrate 22 on which the conductor pattern 24 and the solder resist layer 10 are laminated is immersed in a swelling liquid containing an organic solvent. Then, it is treated by immersing in an alkaline permanganate aqueous solution.

過マンガン酸塩としてはたとえば過マンガン酸カリウム、過マンガン酸ナトリウム等を用いることができる。過マンガン酸塩として過マンガン酸カリウムを用いる場合、浸漬させる過マンガン酸カリウム水溶液の温度は、50℃以上であることが好ましく、100℃以下であることが好ましい。上記上限値以下であり、且つ上記下限値以上であれば、ソルダーレジスト層10と封止樹脂40との密着性をより確実に向上させることができる。また、アルカリ性過マンガン酸塩水溶液への浸漬時間は1分間以上であることが好ましく、30分間以下であることが好ましい。上記上限値以下であり、かつ上記下限値以上であれば、ソルダーレジスト層10と封止樹脂40との密着性をより確実に向上させることができる。また、耐久性と液状封止樹脂のパターニング精度との性能バランスの良い配線基板20を得られる。   As the permanganate, for example, potassium permanganate, sodium permanganate and the like can be used. When using potassium permanganate as the permanganate, the temperature of the potassium permanganate aqueous solution to be immersed is preferably 50 ° C. or higher, and preferably 100 ° C. or lower. If it is below the said upper limit and is more than the said lower limit, the adhesiveness of the soldering resist layer 10 and the sealing resin 40 can be improved more reliably. Further, the immersion time in the alkaline permanganate aqueous solution is preferably 1 minute or more, and preferably 30 minutes or less. If it is below the said upper limit and is more than the said lower limit, the adhesiveness of the soldering resist layer 10 and the sealing resin 40 can be improved more reliably. Further, it is possible to obtain the wiring substrate 20 having a good performance balance between the durability and the patterning accuracy of the liquid sealing resin.

デスミア処理する工程では、上記の湿式のデスミア処理のみを行うことができるが、上記の湿式の処理に代えて、もしくは加えて、デスミア処理としてプラズマ照射を行っても良い。このとき、処理ガスとしてはたとえばアルゴンガス、Oガス、Oガス、COガス、COガス、NOガス、NOガス、またはフッ素系ガスを用いることができる。プラズマ処理時間は30秒以上であることが好ましく、1分以上であることがより好ましい。一方、当該時間は10分以下であることが好ましく、5分以下であることがより好ましい。プラズマ処理時間が上記下限値以上であり、かつ上記上限値以下であれば、スミアを効率的に除去できる。また、上記処理条件を採用することにより、半導体パッケージの封止材との密着性も向上させることができる。In the desmear process, only the above-described wet desmear process can be performed. However, instead of or in addition to the above-described wet process, plasma irradiation may be performed as a desmear process. At this time, for example, argon gas, O 2 gas, O 3 gas, CO gas, CO 2 gas, NO gas, NO 2 gas, or fluorine-based gas can be used as the processing gas. The plasma treatment time is preferably 30 seconds or longer, more preferably 1 minute or longer. On the other hand, the time is preferably 10 minutes or less, and more preferably 5 minutes or less. If the plasma treatment time is not less than the above lower limit and not more than the above upper limit, smear can be efficiently removed. Further, by adopting the above processing conditions, it is possible to improve the adhesion of the semiconductor package to the sealing material.

次いで、図6(b)に示すように露出した導電パターン24の表面にめっき膜246を形成する。具体的には、開口部28に露出した導電パターン24の導電部を覆うようにめっき膜246を形成する。
めっき膜246は、たとえば半田めっき膜、錫めっき膜、またはニッケルめっき膜の上に金めっき膜を積層した2層構造のめっき膜、さらには無電解めっきにより形成したアンダーバンプメタル(UBM)膜とすることができる。
また、めっき膜246の膜厚は、とくに限定されないが、たとえば2μm以上10μm以下とすることができる。これにより、ランド244部分を、配線基板20を用いた実装工程においてワイヤボンディングや半田付けに適した接続部とすることができる。
Next, a plating film 246 is formed on the exposed surface of the conductive pattern 24 as shown in FIG. Specifically, the plating film 246 is formed so as to cover the conductive portion of the conductive pattern 24 exposed in the opening 28.
The plating film 246 includes, for example, a solder plating film, a tin plating film, a two-layer plating film in which a gold plating film is laminated on a nickel plating film, and an under bump metal (UBM) film formed by electroless plating. can do.
Moreover, the film thickness of the plating film 246 is not particularly limited, but may be, for example, 2 μm or more and 10 μm or less. Thereby, the land 244 portion can be a connection portion suitable for wire bonding or soldering in a mounting process using the wiring board 20.

めっき処理の方法は、特に限定されないが、たとえば、電解めっき法または無電解めっき法を用いることができる。無電解めっき法を用いる場合、次のようにめっき膜246を形成することが出来る。なお、ここではニッケルめっき膜と金めっき膜の2層からなるめっき膜246を形成する例について説明するが、これに限定されない。
まず、ニッケルめっき膜を形成する。無電解ニッケルめっきを行う場合、めっき液に開口部28を設けた構造体1000を浸漬する。このことで、開口部28に露出した導電パターン24の導電部の上に、ニッケルめっき膜を形成できる。
このようなめっき液としては、ニッケル鉛、および還元剤としてたとえば次亜リン酸塩を含んだめっき液を用いることができる。続いて、ニッケルめっき膜の上に無電解金めっきを行う。無電解金めっきの方法は特に限定されないが、たとえば金イオンと下地金属のイオンとの置換により行う置換金めっきで行うことができる。
The method for the plating treatment is not particularly limited, and for example, an electrolytic plating method or an electroless plating method can be used. When the electroless plating method is used, the plating film 246 can be formed as follows. In addition, although the example which forms the plating film 246 which consists of two layers, a nickel plating film and a gold plating film, is demonstrated here, it is not limited to this.
First, a nickel plating film is formed. When performing electroless nickel plating, the structure 1000 provided with the opening 28 in the plating solution is immersed. Thus, a nickel plating film can be formed on the conductive portion of the conductive pattern 24 exposed at the opening 28.
As such a plating solution, nickel lead and a plating solution containing hypophosphite as a reducing agent can be used. Subsequently, electroless gold plating is performed on the nickel plating film. Although the method of electroless gold plating is not particularly limited, for example, it can be performed by substitution gold plating performed by substitution of gold ions and ions of a base metal.

次いで、ソルダーレジスト層10およびめっき膜246の表面をプラズマ処理する。プラズマ処理では、たとえば処理ガスとして、アルゴンガス、酸化性ガス、またはフッ素系ガスを用いることができる。酸化性ガスとしてはOガス、Oガス、COガス、COガス、NOガス、NOガスなどを用いることができる。本実施形態におけるプラズマ処理の条件は特に限定されないが、アッシング処理のほか、不活性ガス由来のプラズマに接触させる処理であってもよい。なお、ソルダーレジスト層10のエッチングを伴うプラズマ処理でないことが好ましい。ここで、エッチングを伴うプラズマ処理とは、処理対象にバイアス電圧を印加し、かつエッチングガスを処理ガスとして用いるプラズマ処理をいう。つまり、本実施形態に係るプラズマ処理は、処理対象にバイアス電圧を印加せずに行うプラズマ処理、または非反応性ガスを用いて行うプラズマ処理であることが好ましい。Next, the surfaces of the solder resist layer 10 and the plating film 246 are subjected to plasma treatment. In the plasma processing, for example, argon gas, oxidizing gas, or fluorine-based gas can be used as the processing gas. As the oxidizing gas, O 2 gas, O 3 gas, CO gas, CO 2 gas, NO gas, NO 2 gas, or the like can be used. The conditions for the plasma treatment in the present embodiment are not particularly limited, but may be a treatment in contact with plasma derived from an inert gas in addition to the ashing treatment. In addition, it is preferable that it is not a plasma process with the etching of the soldering resist layer 10. FIG. Here, plasma treatment with etching refers to plasma treatment in which a bias voltage is applied to a treatment target and an etching gas is used as a treatment gas. That is, the plasma processing according to the present embodiment is preferably a plasma processing performed without applying a bias voltage to the processing target or a plasma processing performed using a non-reactive gas.

なお、処理対象にバイアス電圧を印加しない構成とは、本実施形態において、基板22の導電パターン24およびめっき膜246のいずれにもバイアス電圧を印加しない構成である。また、プラズマ処理中に基板22を固定するプラズマ処理装置の試料台等にもバイアス電圧を印加しない。なお、ソルダーレジスト層10に含まれる無機充填材120(図7参照)の露出度を上げることのない程度に、プラズマ処理によってわずかにソルダーレジスト層10の表面が削られても良い。プラズマ処理時間は30秒以上であることが好ましく、1分以上であることがより好ましい。一方、当該時間は10分以下であることが好ましく、5分以下であることがより好ましい。プラズマ処理時間が、上記下限値以上であり、かつ上記上限値以下であれば、パッケージの耐久性をより確実に向上させることができる。   In the present embodiment, the configuration in which no bias voltage is applied to the processing target is a configuration in which no bias voltage is applied to either the conductive pattern 24 or the plating film 246 of the substrate 22. Further, a bias voltage is not applied to a sample stage of a plasma processing apparatus for fixing the substrate 22 during the plasma processing. Note that the surface of the solder resist layer 10 may be slightly shaved by plasma treatment to the extent that the degree of exposure of the inorganic filler 120 (see FIG. 7) contained in the solder resist layer 10 is not increased. The plasma treatment time is preferably 30 seconds or longer, more preferably 1 minute or longer. On the other hand, the time is preferably 10 minutes or less, and more preferably 5 minutes or less. If the plasma treatment time is not less than the lower limit and not more than the upper limit, the durability of the package can be improved more reliably.

本実施形態に係る製造方法においては、以上のようにして配線基板20を作製する。   In the manufacturing method according to the present embodiment, the wiring board 20 is manufactured as described above.

また、本実施形態に係る配線基板20のソルダーレジスト層10の表面では、図7に示すように、少なくともひとつの無機充填材120の、一部分がソルダーレジスト層10に埋設され、他部分がソルダーレジスト層10の表面(図7中、上面)から突出していることが好ましい。
また、製造した配線基板20のソルダーレジスト層10の表面には、無機充填材120が離脱して形成されたクレーター状の凹部110が形成されていることが好ましい。
また、製造した配線基板20のソルダーレジスト層10の表面には、上記の無機充填材120の一部がソルダーレジスト層10の表面から突出することにより形成された突出部と、凹部110とのいずれか一方のみが存在しても良いが、上記突出部と、凹部110がいずれも存在することがより好ましい。このようなソルダーレジスト層10の表面形態とすることで、耐久性に優れるパッケージを製造できる配線基板20をより確実に実現できる。
In addition, on the surface of the solder resist layer 10 of the wiring board 20 according to the present embodiment, as shown in FIG. 7, a part of at least one inorganic filler 120 is embedded in the solder resist layer 10 and the other part is a solder resist. It is preferable to protrude from the surface of the layer 10 (the upper surface in FIG. 7).
Moreover, it is preferable that the surface of the solder resist layer 10 of the manufactured wiring board 20 is formed with a crater-shaped recess 110 formed by separating the inorganic filler 120.
In addition, on the surface of the solder resist layer 10 of the manufactured wiring board 20, any one of the protrusions formed by protruding a part of the inorganic filler 120 from the surface of the solder resist layer 10 and the recesses 110. Although only one of them may be present, it is more preferable that both the protruding portion and the concave portion 110 exist. By setting it as the surface form of such a soldering resist layer 10, the wiring board 20 which can manufacture the package excellent in durability can be implement | achieved more reliably.

上述の無機充填材120の含有条件、デスミア処理の条件、めっき処理の条件、プラズマ処理の条件などを複合的に適宜調整することにより、ソルダーレジスト層10の表面を上記のような形態にすることができる。なお、無機充填材120の詳細については、後述する。   The surface of the solder resist layer 10 is made to have the above-mentioned form by appropriately adjusting the inclusion condition of the inorganic filler 120, the desmear treatment condition, the plating treatment condition, the plasma treatment condition, and the like appropriately. Can do. Details of the inorganic filler 120 will be described later.

<半導体パッケージの製造方法>
以下、本実施形態に係る半導体パッケージ102の製造方法について、詳細に説明する。本実施形態に係る製造方法においては、まず、上述した配線基板20の製造方法と同様にして、配線基板20を準備する。
<Semiconductor package manufacturing method>
Hereinafter, a method for manufacturing the semiconductor package 102 according to the present embodiment will be described in detail. In the manufacturing method according to the present embodiment, first, the wiring board 20 is prepared in the same manner as the above-described manufacturing method of the wiring board 20.

次いで、準備した配線基板20のソルダーレジスト層10の上に、半導体素子60を配設する。このとき、たとえばダイアタッチ材62を介して半導体素子60を配線基板20上に搭載する。半導体素子60と配線基板20を接続するボンディングワイヤ50は、たとえば配線基板20の上面の開口部28に露出した導電パターン24へボンディングする。次いで、封止する工程では、配線基板20の上面、半導体素子60、およびボンディングワイヤ50を封止樹脂40によって封止する。封止樹脂40としては、たとえばエポキシ樹脂組成物を用いることができる。封止樹脂40で配線基板20等をモールド(封止)する方法としては、トランスファー成形法、射出成形法、転写法、塗布法などを用いることができる。封止樹脂40の硬化は、たとえば150℃以上200℃以下で加熱することにより行われる。   Next, the semiconductor element 60 is disposed on the solder resist layer 10 of the prepared wiring board 20. At this time, for example, the semiconductor element 60 is mounted on the wiring board 20 via the die attach material 62. The bonding wire 50 that connects the semiconductor element 60 and the wiring board 20 is bonded to the conductive pattern 24 exposed in the opening 28 on the upper surface of the wiring board 20, for example. Next, in the sealing step, the upper surface of the wiring substrate 20, the semiconductor element 60, and the bonding wire 50 are sealed with a sealing resin 40. As the sealing resin 40, for example, an epoxy resin composition can be used. As a method of molding (sealing) the wiring substrate 20 or the like with the sealing resin 40, a transfer molding method, an injection molding method, a transfer method, a coating method, or the like can be used. Curing of the sealing resin 40 is performed, for example, by heating at 150 ° C. or higher and 200 ° C. or lower.

また、配線基板20に外部接続端子であるハンダバンプ30が設けられる例においては、たとえば、配線基板20の下面側の開口部28に露出した導電パターン24上に、ハンダバンプ30を形成する。なお、本実施形態に係る半導体パッケージ102としてワイヤボンディングされたパッケージの例について説明したが、半導体パッケージ102はこれに限定されず、フリップチップ接続やTAB接続されるパッケージでもよい。   In the example in which the solder bumps 30 that are external connection terminals are provided on the wiring board 20, for example, the solder bumps 30 are formed on the conductive pattern 24 exposed in the opening 28 on the lower surface side of the wiring board 20. Although an example of a wire bonded package has been described as the semiconductor package 102 according to this embodiment, the semiconductor package 102 is not limited to this, and may be a flip-chip connection or a TAB connection package.

<電子装置の製造方法>
図3に例示した電子装置70は上述のように得られた半導体パッケージ102をマザーボード710上にその他の電子部品720と共に実装することで得られる。
半導体パッケージ102および電子部品720は接続部716やハンダバンプ30などの接続端子をそれぞれ1つ以上有し、接続端子において、マザーボード710の導電パターン712のうち露出した導電部714に電気的に接続される。接続端子と導電部714との接続は、たとえば次の様に行うことができる。
まず、マザーボード710の露出した導電部714の必要箇所に、半田ペーストを印刷する。ここで、半導体パッケージ102がハンダバンプ30を有する場合は、ハンダバンプ30を接続する導電部714には半田ペーストの印刷は不要である。
次いで、マザーボード710上の所定の位置に電子部品720および半導体パッケージ102を配置する。
その後、半導体パッケージ102や電子部品720を載せたマザーボード710をリフロー炉に導入し、リフロー処理(加熱処理)する。リフロー処理により印刷された半田ペーストやハンダバンプ30が溶かされ、その後冷却することで、半導体パッケージ102および電子部品720がそれぞれマザーボード710に半田づけされる。
<Method for Manufacturing Electronic Device>
The electronic device 70 illustrated in FIG. 3 is obtained by mounting the semiconductor package 102 obtained as described above on the mother board 710 together with other electronic components 720.
The semiconductor package 102 and the electronic component 720 each have one or more connection terminals such as a connection portion 716 and a solder bump 30, and the connection terminals are electrically connected to the exposed conductive portion 714 in the conductive pattern 712 of the motherboard 710. . The connection between the connection terminal and the conductive portion 714 can be performed as follows, for example.
First, a solder paste is printed on a necessary portion of the exposed conductive portion 714 of the motherboard 710. Here, when the semiconductor package 102 has the solder bumps 30, it is not necessary to print solder paste on the conductive portions 714 that connect the solder bumps 30.
Next, the electronic component 720 and the semiconductor package 102 are arranged at predetermined positions on the mother board 710.
Thereafter, the motherboard 710 on which the semiconductor package 102 and the electronic component 720 are mounted is introduced into a reflow furnace, and reflow processing (heating processing) is performed. The solder paste and solder bumps 30 printed by the reflow process are melted and then cooled, whereby the semiconductor package 102 and the electronic component 720 are respectively soldered to the mother board 710.

本実施形態に係る電子装置70の製造方法は、加熱処理工程を含む。加熱処理はたとえばリフロー処理である。たとえば、半導体パッケージ102がワイヤボンディングでマザーボード710に接続されるパッケージである場合にも、電子部品720を表面実装するために加熱処理を行うことができる。よって、加熱処理を経た後においても、ソルダーレジスト層10と封止樹脂40の間の接合強度が十分高ければ、より確実にパッケージの耐久性を向上させることができる。   The method for manufacturing the electronic device 70 according to the present embodiment includes a heat treatment process. The heat treatment is, for example, a reflow process. For example, when the semiconductor package 102 is a package connected to the motherboard 710 by wire bonding, heat treatment can be performed to surface-mount the electronic component 720. Therefore, even after the heat treatment, if the bonding strength between the solder resist layer 10 and the sealing resin 40 is sufficiently high, the durability of the package can be improved more reliably.

また、電子装置70は高湿度下で使用されることがある。その様な場合にも、ソルダーレジスト層10と封止樹脂40の間の接合強度が十分高ければ、より確実にパッケージの耐久性を向上させることができる。   Also, the electronic device 70 may be used under high humidity. Even in such a case, if the bonding strength between the solder resist layer 10 and the sealing resin 40 is sufficiently high, the durability of the package can be improved more reliably.

そして、電子装置70に含まれる半導体パッケージ102が優れた耐久性および優れた耐湿性を有することにより、信頼性の高い電子装置70を得ることができる。なお、電子装置70はさらに封止樹脂で一括封止してもよい。マザーボード710が、上述した配線基板20であって、電子装置70が一括封止されている場合、電子装置70をパッケージとして製造することもできる。   In addition, since the semiconductor package 102 included in the electronic device 70 has excellent durability and excellent moisture resistance, the highly reliable electronic device 70 can be obtained. The electronic device 70 may be further collectively sealed with a sealing resin. When the motherboard 710 is the wiring substrate 20 described above and the electronic device 70 is collectively sealed, the electronic device 70 can be manufactured as a package.

本実施形態に係る製造方法によれば、アンダーエッチングが発生することなく、ソルダーレジスト層10を、短時間で、効率よく、均一に除去することができる。そのため、本実施形態に係る製造方法によれば、特許文献1に記載の従来の製造プロセスと比べて、接続信頼性に優れた半導体パッケージ102を歩留まり良く得ることができる。   According to the manufacturing method according to the present embodiment, the solder resist layer 10 can be efficiently and uniformly removed in a short time without under-etching. Therefore, according to the manufacturing method according to the present embodiment, the semiconductor package 102 having excellent connection reliability can be obtained with a high yield as compared with the conventional manufacturing process described in Patent Document 1.

以下、本実施形態に係る配線基板20のコア基板22の最外層を形成する樹脂材料と、ソルダーレジスト層10を形成する樹脂材料について説明する。   Hereinafter, the resin material that forms the outermost layer of the core substrate 22 of the wiring board 20 according to the present embodiment and the resin material that forms the solder resist layer 10 will be described.

<コア基板22の最外層を形成する樹脂材料>
本実施形態に係るコア基板22の最外層を形成する樹脂材料としては、たとえば、以下のような熱硬化性樹脂組成物(X)を用いることができる。
<Resin Material Forming Outermost Layer of Core Substrate 22>
As a resin material forming the outermost layer of the core substrate 22 according to the present embodiment, for example, the following thermosetting resin composition (X) can be used.

熱硬化性樹脂組成物(X)は、エポキシ樹脂と、ナフトール樹脂と、無機充填材と、を含んでいることが好ましい。   The thermosetting resin composition (X) preferably contains an epoxy resin, a naphthol resin, and an inorganic filler.

熱硬化性樹脂組成物(X)は、上述した通り、必須成分としてエポキシ樹脂を含んでいることが好ましい。かかるエポキシ樹脂としては、例えば、ビスフェノールA型エポキシ樹脂、ビスフェノールF型エポキシ樹脂、ビスフェノールS型エポキシ樹脂、ビスフェノールAF型エポキシ樹脂等のビスフェノール型エポキシ樹脂;フェノールノボラック型エポキシ樹脂;tert-ブチル-カテコール型エポキシ樹脂;ナフトール型エポキシ樹脂、2官能ナフタレン型エポキシ樹脂、4官能ナフタレン型エポキシ樹脂、ナフチレンエーテル型エポキシ樹脂等のナフタレン型エポキシ樹脂;グリシジルアミン型エポキシ樹脂;クレゾールノボラック型エポキシ樹脂;ビフェニル型エポキシ樹脂;線状脂肪族エポキシ樹脂;ブタジエン構造を有するエポキシ樹脂;脂環式エポキシ樹脂;複素環式エポキシ樹脂;リン含有エポキシ樹脂;スピロ環含有エポキシ樹脂;シクロヘキサンジメタノール型エポキシ樹脂;トリメチロール型エポキシ樹脂;ハロゲン化エポキシ樹脂等が挙げられる。   As described above, the thermosetting resin composition (X) preferably contains an epoxy resin as an essential component. Examples of such epoxy resins include bisphenol type epoxy resins such as bisphenol A type epoxy resins, bisphenol F type epoxy resins, bisphenol S type epoxy resins, and bisphenol AF type epoxy resins; phenol novolac type epoxy resins; tert-butyl-catechol type Epoxy resin: Naphthol type epoxy resin, bifunctional naphthalene type epoxy resin, tetrafunctional naphthalene type epoxy resin, naphthylene ether type epoxy resin and other naphthalene type epoxy resins; glycidylamine type epoxy resin; cresol novolac type epoxy resin; biphenyl type epoxy Resin; Linear aliphatic epoxy resin; Epoxy resin having butadiene structure; Alicyclic epoxy resin; Heterocyclic epoxy resin; Phosphorus-containing epoxy resin; Spiro ring-containing epoxy Fats; cyclohexanedimethanol type epoxy resins; trimethylol type epoxy resins, halogenated epoxy resins.

上記エポキシ樹脂として、これらの中の1種類を単独で用いてもよいし、異なる重量平均分子量を有する2種類以上を併用してもよく、1種類または2種類以上とそれらのプレポリマーとを併用してもよい。   As the epoxy resin, one of these may be used alone, or two or more having different weight average molecular weights may be used in combination, or one or two or more and those prepolymers may be used in combination. May be.

上記エポキシ樹脂の中でも、半導体パッケージの耐久性および接続信頼性をより一層向上させる観点から、ビスフェノール型エポキシ樹脂、ナフタレン型エポキシ樹脂、アントラセン型エポキシ樹脂、ビフェニル型エポキシ樹脂、およびブタジエン構造を有するエポキシ樹脂からなる群から選択される一種または二種以上が好ましく、ビスフェノールF型エポキシ樹脂、ナフタレン型エポキシ樹脂、アントラセン型エポキシ樹脂、およびビフェニル型エポキシ樹脂からなる群から選択される一種または二種以上がより好ましい。   Among the above epoxy resins, bisphenol type epoxy resin, naphthalene type epoxy resin, anthracene type epoxy resin, biphenyl type epoxy resin, and epoxy resin having a butadiene structure from the viewpoint of further improving the durability and connection reliability of the semiconductor package One or two or more selected from the group consisting of bisphenol F type epoxy resin, naphthalene type epoxy resin, anthracene type epoxy resin, and biphenyl type epoxy resin are more preferable. preferable.

ビスフェノールA型エポキシ樹脂としては、三菱化学社製の「エピコート828EL」および「YL980」等を用いることができる。ビスフェノールF型エポキシ樹脂としては、三菱化学社製の「jER806H」および「YL983U」、DIC社製の「EPICLON 830S」等を用いることができる。2官能ナフタレン型エポキシ樹脂としては、DIC社製の「HP4032」、「HP4032D」および「HP4032SS」等を用いることができる。4官能ナフタレン型エポキシ樹脂としては、DIC社製の「HP4700」および「HP4710」等を用いることができる。ナフトール型エポキシ樹脂としては、新日鐵化学社製の「ESN−475V」、日本化薬社製の「NC7000L」等を用いることができる。ブタジエン構造を有するエポキシ樹脂としては、ダイセル化学工業社製の「PB−3600」等を用いることができる。ビフェニル型エポキシ樹脂としては、日本化薬社製の「NC3000」、「NC3000H」、「NC3000L」および「NC3100」、三菱化学社製の「YX4000」、「YX4000H」、「YX4000HK」および「YL6121」等を用いることができる。アントラセン型エポキシ樹脂としては、三菱化学社製の「YX8800」等を用いることができる。ナフチレンエーテル型エポキシ樹脂としては、DIC社製の「EXA−7310」、「EXA−7311」、「EXA−7311L」および「EXA7311−G3」等を用いることができる。   As the bisphenol A type epoxy resin, "Epicoat 828EL" and "YL980" manufactured by Mitsubishi Chemical Corporation can be used. As the bisphenol F type epoxy resin, “jER806H” and “YL983U” manufactured by Mitsubishi Chemical Corporation, “EPICLON 830S” manufactured by DIC Corporation, and the like can be used. As the bifunctional naphthalene type epoxy resin, “HP4032”, “HP4032D”, “HP4032SS” manufactured by DIC, and the like can be used. As the tetrafunctional naphthalene type epoxy resin, “HP4700” and “HP4710” manufactured by DIC, etc. can be used. As the naphthol type epoxy resin, “ESN-475V” manufactured by Nippon Steel Chemical Co., Ltd., “NC7000L” manufactured by Nippon Kayaku Co., Ltd. and the like can be used. As the epoxy resin having a butadiene structure, “PB-3600” manufactured by Daicel Chemical Industries, Ltd. can be used. Examples of the biphenyl type epoxy resin include “NC3000”, “NC3000H”, “NC3000L” and “NC3100” manufactured by Nippon Kayaku Co., Ltd., “YX4000”, “YX4000H”, “YX4000HK” and “YL6121” manufactured by Mitsubishi Chemical Corporation. Can be used. As the anthracene type epoxy resin, “YX8800” manufactured by Mitsubishi Chemical Corporation can be used. As the naphthylene ether type epoxy resin, “EXA-7310”, “EXA-7311”, “EXA-7311L”, “EXA7311-G3” and the like manufactured by DIC can be used.

上記エポキシ樹脂の含有量は、熱硬化性樹脂組成物(X)の全固形分(すなわち、溶媒を除く成分)を100質量%としたとき、10質量%以上が好ましく、20質量%以上がより好ましい。上記エポキシ樹脂の含有量が上記下限値以上であると、コア基板22形成時のハンドリング性が向上し、コア基板22を形成するのが容易となる。
また、上記エポキシ樹脂の含有量は、熱硬化性樹脂組成物(X)の全固形分を100質量%としたとき、55質量%以下が好ましく、40質量%以下がより好ましい。上記エポキシ樹脂の含有量が上記上限値以下であると、コア基板22の機械的強度、難燃性および低熱膨張性を向上させることができる。
The content of the epoxy resin is preferably 10% by mass or more, more preferably 20% by mass or more when the total solid content of the thermosetting resin composition (X) (that is, the component excluding the solvent) is 100% by mass. preferable. When the content of the epoxy resin is equal to or more than the lower limit value, handling properties at the time of forming the core substrate 22 are improved, and the core substrate 22 can be easily formed.
In addition, the content of the epoxy resin is preferably 55% by mass or less, and more preferably 40% by mass or less, when the total solid content of the thermosetting resin composition (X) is 100% by mass. When the content of the epoxy resin is not more than the above upper limit value, the mechanical strength, flame retardancy, and low thermal expansion of the core substrate 22 can be improved.

熱硬化性樹脂組成物(X)は、上述した通り、必須成分としてナフトール樹脂を含んでいることが好ましい。かかるナフトール樹脂はナフトール性水酸基を有し、かつ、上記エポキシ樹脂に対して硬化作用を有するエポキシ樹脂硬化剤である。上記ナフトール樹脂としては、例えば、ナフトールノボラック樹脂、ナフトールアラルキル型樹脂などが挙げられ、これらの1種又は2種以上組み合わせて使用してもよい。ナフトール樹脂は、半導体パッケージの反りをより一層低減できる観点から、ナフトールアラルキル型樹脂が好ましく、下記式(1)であらわされるナフトールアラルキル型樹脂がより好ましい。
ナフトールアラルキル型樹脂として、例えば、新日鐵化学社製の「SN170」、「SN180」、「SN190」、「SN475」、「SN485」、「SN495」、「SN375」および「SN395」、日本化薬社製の「NHN」および「CBN」等を用いることができる。
As described above, the thermosetting resin composition (X) preferably contains a naphthol resin as an essential component. Such a naphthol resin is an epoxy resin curing agent having a naphtholic hydroxyl group and having a curing action on the epoxy resin. Examples of the naphthol resins include naphthol novolak resins and naphthol aralkyl resins, and these may be used alone or in combination. The naphthol resin is preferably a naphthol aralkyl type resin, more preferably a naphthol aralkyl type resin represented by the following formula (1), from the viewpoint of further reducing the warpage of the semiconductor package.
As naphthol aralkyl type resins, for example, “SN170”, “SN180”, “SN190”, “SN475”, “SN485”, “SN495”, “SN375” and “SN395” manufactured by Nippon Steel Chemical Co., Ltd., Nippon Kayaku “NHN”, “CBN” and the like manufactured by the company can be used.

Figure 0006217870
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(上記一般式(1)式において、nは1以上15以下の整数であり、mはそれぞれ独立に1または2であり、lはそれぞれ独立に0または1であり、Rはそれぞれ独立にアルキル基、好ましくはメチル基である。) (In the general formula (1), n is an integer of 1 to 15, m is independently 1 or 2, l is independently 0 or 1, and R is independently an alkyl group. Preferably a methyl group.)

コア基板22の最外層が上記ナフトール樹脂を含む樹脂材料により形成されている場合、硬化収縮が小さく、さらに線張係数が小さいコア基板22とすることができる。   When the outermost layer of the core substrate 22 is formed of the resin material containing the naphthol resin, the core substrate 22 having a small curing shrinkage and a small linearity coefficient can be obtained.

上記ナフトール樹脂の含有量は、熱硬化性樹脂組成物(X)の全固形分(すなわち、溶媒を除く成分)を100質量%としたとき、10質量%以上が好ましく、20質量%以上がより好ましい。上記ナフトール樹脂の含有量が上記下限値以上であると、コア基板22成形時のハンドリング性が向上し、コア基板22を形成するのが容易となる。
上記ナフトール樹脂の含有量は、熱硬化性樹脂組成物(X)の全固形分を100質量%としたとき、55質量%以下が好ましく、40質量%以下がより好ましい。上記ナフトール樹脂の含有量が上記上限値以下であると、コア基板22の機械的強度、難燃性および低熱膨張性を向上させることができる。
The content of the naphthol resin is preferably 10% by mass or more and more preferably 20% by mass or more when the total solid content of the thermosetting resin composition (X) (that is, the component excluding the solvent) is 100% by mass. preferable. When the content of the naphthol resin is equal to or more than the lower limit value, handling properties at the time of molding the core substrate 22 are improved, and the core substrate 22 can be easily formed.
The content of the naphthol resin is preferably 55% by mass or less and more preferably 40% by mass or less when the total solid content of the thermosetting resin composition (X) is 100% by mass. When the content of the naphthol resin is not more than the above upper limit value, the mechanical strength, flame retardancy, and low thermal expansion of the core substrate 22 can be improved.

本実施形態に係る熱硬化性樹脂組成物(X)は、必須成分として無機充填材を含んでいることが好ましい。これにより、コア基板22の機械強度および剛性を向上させることができる。さらに、得られるコア基板22の線膨張係数を小さくすることができる。   The thermosetting resin composition (X) according to the present embodiment preferably contains an inorganic filler as an essential component. Thereby, the mechanical strength and rigidity of the core substrate 22 can be improved. Furthermore, the linear expansion coefficient of the obtained core substrate 22 can be reduced.

上記無機充填材としては、例えば、タルク、焼成クレー、未焼成クレー、マイカ、ガラスなどのケイ酸塩;酸化チタン、アルミナ、ベーマイト、シリカ、溶融シリカなどの酸化物;炭酸カルシウム、炭酸マグネシウム、ハイドロタルサイトなどの炭酸塩;水酸化アルミニウム、水酸化マグネシウム、水酸化カルシウムなどの水酸化物;硫酸バリウム、硫酸カルシウム、亜硫酸カルシウムなどの硫酸塩または亜硫酸塩;ホウ酸亜鉛、メタホウ酸バリウム、ホウ酸アルミニウム、ホウ酸カルシウム、ホウ酸ナトリウムなどのホウ酸塩;窒化アルミニウム、窒化ホウ素、窒化ケイ素、窒化炭素などの窒化物;チタン酸ストロンチウム、チタン酸バリウムなどのチタン酸塩;などを挙げることができる。   Examples of the inorganic filler include silicates such as talc, fired clay, unfired clay, mica, and glass; oxides such as titanium oxide, alumina, boehmite, silica, and fused silica; calcium carbonate, magnesium carbonate, hydro Carbonates such as talcite; hydroxides such as aluminum hydroxide, magnesium hydroxide and calcium hydroxide; sulfates or sulfites such as barium sulfate, calcium sulfate and calcium sulfite; zinc borate, barium metaborate, boric acid Examples thereof include borates such as aluminum, calcium borate and sodium borate; nitrides such as aluminum nitride, boron nitride, silicon nitride and carbon nitride; titanates such as strontium titanate and barium titanate; .

上記無機充填材として、これらの中の1種類を単独で用いてもよく、2種類以上を併用してもよい。これらの中でも、とくにシリカが好ましい。シリカの形状には破砕状および球状がある。熱硬化性樹脂組成物(X)の溶融粘度を下げて、無機充填材の熱硬化性樹脂組成物(X)への高充填化を確保するために球状シリカを使うなど、その目的にあわせた使用方法を採用することができる。   As the inorganic filler, one of these may be used alone, or two or more may be used in combination. Among these, silica is particularly preferable. Silica has a crushed shape and a spherical shape. In order to reduce the melt viscosity of the thermosetting resin composition (X) and use spherical silica to ensure high filling of the inorganic filler into the thermosetting resin composition (X), etc. The usage method can be adopted.

無機充填材の平均粒子径d50は、0.01μm以上が好ましく、0.05μm以上がより好ましい。無機充填材の平均粒子径d50が上記下限値以上であると、ワニスの粘度が高くなるのを抑制でき、コア基板22作製時の作業性を向上させることができる。また、無機充填材の平均粒子径は、5.0μm以下が好ましく、2.0μm以下がより好ましく、1.0μm以下がさらに好ましい。無機充填材の平均粒子径d50が上記上限値以下であると、ワニス中で無機充填材の沈降などの現象を抑制でき、より均一なコア基板22の最外層を得ることができる。
上記無機充填材の平均粒子径d50は、例えば、レーザー回折式粒度分布測定装置(HORIBA社製、LA−500)により、粒子の粒度分布を体積基準で測定し、そのメディアン径(D50)を平均粒子径とすることができる。
The average particle diameter d50 of the inorganic filler is preferably 0.01 μm or more, and more preferably 0.05 μm or more. When the average particle diameter d50 of the inorganic filler is equal to or larger than the lower limit, it is possible to suppress the viscosity of the varnish from being increased, and it is possible to improve the workability when the core substrate 22 is manufactured. Further, the average particle size of the inorganic filler is preferably 5.0 μm or less, more preferably 2.0 μm or less, and further preferably 1.0 μm or less. When the average particle diameter d50 of the inorganic filler is less than or equal to the above upper limit, phenomena such as sedimentation of the inorganic filler in the varnish can be suppressed, and a more uniform outermost layer of the core substrate 22 can be obtained.
The average particle diameter d50 of the inorganic filler is measured, for example, by measuring the particle size distribution on a volume basis with a laser diffraction particle size distribution measuring device (LA-500, manufactured by HORIBA), and the median diameter (D50) is averaged. The particle diameter can be set.

また、上記無機充填材は、平均粒子径が単分散の無機充填材を用いてもよいし、平均粒子径が多分散の無機充填材を用いてもよい。さらに平均粒子径が単分散および/または多分散の無機充填材を1種類または2種類以上で併用してもよい。   The inorganic filler may be a monodispersed inorganic filler having an average particle diameter, or may be an inorganic filler having a polydispersed average particle diameter. Furthermore, one type or two or more types of inorganic fillers having an average particle size of monodispersed and / or polydispersed may be used in combination.

無機充填材は、平均粒子径5.0μm以下のシリカ粒子が好ましく、平均粒子径0.01μm以上2.0μm以下のシリカ粒子がより好ましく、0.05μm以上1.0μm以下のシリカ粒子が特に好ましい。これにより、無機充填材の熱硬化性樹脂組成物(X)への充填性をさらに向上させることができる。   The inorganic filler is preferably silica particles having an average particle size of 5.0 μm or less, more preferably silica particles having an average particle size of 0.01 μm or more and 2.0 μm or less, and particularly preferably silica particles of 0.05 μm or more and 1.0 μm or less. . Thereby, the filling property to the thermosetting resin composition (X) of an inorganic filler can further be improved.

無機充填材の含有量は、熱硬化性樹脂組成物(X)の全固形分(すなわち、溶媒を除く成分)を100質量%としたとき、20質量%以上70質量%以下が好ましく、30質量%以上50質量%以下がより好ましい。   The content of the inorganic filler is preferably 20% by mass or more and 70% by mass or less, when the total solid content of the thermosetting resin composition (X) (that is, the component excluding the solvent) is 100% by mass, preferably 30% by mass. % To 50% by mass is more preferable.

本実施形態に係る熱硬化性樹脂組成物(X)は、熱可塑性樹脂をさらに含むことが好ましい。これにより、コア基板22とソルダーレジスト層10との密着性をより一層向上できると共に、コア基板22の最外層の応力緩和能をより一層向上できる。   It is preferable that the thermosetting resin composition (X) according to this embodiment further includes a thermoplastic resin. Thereby, the adhesiveness between the core substrate 22 and the solder resist layer 10 can be further improved, and the stress relaxation ability of the outermost layer of the core substrate 22 can be further improved.

本実施形態に係る熱可塑性樹脂としては、例えば、アクリル樹脂、メタクリル樹脂、フェノキシ樹脂、ポリビニルアセタール樹脂、熱可塑性ポリイミド樹脂、ポリアミド樹脂、ポリアミドイミド樹脂、ポリフェニレンオキサイド樹脂、ポリエーテルスルホン樹脂、ポリエステル樹脂、ポリエチレン樹脂、ポリスチレン樹脂、ポリスルホン樹脂、ポリブタジエン樹脂、ABS樹脂等が挙げられる。これらの中でも、絶縁層101と金属層103との密着性をより一層向上できる観点から、アクリル樹脂、メタクリル樹脂、フェノキシ樹脂、ポリビニルアセタール樹脂、ポリアミド樹脂、熱可塑性ポリイミド樹脂およびポリアミドイミド樹脂からなる群から選択される1種または2種以上が好ましく、アクリル樹脂、メタクリル樹脂、フェノキシ樹脂、ポリビニルアセタール樹脂、およびポリアミドイミド樹脂からなる群から選択される1種または2種以上が特に好ましい。
熱可塑性樹脂として、これらの中の1種類を単独で用いてもよいし、異なる重量平均分子量を有する2種類以上を併用してもよく、1種類または2種類以上とそれらのプレポリマーとを併用してもよい。
Examples of the thermoplastic resin according to the present embodiment include acrylic resin, methacrylic resin, phenoxy resin, polyvinyl acetal resin, thermoplastic polyimide resin, polyamide resin, polyamideimide resin, polyphenylene oxide resin, polyethersulfone resin, polyester resin, Examples thereof include polyethylene resin, polystyrene resin, polysulfone resin, polybutadiene resin, and ABS resin. Among these, the group consisting of an acrylic resin, a methacrylic resin, a phenoxy resin, a polyvinyl acetal resin, a polyamide resin, a thermoplastic polyimide resin, and a polyamideimide resin from the viewpoint of further improving the adhesion between the insulating layer 101 and the metal layer 103. 1 type or 2 or more types selected from are preferable, and 1 type or 2 or more types selected from the group consisting of acrylic resins, methacrylic resins, phenoxy resins, polyvinyl acetal resins, and polyamideimide resins are particularly preferable.
As the thermoplastic resin, one of these may be used alone, or two or more having different weight average molecular weights may be used in combination, or one or two or more and those prepolymers may be used in combination. May be.

上記アクリル樹脂としては、アクリル酸メチル、アクリル酸エチル、アクリル酸n−プロピル、アクリル酸n−ブチル、アクリル酸、2−ヒドロキシエチルアクリレートのような各種アクリル系モノマーから選択される共重合体等が挙げられる。これらのうち、アクリル樹脂としては、ポリアクリル酸メチル又はポリアクリル酸エチルが、コア基板22作製時の作業性を向上させる点で、好ましい。   Examples of the acrylic resin include copolymers selected from various acrylic monomers such as methyl acrylate, ethyl acrylate, n-propyl acrylate, n-butyl acrylate, acrylic acid, and 2-hydroxyethyl acrylate. Can be mentioned. Among these, as the acrylic resin, polymethyl acrylate or polyethyl acrylate is preferable in terms of improving workability when the core substrate 22 is manufactured.

上記メタクリル樹脂としては、メタクリル酸メチル、メタクリル酸エチル、メタクリル酸n−プロピル、メタクリル酸n−ブチル、メタクリル酸、2−ヒドロキシエチルメタクリレートのような各種メタクリル系モノマーから選択される共重合体等が挙げられる。これらのうち、メタクリル樹脂としては、ポリメタクリル酸メチル又はポリメタクリル酸エチルが、コア基板22作製時の作業性を向上させる点で、好ましい。   Examples of the methacrylic resin include copolymers selected from various methacrylic monomers such as methyl methacrylate, ethyl methacrylate, n-propyl methacrylate, n-butyl methacrylate, methacrylic acid, and 2-hydroxyethyl methacrylate. Can be mentioned. Among these, as the methacrylic resin, polymethyl methacrylate or polyethyl methacrylate is preferable in terms of improving workability when the core substrate 22 is manufactured.

上記フェノキシ樹脂としては、ビスフェノールA骨格、ビスフェノールF骨格、ビスフェノールS骨格、ビスフェノールアセトフェノン骨格、ノボラック骨格、ビフェニル骨格、フルオレン骨格、ジシクロペンタジエン骨格、ノルボルネン骨格、ナフタレン骨格、アントラセン骨格、アダマンタン骨格、テルペン骨格、およびトリメチルシクロヘキサン骨格からなる群から選択される一種または二種以上の骨格を有するものが挙げられる。フェノキシ樹脂の末端はフェノール性水酸基、エポキシ基等のいずれの官能基でもよい。
フェノキシ樹脂としては、例えば、ジャパンエポキシレジン社製の「1256」、「4250」(ビスフェノールA骨格含有フェノキシ樹脂)、ジャパンエポキシレジン社製の「YX8100」(ビスフェノールS骨格含有フェノキシ樹脂)、ジャパンエポキシレジン社製の「YX6954」(ビスフェノールアセトフェノン骨格含有フェノキシ樹脂)、東都化成社製の「FX280」、「FX293」、ジャパンエポキシレジン社製の「YL7553BH30」、「YL6794」、「YL7213」、「YL7290」、「YL7482」等が挙げられる。
Examples of the phenoxy resin include bisphenol A skeleton, bisphenol F skeleton, bisphenol S skeleton, bisphenolacetophenone skeleton, novolac skeleton, biphenyl skeleton, fluorene skeleton, dicyclopentadiene skeleton, norbornene skeleton, naphthalene skeleton, anthracene skeleton, adamantane skeleton, terpene skeleton And those having one or more skeletons selected from the group consisting of trimethylcyclohexane skeletons. The terminal of the phenoxy resin may be any functional group such as a phenolic hydroxyl group or an epoxy group.
Examples of the phenoxy resin include “1256” and “4250” (bisphenol A skeleton-containing phenoxy resin) manufactured by Japan Epoxy Resin, “YX8100” (bisphenol S skeleton-containing phenoxy resin) manufactured by Japan Epoxy Resin, Japan Epoxy Resin "YX6954" (bisphenol acetophenone skeleton-containing phenoxy resin) manufactured by KK, "FX280", "FX293" manufactured by Toto Kasei Co., Ltd., "YL7553BH30", "YL6794", "YL7213", "YL7290" manufactured by Japan Epoxy Resins, "YL7482" etc. are mentioned.

上記ポリビニルアセタール樹脂としては、例えば、ポリビニルブチラール樹脂が挙げられる。市販のポリビニルアセタール樹脂としては、電気化学工業社製の電化ブチラール4000−2、5000−A、6000−C、6000−EP、積水化学工業社製のエスレックBHシリーズ、BXシリーズ、KSシリーズ、BLシリーズ、BMシリーズ等が挙げられる。   Examples of the polyvinyl acetal resin include polyvinyl butyral resin. Examples of commercially available polyvinyl acetal resins include: electrified butyral 4000-2, 5000-A, 6000-C, 6000-EP manufactured by Denki Kagaku Kogyo Co., Ltd., and ESREC BH series, BX series, KS series, BL series manufactured by Sekisui Chemical Co., Ltd. , BM series and the like.

上記ポリアミドイミド樹脂としては、主鎖中にアミド基とイミド基を有する重合体であれば特に限定されず、例えば、ジカルボン酸誘導体とジイソシアネートから合成することができる。上記ポリアミドイミド樹脂の具体例としては、東洋紡績社製のHR−11NN、HR−16NN等が挙げられる。   The polyamide-imide resin is not particularly limited as long as it is a polymer having an amide group and an imide group in the main chain, and can be synthesized from, for example, a dicarboxylic acid derivative and diisocyanate. Specific examples of the polyamideimide resin include HR-11NN and HR-16NN manufactured by Toyobo Co., Ltd.

上記熱可塑性樹脂の含有量は、熱硬化性樹脂組成物(X)の全固形分(すなわち、溶媒を除く成分)を100質量%としたとき、1質量%以上20質量%以下であることが好ましく、2質量%以上10質量%以下であることがより好ましい。   The content of the thermoplastic resin is 1% by mass or more and 20% by mass or less when the total solid content of the thermosetting resin composition (X) (that is, the component excluding the solvent) is 100% by mass. Preferably, it is 2 mass% or more and 10 mass% or less.

(その他の添加剤)
このほか、必要に応じて、熱硬化性樹脂組成物(X)にはカップリング剤、ゴム粒子、上記ナフトール樹脂以外の硬化剤などの添加剤を適宜配合することができる。本実施形態で用いられる熱硬化性樹脂組成物(X)は、上記成分を有機溶媒などにより溶解および/または分散させた液状形態で好適に用いることができる。
(Other additives)
In addition, if necessary, additives such as a coupling agent, rubber particles, and a curing agent other than the naphthol resin can be appropriately blended in the thermosetting resin composition (X). The thermosetting resin composition (X) used in the present embodiment can be suitably used in a liquid form in which the above components are dissolved and / or dispersed with an organic solvent or the like.

(カップリング剤)
カップリング剤の使用により、無機充填材と各樹脂成分との界面の濡れ性を向上させることができる。したがって、カップリング剤を使用することは好ましく、コア基板22の最外層の耐熱性を改良することができる。
(Coupling agent)
By using a coupling agent, the wettability of the interface between the inorganic filler and each resin component can be improved. Therefore, it is preferable to use a coupling agent, and the heat resistance of the outermost layer of the core substrate 22 can be improved.

カップリング剤としては、例えば、エポキシシランカップリング剤、カチオニックシランカップリング剤、アミノシランカップリング剤、チタネート系カップリング剤およびシリコーンオイル型カップリング剤等が挙げられる。カップリング剤は1種類を単独で用いてもよいし、2種類以上を併用してもよい。
これにより、無機充填材と各樹脂成分との界面の濡れ性を高くすることができ、それによって耐熱性をより向上させることができる。
Examples of the coupling agent include an epoxy silane coupling agent, a cationic silane coupling agent, an amino silane coupling agent, a titanate coupling agent, and a silicone oil type coupling agent. A coupling agent may be used individually by 1 type, and may use 2 or more types together.
Thereby, the wettability of the interface of an inorganic filler and each resin component can be made high, and, thereby, heat resistance can be improved more.

カップリング剤の添加量は、無機充填材の比表面積に依存するのでとくに限定されないが、熱硬化性樹脂組成物(X)の全固形分(すなわち、溶媒を除く成分)を100質量%としたとき、0.01質量%以上1質量%以下が好ましく、0.05質量%以上0.5質量%以下がより好ましい。
カップリング剤の含有量が上記下限値以上であると、無機充填材を十分に被覆することができ、コア基板22の耐熱性を向上させることができる。また、カップリング剤の含有量が上記上限値以下であると、反応に影響を与えるのを抑制でき、コア基板22の曲げ強度などの低下を抑制することができる。
The addition amount of the coupling agent is not particularly limited because it depends on the specific surface area of the inorganic filler, but the total solid content (that is, the component excluding the solvent) of the thermosetting resin composition (X) is 100% by mass. When it is 0.01 mass% or more and 1 mass% or less, 0.05 mass% or more and 0.5 mass% or less are more preferable.
When the content of the coupling agent is not less than the above lower limit value, the inorganic filler can be sufficiently covered, and the heat resistance of the core substrate 22 can be improved. Moreover, when content of a coupling agent is below the said upper limit, it can suppress affecting a reaction and can suppress the fall of the bending strength of the core board | substrate 22, etc.

(ゴム粒子)
ゴム粒子の使用により、コア基板22の応力緩和能をより一層向上できる。その結果として、得られる配線基板20の絶縁信頼性をより一層向上できる。
ゴム粒子の好ましい例としては、コアシェル型ゴム粒子、架橋アクリロニトリルブタジエンゴム粒子、架橋スチレンブタジエンゴム粒子、アクリルゴム粒子、シリコーン粒子などが挙げられる。
(Rubber particles)
By using rubber particles, the stress relaxation ability of the core substrate 22 can be further improved. As a result, the insulation reliability of the obtained wiring board 20 can be further improved.
Preferable examples of the rubber particles include core-shell type rubber particles, crosslinked acrylonitrile butadiene rubber particles, crosslinked styrene butadiene rubber particles, acrylic rubber particles, and silicone particles.

コアシェル型ゴム粒子は、コア層とシェル層とを有するゴム粒子であり、例えば、外層のシェル層がガラス状ポリマーで構成され、内層のコア層がゴム状ポリマーで構成される2層構造、または外層のシェル層がガラス状ポリマーで構成され、中間層がゴム状ポリマーで構成され、コア層がガラス状ポリマーで構成される3層構造のものなどが挙げられる。ガラス状ポリマー層は、例えば、メタクリル酸メチルの重合物などで構成され、ゴム状ポリマー層は、例えば、ブチルアクリレート重合物(ブチルゴム)などで構成される。コアシェル型ゴム粒子の具体例としては、スタフィロイドAC3832、AC3816N(商品名、ガンツ化成社製)、メタブレンKW−4426(商品名、三菱レイヨン社製)が挙げられる。架橋アクリロニトリルブタジエンゴム(NBR)粒子の具体例としては、XER−91(平均粒子径0.5μm、JSR社製)などが挙げられる。   The core-shell type rubber particles are rubber particles having a core layer and a shell layer. For example, a two-layer structure in which an outer shell layer is formed of a glassy polymer and an inner core layer is formed of a rubbery polymer, or Examples include a three-layer structure in which the outer shell layer is made of a glassy polymer, the intermediate layer is made of a rubbery polymer, and the core layer is made of a glassy polymer. The glassy polymer layer is made of, for example, a polymer of methyl methacrylate, and the rubbery polymer layer is made of, for example, a butyl acrylate polymer (butyl rubber). Specific examples of the core-shell type rubber particles include Staphyloid AC3832, AC3816N (trade names, manufactured by Ganz Kasei Co., Ltd.), and Metabrene KW-4426 (trade names, manufactured by Mitsubishi Rayon Co., Ltd.). Specific examples of the crosslinked acrylonitrile butadiene rubber (NBR) particles include XER-91 (average particle size: 0.5 μm, manufactured by JSR).

架橋スチレンブタジエンゴム(SBR)粒子の具体例としては、XSK−500(平均粒子径0.5μm、JSR社製)などが挙げられる。アクリルゴム粒子の具体例としては、メタブレンW300A(平均粒子径0.1μm)、W450A(平均粒子径0.2μm)(三菱レイヨン社製)などが挙げられる。   Specific examples of the crosslinked styrene butadiene rubber (SBR) particles include XSK-500 (average particle size 0.5 μm, manufactured by JSR). Specific examples of the acrylic rubber particles include methabrene W300A (average particle size 0.1 μm), W450A (average particle size 0.2 μm) (manufactured by Mitsubishi Rayon Co., Ltd.), and the like.

シリコーン粒子は、オルガノポリシロキサンで形成されたゴム弾性微粒子であればとくに限定されず、例えば、シリコーンゴム(オルガノポリシロキサン架橋エラストマー)そのものからなる微粒子、および二次元架橋主体のシリコーンからなるコア部を三次元架橋型主体のシリコーンで被覆したコアシェル構造粒子などが挙げられる。シリコーンゴム微粒子としては、KMP−605、KMP−600、KMP−597、KMP−594(信越化学社製)、トレフィルE−500、トレフィルE−600(東レ・ダウコーニング社製)などの市販品を用いることができる。   The silicone particles are not particularly limited as long as they are rubber elastic fine particles formed of organopolysiloxane. For example, fine particles made of silicone rubber (organopolysiloxane crosslinked elastomer) itself and a core portion made of silicone mainly composed of two-dimensional crosslinks. Examples thereof include core-shell structure particles coated with silicone mainly composed of a three-dimensional crosslinking type. As silicone rubber fine particles, commercially available products such as KMP-605, KMP-600, KMP-597, KMP-594 (manufactured by Shin-Etsu Chemical Co., Ltd.), Trefil E-500, Trefil E-600 (manufactured by Toray Dow Corning), etc. Can be used.

ゴム粒子の添加量は、熱硬化性樹脂組成物(X)の全固形分(すなわち、溶媒を除く成分)を100質量%としたとき、0.1質量%以上5質量%以下が好ましく、0.5質量%以上3.0質量%以下がより好ましい。   The addition amount of the rubber particles is preferably 0.1% by mass or more and 5% by mass or less when the total solid content of the thermosetting resin composition (X) (that is, the component excluding the solvent) is 100% by mass. More preferably, the content is 5% by mass or more and 3.0% by mass or less.

(その他の硬化剤)
上記ナフトール樹脂以外の硬化剤としては、例えば、ベンジルジメチルアミン(BDMA)、2,4,6−トリスジメチルアミノメチルフェノール(DMP−30)などの3級アミン化合物;2−メチルイミダゾール、2−エチル−4−メチルイミダゾール(EMI24)、2−フェニル−4−メチルイミダゾール(2P4MZ)、2−フェニルイミダゾール(2PZ)、2−フェニル−4−メチル−5−ヒドロキシイミダゾール(2P4MHZ)、1−ベンジル−2−フェニルイミダゾール(1B2PZ)などのイミダゾール化合物;BF3錯体などのルイス酸などの触媒型の硬化剤が挙げられる。
(Other curing agents)
Examples of the curing agent other than the naphthol resin include tertiary amine compounds such as benzyldimethylamine (BDMA) and 2,4,6-trisdimethylaminomethylphenol (DMP-30); 2-methylimidazole, 2-ethyl -4-methylimidazole (EMI24), 2-phenyl-4-methylimidazole (2P4MZ), 2-phenylimidazole (2PZ), 2-phenyl-4-methyl-5-hydroxyimidazole (2P4MHZ), 1-benzyl-2 -Imidazole compounds such as phenylimidazole (1B2PZ); and catalyst-type curing agents such as Lewis acids such as BF3 complexes.

また、例えば、ジエチレントリアミン(DETA)、トリエチレンテトラミン(TETA)、メタキシレリレンジアミン(MXDA)などの脂肪族ポリアミン、ジアミノジフェニルメタン(DDM)、m−フェニレンジアミン(MPDA)、ジアミノジフェニルスルホン(DDS)などの芳香族ポリアミンのほか、ジシアンジアミド(DICY)、有機酸ジヒドララジドなどを含むポリアミン化合物;ヘキサヒドロ無水フタル酸(HHPA)、メチルテトラヒドロ無水フタル酸(MTHPA)などの脂環族酸無水物、無水トリメリット酸(TMA)、無水ピロメリット酸(PMDA)、ベンゾフェノンテトラカルボン酸(BTDA)などの芳香族酸無水物などを含む酸無水物;ノボラック型フェノール樹脂、フェノールポリマーなどのポリフェノール化合物;ポリサルファイド、チオエステル、チオエーテルなどのポリメルカプタン化合物;イソシアネートプレポリマー、ブロック化イソシアネートなどのイソシアネート化合物;カルボン酸含有ポリエステル樹脂などの有機酸類などの重付加型の硬化剤も用いることができる。   Also, for example, aliphatic polyamines such as diethylenetriamine (DETA), triethylenetetramine (TETA), metaxylylenediamine (MXDA), diaminodiphenylmethane (DDM), m-phenylenediamine (MPDA), diaminodiphenylsulfone (DDS) In addition to aromatic polyamines such as dicyandiamide (DICY), polyamine compounds containing organic acid dihydralazide, etc .; alicyclic acid anhydrides such as hexahydrophthalic anhydride (HHPA), methyltetrahydrophthalic anhydride (MTHPA), and trimellitic anhydride Acid anhydrides including aromatic acid anhydrides such as acid (TMA), pyromellitic anhydride (PMDA) and benzophenone tetracarboxylic acid (BTDA); polyphenols such as novolac-type phenolic resins and phenolic polymers Nord compounds; polysulfide, thioester, polymercaptan compounds such as thioethers; isocyanate prepolymer, isocyanate compounds such as blocked isocyanate; polyaddition type curing agent, such as organic acids such as carboxylic acid-containing polyester resin can be used.

さらに、例えば、ノボラック型フェノール樹脂、レゾール型フェノール樹脂等のフェノール樹脂系硬化剤;メチロール基含有尿素樹脂のような尿素樹脂;メチロール基含有メラミン樹脂のようなメラミン樹脂などの縮合型の硬化剤も用いてもよい。フェノール樹脂系硬化剤は、一分子内にフェノール性水酸基を2個以上有するモノマー、オリゴマー、ポリマー全般であり、その分子量、分子構造を特に限定するものではないが、例えば、フェノールノボラック樹脂、クレゾールノボラック樹脂等のノボラック型樹脂;トリフェノールメタン型フェノール樹脂等の多官能型フェノール樹脂;テルペン変性フェノール樹脂、ジシクロペンタジエン変性フェノール樹脂等の変性フェノール樹脂;フェニレン骨格及び/又はビフェニレン骨格を有するフェノールアラルキル樹脂等のアラルキル型樹脂;ビスフェノールA、ビスフェノールF等のビスフェノール化合物等が挙げられ、これらは1種類を単独で用いても2種類以上を併用してもよい。これらのうち、硬化性の点から水酸基当量は90g/eq以上、250g/eq以下のものが好ましい。   Furthermore, for example, phenolic resin-based curing agents such as novolak-type phenolic resins and resol-type phenolic resins; urea resins such as methylol group-containing urea resins; and condensation-type curing agents such as melamine resins such as methylol group-containing melamine resins It may be used. The phenol resin-based curing agent is a monomer, oligomer, or polymer in general having two or more phenolic hydroxyl groups in one molecule, and its molecular weight and molecular structure are not particularly limited. For example, phenol novolak resin, cresol novolak Novolak resins such as resins; polyfunctional phenol resins such as triphenolmethane phenol resins; modified phenol resins such as terpene-modified phenol resins and dicyclopentadiene-modified phenol resins; phenol aralkyl resins having a phenylene skeleton and / or a biphenylene skeleton Aralkyl type resins such as bisphenol compounds such as bisphenol A and bisphenol F, and the like may be used alone or in combination of two or more. Among these, the hydroxyl equivalent is preferably 90 g / eq or more and 250 g / eq or less from the viewpoint of curability.

上記ナフトール樹脂以外の硬化剤の含有量は、熱硬化性樹脂組成物(X)の全固形分(すなわち、溶媒を除く成分)を100質量%としたとき、0.01質量%以上5質量%以下が好ましく、0.05質量%以上1質量%以下がより好ましい。硬化剤の含有量が上記数値範囲内であると、エポキシ樹脂等の熱硬化性樹脂成分の硬化を促進する効果が十分に発揮することができる。   The content of the curing agent other than the naphthol resin is 0.01% by mass or more and 5% by mass when the total solid content of the thermosetting resin composition (X) (that is, the component excluding the solvent) is 100% by mass. The following is preferable, and 0.05% by mass or more and 1% by mass or less is more preferable. When the content of the curing agent is within the above numerical range, the effect of promoting the curing of a thermosetting resin component such as an epoxy resin can be sufficiently exerted.

さらに、熱硬化性樹脂組成物(X)には、必要に応じて、顔料、染料、消泡剤、レベリング剤、紫外線吸収剤、発泡剤、酸化防止剤、難燃剤、イオン捕捉剤などの上記成分以外の添加物を添加してもよい。   Furthermore, in the thermosetting resin composition (X), if necessary, the above-mentioned pigments, dyes, antifoaming agents, leveling agents, ultraviolet absorbers, foaming agents, antioxidants, flame retardants, ion scavengers, etc. Additives other than the components may be added.

以上の熱硬化性樹脂組成物(X)において、各成分の割合はたとえば、以下のようである。
熱硬化性樹脂組成物(X)の全固形分(すなわち、溶媒を除く成分)を100質量%としたとき、好ましくは、上記エポキシ樹脂の割合が10質量%以上55質量%以下であり、上記ナフトール樹脂の割合が10質量%以上55質量%以下であり、上記無機充填材の割合が20質量%以上70質量%以下である。より好ましくは、上記エポキシ樹脂の割合が20質量%以上40質量%以下であり、上記ナフトール樹脂の割合が20質量%以上40質量%以下であり、上記無機充填材の割合が30質量%以上50質量%以下である。
In the above thermosetting resin composition (X), the ratio of each component is as follows, for example.
When the total solid content of the thermosetting resin composition (X) (that is, the component excluding the solvent) is 100% by mass, the proportion of the epoxy resin is preferably 10% by mass to 55% by mass, The ratio of the naphthol resin is 10% by mass or more and 55% by mass or less, and the ratio of the inorganic filler is 20% by mass or more and 70% by mass or less. More preferably, the proportion of the epoxy resin is 20% to 40% by mass, the proportion of the naphthol resin is 20% to 40% by mass, and the proportion of the inorganic filler is 30% to 50%. It is below mass%.

<ソルダーレジスト層10を形成する樹脂材料>
本実施形態に係るソルダーレジスト層10は、たとえば以下のような熱硬化性樹脂組成物(P)から形成することができる。
<Resin Material Forming Solder Resist Layer 10>
The solder resist layer 10 according to the present embodiment can be formed from, for example, the following thermosetting resin composition (P).

熱硬化性樹脂組成物(P)は、配線基板20の絶縁材料として使用できる樹脂組成物であれば、特に限定されない。熱硬化性樹脂組成物(P)は、たとえば、エポキシ樹脂、シアネート樹脂、フェノール樹脂、ビスマレイミド−トリアジン樹脂、ポリイミド樹脂、アクリル樹脂、ビニルベンジル樹脂等の熱硬化性樹脂に少なくともその硬化剤を配合した組成物とすることができる。中でも、エポキシ樹脂(A)、シアネート樹脂および無機充填材とを必須成分として含有する組成物が好ましい。   The thermosetting resin composition (P) is not particularly limited as long as it is a resin composition that can be used as an insulating material for the wiring board 20. The thermosetting resin composition (P) includes, for example, at least its curing agent in a thermosetting resin such as an epoxy resin, a cyanate resin, a phenol resin, a bismaleimide-triazine resin, a polyimide resin, an acrylic resin, or a vinylbenzyl resin. Composition. Especially, the composition containing an epoxy resin (A), cyanate resin, and an inorganic filler as an essential component is preferable.

(エポキシ樹脂(A))
熱硬化性樹脂組成物(P)は主にエポキシ樹脂(A)を含むことができる。エポキシ樹脂(A)は、たとえばビスフェノールA型エポキシ樹脂、ビスフェノールF型エポキシ樹脂、ビスフェノールE型エポキシ樹脂、ビスフェノールS型エポキシ樹脂、水添ビスフェノールA型エポキシ樹脂、ビスフェノールM型エポキシ樹脂(4,4'−(1,3−フェニレンジイソプリジエン)ビスフェノール型エポキシ樹脂)、ビスフェノールP型エポキシ樹脂(4,4'−(1,4−フェニレンジイソプリジエン)ビスフェノール型エポキシ樹脂)、ビスフェノールZ型エポキシ樹脂(4,4'−シクロヘキシジエンビスフェノール型エポキシ樹脂)などのビスフェノール型エポキシ樹脂;フェノールノボラック型エポキシ樹脂、臭素化フェノールノボラック型エポキシ樹脂、クレゾールノボラック型エポキシ樹脂、テトラフェノール基エタン型ノボラック型エポキシ樹脂、縮合環芳香族炭化水素構造を有するノボラック型エポキシ樹脂などのノボラック型エポキシ樹脂;ビフェニル型エポキシ樹脂;キシリレン型エポキシ樹脂、ビフェニルアラルキル型エポキシ樹脂などのアラルキル型エポキシ樹脂;ナフチレンエーテル型エポキシ樹脂、ナフトール型エポキシ樹脂、ナフタレン型エポキシ樹脂、ナフタレンジオール型エポキシ樹脂、2官能ないし4官能エポキシ型ナフタレン樹脂、ビナフチル型エポキシ樹脂、ナフタレンアラルキル型エポキシ樹脂などのナフタレン骨格を有するエポキシ樹脂;アントラセン型エポキシ樹脂;フェノキシ型エポキシ樹脂;ジシクロペンタジエン型エポキシ樹脂;ノルボルネン型エポキシ樹脂;アダマンタン型エポキシ樹脂;フルオレン型エポキシ樹脂、リン含有エポキシ樹脂、脂環式エポキシ樹脂、脂肪族鎖状エポキシ樹脂、ビスフェノールAノボラック型エポキシ樹脂、ビキシレノール型エポキシ樹脂、トリヒドロキシフェニルメタン型エポキシ樹脂、テトラフェニロールエタン型エポキシ樹脂、トリグリシジルイソシアヌレートなどの複素環式エポキシ樹脂;N,N,N',N'−テトラグリシジルメタキシレンジアミン、N,N,N',N'−テトラグリシジルビスアミノメチルシクロヘキサン、N,N−ジグリシジルアニリンなどのグリシジルアミン類や、グリシジル(メタ)アクリレートとエチレン性不飽和二重結合を有する化合物との共重合物、ブタジエン構造を有するエポキシ樹脂、ビスフェノールのジグリシジルエーテル化物、ナフタレンジオールのジグリシジルエーテル化物、フェノール類のグリシジルエーテル化物から選択される一種または二種以上を含むことができる。
(Epoxy resin (A))
The thermosetting resin composition (P) can mainly contain an epoxy resin (A). The epoxy resin (A) is, for example, bisphenol A type epoxy resin, bisphenol F type epoxy resin, bisphenol E type epoxy resin, bisphenol S type epoxy resin, hydrogenated bisphenol A type epoxy resin, bisphenol M type epoxy resin (4,4 ' -(1,3-phenylenediisopridiene) bisphenol type epoxy resin), bisphenol P type epoxy resin (4,4 '-(1,4-phenylenediisopridiene) bisphenol type epoxy resin), bisphenol Z type epoxy Bisphenol type epoxy resins such as resins (4,4'-cyclohexyldiene bisphenol type epoxy resins); phenol novolac type epoxy resins, brominated phenol novolac type epoxy resins, cresol novolac type epoxy resins, tetrapheno Novolak-type epoxy resins such as novolak-type epoxy resins having a ruthenium ethane-type novolak-type epoxy resin and condensed ring aromatic hydrocarbon structures; biphenyl-type epoxy resins; aralkyl-type epoxy resins such as xylylene-type epoxy resins and biphenyl-aralkyl-type epoxy resins ; Having a naphthalene skeleton such as naphthylene ether type epoxy resin, naphthol type epoxy resin, naphthalene type epoxy resin, naphthalene diol type epoxy resin, bifunctional or tetrafunctional epoxy type naphthalene resin, binaphthyl type epoxy resin, naphthalene aralkyl type epoxy resin, etc. Epoxy resin; anthracene type epoxy resin; phenoxy type epoxy resin; dicyclopentadiene type epoxy resin; norbornene type epoxy resin; adamantane type epoxy resin; Type epoxy resin, phosphorus-containing epoxy resin, alicyclic epoxy resin, aliphatic chain epoxy resin, bisphenol A novolak type epoxy resin, bixylenol type epoxy resin, trihydroxyphenylmethane type epoxy resin, tetraphenylolethane type epoxy resin , Heterocyclic epoxy resins such as triglycidyl isocyanurate; N, N, N ′, N′-tetraglycidylmetaxylenediamine, N, N, N ′, N′-tetraglycidylbisaminomethylcyclohexane, N, N— Diglycidylamines such as diglycidylaniline, copolymers of glycidyl (meth) acrylate and compounds with ethylenically unsaturated double bonds, epoxy resins having a butadiene structure, diglycidyl etherified products of bisphenol, diglycidyl of naphthalenediol Etherate, it can include one or more selected from glycidyl ethers of phenols.

これらの中でも、ソルダーレジスト層10と、コア基板22、導電パターン24、および封止樹脂40との密着性や、埋め込み性を向上させる観点からは、ナフタレン骨格を有するエポキシ樹脂を含むことがより好ましい。これにより、ソルダーレジスト層10の線膨張率を低下させることができるとともに、その弾性率を向上させることもできる。また、配線基板20の剛性を向上させて作業性の向上に寄与することや、半導体パッケージ102における耐リフロー性の向上および反りの抑制を実現することも可能である。なお、ソルダーレジスト層10と、コア基板22、導電パターン24、および封止樹脂40との密着性や、導電パターン24のソルダーレジスト層10への埋め込み性を向上させる観点からは、3官能以上のナフタレン骨格を有するエポキシ樹脂を含むことがとくに好ましい。   Among these, it is more preferable to include an epoxy resin having a naphthalene skeleton from the viewpoint of improving the adhesion between the solder resist layer 10, the core substrate 22, the conductive pattern 24, and the sealing resin 40 and the embedding property. . Thereby, while being able to reduce the linear expansion coefficient of the soldering resist layer 10, the elasticity modulus can also be improved. In addition, it is possible to improve the workability by improving the rigidity of the wiring substrate 20 and to improve the reflow resistance and suppress the warpage of the semiconductor package 102. In addition, from the viewpoint of improving the adhesion between the solder resist layer 10 and the core substrate 22, the conductive pattern 24, and the sealing resin 40, and the embedding property of the conductive pattern 24 in the solder resist layer 10, a trifunctional or higher functional group is used. It is particularly preferable to include an epoxy resin having a naphthalene skeleton.

本実施形態においては、エポキシ樹脂(A)として、以下の式(a)に示すエポキシ樹脂を含むことが、好ましい態様の一例として挙げられる。   In this embodiment, it is mentioned as an example of a preferable aspect that the epoxy resin shown to the following formula | equation (a) is included as an epoxy resin (A).

Figure 0006217870
Figure 0006217870

(式(a)中、nは0〜10の整数であり、R1およびR2は互いに独立して水素原子、炭素数1〜6のアルキル基、または炭素数1〜6のアルコキシ基である) (In formula (a), n is an integer of 0 to 10, and R1 and R2 are each independently a hydrogen atom, an alkyl group having 1 to 6 carbon atoms, or an alkoxy group having 1 to 6 carbon atoms)

エポキシ樹脂(A)の含有量は、たとえば熱硬化性樹脂組成物(P)の全固形分に対して3質量%以上であることが好ましく、5質量%以上であることがより好ましい。エポキシ樹脂(A)の含有量を上記下限値以上とすることにより、熱硬化性樹脂組成物(P)を用いて形成されるソルダーレジスト層10と、コア基板22、導電パターン24、および封止樹脂40との密着性や、導電パターン24のソルダーレジスト層10への埋め込み性の向上に寄与することができる。一方で、エポキシ樹脂(A)の含有量は、たとえば熱硬化性樹脂組成物(P)の全固形分に対して30質量%以下であることが好ましく、20質量%以下であることがより好ましい。エポキシ樹脂(A)の含有量を上記上限値以下とすることにより、熱硬化性樹脂組成物(P)を用いて形成されるソルダーレジスト層10の耐熱性や耐湿性の向上を図ることができる。なお、熱硬化性樹脂組成物(P)の全固形分とは、熱硬化性樹脂組成物(P)中に含まれる溶剤を除く成分全体を指す。以下、本明細書において同様である。   The content of the epoxy resin (A) is, for example, preferably 3% by mass or more and more preferably 5% by mass or more with respect to the total solid content of the thermosetting resin composition (P). By making content of an epoxy resin (A) more than the said lower limit, the soldering resist layer 10 formed using a thermosetting resin composition (P), the core board | substrate 22, the conductive pattern 24, and sealing This can contribute to improvement in adhesion to the resin 40 and embedding property of the conductive pattern 24 in the solder resist layer 10. On the other hand, the content of the epoxy resin (A) is preferably 30% by mass or less, and more preferably 20% by mass or less, for example, based on the total solid content of the thermosetting resin composition (P). . By making content of an epoxy resin (A) below the said upper limit, the heat resistance and moisture resistance of the soldering resist layer 10 formed using a thermosetting resin composition (P) can be aimed at. . The total solid content of the thermosetting resin composition (P) refers to the entire component excluding the solvent contained in the thermosetting resin composition (P). The same applies hereinafter.

(無機充填材(B))
無機充填材(B)の具体例としては、球状シリカ、および破砕シリカ等が挙げられる。ソルダーレジスト層10と、コア基板22、導電パターン24、および封止樹脂40との密着性や、導電パターン24のソルダーレジスト層10への埋め込み性を向上させる観点からは、球状シリカを含むことがより好ましい。また、無機充填材(B)は、たとえば溶融シリカである。無機充填材(B)は、図7に示す通り、無機充填材120としてソルダーレジスト層10に含まれる。
(Inorganic filler (B))
Specific examples of the inorganic filler (B) include spherical silica and crushed silica. From the viewpoint of improving the adhesion between the solder resist layer 10 and the core substrate 22, the conductive pattern 24, and the sealing resin 40 and the embedding property of the conductive pattern 24 in the solder resist layer 10, it may contain spherical silica. More preferred. The inorganic filler (B) is, for example, fused silica. As shown in FIG. 7, the inorganic filler (B) is included in the solder resist layer 10 as the inorganic filler 120.

無機充填材(B)として、平均粒子径が2nm以上100nm以下である微粒子シリカを熱硬化性樹脂組成物(P)中に含むことがより好ましい。これにより、ソルダーレジスト層10と、コア基板22、導電体パターン24、および封止樹脂40との密着性や、導電パターン24のソルダーレジスト層10への埋め込み性を向上させることができる。平均粒子径が2nm以上100nm以下である微粒子シリカと、平均粒子径が100nm超過のシリカをともに熱硬化性樹脂組成物(P)中に含むことが、ソルダーレジスト層10と、コア基板22、導電体パターン24、および封止樹脂40との密着性や、導電パターン24のソルダーレジスト層10への埋め込み性を向上させるうえで好ましい態様の一例として挙げられる。
なお、無機充填材(B)の平均粒子径は、たとえばレーザー回折式粒度分布測定装置(HORIBA社製、LA−500)を用いて測定することが可能である。
As the inorganic filler (B), it is more preferable that fine particle silica having an average particle diameter of 2 nm or more and 100 nm or less is included in the thermosetting resin composition (P). Thereby, the adhesiveness between the solder resist layer 10 and the core substrate 22, the conductor pattern 24, and the sealing resin 40 and the embedding property of the conductive pattern 24 in the solder resist layer 10 can be improved. It is included in the thermosetting resin composition (P) that both the fine particle silica having an average particle diameter of 2 nm or more and 100 nm or less and the silica having an average particle diameter of more than 100 nm are contained in the thermosetting resin composition (P). It is mentioned as an example of a preferable aspect when improving the adhesiveness with the body pattern 24 and the sealing resin 40, and the embedding property to the soldering resist layer 10 of the conductive pattern 24.
In addition, the average particle diameter of an inorganic filler (B) can be measured, for example using a laser diffraction type particle size distribution measuring apparatus (the product made by HORIBA, LA-500).

無機充填材(B)の含有量は、たとえば熱硬化性樹脂組成物(P)の全固形分に対して30質量%以上であることが好ましく、50質量%以上であることがより好ましい。無機充填材(B)の含有量を上記下限値以上とすることにより、熱硬化性樹脂組成物(P)を用いて得られるソルダーレジスト層10の耐熱性や耐湿性を効果的に向上させることができる。また、無機充填剤(B)の含有量が上記下限値以上であれば、ソルダーレジスト層10の線膨張率を低下させることができるとともに、その弾性率を向上させることができる。これにより、得られる半導体パッケージ102の反り低減に寄与することも可能である。一方で、無機充填材(B)の含有量は、たとえば熱硬化性樹脂組成物(P)の全固形分に対して94質量%以下であることが好ましく、85質量%以下であることがより好ましい。無機充填材(B)の含有量を上記上限値以下とすることにより、ソルダーレジスト層10と、コア基板22、導電体パターン24、および封止樹脂40との密着性や、、導電パターン24のソルダーレジスト層10への埋め込み性を向上させることが可能となる。   The content of the inorganic filler (B) is, for example, preferably 30% by mass or more and more preferably 50% by mass or more with respect to the total solid content of the thermosetting resin composition (P). By making content of an inorganic filler (B) more than the said lower limit, the heat resistance and moisture resistance of the soldering resist layer 10 obtained using a thermosetting resin composition (P) are improved effectively. Can do. Moreover, if content of an inorganic filler (B) is more than the said lower limit, while the linear expansion coefficient of the soldering resist layer 10 can be reduced, the elasticity modulus can be improved. Thereby, it is possible to contribute to the reduction of warpage of the obtained semiconductor package 102. On the other hand, the content of the inorganic filler (B) is preferably 94% by mass or less and more preferably 85% by mass or less with respect to the total solid content of the thermosetting resin composition (P), for example. preferable. By setting the content of the inorganic filler (B) to the upper limit or less, the adhesion between the solder resist layer 10 and the core substrate 22, the conductor pattern 24, and the sealing resin 40, It becomes possible to improve the embedding property in the solder resist layer 10.

(シアネート樹脂(C))
熱硬化性樹脂組成物(P)は、たとえばシアネート樹脂(C)を含むことができる。これにより、ソルダーレジスト層10の線膨張率を低下させることができるとともに、その弾性率および剛性の向上を図ることができる。また、得られる半導体装置の耐熱性や耐湿性の向上に寄与することも可能である。
シアネート樹脂(C)は、たとえばノボラック型シアネート樹脂;ビスフェノールA型シアネート樹脂、ビスフェノールE型シアネート樹脂、テトラメチルビスフェノールF型シアネート樹脂などのビスフェノール型シアネート樹脂;ナフトールアラルキル型フェノール樹脂と、ハロゲン化シアンとの反応で得られるナフトールアラルキル型シアネート樹脂;ジシクロペンタジエン型シアネート樹脂;ビフェニルアルキル型シアネート樹脂から選択される一種または二種以上を含むことができる。これらの中でも、ソルダーレジスト層10の線膨張率を低下させるとともに、弾性率および剛性を向上させる観点からは、ノボラック型シアネート樹脂およびナフトールアラルキル型シアネート樹脂のうちの少なくとも一方を含むことがより好ましく、ノボラック型シアネート樹脂を含むことがとくに好ましい。
(Cyanate resin (C))
The thermosetting resin composition (P) can contain, for example, a cyanate resin (C). Thereby, while being able to reduce the linear expansion coefficient of the soldering resist layer 10, the elasticity modulus and rigidity can be improved. It is also possible to contribute to improvement of heat resistance and moisture resistance of the obtained semiconductor device.
The cyanate resin (C) is, for example, a novolak-type cyanate resin; a bisphenol-type cyanate resin such as a bisphenol A-type cyanate resin, a bisphenol E-type cyanate resin, or a tetramethylbisphenol F-type cyanate resin; a naphthol aralkyl-type phenol resin; 1 type or 2 types or more selected from naphthol aralkyl type cyanate resin obtained by reaction of this; dicyclopentadiene type cyanate resin; biphenyl alkyl type cyanate resin can be included. Among these, from the viewpoint of reducing the linear expansion coefficient of the solder resist layer 10 and improving the elastic modulus and rigidity, it is more preferable to include at least one of a novolak type cyanate resin and a naphthol aralkyl type cyanate resin, It is particularly preferable to include a novolac type cyanate resin.

シアネート樹脂(C)の含有量は、たとえば熱硬化性樹脂組成物(P)の全固形分に対して3質量%以上であることが好ましく、5質量%以上であることがより好ましい。シアネート樹脂(C)の含有量を上記下限値以上とすることにより、熱硬化性樹脂組成物(P)を用いて形成されるソルダーレジスト層10の線膨張率を効果的に低下させることができるとともに、その弾性率を向上させることができる。また、ソルダーレジスト層10と、コア基板22、導電パターン24、および封止樹脂40との密着性や、導電パターン24のソルダーレジスト層10への埋め込み性の向上に寄与することができる。一方で、シアネート樹脂(C)の含有量は、たとえば熱硬化性樹脂組成物(P)の全固形分に対して30質量%以下であることが好ましく、20質量%以下であることがより好ましい。シアネート樹脂(C)の含有量を上記上限値以下とすることにより、熱硬化性樹脂組成物(P)を用いて形成されるソルダーレジスト層10の耐熱性や耐湿性の向上を図ることができる。   The content of the cyanate resin (C) is, for example, preferably 3% by mass or more and more preferably 5% by mass or more with respect to the total solid content of the thermosetting resin composition (P). By making content of cyanate resin (C) more than the said lower limit, the linear expansion coefficient of the soldering resist layer 10 formed using a thermosetting resin composition (P) can be reduced effectively. At the same time, the elastic modulus can be improved. Moreover, it can contribute to the improvement of the adhesiveness between the solder resist layer 10 and the core substrate 22, the conductive pattern 24, and the sealing resin 40 and the embedding property of the conductive pattern 24 in the solder resist layer 10. On the other hand, the content of the cyanate resin (C) is, for example, preferably 30% by mass or less, more preferably 20% by mass or less, based on the total solid content of the thermosetting resin composition (P). . By making content of cyanate resin (C) below the said upper limit, the heat resistance and moisture resistance of the soldering resist layer 10 formed using a thermosetting resin composition (P) can be aimed at. .

(硬化促進剤(D))
熱硬化性樹脂組成物(P)は、たとえば硬化促進剤(D)を含むことができる。これにより、熱硬化性樹脂組成物(P)の硬化性を向上させることができる。硬化促進剤(D)としては、エポキシ樹脂(A)の硬化反応を促進させる化合物を用いることができ、その種類はとくに限定されない。本実施形態においては、硬化促進剤(D)として、たとえばナフテン酸亜鉛、ナフテン酸コバルト、オクチル酸スズ、オクチル酸コバルト、オクチル酸亜鉛、ビスアセチルアセトナートコバルト(II)、トリスアセチルアセトナートコバルト(III)などの有機金属塩、トリエチルアミン、トリブチルアミン、ジアザビシクロ[2,2,2]オクタンなどの3級アミン類、2−フェニル−4−メチルイミダゾール、2−エチル−4−エチルイミダゾール、2−フェニル−4−エチルイミダゾール、2−フェニル−4−メチル−5−ヒドロキシイミダゾール、2−フェニル−4−メチル−5−ヒドロキシメチルイミダゾール、2−フェニル−4,5−ジヒドロキシイミダゾールなどのイミダゾール類、フェノール、ビスフェノールA、ノニルフェノールなどのフェノール化合物、酢酸、安息香酸、サリチル酸、パラトルエンスルホン酸などの有機酸、およびオニウム塩化合物から選択される一種または二種以上を含むことができる。これらの中でも、硬化性をより効果的に向上させる観点からは、オニウム塩化合物を含むことがより好ましい。
(Curing accelerator (D))
The thermosetting resin composition (P) can contain, for example, a curing accelerator (D). Thereby, the sclerosis | hardenability of a thermosetting resin composition (P) can be improved. As a hardening accelerator (D), the compound which accelerates | stimulates hardening reaction of an epoxy resin (A) can be used, The kind in particular is not limited. In the present embodiment, as the hardening accelerator (D), for example, zinc naphthenate, cobalt naphthenate, tin octylate, cobalt octylate, zinc octylate, bisacetylacetonate cobalt (II), trisacetylacetonate cobalt ( III) organic metal salts such as triethylamine, tributylamine, tertiary amines such as diazabicyclo [2,2,2] octane, 2-phenyl-4-methylimidazole, 2-ethyl-4-ethylimidazole, 2-phenyl Imidazoles such as -4-ethylimidazole, 2-phenyl-4-methyl-5-hydroxyimidazole, 2-phenyl-4-methyl-5-hydroxymethylimidazole, 2-phenyl-4,5-dihydroxyimidazole, phenol, Bisphenol A, Noni Phenolic compounds such as phenol, acetic acid, benzoic acid, salicylic, organic acids such as p-toluenesulfonic acid, and one or more selected from an onium salt compound. Among these, it is more preferable to include an onium salt compound from the viewpoint of more effectively improving curability.

硬化促進剤(D)として用いられるオニウム塩化合物は、とくに限定されないが、たとえば下記一般式(2)で表される化合物を用いることができる。   Although the onium salt compound used as a hardening accelerator (D) is not specifically limited, For example, the compound represented by following General formula (2) can be used.

Figure 0006217870
Figure 0006217870

(式(2)中、Pはリン原子、R3、R4、R5およびR6は、それぞれ、置換もしくは無置換の芳香環または複素環を有する有機基、あるいは置換もしくは無置換の脂肪族基を示し、互いに同一であっても異なっていてもよい。A−は分子外に放出しうるプロトンを少なくとも1個以上分子内に有するn(n≧1)価のプロトン供与体のアニオン、またはその錯アニオンを示す) (In formula (2), P represents a phosphorus atom, R3, R4, R5 and R6 each represents an organic group having a substituted or unsubstituted aromatic ring or heterocyclic ring, or a substituted or unsubstituted aliphatic group; A- may represent an anion of an n (n ≧ 1) -valent proton donor having at least one proton that can be released to the outside of the molecule, or a complex anion thereof. Show)

硬化促進剤(D)の含有量は、たとえば熱硬化性樹脂組成物(P)の全固形分に対して0.1質量%以上であることが好ましく、0.3質量%以上であることがより好ましい。硬化促進剤(D)の含有量を上記下限値以上とすることにより、熱硬化性樹脂組成物(P)の硬化性をより効果的に向上させることができる。一方で、硬化促進剤(D)の含有量は、たとえば熱硬化性樹脂組成物(P)の全固形分に対して10質量%以下であることが好ましく、5質量%以下であることがより好ましい。硬化促進剤(D)の含有量を上記上限値以下とすることにより、熱硬化性樹脂組成物(P)の保存性を向上させることができる。   The content of the curing accelerator (D) is preferably 0.1% by mass or more, for example, 0.3% by mass or more with respect to the total solid content of the thermosetting resin composition (P). More preferred. By making content of a hardening accelerator (D) more than the said lower limit, sclerosis | hardenability of a thermosetting resin composition (P) can be improved more effectively. On the other hand, the content of the curing accelerator (D) is, for example, preferably 10% by mass or less and more preferably 5% by mass or less with respect to the total solid content of the thermosetting resin composition (P). preferable. By making content of a hardening accelerator (D) below the said upper limit, the preservability of a thermosetting resin composition (P) can be improved.

(着色剤(E))
熱硬化性樹脂組成物(P)は、たとえば着色剤(E)を含むことができる。着色剤(E)は、たとえば緑、赤、青、黄、および黒等の染料、顔料、および色素から選択される一種または二種以上を含んでもよい。これらの中でも、開口部28の視認性等を向上させる観点から、緑色の着色剤を含むことがより好ましく、緑色染料を含むことがとくに好ましい。緑色の着色剤としては、たとえばアントラキノン系、フタロシアニン系、およびペリレン系等の公知の着色剤を一種または二種以上含むことができる。
(Colorant (E))
The thermosetting resin composition (P) can contain, for example, a colorant (E). The colorant (E) may include one or more selected from dyes, pigments, and pigments such as green, red, blue, yellow, and black. Among these, from the viewpoint of improving the visibility of the opening 28 and the like, it is more preferable to include a green colorant, and it is particularly preferable to include a green dye. As the green colorant, for example, one or more known colorants such as anthraquinone, phthalocyanine, and perylene can be contained.

着色剤(E)の含有量は、たとえば熱硬化性樹脂組成物(P)の全固形分に対して0.05質量%以上であることが好ましく、0.1質量%以上であることがより好ましい。着色剤(E)の含有量を上記下限値以上とすることにより、熱硬化性樹脂組成物(P)を用いて得られるソルダーレジスト層10の開口部28の視認性や隠蔽性をより効果的に向上させることができる。
一方、着色剤(E)の含有量は、たとえば熱硬化性樹脂組成物(P)の全固形分に対して5質量%以下であることが好ましく、3質量%以下であることがより好ましい。着色剤(E)の含有量を上記上限値以下とすることにより、熱硬化性樹脂組成物(P)の硬化性等をより効果的に向上させることが可能となる。
The content of the colorant (E) is, for example, preferably 0.05% by mass or more and more preferably 0.1% by mass or more with respect to the total solid content of the thermosetting resin composition (P). preferable. By making content of a coloring agent (E) more than the said lower limit, visibility and concealment of the opening part 28 of the soldering resist layer 10 obtained using a thermosetting resin composition (P) are more effective. Can be improved.
On the other hand, the content of the colorant (E) is, for example, preferably 5% by mass or less, more preferably 3% by mass or less, based on the total solid content of the thermosetting resin composition (P). By making content of a coloring agent (E) below the said upper limit, it becomes possible to improve sclerosis | hardenability etc. of a thermosetting resin composition (P) more effectively.

(その他の成分)
熱硬化性樹脂組成物(P)には、上記各成分以外に、必要に応じてカップリング剤、レベリング剤、硬化剤、感光剤、消泡剤、紫外線吸収剤、発泡剤、酸化防止剤、難燃剤、およびイオン捕捉剤等から選択される一種または二種以上の添加物を添加してもよい。
カップリング剤としては、たとえばエポキシシランカップリング剤、カチオニックシランカップリング剤、アミノシランカップリング剤などのシランカップリング剤、チタネート系カップリング剤およびシリコーンオイル型カップリング剤などが挙げられる。
レベリング剤としては、アクリル系共重合物等が挙げられる。
硬化剤としては、たとえばフェノール樹脂等のフェノール系硬化剤、ナフトール型ノボラック樹脂等のナフトール系硬化剤、アミン系硬化剤、グアニジン系硬化剤、イミダゾール系硬化剤、酸無水物系硬化剤又はこれらのエポキシアダクトやマイクロカプセル化した化合物、シアネートエステル樹脂等が挙げられる。中でもフェノール系硬化剤やナフトール系硬化剤が好ましい。感光剤としては、たとえば感光性ジアゾキノン化合物が挙げられる。
また、熱硬化性樹脂組成物(P)は、ほかに、コア基板22とソルダーレジスト層10との密着性向上、および封止樹脂40とソルダーレジスト層10との密着性向上の観点から、ポリビニルアセタール樹脂を含んでも良い。ポリビニルアセタール樹脂としてはたとえば、ポリビニルブチラール樹脂やポリビニルアセトアセタール樹脂などが挙げられる。
(Other ingredients)
In addition to the above components, the thermosetting resin composition (P) includes a coupling agent, a leveling agent, a curing agent, a photosensitizer, an antifoaming agent, an ultraviolet absorber, a foaming agent, an antioxidant, as necessary. One or more additives selected from a flame retardant and an ion scavenger may be added.
Examples of the coupling agent include silane coupling agents such as epoxy silane coupling agents, cationic silane coupling agents and aminosilane coupling agents, titanate coupling agents and silicone oil type coupling agents.
Examples of the leveling agent include acrylic copolymers.
Examples of the curing agent include a phenolic curing agent such as a phenol resin, a naphthol curing agent such as a naphthol type novolak resin, an amine curing agent, a guanidine curing agent, an imidazole curing agent, an acid anhydride curing agent, or the like. Examples thereof include epoxy adducts, microencapsulated compounds, and cyanate ester resins. Of these, phenol-based curing agents and naphthol-based curing agents are preferred. Examples of the photosensitive agent include photosensitive diazoquinone compounds.
In addition, the thermosetting resin composition (P) is polyvinyl chloride from the viewpoint of improving the adhesion between the core substrate 22 and the solder resist layer 10 and improving the adhesion between the sealing resin 40 and the solder resist layer 10. An acetal resin may be included. Examples of the polyvinyl acetal resin include polyvinyl butyral resin and polyvinyl acetoacetal resin.

(溶剤)
熱硬化性樹脂組成物(P)は、たとえば溶剤を含むことができる。溶剤としては、たとえばアセトン、メチルエチルケトン、メチルイソブチルケトン、トルエン、キシレン、酢酸エチル、酢酸ブチル、乳酸ブチル、テトラメチルベンゼン、エチレングリコールモノエチルエーテル、シクロヘキサン、ヘプタン、シクロヘキサン、シクロヘキサノン、テトラヒドロフラン、ジメチルホルムアミド、ジメチルアセトアミド、ジメチルスルホキシド、エチレングリコール、セルソルブ系、カルビトール系、アニソール、およびN−メチルピロリドン等の有機溶剤から選択される一種または二種以上を含むことができる。
(solvent)
The thermosetting resin composition (P) can contain a solvent, for example. Examples of the solvent include acetone, methyl ethyl ketone, methyl isobutyl ketone, toluene, xylene, ethyl acetate, butyl acetate, butyl lactate, tetramethylbenzene, ethylene glycol monoethyl ether, cyclohexane, heptane, cyclohexane, cyclohexanone, tetrahydrofuran, dimethylformamide, dimethyl One or more selected from organic solvents such as acetamide, dimethyl sulfoxide, ethylene glycol, cellosolve, carbitol, anisole, and N-methylpyrrolidone can be included.

熱硬化性樹脂組成物(P)がワニス状である場合において、ワニス中の熱硬化性樹脂組成物(P)の固形分含有量は、たとえば30質量%以上80質量%以下であることが好ましく、40質量%以上70質量%以下であることがより好ましい。これにより、作業性や成膜性に非常に優れた熱硬化性樹脂組成物(P)が得られる。なお、ワニス状の熱硬化性樹脂組成物(P)は、たとえば上述の各成分を、超音波分散方式、高圧衝突式分散方式、高速回転分散方式、ビーズミル方式、高速せん断分散方式、および自転公転式分散方式などの各種混合機を用いて溶剤中に溶解、混合、撹拌することにより調製することができる。   In the case where the thermosetting resin composition (P) is varnished, the solid content of the thermosetting resin composition (P) in the varnish is preferably, for example, 30% by mass or more and 80% by mass or less. 40 mass% or more and 70 mass% or less is more preferable. Thereby, the thermosetting resin composition (P) excellent in workability | operativity and film formability is obtained. The varnish-like thermosetting resin composition (P) includes, for example, the above-described components, an ultrasonic dispersion method, a high-pressure collision dispersion method, a high-speed rotation dispersion method, a bead mill method, a high-speed shear dispersion method, and rotation and revolution It can prepare by melt | dissolving, mixing, and stirring in a solvent using various mixers, such as a formula dispersion system.

本実施形態に係る熱硬化性樹脂組成物(P)は、ほかに、たとえばガラス繊維基材等の繊維基材や紙基材を含んでもよい。これにより、ソルダーレジスト層10の剛性を向上させることができ、配線基板20の反りが抑えられる。   In addition, the thermosetting resin composition (P) according to the present embodiment may include, for example, a fiber substrate such as a glass fiber substrate or a paper substrate. Thereby, the rigidity of the solder resist layer 10 can be improved, and the curvature of the wiring board 20 is suppressed.

熱硬化性樹脂組成物(P)がフィルム状である場合には、熱硬化性樹脂組成物(P)を用いて得られる樹脂膜として、このフィルム状熱硬化性樹脂組成物(P)をそのまま用いることができる。一方で、熱硬化性樹脂組成物(P)がワニス状である場合には、このワニス状熱硬化性樹脂組成物(P)を成膜して得られた熱硬化性樹脂膜に対し、溶剤除去処理を行った樹脂膜を、熱硬化性樹脂組成物(P)を用いて得られる樹脂膜として使用することができる。この溶剤除去処理は、熱硬化性樹脂膜の溶剤含有率が熱硬化性樹脂膜全体に対して5質量%以下となる条件で行われる。また、処理後の熱硬化性樹脂膜は、170℃、2分の熱処理前後における重量変化率が5質量%以下となる。本実施形態においては、たとえば100〜160℃、5分〜60分の条件で溶剤除去処理を行うことができる。   When the thermosetting resin composition (P) is in the form of a film, the film-like thermosetting resin composition (P) is used as it is as a resin film obtained using the thermosetting resin composition (P). Can be used. On the other hand, when the thermosetting resin composition (P) is varnished, the solvent is used for the thermosetting resin film obtained by forming the varnish-like thermosetting resin composition (P). The resin film subjected to the removal treatment can be used as a resin film obtained using the thermosetting resin composition (P). This solvent removal process is performed on the conditions that the solvent content rate of a thermosetting resin film will be 5 mass% or less with respect to the whole thermosetting resin film. Moreover, the thermosetting resin film after processing has a weight change rate of 5% by mass or less before and after heat treatment at 170 ° C. for 2 minutes. In this embodiment, for example, the solvent removal treatment can be performed under conditions of 100 to 160 ° C. and 5 to 60 minutes.

以上、図面を参照して本発明の好適な実施形態について述べたが、これらは本発明の例示であり、上記以外の様々な構成を採用することもできる。例えば、上述した実施形態では、配線基板として、複数の開口部28が設けられた配線基板について説明したが、1つの開口部が設けられた配線基板であってもよい。   As mentioned above, although preferred embodiment of this invention was described with reference to drawings, these are the illustrations of this invention and can also employ | adopt various structures other than the above. For example, in the above-described embodiment, a wiring board provided with a plurality of openings 28 has been described as a wiring board. However, a wiring board provided with one opening may be used.

なお、本発明は前述の実施形態に限定されるものではなく、本発明の目的を達成できる範囲での変形、改良等は本発明に含まれるものである。   It should be noted that the present invention is not limited to the above-described embodiments, and modifications, improvements, and the like within the scope that can achieve the object of the present invention are included in the present invention.

次に、本発明の実施例について説明する。なお、本実施形態は、これらの実施例の記載に何ら限定されない。   Next, examples of the present invention will be described. In addition, this embodiment is not limited to description of these Examples at all.

(実施例1)
[1]ソルダーレジスト層を形成するために用いる熱硬化性樹脂組成物(P)の調製
撹拌容器に、エポキシ樹脂としてナフタレンアラルキル型エポキシ樹脂(DIC株式会社製、HP−5000)9.5質量%、無機充填剤(フィラー)として溶融シリカ粒子(B1)(株式会社アドマテックス製、アドマナノ、平均粒径0.05μm)12.4質量%、無機充填剤として溶融シリカ粒子(B2)(株式会社アドマテックス製、SO−C4、平均粒径1μm)65.7質量%、着色剤として緑色染料(日本化薬株式会社製、Kayaset Green)0.3質量%、シアネート樹脂としてフェノールノボラック型シアネートエステル樹脂(LONZA社製、PT−30)10.6質量%、カップリング剤として3−グリシドキシプロピルトリメトキシシラン(モメンティブ・パフォーマンス・マテリアルズ社製、A−187)0.3質量%、レベリング剤としてアクリル系樹脂(BYK−Chemie GmbH製、BYK−361N)0.2質量%を投入し、その後、撹拌容器内に硬化促進剤として2−フェニル−4−メチル−5−ヒドロキシメチルイミダゾール(四国化成工業株式会社製、2P4MHZ)1.0質量%を添加して、混合液を得た。次に、撹拌容器内の混合液を、高速撹拌装置を用いて30分間撹拌し、不揮発分が65質量%となるように調整して、下記表1に示す配合のワニス状の熱硬化性樹脂組成物(P)を得た。
Example 1
[1] Preparation of thermosetting resin composition (P 1 ) used for forming a solder resist layer 9.5 mass of naphthalene aralkyl type epoxy resin (manufactured by DIC Corporation, HP-5000) as an epoxy resin in a stirring vessel %, Fused silica particle (B1) as inorganic filler (filler) (manufactured by Admatechs Co., Ltd., Admanano, average particle size 0.05 μm) 12.4 mass%, fused silica particle (B2) (incorporated as inorganic filler) Made by Admatechs, SO-C4, average particle size 1 μm) 65.7% by mass, green dye as colorant (manufactured by Nippon Kayaku Co., Ltd., Kayase Green) 0.3% by mass, phenol novolac type cyanate ester resin as cyanate resin (Manufactured by LONZA, PT-30) 10.6% by mass, 3-glycidoxypropylene as a coupling agent Trimethoxysilane (Momentive Performance Materials, Inc., A-187) 0.3% by mass, acrylic resin (BYK-Chemie GmbH, BYK-361N) 0.2% by mass was added as a leveling agent, and then In addition, 1.0% by mass of 2-phenyl-4-methyl-5-hydroxymethylimidazole (manufactured by Shikoku Kasei Kogyo Co., Ltd., 2P4MHZ) was added to the stirring vessel as a curing accelerator to obtain a mixed solution. Next, the mixed solution in the stirring vessel is stirred for 30 minutes using a high-speed stirring device, and adjusted so that the non-volatile content becomes 65% by mass, and a varnish-like thermosetting resin having the composition shown in Table 1 below is prepared. A composition (P 1 ) was obtained.

[2]コア基板の最外層を形成するために用いる熱硬化性樹脂組成物(X)の調製
エポキシ樹脂としてビスフェノールF型エポキシ樹脂(DIC社製、EPICLON 830S)7.0質量部、4官能ナフタレン型エポキシ樹脂(DIC社製、EPICLON HP−4710、下記一般式(b))18.0質量部、硬化剤としてナフトールアラルキル型樹脂(新日鐵化学社製、SN−485、下記一般式(c))30.0質量部、熱可塑性樹脂としてアクリル樹脂(日立化成社製、KH−CT−865)5.0質量部、硬化触媒としてイミダゾール(四国化成社製、キュアゾール1B2PZ)0.1質量部をジメチルアセトアミドとメチルエチルケトンの混合溶媒に添加して混合液を得た。その後、この混合液を30分攪拌して溶解させた。
さらに、混合液にカップリング剤としてエポキシシランカップリング剤(モメンティブパフォーマンスマテリアルズ社製、A187)0.2質量部、無機充填材としてシリカ粒子(アドマテックス社製、SO25R、平均粒子径0.5μm)38.0質量部、ゴム粒子(ガンツ化成社製、スタフィロイドAC3816N)1.7質量部を添加した。その後、高速攪拌装置を用いて混合液を10分攪拌し、下記表1に示す配合の固形分30%の樹脂ワニスを熱硬化性樹脂組成物(X)として調製した。
[2] Preparation of Thermosetting Resin Composition (X 1 ) Used for Forming Outermost Layer of Core Substrate 7.0 parts by mass of bisphenol F type epoxy resin (Epiclon 830S, manufactured by DIC) as an epoxy resin 18.0 parts by mass of a naphthalene type epoxy resin (manufactured by DIC, EPICLON HP-4710, the following general formula (b)), a naphthol aralkyl type resin (manufactured by Nippon Steel Chemical Co., SN-485, the following general formula ( c)) 30.0 parts by mass, acrylic resin (made by Hitachi Chemical Co., Ltd., KH-CT-865) 5.0 parts by mass as a thermoplastic resin, and imidazole (Shikoku Kasei Co., Ltd., Curazole 1B2PZ) 0.1 mass as a curing catalyst Part was added to a mixed solvent of dimethylacetamide and methyl ethyl ketone to obtain a mixed solution. Thereafter, the mixed solution was stirred for 30 minutes to be dissolved.
Further, 0.2 parts by mass of an epoxy silane coupling agent (Momentive Performance Materials, A187) as a coupling agent in the mixed solution, and silica particles (Admatechs, SO25R, average particle size of 0.5 μm as an inorganic filler) ) 38.0 parts by mass and 1.7 parts by mass of rubber particles (manufactured by Ganz Kasei Co., Ltd., Staphyloid AC3816N) were added. Thereafter, the mixture using a high speed stirrer and stirred for 10 minutes to prepare a 30% solids resin varnish formulations shown in Table 1 as the thermosetting resin composition (X 1).

Figure 0006217870
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Figure 0006217870
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上記一般式(c)において、nは1〜10の整数である。   In the said general formula (c), n is an integer of 1-10.

[3]コア基板の作製
[2]で上述した方法で調整した樹脂ワニスを、12μm電解銅箔の粗化面に、コンマコーター装置を用いて乾燥後(半硬化後)の層厚が5μmとなるように塗工し、140℃の乾燥装置で2分間乾燥して、エッチング阻止膜付き銅箔を得た。次に、銅張積層板の両面の銅箔をすべてエッチングした銅なし基板の両面に、上記で作成したエッチング阻止膜付き銅箔の上記エッチング阻止膜側を銅なし基板に対向させ、真空加圧式ラミネーター装置を用いて、温度100℃、圧力1MPaにて真空加熱加圧成形させた後、180℃の乾燥装置で60分間乾燥した。その後、両面の銅箔を回路パターニングし、銅箔を粗化処理して、回路付きのエッチング阻止膜を最外層に有するコア基板を得た。なお、基板として、銅張積層板(住友ベークライト株式会社製、LαZ4785GS−B)を用意した。
[3] Fabrication of core substrate The resin varnish prepared by the method described above in [2] is dried on a roughened surface of 12 μm electrolytic copper foil using a comma coater device (after semi-curing) and the layer thickness is 5 μm. The resulting coating was dried for 2 minutes with a drying apparatus at 140 ° C. to obtain a copper foil with an etching stopper film. Next, on both sides of the copper-less substrate etched all copper foil on both sides of the copper-clad laminate, the above-mentioned etching prevention film side of the copper foil with the etching prevention film created above is opposed to the copper-less substrate, vacuum pressurization type Using a laminator apparatus, vacuum heating and pressure molding was performed at a temperature of 100 ° C. and a pressure of 1 MPa, and then dried for 60 minutes by a 180 ° C. drying apparatus. Thereafter, the copper foils on both sides were subjected to circuit patterning, and the copper foil was roughened to obtain a core substrate having an etching stopper film with a circuit as an outermost layer. In addition, the copper clad laminated board (Sumitomo Bakelite Co., Ltd. make, L (alpha) Z4785GS-B) was prepared as a board | substrate.

[4]ソルダーレジスト膜の作製
次に、ソルダーレジスト膜を作製した。PETフィルム(ユニチカ株式会社製、TR1T、厚さ38μm)をキャリア基材とし、コンマコーターを用いて乾燥後のソルダーレジスト膜が20μmとなるようにワニス状の熱硬化性樹脂組成物(P)を塗工し、140℃の乾燥装置で2分間乾燥して、キャリア付のソルダーレジスト膜を作製した。
[4] Preparation of solder resist film Next, a solder resist film was prepared. Using a PET film (Unitika Ltd., TR1T, thickness 38 μm) as a carrier substrate and using a comma coater, a varnish-like thermosetting resin composition (P) so that the solder resist film after drying becomes 20 μm It was coated and dried for 2 minutes with a drying apparatus at 140 ° C. to prepare a solder resist film with a carrier.

[5]ラミネート
上記[3]で得られたコア基板上に、上記[4]で得られたキャリア付のソルダーレジスト膜を、エッチング阻止膜とソルダーレジスト膜とが対向するようにして重ね合わせた。この積層体を、真空加圧式ラミネーター装置を用いて、温度100℃、圧力1MPaにて真空加熱加圧成形させた。キャリア付のソルダーレジスト膜のキャリア基材であるPETフィルムを剥離した後、コア基板を熱風乾燥装置にて160℃で60分間加熱し、さらに200℃で60分間加熱して硬化させた。以上の工程により構造体が得られた。
[5] Laminate The solder resist film with a carrier obtained in [4] above was overlaid on the core substrate obtained in [3] so that the etching stopper film and the solder resist film face each other. . This laminated body was vacuum-heated and pressure-molded at a temperature of 100 ° C. and a pressure of 1 MPa using a vacuum pressure laminator device. After peeling off the PET film, which is a carrier base material of the solder resist film with a carrier, the core substrate was heated at 160 ° C. for 60 minutes with a hot air drying apparatus, and further heated at 200 ° C. for 60 minutes to be cured. A structure was obtained by the above steps.

[6]開口の形成
次に、構造体の銅箔の一部とコア基板の最外層の一部とが露出するように、平均粒子径(D50)が10μmの微細粒子を用いてブラスト法によりコア基板上のソルダーレジスト膜に複数の開口を形成した。なお、ブラスト処理の加工速度は、1.4mm/secとした。このとき、全ての開口において、露出したコア基板の最外層表面は、エッチングダメージのない状態であった。
[6] Formation of opening Next, by blasting using fine particles having an average particle diameter (D50) of 10 μm so that a part of the copper foil of the structure and a part of the outermost layer of the core substrate are exposed. A plurality of openings were formed in the solder resist film on the core substrate. In addition, the processing speed of the blasting process was set to 1.4 mm / sec. At this time, in all the openings, the exposed outermost layer surface of the core substrate was free from etching damage.

[7]デスミア処理
次に、開口が形成された構造体を60℃の膨潤液(アトテック社製、スウェリングディップ セキュリガント P)に5分間浸漬し、さらに80℃の過マンガン酸カリウム水溶液(アトテック社製、コンセントレート コンパクト CP)に5分浸漬後、中和し、さらにOガスによるプラズマ照射を5分間行うことで、デスミア処理を行った。このとき、構造体にバイアス電圧は印加しなかった。
[7] Desmear treatment Next, the structure in which the opening is formed is immersed in a swelling liquid at 60 ° C. (Swelling Dip Securigant P, manufactured by Atotech Co., Ltd.) for 5 minutes, and further an aqueous potassium permanganate solution at 80 ° C. (Atotech). After being immersed in Concentrate Compact CP) for 5 minutes, neutralization was performed, and further, plasma irradiation with O 2 gas was performed for 5 minutes to perform desmear treatment. At this time, no bias voltage was applied to the structure.

[8]めっき処理
次に、銅箔の露出部にめっき層を形成した。具体的には、無電解ニッケルめっき層3μmを形成し、さらにその上に無電解金めっき層0.1μmを形成した。
[8] Plating treatment Next, a plating layer was formed on the exposed portion of the copper foil. Specifically, an electroless nickel plating layer of 3 μm was formed, and an electroless gold plating layer of 0.1 μm was further formed thereon.

[9]プラズマ処理
次に、ソルダーレジスト膜およびめっき層の形成された構造体の上面をプラズマ処理して、積層基板(配線基板)を得た。プラズマ処理の条件は以下の通りとした。このとき積層基板にバイアス電圧は印加しなかった。
真空度:20Pa
処理ガス:アルゴンガス
ガス流量:200sccm
電力:200W
時間:2min
[9] Plasma treatment Next, the upper surface of the structure on which the solder resist film and the plating layer were formed was subjected to plasma treatment to obtain a multilayer substrate (wiring substrate). The conditions for the plasma treatment were as follows. At this time, no bias voltage was applied to the laminated substrate.
Degree of vacuum: 20Pa
Process gas: Argon gas Gas flow rate: 200 sccm
Power: 200W
Time: 2min

[10]表面粗さの測定
上記[9]で得た積層基板におけるソルダーレジスト膜の表面粗さを、レーザー顕微鏡(株式会社キーエンス製、VK−X100)を用いて測定した。その結果、算術平均粗さRaは0.15μm、十点平均粗さRzは1.73μm、二乗平均粗さRMSは0.180μmであった。
[10] Measurement of surface roughness The surface roughness of the solder resist film in the laminated substrate obtained in [9] above was measured using a laser microscope (manufactured by Keyence Corporation, VK-X100). As a result, the arithmetic average roughness Ra was 0.15 μm, the ten-point average roughness Rz was 1.73 μm, and the root-mean-square roughness RMS was 0.180 μm.

[11]半導体パッケージの作製
上記[9]で得た積層基板を用いて、図3に示す半導体パッケージを作製した。
[11] Fabrication of Semiconductor Package The semiconductor package shown in FIG. 3 was fabricated using the multilayer substrate obtained in [9] above.

(実施例2)
コア基板の最外層を形成するために用いる熱硬化性樹脂組成物(X)として、下記表1に示す配合組成の熱硬化性樹脂組成物を用いた以外は、実施例1と同様の方法でコア基板、構造体、積層基板および半導体パッケージを作製した。なお、本実施例で得られた積層基板において、露出したコア基板の最外層表面は、エッチングダメージのない状態であった。
(Example 2)
The same method as in Example 1 except that the thermosetting resin composition having the blending composition shown in Table 1 below was used as the thermosetting resin composition (X 2 ) used to form the outermost layer of the core substrate. Thus, a core substrate, a structure, a laminated substrate, and a semiconductor package were produced. In the laminated substrate obtained in this example, the exposed outermost layer surface of the core substrate was free from etching damage.

(実施例3)
コア基板の最外層を形成するために用いる熱硬化性樹脂組成物(X)として、下記表1に示す配合組成の熱硬化性樹脂組成物を用いた以外は、実施例1と同様の方法でコア基板、構造体、積層基板および半導体パッケージを作製した。なお、本実施例で得られた積層基板において、露出したコア基板の最外層表面は、エッチングダメージのない状態であった。
(Example 3)
The same method as in Example 1 except that the thermosetting resin composition having the composition shown in Table 1 below was used as the thermosetting resin composition (X 3 ) used to form the outermost layer of the core substrate. Thus, a core substrate, a structure, a laminated substrate, and a semiconductor package were produced. In the laminated substrate obtained in this example, the exposed outermost layer surface of the core substrate was free from etching damage.

(実施例4)
コア基板の最外層を形成するために用いる熱硬化性樹脂組成物(X)として、下記表1に示す配合組成の熱硬化性樹脂組成物を用いた以外は、実施例1と同様の方法でコア基板、構造体、積層基板および半導体パッケージを作製した。なお、本実施例で得られた積層基板において、露出したコア基板の最外層表面は、エッチングダメージのない状態であった。
Example 4
The same method as in Example 1 except that the thermosetting resin composition having the composition shown in Table 1 below was used as the thermosetting resin composition (X 4 ) used for forming the outermost layer of the core substrate. Thus, a core substrate, a structure, a laminated substrate, and a semiconductor package were produced. In the laminated substrate obtained in this example, the exposed outermost layer surface of the core substrate was free from etching damage.

(実施例5)
コア基板として、銅張積層板(住友ベークライト株式会社製、LαZ4785GS−B)を準備した。
次に、ソルダーレジスト層を形成するために用いる熱硬化性樹脂組成物(P)として、下記表1に示す配合組成の熱硬化性樹脂組成物を準備し、上記[4]と同様にしてキャリア付きソルダーレジスト膜を作製した。
その後、上記[5]と同様にして、コア基板上に、銅箔とソルダーレジスト膜とが対向するようにして、キャリア付きソルダーレジスト膜をラミネートし、構造体を得た。その後、上記[6]〜[11]の工程を経て、積層基板および半導体パッケージを作製した。なお、本実施例で得られた積層基板において、露出したコア基板の最外層表面は、エッチングダメージのない状態であった。
(Example 5)
A copper-clad laminate (manufactured by Sumitomo Bakelite Co., Ltd., LαZ4785GS-B) was prepared as a core substrate.
Next, as the thermosetting resin composition (P 2 ) used for forming the solder resist layer, a thermosetting resin composition having the blending composition shown in Table 1 below is prepared, and the same as [4] above. A solder resist film with a carrier was prepared.
Thereafter, in the same manner as in [5] above, a solder resist film with a carrier was laminated on the core substrate so that the copper foil and the solder resist film faced to obtain a structure. Then, the laminated substrate and the semiconductor package were produced through the steps [6] to [11]. In the laminated substrate obtained in this example, the exposed outermost layer surface of the core substrate was free from etching damage.

(実施例6)
コア基板の最外層を形成するために用いる熱硬化性樹脂組成物として、上述した熱硬化性樹脂組成物(X)を用いるとともに、ソルダーレジスト層を形成するために用いる熱硬化性樹脂組成物として、上述した熱硬化性樹脂組成物(P)を用いた以外は、実施例1と同様の方法でコア基板、構造体、積層基板および半導体パッケージを作製した。なお、本実施例で得られた積層基板において、露出したコア基板の最外層表面は、エッチングダメージのない状態であった。
(Example 6)
As the thermosetting resin composition used to form the outermost layer of the core substrate, the above-described thermosetting resin composition (X 3 ) is used, and the thermosetting resin composition used to form the solder resist layer. As described above, a core substrate, a structure, a multilayer substrate, and a semiconductor package were produced in the same manner as in Example 1 except that the above-described thermosetting resin composition (P 2 ) was used. In the laminated substrate obtained in this example, the exposed outermost layer surface of the core substrate was free from etching damage.

(比較例)
コア基板の最外層を形成するために用いる熱硬化性樹脂組成物(X)として、下記表1に示す配合組成の熱硬化性樹脂組成物を用いた以外は、実施例1と同様の方法でコア基板、構造体、積層基板および半導体パッケージを作製した。
なお、本比較例で得られた積層基板において、露出したコア基板の最外層表面には、不規則なエッチングダメージが加わっていることが確認された。
(Comparative example)
The same method as in Example 1 except that the thermosetting resin composition having the composition shown in Table 1 below was used as the thermosetting resin composition (X 5 ) used to form the outermost layer of the core substrate. Thus, a core substrate, a structure, a laminated substrate, and a semiconductor package were produced.
In the multilayer substrate obtained in this comparative example, it was confirmed that irregular etching damage was applied to the exposed outermost layer surface of the core substrate.

実施例および比較例について、以下の評価を行った。結果を表1に示す。   The following evaluation was performed about the Example and the comparative example. The results are shown in Table 1.

(ブラスト法による加工深さの測定)
各実施例および比較例について、上記[2]で述べた方法で作製した樹脂ワニスを用い、PETフィルム(ユニチカ株式会社製、TR1T、厚さ38μm)上に、上記[3]で述べた方法を用いて厚さ20μmの樹脂膜を作製した。この樹脂膜と、上記[4]で述べた方法で作製したキャリア付のソルダーレジスト膜とに対して、それぞれ上記[6]で述べた方法と同様の手法でブラスト処理を実施し、樹脂膜およびソルダーレジスト膜の加工深さを測定した。測定したデータについては、処理対象の厚みが一定ではないことを考慮して、ソルダーレジスト膜の加工深さX1を10としたときの、上記樹脂膜の加工深さX2を算出した。なお、マイクロブラスト処理による表面加工深さは、処理対象への表面加工速度に比例した。
(Measurement of processing depth by blast method)
For each example and comparative example, using the resin varnish produced by the method described in [2] above, the method described in [3] above on a PET film (Unitika Ltd., TR1T, thickness 38 μm). A resin film having a thickness of 20 μm was produced. The resin film and a solder resist film with a carrier produced by the method described in [4] above are subjected to blasting by the same method as that described in [6] above, and the resin film and The processing depth of the solder resist film was measured. Regarding the measured data, the processing depth X2 of the resin film was calculated when the processing depth X1 of the solder resist film was set to 10 in consideration of the fact that the thickness of the processing target was not constant. In addition, the surface processing depth by the microblast processing was proportional to the surface processing speed to the processing target.

(半導体パッケージの耐久性)
各実施例および比較例について、上記[11]で述べた方法で得られた半導体パッケージ4個を60℃、湿度60%の条件下で40時間処理後、IRリフロー炉(ピーク温度:260℃)で3回処理し、大気中で、−55℃(15分)、125℃(15分)で500サイクル処理した。つぎに、超音波映像装置(日立建機ファインテック社製、FS300)を用いて、半導体素子、半田バンプに異常がないか観察し、以下の基準にしたがって評価した。
A:半導体素子、半田バンプともに異常なし、または一部にクラックが見られるが実用上問題なし。
B:半導体素子および/または半田バンプの一部にクラックが見られ実用上問題あり。
C:半導体素子、半田バンプともにクラックが見られ使用できない。
(Durability of semiconductor packages)
For each example and comparative example, four semiconductor packages obtained by the method described in [11] above were treated for 40 hours under conditions of 60 ° C. and 60% humidity, and then an IR reflow furnace (peak temperature: 260 ° C.) And was subjected to 500 cycles at −55 ° C. (15 minutes) and 125 ° C. (15 minutes) in the atmosphere. Next, using an ultrasonic imaging device (manufactured by Hitachi Construction Machinery Finetech Co., Ltd., FS300), the semiconductor elements and solder bumps were observed for abnormalities and evaluated according to the following criteria.
A: There is no abnormality in the semiconductor element and the solder bump, or a crack is seen in a part, but there is no practical problem.
B: Cracks are seen in a part of the semiconductor element and / or solder bump, which is problematic in practical use.
C: Both the semiconductor element and the solder bump are cracked and cannot be used.

(半導体パッケージの接続信頼性)
各実施例および比較例について、上記[11]で述べた方法で得られた半導体パッケージ3個をフライングチェッカー(1116X−YC ハイテスタ:日置電機社製)を用い、半田バンプを介して半導体素子と回路基板間を通る回路端子の導通の測定をおこない、初期値とした。つぎに、60℃、湿度60%の吸湿条件下で40時間処理後、IRリフロー炉(ピーク温度:260℃)で3回処理し、同様に導通を測定して初期値より抵抗値が5%以上上昇したサンプルを実装時の断線と判定して、以下の基準にしたがって評価した。ここで、初期値で断線が生じていた場合は、回路作製上の不具合と判断しカウントしていない。なお、半導体パッケージ1個につき測定箇所は61箇所、計183箇所を測定した。
A:断線箇所が無かった、または断線箇所が1〜10%であった。
B:断線箇所が11〜50%であった。
C:断線箇所が51%以上であった。
(Semiconductor package connection reliability)
For each of the examples and comparative examples, three semiconductor packages obtained by the method described in [11] above were used using a flying checker (1116X-YC Hitester: manufactured by Hioki Electric Co., Ltd.), and a semiconductor element and a circuit via solder bumps. The continuity of circuit terminals passing between the substrates was measured and set as the initial value. Next, after treatment for 40 hours under a moisture absorption condition of 60 ° C. and 60% humidity, the treatment was conducted three times in an IR reflow furnace (peak temperature: 260 ° C.), and the continuity was measured in the same manner, and the resistance value was 5% from the initial value. The sample that has risen above was determined as a disconnection during mounting, and was evaluated according to the following criteria. Here, when the disconnection has occurred at the initial value, it is determined that it is a malfunction in circuit fabrication and is not counted. In addition, the measurement location was 61 locations per semiconductor package, and a total of 183 locations were measured.
A: There was no disconnection part or the disconnection part was 1 to 10%.
B: The disconnection location was 11 to 50%.
C: The disconnection location was 51% or more.

Figure 0006217870
Figure 0006217870

実施例の半導体パッケージは、いずれも、耐久性および接続信頼性に優れたものであったのに対し、比較例の半導体パッケージは、特に、接続信頼性という観点において、要求水準を満たすものではなかった。   While all of the semiconductor packages of the examples were excellent in durability and connection reliability, the semiconductor package of the comparative example did not satisfy the required level particularly in terms of connection reliability. It was.

本発明によれば、コア基板と、コア基板の少なくとも一方の面上に設けられた導電パターンと、導電パターンを覆うように、コア基板の上記一方の面上に設けられたソルダーレジスト層とを有する構造体を提供する。かかる構造体は、コア基板の上記一方の面が、導電パターンが接触する第1の領域と、第1の領域と隣接する第2の領域とを備え、少なくとも第2の領域のブラスト処理に対するエッチング耐性が、ソルダーレジスト層のブラスト処理に対するエッチング耐性より高い。かかる構造体を用いた配線基板では、開口部に露出した導電パッドやコア基板の表面に対するエッチングダメージを抑えることができる。したがって、かかる構造体(配線基板)を用いることにより、耐久性および接続信頼性に優れた半導体パッケージを、より容易に、かつ、より高い歩留りで作成することができる。したがって、本発明は、産業上の利用可能性を有する。   According to the present invention, the core substrate, the conductive pattern provided on at least one surface of the core substrate, and the solder resist layer provided on the one surface of the core substrate so as to cover the conductive pattern are provided. A structure is provided. In such a structure, the one surface of the core substrate includes a first region in contact with the conductive pattern, and a second region adjacent to the first region, and at least etching for blasting the second region. The resistance is higher than the etching resistance to the blast treatment of the solder resist layer. In a wiring board using such a structure, etching damage to the conductive pad exposed at the opening and the surface of the core substrate can be suppressed. Therefore, by using such a structure (wiring board), a semiconductor package excellent in durability and connection reliability can be produced more easily and with a higher yield. Therefore, the present invention has industrial applicability.

Claims (13)

コア基板と、
前記コア基板の少なくとも一方の面上に設けられた導電パターンと、
前記導電パターンおよび前記コア基板の前記一方の面を覆うようにかつ、これらに直接接触して設けられたソルダーレジスト層とを有し、
前記コア基板の前記一方の面は、前記導電パターンが接触する第1の領域と、前記第1の領域と隣接する第2の領域とを備え、少なくとも前記第2の領域のブラスト処理に対するエッチング耐性が、前記ソルダーレジスト層の前記ブラスト処理に対するエッチング耐性より高いことを特徴とする構造体。
A core substrate;
A conductive pattern provided on at least one surface of the core substrate;
The conductive patterns and to cover the one surface of the core substrate, and, and a solder resist layer provided in contact these directly,
The one surface of the core substrate includes a first region in contact with the conductive pattern, and a second region adjacent to the first region, and at least etching resistance to blasting of the second region Is higher than the etching resistance of the solder resist layer to the blast treatment.
前記コア基板は、コア基板本体と、前記コア基板本体上に設けられ、少なくとも前記第2の領域を形成するエッチング阻止膜とを備える請求項1に記載の構造体。   2. The structure according to claim 1, wherein the core substrate includes a core substrate body and an etching stopper film provided on the core substrate body and forming at least the second region. 前記エッチング阻止膜は、エポキシ樹脂と、ナフトール樹脂と、無機充填材と、を含む樹脂材料で構成されている請求項2に記載の構造体。   The structure according to claim 2, wherein the etching stop film is made of a resin material including an epoxy resin, a naphthol resin, and an inorganic filler. 前記樹脂材料の全固形分量に対する前記無機充填材の含有量が、20質量%以上70質量%以下である請求項3に記載の構造体。   The structure according to claim 3, wherein the content of the inorganic filler with respect to the total solid content of the resin material is 20 mass% or more and 70 mass% or less. 前記無機充填材の平均粒子径d50が0.01μm以上5μm以下である請求項3または4に記載の構造体。   The structure according to claim 3 or 4, wherein the inorganic filler has an average particle diameter d50 of 0.01 µm or more and 5 µm or less. 前記ソルダーレジスト層は、エポキシ樹脂と、シアネート樹脂と、無機充填材と、を含む熱硬化性樹脂組成物で構成されている請求項1ないし5のいずれか一項に記載の構造体。   The said soldering resist layer is a structure as described in any one of Claim 1 thru | or 5 comprised by the thermosetting resin composition containing an epoxy resin, cyanate resin, and an inorganic filler. 前記ソルダーレジスト層のガラス転移温度(Tg)が、150℃以上280℃以下である請求項1ないし6のいずれか一項に記載の構造体。   The structure according to any one of claims 1 to 6, wherein a glass transition temperature (Tg) of the solder resist layer is 150 ° C or higher and 280 ° C or lower. 前記ソルダーレジスト層および前記コア基板の前記第2の領域に対して、前記ソルダーレジスト層が1.4mm/secの速度で加工される条件で前記ブラスト処理を実施した場合における、前記ソルダーレジスト層の表面加工量をX1[mm]とし、第2の領域の表面加工量をX2[mm]としたとき、4≦X1/X2≦20の関係を満足する請求項1ないし7のいずれか一項に記載の構造体。  The solder resist layer in the case where the solder resist layer and the second region of the core substrate are subjected to the blasting process under the condition that the solder resist layer is processed at a speed of 1.4 mm / sec. The surface processing amount is X1 [mm] and the surface processing amount of the second region is X2 [mm], wherein the relationship of 4 ≦ X1 / X2 ≦ 20 is satisfied. The structure described. 請求項1ないしのいずれか一項に記載の前記構造体を準備する工程と、
前記ソルダーレジスト層に対して前記ブラスト処理を実施することにより、前記ソルダーレジスト層を貫通して、前記コア基板の前記一方の面の一部と前記導電パターンの一部とが露出する少なくとも1つの開口部を形成する工程とを有することを特徴とする配線基板の製造方法。
Preparing the structure according to any one of claims 1 to 8 ,
By performing the blasting process on the solder resist layer, at least one of the one surface of the core substrate and a part of the conductive pattern is exposed through the solder resist layer. And a step of forming an opening.
前記ソルダーレジスト層および前記コア基板の前記第2の領域に対して同一条件で前記ブラスト処理を実施した場合、前記ソルダーレジスト層に対するエッチング速度が、前記コア基板の前記第2の領域に対するエッチング速度より速い請求項に記載の配線基板の製造方法。 When the blast treatment is performed on the solder resist layer and the second region of the core substrate under the same conditions, the etching rate for the solder resist layer is higher than the etching rate for the second region of the core substrate. The manufacturing method of the wiring board according to claim 9, which is quick. 前記ソルダーレジスト層および前記コア基板の前記第2の領域に対して、前記ソルダーレジスト層が1.4mm/secの速度で加工される条件で前記ブラスト処理を実施した場合における、前記ソルダーレジスト層の表面加工量をX1[mm]とし、第2の領域の表面加工量をX2[mm]としたとき、前記表面加工量X1が、前記表面加工量X2の10倍以上である請求項9または10に記載の配線基板の製造方法。 The solder resist layer in the case where the solder resist layer and the second region of the core substrate are subjected to the blasting process under the condition that the solder resist layer is processed at a speed of 1.4 mm / sec. the surface treatment amount is X1 [mm], when the surface treatment amount of the second region and the X2 [mm], the surface treatment amount X1 is, claim 9 or 10 times or more of the previous SL surface processing amount X2 The manufacturing method of the wiring board of Claim 10. 前記ブラスト処理において使用する粒子の平均粒子径(D50)が、1μm以上25μm以下である、請求項ないし11のいずれか一項に記載の配線基板の製造方法。 The method for manufacturing a wiring board according to any one of claims 9 to 11, wherein an average particle diameter (D50) of particles used in the blast treatment is 1 µm or more and 25 µm or less. コア基板と、
前記コア基板の少なくとも一方の面上に設けられた導電パターンと、
前記導電パターンおよび前記コア基板の前記一方の面を覆うようにかつ、これらに直接接触して設けられたソルダーレジスト層と、
前記ソルダーレジスト層を貫通して設けられ、前記コア基板の前記一方の面の一部と前記導電パターンの一部とが露出する少なくとも1つの開口部とを有し、
前記コア基板の前記一方の面は、前記導電パターンが接触する第1の領域と、前記第1の領域と隣接する第2の領域とを備え、少なくとも前記第2の領域のブラスト処理に対するエッチング耐性が、前記ソルダーレジスト層の前記ブラスト処理に対するエッチング耐性より高いことを特徴とする配線基板。
A core substrate;
A conductive pattern provided on at least one surface of the core substrate;
A solder resist layer provided so as to cover the conductive pattern and the one surface of the core substrate , and in direct contact with them ;
Provided through the solder resist layer, and having at least one opening through which a part of the one surface of the core substrate and a part of the conductive pattern are exposed;
The one surface of the core substrate includes a first region in contact with the conductive pattern, and a second region adjacent to the first region, and at least etching resistance to blasting of the second region Is higher than the etching resistance with respect to the said blast process of the said soldering resist layer, The wiring board characterized by the above-mentioned.
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