JP5864222B2 - トランジスタ保護回路 - Google Patents
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Description
Claims (3)
- 駆動回路によって電源の高電位側電圧または低電位側電圧がゲート端子に印加されて、スイッチング制御される電圧駆動型のトランジスタの保護を行うためのトランジスタ保護回路であって、
前記トランジスタの保護を実行する保護指令を受けたときに、前記電源の高電位側電圧を次第に低下させる電源制御部と、
前記トランジスタのゲート端子と、ソース端子またはエミッタ端子とを短絡するためのゲート短絡部と、
前記保護指令に応じて、前記トランジスタのゲート端子と、ソース端子またはエミッタ端子とを短絡するように前記ゲート短絡部を制御する短絡制御部と、
を備え、
前記短絡制御部は、前記保護指令を受けてから所定遅延時間経過後に前記トランジスタのゲート端子と、ソース端子またはエミッタ端子とを短絡するように前記ゲート短絡部を制御し、
前記所定遅延時間は、前記トランジスタのゲート端子に印加される電圧が前記トランジスタのしきい値電圧に低下する時間以上である、
ことを特徴とする、トランジスタ保護回路。 - 前記保護指令に応じて、前記電源の高電位側電圧を前記トランジスタのゲート端子に印加することを停止するように前記駆動回路を制御する駆動制御部を更に備え、
前記駆動制御部は、前記保護指令を受けてから前記所定遅延時間経過後に、前記電源の高電位側電圧を前記トランジスタのゲート端子に印加することを停止するように前記駆動回路を制御する、
請求項1に記載のトランジスタ保護回路。 - 前記駆動制御部は、前記保護指令を受けてから前記所定遅延時間経過前には、前記電源の高電位側電圧を前記トランジスタのゲート端子に印加することを継続するように前記駆動回路を制御する、請求項2に記載のトランジスタ保護回路。
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