JP5773364B2 - Em級増幅器 - Google Patents
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Description
図1は、本実施形態に係る増幅器(以下「本増幅器」という。)1の等価回路を示す図である。なお、本実施形態に係るEM級増幅器の形態は、様々な形態で実現が可能であり、例えば導電性の材料からなる配線がプリントされた基板に各種部品を配置し、これらをハンダ等で固定することで実現してもよいし、半導体集積回路を用いてチップ化したものとすることも可能であり、特に限定されるものではない。
4の電圧の範囲は、出力する信号の振幅等を考慮する限りにおいて当然に調整可能である。
本実施形態に係るEM級増幅器は、ほぼ実施形態1と同様であるが、補助回路の構成が実施形態1と異なる。本実施形態では主に実施形態1との際について説明し、その他の共通する構成についての説明は省略する。図6は、本実施形態に係るEM級増幅器の等価回路図である。
Claims (1)
- 主回路と、前記主回路に信号を入力する補助回路と、を有するEM級増幅器であって、
前記主回路は、第一の主基礎回路と、前記第一の主基礎回路と同様な構造の第二の主基礎回路と、前記第一の主基礎回路と前記第二の主基礎回路に接続される負荷回路と、を有して構成され、
前記第一の主基礎回路は、
第一の定電圧源に接続される入力端子と、
前記入力端子に接続される第一のインダクタと、
前記第一のインダクタにドレイン領域が接続される第一のスイッチング素子と並列に接続される第一のキャパシタと、を有しており、
前記第二の主基礎回路は、
第二の定電圧源に接続される入力端子と、
前記入力端子に接続される第二のインダクタと、
前記第二のインダクタにドレイン領域が接続される第二のスイッチング素子と、
前記第二のインダクタに接続され、前記第二のスイッチング素子と並列に接続される第二のキャパシタと、を有しており、
前記補助回路は、
第三の定電圧源と、
前記第三の定電圧源に接続される第三のインダクタと、
前記第三のインダクタに接続される第一の共振フィルタ及び第二の共振フィルタと、
前記第三のインダクタにドレイン領域が接続される第三のスイッチング素子と、
前記第三のインダクタに接続され、前記第三のスイッチング素子と並列に接続される第三のキャパシタと、を有しており、
前記第一の共振フィルタは、前記第一の基礎主回路における前記第一のインダクタと前記負荷回路とを接続する配線に接続されており、
前記第二の共振フィルタは、前記第二の基礎主回路における前記第二のインダクタと前記負荷回路とを接続する配線に接続されているE M 級増幅器。
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