JP5556062B2 - 集積回路装置、電気光学装置及び電子機器 - Google Patents
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Description
図1〜図3を用いて、マルチプレクス駆動(線順次駆動)について説明する。なお、以下では、単色の液晶パネルの駆動を例に説明する。但し、本実施形態では、複数色(例えばRGB)の液晶パネルが駆動されてもよく、EL(Electro-Luminescence)パネル、電気泳動パネル(EPD: Electrophoretic Display)等の液晶パネル以外の電気光学パネルが駆動されてもよい。また、以下では、データ信号供給線に供給されるデータ信号(階調信号)がデータ電圧である場合を例に説明する。但し、本実施形態では、データ信号供給線に供給されるデータ信号がデータ電流であってもよい。
図2、図3に、マルチプレクス駆動の動作説明図を示す。
図4〜図8を用いて、データ電圧に生じるオフセット電圧(誤差、偏差、バラツキ。広義には、オフセット信号)の具体例について説明する。以下では、具体例として、マルチプレクス駆動におけるデータ線の位置(並び順)によって異なる位置オフセット電圧について説明する。但し、本実施形態では、以下に説明する位置オフセットに限らず、他のオフセット電圧を補正することもできる。
図8に、上記課題を解決できる本実施形態の集積回路装置の第1の構成例を示す。この構成例の集積回路装置は、補正回路300、ラッチ回路330、第1〜第nのデータ線駆動回路200−1〜200−n(複数のデータ線駆動回路)、第1〜第nの出力選択回路220−1〜220−n(複数の出力選択回路)を含む。なお、本実施形態の集積回路装置は図8の構成に限定されず、その構成要素の一部(例えば、出力選択回路等)を省略したり他の構成要素を追加したりする等の種々の変形実施が可能である。
図9に、補正回路300の動作説明図を示す。図9では、説明を簡単にするために、画素グループ数n=8、各画素グループの画素数p=8、補正データの個数k=5である場合を例に説明する。但し、本実施形態では、n=8、p=8、k=5に限定されず、n、p、kが他の数であってもよい。
図10に、補正回路の詳細な構成例を示す。この補正回路は、演算回路400、出力数設定レジスター410(第1のレジスター)、補正データレジスター420(第2のレジスター)、セレクター430、一致検出回路440(検出回路)、一致数カウンター450(第1のカウンター)、補正データ生成回路460、加算回路470、出力数カウンター480(第2のカウンター)、シーケンサー490(制御回路)を含む。
図11を用いて、マルチプレクス駆動における位置オフセット電圧(広義には、位置オフセット信号)について説明する。位置オフセット電圧は、画素に書き込まれるデータ電圧に生じるオフセット電圧であり、画素グループ中における画素(またはデータ線)の位置(並び順)によって異なるオフセット電圧である。なお、以下では、上述の図4に示す第1の画素グループの画素P1〜P3を例に説明する。但し、本実施形態では、他の画素グループの画素についても同様である。
上記の課題を解決するために、第2の構成例の集積回路装置は、第1〜第nのデータ線駆動回路200−1〜200−n(複数のデータ線駆動回路)、第1〜第nの位置オフセット用加算回路210−1〜210−n(広義には、複数の位置オフセット用補正回路)、第1〜第nの出力選択回路220−1〜220−n(複数の出力選択回路)、位置オフセット用レジスター230、選択回路240、順番設定回路250を含む。
図13を用いて、第2の構成例の動作例を具体的に説明する。図13では、データ線駆動回路200−iにより、1水平走査期間に画素P1i〜P8i(p=8)にデータ電圧が書き込まれる場合を例に説明する。
図14に、データドライバーの詳細な構成例を示す。このデータドライバーは、シフトレジスター22、ラインラッチ24、26、多重化回路80、オフセット調整部84(補正回路)、基準電圧発生回路30(階調電圧発生回路)、DAC32(Digital-to-Analog Converter)、データ線駆動回路34、マルチプレクス駆動制御部82、補正回路300を含む。
図15に、本実施形態の集積回路装置が適用されたプロジェクター(投写型表示装置)の構成例を示す。なお、本実施形態の集積回路装置が適用される電子機器として、他にテレビ受像器、カーナビゲーション、携帯電話端末、携帯情報端末、パーソナルコンピュータ等が想定される。
50 電源回路、60 集積回路装置、80 多重化回路、
82 マルチプレクス駆動制御部、84 オフセット調整部、
200−1〜200−n データ線駆動回路、
220−1〜220−n 出力選択回路、230 位置オフセット用レジスター、
240 選択回路、250 順番設定回路、210−i、位置オフセット用加算回路、
300 補正回路、310 第1のレジスター、320 第2のレジスター、
330 ラッチ回路、700 電子機器、
DMUX1〜DMUXn デマルチプレクサー、P1〜P8 複数の画素、
S1〜Sn データ信号供給線、SEL1〜SEL8 マルチプレクス制御信号、
JS 画素選択信号、OG1〜OGp 位置オフセット用設定値、PD 画像データ、
GD 補正処理後の画像データ、CD1〜CD5 補正データ
Claims (8)
- 画像データの補正処理を行い、補正処理後の画像データを出力する補正回路と、
各データ線駆動回路が、前記補正処理後の画像データを受け、複数のデータ信号供給線のうちの対応するデータ信号供給線に対してマルチプレクスされたデータ信号を供給する第1〜第n(nは自然数)のデータ線駆動回路と、
を含み、
前記第1〜第nのデータ線駆動回路のうちの第i(iは、1以上n以下の自然数)のデータ線駆動回路からの前記マルチプレクスされたデータ信号が、デマルチプレクサーによりデマルチプレクスされ、デマルチプレクス後の複数のデータ信号が、1水平走査期間において、第1〜第nの画素グループのうちの第iの画素グループの複数の画素に供給され、
前記補正回路は、
前記複数の画素である第1〜第p(pは自然数)の画素が前記第1の画素から前記第pの画素の順に、水平走査方向に対応する第1の方向に沿って配置される場合に、前記第1の画素に対応する画像データを補正する処理を行い、前記第1〜第nの画素グループの前記第1の画素に供給されるデータ信号のオフセットの前記水平走査方向での傾きを補正することで、前記第1〜第nの画素グループの前記第1の画素グループの第1の画素に供給されるデータ信号に生じるオフセットと、前記第1〜第nの画素グループの前記第nの画素グループの第1の画素に供給されるデータ信号に生じるオフセットとの差によって決まるオフセット傾きを、前記第1〜第nの画素グループの前記第2の画素に供給されるデータ信号のオフセットの前記水平走査方向での傾きに合わせるように補正する処理を行うことを特徴とする集積回路装置。 - 請求項1において、
前記補正回路は、
前記第1〜第nの画素グループの1または複数の画素グループ毎に各補正データが設定される第1〜第k(kはn以下の自然数)の補正データを求め、前記第1〜第kの補正データの前記各補正データを、対応する前記1または複数の画素グループの前記第1の画素の前記画像データに加算処理することにより前記画像データを補正する処理を行い、
前記第1〜第kの補正データは、前記第1の補正データから前記第kの補正データに向かうに従って単調増加または単調減少することを特徴とする集積回路装置。 - 請求項2において、
前記補正回路は、
前記第1の画素グループに対応する前記第1の補正データが設定される第1のレジスターを有し、
前記第1のレジスターに設定された前記第1の補正データを基点として、前記第1の補正データから前記第kの補正データに向かうに従って単調増加または単調減少する前記第2〜第kの補正データを生成することを特徴とする集積回路装置。 - 請求項3において、
前記補正回路は、
前記第1〜第nの画素グループの画素グループ数であるnが設定される第2のレジスターを有し、
前記第2のレジスターに設定されたnの画素グループを前記1または複数の画素グループ毎に前記各補正データに割り当て、前記第1のレジスターに設定された前記第1の補正データと前記第1の補正データの符号反転データとの間をリニアに単調増加または単調減少する前記第2〜第kの補正データを生成することを特徴とする集積回路装置。 - 請求項1乃至4のいずれかにおいて、
前記デマルチプレクス後の複数のデータ信号において前記第iの画素グループの前記複数の画素の位置に依存して生じるオフセットである位置オフセットに対応する位置オフセット用設定値を記憶する位置オフセット用レジスターと、
前記第iのデータ線駆動回路に対応して設けられ、前記オフセット用設定値に基づいて前記位置オフセットを補正する処理を行う第iの位置オフセット用補正回路と、
を含み、
前記位置オフセット用レジスターは、
前記複数の画素である第1の画素〜第p(pは2以上の整数)の画素のうちの前記第1の画素に対応する第1の位置オフセット用設定値と、前記第1の画素〜前記第pの画素のうちの前記第pの画素に対応する第pの位置オフセット用設定値とを前記位置オフセット用設定値として少なくとも記憶し、
前記第iの位置オフセット用補正回路は、
前記第1の画素〜前記第pの画素に対応する第1の画像データ〜第pの画像データのうちの前記第1の画像データに対して、前記第1の位置オフセット用設定値に基づく位置オフセット補正値を加算する処理と、前記第1の画像データ〜前記第pの画像データのうちの前記第pの画像データに対して、前記第pの位置オフセット用設定値に基づく位置オフセット補正値を加算する処理とを、前記位置オフセットを前記補正する処理として少なくとも行うことを特徴とする集積回路装置。 - 請求項1乃至5のいずれかにおいて、
前記デマルチプレクサーに含まれる複数のデマルチプレクス用スイッチング素子をオン・オフ制御するためのデマルチプレクス用スイッチ信号を生成するスイッチ信号生成回路を有することを特徴とする集積回路装置。 - 請求項1乃至6のいずれかに記載の集積回路装置を含むことを特徴とする電気光学装置。
- 請求項7に記載の電気光学装置を含むことを特徴とする電子機器。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
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JP2009141205A JP5556062B2 (ja) | 2009-06-12 | 2009-06-12 | 集積回路装置、電気光学装置及び電子機器 |
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Application Number | Priority Date | Filing Date | Title |
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JP2009141205A JP5556062B2 (ja) | 2009-06-12 | 2009-06-12 | 集積回路装置、電気光学装置及び電子機器 |
Publications (2)
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ID=43542449
Family Applications (1)
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JP (1) | JP5556062B2 (ja) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP6880594B2 (ja) * | 2016-08-10 | 2021-06-02 | セイコーエプソン株式会社 | 表示ドライバー、電気光学装置及び電子機器 |
Family Cites Families (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3726589B2 (ja) * | 1998-09-28 | 2005-12-14 | セイコーエプソン株式会社 | 電気光学装置の駆動回路及び電気光学装置並びに電気光学装置の駆動方法 |
JP4449320B2 (ja) * | 2003-03-27 | 2010-04-14 | カシオ計算機株式会社 | 信号分配装置及び表示装置 |
JP2009109707A (ja) * | 2007-10-30 | 2009-05-21 | Seiko Epson Corp | 電気光学装置及び電子機器 |
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Publication number | Publication date |
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JP2010286715A (ja) | 2010-12-24 |
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