JP5460618B2 - 光学レシーバのための位相制御回路及び方法 - Google Patents
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Description
AC:交流
ASK:振幅偏移変調
BER:ビット誤り率
CD:波長分散
CDR:クロックデータ再生器
D:遅延
DC:直流
DGD:微分群遅延差
DI:遅延干渉計
DQPSK:差動四相位相偏移変調
DPSK:差動位相偏移変調
FEC:前方誤り訂正
ISI:シンボル間干渉
MLSE:最ゆう系列推定器
MZM:マッハツェンダ変調器
NRZ:非ゼロ復帰
OOK:オンオフ変調
OSNR:光学信号対ノイズ比
PMD:偏光モード分散
RF:無線周波数
RMS:二乗平均
RZ:ゼロ復帰
2 同相バランスドレシーバ
3 破壊的出力ポート
4 建設的出力ポート
5 位相制御信号
6 増幅器
7 受信電気信号
8 クロックデータ再生器
9 位相制御回路
12 直角位相バランスドレシーバ
13 破壊的出力ポート
14 建設的出力ポート
15 位相制御信号
17 受信電気信号
18 クロックデータ再生器
19 位相制御回路
20 受信信号
21 スプリッタ
22 二乗器
23 コンデンサ
24 RFパワー検出器
25 低域通過フィルタ
26 二乗器
27 ディザトーン発生器
28 ミキサ
29 低域通過フィルタ
30 積分器
31 加算器
33 第二入力
41 トランスミッタ
42,43マッハツェンダ変調器(MZM)
44 レーザー源
45 スプリッタ
46 光学π/2−移相器
47 合成器
48 出力信号
51 遅延干渉計(DI)
52 遅延差
53 破壊的出力ポート
54 建設的出力ポート
55,56検出器
57 減算器
Claims (12)
- 光学レシーバのための位相制御回路であって、
受信信号を二乗して二乗信号を生成させるように構成される二乗器;
前記二乗信号に基づいてエラー信号を生成させるように構成されるパワー検出器;
ディザ信号を生成させるように構成されるディザ発生器;
前記ディザ信号と前記エラー信号とをミキシングしてミキシング信号を生成させるように構成されるミキサ;
前記ミキシング信号を積分して積分された信号を生成させるように構成される積分器;及び、
前記ディザ発生器から受信したディザ信号及び前記積分器から受信した積分された信号を加算して、遅延干渉計によって使用されるための位相制御信号を生成させるように構成される加算器
を含む前記回路。 - さらに、前記ミキシング信号をフィルタリングしてフィルタリング信号を生成させ、該フィルタリング信号が前記積分器によって使用されて前記積分された信号を生成させるように構成される低域通過フィルタを含む、請求項1に記載の回路。
- 前記二乗器により生成された前記二乗信号が、クロック成分及び前記遅延干渉計の位相に依存する成分を含み、そして、前記パワー検出器が、前記二乗信号からクロック信号を除去するように構成される低域通過フィルタを含む、請求項1に記載の回路。
- 前記パワー検出器は二乗器を含み;そして、
前記パワー検出器は、直流(DC)のちょうど上から前記位相制御回路が設計される光学データ伝送システムのシンボル周波数より低い上限周波数にわたる帯域幅を有する、請求項1に記載の回路。 - 前記パワー検出器の入力は、前記二乗器の出力とコンデンサにより結合される、請求項1に記載の回路。
- 光学レシーバの位相制御方法であって、
電気信号を二乗器にて受信し;
前記受信電気信号に基づいて二乗信号を生成させ;
前記二乗信号のパワーをパワー検出器で検出して、前記パワー検出器の出力にてエラー信号を取得し;
ディザ信号を生成させ;
前記ディザ信号と前記エラー信号をミキシングしてミキシング信号を生成させ;
前記ミキシング信号を積分して積分された信号を生成させ;そして、
前記ディザ信号と前記積分された信号とを加算して遅延干渉計により使用されるための位相制御信号を生成させる
ことを含む、前記方法。 - さらに、前記ミキシング信号を低域通過フィルタリングして、前記積分された信号を生成させるために使用されるフィルタリングされた信号を生成させることを含む、請求項6に記載の方法。
- 前記二乗器により生成された前記二乗信号が、クロック成分及び前記遅延干渉計の位相に依存する成分を含み、そして、前記方法が、さらに、
前記パワー検出器にて前記二乗信号を低域通過フィルタリングして、前記二乗信号からクロック信号を除去すること
を含む、請求項7記載の方法。 - さらに、前記二乗信号をコンデンサによってフィルタリングしてから、前記二乗信号をパワー検出器へ入力することを含む、請求項6に記載の方法。
- 受信光信号を第一及び第二の等価なパートに分割するように構成されるスプリッタ;
前記第一の信号パートを受信するように構成される同相バランスドレシーバであって、
建設的出力及び破壊的出力を生成させるように構成される第一の遅延干渉計、
前記光信号の二つの連続するシンボル間に位相シフトがなければ前記第一の遅延干渉計の前記建設的出力が最大値になるように前記第一遅延の干渉計内で遅延を生成させるように構成される第一の位相制御回路、
を含む前記同相バランスドレシーバ;並びに
前記第二の信号パートを受信するように構成される直角位相バランスドレシーバであって、
建設的出力及び破壊的出力を生成させるように構成される第二の遅延干渉計、
前記受信光信号の二つの連続するシンボル間に所定量の位相シフトが存在すれば前記第二の遅延干渉計の建設的出力が最大値になるように前記第二の遅延干渉計内で遅延を生成させるように構成される第二の位相制御回路
を含む前記直角位相バランスドレシーバを含む装置において、
前記第一の位相制御回路は、
前記第一の遅延干渉計の前記建設的及び破壊的出力に基づいて第一の電気信号を生成させるように構成される第一及び第二の直列接続の光ダイオード;
受信された前記第一の電気信号を二乗して二乗信号を生成させるように構成される二乗器;
前記二乗信号に基づいてエラー信号を生成させるように構成されるパワー検出器;
ディザ信号を生成させるように構成されるディザ発生器;
前記ディザ信号と前記エラー信号をミキシングしてミキシング信号を生成させるように構成されるミキサ;
前記ミキシング信号を積分して積分された信号を生成させるように構成される積分器;及び、
前記ディザ発生器から受信したディザ信号及び前記積分器から受信した積分された信号を加算して、前記第一の遅延干渉計に向かう第一の位相制御信号を生成させるように構成される加算器
を含む装置。 - 前記第二の位相制御回路は、
前記第二の遅延干渉計の前記建設的及び破壊的出力に基づいて第二の電気信号を生成させるように構成される第一及び第二の直列接続の光ダイオード;
受信された前記第二の電気信号を二乗して二乗信号を生成させるように構成される二乗器;
前記二乗信号に基づいてエラー信号を生成させるように構成されるパワー検出器;
ディザ信号を生成させるように構成されるディザ発生器;
前記ディザ信号と前記エラー信号をミキシングしてミキシング信号を生成させるように構成されるミキサ;
前記ミキシング信号を積分して積分された信号を生成させるように構成される積分器;及び、
前記ディザ発生器から受信したディザ信号及び前記積分器から受信した積分された信号を加算して、前記第二の遅延干渉計に向かう第二の位相制御信号を生成させるように構成される加算器
を含む、請求項10に記載の装置。 - 前記第二の位相制御回路は、前記光信号の二つの連続するシンボル間にπ/2の位相シフトが存在すれば前記第二の遅延干渉計の建設的出力が最大値になるように前記第二の遅延干渉計内で遅延を生成させるように構成される、請求項10に記載の装置。
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